VISION AT697 EVB User's Manual

8 VISION AT697 EVB User's Manual
4.4 PLL, SKEW配置
CPU内部时钟,可以使用bypass或PLL SKEW可以调整, 线路如下:
缺省设定是全off
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4.5 其他
还有一些CPU的管脚培植如下:
CPU 配置
9
nBRDY一直是下拉的 如果使用PLL,并且PLL lock后, D5就会亮
EDAC配置
4.4
PLL, SKEW配置
4.5
其他
第5章 Power
第6章 Clock
第7章 Buffer
第8章 SDRAM
第9章 RS232
第10章 LED
第11章 Key
第12章 CPCI
第13章 DSU
第14章 扩展接口
第15章 CPLD
© 2009 上海创景计算机系统有限公司 Nhomakorabea目录
I
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• 四个IO用于按键，可接到Interrupt
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功能介绍
3
• CPCI接口，CPCI 工作于33Mhz, 32Bits。支持Host, Satellite • 可外接CPU Clock, PCI Clock • 丰富的外接扩展接口，可通过CPCI P4, P5，也可通过SAMTEK QSH-QTH接
这SEL8_40Bits在CPLD中进行了译码:
//config 8 / 40 bits operation
always @(posedge clk)
begin
if(nRESET == 1'b0)
//when reseting
begin
if(SEL8_40Bits)
//it is 32/40 bits
上海创景计算机系统有限公司 地址：上海市浦东新区(中邦商务园）王桥路1018-D室 电话：+86 21 58380789 传真：+86 21 58380790 网址： 此用户手册详细描述了上海创景AT697各部分的功能
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2 VISION AT697 EVB User's Manual
在板上, 有众多的黑色的地信号连接点,可供外接设备使用: J3,J4,J5,J6, J7,J8.有众多的红色电源连接点, 可供外接设备测量使用
来源
电压测量 和正常工作时 电流测量时设定和测量
设定和测量点
点
12V J1
J2
CPU 3.3V
LM3676S-3.3
JP1,JP2 Close J37 JP5,JP6 Open
II VISION AT697 EVB User's Manual
第16章 FLASH条
27
第17章 可选配件: SRAM 条
28
第18章 可选配件: 网口条
29
第19章 可选配件: CAN 总线条
30
第20章 附件
31
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第1章 前言
前言
1
欢迎使用 上海创景AT697 评估板工具，如有任何问题请与上海创景计算 机系统有限公司联系。
功能:
• AT697 CPU，工作频率是100MHZ
• CPCI 6U尺寸
• 支持8位, 32位和40位 (EDAC 打开)工作方式
• Flash PROM可换模块：用户可以更换自己的Flash PROM条。可用创景公 司 Vision Debugger for LEON仿真器软硬件进行Flash PROM烧入, 包括 了EDAC的烧入
JP11~JP14 Open
J11 ~ J14
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VCC PLL
LP3962ES-1.8 JP9, JP10 Close J13 (default)
JP9, JP10 Open
J11 ~ J13
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第6章 Clock
Clock 13
创景公司AT697 EVB评估板的CPU 输入Clock是25MHZ, PCI 输入Clock是 33MHZ
通过SMB 插头, 可以输入外接时钟
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14 VISION AT697 EVB User's Manual
并且, 有黄色测量点
用户可以把CPU clock, 换成DIP 封装的, 这时候, 需要把板上25MHZ的 clock 断开: 只要把 R107 拿掉,把 R142焊上就可以了.
送到CPCI上的33Mhz clock,是通过CY2305驱动的.
Clock的SKEW0,1和 PLL, 通过S8调整:
信号
信号电平
S8 设定
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4.2 PROM 总线宽度选择
创景公司AT697 EVB评估板可以使用8位或32位ROM总线, 所以,就需要在CPU 启动时候,做8/32位的选择
在板上,拨码开关S10-1可以选择总线宽度, 线路如下:
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第9章 RS232
o
40位模式：16Mbyte (32 bits) + 4Mbyte (EDAC)
o
8 位模式：8Mbyte
• SDRAM: SDRAM采用标准的SO-DIMM144笔记本内存条
40位模式：128Mbyte (32bits) + 32Mbyte (EDAC)
• 二个UART
• 八个IO用于LED显示，以及其他LED用于显示状态
HelpAndManual_unregistered_evaluation_copy
VISION AT697 EVB
User's Manual
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目录
第1章 前言
第2章 功能介绍
第3章 外型尺寸
第4章 CPU 配置
4.1
RESET
4.2
PROM 总线宽度选择
4.3
第3章 外型尺寸
创景公司AT697 EVB评估板是6U尺寸,各个外部接口如下图:
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第4章 CPU 配置
CPU 配置
5
4.1
CPU 的配置如下：
RESET
复位电路，使用的是IMP811复位芯片, 线路如下:
其中,J29可以接到上海创景Leon 仿真器的RESET 脚上
JP3,JP4 Open J9 ~ J10 JP7,JP8 Open
(default)
PCI
JP3,JP4 Open J10 JP3,JP4 Open J12 ~
JP7,JP8 Close
JP7,JP8 Open J10
CPU 1.8V
LP3962ES-1.8 JP11~JP14 Close J14 (default)
第2章 功能介绍
创景公司AT697 EVB评估板是专门用于宇航级芯片AT697硬件、软件开发的 开发平台，软件、硬件工程师可借助此平台熟悉并了解AT697系列硬件、软件的 开发，在最短时间内搭建AT697原型系统，从而达到快速开发基于AT697处理器 的嵌入式系统。
创景公司AT697 EVB评估板带有AT697处理器， Flash PROM， SRAM， SDRAM， CPCI，以太网口，CAN总线, RS232，LED，按钮及扩展连接头可非常灵 活地用于产品评估与演示。
SRAM条：这SRAM 可以切换到SRAM 或ROM空间, 40位模式： 4Mbyte (32 位) + 1Mbyte (EDAC)
外扩的网口：通过DM9000外扩 外扩CAN 总线： 通过SJA1000外扩，上面有二路CAN
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4 VISION AT697 EVB User's Manual
assign ROM_8BitsCS = SEL8_40Bits ? 1'b1 : nROMCS0 ;
从上面的逻辑可以看出, 当S10-1是off时候, 选择了32/40位方式。当on
时，是8位方式。
复位完后,这PIO0， PIO1还是可以当普通IO用.
4.3 EDAC配置
创景公司AT697 EVB评估板可以使用EDAC 或不用EDAC。 S10-2就是用来选 择这方面功能的.
头 • 采用专用复/位芯片,总线驱动，Clock驱动。使得可靠性得到提高 • 板上CPLD，大量资源可以使用 • DSU调试可达到1MBps • 电压和电流测量点 • 12V外接电源，可使用CPCI电源 • 选配件: 创景公司AT697 EVB评估板上,有三条一样接口的外扩接口,除了一条已经插 了FLASH PROM可换模块外,其他二条还可以插别的扩展条. 上海创景已经做好了 以下几种:
SKEW0
=0
1 off (Default)
=1
1 on
SKEW1
=0
2 off (Default)
=1
2 on
BYPASS
= 0 (PLL)
3 off (Default)
= 1 (Bypass)
3 on
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第7章 Buffer
Buffer 15
考虑到CPU的Address bus 还有一些读些信号, 需要驱动众多的芯片, 所以 创景公司AT697 EVB评估板对以下信号做了驱动 (通过74LVTH162245)
第8章 SDRAM
创景公司AT697 EVB评估板使用笔记本电脑通用的SDRAM (SO-DIMM 144) SO-DIMM 144使用的是3M 的 390112 SDRAM 内寸条, 是256Mbyte. 其中的一半, 128M byte用为32位, 另外一半 的 32M byte, 用为EDAC.
PIO[1:0] <= 2'b10 ;
else
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CPU 配置
7
PIO[1:0] <= 2'b00 ;
//it is 8 bits
end
else
state
PIO[1:0] <= 2'bzz ;
//after reset, three
end
assign ROM_40BitsCS = SEL8_40Bits ? nROMCS0 : 1'b1 ;
PIO[2] <= 1'b0 ; //EDAC disable
end
else
PIO[2] <= 1'bz ;
//after reset, three state
end
所以，当S10-2是off时候, EDAC是enable的, 当on时候, EDAC是disable
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JP1,JP2 open J9 ~ J37 JP5,JP6 Open
(default)
PCI
JP1,JP2 Open J37 JP1,JP2 Open J12 ~
JP5,JP6 Close
JP5,JP6 Opeb J37
板上 3.3V
LM3676S-3.3
JP3,JP4 Close J10 JP7,JP8 Open
• Address Bus 0~27 • nOE • READ • nWRITE • nIOS • nROMCS 0~1 • nRAMS 0~4 • nRAMOE 0~4 • nRWE 0~3
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Clock
来源
CPU Clock
板上
PCI Clock
J20 板上
J19
跳线. JP21 2,3 Close (Default) JP21 1,2 Close JP20 2,3,Close (Default) JP20 1,2 Close
测量点 J16
J15
J41 (黄色) 可以量 CPU 的 ClkDiv4 信号.
J18为CPU的JTAG信号
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第5章 Power
Power 11
创景公司AT697 EVB评估板电源输入是12V DC, 在板上产生3.3V 和 1.8V, 使用LM2676S-3.3芯片产生3.3V电源,使用LP3962EA-1.8芯片产生1.8V电源
在CPLD中,进行了译码，逻辑如下:
//config EDAC enable/disable
always @(posedge clk)
begin
if(nRESET == 1'b0)
//when reseting
begin
if(EnEDAC)
//EDAC enable
PIO[2] <= 1'b1 ;
else