半导体制造技术第十章PPT

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目录
• 半导体简介 • 半导体材料 • 半导体器件 • 半导体制造工艺 • 半导体技术发展趋势 • 案例分析
半导体简介
01
半导体的定义
总结词
半导体的定义
详细描述
半导体是指在常温下导电性能介于导体与绝缘体之间的材料,常见的半导体材 料有硅、锗等。
半导体的特性
总结词
化合物半导体具有宽的禁带宽度和高 的电子迁移率等特点,使得化合物半 导体在光电子器件和高速电子器件等 领域具有广泛的应用。
掺杂半导体
掺杂半导体是在纯净的半导体中掺入其他元素,改变其导电 性能的半导体。
掺杂半导体的导电性能可以通过掺入不同类型和浓度的杂质 来调控,从而实现电子和空穴的平衡,是制造晶体管、集成 电路等电子器件的重要材料。
掺杂的目的是形成PN结、调控载流 子浓度等,从而影响器件的电学性能。
掺杂和退火的均匀性和控制精度对器 件性能至关重要,直接影响最终产品 的质量和可靠性。
半导体技术发展趋势
05
新型半导体材料
硅基半导体材料
宽禁带半导体材料
作为传统的半导体材料,硅基半导体 在集成电路、微电子等领域应用广泛。 随着技术的不断发展,硅基半导体的 性能也在不断提升。
半导体制造工艺
04
晶圆制备
晶圆制备是半导体制造的第一步,其目的是获得具有特定晶体结构和纯度的单晶硅 片。
制备过程包括多晶硅的提纯、熔炼、长晶、切磨、抛光等步骤,最终得到可用于后 续工艺的晶圆。
晶圆的质量和表面光洁度对后续工艺的成败至关重要,因此制备过程中需严格控制 工艺参数和材料质量。
薄膜沉积
输入 标题
详细描述
集成电路的制作过程涉及微电子技术,通过一系列的 工艺步骤,将晶体管、电阻、电容等电子元件集成在 一块硅片上,形成复杂的电路。

半导体基本知识(PPT课件)

半导体基本知识(PPT课件)

例开关电路如图所示.输入信号U1是幅值为5V频率为 1KHZ的脉冲电压信号.已知 β=125,三极管饱和时 UBE=0.7V,UCES=0.25V.试分析电路的工作状态和输出电压 的波形
三极管的三种接法
• 共射极电路: • 共基极电路: • 共集极电路(射极跟随器)
MOS场效应管
• 压控电流源器件 • 分类:
• 难点:
– 1、载流子运动规律与器件外部特性的关系。 只须了解,不必深究
半导体基本知识
• 半导体:
– 定义:导电性能介于导体和绝缘之间的物质 – 材料:常见硅、锗 – 硅、锗晶体的每个原子均是靠共价键紧密
结合在一起。
本征半导体
• 本征半导体:纯净的半导体。0K时,价电子
不能挣脱共价键而参与导电,因此不导电。随 T上升晶体中少数的价电子获得能量。挣脱共 价键束缚,成为自由电子,原来共价键处留下 空位称为空穴。空穴与自由电子统称载流子。 • 自由电子:负电荷 • 空穴:正电荷 • 不导电– 增强源自、耗尽型 – PMOS管、NMOS管
• 特性曲线
– 转移特性曲线 – 输出特性曲线
MOS场效应管的主要参数
• 直流参数:
– 开启电压 UTN,UTP – 输入电阻 rgs
• 交流参数:
– 跨导gm – 导通电阻Rds – 极间电容
例NMOS管构成反相器如图示,其主要参数为UTN=2.0V, gM=1.3MA/V,rDS(ON)=875,电源电压UC=12V。输入脉 冲电压源辐值为5V,频率为1KHZ。试分析电路的工作状 态及输出电压UO的波形。
限幅电路如图示:假设输入UI为一周期性矩形 脉冲,低电压UIL=-5V,高电压UIH=5V。
• 当输入UI为-5V时,二极管D截止, • 视为“开路”,输出UO=0V。 • 当输入UI为+5V时,二极管D导通, • 由于其等效电阻RD相对于负载电 • 阻R的值小得多,故UI基本落在R上, • 即UO=UI=+5V。

半导体制造工艺流程(PPT97页)

半导体制造工艺流程(PPT97页)
半导体制造工艺流程
半导体相关知识
• 本征材料:纯硅 9-10个9
250000Ω.cm
• N型硅: 掺入V族元素--磷P、砷As、锑
Sb
• P型硅: 掺入 III族元素—镓Ga、硼B
• PN结:
P
-
-
++ + ++
N
半 导体元件制造过程可分为
• 前段(Front End)制程 晶圆处理制程(Wafer Fabrication;简称 Wafer Fab)、 晶圆针测制程(Wafer Probe);
衬底制备 一次氧化 隐埋层光刻 隐埋层扩散
外延淀积
基区光刻
再氧化
隔离扩散
隔离光刻
基区扩散 再分布及氧化 发射区光刻 背面掺金
热氧化 发射区扩散
铝合金
反刻铝
铝淀积
接触孔光刻 再分布及氧化
淀积钝化层 压焊块光刻
中测
横向晶体管刨面图
B
C E
P+
P N
P
P+
P
PNP
纵向晶体管刨面图
CBE P
N
NPN
N+ C
低的静态功耗、宽的电源电压范围、宽的输出电压幅 度(无阈值损失),具有高速度、高密度潜力;可与 TTL电路兼容。电流驱动能力低
半导体制造环境要求
• 主要污染源:微尘颗粒、中金属离子、有 机物残留物和钠离子等轻金属例子。
• 超净间:洁净等级主要由 微尘颗粒数/m3
0.1um I级 35 10 级 350 100级 NA 1000级 NA
SiO2
P+ N-epi P+ N-epi P+

Michael quirk_半导体制造技术-第十章_氧化

Michael quirk_半导体制造技术-第十章_氧化
Semiconductor Manufacturing Technology
Michael Quirk & Julian Serda © October 2001 by Prentice Hall
Chapter 10
Oxidation
Semiconductor Manufacturing Technology
by Michael Quirk and Julian Serda
Table 10.1A
© 2001 by Prentice Hall
Table 10.1 Oxide Applications: Field Oxide
Purpose: Serves as an isolation barrier between individual transistors to isolate them from each other.
Gate oxide Source
Gate Drain Transistor site p+ Silicon substrate
Comments: Growth rate at room temperature is 15 Å per hour up to about 40 Å. Common gate oxide film thickness range from about 30 Å to 500 Å. Dry oxidation is the preferred method.
Semiconductor Manufacturing Technology
by Michael Quirk and Julian Serda
Table 10.1D
© 2001 by Prentice Hall

半导体制造技术ppt

半导体制造技术ppt

半导体制造的环保与安全
05
采用低能耗的设备、优化生产工艺和强化能源管理,以降低能源消耗。
节能设计
利用废水回收系统,回收利用生产过程中产生的废水,减少用水量。
废水回收
采用低排放的设备、实施废气处理技术,以减少废气排放。
废气减排
半导体制造过程中的环保措施
严格执行国家和地方的安全法规
安全培训
安全检查
半导体制造过程的安全规范
将废弃物按照不同的类别进行收集和处理,以便于回收利用。
废弃物处理和回收利用
分类收集和处理
利用回收技术将废弃物进行处理,以回收利用资源。
回收利用
按照国家和地方的规定,将无法回收利用的废弃物进行合法处理,以减少对环境的污染。
废弃物的合法处理
未来半导体制造技术的前景展望
06
新材料
随着人工智能技术的发展,越来越多的半导体制造设备具备了智能化控制和自主学习的能力。
半导体制造设备的最新发展
更高效的生产线
为了提高生产效率和降低成本,各半导体制造厂家正在致力于改进生产线,提高设备的联动性和生产能力。
更先进的材料和工艺
随着科学技术的发展,越来越多的先进材料和工艺被应用于半导体制造中,如石墨烯、碳纳米管等材料以及更为精细的制程工艺。
薄膜沉积
在晶圆表面沉积所需材料,如半导体、绝缘体或导体等。
封装测试
将芯片封装并测试其性能,以确保其满足要求。
半导体制造的基本步骤
原材料准备
晶圆制备
薄膜沉积
刻蚀工艺
离子注入
封装测试
各步骤中的主要技术
制造工艺的优化
通过对制造工艺参数进行调整和完善,提高产品的质量和产量。
制造工艺的改进

半导体制造工艺课件(PPT 98页)

半导体制造工艺课件(PPT 98页)
激活杂质:使不在晶格位置上的离子运动到晶格 位置,以便具有电活性,产生自由载流子,起到 杂质的作用
消除损伤
退火方式:
炉退火
快速退火:脉冲激光法、扫描电子束、连续波激 光、非相干宽带频光源(如卤光灯、电弧灯、石墨 加热器、红外设备等)
氧化工艺
氧化:制备SiO2层 SiO2的性质及其作用 SiO2是一种十分理想的电绝缘材料,
去掉氮化硅层
P阱离子注入,注硼
推阱
去掉N阱区的氧化层 退火驱入
形成场隔离区
生长一层薄氧化层 淀积一层氮化硅
光刻场隔离区,非隔离区被 光刻胶保护起来
反应离子刻蚀氮化硅 场区离子注入 热生长厚的场氧化层 去掉氮化硅层
形成多晶硅栅
生长栅氧化层 淀积多晶硅 光刻多晶硅栅 刻蚀多晶硅栅
掺杂的均匀性好 温度低:小于600℃ 可以精确控制杂质分布 可以注入各种各样的元素 横向扩展比扩散要小得多。 可以对化合物半导体进行掺杂
离子注入系统的原理示意图
离子注入到无定形靶中的高斯分布情况
退火
退火:也叫热处理,集成电路工艺中所有的 在氮气等不活泼气氛中进行的热处理过程都 可以称为退火
Salicide工艺
淀积多晶硅、刻蚀 并形成侧壁氧化层;
淀积Ti或Co等难熔 金属
RTP并选择腐蚀侧 壁氧化层上的金属;
最后形成Salicide 结构
形成硅化物
淀积氧化层 反应离子刻蚀氧化层,形成侧壁氧化层 淀积难熔金属Ti或Co等 低温退火,形成C-47相的TiSi2或CoSi 去掉氧化层上的没有发生化学反应的Ti或Co 高温退火,形成低阻稳定的TiSi2或CoSi2
氧化层刻蚀掉,并去掉光刻胶 进行大剂量As+注入并退火,形成n+埋层

《半导体制造技术导论》读书笔记PPT模板思维导图下载

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3.8 参考文献
3.7 小结
3.9 习题
第4章 晶圆制造
01
4.1 简介
02
4.2 为什 么使用硅 材料
03
4.3 晶体 结构与缺 陷
04
4.4 晶圆 生产技术
06
4.6 衬底 工程
05
4.5 外延 硅生长技 术
4.8 参考文献
4.7 小结
4.9 习题
第5章 加热工艺
01
5.1 简介
02
6.4 光刻技术的 发展趋势
6.5 安全性 6.6 小结
6.7 参考文献 6.8 习题
第7章 等离子体工艺
01
7.1 简介
02
7.2 等离 子体基本 概念
03
7.3 等离 子体中的 碰撞
04
7.4 等离 子体参数
06
7.6 直流 偏压
05
7.5 离子 轰击
7.7 等离子体工 艺优点
7.8 等离子体增 强化学气相沉积
10.9 工艺发展趋 势与故障排除
10.10 化学气相 沉积工艺发展趋 势
10.12 参考文献
10.11 小结
10.13 习题
第11章 金属化工艺
01
11.1 简 介
02
11.2 导 电薄膜
03
11.3 金 属薄膜特 性
04
11.4 金 属化学气 相沉积
06
11.6 铜 金属化工 艺
05
11.5 物 理气相沉 积
5.2 加热 工艺的硬 件设备
03
5.3 氧化 工艺
04
5.4 扩散 工艺
06
5.6 高温 化学气相 沉积
05

半导体制造流程PPT课件

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2019/9/10
3
晶圆处理制程
融化(MeltDown)
颈部成长(Neck Growth)
晶柱成长制程
晶冠成长(Crown Growth)
晶体成长(Body Growth)
尾部成长(Tail Growth)
2019/9/10
4
晶圆处理制程
切片 (Slicing)
圆边 (Edge Polishin
2019/9/10
16
晶圆处理制程
• 离子注入是另一种掺杂技术,离子注入掺杂也分为两 个步骤:离子注入和退火再分布。离子注入是通过高 能离子束轰击硅片表面,在掺杂窗口处,杂质离子被 注入硅本体,在其他部位,杂质离子被硅表面的保护 层屏蔽,完成选择掺杂的过程。进入硅中的杂质离子 在一定的位置形成一定的分布。通常,离子注入的深 度(平均射程)较浅且浓度较大,必须重新使它们再分 布。掺杂深度由注入杂质离子的能量和质量决定,掺 杂浓度由注入杂质离子的数目(剂量)决定。
• 一个现代的IC含有百万个以上的独立组件,而其尺寸通 常在数微米,在此种尺寸上,并无一合适的机械加工机 器可以使用,取而代之的是微电子中使用紫外光的图案 转换(Patterning),这个过程是使用光学的图案以及光感 应膜來将图案转上基板,此种过程称为光刻微影 (photolithography)
2019/9/10
11
晶圆处理制程
曝光(exposure) • 在光刻微影过程,首先为光阻涂布,先将适量光阻滴上基
板中心,而基板是置于光阻涂 布机 的真空吸盘上,转盘 以每分钟數千转之转速,旋转30-60秒,使光阻均匀涂布 在 基板上,转速与旋转时间,依所需光阻厚度而定。 • 曝照于紫外光中,会使得光阻的溶解率改变。紫外光通过 光罩照射于光阻上,而在光照及阴影处产生相对应的图形 ,而受光照射的地方,光阻的溶解率产生变化,称之 为光 化学反应, 而阴影处的率没有变化,这整个过称之为曝光 (exposure)。

《半导体制造工艺》PPT课件

《半导体制造工艺》PPT课件
半导体制造工艺流程
半导体相关知识
• 本征材料:纯硅 9-10个9 250000Ω.cm
• N型硅: 掺入V族元素--磷P、砷As、锑Sb • P型硅: 掺入 III族元素—镓Ga、硼B • PN结:
P
--
--
+++++
N
半 导体元件制造过程可分为
• 前段(Front End)制程 晶圆处理制程(Wafer Fabrication;简称 Wa fer Fab)、 晶圆针测制程(Wafer Probe);
0.1um 35 350 NA NA
0.2um 0.3um 0.5
7.5
3
75
30
750
300
NA
NA
10
半 导体元件制造过程
前段(Front End)制程---前工序
晶圆处理制程(Wafer Fabrication;简称 Wafer Fab)
典型的PN结隔离的掺金TTL电路工艺 流程
衬底制备 一次氧化 隐埋层光刻 隐埋层扩散
多晶硅」。一般晶圆制造厂,将多晶硅融解
后,再利用硅晶种慢慢拉出单晶硅晶棒。一支
85公分长,重76.6公斤的 8寸 硅晶棒,约需
2天半时间长成。经研磨、抛光、切片后,即
成半导体之原料 晶圆片
第一次光刻—N+埋层扩散孔
• 1。减小集电极串联电阻 • 2。减小寄生PNP管的影响
要求: 1。 杂质固浓度大
半导体制造工艺分类
• 一 双极型IC的基本制造工艺: • A 在元器件间要做电隔离区(PN结隔离、全介质隔离及PN结介质混合隔离)
ECL(不掺金) (非饱和型) 、TTL/DTL (饱和型) 、STTL (饱和型) B 在元器件间自然隔离

半导体制造工艺技术(PPT 68页)

半导体制造工艺技术(PPT 68页)
本章将讨论薄膜淀积的原理、过程和所 需的设备,重点讨论SiO2和Si3N4等绝缘材料薄 膜以及多晶硅的淀积。金属和金属化合物薄膜 的淀积将在第13章中介绍。
半导体制造技术 by Michael Quirk and Julian Serda
电信学院微电子教研室
目标
通过本章的学习,将能够:
1. 描述出多层金属化。叙述并解释薄膜生长的三个阶段。 2. 提供对不同薄膜淀积技术的慨况。 3. 列举并描述化学气相淀积(CVD)反应的8个基本步骤,包
Figure 11.10
电信学院微电子教研室
CVD 反应中的压力
如果CVD发生在低压下,反应气体通过边 界层达到表面的扩散作用会显著增加。这会增 加反应物到衬底的输运。在CVD反应中低压的 作用就是使反应物更快地到达衬底表面。在这 种情况下,速度限制将受约于表面反应,即在 较低压下CVD工艺是反应速度限制的。
半导体制造技术 by Michael Quirk and Julian Serda
电信学院微电子教研室
MSI时代nMOS晶体管的各层膜
顶层
垫氧化层
Poly
n+
金属前氧化层 侧墙氧化层
栅氧化层
ILD 场氧化层
n+
p- epi layer
氮化硅
氧化硅
氧化硅 多晶
p+
金属
金属
p+
n-well
p+ silicon substrate
Photo 11.3
电信学院微电子教研室
CVD 化学过程
• 高温分解: 通常在无氧的条件下,通过加热化 合物分解(化学键断裂);
2. 光分解: 利用辐射使化合物的化学键断裂分解; 3. 还原反应: 反应物分子和氢发生的反应; 4. 氧化反应: 反应物原子或分子和氧发生的反应; • 氧化还原反应: 反应3与4地组合,反应后形成两

半导体制造工艺培训教材PPT(共 57张)

半导体制造工艺培训教材PPT(共 57张)
每次煮10min,然后用去离子水煮沸,一直 到中性,烘干;
在真空中加温,时间为1~2h,以去除石墨 中的杂质;
常州信息职业技术学院
蒸铝过程
学习情景三
打开机械泵放气阀门。打开电源开关和机 械泵开关及真空室放气阀门,开启钟罩;
将处理好的铝丝挂好,放好硅片,降下钟 罩,关闭真空室放气阀门;
体(粒子靶)进行轰击,使气相等离子体 内具有被溅镀物体的粒子,这些粒子淀积 到硅晶片上形成溅射薄膜;
常州信息职业技术学院
学习情景三
溅射系统示意图
常州信息职业技术学院
热丝蒸发
学习情景三
分类:真空钨丝蒸发和电子束蒸发
真空钨丝蒸发 真空知识 1标准大气压=760mmHg=760Torr
1mmHg=1Torr=133Pa 粗真空:760~10Torr 低真空:10~10-3Torr 中真空:10-3~10-5Torr 高真空:10-5~10-8Torr 超高真空:10-8Torr以上
学习情景三
学习情景三: 薄膜制备
子情景4: 物理气相淀积
常州信息职业技术学院
学习情景三
半导体制造工艺 第2版
• 书名:半导体制造工 艺 第2版
• 书号:978-7-11150757-4
• 作者:张渊 • 出版社:机械工业出
版社
常州信息职业技术学院
物理气相淀积
学习情景三
概念:物理气相淀积,简称PV喷射出 来。系统中的气体分子不断作扩散运动, 一旦与油蒸汽分子相撞,就被油蒸汽分子 带走。因为油蒸汽分子的质量大,并且作 定向运动,所以气体分子就会被油蒸汽分 子带到前方;
常州信息职业技术学院
学习情景三
蒸发设备
真空蒸发设备又叫真空镀膜机;

半导体制程简介59页PPT

半导体制程简介59页PPT
1) Crystal growth technology -N-doped and heat control
2) Anneal technology -elimination of COP
Polished Wafer
Concepts of Wafers
Hi-WAFERTM
Hyper Hi-WAFERTM & AT-WAFER
Epi(p/p+) Wafer
p+
- >10um DZ - COP free surface
COP(typical grown-in defect)
• BMD(Body Micro Defects)
- Grown-in defect free in device active layer
- Controllable intrinsic gettering ability
-COP(Crystal Originated Pits) is one of the typical grown-in defects -grown-in defect can be well detected by LSTD Scanner
Two Ways to Reduce Grown-in Defects
Hi-WAFER: The Registered Trade Mark of Our Hydrogen-annealed Wafer. Hyper Hi-WAFER: The Upgraded Version of Our Hi-WAFER. AT-WAFER: The Brand Name Our Argon-annealed Wafer.
– 精确的控制温度,单晶硅就随着晶种被拉出来 了。

半导体制造技术第十章PPT

半导体制造技术第十章PPT
③可降低SiO2层中的固定电荷和界面态密度,减少二氧化 硅中的缺陷。由于氯中和界面电荷,填补了氧空位。 ④可提高氧化速度,氯起催化剂的作用。 反应:4 HCl O2 2 H 2O 2Cl 2
6C2 HCl3 13O2 8Cl 2 2HCl 2H 2O 12CO2
影响氧化速率的因素
1)硅片清洗
2)垫底氧化 (20 nm)
3)LPCVD氮化硅 (100 nm)
4)隔离区光刻
5)浅沟槽刻蚀 (0.5 mm)
6)热生长氧化硅阻挡层 (20 nm)
7)场区沟道阻断注入
8)CVD 氧化硅充填沟槽
9)CMP平坦化
10)刻蚀氮化硅+退 火致密化CVD氧化硅
现代STI技术(CMOS)
④ SiO2能被强碱熔蚀,也可被H、Al、Si等还原。
反应式: SiO2 2 NaOH Na2 SiO3 H 2O SiO2 Al Al 2O3 Si
不同方法制备的SiO2,其腐蚀速度不同。
氧化膜的应用
• 器件保护和隔离 • 表面钝化(保护) – Screen oxide, pad oxide, barrier oxide • 栅氧电介质 • 掺杂阻挡 • 金属间的介质层
• 压力效应 由于氧化层的生长速率依赖于氧化剂从气 相运动到硅界面的速度,所以生长速率将随着 压力增大而增大。高压强迫氧原子更快地穿越 正在生长的氧化层,这对线性和抛物线速率系 数的增加很重要。这就允许降低温度但仍保持 不变的氧化速率,或者在相同温度下获得更快 的氧化生长。经验表明,每增加一个大气压的 压力,相当于炉体温度降低30℃。这样就可以 用增加压力来降低温度而节省成本,并可以解 决高温工艺带来的负面影响。
氧化工艺
氧化层质量测量
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不同方法制备的SiO2,其密度,折射率,电阻率等不同
化学性质:
① SiO2是最稳定的硅化物;
② SiO2不溶于水; ③ SiO2能耐较强的侵蚀,但极易与HF作用;
反应式: SiO2 4 HF SiF4 2 H 2O SiF4 2 HF H 2 ( SiF6 )
总反应式: SiO2 6 HF H 2 ( SiF6 ) 2 H 2O
ห้องสมุดไป่ตู้
改进的LOCOS工艺
• 回刻的LOCOS工艺
• 侧墙掩蔽的隔离工艺
• 多晶硅缓冲层的LOCOS工艺(PBL)
浅槽隔离(STI)
STL • 不会产生鸟嘴 LOCOS • 工艺相对简单,便宜, 高产率 • 当特征尺寸 < 0.35 um 不再适用
• 更平坦的表面
• 更多的工艺步骤
LOCOS、PBL可用于技术节点0.35-0.5 mm;<0.35 mm必须使用STI
器件保护和隔离
• LOCOS • STI
LOCOS工艺流程
硅片清洗
生长缓冲SiO2层
涂胶
LPCVD淀积Si3N4
LOCOS掩模板
曝光
刻蚀
显影
去胶
隔离注入
刻蚀氮化硅
热氧化
缺点: • 1、鸟嘴侵蚀有源区; • 2、不利于后序工艺中的平坦化; • 3、杂质重新分布。
“鸟嘴”效应:
局部氧化时,O2扩散穿越已生长的氧化物向各个方向上 扩散,纵向扩散的同时也横向扩散,因此,在氮化物掩 膜下有着轻微的侧面氧化生长。由于Si氧化生成SiO2 后 体积膨胀,使掩蔽的Si3N4- SiO2 膜周边受影响而向上翘 起,形成鸟嘴。
• Pad Oxide衬垫氧化层 • Sacrificial Oxide牺牲氧化层 • Barrier Oxide阻挡氧化层
栅氧电介质
• • • • 高电介质强度 高电阻率 膜厚均匀 无杂质
掺杂阻挡
器件制造过程中的掺杂是定域(有选择的区域) 掺杂,那么不需要掺杂的区域就必须进行保护而 不被掺杂。如图所示。
SiO2膜的原子结构如图所示。它是由一个 硅原子被4个氧样原子包围着的四面体单元组成 的。是一种无定型的玻璃状结构,具体地说是 一种近程有序的网状结构,没有长程有序的晶 格周期。
SiO2物理性质与化学性质
物理性质:
①密度:表示SiO2结构的致密程度;密度大,表示致密程度高; 二氧化硅的密度约为2.23g/cm2,硅的密度为 2.33g/cm2,所以, 硅的密度大于二氧化硅的密度。 Si 变成SiO2后体积会膨胀 ②折射率:表示SiO2的光学性质; SiO2的折射率约为1.46。 ③电阻率:表示SiO2的电学性质;SiO2的电阻率约为1016cm。 ④介电强度:表示单位厚度的SiO2薄膜的耐压能力;106~107V/cm ⑤介电常数:表示SiO2的电容性能;SiO2的相对介电常数SiO2为3.9。 ⑥热膨胀系数:表示SiO2受温度变化的形变; SiO2热膨胀系数小, 是Si的1/5;故冷却时易产生微细的裂纹,丧失钝化和掩蔽的作用; ⑦分凝系数:平衡时杂质在硅和二氧化硅界面的分凝系数为一常 数;对于B: m≈0.3; 对于P:m≈10
第十章 氧化
硅表面 SiO2 的简单实现,是硅材料被广泛 应用的一个重要因素。本章中,将介绍 SiO2 的 生长工艺及用途、氧化反应的不同方法,其中 包括快速热氧化工艺。另外,还简单介绍本工 艺中最重要的部分---反应炉,因为它是氧化、 扩散、热处理及化学气相淀积反应的基本设备。
• 工艺中硅曝露需要的热能称为热预算。半 导体工艺的目标之一是尽量降低硅需要的 热能。一般通过降温或减少时间使热预算 最小。
④ SiO2能被强碱熔蚀,也可被H、Al、Si等还原。
反应式: SiO2 2 NaOH Na2 SiO3 H 2O SiO2 Al Al 2O3 Si
不同方法制备的SiO2,其腐蚀速度不同。
氧化膜的应用
• 器件保护和隔离 • 表面钝化(保护) – Screen oxide, pad oxide, barrier oxide • 栅氧电介质 • 掺杂阻挡 • 金属间的介质层
1)硅片清洗
2)垫底氧化 (20 nm)
3)LPCVD氮化硅 (100 nm)
4)隔离区光刻
5)浅沟槽刻蚀 (0.5 mm)
6)热生长氧化硅阻挡层 (20 nm)
7)场区沟道阻断注入
8)CVD 氧化硅充填沟槽
9)CMP平坦化
10)刻蚀氮化硅+退 火致密化CVD氧化硅
现代STI技术(CMOS)
1)减少了沟道阻断 注入
USG(Un-doped Silicate Glass):SiH4+O2+Ar→USG + volatiles
2)HDPCVD—— 退火致密化
3)CMP平坦化
4)回刻氮化硅 和USG
表面钝化
热生长的二氧化硅的一个主要优点是 可以通过束缚硅的悬挂键,从而降低它的 表面态密度,这种效果称为表面钝化,它 能防止电性能退化并减少由潮湿、离子或 其他外部沾污物引起的漏电流的通路。坚 硬的二氧化硅层可以保护硅免受后期制作 中由可能发生的划檫和工艺损伤。
金属层间的介质
名称
自然氧化层 屏蔽氧化层 掺杂阻挡层
应用
不希望的 注入隔离,减小损伤 掺杂掩蔽
厚度
15-20A ~200A 400-1200A
说明
热生长 选择性扩散
场氧化层和LOCOS 器件隔离
衬垫氧化层 牺牲氧化层 栅氧化层 阻挡氧化层
30005000A
湿氧氧化
热生长很薄 热氧化 干氧氧化
为Si3N4提供应力减小 100-200A 去除缺陷 用作MOS管栅介质 防止STI工艺中的污染 <1000A 30-120A 100-200A
热氧化生长
1、干氧
Si(固)+O2(气) SiO2(固)
2、湿氧
Si(固)+2H2O(水汽) SiO2(固) +2H2(气)
干氧和湿氧的比较
• 氧化生长模式 无论是干氧或者湿氧工艺,二氧化硅的生 长都要消耗硅,如图所示。硅消耗的厚度占氧 化总厚度的0.46,这就意味着每生长1µ m的氧化 物,就有 0.46µ m 的硅消耗(干、湿氧化略有差 别)。
氧化物生长速率
一旦在硅表面有二氧化硅生成,它将阻挡 O2 原子与 Si 原子直接接触,所以其后的继续氧化是 O2 原子通过扩散穿过已生成的二氧化硅层,向 Si 一侧运动到达界面进行反应而增厚的。通过一定 的理论分析可知,在初始阶段,氧化层厚度(X)与 时间(t)是线性关系,而后变成抛物线关系。
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