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西安电子科技大学2020 学年上学期《数字逻辑电路》期末考试试题(综合大作业)

西安电子科技大学2020 学年上学期《数字逻辑电路》期末考试试题(综合大作业)

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姓名答案+3225776615学号

西安电子科技大学网络与继续教育学院

2020 学年上学期

《数字逻辑电路》期末考试试题

(综合大作业)

考试说明:

1、大作业试题于2020 年4 月23 日公布,2020 年4 月24 日至2020 年5 月10 日在线上传大作业答卷(一张图片对应一张A4 纸答题纸),要求拍照清晰、上传完整;

2、考试必须独立完成,如发现抄袭、雷同均按零分计;

3、答案须用《西安电子科技大学网络与继续教育学院标准答题纸》手写完成,要求字迹工整、卷面干净。

一、单项选择题(每题 2 分,共 30 分)

1、与(76)H 相等的数是[ ]。

A (76)O

B (116)D

C (76)

D D (1110110)B

2、(100011.1)B 的8421BCD 是[ ]。

A 00110101.0101

B 00111000.1000

C 00111000.0101

D 100011.1000

3、或非门的输出完成F =A , 则多余输入端[ ]。

A 全部接高电平

B 全部接低电平

C 只需一个接地即可

D 只需一个接高电平即可

4、逻辑函F (ABC )=A ⋅B +AC 的最小项标准式为[ ]。

A F(ABC)= ∑(0,1,4,6)

B F(ABC)= ∑(2,3,5,7)

C F(ABC)= ∑(2,6,7)

D F(ABC)= ∑(0,1,4,6)

5、与AB+AC+B ⋅C 相等的表达式为[ ]。

A AC

B AB

C AB+AC

D A+ B ⋅C

6、函数F=(A B +C)(B+ACD )的对偶式函数表达式是[ ]。

数字逻辑设计及应用 本科2 答案

数字逻辑设计及应用 本科2 答案

电子科技大学网络教育考卷(B 卷)

(20 年至20 学年度第 学期)

考试时间 年 月 日(120分钟) 课程 数字逻辑设计及实践(本科) 教师签名_____

一、填空题(每空1分,共20分) 1、请完成如下的进制转换:10110.112= 26.6 8= 22.75 10= 16.C 16; 2、28.510= 11100.1 2= 34.4 8= 1C.8 16= 00101000.0101 8421BCD

3、某带符号的二进制数的反码是1010101,则该数对应的原码是 1101010 ,补码是 1101011 ;

4、A ⊕B= AB /+A /B ;(A ⊕B)/= AB+A /B / ;

5、正逻辑和负逻辑之间的关系是 对偶 ;

6、请问图1-6的逻辑为:Y= A / ;

7、已知某集成门电路输出和输入的高电平的最小值分别为min IH min OH V V 、;输出和输入的低电平最大值分别为:max IL max OL V V 、;请问该门电路高电平的直流噪声容限NH V = min OH min IH V V - ;低电平的直流噪声容限NL V =

m a x IL max OL V V - ;

8、某状态机的状态数为129,请问至少需要 8 位编码才能完成;

9、如果要从多路输入数据中,选出一路作为输出,应采用 数字选择 器来实现; 10、如果要比较两个二进制数的大小,应采用 比较器 器来实现;

11、如果待实现的时序状态机中存在状态循环圈,应采用 计数器 器来实现; 12、同时具备置0、置1、保持和反转的触发器是 JK 触发器;

【电子科技大学】2015下《数字逻辑设计》半期考试-试题及参考答案

【电子科技大学】2015下《数字逻辑设计》半期考试-试题及参考答案

………密………封………线………以………内………答………题………无………效……

电子科技大学2015 - 2016 学年第 一 学期期 中 考试卷

课程名称:数字逻辑设计及应用 考试形式:闭卷 考试日期:2016年11月07日 考试时长:120分钟 课程成绩构成:平时 30/20 %, 期中 30/20 %, 小班讨论 0/20 %, 期末 40 % 本试卷试题由__V___部分构成,共__5___页。

I. Please fill out the correct answers in th e brackets “( )” . ( 3’ X 15 = 45’ )

1. [3321] 5= ( 111001101 )2 = ( 1CD ) 16 .

2. (37.8)10 = ( 0011 1101.1110 ) 2421 BCD .

3. ([-128] 10)’s 16-bit signed-magnitude representation is ( 10000000 10000000 ), and its 8-bit two’s complement representation is ( 10000000 ).

4. Consider the string of bits (101001110)2, it represents ( 334 ) 10 assuming unsigned binary numbers. If it assumes signed numbers, it represents ( -178 ) 10 assuming 2’s complement binary numbers.

2020秋西安电子科技大学《数字逻辑电路》大作业期末试题及答案

2020秋西安电子科技大学《数字逻辑电路》大作业期末试题及答案

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姓名学号

西安电子科技大学网络与继续教育学院

2020 学年下学期

《数字逻辑电路》期末考试试题

(综合大作业)

题号一二三四总分

题分30 10 30 30

得分

考试说明:

1、大作业试题于2020 年10 月15 日公布:

(1)毕业班学生于2020 年10 月15 日至2020 年11 月1 日在线上传大作业答卷;

(2)非毕业班学生于2020 年10 月22 日至2020 年11 月8 日在线上传大作业答卷;

(3)上传时一张图片对应一张A4 纸答题纸,要求拍照清晰、上传完整;

2、考试必须独立完成,如发现抄袭、雷同均按零分计;

3、答案须用《西安电子科技大学网络与继续教育学院标准答题纸》手写

完成,要求字迹工整、卷面干净。

一、单项选择题(每小题2 分,共40 分)

1、下列各数中与十进制数101 不相等的数是( D )。

A.(0100 0011 0100)余3BCD B.(141)8C.(1100101)2D.(66)16

2、八进制数(35)8的8421BCD 是( B )。

A.0011 1000B.0010 1001C.0011 0101D.0010 1100

3、为使与非门输出为1 则输入( A )。

A.只要有0 即可B.必须全为0C.必须全为1D.只要有1 即可

4、函数F AC BC AB与其相等的表达式是( B )。

A.BC B.C+AB C.AC AB D.AB

5、使函数F AB AC BC 等于 0 的输入 ABC 的组合是( C )。 A .ABC=111 B .ABC=110 C .ABC=100 D .ABC=011

电子科技大学“计算机科学与技术”《数字逻辑设计及应用》23秋期末试题库含答案

电子科技大学“计算机科学与技术”《数字逻辑设计及应用》23秋期末试题库含答案

电子科技大学“计算机科学与技术”《数字逻辑设计及应用》23秋期末试题库含

答案

第1卷

一.综合考核(共20题)

1.若A+B=A+C,则一定是B=C。()

A.错误

B.正确

2.CMOS电路的电源电压只能使用+5V。()

A.错误

B.正确

3.电平异步时序逻辑电路不允许两个或两个以上输入信号()

A、同时为0

B、同时为1

C、同时改变

D、同时出现

4.逻辑式A(A+B)(A+B+C)(A+B+C+D)=()

A、A

B、A+B

C、A+B+C

D、A+D

5.若AB+AC=1,则一定是A=1。()

A.错误

B.正确

6.下列哪个不是基本的逻辑关系()。

A、与

B、或

C、非

D、与非

7.逻辑代数的三种基本运算是()

A、与

B、或

C、非

D、相除

8.

9.

10.移位寄存器可以用作数据的串/并变换。()

A、错误

B、正确

11.欲将JK触发器作成翻转触发器,最简单的方法是令J=1,K=1。()

A.错误

B.正确

12.扭环形计数器都是不能自启动的。()

A、错误

B、正确

13.施密特触发器可以用来鉴别脉冲幅度。()

A、错误

B、正确

14.若A+B=A+C,则一定是B=C。()

A、错误

B、正确

15.下列说法中,()不是逻辑函数的表示方法。

A、真值表和逻辑表达式

B、卡诺图和逻辑图

C、波形图和状态图

D、逻辑图

16.电平异步时序逻辑电路中各反馈回路之间的竞争是由于状态编码引起的。() T、对

F、错

17.

18.逻辑代数的三种基本运算是()。

A.与

B.或

C.非

D.相除

19.下列电路中,是时序电路的是()。

A.二进制译码器

B.移位寄存器

C.数值比较器

D.编码器

2020秋西安电子科技大学《数字逻辑电路》大作业期末试题及答案

2020秋西安电子科技大学《数字逻辑电路》大作业期末试题及答案

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姓名学号

西安电子科技大学网络与继续教育学院

2020 学年下学期

《数字逻辑电路》期末考试试题

(综合大作业)

题号一二三四总分

题分30 10 30 30

得分

考试说明:

1、大作业试题于2020 年10 月15 日公布:

(1)毕业班学生于2020 年10 月15 日至2020 年11 月1 日在线上传大作业答卷;

(2)非毕业班学生于2020 年10 月22 日至2020 年11 月8 日在线上传大作业答卷;

(3)上传时一张图片对应一张A4 纸答题纸,要求拍照清晰、上传完整;

2、考试必须独立完成,如发现抄袭、雷同均按零分计;

3、答案须用《西安电子科技大学网络与继续教育学院标准答题纸》手写

完成,要求字迹工整、卷面干净。

一、单项选择题(每小题2 分,共40 分)

1、下列各数中与十进制数101 不相等的数是( D )。

A.(0100 0011 0100)余3BCD B.(141)8C.(1100101)2D.(66)16

2、八进制数(35)8的8421BCD 是( B )。

A.0011 1000B.0010 1001C.0011 0101D.0010 1100

3、为使与非门输出为1 则输入( A )。

A.只要有0 即可B.必须全为0C.必须全为1D.只要有1 即可

4、函数F AC BC AB与其相等的表达式是( B )。

A.BC B.C+AB C.AC AB D.AB

5、使函数F AB AC BC 等于 0 的输入 ABC 的组合是( C )。 A .ABC=111 B .ABC=110 C .ABC=100 D .ABC=011

电子科大数字电路,期末试题101102半期考试试卷-答案

电子科大数字电路,期末试题101102半期考试试卷-答案

电子科技大学二零零九年至二零一零学年第二学期“数字逻辑设计及应用”课程考试题(半期)(120分钟)考试日期2011年4月23日

一二三四五六七八九十总分评卷教师

I. To fill the answers in the “( )” (2’ X 19=38)

1. [1776 ]8 = ( 3FE )16 = ( 1111111110 )2= ( 1000000001 ) Gray .

2. (365)10 = ( 001101100101 )8421BCD=( 001111001011 ) 2421 BCD.

3.Given an 12-bit binary number N. if the integer’s part is 9 bits and the fraction’s part is 3 bits ( N = a8 a7 a6 a5 a4 a3 a2 a1 a0 . a-1 a-2 a-3), then the maximum decimal number it can represent is ( 511.875 ); the smallest non-zero decimal number it can represent is ( 0.125 ).

4. If X’s signed-magnitude representation X SM is(110101)2, then it’s 8-bit two’s complement representation X2’s COMP is( 11101011 ) , and (–X)’s 8-bit complement representation (–X) 2’s COMP is ( 00010101 )2 .

电子科大-计算机学院-数字逻辑实验报告- Verilog组合逻辑设计

电子科大-计算机学院-数字逻辑实验报告- Verilog组合逻辑设计

电子科技大学

实验报告

学生姓名:郫县阿基王学号:2014666666666 指导教师:

唐明

一、实验项目名称:Verilog组合逻辑设计

二、实验目的:

使用ISE软件和Verilog语言进行组合逻辑的设计与实现。

三、实验内容:

1.3-8译码器的设计和实现。

2.4位并行进位加法器的设计和实现。

3.两输入4位多路选择器的设计和实现。

实验要求如下:

1.采用Verilog语言设计,使用门级方式进行描述。

2.编写仿真测试代码。

3.编写约束文件,使输入、输出信号与开发板的引脚对应。

4.下载到FPGA开发板,拨动输入开关,观察Led灯的显示是否符合真值表。

四、实验原理:

1.74x138译码器是输出低有效的3-8译码器。表1所示为74x138译码器的真值表。

1 0 0 0 1 0 1 1 1 1 1 0 1 1 1 0 0 0 1 1 1 1 1 1 0 1 1 1 1 0 0 1 0 0 1 1 1 0 1 1 1 1 1 0 0 1 0 1 1 1 0 1 1 1 1 1 1 0 0 1 1 0 1 0 1 1 1 1 1 1 1

0 0 1 1 1 0 1 1 1 1 1 1 1

根据3-8译码器的真值表,可得输出的函数表达式为

12_2_0_1_2_3_4_5_6_7_G G G A L G B L Y L C B A G Y L C B A G Y L C B A G Y L C B A G Y L C B A G Y L C B A G Y L C B A G Y L C B A G

=⋅⋅=⋅⋅⋅=⋅⋅⋅=⋅⋅⋅=⋅⋅⋅=⋅⋅⋅=⋅⋅⋅=⋅⋅⋅=⋅⋅⋅

电子科技大学考研829 数字 模拟电子本科试卷考研真题

电子科技大学考研829 数字 模拟电子本科试卷考研真题

电子科技大学模拟电路期末(2000-2011)试卷14份+答案每份不同

电子科技大学模电子科技大学模拟电路期末(2000-2011)试卷14份+答案每份不同电子科技大学模拟电路期中(2004-2011)试卷12份+答案每份不同

电子科技大学数字逻辑电路本科试卷(2002年以后)17套(每份不同)

829数字电路与模拟电路2000-2010真题与答案

电子科大模拟电路简答题试题库(100道左右)

电子科技大学考研模拟电路2007-2010 四份

电子科技大学模拟电路吴援明课后习题答案电子科技大学模拟电路PPT 3份

电子科技大学数字逻辑电路PPT 2份

数字逻辑电路课后答案

拟电路期中(2004-2011)试卷12份+答案每份不同

电子科技大学数字逻辑电路本科试卷(2002年以后)17套(每份不同)

829数字电路与模拟电路2000-2010真题与答案

电子科大模拟电路简答题试题库(100道左右)

电子科技大学考研模拟电路2007-2010 四份

电子科技大学模拟电路吴援明课后习题答案电子科技大学模拟电路PPT 3份

电子科技大学数字逻辑电路PPT 2份

数字逻辑电路课后答案

所有资料不重复。

淘宝网:/item.htm?id=9960243831

电子科技大学二零零五至二零零六学年第二学期期中考试

“数字逻辑设计及应用”课程考试题期中卷(120分钟)考试形式:闭卷考试日期2006

年4月22日

课程成绩构成:平时20 分,期中20 分,实验0 分,期末60 分一二三四五六七八九十合计

一、填空题(每空1分,共15分)

1、( 323 )10=( 101000011 ) 2

电子科技大学14秋《数字逻辑基础》在线作业2答案

电子科技大学14秋《数字逻辑基础》在线作业2答案
A. 10
B. 102
C. 210
D. 104
?
正确答案:C
12.以下各电路中,可以产生脉冲定时。
A.多谐振荡器
B.单稳态触发器
C.施密特触发器
D.石英晶体多谐振荡器
?
正确答案:B
13.下列逻辑电路中为时序逻辑电路的是。
A.变量译码器
B.加法器
C.数码寄存器
D.数据选择器
?
正确答案:C
14.下列门电路属于双极型的是()。
?
正确答案:C
9.触发器有两个稳态,存储8位二进制信息要()个触发器。
A. 2
B. 8
C. 16
D. 32
?
正确答案:B
10. MOS集成电路采用的是( )控制,其功率损耗比较小。
A.电压
B.电流
C.灌电流
D.拉电流
?
正确答案:A
11. ROM电路由地址译码器和存储体构成,若译码器有十个地址输入线,则最多可()个字。
A. OC门
B. PMOS
C. NMOS
D. CMOS
?
正确答案:A
15.用异步I/O输出结构的PAL设计逻辑电路,它们相当于()。
A.组合逻辑电路
B.时序逻辑电路
C.存储器
D.数模转换器
?
正确答案:A

电子科大16秋《数字逻辑基础》在线作业1

电子科大16秋《数字逻辑基础》在线作业1

电子科大16秋《数字逻辑基础》在线作业1 电子科技大学电子科大16秋《数字逻辑基础》在线作业1

一、单选题(共 25 道试题,共 100 分。)

1. 十进制数25用8421BCD码表示为()。

A. 10101

B. 00100101

C. 100101

D. 10101

正确答案:

2. 组合型PLA是由()构成。

A. 与门阵列和或门阵列

B. 一个计数器

C. 一个或阵列

D. 一个寄存器

正确答案:

3. 当用专用输出结构的PAL设计时序逻辑电路时,必须还要具备有()。

A. 触发器

B. 晶体管

C. MOS管

D. 电容

正确答案:

4. ROM电路由地址译码器和存储体构成,若译码器有十个地址输入线,则最多可()个字。

A. 10

B. 102

C. 210

D. 104

正确答案:

5. 用四选一数据选择器实现函数Y=A1A0+A1′A0,应使( )

A. D0=D2=0,D1=D3=1

B. D0=D2=1,D1=D3=0

C. D0=D1=0,D2=D3=1

D. D0=D1=1,D2=D3=0

正确答案:

6. 表示任意两位无符号十进制数需要()二进制数。

A. 6

B. 7

C. 8

D. 9

正确答案:

7. 当用异步I/O输出结构的PAL设计逻辑电路时,它们相当于。

A. 组合逻辑电路

B. 时序逻辑电路

C. 存储器

D. 数模转换器

正确答案:

8. 3线—8线译码器74HC138,数据输入端A2A1A0为011时,输出( )

A. BCD代码

B. 三位二进制数

C. 十进制数

D. 二十进制数

正确答案:

9. 标准或-与式是由()构成的逻辑表达式。

电子科大数字电路,期末试题0708-2半期考试

电子科大数字电路,期末试题0708-2半期考试

………密………封………线………以………内………答………题………无………效……

电子科技大学二零零七至二零零八学年第二学期期中考试

“数字逻辑设计及应用”课程考试题 期中卷(120分钟)考试形式:闭卷 考试日期 2008年4月26日

课程成绩构成:平时 20 分, 期中 20 分, 实验 0 分, 期末60 分

1-1.与十进制数 (0. 4375 )10 等值的二进制数表达是 ( A ) A. ( 0.0111 ) 2 B. ( 0.1001 ) 2 C. ( 0.0101 ) 2 D. ( 0.01101 ) 2 1-2. 与十六进制数(FD .A )16等值的八进制数是( A )8

A. ( 375.5 )8

B. ( 375.6 )8

C. ( 275.5 )8

D. ( 365.5)8 1-3.与二进制数(11010011) 2 对应的格雷码表达是 ( C ) Gray

A. ( 11111010 ) Gray

B. (00111010 ) Gray

C. ( 10111010 )Gray

D. (11111011 ) Gray 1-4.下列数字中与(34.42)8 相同 的是( B )

A.(011010.100101)2

B.(1

C.88)16 C.(27.56)10

D.(54.28)5 1-5.已知[A]补=(10010011),下列表达式中正确的是( C )

A. [–A]反=(01101100)

B. [A]反=(10010100)

C. [-A]原=(01101101)

D. [A]原=(00010011)

电子科技大学22春“计算机科学与技术”《数字逻辑设计及应用》作业考核题库高频考点版(参考答案)试题号

电子科技大学22春“计算机科学与技术”《数字逻辑设计及应用》作业考核题库高频考点版(参考答案)试题号

电子科技大学22春“计算机科学与技术”《数字逻辑设计及应用》作业考

核题库高频考点版(参考答案)

一.综合考核(共50题)

1.

74LS160十进制计数器它含有的触发器的个数是()

A、1个

B、2个

C、4个

D、6个

参考答案:C

2.

一个不完全确定原始状态表的各最大相容类之间可能存在相同状态。()

T、对

F、错

参考答案:T

3.

表达式A+A+A和B×B×B的值分别是()

A、0

B、1

C、A

D、B

参考答案:CD

4.

表达式A+A+A和B×B×B的值分别是()。

A.B

B.A

C.1

D.0

参考答案:AB

5.

一个十进制计数器,可以作为十分频器使用。()

A.错误

B.正确

参考答案:B

6.

下列电路中能够把串行数据变成并行数据的电路应该是()

A、JK触发器

B、3/8线译码器

C、移位寄存器

D、十进制计数器

参考答案:C

7.

四变量A,B,C,D构成的最小项是()。

A、A

B、AB

C、ABC

D、ABCD

参考答案:D

8.

一块数据选择器有三个地址输入端,则它的数据输入端应有()个。

A、3

B、6

C、8

D、1

参考答案:C

9.

CMOS电路的电源电压只能使用+5V。()

参考答案:A

10.

下列电路中,是组合电路的是()

A、串行数据检测器

B、数据选择器

C、环形计数器

D、移位寄存器

参考答案:B

11.

下面各个组成部分,对于一个时序逻辑来说,不可缺少的是()

A、mealy型输出

B、输入

C、moore型输出

D、存储单元

参考答案:D

12.

一块八选一的数据选择器,其地址(选择输入)码有()。

A.1位

B.3位

C.4位

D.8位

参考答案:B

13.

幅度为Vm的矩形脉冲的上升沿时间tr是指从()上升到()之间的时间间隔。

西安电子科技大学数字逻辑电路大作业答案

西安电子科技大学数字逻辑电路大作业答案

西安电子科技大学网络教育

考试题(1)

课程名称:_数字电路 考试形式: 开 卷

学习中心:_________ 考试时间: 90分钟

姓 名:_____________ 学 号:

一、单项选择题(本大题共15小题,每小题2分,共30分)

在每小题列出的四个备选项中只有一个是符合题意要求的,请将其选出并将“答题卡”的相应代码涂黑。未涂、错涂或多涂均无分。 1.下列数中最大的数是

A .(1.1)8

B .(1.1)16

C .(1.1)10

D .(1.1)2 2.八进制数(76)8所对应的8421BCD 码是

A .(10010010)8421BCD

B .(01110110)8421BCD

C .(01100010)8421BC

D D .(10000100)8421BCD

3.某逻辑电路输入A 、B 和输出F 的波形如图1.1所示,由此判断该门电路完成的逻

辑功能是

A .与非

B .异或

C .同或

D .或非

4.图1.2所示电路的输出函数F 的表达式为 A .C B B A F += B .C B B A F += C .C B B A F += D .C B B A F += 5.某函数BD C A B A F ++⋅=反函数为

A .)()(D

B

C A B A F +++= B .)()(

D B C A B A F +++= C .)()(D B C A B A F ++++= D .D B C A B A F +++=)( 6.AC C A B A F ++=的最简表达式为

A B F

图1.1

A .

B A B .

西安电子科技大学网教数字逻辑电路模拟题

西安电子科技大学网教数字逻辑电路模拟题

模拟试题一

一、单项选择题(每题2分,共30分)

1 、下列数中最大的数是[ ] 。

A ()H

B ()D

C O

D B

2 、() D 的余 3BCD 是 [ ] 。

A B

C D

3 、与非门的输出完成 F= , 则多余输入端 [ ] 。

A 全部接高电平

B 只需一个接高电平即可

C 全部接地电平

D 只需一个接地即可

4 、逻辑函数 F= + B 的最小项标准式为 [ ] 。

A F=

B F=

C F=

D F=

5 、与 AB + AC +相等的表达式为 [ ] 。

A C

B

C + C

D A +

6 、函数 F=(A + C)(B + ) 的反函数是 [ ] 。

A G=( +B) · +·

B G=A +

C + B ·

C G=(A +) · C + B ·

D G=(A ) · + (B+ )

7 、逻辑函数的逻辑相邻项是 [ ] 。

A A C

B A

C B

D D ABC

8 、已知输入 A 、 B 和输出 F 的波形如图所示,

其 F 与 AB 的逻辑关系为 [ ] 。

A 与非

B 或非

C 异或

D 同或

9 、下列逻辑部件属于时序电路的是 [ ] 。

A 译码器

B 触发器

C 全加器

D 移位寄存器

10 、数据选择器的功能是 [ ] 。

A 将一路输入送至多路输出

B 将输入二进制代码转换为特定信息输出

C 从多路输入选择一路输出

D 考虑低位进位的加法

11 、逻辑函数用卡诺图化简时,八个逻辑相邻项合并可消去 [ ] 。

A 一个变量

B 二个变量

C 三个变量

D 四个变量

12 、 JK 触发器从 0 1, 则激励端 J 、 K 的取值为 [ ] 。

西安电子科技大学2020 学年上学期《数字逻辑电路》期末考试试题(综合大作业)

西安电子科技大学2020 学年上学期《数字逻辑电路》期末考试试题(综合大作业)

学习中心/函授站_

姓名答案+3225776615学号

西安电子科技大学网络与继续教育学院

2020 学年上学期

《数字逻辑电路》期末考试试题

(综合大作业)

考试说明:

1、大作业试题于2020 年4 月23 日公布,2020 年4 月24 日至2020 年5 月10 日在线上传大作业答卷(一张图片对应一张A4 纸答题纸),要求拍照清晰、上传完整;

2、考试必须独立完成,如发现抄袭、雷同均按零分计;

3、答案须用《西安电子科技大学网络与继续教育学院标准答题纸》手写完成,要求字迹工整、卷面干净。

一、单项选择题(每题 2 分,共 30 分)

1、与(76)H 相等的数是[ ]。

A (76)O

B (116)D

C (76)

D D (1110110)B

2、(100011.1)B 的8421BCD 是[ ]。

A 00110101.0101

B 00111000.1000

C 00111000.0101

D 100011.1000

3、或非门的输出完成F =A , 则多余输入端[ ]。

A 全部接高电平

B 全部接低电平

C 只需一个接地即可

D 只需一个接高电平即可

4、逻辑函F (ABC )=A ⋅B +AC 的最小项标准式为[ ]。

A F(ABC)= ∑(0,1,4,6)

B F(ABC)= ∑(2,3,5,7)

C F(ABC)= ∑(2,6,7)

D F(ABC)= ∑(0,1,4,6)

5、与AB+AC+B ⋅C 相等的表达式为[ ]。

A AC

B AB

C AB+AC

D A+ B ⋅C

6、函数F=(A B +C)(B+ACD )的对偶式函数表达式是[ ]。

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西安电子科技大学网教数字逻辑电路模拟

模拟试题一

一、单项选择题(每题 2分,共30分)

1 、下列数中最大的数是 [ ] 。

A ( 3.1 ) H

B ( 3.1 ) D

C (3.1) O

D (11.1) B

2 、( 35.7 ) D 的余 3BCD 是 [ ] 。

A 00110101.0111

B 00111000.1010

C 00111000.0111

D 01101000.1010

3 、与非门的输出完成 F= , 则多余输入端 [ ] 。

A 全部接高电平

B 只需一个接高电平即可

C 全部接地电平

D 只需一个接地即可

4 、逻辑函数 F= + B 的最小项标准式为 [ ] 。

A F=

B F=

C F=

D F=

5 、与 AB + AC +相等的表达式为 [ ] 。

A C

B

C + C

D A +

6 、函数 F=(A + C)(B +) 的反函数是 [ ] 。

A G=( + B) ·+·

B G=A +

C + B ·

C G=(A +) · C + B ·

D G=(A ) ·+ (B+ )

7 、逻辑函数的逻辑相邻项是 [ ] 。

A A C

B A

C B

D D ABC

8 、已知输入 A 、 B 和输出 F 的波形如图所示,

其 F 与 AB 的逻辑关系为 [ ] 。

A 与非

B 或非

C 异或

D 同或

9 、下列逻辑部件属于时序电路的是 [ ] 。

A 译码器

B 触发器

C 全加器

D 移位寄存器

10 、数据选择器的功能是 [ ] 。

A 将一路输入送至多路输出

B 将输入二进制代码转换为特定信息输出

C 从多路输入选择一路输出

D 考虑低位进位的加法

11 、逻辑函数用卡诺图化简时,八个逻辑相邻项合并可消去 [ ] 。

A 一个变量

B 二个变量

C 三个变量

D 四个变量

12 、 JK 触发器从 0 1, 则激励端 J 、 K 的取值为 [ ] 。

A JK=1X

B JK=X0

C JK=X1

D JK=0X

13 、移位寄存器的现态为 0110 ,经过左移一位后,其次态为 [ ] 。

A 0110 或 1011

B 1011 或 1010

C 0110 或 1110

D 1101 或 1100

14 、 4 级触发器组成计数器,组成 13 进制计数器,其无效的状态数为 [ ] 。

A 3 个

B 4 个

C 13 个

D 16 个

15 、 N 级触发器组成环形计数器,其进位模为 [ ] 。

A N

B 2N

C D

二、填空题(每题 2 分,共 10 分)

1. 格雷码的特征是 ________________ 。

2. F= =________________ 。

3. 偶数个 1 相异或,其结果为 ________________ 。

4. 数字电路的输出仅与当前输入有关,而与电路过去状态无关,该电路称为 ________________ 。

5. 100KH Z 输入信号输出频率 20KH Z 为该电路的分频系数为______________ 。

三、化简题(每题 10 分,共 20 分)

1. 将函数 F(ABCD)= , 约束条件 AB+AC=0 ,

2. 作出卡诺图,并在卡诺图上化简 ;

3. 写出最简与或非式 ;

4. 画出逻辑图。

5. 将函数 F(ABC)= BC + BCD + AC+AD+ 化简为最简的与非式。

四、分析题(每题 10 分,共 20 分)

1 、译码器电路如图。

①写出输出 F 的方程

②列出真值表

③说明功能

2.电路如图所示,分别作出(a)(b)图的状态迁移关系并说明其功能

(a) (b)

五、设计题(每题 10分,共20分)

1.用门电路设计二位二进制数的平方电路,输入二进制数B 2 B 1 ,输出四位二进制数F 3 F 2 F 1 F 0

•列出真值表

•写出方程

•画出电路

2、用JK触发器设计一个三进制加法计数器

•作出状态转换表

•求出状态方程,确定激励函数

附 74LS161,74LS194的功能表

74LS161功能表

输入输出

CP Cr LD P T D C B A Q D Q C Q B Q A X 0 X X X X X X X 0 0 0 0

1 0 X X D C B A D C B A

X 1 1 0 X X X X X 维持

1 1 X 0 X X X X 维持(进位位 O C =0 )

X

1 1 1 1 X X X X 计数

74LS194 功能表

输入输出

Cr S 1 S 0 CP S R S L D 0 D 1 D 2 D 3 Q 0 Q 1 Q 2 Q 3 0 X X X X X X X X X 0 0 0 0

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