数字电子线路第四章复习

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《数字电子技术基础》第四章习题答案

第四章集成触发器 4.1R d S d Q Q不定4.2 （1CP=1时如下表)(2) 特性方程Q n+1=D(3)该电路为锁存器（时钟型D 触发器）。

CP=0时，不接收D 的数据；CP=1时，把数据锁存。

(但该电路有空翻)4.3 (1)、C=0时该电路属于组合电路；C=1时是时序电路。

(2)、C=0时Q=A B +; C=1时Q n+1=B Q BQ nn+= (3)、输出Q 的波形如下图。

A B C Q4.4CP D Q 1Q 2图4.54.5 DQ QCPT4.6 Q 1n 1+=1 Q 2n 1+=Q 2n Q n 13+=Q n 3 Q Q 4n 14n+=Q1CP Q2Q3Q44.7 1、CP 作用下的输出Q 1 Q 2和Z 的波形如下图； 2、Z 对CP 三分频。

DQ QCPQ1DQ QQ2ZRd CP Q1Q2Z14.8由Q D J Q KQ J Q KQ n 1n n n n +==+=⋅得D 触发器转换为J-K 触发器的逻辑图如下面的左图；而将J-K 触发器转换为D 触发器的逻辑图如下面的右图CPD Q QJKQ QDQ QJ KCP4.9CP B CA4.10CP X Q1Q2Z4.11 1、555定时器构成多谐振荡器 2、u c, u o 1, u o 2的波形u c u o 1u o 2t t t 1.67V3.33V3、u o 1的频率f 1=1074501316..H z ⨯⨯≈ u o 2的频率f 2=158H z4、如果在555定时器的第5脚接入4V 的电压源，则u o 1的频率变为1113001071501232....H z ⨯⨯+⨯⨯≈4.12 图(a)是由555定时器构成的单稳态触发电路。

1、工作原理（略）；2、暂稳态维持时间t w =1.1RC=10ms(C 改为1μF)；3、u c 和u o 的波形如下图：u ou ct t tu i (ms)(ms)(ms)5 10 25 30 45 503.33V4、若u i 的低电平维持时间为15m s ，要求暂稳态维持时间t w 不变，可加入微分电路4.13由555定时器构成的施密特触发器如图(a)所示 1、电路的电压传输特性曲线如左下图； 2、u o 的波形如右下图；3、为使电路能识别出u i 中的第二个尖峰，应降低555定时器5脚的电压至3V 左右。

数字电子电路课件第四章4.4

0000 0001 0011 0010 0110 0111 0101 0100 1100 1101 1111 1110 1010 1011 1001 1000
B1
C1
& ≥１
&
F
&
结论：同一功能可用不同电路实现
3．例 5－5 (P.259)
B3B2 B1B0 00
00 0
B3B2 01 11 10 B1B0 00
0 0 0 00 0
01 1 1 1 1
01 0
01 11 10 110 110
11 0 0 0 0 11 1 0 0 1
10 1 1 1 1
例 4－1 (P.130) 根据题意列真值表：
（1）与非－与非式
方法： a. 先求出最简与－或式 (圈“1”格) b. 再对此与－或式两次求反，用狭摩根定理去掉一个非号
AB
C 00 01 11 10 00 0 1 0
A
10 1 1 1
B
F=AB+AC+BC
C
F=AB+AC+BC
=AB ·AC ·BC
ABC F
000 0 001 0 010 0 011 1 100 0 101 1 110 1 111 1
&
&
&F
&
（2）或非－或非式方法：
a.先求出最简或－与式 (圈“0”格) b.再对此与－或式两次求反，用狭摩根定理去掉一个非号.
AB C 00 01 11 10
00 0 1 0 10 1 1 1
10 1 0 0 1
G0卡诺图
G1卡诺图
G0=B1B0+B1B0 =B1 B0 G1=B2B1+B2B1 =B2 B1 G2＝B3⊕ B2

数字电子电路课件第四章(4)

十进制数 8421BCD码
6+7=13
0110 + 0111
1101 + 0110 1, 0011
十进制数 8421BCD码
逢16进一
8+9=17
1000 + 1001 1, 0001 + 0110 1, 0111
4位二进制码相加有进位信号CO时，必须加6（0110）进行修正。
精选ppt
8
F＝CO+F3F2F1F0 +F3F2F1F0 +F3F2F1F0 + F3F2F1F0
0 0 1 1 1 1 1精选p1pt 1
Y2 Y1 Y0 YEX YS
1111 1 1111 0 0000 1 0010 1 0100 1 0110 1 1000 1 1010 1 1100 1 1 1 1 0 1 14
0 1 2 3 4 5 6 7 ST
0 1 2 3 4 5 6 7 EN HPRI/BIN 低位片
组合逻辑电路的特点：
1．是多输入多输出的电路。其模拟框图为
x1
x2 x3
组合逻辑电路
z1 z2 z3
xn
zm
…
… …
Z1 = f1（x1，x2，…，xn） Z2 = f2（x1，x2，…，xn）
Zm = fm（x1，精x选2p，pt …，xn）
1
2．输出仅由当前时刻的输入情况决定，而与该时刻以前的输入无关。
被加数加数
8 4
3
CO
2P 10
8 4
3
3 F3 F2
F1
2 Q 0 F0
10
CI
1
8 4
3
CO

电子电路第四章习题及参考答案

习题四4-1 电路如题图4-1所示，i (t )=10mA 、R =10k Ω、L =1mH 。

开关接在a 端为时已久，在t =0时开关由a 端投向b 端，求t ≥0时，u (t )、i R (t )和i L (t )，并绘出波形图。

解：本题是求零输入响应，即在开关处于a 时，主要是电感储能，当开关投向b 后，讨论由电感的储能所引起的响应。

所以对图(a)t ≥0时的电路可列出00≥=+t Ri dtdiL L L及 i L (0)=i (t )=10(mA ) 其解为：0)(1010)(710≥==--t mA e et i t tL τS R L 73310101010--=⨯==τ 则 0)(10010101010))(0()1)(0()(77101033≥-=⨯⨯⨯-=-=-==-----t V e e e LR Li e Li dt di L t u t ttL t L L L τττ 而 0)(10)()(710≥-=-=-t mA e t i t i t L R其波形图见图(b)、图(c)所示。

4-2 电路如题图4-2所示，开关接在a 端为时已久，在t =0时开关投向b 端，求3Ω电阻中的电流。

解：因为 )(623)0(V u c =⨯= （注意：当稳态以后电容为开路，所以流过1Ω和电容串联支路的电流为零，因此电容两端的电压就是并联支路2Ω支路两端的电压）当开关投向b 时电流的初始值为)(236)0()0(A R u i c ===S RC i 3130)(=⨯===∞τ，故根据三要素法得： 0)(2)(31≥=-t A e t i t4-3 电路如题图4-3所示，开关在t <0时一直打开，在t =0时突然闭合。

求u (t )的零输入响应和零状态响应。

解：因为u (t )=u c (t )，所以求出u c (t )即可。

方法一：直接用三要素法：（注意，开关闭合以后，时间常数由两个电阻并联后，再与电容构成RC 电路）L (t ) i (t L(a)10(b) (c) 题图4-1 习题4-1电路及波形图(t )题图4-2 习题4-2电路S C R 23)1//2(0=⨯==τ)(32)2//1(1)()(221)0(V u V u c c =⨯=∞=⨯= 所以)1(322)322(32))()0(()()(5.05.05.0≥-+=-+=∞-+∞=----t ee e eu u u t u tt t tc c c c 零状态响应零输入响应τ方法二：分别求出零输入响应和零状态响应（可以直接解微分方程，也可以直接利用结论）零输入响应：02)(215.05.00'≥=⨯==---t e V e eU u tt tc τ零状态响应：0))(1(32)1(11212)1(5.05.0"≥-=-⨯+⨯=-=---t V e e eRI u t t ts cτ4-4 电路如题图4-4所示，已知 ⎩⎨⎧≥<=010)(t t t u s 且u c (0)=5V 。

数字电路与数字电子专业技术课后答案第四章

第四章逻辑函数及其符号简化1.列出下述问题的真值表，并写出逻辑表达式：(1) 有A 、B 、C 三个输入信号，如果三个输入信号中出现奇数个1时，输出信号F=1，其余情况下，输出 F= 0.(2) 有A 、B 、C 三个输入信号，当三个输入信号不一致时，输出信号F=1，其余情况下，输出为0.(3) 列出输入三变量表决器的真值表•解：(1 )(1) F=AB+ A B1⑵ F= AB+ A C(3) F= (A+B+C) (A+B+ C ) (A+ B +C) (A+ B +C ) 解： (1) AB = 00 或 AB=11 时 F=1(2) ABC110 或 111 或 001,或 011 时 F=1 (3) ABC = 100 或 101 或 110 或 111 时 F=1 3. 用真值表证明下列等式.(1) A+BC = (A+B) (A+C)(2) A BC+A B C+AB C = BC ABC +AC ABC +AB ABC (3) A B + BC + AC =ABC+ A B C ⑷ AB+BC+AC=(A+B)(B+C)(A+C)A B C F0 0 0 00 01 10 10 10 11 0 1 0 0 11 01(2 )1 B 10 0 1 10 10 10 11 11 00 11 0 1 1 (3 )1 1 0 1 A 1B C F0 00 00 01 00 10 00 11 1 1 0 0 01 011F= A B C+ A B C +A B C +ABCF= (A+B+C) ( A + B +C )F= A BC+A B C+AB C +ABC ,F 的值为“ 12.对下列函数指出变量取哪些组值时(5) ABC+ A + B + C=1证：(1 )A B C A+BC(A+B)(A+C)0 0 0 0 00 0 1 0 00 1 0 0 00 1 1 1 11 0 0 1 11 0 1 1 11 1 0 1 1A B C ABC + ABC + ABC —BCABC + ACA B C + ABABC0 0 0 0 00 0 1 0 00 1 0 0 00 1 1 1 11 0 0 0 01 0 1 1 11 1 0 1 11 1 1 0 0(5 )A B C AB+ BC3 AC ABC + A"B"C—0 0 0 1 10 0 1 0 00 1 0 0 00 1 1 0 01 0 0 0 01 0 1 0 01 1 0 0 01 1 1 1 1ABC AB+BC+AC (A+B)(B+C)(A+C)0 0 00 0 10 1 00 1 11 0 01 0 11 1 0 11ABC ABC + A + B + C0 0 0 10 0 1 10 1 0 10 1 1 11 0 0 11 0 1 1(5 )4. 直接写出下列函数的对偶式F'及反演式F的函数表达式(1) F=[A B(C+D)][B C D+B(C +D)](2) F= A BC + ( A +B C ) (A+C)⑶F= AB+ CD + BC + D + CE + D + E(4)F=C+AB?AB+ D解：(1) F'= [ A +B+CD]+[(B+ C+ D)?B+C D]]F = [A+ B + C D ]+[( B +C+D) ?( B +CD ]](2) F'= (A+ B + C)?[A?(B + C)AC]F = (A+ B<C)?[A?(B + C)+ A C]⑶F、=C?(A + B)+(A + B)?DF = C?(A + B) + (A + B)?D5. 若已知x+y = x+z，问y = z吗？为什么？解：y不一定等于z,因为若x=1时,若y=0,z=1,或y=1,z=0,则x+y = x+z = 1,逻辑或的特点，有一个为1则为1。

数字电子技术基础第四章重点最新版

触 CP 上升沿(或下降沿)时刻翻转。
发
这种触发方式称为边沿触发式。
器
EXIT
集成触发器
主从触发器和边沿触发器有何异同？
空翻可导致电路工作失控。
EXIT
集成触发器
4.3 无空翻触发器
主要要求：
了解无空翻触发器的类型，掌握其工作特点。能根据触发器符号识别其逻辑功能和触发方式，并进行波形分析。
EXIT
集成触发器
一、无空翻触发器的类型和工作特点
主
工作特点：CP = 1 期间，主触发器接收
从输入信号；CP = 0 期间，主触发器保持 CP
EXIT
集成触发器
2. 工作原理及逻辑功能 Q 0 触发器被工置作0原1理Q
G1 11
1 SD
输入 RD SD 00 01 10 11
输出 QQ
01
G2
RD 0 功能说明
触发器置 0
EXIT
2. 工作原理及逻辑功能
集成触发器
Q 1 触发器被置 1 0 Q
G1
0 SD
输入 RD SD 00 01 10 11
触发器置 0 触发器置 1 触发器保持原状态不变
EXIT
2. 工作原理及逻辑功能
Q 1
G1
0 SD
输入 RD SD 00 01 10 11
输出
QQ 不定
01 10 不变
集成触发器
Q
输出既非 0 状态，
1 也非 1 状态。当 RD 和 SD 同时由 0 变 1 时，输出状态可能为 0，也
G2 可能为 1，即输出状态不定。因此，这种情况
EXIT
四、一些约定
集成触发器
1态： Qn=1，Qn=0 0态： Qn=0，Qn=1

数字电子技术基础第4章数字电子技术基础课件

S
Q & G2
R
SD,RD
Qn1SRQn
D DQn D
（CP = 1期间有效）
G3 & S
Байду номын сангаас
& G4 R
1
CP
D
简化电路：省掉反相器。把G3的输出送到R端。 G3的输出为S·CP＝S·1＝S＝D＝R
(4-29)
二、主要特点
1、时钟电平控制，无约束问题在CP=1期间，若D=1，则Qn+1=1；若D=0，
EN
内含 4 个基本 RS 触发器
2. 由或非门组成：CC4043(略)
(4-21)
二、TTL 集成基本触发器
74279、74LS279
Q
&
&
S
R
Q
&
&
S1 S2
R
+VCC
RSSRSRSSRS––––––––––11233412341212
1 2 3 5 6 10 11 12 14 15
16
1R
4
CP－控制时序电路工作节奏的固定频率的脉冲信号，一般是矩形波。
具有时钟脉冲CP控制的触发器称为同步触发器，或时钟触发器，触发器状态的改变与时钟脉冲同步。
同步触发器：同步 RS 触发器同步 D 触发器
(4-23)
4.2.1 同步RS触发器
一、电路组成及工作原理 1. 电路及逻辑符号
控制门只有CP=1时， G3、G4导通
&
01
1
11
不变
S1
1R
③R=1、S=1时：根据与非门的逻辑功能不难推知，触发器保持原有状态不变，即原来的状态被触发器存储起来，这体现了触发器具有记忆能力。

数字电子技术基础第四章

&
G3
&
S=0，R=1：Qn+1=0
R
S=1，R=1：Qn+1=1(×)，
CP
S
CP回到0后状态不定输入端R、S通过与非门
作用于基精本品PPRT S触发器。
1R C1 1S R CP S
（三）同步RS触发器
2. 特征(tèzhēng)表
RS
00 01 10 11
Qn+1
Qn 1 0 1(×)
3. 特征方程
CP
电路连接的特点：第一个触发器的CP1端作为计数脉冲CP输入端，Q1与第二个触发器的CP2端相连，依次有Qi与CPi+1相连，触发器的输出Q4Q3Q2Q1代表四位二进制数。
精品PPT
4. 应用(yìngyòng)
二、主从(zhǔcóng)触发器
每一个CP下降沿，都会使Q的状态变化，Q4Q3Q2Q1代表四位二进制数，故称该电路为四位二进制计数器。
1. 逻辑(luójí)符号
输入信号：R、S（高有效）时钟输入：CP 异步置0、置1：RD、SD
（不受CP限制，低有效）输出信号：Q、Q
精品PPT
Q
Q
R 1R C1 1S S RD R CP S SD
2. 组成(zǔ chénɡ)及工作原理
组成：由两个同步RS触发器级联而成。
工作原理：
按照C同P步为高RS电触平发：器主的触功发能器翻输从转出触，A发、从B器触发器时的钟状C态P不直变接，作Q用状于态主保触持。
精品PPT
3. 状态(zhuàngtài)转换图
特征表
D
Qn+1
0
0
1
1

数字电子技术基础(第四版)课后习题答案_第四章

第4章触发器[题4.1]画出图P4.1所示由与非门组成的根本RS触发器输出端Q、Q的电压波形，输入端S、R的电压波形如图中所示。

图P4.1[解]见图A4.1图A4.1[题4.2]画出图P4.2由或非门组成的根本R-S触发器输出端Q、Q的电压波形，输出入端S D，R D的电压波形如图中所示。

图P4.2[解]见图A4.2[题4.3]试分析图P4.3所示电路的逻辑功能，列出真值表写出逻辑函数式。

图P4.3 [解]：图P4.3所示电路的真值表S R Q n Q n+1 0 0 0 0 0 0 1 1 0 1 0 0 0 1 1 0 1 0 0 1 1 0 1 1 1 1 0 0* 1 110*由真值表得逻辑函数式 01=+=+SR Q R S Q nn[题4.4] 图P4.4所示为一个防抖动输出的开关电路。

当拨动开关S 时，由于开关触点接触瞬间发生振颤，D S 和D R 的电压波形如图中所示，试画出Q 、Q 端对应的电压波形。

图P4.4[解] 见图A4.4图A4.4[题4.5] 在图P4.5电路中，假设CP 、S 、R 的电压波形如图中所示，试画出Q 和Q 端与之对应的电压波形。

假定触发器的初始状态为Q =0。

图P4.5[解]见图A4.5图A4.5[题4.6]假设将同步RS触发器的Q与R、Q与S相连如图P4.6所示，试画出在CP 信号作用下Q和Q端的电压波形。

己知CP信号的宽度t w = 4 t Pd 。

t Pd为门电路的平均传输延迟时间，假定t Pd≈t PHL≈t PLH，设触发器的初始状态为Q=0。

图P4.6图A4.6[解]见图A4.6[题4.7]假设主从结构RS触发器各输入端的电压波形如图P4.7中所给出，试画Q、Q端对应的电压波形。

设触发器的初始状态为Q=0。

图P4.7[解] 见图A4.7图A4.7[题4.8]假设主从结构RS触发器的CP、S、R、DR各输入端的电压波形如图P4.8所示，1DS。

《数字电子技术基础》复习指导（第四章）

《数字电⼦技术基础》复习指导（第四章）第四章组合逻辑电路⼀、本章知识点(⼀)概念1.组合电路：电路在任⼀时刻输出仅取决于该时刻的输⼊，⽽与电路原来的状态⽆关。

电路结构特点：只有门电路，不含存储（记忆）单元。

2.编码器的逻辑功能：把输⼊的每⼀个⾼、低电平信号编成⼀个对应的⼆进制代码。

优先编码器：⼏个输⼊信号同时出现时，只对其中优先权最⾼的⼀个进⾏编码。

3.译码器的逻辑功能：输⼊⼆进制代码，输出⾼、低电平信号。

显⽰译码器：半导体数码管(LED数码管)、液晶显⽰器(LCD)4.数据选择器：从⼀组输⼊数据中选出某⼀个输出的电路，也称为多路开关。

5.加法器半加器：不考虑来⾃低位的进位的两个1位⼆进制数相加的电路。

全加器：带低位进位的两个 1 位⼆进制数相加的电路。

超前进位加法器与串⾏进位加法器相⽐虽然电路⽐较复杂，但其速度快。

6.数值⽐较器：⽐较两个数字⼤⼩的各种逻辑电路。

7.组合逻辑电路中的竞争⼀冒险现象竞争：门电路两个输⼊信号同时向相反跳变(⼀个从1变0，另⼀个从0变1)的现象。

竞争-冒险：由于竞争⽽在电路输出端可能产⽣尖峰脉冲的现象。

消除竞争⼀冒险现象的⽅法：接⼊滤波电容、引⼊选通脉冲、修改逻辑设计(⼆)组合逻辑电路的分析⽅法分析步骤：1.由图写出逻辑函数式，并作适当化简；注意：写逻辑函数式时从输⼊到输出逐级写出。

2.由函数式列出真值表；3.根据真值表说明电路功能。

(三)组合逻辑电路的设计⽅法设计步骤：1.逻辑抽象：设计要求----⽂字描述的具有⼀定因果关系的事件。

逻辑要求---真值表(1) 设定变量--根据因果关系确定输⼊、输出变量；(2)状态赋值：定义逻辑状态的含意输⼊、输出变量的两种不同状态分别⽤0、1代表。

(3)列出真值表2.由真值表写出逻辑函数式真值表→函数式，有时可省略。

3.选定器件的类型可选⽤⼩规模门电路，中规模常⽤组合逻辑器件或可编程逻辑器件。

4.函数化简或变换式(1)⽤门电路进⾏设计：从真值表----卡诺图/公式法化简。

数字电路PPT课件第四章

AABC B ABC C ABC （2）化简与变换：
A B C
&
≥1
L
L ABC( A B C ) ABC A B C
（3）由表达式列出真值表。（4）分析逻辑功能：当 A 、 B 、 C 三个变量一致时，输出为
A B C
0 0 0 0 1 1 1 1 0 0 1 1 0 0 1 1 0 1 0 1 0 1 0 1
（2）列真值表（3）分析电路的逻辑功能多数输入变量为1，输出F为1；多数输入变量为0，输出 F为0
结论：电路为少数服从多数的三变量表决电路。
4.1组合逻辑电路分析
例2：电路如图所示，分析该电路的逻辑功能。解：（1）由逻辑图逐级写出表达式
P ABC
& P & &
真值表
L AP BP CP
在片内是超前进位，而片与片之间是串行进位。
4.2常用组合逻辑电路的介绍 4.2.2数值比较器
1 数值比较器的逻辑功能数值比较器完成对两个二进制数A、B进行大小比较 1位数值比较器对两个1位二进制数A、B进行比较 • 真值表 • 逻辑表达式
B 1
1位比较器真值表
&
输入
A B
输出
≥1
FA＞B
• 逻辑图
4.1组合逻辑电路分析 4.1.2 组合逻辑电路分析
例1：试分析图所示逻辑电路的功能。解（1）逻辑表达式
AB
BC AC
真值表 A 0 0 0 0 1 1 1 1 B 0 0 1 1 0 0 1 1 C 0 1 0 1 0 1 0 1 F 0 0 0 1 0 1 1 1
F AB BC AC AB BC AC

数字电子技术第四章习题答案

M 0 0 0 0 0 0 0 0 A 0 0 0 0 1 1 1 1 B 0 0 1 1 0 0 1 1 C 0 1 0 1 0 1 0 1 Z 1 0 0 0 0 0 0 1 M 1 1 1 1 1 1 1 1 A 0 0 0 0 1 1 1 1 B 0 0 1 1 0 0 1 1 C 0 1 0 1 0 1 0 1 Z 0 0 0 1 0 1 1 1
4.8 用4片8线-3线优先编码器组成线-5线优先编码器。线优先编码器组成32线线优先编码器线优先编码器。片线线优先编码器组成
YS'
1 0 1 0
Y’2(4) 0 1 1 1 1
' YEX
状态不工作工作，工作，但无输入工作，工作，且有输入不可能出现
1 1 0 0
Y’2(3) 1 0 1 1 1
C 0 1 0 1 0 1 0 1
MS 0 1 × 0 × × × 1
ML 0 0 × 1 × × × 1
MS
BC 00 A 0 1 0 x BC 00 0 x
01 1 x
11 0 1
10 x x
ML A 0 1
01 0 x
11 1 1
10 x x
MS=A+B’C ML=B
B ML
《数字电子技术基础》第五版数字电子技术基础》
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4.3
解：输入变量——水位检测结果输入变量水位检测结果来表示，用A，B，C来表示，，，来表示高于检测元件时为“ ，高于检测元件时为“0”，低于检测元件时为“1”；低于检测元件时为“ ；输出变量——水泵工作状态输出变量水泵工作状态用ML，MS分别代表两个水泵工作为“ ，不工作为“ 。工作为“1”，不工作为“0”。

数字电路与逻辑设计第四章答案PPT课件

时钟触发方式的动作特点：
①在CLK＝0期间， SR触发器的状态不变化。只有 CLK=1期间，S和R的信号都能通过引导门G3和G4门，从而使得触发器置成相应的状态；
②在CLK＝1的全部时间里S和R的变化都将引起触发器输出端状态的变化。在CLK回到0以后，触发器保存的是CLK回到0以前瞬间的状态。
这种在CLK由“0”到“1”整个正脉冲期间触发器动作的控制方式称为时钟触发方式。
4-3题 CLK
SRQຫໍສະໝຸດ Q禁态不定态图4-3
禁态
不定态
4.3.1 主从JK触发器
虽然主从RS触发器克服了同步RS触发器在CLK=1期间的输出状态不断随输入变化而变化，但仍然存在约束条件。为了使触发器输入数据不受约束，则将主从RS触发器的输出端反馈到输入端，构成了主从JK触发器。
Q*= 1
若Q＝1， Q¢＝0
在CLK的
S主＝0
在CLK＝1时，主触发器翻转为
R主＝1
“0”，即 Q*主=
，即Q*=
0,
Q*¢
=
0 1
Q*= Q ¢
脉冲触发方式的动作特点：
1.分两步动作：第一步在CLK＝1时，主触发器受输入信号控制，从触发器保持原态；第二步在CLK到达后，从触发器按主触发器状态翻转，故触发器输出状态只改变一次。CLK 到达时从触发器的状态不一定能按此刻输入信号的状态来确定，而必须考虑整个CLK＝1输入信号的变化过程。
输入
输出
SD
RD
0
0
0
0
0
1
0
1
1
0
1
0
1
1
1
1
Qn Qn
01 10 01 10 01 10 01 10

数字电子技术基础第4章

Thanks!

4.4.1 竞争-冒险现象及其成因

将门电路的两个输入信号同时向相反的逻辑电平跳变的现象称为竞争。由于竞争而在电路输出端可能产生尖峰脉冲的现象称为竞争-冒险。图4.4.1 由于竞争而产生的尖峰脉冲
图4.4.2
2线－4线译码器中的竞争－冒险现象（a）电路图（b）电压波形图
4.4.2 检查竞争-冒险现象的方法
液晶优点：功耗极小。缺点：亮度差，响应速度低。
A=0, 不工作 A=1，工作
图4.3.14 用异或门驱动液晶显示器（a）电路（b）电压波形
2. BCD –七段显示译码器
图4.3.15
BCD－七段显示译码器的卡诺图
LT’：灯测试输入 RBI’：灭零输入 BI’/RBO’灭灯输入/灭零输出
图4.3.16

在将两个多位二进制数相加时，除了最低位以外，每一位都应该考虑来自低位的进位，即将两个对应位的加数和来自低位的进位3个数相加。这种运算称为全加，所用的电路称为全加器。
图4.3.26
全加器的卡诺图
图4.3.27 双全加器74LS183 （a）1/2逻辑图（b）图形符号
二、多位加法器

1、串行进位加法器（速度慢）
复习思考题

R4.3.3 用4线-16线译码器（输入为A3、A2、A1、 A0，输出为Y’0~Y’15）能否取代图4.3.20中的3 线-8线译码器？如果可以取代，那么电路应如何连接？ R4.3.4 数据选择器输入数据的位数和输入地址的位数之间应满足怎样的定量关系？ R4.3.5 如果用同样的一个4选1数据选择器产生同样的一个三变量逻辑函数，电路接法是否是唯一的？

数字电子技术基础第四章习题及参考答案

数字电子技术基础第四章习题及参考答案第四章习题1．分析图4-1中所示的同步时序逻辑电路，要求：（1）写出驱动方程、输出方程、状态方程；（2）画出状态转换图，并说出电路功能。

CPY图4-12．由D触发器组成的时序逻辑电路如图4-2所示，在图中所示的CP脉冲及D作用下，画出Q0、Q1的波形。

设触发器的初始状态为Q0=0，Q1=0。

D图4-23．试分析图4-3所示同步时序逻辑电路，要求：写出驱动方程、状态方程，列出状态真值表，画出状态图。

CP图4-34．一同步时序逻辑电路如图4-4所示，设各触发器的起始状态均为0态。

（1）作出电路的状态转换表；（2）画出电路的状态图；（3）画出CP作用下Q0、Q1、Q2的波形图；（4）说明电路的逻辑功能。

图4-45．试画出如图4-5所示电路在CP波形作用下的输出波形Q1及Q0，并说明它的功能（假设初态Q0Q1=00）。

CPQ1Q0CP图4-56．分析如图4-6所示同步时序逻辑电路的功能，写出分析过程。

Y图4-67．分析图4-7所示电路的逻辑功能。

（1）写出驱动方程、状态方程；（2）作出状态转移表、状态转移图；（3）指出电路的逻辑功能，并说明能否自启动；（4）画出在时钟作用下的各触发器输出波形。

CP图4-78．时序逻辑电路分析。

电路如图4-8所示：（1）列出方程式、状态表；（2）画出状态图、时序图。

并说明电路的功能。

1C图4-89．试分析图4-9下面时序逻辑电路：（1）写出该电路的驱动方程，状态方程和输出方程；（2）画出Q1Q0的状态转换图；（3）根据状态图分析其功能；1B图4-910.分析如图4-10所示同步时序逻辑电路，具体要求：写出它的激励方程组、状态方程组和输出方程，画出状态图并描述功能。

1Z图4-1011．已知某同步时序逻辑电路如图4-11所示，试：（1）分析电路的状态转移图，并要求给出详细分析过程。

（2）电路逻辑功能是什么，能否自启动？（3）若计数脉冲f CP频率等于700Hz，从Q2端输出时的脉冲频率是多少?CP图4-1112．分析图4-12所示同步时序逻辑电路，写出它的激励方程组、状态方程组，并画出状态转换图。

(完整版)数字电子技术第四章答案

习题44－1 分析图P4－1所示的各组合电路，写出输出函数表达式，列出真值表，说明电路的逻辑功能。

解：图（a ）：1F AB =；2F A B =e ；3F AB = 真值表如下表所示： A B 1F2F3F0 0 0 1 0 0 1 0 0 1 1 0 1 0 0 111其功能为一位比较器。

A>B 时，11F =；A=B 时，21F =；A<B 时，31F = 图（b ）：12F AB AB F AB =+=；真值表如下表所示： A B 1F2F功能：一位半加器，1F 为本位和，2F 为进位。

图（c ）：1(0,3,5,6)(1,2,4,7)F M m ==∑∏2(0,1,2,4)(3,5,6,7)F M m ==∑∏真值表如下表所示：功能：一位全加器，1F 为本位和，2F 为本位向高位的进位。

图（d ）：1F AB =；2F A B =e ；3F AB =功能：为一位比较器，A<B 时，1F ＝1；A=B 时，2F ＝1；A>B 时，3F ＝14－2 分析图P4－2所示的组合电路，写出输出函数表达式，列出真值表，指出该电路完成的逻辑功能。

解：该电路的输出逻辑函数表达式为：100101102103F A A x A A x A A x A A x =+++因此该电路是一个四选一数据选择器，其真值表如下表所示：1A0AF0 0 0x 0 1 1x 1 0 2x 1 13x4－3 图P4－3是一个受M 控制的代码转换电路，当M ＝1时，完成4为二进制码至格雷码的转换；当M ＝0时，完成4为格雷码至二进制的转换。

试分别写出0Y ,1Y ,2Y ,3Y 的逻辑函数的表达式，并列出真值表，说明该电路的工作原理。

解：该电路的输入为3x 2x 1x 0x ，输出为3Y 2Y 1Y 0Y 。

真值表如下： 3x2x1x0x3Y2Y1Y0YM=10 0 0 0 0 0 0 0 0 0 0 1 0 0 0 1 0 0 1 0 0 0 1 1 0 0 1 1 0 0 1 0 0 1 0 0 0 1 1 0 0 1 0 1 0 1 1 1 0 1 1 0 0 1 0 1 01 1 0 0 1 0 0 M=0 1 0 0 0 1 1 1 1 1 0 0 1 1 1 1 0 1 0 1 0 1 1 0 0 1 0 1 1 1 1 0 1 1 1 0 0 1 0 0 0 1 1 0 1 1 0 0 1 1 1 1 0 1 0 1 1 111111由此可得：1M =当时，33232121010Y x Y x x Y x x Y x x =⎧⎪=⊕⎪⎨=⊕⎪⎪=⊕⎩ 完成二进制至格雷码的转换。