集成触发器及其应用电路设计
数电实验报告触发器及其应用(共10篇)
数电实验报告触发器及其应用(共10篇)1、实验目的：掌握触发器的原理和使用方法，学会利用触发器进行计数、存储等应用。
2、实验原理：触发器是一种多稳态数字电路，具有存储、计数、分频、时序控制等功能。
常见的触发器有RS触发器、D触发器、T触发器、JK触发器等。
RS触发器是由两个交叉互连的反相器组成的，它具有两个输入端R(复位)和S(置位)，一个输出端Q。
当输入R=1，S=0时，Q=0;当输入R=0，S=1时，Q=1;当R=S=1时，无法确定Q的状态，称为禁态。
JK触发器是将RS触发器的两个输入端合并在一起而成，即J=S，K=R，当J=1，K=0时，Q=1;当J=0，K=1时，Q=0;当J=K=1时，Q反转。
JK触发器具有启动、停止、颠倒相位等功能。
D触发器是由单个输入端D、输出端Q和时钟脉冲输入端组成的，当时钟信号上升沿出现时，D触发器的状态发生改变，如果D=1，Q=1;如果D=0，Q=0。
T触发器只有一个输入端T和一个输出端Q，在每个时钟脉冲到来时，T触发器执行T→Q操作，即若T=1，则Q取反；若T=0，则Q保持不变。
触发器可以组成计数器、分频器、存储器、状态机等各种数字电路，被广泛用于计算机、控制系统等领域。
3、实验器材：数码万用表、示波器、逻辑分析仪、CD4013B触发器芯片、几个电阻、电容、开关、信号发生器等。
4、实验内容：4.1 RS触发器测试利用CD4013B芯片来测试RS触发器的功能，在实验中将RS触发器的输入端分别接入CD4013B芯片的端子，用示波器观察输出端的波形变化，并记录下输入输出关系表格，来验证RS触发器的工作原理。
具体实验步骤如下：将CD4013B芯片的端子按如下接线方式连接：RST1,2脚接入+5V电源，C1个100nF的电容与单位时间5 ns的外部时钟信号交替输入接口CLK，以模拟器件为master时，向器件提供单个时钟脉冲。
测试时选择适宜的数据输入，R1和S2另一端程+5V，S1和R2另一端连接接地GND,用万用表测量各端电压，电容缓存的电压。
触发器及其应用实验
触发器及其应用实验一、实验目的1、掌握基本RS、JK、D和T触发器的逻辑功能2、掌握集成触发器的逻辑功能及使用方法3、熟悉触发器之间相互转换的方法二、实验原理触发器具有两个稳定状态，用以表示逻辑状态“1”和“0”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态，它是一个具有记忆功能的二进制信息存贮器件，是构成各种时序电路的最基本逻辑单元。
1、基本RS触发器图4－1为由两个与非门交叉耦合构成的基本RS触发器，它是无时钟控制低电平直接触发的触发器。
图4－1 基本RS触发器2、JK触发器在输入信号为双端的情况下，JK触发器是功能完善、使用灵活和通用性较强的一种触发器。
本实验采用CC4027双JK触发器。
引脚功能及逻辑符号如图8－2所示。
JK触发器的状态方程为：Q n+1＝J Q n＋K Q nCC4027是由CMOS传输门构成的边沿型JK触发器，它是上升沿触发的双JK触发器，图4－2为引脚排列。
图4－2 双上升沿J－K触发器3、D触发器在输入信号为单端的情况下，D触发器用起来最为方便，其状态方程为Q n+1＝D n。
CC4013是由CMOS传输门构成的边沿型D触发器。
它是上升沿触发的双D触发器，图4－3为引脚排列。
图4－3 双上升沿D触发器4、触发器之间的相互转换在集成触发器的产品中，每一种触发器都有自己固定的逻辑功能。
但可以利用转换的方法获得具有其它功能的触发器。
若将D 触发器Q端与D端相连，便转换成T'触发器。
如图4－4所示。
图4－4 D转成T'三、实验设备与器件1、双踪示波器2、器件:CC4027、 74LS00、 CC4013四、实验内容1、测试基本RS触发器的逻辑功能按图4－1，用两个与非门组成基本RS触发器，输入端R、S接逻辑开关的输出插口，输出端 Q、Q接逻辑电平显示输入插口，按表4－1要求测试，记录之。
表4－12、测试双JK触发器CC4027逻辑功能(1) 测试JK触发器的逻辑功能按表4－2的要求改变J、K、CP端状态，观察Q状态变化，记录之。
实验五触发器及其应用(仿真)一、实验目的
实验五 触发器及其应用（仿真）一、实验目的1．掌握JK 触发器和D 触发器的逻辑功能。
2．掌握触发器相互转换的方法。
3．掌握集成JK 触发器和集成D 触发器的使用方法。
二、实验相关知识1．JK 触发器数字集成触发器74112内部有两个独立的下降沿触发的JK 触发器，其逻辑符号和仿真元件引线排列如图5-1所示。
CLR 是异步置0端D R ， PRE 是异步置1端D S 。
特性方程是：2．D 触发器数字集成触发器7474内部有两个独立的上升沿触发的D 触发器，其逻辑符号和仿真元件引线排列如图5-2所示。
其特点是次态（Q n+1）输出仅取决于CP 上升沿到达时D 端输入信号的状态，而与在此以前或以后D 的状态无关。
其特性方程是： Q n+1 = D三、实验预习要求与思考1．阅读实验相关知识。
2．按要求设计“实验内容”中的电路，画出逻辑图。
n n n Q KQ J Q 1（b ） 仿真元件引线排列（a ） 逻辑符号图5-1 74112的逻辑符号和仿真元件引线排列1J C1 1K Q＞ J CP K R D S DRSQ（a ） 逻辑符号（b ） 仿真元件引线排列图5-2 7474的逻辑符号和仿真元件引线排列四、实验内容1．设计电路验证JK触发器74112的逻辑功能。
建议示波器A通道接时钟脉冲、B通道接输出端Q，Q 和Q端接指示灯。
表5-1 JK触发器逻辑功能验证表（1）由表5-1可以得出PRE’和CLR’的优先级哪个高？（2）由表5-1可以得出JK触发器的特性方程：。
2．设计电路验证D触发器7474的逻辑功能。
建议示波器A通道接时钟脉冲、B通道接输出端Q，Q 和Q端接指示灯。
表5-2 D触发器逻辑功能验证表（1）比较7474和74112的复位、置位端的异同。
（2）由表5-2可以得出D触发器的特性方程： 。
3．比较D触发器、JK触发器逻辑表达式，用适当的逻辑门实现D触发器与JK触发器的逻辑功能互相转换，并验证之。
什么是触发器及其在电路中的应用
什么是触发器及其在电路中的应用触发器是一种电子器件或电路，用于接收输入信号并根据特定条件来触发输出信号。
触发器通常由逻辑门电路或者其他电子元件构成，可以在电路中实现存储和控制功能。
触发器在数字系统、计算机、通信系统等领域广泛应用。
一、触发器的基本概念触发器是一种同步逻辑电路，能够储存和稳定输入信号的状态，并在满足特定条件时产生输出信号。
触发器的输入可以是电流、电压或者其它物理量。
触发器的输出可以是开关、逻辑位或者电路状态的改变。
触发器按照其功能和构造可以分为多种类型，例如RS触发器、D 触发器、JK触发器和T触发器等。
这些触发器都有各自的特点和适用场景。
二、触发器在电路中的应用触发器在电子电路中有广泛的应用，主要可以分为存储功能和控制功能两个方面。
1. 存储功能：触发器能够在特定的时刻存储输入信号的状态，这种存储功能可以用于数字系统的数据存储。
例如，D触发器可以储存一个位的数据，并在时钟信号的作用下改变其状态。
多个触发器可以组合成寄存器、存储器等用于大规模数据存储的器件。
2. 控制功能：触发器的输出信号可以用于控制电路的工作状态。
例如，JK触发器可以根据输入信号的变化来控制电路的动作，实现时序逻辑的功能。
触发器还可以用于时序电路的设计，比如在计数器、时钟发生器、锁存器等电路中广泛使用。
三、触发器的特性和应用注意事项触发器具有一些特性和应用注意事项，需要在设计和使用时加以考虑。
1. 触发器的稳定性：触发器应该具有稳定的输出状态，能够在一定的时间内保持其存储的状态。
触发器的设计和器件的选取需要考虑这一点。
2. 触发器的时序特性：触发器在输入和输出信号之间有一定的时间延迟，需要在电路设计中合理考虑这个延迟时间，以保证电路的正常工作。
3. 触发器的电源和工作电压：触发器的工作电源和电压范围需要满足设计要求，在实际应用中需要注意。
4. 触发器的逻辑功能：不同类型的触发器具有不同的逻辑功能和特性，需要根据具体需求选择合适的触发器类型。
触发器在电子电路中的应用
触发器在电子电路中的应用触发器作为一种重要的数字电路元件，在电子电路中起着关键的作用。
它能够实现信号的存储、传输和逻辑操作，广泛应用于计算机、通信设备、自动控制系统等各个领域。
本文将介绍触发器的工作原理、种类及其在电子电路中的应用。
一、触发器的工作原理触发器是一种能够在特定条件下稳定存储和改变输出状态的电子元件。
它通常由若干个逻辑门电路组成，具有多种工作模式，如RS触发器、D触发器、JK触发器等。
触发器的核心是存储单元，其中包含的锁存模块能够存储输入信号的状态，并按照特定条件改变输出状态。
二、常见触发器的种类及特点1. RS触发器RS触发器是最简单的一种触发器，由两个反相器和两个输入端组成。
它的输入信号可以是0或1，根据输入信号的不同组合，RS触发器可以实现不同的功能。
例如，当S=1，R=0时，输出为1；当S=0，R=1时，输出为0；当S=0，R=0时，输出保持不变。
2. D触发器D触发器是应用广泛的一种触发器，在数字系统中扮演着重要的角色。
它只有一个数据输入端(D)，一个时钟输入端(Clk)和一个输出端(Q)。
在时钟信号作用下，D触发器能够将输入信号有效地存储并传输到输出端。
3. JK触发器JK触发器是一种较为复杂的触发器，具有比D触发器更丰富的功能。
它具有两个数据输入端(J和K)，一个时钟输入端(Clk)和一个输出端(Q)。
当输入信号为1时，JK触发器的状态会根据时钟信号发生变化，而当输入信号为0时，JK触发器的状态保持不变。
三、触发器的应用领域1. 计算机存储器触发器在计算机存储器中起着重要作用。
通过触发器的存储功能，计算机能够存储、读取和修改数据。
在计算机的随机存储器（RAM）和只读存储器（ROM）中，触发器作为存储单元，能够有效地管理数据。
2. 数字信号处理在数字信号处理系统中，触发器常被用于存储和转换输入信号。
通过触发器的状态改变，实现数据的存储、处理和输出。
触发器在数字信号滤波、数模转换等领域具有广泛的应用。
实验4触发器及其应用
实验四 触发器及其应用一、实验目的1、 掌握基本RS 、JK 、D 、T 触发器的逻辑功能；2、 熟悉集成触发器的逻辑功能及使用方法；3、 学会不同逻辑功能触发器之间的转换方法。
二、实验仪器及设备1、 EEL-II 型电工电子实验台2、 数字电路实验箱3、 万用表4、 直流稳压电源5、 参考元件 三、实验内容1、 基本RS 触发器逻辑功能测试，元件用74LS00QDDQQ(a)(b)图5.1基本RS 触发器结构图2、 D 触发器逻辑功能测试，元件用74LS74（双上升沿触发D 触发器） （1） 直接复位端R D 和直接置位端S D 的功能测试 （2） D 触发器的逻辑功能测试直接复位、置位端R D 、S D 接模拟电位开关，CP 接单脉冲发生器，并改变D 的状态，将测试结果填入表5.2中。
3、 JK 触发器功能测试，选用74LS112直接复位、置位端R D 、S D 接模拟电位开关，CP 接单脉冲发生器，并改变J 、K 的状态，将测试结果填入表5.3中。
4、用D触发器构成T’触发器Q 将D触发器的D端与Q端相连，构成T’触发器。
其逻辑功能为：Q n+1=n表示每来一个CP脉冲翻转一次。
有计数功能。
（1）在CP加入单脉冲观察翻转次数和CP输入正脉冲个数间的关系。
（2）CP端加连续脉冲，用示波器观察Q与Q波形，记录填表5.4，并画出波形图。
如图5.4所示。
CPQQ图5.3波形图5、用JK触发器接T和T’触发器（1）设计电路（2）测试功能并观察CP和Q的同步波形，体会触发器的分频作用。
四、实验报告1、整理实验数据，结果填入各表格，画出要求的有关电路图；2、依实验结果总结触发器的逻辑功能。
五、思考题1、何谓基本RS触发器的记忆功能？2、D触发器翻转条件及特点是什么？3、*D触发器实现可靠计数的基本思想是什么？六、器件介绍1、D触发器74LS74图5.2上升沿触发D 触发器74LS74符号2、 JK 触发器74LS11274LS112是双主从下降沿触发JK 触发器，其逻辑符号和管脚引线排列如图5.5所示。
实验四触发器及其应用
实验四触发器及其应用实验四实验四实验目的1.掌握基本RS触发器、JK触发器、D触发器和T触发器的逻辑功能。
2.熟悉各类触发器之间逻辑功能的相互转换方法。
3.了解触发器的应用。
实验四实验内容1.测试基本RS触发器的逻辑功能★选做2.测试双JK触发器74LS73逻辑功能3.测试双D触器74LS74的逻辑功能★选做4.触发器的转换①②将JK触发器加上门电路转化成D触发器。
将D触发器加上连接，构成T’触发器。
5.触发器的应用，利用74175的D触发器构成下面电路。
①竞赛抢答电路①移位寄存器实验四实验原理触发器是组成时序逻辑电路的基本单元之一，具有记忆功能的二进制信息存贮器件。
在外加信号的作用下，触发器可以从一个稳定状态转变为另一个稳定状态。
RS触发器：图6—1所示电路为由两个“与非”门交叉耦合而成的基本RS触发器，它是无触发器：触发器时钟控制低电平低电平直接触发的触发器，有直接置位、复位的功能，是组成各种功能触发器低电平的最基本单元。
基本RS触发器也可以用两个“或非”门组成，它是高电平高电平直接触发的触高电平发器。
011100011置1保持置零保持实验四实验原理JK触发器：JK触发器：本实验采用74LS73型双JK触发器，其引脚排列如图6-3所示。
它是下降边沿触发器触发的边沿触发器，即在CP脉冲下降沿(“1→0”)触发翻转，有强迫置“0”功能R(RD),没有强迫置“1”的功能，在置D=1时，根据下表可以测试出其逻辑功能。
保持置1置0翻转翻转异步清零实验四实验原理D触发器：是另一种使用广泛的触发器，它的基本结构多为维持阻塞型。
D触发器触发器：触发器是在CP脉冲上升沿触发翻转，触发器的状态取决于CP脉冲到来之前D端的状态，状态方程为Qn+1=D本实验采用74LS74型双D触发器,是上升边沿触发的边沿触发器。
它采用维持阻塞结构，在CP脉冲上升沿(“0→1”)触发翻转。
触发器的次态Qn+1取决于CP脉冲的上升来到之前D的状态，但是S=0,R=1时强行置1,S=1,R=0时强行置0。
几种常用的集成触发器
引入了时钟信号，避免了
等领域
输入为“00”的不确定状态。
D触发器
数字信号存储
用于存储数字信号，比如数 据寄存器、状态寄存器等。
时序逻辑设计
在时序逻辑中，D触发器经 常被用于存储和传输数据。
触发信号控制
通过设置触发信号，可以实 现数据的读写与控制。
T触发器
连环反馈结构
通过将输出与非触发输入相连， 实现反馈。
2 多功能
由两个反馈型门电路组成， 具有两个输入端和两个输 出端。
可以用作存储单元、计数 器和频率分频器等。
3 应用广泛
常用于数字电路中的布性强
可以通过连接或断开某些 输入端，实现各种逻辑功 能。
2 解决RS触发器的缺陷 3 广泛应用于存储器、
计数器、频率分频器
总结和要点
常用触发器
RS、JK、D和T触发器是数字电路 中常用的存储器件。
广泛应用
集成触发器在计算机、通信和工 业自动化等领域得到广泛应用。
时序逻辑设计
触发器在时序逻辑设计中起到重 要的作用，实现数据的存储和传 输。
触发条件精确定义
通过设置输入的初始状态和触 发信号边沿，定义了触发器的 工作方式。
频率分频与计数器
常用于频率分频器和计数器等 电路中。
应用场景
1
数字计算机
集成触发器在计算机中广泛用于存储和处理数据。
2
通信系统
在通信系统中，触发器用于信号检测和传输控制。
3
工业自动化
触发器被应用于各种工业自动化设备中，实现信号的存储与控制。
几种常用的集成触发器
集成触发器是数字电路中常用的元件，用于存储和控制信号。本节将介绍几 种常用的触发器及其应用场景。
触发器的应用
而
在CP 由高变低时, 因SR 同时由低变高, 触发器的次态就不能确定, 故
同步SR 触发器的约束条件为SR =0。
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5. 3 时钟触发器的逻辑功能
• 3. 触发器功能的几种表示方法 • 1) 特性方程 • 将表5-3 SR 触发器的功能真值表, 经过图5-6 所示次态卡诺图的化简,
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5. 3 时钟触发器的逻辑功能
• T 触发器的逻辑功能可概括为: 当T =0 时, 触发器保持原状态不变; 当 T =1 时, 触发器状态与原状态相反, 即
• 本节中为了便于理解和叙述, 我们讨论SR、JK、D、T 四种触发器的 功能时, 仅以同步时钟触发器为例。实际上, 上述讨论的结论完全适用 于其他结构形式的时钟触发器(维持阻塞触发器、边沿触发器和主从 触发器), 它们的功能真值表、激励表、特性方程、状态图均与同步式 相应功能触发器完全一致。下面就讨论这些不同结构形式的时钟触发 器以及它们各自的触发方式。
第5 章 触发器的应用
• 5. 1 概述 • 5. 2 基本触发器 • 5. 3 时钟触发器的逻辑功能 • 5. 4 时钟触发器的结构及触发方式 • 5. 5 集成触发器及其应用
返回
5. 1 概 述
• 在数字系统中不但需要对“0” “1” 信息进行算术运算和逻辑运算, 还需要将这些信息和运算结果保存起来。为此, 需要使用具有记忆功 能的单元电路。能够存储0、1 信息的基本单元电路称为触发器(FlipFlop)。
• 触发器是一种具有记忆功能, 能存储一位二进制信息的逻辑电路。每 个触发器都应有两个互非的输出端Q 和 , 并且有两个基本性质:
• (1) 在一定的条件下, 触发器具有两个稳定的工作状态( “1” 态和“0” 态)。用触发器输出端Q 的状态作为触发器的状态。即当输出Q = 1, = 0 时, 表示触发器“1” 状态;当输出Q =0, =1, 表示触发器“0” 状态。
电子技术实验报告5-触发器及其应用
电子技术实验报告5-触发器及其应用一、实验目的1.了解触发器的基础知识。
2.了解 RS 触发器、JK 触发器的应用原理。
3.学会使用电路模拟软件进行仿真分析。
二、实验器材1.计算机2.电路仿真软件（Multisim）三、实验原理1.触发器触发器是一种与时序有关的电路，其输出信号的状态与输入信号、在输入信号作用下出现的前一个时刻输出状态有关。
触发器的作用是存贮一个值，然后在时钟信号的控制下，使得这个存贮的值在合适的时刻得到保持或改变。
2.RS 触发器RS 触发器是一种基础的触发器，它由两个 NOR 门构成，主要由两个输入端、一个输出端和一个时钟端组成。
它的真值表如下：状态\t输入\tS \t R \t输出重置\tQ \tQ’复位\tL \tH \t1 \t0保持 \tH \tL \t1 \t0倒置 \tL \tH\t0 \t1禁止 \tL \tL \t不确定不确定3.JK 触发器JK 触发器是一种基于 RS 触发器的扩展。
它由两个输入端、一个输出端和一个时钟端组成。
JK 触发器的输入有两个控制信号 J 和 K。
它的真值表如下：状态\t输入\tJ \tK \tQ \tQ’禁止/复位\tX \tX \t不变 \t不变置位 \t1 \tX \t1 \t0清零 \tX \t1 \t0 \t1保持 \tX \t0 \t不变不变倒置 \t1 \t1 \t0 \t1不变 \t1 \t1 \t1 \t0不变 \t0 \t0 \tQ\tQ’4.应用原理RS 触发器可以用于计数、存贮、分频、时序控制等方面。
当 S=1，R=0 时，Q=1，Q’=0，实现置位操作；当 S=0，R=1 时，Q=0，Q’=1，实现清零操作；当S=R=0 时，输出保持不变；当 S=R=1 时，输出不确定。
JK 触发器可以通过设置 J、K 对输入信号进行控制，实现存贮、倒置、计数等功能。
当输入信号为 0 时，JK 触发器保持原状态不变；当输入信号为 1 时，JK 触发器转换状态，若输入信号在时钟脉冲作用下状态不变，则为存贮；若 J、K 不同，并且输入信号在时钟脉冲作用下状态反转，则为倒置；若 J、K 相同，输入信号在时钟脉冲作用下状态反转，则为计数。
触发器及其应用的实验原理
触发器及其应用的实验原理实验目的本实验旨在通过实际操作与观察，学习和理解触发器的原理和应用。
通过实验，我们可以掌握触发器的工作原理、稳态和转态的概念，并能够灵活运用触发器解决实际问题。
实验器材1.74LS74触发器芯片 x 12.电路实验板 x 13.LED灯 x 24.电压源 x 15.连接线若干实验原理触发器是一种用于存储和放大数字信号的电子元件。
在数字电路中，触发器被广泛应用于时序电路和存储器等关键部分。
触发器可以根据输入信号的变化，在一定条件下产生稳态输出。
触发器的输出可以作为下一级触发器的输入，从而构成复杂的逻辑电路。
常见的触发器有RS触发器、D触发器、JK触发器和T触发器等。
本实验中，我们将使用74LS74触发器芯片，它是一种常见的双D触发器芯片。
触发器有两个稳态，分别是清零稳态（也称为复位稳态）和置位稳态（也称为设定稳态）。
其转态变化取决于输入信号的变化和特定的触发条件。
触发条件可以通过输入的极性选择和时钟脉冲确定。
实验步骤1.将74LS74触发器芯片插入电路实验板的指定位置。
2.将两个LED灯分别连接到触发器芯片的输出引脚，其中一个用于显示Q输出，另一个用于显示Q’输出。
3.连接电压源，将正极连接到芯片的Vcc引脚，将负极连接到芯片的地（GND）引脚。
4.使用连接线将触发器芯片的时钟脉冲引脚（CLK）连接到电路实验板上的一个按钮。
5.使用连接线将触发器芯片的复位引脚（CLR）连接到电路实验板上的另一个按钮。
6.分别使用连接线将两个D触发器的输入引脚（D）分别连接到电路实验板上的两个开关。
7.按下时钟按钮，观察LED灯的状态变化。
8.按下复位按钮，观察LED灯的状态是否恢复初始状态。
实验结果分析通过实验观察，我们可以得出以下结论： 1. 当输入信号D为高电平时，触发器芯片74LS74的Q输出为高电平，Q’输出为低电平。
2. 当输入信号D为低电平时，触发器芯片74LS74的Q输出为低电平，Q’输出为高电平。
触发器及其应用实验报告
触发器及其应用实验报告触发器及其应用实验报告引言在现代电子技术中，触发器是一种重要的数字电路元件，用于存储和控制信号的状态。
触发器广泛应用于计算机、通信、控制系统等领域，具有重要的实际应用价值。
本实验旨在通过实际操作，深入理解触发器的工作原理和应用。
实验目的1. 了解触发器的基本概念和工作原理。
2. 学习触发器的常见类型及其特点。
3. 掌握触发器在数字电路中的应用。
实验仪器和材料1. 示波器2. 电源3. 电阻、电容等元件4. 7400系列触发器芯片实验步骤1. 实验一：RS触发器的实验a. 将7400芯片连接到电源和示波器上。
b. 通过连接电路，将RS触发器的输入端和输出端连接到示波器上。
c. 分别给RS触发器的S和R输入端施加高电平和低电平信号，观察输出端的变化。
d. 记录实验结果并进行分析。
2. 实验二：D触发器的实验a. 将7400芯片连接到电源和示波器上。
b. 通过连接电路，将D触发器的输入端和输出端连接到示波器上。
c. 分别给D触发器的D输入端施加高电平和低电平信号，观察输出端的变化。
d. 记录实验结果并进行分析。
3. 实验三：JK触发器的实验a. 将7400芯片连接到电源和示波器上。
b. 通过连接电路，将JK触发器的输入端和输出端连接到示波器上。
c. 分别给JK触发器的J和K输入端施加高电平和低电平信号，观察输出端的变化。
d. 记录实验结果并进行分析。
实验结果与分析通过实验一、实验二和实验三，我们观察到了不同类型触发器的输入和输出变化情况。
在RS触发器中，当S和R输入均为低电平时，输出保持不变；当S和R输入均为高电平时，输出翻转；当S为高电平，R为低电平时，输出为高电平；当S为低电平，R为高电平时，输出为低电平。
在D触发器中，输出跟随输入信号变化，实现了数据的存储和传输。
在JK触发器中，当J和K输入均为低电平时，输出保持不变；当J和K输入均为高电平时，输出翻转；当J为高电平，K为低电平时，输出为高电平；当J为低电平，K为高电平时，输出为低电平。
触发器的认识和应用实验报告
触发器的认识和应用实验报告摘要：本实验报告旨在介绍和探讨触发器的概念、分类及其在电子电路中的应用。
通过实验验证触发器的工作原理和功能，并分析不同类型的触发器在不同应用场景下的优劣势。
实验结果表明触发器在数字电路设计中具有重要的作用，可实现存储、计数、时序等功能，且应用广泛。
1. 引言触发器是一种能够存储和改变输入信号状态的电子元件，其在数字电路中应用广泛。
触发器可用于存储数据、实现电平变换、计数和时序控制等功能，是数字电路设计中不可或缺的组成部分。
2. 基本概念触发器是由逻辑门电路构成的，其输入和输出可以采用不同的电平表示，如低电平表示0、高电平表示1。
触发器一般由几个逻辑门组成，包括主门和辅助门。
常见的触发器有RS触发器、D触发器、JK触发器等。
3. 实验设备和方法本实验使用LogicWorks软件进行模拟实验，搭建了RS触发器、D触发器和JK触发器的电路图，并通过输入不同的信号进行触发器的触发和状态变化观察。
实验过程中，通过改变输入信号和时钟信号频率，观察触发器的输出变化。
4. 实验结果和分析实验结果表明RS触发器适用于简单的状态存储和电平变换，但容易出现互锁现象；D触发器可以实现数据的存储和变换，并解决了RS 触发器的互锁问题；JK触发器则更加灵活，可实现计数和时序控制等功能。
5. 应用实例触发器在数字电路设计中有广泛的应用。
例如，D触发器可用于实现数据锁存器、寄存器和移位寄存器等；JK触发器可用于实现计数器、时序控制器和频率分频器等。
触发器还可以在时序电路、时钟同步电路和时序逻辑电路等领域发挥重要作用。
6. 结论本实验对触发器的概念、分类及其在电子电路中的应用进行了介绍和探讨。
通过实验验证了触发器的工作原理和功能，并分析了不同类型触发器的优劣势。
触发器在数字电路设计中具有重要的作用，可实现存储、计数、时序等功能，应用广泛。
实验七 触发器及其应用实验
实验七触发器及其应用实验一、实验概述本实验是通过使用74LS00、74LS74和74LS76来实现RS触发器、D触发器、JK 触发器以及T触发器的功能。
二、实验目的1、掌握基本RS、JK、T和D触发器的逻辑功能2、掌握集成触发器的功能和使用方法3、熟悉触发器之间相互转换的方法三、实验预习要求1、复习有关触发器内容，熟悉有关器件的管脚分配2、列出各触发器功能测试表格3、参考有关资料查看74LS00、74LS74和74LS76的逻辑功能四、实验原理在实际的数字系统中往往包含大量的存储单元，而且经常要求他们在同一时刻同步动作，为达到这个目的，在每个存储单元电路上引入一个时钟脉冲（CLK）作为控制信号，只有当CLK到来时电路才被“触发”而动作，并根据输入信号改变输出状态。
把这种在时钟信号触发时才能动作的存储单元电路称为触发器，以区别没有时钟信号控制的锁存器。
触发器具有两个稳定状态，用以表示逻辑状态“1”和“0”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态，它是一个具有记忆功能的二进制信息存贮器件，是构成多种电路的最基本逻辑单元。
1、RS触发器RS触发器是构成其它各种功能触发器的基本组成部分。
又称为基本RS触发器。
结构是把两个与非门或者或非门G1、G2的输入、输出端交叉连接，如图7.4-1所示。
图7.4-1 RS触发器2、D触发器D触发器是一个具有记忆功能的，具有两个稳定状态的信息存储器件，是构成多种时序电路的最基本逻辑单元，也是数字逻辑电路中一种重要的单元电路，如图7.4-2所示。
在数字系统和计算机中有着广泛的应用。
触发器具有两个稳定状态，即"0"和"1"，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。
JK触发器是数字电路触发器中的一种基本电路单元，如图7.4-3所示。
JK触发器具有置0、置1、保持和翻转功能，在各类集成触发器中，JK触发器的功能最为齐全。
电子技术实验与Multisim 12仿真实验3.5 触发器及其应用
VCC 5V
4
~1PR
3 1J
1Q 5
1 1CLK
2 1K
~1Q 6
~1CLR
15
74LS112D
74LS00D 74LS00D
XLA1
1
CPA
74LS04D CPB
74LS04D
F
CQT
图3-47 双向时钟脉冲仿真电路图
图3-48 双向时钟脉冲仿真波形图
实验3.5 触发器及其应用
五、实验室操作实验内容
实验3.5 触发器及其应用
三、实验原理
Q* JQ KQ
图3-37 基本RS触发器
图3-38 74LS112双JK触发器引脚排列及逻辑符号
实验3.5 触发器及其应用
三、实验原理
图3-39 74LS74的引脚排列及逻辑符号
实验3.5 触发器及其应用
三、实验原理
图3-40 JK触发器转换为T、T' 触发器 a) T触发器 b) T' 触发器
实验3.5 触发器及其应用
一、实验目的
1．掌握基本RS、JK、D等触发器的逻辑功能的测试方法。 2．掌握集成触发器之间的转换使用方法。
实验3.5 触发器及其应用
二、实验设备及材料
1．装有Multisim 12的计算机。 2．数字电路实验箱。 3．数字万用表。 4．双通道示波器。 5．74LS112、74LS74、74LS00。
图3-43 JK触发器组成的双相时钟脉冲电路
图3-41 D触发器转成T'触发器
图3-42 JK触发器转成D触发器
实验报告——触发器及其应用
实验四项目名称：触发器及其应用一、实验目的1、了解基本RS、JK和D触发器的逻辑功能2、了解时钟对触发器的触发作用3、能用触发器设计基本的时序逻辑电路二、实验设备1、数字电路实验箱2、74LS112 74LS00 74LS74三、实验内容及步骤1、测试基本RS触发器的逻辑功能本实验是选取74LS00芯片（引脚如图4-7所示）中两个与非门交叉耦合而成，如图4-8所示。
根据图4-8连线，d S、d R端分别接在实验箱上的逻辑电平选择开关上，输出Q和Q分别接在实验箱上的LED电平指示上。
按表4-5选择输入状态，测试并记录结果。
图4-7 74LS00引脚图图4-8 基本RS触发器表4－5d S d R Q Q011110112、JK触发器(1) 测试置位端S D和复位端R D 的功能按表4-6，将74LS112芯片（引脚如图4-9所示）的R D、S D、J、K端分别接逻辑电平选择开关，CP 接实验箱中的单脉冲下降沿触发输出端，Q、Q端分别接至实验箱的LED电平指示上。
根据表4-6，确定R D，S D、J、K端状态，按下单脉冲触发按钮，测试并记录实验结果（表中“×”表示无关项，即可置于任意状态）。
图4-9 74LS112引脚图表4-6(2) 测试JK触发器的逻辑功能按表4－7，测试JK触发器的逻辑功能。
将CP接单脉冲下降沿触发输出端，J、K、R D、S D端分别接逻辑电平选择开关，Q端接在实验箱的LED电平指示上。
利用置位端S D和复位端R D的功能，根据表4-6预置现态Q n ,然后R D 、S D 端同时置“1”，J 、K 状态按表4-7设定。
按下单脉冲触发按钮，测试并记录结果。
表4-73、D 触发器(1) 测试置位端S D 、复位端R D 的功能。
将74LS74芯片（引脚如图4-10所示）的D 、S D 、R D 端分别接逻辑电平选择开关，CP 接实验箱中的单脉冲上升沿触发端输出端，Q 、Q 分别接在实验箱的LED 电平指示上。
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华中科技大学
电子线路设计、测试与实验》实验报告
实验名称：集成运算放大器的基本应用
院（系）：自动化学院
地点：南一楼东306
实验成绩：
指导教师：汪小燕
2014 年6 月7 日
、实验目的
1）了解触发器的逻辑功能及相互转换的方法。
2）掌握集成JK 触发器逻辑功能的测试方法。
3）学习用JK 触发器构成简单时序逻辑电路的方法。
4）熟悉用双踪示波器测量多个波形的方法。
（5）学习用Verliog HDL描述简单时序逻辑电路的方法，以及EDA技术
、实验元器件及条件
双JK 触发器CC4027 2 片；
四2 输入与非门CC4011 2 片；
三3 输入与非门CC4023 1 片；
计算机、MAX+PLUSII 10.2集成开发环境、可编程器件实验板及专用电缆
三、预习要求
（1）复习触发器的基本类型及其逻辑功能。
（2）掌握D触发器和JK触发器的真值表及JK触发器转化成D触发器、T触发器、T 触发器的基本方法。
（3）按硬件电路实验内容（4）（5），分别设计同步3 分频电路和同步模4 可逆计数器电路。
四、硬件电路实验内容
（1）验证JK触发器的逻辑功能。
（2）将JK触发器转换成T触发器和D触发器，并验证其功能。
（3）将两个JK触发器连接起来，即第二个JK触发器的J、K端连接在一起，
接到第一个JK触发器的输出端Q两个JK触发器的时钟端CP接在一起，并输入1kHz 正方波，用示波器分别观察和记录CP Q、Q的波形（注意它们之间的时序关系），理解2分频、4分频的概念。
（4）根据给定的器件，设计一个同步3分频电路，其输出波形如图所示。
然后组装电路，并用示波器观察和记录CP Q、Q的波形。
（5）根据给定器件，设计一个可逆的同步模4 计数器，其框图如图所示。
图中，M为控制变量，当M=0时，进行递增计数，当M=1时，进行递减计数；Q、
Q为计数器的状态输出，Z为进位或借位信号。
然后组装电路，并测试电路的输入、输出
波形。
五、实验结果及分析
5.1三分频电路
得到激励方程:
K1
J0
K0
1
Q1
1
输出方程：
Q1n1
Q；
Q0r
Q°n1Q1Q
按照上述分析，得到实验电路图如下：
(2)按照上述设计电路，插板实验得到示波器的图形如下:
（3）结果分析
从图上可以看出，同步三分频电路较好的将原输入信号的频率减为原来的1/3，且实现了状态真值表的功能。
5.2同步模4计数器
（1）功能简介
Q i、Q o为计数器状态，M为输入控制端，当M 0时，进行递增计数，当
M 1时，进行递减计数。
Z为输出进位或借位信号
（2）状态转换真值表
根据电路功能及JK触发器的性质，状态转换真值表如下:
根据真值表作卡诺图化简得激励方程为：
J o 1
K o 1
J1 Q o M Q o M Q o M gQ o M
K1 J1
输出方程为：
Z Q1gQ o M gQ1Q o M
根据激励方程及输出方程，作出电路图如下:
(3)连接电路后，示波器观察Q「Q。
、Z的波形如下:
当M 0时，波形实现了递增计数功能，触发方式选择下降，得到实验波形如下，Q1, CP波形如下:
Q1, Q0波形如下:
Q1与进位退位信号Z波形如下:
当M 1时，波形有递减计数功能，触发方式选择上升
Q1与Q0波形:
Q1与进位信号Z波形:
(4)注意事项
1. 实验中需观察多个波形，故需选定某一波形为基准信号，其他信号通过与该信号比对判断结果是否错误。
2. 注意示波器触发选项，为使触发器从“零”开始工作，需要选择触发设置的信号端及触发选项(上升、下降)。
3. 同步模4技术实验连线较复杂，需准备足够导线及相应集成电路，连线时要有耐心。
5.3、十进制加减可逆计数器设计(附加实验题，未做)
设计方案
在十进制计数体制中，每位数都可能是0，1, 2, ,，9十个数码中的任意一个，且“逢十进一”。
根据计数器的构成原理，必须由四个触发器的状态来表示一位十进制数的四位二进制编码。
而四位编码总共有十六个状态。
所以必须去掉其中的六个状态，至于去掉哪六个状态，可有不同的选择。
这里考虑去掉1010〜1111六个状态，即采用8421BC［码的编码方式来表示一位十进制数。
8421BCD码异步十进制加计数器：用JK主从触发器组成的一位异步十进制加计数器如图所示。
1T
8.5.1 8421BCD码异步十遊制加计数器澎辑图⑹ 工作波形
1、电路结构：由四个JK主从触发器组成，其中FF0始终处于计数状态。
Q0 同时触发FF1和FF3, Q3反馈到J1，Q2Q1作为J3端信号。
2、工作原理：
(1)工作波形分析法由逻辑图可知，在FF3翻转以前，即从状态0000到0111 为止，各触发器翻转情况与异步二进制递增计数器相同。
第八个脉冲输入后，四个触发器状态为1000,此时Q3= 0,使下一个FF0来的负阶跃电压不能使FF1翻转。
因而在第十个脉冲输入后，触发器状态由1001变为0000,而不是1010,从而使四个触发器跳过1010〜1111六个状态而复位到原始状态0000,其工作波形
如图8(b)所示。
当第十个脉冲作用后，产生进位输出信号 C0=Q3QQ
3、触发器在异步工作时，若有 CP 触发沿输入，其状态由特征方程确定，否
则维持原态不变。
这时触发器的特征方程可变为 Qn+仁(JQ n+KQ n)Cp+Q nCH, 其中CPJ = 1表示有CP 触发沿加入，CP= 0表示没有CP 触发沿加入。
所以可以 写出 以下状态方程：
c
烬細皿师
J Qi =^QiCPd 根据以上状态方程，即可列出计数器的状态转移表。
七、实验总结
1、 本次实验有模3、模4两个实验，其中模3实验较简单，连线不复杂，模 4实验连线较复杂。
模3实验可作为多波形观察方法的入手实验，为模 4实验中 的波形观察，示波器设置打基础。
在实验时，首先要注意示波器触发时的信号源， 一般选为周期最长的信号。
其次，注意设置示波器触发方式，在递增计数时，选
择“下降触发”，在递减计数时，选择“上升触发”。
2、 书到用时方恨少，事非经过不知难。
实验课的效率和理论课的扎实水平是 正相关的，在实验中遇到问题时，如果理论课扎实，很快就能排除问题，如果理 论课不扎实，就会不知从何入手排查。
课本上的永远是最简单的，不经过实践，
不能对知识形成强烈的印象。
课本上的几根毫不在意的导线，可能就是葬送自己 实验的“陷阱”。
3、 这个实验横跨五一，时间跨度可谓很长了。
只记得自己还有一个模四的实 验没有验收，模三的实验还是比较简单的。
至于为什么在五一之前没有把模四的 实验验收掉的原因现在看来，估计是当时哪里的一根线连错了，直接导致了 Z 的 输出波形和参考的波形相差了四分之一个周期， 再加上时间也不是很长了，于是 就有了下次实验再验收的想法，现在看来，还是有点错误的。
五一之后的实验一 样的不好做，之前的实验又没有验收，学习的压力也逐渐大了起来，感觉自己也 比较吃力的，实验还是要好好做的。
老师的话也是为我们好的。
理论与实践的相 互结合，其学习的效果是非常大的。
以后对每个实验都应该尽全力做好。
(2)状态方程分析法： 首先列
出各触发器驱动方程:。