电子测量2013DDS-PLL-Osili

DFF
step[7..0]
INPUT VCC
如何正确调用 累加器
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如何从相位变换到模拟波形
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累加器到DAC的数据
累加器的位数（分辨率）是无限的； DAC的位数（分辨率）是有限的； 只能截取累加器最高若干位的累加结果；
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复杂触发 (Complex Trigger)
一种示波器 功能，用来根据 复杂的信号参数 确定和采集信号， 如欠幅脉冲、串 行或并行数字信 号码型及复杂的 触发事件序列。
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clk
d c
仿真结果
lpm_add_sub0
dataa[7..0] clock datab[7..0]
inst4
A A+B B
result[7..0]
cout
comp_adder
dataa[7..0] acc_dffs A 每周三下午 2:00 — 4:00教四301 result[7..0] A+B data[7..0] datab[7..0] 10:00—12:00教四401 单周五上午 B clock q[7..0] cout
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电子测量原理 DDS—锁相环-示波器
厚积薄发，天道酬勤
电子与信息工程学院电子信息工程系 2013版
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主要内容
DDS基本定义； DDS的主要参数； 全数字可编程脉冲发生器设计； 典型的DDS芯片；
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看看老外如何赚你
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波形的测量 数字示波器简介
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累加器开始累加的起始值不一 样，造成了相位的不一致。 累加器的起始值最小差值为1， 总周期被平均划分了2^N份；
1 N 2 2
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累加器的仿真结果
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深入认识累加器
输出=步进量+上一次加法的结果； 必须要有时钟信号，存储上一次运算结果； 也可以理解成加法器与D触发器级联；
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累加器的逻辑等效
每周三下午2:00—4:00教四301 单周五上午10:00—12:00教四 401 INPUT
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DDS的相位圆环
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相位累加器的逻辑实现
每周三下午2:00—4:00教四301 单周五上午 10:00—12:00教四 401 INPUT clk
d c
相位累加器的分辨率
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DDS的频率分辨率
M fc fo N 2
f c : 累加器的工作频率 M : 累加器的步进量 N : 累加器的位数（长度）
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高速总线 (High-speed Bus)
传送高 速数字信号 的一套导体， 通常位于计 算机各个功 能单元之间
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抖动 (Jitter)
信号有效时点距理想时点的短期变化。 每周三下午2:00—4:00教四301
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重建 (Reconstruction)
每周三下午2:00—4:00教四301 在波形采样点之间进行插补的过程，以把其恢复成连续时间波形 单周五上午10:00—12:00教四401
振铃 (Ringing)
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鳄鱼夹 (Alligator Clip)
鳄鱼夹 (Alligator Clip) 一种带合页的弹簧支撑的 夹子，带有金属钳叉，通 常用来把探头的参考引线 连接到电路中的接地测试 点上。
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单次 (Single Shot)
示波器上测得的只发生一次的信 号(也称为瞬态事件)。
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数字荧光示波器 (Digital Phosphor Oscilloscope)
一种数字示波 器，其模式与模拟 示波器显示特点非 常相近，同时提供 了传统数字示波器 的优势(如波形存储、 自动测量、等等)。
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浮动测量 (Floating Measurements）
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DAC的截断误差
数字到模拟的变换只能逼近，总会有误差
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量化误差造成的频谱“劣化”
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在电路共振时产生的振荡；一般是脉冲上看到的阻尼正弦曲线变化 。 每周三下午2:00—4:00教四301
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上升时间 (Rise Time)
脉冲前沿从低值上升到 高值所需的时间， 通常测量从10%上升到 90%所需的时间。
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DDS的频率分辨率
能够区分开的最小频率差异
( M 1) f c M f c f o N N 2 2 1 N fc 2
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DDS的相位分辨率
相位：信号变化先后的概念；
频率：信号变化快满的概念；
DDS是什么
直接数字频率合成器（Direct Digital Frequency Synthesizer）是一种基于全数字技 术，从相位概念出发直接合成所需波形的一种 频率合成技术。
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优点：
工作频率范围很宽； 极高的频率分辨力； 极短的频率转换时间； 任意波形输出能力； 数字调制性能好。
DAC截断误差的图形化解释
பைடு நூலகம்
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实际设计要求
请设计一个可编程脉冲发生器，要求： 频率分辨率：0.01Hz； 脉宽分辨率：1uS； 占空比<20%； 请给出参数推导过程和基本流程说明
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两个 测量 点都 不在 接地 电位 的测 量。
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接地环路 (Ground Loop)
把两个或多个点 上两条或多条分开的 接地路径捆绑在一起 而成； 环路中循环的电 流在环路内任何阻抗 上形成一个电压，因 此接地环路内部的各 个点不在同一个'接地 '电位上。