第二章微处理器的结构及微计算机的组成资料
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计算机原理
12
例： 设代码段寄存器CS的内容为1234H，指令指 针IP的内容为0022H，即(CS)＝1234H，(IP)＝ 0022H，则访问代码段存储单元的物理地址计算如 下：
左移4位 12340
1234 0022
段基值 逻辑地址
偏移量
整理课件
+）
002 2
1236 2
物理地址
13
整理课件
4. 6字节的指令队列（ISQ）
例： 49H＋6DH＝B6H，就是73＋109＝182， 补码B6H表达真值是-74，显然运算结果不正确； 计算结果超出－128～＋127范围，产生溢出，故 OF＝1。
30
整理课件
奇偶标志PF（Parity Flag） – 当运算结果最低字节中“1”的个数为零或偶 数时，PF = 1；否则PF = 0 – PF 标 志 仅 反 映 最 低 8 位 中 “ 1” 的 个 数 是 偶或奇，即使是进行16位字操作
地址指针寄存器用于存放操作数的地址，编程 时通过修改寄存器的内容达到修改地址的目的。
通过地址指针寄存器寻址内存内的数据
SP为堆栈指针寄存器，指示栈顶的偏移地址, SP不能再用于其他目的，具有专用目的
23
整理课件
BP为基址指针寄存器，表示数据在堆栈段中一 个数据区的基地址，SP和BP寄存器与SS段寄存 器联合使用以确定堆栈段中的存储单元地址。
整理课件
对其中某8位的操作，并不影 响另外对应8位的数据 ；
数据寄存器用于存放操作数及 中间结果，也可以存放地址；
AX和AL可用作累加操作，因
此又可称作累加器。
21
每个寄存器又有它们各自的专用目的
– AX－－累加器，使用频度最高； 用于算术、逻辑运算存放中间结果； 与外设传送信息等
例： 设代码段寄存器CS的内容为1234H，指令指 针IP的内容为0022H，即(CS)＝1234H，(IP)＝ 0022H，则访问代码段存储单元的物理地址计算如 下：
左移4位 12340
1234 0022
段基值 逻辑地址
偏移量
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+）
002 2
1236 2
物理地址
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4. 6字节的指令队列（ISQ）
例： 49H＋6DH＝B6H，就是73＋109＝182， 补码B6H表达真值是-74，显然运算结果不正确； 计算结果超出－128～＋127范围，产生溢出，故 OF＝1。
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奇偶标志PF（Parity Flag） – 当运算结果最低字节中“1”的个数为零或偶 数时，PF = 1；否则PF = 0 – PF 标 志 仅 反 映 最 低 8 位 中 “ 1” 的 个 数 是 偶或奇，即使是进行16位字操作
地址指针寄存器用于存放操作数的地址，编程 时通过修改寄存器的内容达到修改地址的目的。
通过地址指针寄存器寻址内存内的数据
SP为堆栈指针寄存器，指示栈顶的偏移地址, SP不能再用于其他目的，具有专用目的
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BP为基址指针寄存器，表示数据在堆栈段中一 个数据区的基地址，SP和BP寄存器与SS段寄存 器联合使用以确定堆栈段中的存储单元地址。
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对其中某8位的操作，并不影 响另外对应8位的数据 ；
数据寄存器用于存放操作数及 中间结果，也可以存放地址；
AX和AL可用作累加操作，因
此又可称作累加器。
21
每个寄存器又有它们各自的专用目的
– AX－－累加器，使用频度最高； 用于算术、逻辑运算存放中间结果； 与外设传送信息等
第2章微型计算机系统的组成及工作原理
2.5.6 ISA总线的定义与应用
2. ISA总线的信号线定义 ——98芯插槽，包括地址线、数据线、控制线、时钟和电源线 (1)地址线：SA019和LA1723 (2)数据线：SD015 (3)控制线：AEN、BALE、 IOR 和 IOW、 SMEMR和 SMEMW
MEMR 和 MEMW、 MEM CS16 和 I/O CS16 、SBHE
2.1.2 微机系统的软件配置
系统软件、工具软件、应用软件、用户应用程序
.3 微机系统中的信息流与信息链
1. 微机系统中信息流与信息链的构成 信息流：存储器中的数据、程序代码；接口寄存器中的I/O数据、 状态、I/O命令 信息链：信息流在系统中流动的路径； 包括物理(硬件)环节和逻辑(软件)环节 2. 微机系统中信息流与信息链 ——早期微机系统/现代微机系统中的信息链 3. 研究信息流与信息链的意义 ——通过信息流从整体上认识微机体系结构和组成微机系统的各 部件之间的关系
2.5.7 现代微机总线技术的新特点
3. 总线桥 (1) 总线桥 ——总线转换器和控制器，是两种不同总线间的总线接口 内部包含兼容协议及总线信号和数据缓冲电路；把一条总线映 射到另一条总线上 北桥：连接CPU总线和PCI总线的桥 南桥：连接PCI总线和本地总线(如ISA)的桥 (2) PCI总线芯片组 ——实现总线桥功能的一组大规模集成专用电路 保持主板结构不变前提下，改变这些芯片组的设计，即可适应 不同微处理器的要求 4. 多级总线结构中接口与总线的连接
2.4 I/O设备与I/O设备接口
2.4.1 I/O设备及其接口的作用
1. I/O设备的作用 2. I/O设备接口的作用——连接与转换
2.4.2 I/O设备的类型及设备的逻辑概念
第2章微型计算机的组成及应用
2. 微型计算机分类
按主机、I/0接口和系统总线组成部件所在位置 划分为：
① 单片机：组成部件集成在一个超大规模芯片 上，用于控制仪器仪表等。、
② 单板机：各组成部件装配在一块电路板上， 常用于实验控制。
③ 多板机：各组成部件装配在多块电路板上， 如台式微型计算机、便携式PC机。
2.1.2 微型计算机系统的配件
2.4.2 CMOS
“小随机存储器”，靠电池供电。用于保存系统当 前配置，如系统日期和时间、硬盘格式和容量、内存 容量等。这些信息既是系统启动时必读信息，也是更 新硬件时要修改的信息。
2.4.3 高速缓存Cache
为了解决CPU与内存之间速度不匹配的问题，引 入高速缓存技术。高速缓存介于内存和CPU之间，是高 速存取信息的芯片。它存取速度比内存快，但容量不 大，主要用于存放当前使用最多的程序段和数据块， 并以接近CPU的速度向CPU提供程序指令和数据。
AGP（Accelerated Graphics Port）扩展槽：专门用于图形显示 卡，是在PCI总线基础上发展起来的，主要针对图形显示方面 进行了优化。AGP插槽通常是棕色，随着显卡速度的提高， AGP接口已经不能满足显卡传输数据速度的要求，目前AGP 显卡已经逐渐被PCI Express接口显卡所取代。
2.4 微型机系统存储器
内存是微机重要配置之一，内存容量及性能是影响微机性 能的重要因素。在Pentium Ⅲ系列微型计算机中，内存条以使 用168 Pin SDRAM(同步动态随机存取存储器 )型为主，目前在 Pentium 4系列微型计算机中，多数采用DDR内存条。
图2.3.1 微型计算机内存储器（条）
为方便识别主板上的各种接口，PC99技术规格规 范了主板设计要求，提出主板各接口必须采用颜色识 别标识。
微处理器与系统结构PPT详细讲解
•29 •HLDA* •28 •WR*
有效，三态)
•27 •M/IO* 测试信号(输入、低电
•26 •DT/R* •25 •DEN*
平有效)
•24 •23 •22
•ALE* •INTA* •TEST
READY 准备就绪(输入 、高电平有效)
•21 •READY
•RESET
状态信号指示当前使用段
一、8086通用引脚信号
•1
•40 •VCC
•2
•39 •AD15 INTR可屏蔽中断请求
•3 •4
•38 •A16/S3 •37 •A17/S4
信号(输入、高有效)
•5 •6
•36 •35
•A18/S5 •A19/S6
NMI非屏蔽中断请求(
•7 •8
•34 •BHE/S7 •33 •MN/M
输入，上升沿触发)
•GND •AD14 •AD13 •AD12 •AD11 •AD10 •AD9 •AD8 •AD7 •AD6 •AD5 •AD4 •AD3 •AD2 •AD1 •AD0 •NMI •INTR •CLK •GND
二、8086最小模式引脚信号
M/ 存储器/IO控制信号
•1 •2 •3
•40 •39 •38
微处理器与系统结构PPT详 细讲解
第二章学习要点
重点掌握内容： 1．微处理器的基本结构。 2．Intel 8086微处理器的基本结构，包括： 功能结构、寄存器结构和总线结构。 3．Intel 8086微处理器系统的组成： 控制核心单元＋存储器组织＋I/O端口组织 4．Intel 8086微处理器在最小模式下的典型总线 操作和时序。 5．几个重要概念：时钟周期，总线周期，指令周期。
微处理器的体系结构
兼容性
针对系列计算机 要求所有机种间能够保持向上兼容和向后兼容 向上兼容：为某个档次机种编制的软件能够不加修 改地运行在比它高档的机种上 向后兼容：为某个时期生产的机种编制的软件能够 不加修改地运行在它之后生产的机种上 Pentium微处理器的运行模式：实模式、保护模式
兼容性 针对（软件）体系结构，非硬件实现
1000：1234 0100：ABCD
计算机体系结构是程序员所看到的系统的一些属性： 概念性的结构和功能上的表现，这些属性既不同于数 据流和控制的组织，也不同于逻辑设计和物理实现。
Amdahl,1964
计算机体系结构是连接硬件和软件的一门学科，它研 究的内容不但涉及计算机硬件，也涉及计算机软件。
计算机体系结构与计算机组成
区别在于关心的问题不同： •计算机体系结构关心的是怎样合理地进行软硬 件功能分配，为软件人员提供适用的计算机 •计算机组成关心的是怎样合理地实现分配给硬 件的功能和指标，提高性能价格比
第二章 Pentium微处理器的体系结构
2.1 计算机体系结构的含义 2.2 Pentium微处理器的内部结构 2.3 实模式软件体系结构 2.4 保护模式软件体系结构 2.5 浮点部件软件体系结构
2.1 计算机体系结构的含义
计算机体系结构 = computer architecture (计算机系统结构)
简单指令：完全由硬件执行而无需任何微码控制， 在一个时钟周期内执行的指令
•mov reg, reg/mem/imm •mov mem,reg/imm •alu reg, reg/mem/imm •alu mem, reg/imm •inc reg/mem •dec reg/mem •push reg/mem •pop reg •lea reg, mem •jmp/call/jcc near •nop
微型计算机系统(全)
第 二 章 微型计 算 机系统 第 一 章：计 算 机 基 础 知 识
2.2.4 微机总线
1．按层次结构分类 （1）内部总线 内部总线是微机内部各芯片与CPU之间的连线，用于芯片一级的 互连。 （2）系统总线 系统总线是微机中各插件板与主板之间的连线，用于插件板一级 的互连。 ① PCI总线 （3）外部总线 外部总线是微机与外部设备之间的连线。 ② AGP总线
第 二 章 微型计 算 机系统 第 一 章：计 算 机 基 础 知 识
2.3.3 输出设备
1 显示器：显示器由监视器和显示适配卡组成，是 最常用的输出设备。 2 打印机：打印机也是计算机中最常用的输出设备。 按输出方式可分为击打式和非击打式，击打式以针 式打印机为主要代表，非击打式以激光打印机和喷 墨打印机为主流。
高级语言 源程序 编译
机器语言 目标程序 运行
执行 结果
高级语言 源程序 解释并执行
执行 结果
编译过程示意图
解释过程示意图
第 二 章 微型计 算 机系统 第 一 章：计 算 机 基 础 知 识
2．应用程序 应用程序是用各种高级语言编写出来的具有 特定功能的程序，例如：Word、NetAnt、金山解 霸等。应用程序是面向用户的最高层程序。 （1）文字处理软件 （2）信息管理软件 （3）辅助设计软件 （4）实施控制软件
第 二 章 微型计 算 机系统 第 一 章：计 算 机 基 础 知 识
2．按功能分类
（1）数据总线（Data Bus，DB） 数据总线用于传递数据信息。 （2）地址总线（Address Bus，AB） 地址总线用于传送CPU发出的地址信息，如要访问的内存 地址、外部设备地址等。 （3）控制总线（Control Bus，CB） 控制总线是用来传送控制信号、命令信号和定时信号的， 这些信号是由CPU发出的，因此是单向的。
微型计算机硬件组成.ppt
计算机文化基础
5
常见微机系统
平板电脑 移动计算机
计算机、电视、影 音三模式
家庭网络计算机
6
微机基本结构 显示器、键盘和主机
7
2.1.2 微型计算机的分类
1 按组成结构分类 单片机 组成部分集成在一个超大规模芯片上，广泛 用于控制、仪器仪表、通信、家用电器等领域。 单板机 各组成部分装配在一块印刷电路板上，常用 于过程控制或作为仪器仪表的控制部件 。 多板机 各组成部分装配在多块印刷电路板上，如台 式、便携式PC 机。
2
计算机系统的组成
运算器
CPU
寄存器 控制器
硬件
主机
内存
随机存储器(RAM) 只读存储器(ROM) 高速缓冲存储器
计
输入设备：键盘、鼠标、扫描仪
算 机
外部设备
输出设备：显示器、打印机 外 存：软、硬盘、光盘、闪存
系
网络设备：网卡、调制解调器等
统
操作系统：Windows、Unix、Linux
系统软件 语言处理程序：C、Pascal、VB等
使用单片机芯片构成的仿真系统。
有镜像功能的单板机
2019/12/17
计算机文化基础
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微型计算机的发展方向
① 高速化 处理器主频
② 超小型化 典型的标志是笔记本电脑和PDA的流行。
③ 多媒体化 全新的多媒体处理芯片、多媒体和超媒体系 统的开发和标准化、虚拟现实技术和发展多媒体通信等。
④ 网络化 网络计算机、具有联网功能的PDA以及各种类 型的个人计算机等正在飞速发展。
主板板载了四条DDR2内存插槽，支持 最高8GB DDR2-800内存容量和双通道 技术。另外，内存插槽的周围布满了不 少铝壳固态电容，内存的工作稳定性完 全得以保障。
微机原理第二章8086微处理器
▪ 表面上看来，微处理器的外部就是数量有限的输入输出 引脚。但是，正是依靠这些引脚与其它逻辑部件相连接， 才能组成多种型号的微型计算机系统。
▪ 这些引脚就是微处理器级总线。微处理器通过微处理器 级总线沟通与外部部件和设备之间的联系。这些总线及 其信号必须完成以下功能：
▪ （1）和存储器之间交换信息； ▪ （2）和I/O设备之间交换信息； ▪ （3）为了系统工作而接收和输出必要的信号，如输入
▪ 时钟信号输入端。19 CLK（输入） ▪ 8086和8088为5MHz。 ▪ 8086/8088的CLK信号必须由8284A时钟发生器产生。 ▪ 微处理器是在统一的时钟信号CLK控制下，按节拍进行
工作的。
2021/6/12
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8086/8088微处理器——微处理器的引脚功能
▪ 工作方式控制线 33
指令执行示例
2021/6/12
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第二章：8086/8088微处理器
1. 微处理器ห้องสมุดไป่ตู้结构 2. 微处理器的内部寄存器 3. 微处理器的引脚功能 4. 微处理器的存储器组织 5. 最大模式和最小模式 6. 微处理器的时序
2021/6/12
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▪ 存储器分段
▪ 由于CPU内部的寄存器都是16位的，为了
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第二章：8086/8088微处理器
1. 微处理器的结构 2. 微处理器的内部寄存器 3. 微处理器的引脚功能 4. 微处理器的存储器组织 5. 最大模式和最小模式 6. 微处理器的时序
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8086/8088微处理器——微处理器的引脚功能
▪ 一、微处理器的外部结构
时钟脉冲、复位信号、电源和接地等。
▪ 这些引脚就是微处理器级总线。微处理器通过微处理器 级总线沟通与外部部件和设备之间的联系。这些总线及 其信号必须完成以下功能：
▪ （1）和存储器之间交换信息； ▪ （2）和I/O设备之间交换信息； ▪ （3）为了系统工作而接收和输出必要的信号，如输入
▪ 时钟信号输入端。19 CLK（输入） ▪ 8086和8088为5MHz。 ▪ 8086/8088的CLK信号必须由8284A时钟发生器产生。 ▪ 微处理器是在统一的时钟信号CLK控制下，按节拍进行
工作的。
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8086/8088微处理器——微处理器的引脚功能
▪ 工作方式控制线 33
指令执行示例
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第二章：8086/8088微处理器
1. 微处理器ห้องสมุดไป่ตู้结构 2. 微处理器的内部寄存器 3. 微处理器的引脚功能 4. 微处理器的存储器组织 5. 最大模式和最小模式 6. 微处理器的时序
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▪ 存储器分段
▪ 由于CPU内部的寄存器都是16位的，为了
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第二章：8086/8088微处理器
1. 微处理器的结构 2. 微处理器的内部寄存器 3. 微处理器的引脚功能 4. 微处理器的存储器组织 5. 最大模式和最小模式 6. 微处理器的时序
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8086/8088微处理器——微处理器的引脚功能
▪ 一、微处理器的外部结构
时钟脉冲、复位信号、电源和接地等。
第2章 微型计算机和微处理器的结构
2.1.1 微处理器（微处理机）
微处理器：是微型计算机的中央处理部件，是由一片 或几片大规模集成电路组成的中央处理器，一般也称 CPU（Center Process Unit）。其内部通常包括算术逻辑 部件，累加器、通用寄存器组，程序计数器，时序和控制 逻辑部件，内部总线等等。 2.1.2 存储器
存储结果 1
取指令 4
……
EU
……
译码 1
执行 1
译码 2
执行 2
……
（b）流水处理
如图： 8086/8088 CPU 由于指令执行部件EU和总线接口 部件BIU相互独立，可并行操作，进行流水线处理。若一条指 令执行过程中不需要从存储器取操作数和向存储器存储结果， 即不占CPU总线时间，总线接口部件便可对下一条要执行的指 令预取。可见。采用流水线技术提高了指令执行速度。
2.2.3 8086/8088微处理器的功能结构 从功能上来看，8086/8088 CPU可分为两部分，即总线接 口部件BIU（Bus Interface Unit）和执行部件EU（Execution Unit）。
图2.3 8086/8088CPU内部功能结构图
(1) 执行部件（EU）
功能：负责指令的执行。(主要进行8位及16位的各种运算) 组成：①ALU(算术逻辑单元)； ②通用寄存器组； ③标志寄存器（ FLAGS ）。 ①通用寄存器（AX、BX、CX、DX） 8086 有4个16位的通用寄存器（AX、BX、CX、DX）， 可以存放16位的操作数，也可分为8个8位的寄存器（AL、AH； BL、BH；CL、CH；DL、DH）来使用。其中AX称为累加器， BX称为基址寄存器，CX称为计数寄存器，DX称为数据寄存 器。这些寄存器在具体使用上有一定的差别，如表2-1所示。
微机复习资料2
10550H
CS
250A0H
右图所示。
操作数的物理地址为：
2EF00H
DS ES
250AH×10H+0204H= 252A4H
8FF00H
SS
堆栈及堆栈段的使用
内存中一个按FILO方式操作的特殊区域； 每次压栈和退栈均以字节为单位； SS存放堆栈段地址，SP存放段内偏移，SS:SP构 成了堆栈指针； 堆栈用于存放返回地址、过程参数或需要保护的 数据； 常用于响应中断或子程序调用。
控制标志：3个
TF—陷阱标志位(单步标志位、跟踪标志)。当该位 置1时，将使8086/8088进入单步工作方式，通常 用于程序的调试。 IF—中断允许标志位，若该位置1，则处理器可以响 应可屏蔽中断，否则就不能响应可屏蔽中断。 DF—方向标志位，若该位置1，则串操作指令的地址 修改为自动减量方向，反之，为自动增量方向。
曹 晶
1
主要内容：
8088/8086 CPU的结构及工作原理 系统总线
2
§2.1 微处理器概述
3
运算器
微处理器 存储器 I/O接口 总线 ALU 寄存器 控制器
硬件系统 微 型 计算机 系 统 软件系统
微 型 计算机 (主机)
外 设 系统软件 应用软件
键盘、鼠标 显示器 软驱、硬盘、光驱 打印机、扫描仪
10
串行工作方式：
CPU BUS
取指令 1
执行 1
存结果 1
取指令 2
取操 作数2执行 2 Nhomakorabea忙碌忙碌
忙碌
忙碌
1） CPU访问存储器(存取数据或指令)时要等待总线 操作的完成 2） CPU执行指令时总线处于空闲状态 缺点：CPU无法全速运行。 解决：总线空闲时预取指令，使CPU需要指令时能立 刻得到。 11
微型计算机-第2章 8086微型计算机系统
第2章 8086微型计算机系统
4、总线控制逻辑 微型计算机系统采用总线结构 总线是连接计算机各组成部件的公共数据通路。 在微型计算机系统中，总线分为：
片内总线：连接CPU内部的各个部件； 片级总线：连接CPU、存储器及I/O接口等电
路，构成所谓的主机板； 系统总线：用来连接外部设备。系统总线的
第2章 8086微型计算机系统
本章主要内容
1 半80导86体微处存理储器器的的结分构类及工作模式 2 8086微处理器的引脚特性 3 8086微型计算机系统的总线时序 4 8086微型计算机系统的组成
第2章 8086微型计算机系统
2.1 概述
微型计算机（简称微机）： 将计算机的核心器件中央处理器（运算 器和控制器）集成在一块半导体芯片上 ，配以存储器、I/O接口电路及系统总 线等设备的计算机。
总线控制逻辑的任务就是产生和接受这些操作 所需要的信号。
第2章 8086微型计算机系统
5、外存储器
也称辅存或外存，用来存储大量暂时不参加运算或处 理的数据和程序，是主存的后备和补充。
常见的外存储器主要有： 硬盘：安装在主机箱内，常见容量有：80GB、 120GB、250GB等。 光盘：信息读取要借助于光驱，其容量为650MB。 DVD光盘：存储密度高，存储容量大，容量一般为 4.7GB。 优盘：是利用闪存在断电后还能保持存储的数据不 丢失的特点而制成的，特点是重量轻、体积小。 移动硬盘：可以通过USB接口即插即用，特点是体 积小、重量轻、容量大、存取速度快。
内存储器分为随机存取存储器（RAM）和只读存储器 （ ROM）两大类。 随机存储器：RAM接受程序的控制，可由用户写 入数据或读出数据，但是断电后数据会消失。 RAM可以用来临时存放程序、输入数据和中间结 果等。 只读存储器：ROM中的信息由厂家预先写入，一 般用来存放自检程序、配置信息等。通常只能读 出而不能写入，断电后信息不会丢失。
4、总线控制逻辑 微型计算机系统采用总线结构 总线是连接计算机各组成部件的公共数据通路。 在微型计算机系统中，总线分为：
片内总线：连接CPU内部的各个部件； 片级总线：连接CPU、存储器及I/O接口等电
路，构成所谓的主机板； 系统总线：用来连接外部设备。系统总线的
第2章 8086微型计算机系统
本章主要内容
1 半80导86体微处存理储器器的的结分构类及工作模式 2 8086微处理器的引脚特性 3 8086微型计算机系统的总线时序 4 8086微型计算机系统的组成
第2章 8086微型计算机系统
2.1 概述
微型计算机（简称微机）： 将计算机的核心器件中央处理器（运算 器和控制器）集成在一块半导体芯片上 ，配以存储器、I/O接口电路及系统总 线等设备的计算机。
总线控制逻辑的任务就是产生和接受这些操作 所需要的信号。
第2章 8086微型计算机系统
5、外存储器
也称辅存或外存，用来存储大量暂时不参加运算或处 理的数据和程序，是主存的后备和补充。
常见的外存储器主要有： 硬盘：安装在主机箱内，常见容量有：80GB、 120GB、250GB等。 光盘：信息读取要借助于光驱，其容量为650MB。 DVD光盘：存储密度高，存储容量大，容量一般为 4.7GB。 优盘：是利用闪存在断电后还能保持存储的数据不 丢失的特点而制成的，特点是重量轻、体积小。 移动硬盘：可以通过USB接口即插即用，特点是体 积小、重量轻、容量大、存取速度快。
内存储器分为随机存取存储器（RAM）和只读存储器 （ ROM）两大类。 随机存储器：RAM接受程序的控制，可由用户写 入数据或读出数据，但是断电后数据会消失。 RAM可以用来临时存放程序、输入数据和中间结 果等。 只读存储器：ROM中的信息由厂家预先写入，一 般用来存放自检程序、配置信息等。通常只能读 出而不能写入，断电后信息不会丢失。
2.第二章 8086系统结构
总线接口部件BIU SI:（Source Index）：SI含有源地址意思,产 生有效地址或实际地址的偏移量。 总线接口部件BIU内部设 有四个16位段地址寄存器： DI:（Destination Index）：DI含有目的意思, 代码段寄存器CS、数据段寄 产生有效地址或实际地址的偏移量。 存器DS、堆栈段寄存器SS和 播 音 附加段寄存器ES，一个16位 ： 指令指针寄存器IP，一个6字 16位字利用了9位。 标志分两类： 节指令队列缓冲器，20位地 状态标志（6位）:反映刚刚完成的操作结果情况。 址加法器和总线控制电路。
志(结果低8 CLC(复位)， 位1的个数 CMC(求反)。 为偶数 PF=1) 。
15
14
13
12
11
10
9
8
3
2
1
0
OF DF IF TF
SF ZF
AF
PF
CF
DF：方向标志 .DF=1使串 操作按减地址进行,DF=0按 增地址进行。指令： CLD(复位), STD(置位).
TF：陷阱标志或单步操作标志 IF：中断允许 标志 图 2-6 8086CPU标志寄存器 目录
通用寄存器（数据寄存器） ： AX 累加器 BX 基址寄存器 CX 计数寄存器 DX 数据寄存器
SP BP SI DI
IP
地址指针和变址寄存器： SP 堆栈指针寄存器 BP 基址指针寄存器 SI 源变址寄存器 控制寄存器: DI 目的变址寄存器 IP 指令指针寄存器
FLAGS
CS DS SS ES
段寄存器: CS 代码段寄存器 DS 数据段寄存器 SS 堆栈段寄存器 ES 附加段寄存器
EU 总线 忙
执行1 忙
执行2 忙
第02章 微型计算机系统中的微处理器
主要引线（最小模式下）：
8088是工作在最小还是最大模式由MN/MX端状态决 定。MN/MX=0工作于最大模式，反之工作于最小模式
AD7---AD0：低8位地址和数据信号分时复 用。在传送地址信号时为单 向，传送数据信号时为双向。 A19--- A16：高4位地址信号，分时复用。 A15--- A8 ：输出8位地址信号。
第2章 微型计算机系统中的微处理器
2.1 微型计算机的组成及工作原理 2.1.1微型计算机基本结构（冯诺依曼结构）
存储程序工作原理是指把程序存储在计算机内， 使计算机能像快速存取数据一样地快速存取组 成程序的指令。为实现控制器自动连续地执行 程序，必须先把程序和数据送到具有记忆功能 的存储器中保存起来，然后给出程序中第一条 指令的地址，控制器就可依据存储程序中的指 令顺序周而复始地取指令、译码、执行，直到 完成全部指令操作为止，即控制器通过指令流 的串行驱动实现程序控制
2.1.2微处理器CPU
1、寄存器组 2、算术逻辑单元ALU 3、控制器 （1）程序计数器PC （2）地址寄存器AR （3）数据寄存器DR （4）指令寄存器IR和指令译码器ID （5）时许部件
2.1.3 总线
1、DB 2、AB 3、CB
2.1.4 存储器----P11 通常指内存，有读、写操作
图2-13 8086CPU最小模式下的典型配置
2．最大工作模式
由图2-4可知， 最大模式配 置和最小模 式配置有一 个主要的差 别： 最大模 式下多了 8288总线控 制器。
图2-4 8086CPU最大工作 模式下的典型配置
2.6 8086的总线时序
1．读周期的时序 2．写周期的时序
1．读周期的时序（图2-9）
第2章
微机8088第二章
15
1 0 0 1 1
OF DF IF TF SF ZF
0 1 0 1
AF PF
0
CF
FR
实模式下标志寄存器有9个标志位：6个状态标志位，3个控制标志位 状态标志位反映算术或逻辑运算后结果的状态： CF——进/借位标志。D7/D15向高位有进/借位，CF为1，否则为0。 PF——奇偶标志，运算结果中1的个数为偶数置1 AF——辅助进/借位标志，低4位/ 8位向高位产生进/借位置1，用于十进 制数运算调整。 ZF — 零标志，结果为0置1 SF ——符号标志，与运算结果的最高位相同。 OF — 溢出标志。反映有符号数作加法或减法运算时，运算结果是否 出现溢出的状态。OF=1，溢出。 字节：+127~-128； 字：+32767~-32768
微处理器的集成度
•指微处理器芯片上集成的晶体管的密度。 •最早Intel 4004的集成度为2250个晶体管，Pentium III的集 成度已经达到750万个晶体管以上，集成度提高了3000多倍 。
微处理器的发展概况 1971年～1977年是微处理器发展的早期阶段:
1971年：Intel 4004，是世界上
第三代：80386（1985年-1988年）
•第一个实用的32位微处理器，采用了 1.5m工艺，集成了275,000个晶体管 ，工作频率达到16MHz。80386的内 部寄存器、数据总线和地址总线都是 32 位 的 。 通 过 32 位 的 地 址 总 线 ， 80386的可寻址空间达到4GB。
•80386的其他一些版本：80386SX，包含16位数据总线 和24位地址总线，寻址空间为16MB；80386SL／ 80386SLC，包含 l6位数据总线和25位地址总线，寻址 空间为32MB。由于这些微处理器由于与I/O之间传输 为16位，故也称为准32位微处理器。
NEW02_第二章_微处理器_part2
微机原理与接口
Pentium性能简介
Pentium通往外部存储器的数据总线为64位， CPU内部主要寄存器的宽度仍然为32位，那么 Pentium、Pentium（P54C）应该是32位微处理器 。外部64位数据总线（D63-D0）每次可同时传输8 字节的二进制信息，若选用主总线时钟频率66MHz 计算，即存储器总线的时钟频率也为66MHz，则 Pentium与主存储器交换数据的速率可为528MB/S 。
微机原理与接口
Pentium CPU原理结构图
微机原理与接口
2.6.1 Pentium的原理结构
二、原理结构 在Pentium CPU中，总线接口部件实现 CPU与系统总线之间的连接，其中包括64位 双向的数据线、32位地址线和所有的控制信 号线，具有锁存与缓冲等功能，总线接口部 件实现CPU与外设之间的信息交换，并产生 相应的各类总线周期。
··· ·· ··
微机原理与接口
从上述程序可以看出，许多分支转移指令 转向每个分支的机会不是均等的，而且大多数 分支转移指令排列在循环程序段中，除了一次 跳出循环体之外，其余转移的目标地址均在循 环体内。因此，分支转移指令的转移目标地址 是可以预测的，预测的依据就是前一次转移目 标地址的状况，即根据历史状态预测下一次转 移的目标地址。预测的准确率不可能为100%， 但是对于某些转移指令预测的准确率却非常高。
U、V流水线中整数指令流水线均由5段组成。分别 为预取指令（PF）、指令译码（D1）、地址生成（ D2）、指令执行（EX）和结果写回（WB）。
由于采用了指令流水线作业，每条指令流水线可以 在1个时钟周期内执行一条指令。因此，最佳情况 下一个时钟周期内可以执行两条整数指令。
微机原理与接口
第2章 Pentium系列微处理器的基本结构
控制寄 存器组
整数寄存器组 64 64位数 据总线 32 32位地 址总线 ALU（U流水） ALU（V流水） 32 32 TLB 32 数据高速缓存（8KB） 80 桶形移位器
加法 除法 80 乘法
2.1.1总线接口部件 1.地址收发器和驱动器 2.数据总线收发器 3.总线宽度控制
4.写缓冲
5.总线周期和总线控制
–（2）超流水线和超标量技术
超流水线是指CPU内部的流水线超过通常的5～6步。 流水线的步数越多，完成一条指令的速度就越快。超标 量(Super-Scalar)是指CPU中有一条以上的流水线，并且 每时钟周期可以完成一条以上的指令。
–3）乱序执行技术
乱序执行(Out-of-Order Execution)是指CPU采用了允 许将多条指令不按程序规定的顺序，分开发送给各相应 电路单元处理的技术。。。。。
解决方法：① 延迟等待，使指令推迟执行； ② 设置重复资源，将指令和数据分 别存放在两个存储器中。 （2）数据相关：在一个程序中，如果必须等 前一条指令执行完，才能执行后一条指令， 这两条指令即为数据相关。当多条指令重叠 处理时，可能发生冲突。 解决方法：① 采用定向传送技术； ② 编译优化。
A-B-C A-C
2.3 Pentium MMX系列CPU
中文名为“多能奔腾”。它是为改善PC图形、音响， 加速多媒体视听和为通信应用软件开发的新型处理 器，实际上是带有多媒体扩展结构MMX(Multi Media eXtension)的奔腾CPU芯片。采用多媒体CPU 的微机在进行视频、音频处理时，具有很平滑的视 频播放能力、清晰逼真的画面、完美的音响效果。
RISC的三个要素是： (1)一个有限的简单的指令集；(2)CPU配备大量的 通用寄存器；(3)强调对指令流水线的优化。 基于三要素的RISC机器的特征是： (1)使用等长指令，目前的典型长度是4个字节。 (2)寻址方式少且简单，一般为2—3种，最多不超 过4种，绝不出现存储器间接寻址方式。 (3)只有取数指令、存数指令访问存储器。指令中 最多entium PⅡ
整数寄存器组 64 64位数 据总线 32 32位地 址总线 ALU（U流水） ALU（V流水） 32 32 TLB 32 数据高速缓存（8KB） 80 桶形移位器
加法 除法 80 乘法
2.1.1总线接口部件 1.地址收发器和驱动器 2.数据总线收发器 3.总线宽度控制
4.写缓冲
5.总线周期和总线控制
–（2）超流水线和超标量技术
超流水线是指CPU内部的流水线超过通常的5～6步。 流水线的步数越多，完成一条指令的速度就越快。超标 量(Super-Scalar)是指CPU中有一条以上的流水线，并且 每时钟周期可以完成一条以上的指令。
–3）乱序执行技术
乱序执行(Out-of-Order Execution)是指CPU采用了允 许将多条指令不按程序规定的顺序，分开发送给各相应 电路单元处理的技术。。。。。
解决方法：① 延迟等待，使指令推迟执行； ② 设置重复资源，将指令和数据分 别存放在两个存储器中。 （2）数据相关：在一个程序中，如果必须等 前一条指令执行完，才能执行后一条指令， 这两条指令即为数据相关。当多条指令重叠 处理时，可能发生冲突。 解决方法：① 采用定向传送技术； ② 编译优化。
A-B-C A-C
2.3 Pentium MMX系列CPU
中文名为“多能奔腾”。它是为改善PC图形、音响， 加速多媒体视听和为通信应用软件开发的新型处理 器，实际上是带有多媒体扩展结构MMX(Multi Media eXtension)的奔腾CPU芯片。采用多媒体CPU 的微机在进行视频、音频处理时，具有很平滑的视 频播放能力、清晰逼真的画面、完美的音响效果。
RISC的三个要素是： (1)一个有限的简单的指令集；(2)CPU配备大量的 通用寄存器；(3)强调对指令流水线的优化。 基于三要素的RISC机器的特征是： (1)使用等长指令，目前的典型长度是4个字节。 (2)寻址方式少且简单，一般为2—3种，最多不超 过4种，绝不出现存储器间接寻址方式。 (3)只有取数指令、存数指令访问存储器。指令中 最多entium PⅡ
第二章_微型计算机基础
例：Intel 8088/8086、PIII、P4、Celeron
CPU的位数是指能同时处理的二进制数据的位数， 有4位、8位、16位、32位、64位之分，位数越多 处理能力越强。
7
主机硬件系统之二：存储器
存储器是存放程序和数据的记忆装置，分为内存 和外存。
内存：ROM、RAM，用来存放当前正在执行的 程序和正在处理的数据。
8086的流水线操作
8086CPU流水线的实现 BIU不断地从存储器取指令送入指令队列IPQ，EU不 地从IPQ取出指令执行 EU和BIU构成了一个简单的2段流水线 指令预取队列IPQ是实现流水线操作的关键（类似于 工厂流水线的传送带）
新型CPU将一条指令划分成更多的阶段，以便可以同时执 行更多的指令 例如，PIII为14个段，P4为20个段（超标量流水线）
CPU送到AB上的20位的地址称为物理地址。
34
物理地址：数据交换时CPU使用的实际地址
物理地址
存储器的操作完全基 于物理地址。 ➢问题： 8086的内部总线和内 部寄存器均为16位， 如何生成20位地址？ ➢解决：存储器分段
. . 60000H F0H 60001H 12H 60002H 1BH 60003H 08H 60004H . . .
10
存储器相关概念3：内存储器的分类
读写存储器（RAM）
可读可写 易失性，临时存放程序和数据 RAM又分静态RAM和动态RAM，即SRAM、DRAM
只读存储器（ROM）
工作时只能读 非易失性，永久或半永久性存放信息
11
主机硬件系统之三：输入输出接口
I/O接口是指主机与外设的交接部分，位于系统 总线和外设之间，是主机和外设联系的桥梁。
CPU的位数是指能同时处理的二进制数据的位数， 有4位、8位、16位、32位、64位之分，位数越多 处理能力越强。
7
主机硬件系统之二：存储器
存储器是存放程序和数据的记忆装置，分为内存 和外存。
内存：ROM、RAM，用来存放当前正在执行的 程序和正在处理的数据。
8086的流水线操作
8086CPU流水线的实现 BIU不断地从存储器取指令送入指令队列IPQ，EU不 地从IPQ取出指令执行 EU和BIU构成了一个简单的2段流水线 指令预取队列IPQ是实现流水线操作的关键（类似于 工厂流水线的传送带）
新型CPU将一条指令划分成更多的阶段，以便可以同时执 行更多的指令 例如，PIII为14个段，P4为20个段（超标量流水线）
CPU送到AB上的20位的地址称为物理地址。
34
物理地址：数据交换时CPU使用的实际地址
物理地址
存储器的操作完全基 于物理地址。 ➢问题： 8086的内部总线和内 部寄存器均为16位， 如何生成20位地址？ ➢解决：存储器分段
. . 60000H F0H 60001H 12H 60002H 1BH 60003H 08H 60004H . . .
10
存储器相关概念3：内存储器的分类
读写存储器（RAM）
可读可写 易失性，临时存放程序和数据 RAM又分静态RAM和动态RAM，即SRAM、DRAM
只读存储器（ROM）
工作时只能读 非易失性，永久或半永久性存放信息
11
主机硬件系统之三：输入输出接口
I/O接口是指主机与外设的交接部分，位于系统 总线和外设之间，是主机和外设联系的桥梁。
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第二章 微处理器的结构 及微计算机的组成
2020/5/24
1
8086总线操作、中断系统及总线请求
1. 8086总线操作：8086微处理器与片外存储器
或I/O接口进行数据传输时，经BIU执行8086 规定的总线操作。
2. 8086的中断系统：8086微处理器可处理256种
中断。
3. 8086总线请求：在一个系统中，若存在多个
8086 中 断 分 类 图
2020/5
中断向量与中断向量表
➢中断向量：每种中断处理程序的入口地
址称为中断向量。
➢中断向量表：8086将内存最低地址的
1K单元作为中断向量表，存放256种中 断处理程序的入口地址，每个地址占4字 节。中断向量表的分配如下图所示：
基
本
定
时
P22
（最小方7式）
•8086最小方式下写总线周期时序
CLK
A19/S6-A16/S3 BHE S 7
AD15-AD0
ALE M/IO
WR DT/R
DEN
一个总线周期
T1
T2
T3
T4
8
0
Addr ,BHE
Status 输出
8
.
6
Addr 输 出 .
DATA 输出
写 总
线
周
LOW = I/O Write, HIGH=MEMORY READ
期
基
本
定
时
2020/5/24
(最小方式)
8
2. 8086中断系统
8086微处理器有处理256种中断的能力。 每个中断分配给一个中断类型码，在0～255 之间，用一字节表示，也称为256种类型中断。 256种类型中断分为硬件中断和软件中断。
➢ 硬件中断：外部硬件电路产生的中断。 ➢ 软件中断：8086操作过程中发生异常事件或
可控制总线的主模块时，总线使用权的转移 存在着一个请求与响应的过程。
2020/5/24
P21 2
1. 8086总线操作
总线周期的组成：8086的基本总线周期 为4个时钟周期，每个时钟周期间隔称为 一个T状态。
总线周期
总线周期
T1
CLK
T2
T3
T4
T1
T2
T3
T4
AD 地址
缓 冲 数 据 地址
缓冲
数据
e. 中断响应过程中8086不响应总线请求。
2020/5/24
15
3. 8086总线请求
在一个系统中，若存在多个可控制总线 的主模块时，总线使用权的转移存在着 一个请求与响应的过程。
最小模式下总线请求：
➢ 请求信号是HOLD,响应信号是HLDA； ➢ 8086在每个CLK上升沿检测HOLD信号； ➢ 当前总线周期结束时HLDA变高，响应请
求，8086让出总线控制权。
2020/5/24
P26
16
3. 8086总线请求（续）
a. INTA#在两个总线周期中分别发出有效信号，
第二周期中8086读到中断类型码
b. 保护现场：标志寄存器入栈，清除IF和TF标
志位，保护断点（下一条指令地址入栈）。
2020/5/24
13
8086中断响应时序
CLK
第一个中断响应总线周期 T1 T2 T3 T4
第二个中断响应总线周期 T1 T2 T3 T4
8086/8088中断向量表 占内存0000H段
0014H 0013H 0010H 000FH 000CH 000FH 0008H 0007H 0004H 0003H 0000H
溢出中断 断点中断 非屏蔽中断 单步中断 除数为 0
P25
12
2. 8086中断系统（续）
8086对外部硬件中断请求INTR的响应： 当INTR有一高电平，即有可屏蔽中断请求。 若此时IF=1且当前指令执行完，进入中断响 应周期，处理过程如下：
➢ALE 信号在 T1 出现，表明一个总线周
期开始，选通外部地址锁存器，锁存AD 总线上的地址信息。
➢在RD#、WR#等信号的配合下，T3、
T4期间完成数据访问。
➢T3 上升沿检测READY信号是否有效，
无效时在T3与T4间插入等待状态Tw。
2020/5/24
6
•8086最小方式下读总线周期时序
CLK
T3, T4:对于读或写总线周期，AD总线 上均为数据。 Tw: 当RAM或I/O接口速度不够时，T3 与 T4 之间可插入等待状态 Tw 。 Ti : 当BIU无访问操作数和取指令的任务 时，8086不执行总线操作，总线周期处 于空闲状态 Ti 。
2020/5/24
5
8086总线操作
8086最小方式下读写总线周期时序。
ALE LOCK#
INTA#
AD7~AD0
TYPE
2020/5/24
14
2. 8086中断系统（续）
c. 8086将中断类型码乘4，得到中断向量
表的入口地址，例如： 类型码=0CH，中断向量表入口=0030H
d. 8086从0030H开始读取4字节中断处理程
序的入口地址，前两字节装入IP，后两 字节装入CS，8086执行中断处理程序。
2020/5/24
3
8086总线操作
T1 状态：BIU将RAM或I/O地址放在地 址/数据复用总线（A/D）上。 T2 状态：
➢读总线周期：A/D总线为接收数据做准
备。改变线路的方向。
➢写总线周期： A/D总线上形成待写的数
据，且保持到总线周期的结束(T4)。
2020/5/24
4
8086总线操作
2020/5/24
11
:
用
CS
户 Type 225 定
IP
义
:
224
CS
个 Type 32
IP
CS
Type 31
保
IP
留
:
27 个 Type 5
CS
IP
CS Type 4
IP
8086 Type 3
CS
专
IP
用
5
Type 2
CS
个
IP
CS Type 1
IP
CS Type 0
IP 2020/5/24
03FFH 03FCH 0083H 0080H 007FH 007CH
执行中断指令INTn。
2020/5/24
P23
9
指令/CPU 启动的
软件中断（内部） INTn 指令
软件中断（外部）
非屏蔽中断请求 （2）
NMI
中断逻辑
INTR
中
INT3 断点 中断
（3）
INTO
溢出 中断 OF=1 （4）
单步 中断
TF=1 （1）
除数为 0 中断
（0）
断
可
控
屏
制
蔽 中
器
断
请
求
8259A
A19/S6- A16/S3 BHE S7
AD15-AD0 ALE
M/IO RD
DT/R
DEN
2020/5/24
BUS CYCLE
T1
T2
T3
T4
8
0
Addr ,BHE
Status 输出
8
.
6
Addr 输 出 .
DATA 输入
读 总
线
周
LOW = I/O READ , HIGH= MEM READ
期
2020/5/24
1
8086总线操作、中断系统及总线请求
1. 8086总线操作：8086微处理器与片外存储器
或I/O接口进行数据传输时，经BIU执行8086 规定的总线操作。
2. 8086的中断系统：8086微处理器可处理256种
中断。
3. 8086总线请求：在一个系统中，若存在多个
8086 中 断 分 类 图
2020/5
中断向量与中断向量表
➢中断向量：每种中断处理程序的入口地
址称为中断向量。
➢中断向量表：8086将内存最低地址的
1K单元作为中断向量表，存放256种中 断处理程序的入口地址，每个地址占4字 节。中断向量表的分配如下图所示：
基
本
定
时
P22
（最小方7式）
•8086最小方式下写总线周期时序
CLK
A19/S6-A16/S3 BHE S 7
AD15-AD0
ALE M/IO
WR DT/R
DEN
一个总线周期
T1
T2
T3
T4
8
0
Addr ,BHE
Status 输出
8
.
6
Addr 输 出 .
DATA 输出
写 总
线
周
LOW = I/O Write, HIGH=MEMORY READ
期
基
本
定
时
2020/5/24
(最小方式)
8
2. 8086中断系统
8086微处理器有处理256种中断的能力。 每个中断分配给一个中断类型码，在0～255 之间，用一字节表示，也称为256种类型中断。 256种类型中断分为硬件中断和软件中断。
➢ 硬件中断：外部硬件电路产生的中断。 ➢ 软件中断：8086操作过程中发生异常事件或
可控制总线的主模块时，总线使用权的转移 存在着一个请求与响应的过程。
2020/5/24
P21 2
1. 8086总线操作
总线周期的组成：8086的基本总线周期 为4个时钟周期，每个时钟周期间隔称为 一个T状态。
总线周期
总线周期
T1
CLK
T2
T3
T4
T1
T2
T3
T4
AD 地址
缓 冲 数 据 地址
缓冲
数据
e. 中断响应过程中8086不响应总线请求。
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15
3. 8086总线请求
在一个系统中，若存在多个可控制总线 的主模块时，总线使用权的转移存在着 一个请求与响应的过程。
最小模式下总线请求：
➢ 请求信号是HOLD,响应信号是HLDA； ➢ 8086在每个CLK上升沿检测HOLD信号； ➢ 当前总线周期结束时HLDA变高，响应请
求，8086让出总线控制权。
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P26
16
3. 8086总线请求（续）
a. INTA#在两个总线周期中分别发出有效信号，
第二周期中8086读到中断类型码
b. 保护现场：标志寄存器入栈，清除IF和TF标
志位，保护断点（下一条指令地址入栈）。
2020/5/24
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8086中断响应时序
CLK
第一个中断响应总线周期 T1 T2 T3 T4
第二个中断响应总线周期 T1 T2 T3 T4
8086/8088中断向量表 占内存0000H段
0014H 0013H 0010H 000FH 000CH 000FH 0008H 0007H 0004H 0003H 0000H
溢出中断 断点中断 非屏蔽中断 单步中断 除数为 0
P25
12
2. 8086中断系统（续）
8086对外部硬件中断请求INTR的响应： 当INTR有一高电平，即有可屏蔽中断请求。 若此时IF=1且当前指令执行完，进入中断响 应周期，处理过程如下：
➢ALE 信号在 T1 出现，表明一个总线周
期开始，选通外部地址锁存器，锁存AD 总线上的地址信息。
➢在RD#、WR#等信号的配合下，T3、
T4期间完成数据访问。
➢T3 上升沿检测READY信号是否有效，
无效时在T3与T4间插入等待状态Tw。
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•8086最小方式下读总线周期时序
CLK
T3, T4:对于读或写总线周期，AD总线 上均为数据。 Tw: 当RAM或I/O接口速度不够时，T3 与 T4 之间可插入等待状态 Tw 。 Ti : 当BIU无访问操作数和取指令的任务 时，8086不执行总线操作，总线周期处 于空闲状态 Ti 。
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5
8086总线操作
8086最小方式下读写总线周期时序。
ALE LOCK#
INTA#
AD7~AD0
TYPE
2020/5/24
14
2. 8086中断系统（续）
c. 8086将中断类型码乘4，得到中断向量
表的入口地址，例如： 类型码=0CH，中断向量表入口=0030H
d. 8086从0030H开始读取4字节中断处理程
序的入口地址，前两字节装入IP，后两 字节装入CS，8086执行中断处理程序。
2020/5/24
3
8086总线操作
T1 状态：BIU将RAM或I/O地址放在地 址/数据复用总线（A/D）上。 T2 状态：
➢读总线周期：A/D总线为接收数据做准
备。改变线路的方向。
➢写总线周期： A/D总线上形成待写的数
据，且保持到总线周期的结束(T4)。
2020/5/24
4
8086总线操作
2020/5/24
11
:
用
CS
户 Type 225 定
IP
义
:
224
CS
个 Type 32
IP
CS
Type 31
保
IP
留
:
27 个 Type 5
CS
IP
CS Type 4
IP
8086 Type 3
CS
专
IP
用
5
Type 2
CS
个
IP
CS Type 1
IP
CS Type 0
IP 2020/5/24
03FFH 03FCH 0083H 0080H 007FH 007CH
执行中断指令INTn。
2020/5/24
P23
9
指令/CPU 启动的
软件中断（内部） INTn 指令
软件中断（外部）
非屏蔽中断请求 （2）
NMI
中断逻辑
INTR
中
INT3 断点 中断
（3）
INTO
溢出 中断 OF=1 （4）
单步 中断
TF=1 （1）
除数为 0 中断
（0）
断
可
控
屏
制
蔽 中
器
断
请
求
8259A
A19/S6- A16/S3 BHE S7
AD15-AD0 ALE
M/IO RD
DT/R
DEN
2020/5/24
BUS CYCLE
T1
T2
T3
T4
8
0
Addr ,BHE
Status 输出
8
.
6
Addr 输 出 .
DATA 输入
读 总
线
周
LOW = I/O READ , HIGH= MEM READ
期