触发器画波形试题[1]
哈工大数字电子技术基础习题册2010-答案6-7章
哈工大数字电子技术基础习题册2010-答案6-7章第6章触发器【6-1】已知由与非门构成的基本RS触发器的直接置“0”端和直接置“1”端的输入波形如图6.1所示，试画出触发器Q端和Q端的波形。
R d SdQQ图 6.1解：基本RS触发器Q端和Q端的波形可按真值表确定，要注意的是，当dR和d S同时为“0”时，Q端和Q端都等于“1”。
d R和d S同时撤消，即同时变为“1”时，Q端和Q端的状态不定。
见图6.1（b）所示，图中Q端和Q端的最右侧的虚线表示状态不定。
R dS dQQ不定状态图6.1（b）题6-1答案的波形图【6-2】触发器电路如图6.2(a)所示，在图(b)中画出电路的输出端波形，设触发器初态为“0”。
QdS dQQR(a) (b)图6.2解：此题是由或非门构成的RS 触发器，工作原理与由与非门构成的基本RS 触发器一样，只不过此电路对输入触发信号是高电平有效。
参照题6-1的求解方法，即可画出输出端的波形，见图6.2(c)。
d S dQR 不定状态图6.2(c)【6-3】试画出图6.3所示的电路，在给定输入时钟作用下的输出波形，设触发器的初态为“0”。
“CPYZCP图 6.3解：见图6.3(b)所示，此电路可获得双相时钟。
Q Q CP Y Z图6.3(b)【6-4】分析图6.4所示电路，列出真值表，写出特性方程，说明其逻辑功能。
Q图6.4解：1．真值表(CP =0时，保持；CP =1时，如下表）D n Q n Q n+1 0 0 0 0 1 0 1 0 1 1 1 12．特性方程Q n+1=D n3．该电路为锁存器（时钟型D 触发器）。
CP =0时，不接收D 的数据；CP =1时，把数据锁存，但该电路有空翻。
【6-5】试画出在图6.5所示输入波形的作用下，上升和下降边沿JK 触发器的输出波形。
设触发器的初态为“0”。
CP J K图 6.5解：见图6.5(b)所示。
CP J KJ K QQ图6.5(b)【6-6】试画出图P6.6(a)所示电路，在图6.6(b)给定输入下的Q 端波形，设触发器初态为“0”。
(完整版)触发器时序逻辑电路习题答案
第4章 触发器4.3 若在图4.5电路中的CP 、S 、R 输入端，加入如图4.27所示波形的信号，试画出其Q 和Q 端波形，设初态Q =0。
SRCP图4.27 题4.3图解：图4.5电路为同步RS 触发器，分析作图如下：S RQ4.5 设图4.28中各触发器的初始状态皆为Q =0，画出在CP 脉冲连续作用下个各触发器输出端的波形图。
Q 11CPQ 3CPCPQ 2Q 6Q 4Q 5CP图4.28 题4.5图解：Q Q nn 111=+ Q Q n n 212=+ Q Q nn 313=+Q Q n n 414=+ Q Q n n 515=+ Q Q nn 616=+Q 1CP Q 2Q 3Q 4Q 5Q64.6 试写出 图4.29(a)中各触发器的次态函数（即Q 1 n+1 、 Q 2 n+1与现态和输入变量之间的函数式），并画出在图4.29（b ）给定信号的作用下Q 1 、Q 2的波形。
假定各触发器的初始状态均为Q =0。
1A BCP＞1D C1=1A BQ 1Q 2Q 2(a)BA(b)图4.29题4.6图解：由图可见：Q B A AB Q n n 111)(++=+ B A Q n ⊕=+12B A Q 2Q 14.7 图4.30（a ）、（b ）分别示出了触发器和逻辑门构成的脉冲分频电路，CP 脉冲如图4.30（c ）所示，设各触发器的初始状态均为0。
（1）试画出图（a ）中的Q 1、Q 2和F 的波形。
（2）试画出图（b ）中的Q 3、Q 4和Y 的波形。
Y（b ）（c ）CPQ 1Q 2（a ）图4.30 题4.7图解： （a ）Q Q nn 211=+ QQ nn 112=+ Q F 1CP ⊕= R 2 = Q 1 低电平有效CPQ 1Q 2F（b ）Q Q Q n n n 4313=+ Q Q Q n n n 4314=+ Q Q Y nn43=CP 3= CP 上降沿触发 CP 4= CP 下降沿触发CPQ 3Q 4Y4.8 电路如图4.31所示，设各触发器的初始状态均为0。
电工与电子技术习题参考答案第9章
第9章时序逻辑电路习题解答9.1 d R端和d S端的输入信号如题9.1图所示，设基本RS触发器的初始状态分别为1和0两种情况，试画出Q端的输出波形。
题9.1图解：9.2 同步RS触发器的CP、R、S端的状态波形如题9.2图所示。
设初始状态为0和1两种情况，试画出Q端的状态波形。
题9.2图解：9.3 设主从型JK触发器的初始状态为0，J、K、CP端的输入波形如题9.3图所示。
试画出Q端的输出波形（下降沿触发翻转）。
解：如题9.3图所示红色为其输出波形。
第9章时序逻辑电路225题9.3图9.4 设主从型JK触发器的初始状态为0，J、K、CP端输入波形如题9.4图所示。
试画出Q端的输出波形（下降沿触发翻转）。
如初始状态为1态，Q端的波形又如何？解：如题9.4图所示红色为其输出波形。
题9.4图9.5 设维持阻塞型D触发器的初始状态为0，D端和CP端的输入波形如题9.5图所示，试画出Q端的输出波形（上升沿触发翻转）。
如初始状态为1态，Q端的波形又如何？解：如题9.5图所示红色为其输出波形。
第9章时序逻辑电路226题9.5图9.6 根据CP时钟脉冲，画出题9.6图所示各触发器Q端的波形。
（1）设初始状态为0；（2）设初始状态为1。
（各输入端悬空时相当于“1”）题9.6图解：第9章时序逻辑电路2279.7 题9.7图所示的逻辑电路中，有J和K两个输入端，试分析其逻辑功能，并说明它是何种触发器。
题9.7图=⋅⋅⋅=⋅+⋅解：由图得D Q F J Q Q F J QJ K Q n D Q n+10 0 0 0 00 0 1 1 10 1 0 0 00 1 1 0 01 0 0 1 11 0 1 1 11 1 0 1 11 1 1 0 0此电路为D触发器和与非门组成的上升沿触发的JK触发器。
9.8 根据题9.8图所示的逻辑图和相应的CP、d R、D的波形，试画出Q1和Q2端的输出波形。
设初始状态Q1=Q2=0。
题9.8图解：第9章时序逻辑电路2289.9 试用4个D触发器组成一个四位右移移位寄存器。
数字电子技术基础(第四版)课后习题答案-第四章
第4章触发器[题4.1]画出图P4.1所示由与非门组成的基本RS触发器输出端Q、Q的电压波形，输入端S、R的电压波形如图中所示。
图P4.1[解]见图A4.1图A4.1[题4.2]画出图P4.2由或非门组成的基本R-S触发器输出端Q、Q的电压波形，输出入端S D，R D的电压波形如图中所示。
图P4.2[解]见图A4.2[题4.3]试分析图P4.3所示电路的逻辑功能，列出真值表写出逻辑函数式。
图P4.3 [解]：图P4.3所示电路的真值表S R Q n Q n+1 0 0 0 0 0 0 1 1 0 1 0 0 0 1 1 0 1 0 0 1 1 0 1 1 1 1 0 0* 1 110*由真值表得逻辑函数式 01=+=+SR Q R S Q nn[题4.4] 图P4.4所示为一个防抖动输出的开关电路。
当拨动开关S 时，由于开关触点接触瞬间发生振颤，D S 和D R 的电压波形如图中所示，试画出Q 、Q 端对应的电压波形。
图P4.4[解] 见图A4.4图A4.4[题4.5] 在图P4.5电路中，若CP 、S 、R 的电压波形如图中所示，试画出Q 和Q 端与之对应的电压波形。
假定触发器的初始状态为Q =0。
图P4.5[解]见图A4.5图A4.5[题4.6]若将同步RS触发器的Q与R、Q与S相连如图P4.6所示，试画出在CP信号作用下Q和Q端的电压波形。
己知CP信号的宽度tw= 4 t Pd 。
t Pd为门电路的平均传输延迟时间，假定t Pd≈t PHL≈t PLH，设触发器的初始状态为Q=0。
图P4.6图A4.6[解]见图A4.6[题4.7]若主从结构RS触发器各输入端的电压波形如图P4.7中所给出，试画Q、Q端对应的电压波形。
设触发器的初始状态为Q=0。
图P4.7[解] 见图A4.7图A4.7R各输入端的电压波形如图P4.8所示，[题4.8]若主从结构RS触发器的CP、S、R、D1S。
试画出Q、Q端对应的电压波形。
第14章触发器和时序逻辑电路-习题
第14章 触发器和时序逻辑电路A 选择题14.1.1 触发器如图14.01所示，设初始状态为0，则输出Q的波形为图14.02中的（ ）。
图14.01 习题14.1.1的图 图14.02 习题14.1.1的图14.1.2 触发器如图14.03所示，设初始状态为0，则输出Q的波形为图14.04中的（ ）。
图14.03 习题14.1.2的图 图14.04 习题14.1.2的图14.1.3 图14.05所示的触发器具有（ ）功能。
（1）保持 （2）计数 （3）置1图14.05 习题14.1.3的图14.1.4 在图14.06所示的电路中，触发器的原状态Q1Q0＝01，则在下一个CP作用下，Q1Q0为（ ）。
（1）00 （2）01 （3）10图14.06 习题14.1.4的图 图14.07 习题14.1.5的图14.1.5在图14.07所示的电路中，触发器的原状态Q1Q0＝00，则在下一个CP作用下，Q1Q0为（ ）。
（1）00 （2）01 （3）1014.3.1 图14.08所示的是（ ）计数器。
（1）七进制 （2）八进制 （3）九进制图14.08 习题14.3.1的图14.4.1 由555定时器组成的单稳态触发器如图14.4.2（a）所示，若加大电容C的电容值，则（ ）。
（1）增大输出脉冲u0的幅度（2）增大输出脉冲u0的宽度（3）对输出脉冲u0无影响14.4.2 由555定时器组成的多谐振荡器如图14.4.3（a）所示，欲使振荡频率增高，则可（ ）。
（1）减小C （2）增大R1,R2 （3）增大U CCB基本题14.1.6 当基本RS触发器D R和D S端加上图14.09所示的波形时，试画出Q端的输出波形。
设初始状态为0和1两种情况。
14.1.7 当可控RS触发器CP，S和R端加上图14.10所示的波形时，使画出Q端的输出波形。
设初始状态为0和1两种情况。
图14.09 习题14.1.6的图 图14.10 习题14.1.7的图14.1.8 当主从型JK触发器的CP，J、K端分别加上图14.11所示的波形时，试画出Q端的输出波形。
数字电子技术基础试卷及答案
三．(8分）逻辑单元电路符号和具有“0”、“1”逻辑电平输入信号X１如下图所示，试分别画出各单元电路相应的电压输出信号波形Y１、Y２、Y3。设各触发器初始状态为“0”态。
四.(8分）判断下面电路中的极间交流反馈的极性（要求在图上标出瞬时极性符号)。如为负反馈,则进一步指明反馈的组态。
附:
5５5功能表
复位端(4)
触发端(2)
阈值端(6)
放电端
(7)
输出端
(３)
0
×
×
对地短路
0
1
>1/3Vｃc
>2／3Ｖｃｃ
对地短路
０
１
＜1/3Vｃc
<2/3Ｖcｃ
对地开路
1
1
>1/3Vcc
<２／3Vcｃ
保持原态
保持原态
数字电子技术基础3
一．（20分)电路如图所示，晶体管的β=１００,Vbe=0.7v。
七.（16分）设图示电路初始状态是“00０”，要求完成以下各问:
（1）写出各触发器的驱动方程;
（2）写出各触发器的状态方程；
（3）列出状态转换表；
（4）试分析图示电路是几进制计数器。
八.（１2分)下图为由5５5定时器构成的多谐振荡器电路。
(１)对应画出图中Vc和Vo的波形（要求标出对应电压值)；
（2)设图中二极管为理想器件，计算Vo波形的周期T及占空比ｑ(％)。
若将负反馈支路上的电阻R1改为可稳幅的热敏电阻，问R1应有怎样的温度系数?
利用相位平衡条件判断图(ｂ)电路能否产生振荡(标出瞬时极性）,如能，求振荡频率(其中C1=Ｃ2＝47pF，L=1．6mH）。
数字电子技术试题及答案题库
《数字电子技术》试卷姓名：__ _______ 班级：__________ 考号：___________ 成绩：____________ 本试卷共 6 页，满分100 分；考试时间：90 分钟；考试方式：闭卷 题 号 一 二 三 四（1） 四（2） 四（3） 四（4） 总 分 得 分一、填空题（每空1分，共20分）1.?有一数码10010011，作为自然二进制数时，它相当于十进制数（ ），作为8421BCD 码时，它相当于十进制数（ ）。
2.三态门电路的输出有高电平、低电平和（ ）3种状态。
3．TTL 与非门多余的输入端应接（ ）。
4．TTL 集成JK 触发器正常工作时，其d R 和d S 端应接（ ）电平。
5. 已知某函数⎪⎭⎫ ⎝⎛+⎪⎭⎫ ⎝⎛++=D C AB D C A B F ，该函数的反函数F =（ ）。
6. 如果对键盘上108个符号进行二进制编码，则至少要（ ）位二进制数码。
7. 典型的TTL 与非门电路使用的电路为电源电压为（ ）V ，其输出高电平为（ ）V ，输出低电平为（ ）V ， CMOS 电路的电源电压为（ ） V 。
8．74LS138是3线—8线译码器，译码为输出低电平有效，若输入为A 2A 1A 0=110时，输出01234567Y Y Y Y Y Y Y Y 应为（ ）。
9．将一个包含有32768个基本存储单元的存储电路设计16位为一个字节的ROM 。
该ROM 有（ ）根地址线，有（ ）根数据读出线。
10. 两片中规模集成电路10进制计数器串联后，最大计数容量为（ ）位。
11. 下图所示电路中， Y 1＝（ ）；Y 2 ＝（ ）；Y 3 ＝（ ）。
12. 某计数器的输出波形如图1所示，该计数器是（ ）进制计数器。
13．驱动共阳极七段数码管的译码器的输出电平为（ ）有效。
二、单项选择题（本大题共15小题，每小题2分，共30分） （在每小题列出的四个备选项中只有一个是最符合题目要求的，请将其代码填写在题后的括号内。
触发器练习
触发器练习（一）1、画出图题5-1所示的RS 触发器输出端Q 、Q 端的波形，输入端S 与R 的波形如图所示。
（设Q 初始状态为0）S RSRSRQQ....图题5-12、画出图题5-2所示的RS 触发器输出端Q 、Q 端的波形，输入端S 与R 的波形如图所示。
（设Q 初始状态为0）S RS RQQ...SR....图题5-23、画出图题5-3所示的同步RS 触发器输出端Q 、Q 端的波形，输入端S 、R 与CLK 的波形如图所示。
（设Q 初始状态为0）C1S RS RQQ....CLKS RCLK...图题5-34、画出图题5-4所示的同步D 触发器输出Q 端的波形，输入端D 与CLK 的波形如图所示。
（设Q 初始状态为0）C1DDQQ....CLKDCLK..图题5-45、若在图5-5电路中的CP 、S 、R 输入端，加入如图4.27所示波形的信号，试画出其 Q 和Q端波形，设初态Q =0。
SRCP触发器练习（二）1、画出图题5-6所示的同步JK 触发器输出Q 端的波形，输入端J 、K 与CLK 的波形如图所示。
（设Q 初始状态为0）J KQQ..CLKJKCLK ......C11J 1K..图题5-62、画出图题5-6所示的边沿触发D 触发器输出端Q 端的波形，输入端D 与CLK的波形如图所示。
（设Q 初始状态为0）C11D D QQ....CLKDCLK...D QQ....CLKDCLK...C11D （1）（2）3、画出图题5-7所示的边沿D 触发器输出Q 端的波形，CLK 的波形如图所示。
（设Q 初始状态为0）C11D Q 1CLK....CLK.1C11D Q 2CLK .CLK .图题5-74、画出图题5-8所示的JK 触发器输出Q 端的波形，输入端J 、K 与CLK 的波形如图所示。
（设Q 初始状态为0）J KQQ....CLKJ KCLK ...C11J 1KJ KCLK ......图题5-85、试画出图题5-9所示T 触发器输出Q 端的波形，输入端CLK 的波形如图所示。
电子技术习题解答第章触发器和时序逻辑电路及其应用习题解答
第8章 触发器和时序逻辑电路及其应用习题解答8.1 已知基本RS 触发器的两输入端D S 和D R 的波形如图8-33所示，试画出当基本RS 触发器初始状态分别为0和1两种情况下，输出端Ｑ的波形图。
图8-33 习题8.1图解：根据基本RS 触发器的真值表可得：初始状态为0和1两种情况下，Ｑ的输出波形分别如下图所示：习题8.1输出端Ｑ的波形图8.2 已知同步RS 触发器的初态为0，当S 、R 和CP 的波形如图8-34所示时，试画出输出端Ｑ的波形图。
图8-34 题8.2图解：根据同步RS 触发器的真值表可得：初始状态为0时，Ｑ的输出波形分别如下图所示：习题8.2输出端Ｑ的波形图8.3 已知主从JK触发器的输入端CP、J和K的波形如图8-35所示，试画出触发器初始状态分别为0时，输出端Ｑ的波形图。
图8-35 习题8.3图解：根据主从JK触发器的真值表可得：初始状态为0情况下，Ｑ的输出波形分别如下图所示：习题8.3输出端Ｑ的波形图8.4 已知各触发器和它的输入脉冲CP的波形如图8-36所示，当各触发器初始状态均为1时，试画出各触发器输出Ｑ端和Q端的波形。
图8-36 习题8.4图解：根据逻辑图及触发器的真值表或特性方程，且将驱动方程代入特性方程可得状态方程。
即：（a ）J ＝K ＝1；Ｑn ＋1＝n Ｑ，上升沿触发 （ｂ）J ＝K ＝1；Ｑn ＋1＝n Ｑ， 下降沿触发 （ｃ）K ＝0，J ＝1；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝1，上升沿触发 （ｄ）K ＝1，J ＝n Ｑ；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝n Ｑn Ｑ＋０·Ｑn ＝n Ｑ，上升沿触发 （ｅ）K ＝Ｑn ，J ＝n Ｑ；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝n Ｑn Ｑ＋０＝n Ｑ，上升沿触发 （ｆ）K ＝Ｑn ，J ＝n Ｑ；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝n Ｑn Ｑ＋０＝n Ｑ，下降沿触发， 再根据边沿触发器的触发翻转时刻，可得当初始状态为1时，各个电路输出端Ｑ的波形分别如图（a ）、（b ）、（c ）、（d ）、（e ）和（f ）所示，其中具有计数功能的是：（a ）、（b ）、（d ）、（e ）和（f ）。
数字电子技术习题课
输出波形
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第5章、触发器
例5：画出与或非门的输出端T以及在时钟CP作用下触发器输出波形。 设触发器初态为零。
CP
A
B
C
T
（a）
Q
Q
电路及输入波形 第10页/共36页
（b）
第5章、触发器
解：该触发器是下降沿触发的JK触发器，触发器的两个输入端J和K连 在一起，构成T触发器。与或非门的输出构成T触发器的输入信号，若 T=1，Q翻转；若T=0，Q保持。输出波形见下图。
都没有发生变化，所以由CP下降沿的R、S值决定输出状态。
第一个CP下降沿：S=1，R=0，触 发器输出置1，Q由初态0变1；
第二个CP下降沿：S=0，R=1，触 发器输出复位，Q由1变0；
第三个CP下降沿：S=0，R=0，触 发器输出保持原来值，Q仍为0；
第四个CP下降沿：S=1，R=1，触 发器输出不确定，Q为不定；
题5.19 试写出图P5.19（a）中各电路的次态函数（即Q1 、 n1Q 2、n1Q 3、n1Q 4 n1 与现态和输入变量之间的函数式），并画出在图P5.19（b）所给定信 号的作用下Q1、Q2、Q3、Q4的电压波形。假定各触发器的初始状态 均为Q=0。
图P5.19
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第5章、触发器
图P5.15
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第5章、触发器
解：此图为带异步置位、复位的上升沿触发的JK触发器，由图可知：
异步置位、复位端均为高电平 有效，SD始终接“0”无效，所以输 出不会出现异步置位的情况；RD初 始为1，所以触发器输出初始状态为 复位状态0。
由边沿触发器的特点可知：边 沿触发器的输出状态仅取决于边沿 时刻瞬间的输入数据。图中注意RD 值的变化情况。
第05章触发器习题解N
图A5.7
[题5.8] 在脉冲触发 触发器电路中，若S、R、CLK端的电 题 在脉冲触发SR触发器电路中 触发器电路中， 、 、 端的电 压波形如图P5.8所示，试画出 、Q'端对应的电压波形。假 所示， 端对应的电压波形。 压波形如图 所示 试画出Q、 端对应的电压波形 定触发器的初始状态为Q=0。 定触发器的初始状态为 。
触发器逻辑功能的定义和脉冲触发方式的动作特点(主从结 解：根据SR触发器逻辑功能的定义和脉冲触发方式的动作特点 主从结 根据 触发器逻辑功能的定义和脉冲触发方式的动作特点 构触发器属于脉冲触发方式)，即可画出如图A5.7所示的输出电压波形图。 所示的输出电压波形图。 构触发器属于脉冲触发方式 ，即可画出如图 所示的输出电压波形图
解：根据D触发器逻辑功能的定义及维持阻塞结构所具有的边沿触发方 根据 触发器逻辑功能的定义及维持阻塞结构所具有的边沿触发方 即可画出Q和 的电压波形如图 的电压波形如图A5.14。 式，即可画出 和Q'的电压波形如图 。
图A5.14
[题5.15] 已知 题 已知CMOS边沿触发方式 触发器各输入端的电压 边沿触发方式JK触发器各输入端的电压 边沿触发方式 波形如图P5.15所示，试画出 、Q'端对应的电压波形。 所示， 端对应的电压波形。 波形如图 所示 试画出Q、 端对应的电压波形
触发器逻辑功能的定义及边沿触发方式的动作特点， 解：根据D触发器逻辑功能的定义及边沿触发方式的动作特点，即可画 根据 触发器逻辑功能的定义及边沿触发方式的动作特点 出Q、Q'端的电压波形如图A5.13。 、 端的电压波形如
图A5.13
[题5.14] 已知维持阻塞结构 触发器各输人端的电压波形如 题 已知维持阻塞结构D触发器各输人端的电压波形如 所示， 端对应的电压波形。 图P5.14所示，试画出 、Q'端对应的电压波形。 所示 试画出Q、 端对应的电压波形
数电-触发器练习题
分析提示
主从触发方式，在时钟脉冲 CP=1期间接收输入信号，在时钟 脉冲 CP 下降沿改变状态，分两步完成状态变化。
第
7
页
数字电子技术
第 4 章 触发器
单项选择题 ( )。
7、时钟触发器产生空翻现象的原因是因为采用了 A C 主从触发方式 电位触发方式
× √
B D
边沿触发方式
×
维持阻塞触发方式 ×
×
维持阻塞D触发器 ×
分析提示
基本RS触发器 ，没有对输入信号起作用时刻进行控制的时钟 脉冲CP信号，输入信号直接控制输出状态。
第
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数字电子技术
第 4 章 触发器
单项选择题 ( )。
6、使触发器的状态变化分两步完成的触发方式是 A C 主从触发方式
√ ×
B D
边沿触发方式
×
电位触发方式
维持阻塞触发方式×
填空题 触发器、
6、按逻辑功能划分，触发器可以分为 RS触发器、 触发器和 触发器四种类型。
参考答案
D
JK
THale Waihona Puke 分析提示触发器按逻辑功能分类，分为RS触发器、D触发器、JK触发 器和 T触发器。
第
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数字电子技术
第 4 章 触发器
填空题
7、钟控触发器也称同步触发器，其状态的变化不仅取决于
信号的变化，还取决于 信号的作用。
；
。
参考答案
JQ n + K Q n
Qn
分析提示
JK触发器的特性方程： Q n 1 J Q n KQ n
J = K = 1时， Q n 1 J Q KQ n 1 Q 1 Q n Q
电子技术习题解答.第8章.触发器和时序逻辑电路及其应用习题解答
第8章 触发器和时序逻辑电路及其应用习题解答8.1 已知基本RS 触发器的两输入端D S 和D R 的波形如图8-33所示，试画出当基本RS 触发器初始状态分别为0和1两种情况下，输出端Ｑ的波形图。
图8-33 习题8.1图解：根据基本RS 触发器的真值表可得：初始状态为0和1两种情况下，Ｑ的输出波形分别如下图所示：习题8.1输出端Ｑ的波形图8.2 已知同步RS 触发器的初态为0，当S 、R 和CP 的波形如图8-34所示时，试画出输出端Ｑ的波形图。
图8-34 题8.2图解：根据同步RS 触发器的真值表可得：初始状态为0时，Ｑ的输出波形分别如下图所示：习题8.2输出端Ｑ的波形图8.3 已知主从JK触发器的输入端CP、J和K的波形如图8-35所示，试画出触发器初始状态分别为0时，输出端Ｑ的波形图。
图8-35 习题8.3图解：根据主从JK触发器的真值表可得：初始状态为0情况下，Ｑ的输出波形分别如下图所示：习题8.3输出端Ｑ的波形图8.4 已知各触发器和它的输入脉冲CP的波形如图8-36所示，当各触发器初始状态均为1时，试画出各触发器输出Ｑ端和Q端的波形。
图8-36 习题8.4图解：根据逻辑图及触发器的真值表或特性方程，且将驱动方程代入特性方程可得状态方程。
即：（a ）J ＝K ＝1；Ｑn ＋1＝n Ｑ，上升沿触发 （ｂ）J ＝K ＝1；Ｑn ＋1＝n Ｑ， 下降沿触发 （ｃ）K ＝0，J ＝1；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝1，上升沿触发 （ｄ）K ＝1，J ＝n Ｑ；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝n Ｑn Ｑ＋０·Ｑn ＝n Ｑ，上升沿触发 （ｅ）K ＝Ｑn ，J ＝n Ｑ；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝n Ｑn Ｑ＋０＝n Ｑ，上升沿触发 （ｆ）K ＝Ｑn ，J ＝n Ｑ；Ｑn ＋1＝J n Ｑ＋K Ｑn ＝n Ｑn Ｑ＋０＝n Ｑ，下降沿触发， 再根据边沿触发器的触发翻转时刻，可得当初始状态为1时，各个电路输出端Ｑ的波形分别如图（a ）、（b ）、（c ）、（d ）、（e ）和（f ）所示，其中具有计数功能的是：（a ）、（b ）、（d ）、（e ）和（f ）。
D触发器、波形、代码（转）
D触发器、波形、代码（转）在学习verilog之前，我们先学习⼀下D触发器以及它的代码。
FPGA的设计基础是数字电路，因此很多同学会认为我们要先学好数字电路之后，才学习FPGA。
但是，数字电路教材的内容很多.例如：JK 触发器、RS触发器、真值表、卡诺图等。
但是，这⾥的很多内容其实已经过时了。
此外，对于FPGA的学习来讲，我们只⽤到了其中很少很少的⼀部分内容。
如果没有数字电路的基础，我们建议就看⼀部分，知道D触发器就够了。
那么D触发器是什么样⼦的呢?这个就是D触发器的⽰意图。
其中，clk为时钟，rst_n为复位，d为输⼊，q为输出。
这个功能⾮常简单，复位有效的时候，这个q的值你可以认为是0。
如果复位⽆效的时候，那么在时钟上升沿的时候，就把d的值给了q。
就是这么简单，记住这个动作，先有时钟上升沿，再有把d的值给了q。
这就意味着，时钟上升沿的时候q的值还是没变的。
只有时钟上升沿之后，q的值才变化。
这是⼀个很重要的概念，也就是说先有时钟上升沿才有q的变化。
如果下⼀个时钟上升沿没有到来，那么q的值就保持不变。
因此，q的值是在时钟上升沿之后⼀点点变化。
这就是D触发器，我们所有的FPGA电路都是基于这个结构来进⾏设计的。
就是这么简单，诸如JK触发器、RS触发器之类完全不需⽤到。
我们就⽤最简单的结果来进⾏设计。
有些同学会问为什么如此简单就⾜以进⾏设计呢？其实我们要做⼀个系统，⼀个稳定的系统，⼀定是从⼀个最简单的结构搭建起来的，⽽不会是⼀个很复杂的结构，因此我们FPGA电路⾥⾯就是利⽤D触发器的稳定性，把它搭建起来的。
那么D触发器所对应的波形图是怎么样的呢?这个是波形图，你可以看⼀看q，它都是在时钟上升沿之后变化的，在第2个时钟上升沿，看到d的值为0，那么q就输出0，q的值就保持不变了直到下⼀个时钟上升沿的到来。
下⼀个时钟上升沿d的值为1，那么q就输出1，如此类推。
这就是我们d触发器的功能，⾮常⾮常地简单。
那么这个D触发器在FPGA⾥⾯⽤verilog代码怎么描述呢?其实就是这样的代码，可以看出来，这个代码跟这个D触发器是完全⼀样的，描述的就是D触发器。
触发器和时序逻辑电路测试题
触发器和时序逻辑电路测试题（十二章，十三章）一、填空题1、存放N为二进制数码需要_______个触发器。
2、一个四位二进制减法计数器状态为_______时，在输入一个计数脉冲，计数状态为1111，然后向高位发_____信号。
3、时序逻辑电路在结构方面的特点是;由具有____逻辑门电路和具有______的触发器两部分组成。
4、十进制计数器最少要用______个触发器。
5、用N个触发器可以构成存放_______位二进制代码寄存器。
6、在数字电路系统中，按逻辑功能和电路特点，各种数字集成电路可分位________逻辑电路和_________逻辑电路两大类。
7、8421BCD码位1001，它代表的十进制是_________。
8、8421BCD码的二一进制计数器当前计数状态是1000，再输入三个计数脉冲，计数状态位________。
9、数码寄存器主要由______和______组成，起功能是用来暂存_______数码。
10、同步计数器各个触发器的状态转换，与________同步，具有______特点。
11、寄存器在断电后，锁存的数码_______。
12、4个触发器构成8421BCD码计数器，共有______个无效状态，即跳过二进制数码_________到______6个状态。
二、判断题、1、移位寄存器每输入一个脉冲时，电路中只有一个触发器翻转。
（）2、移位寄存器即可并行输出也可串行输出。
（）3、右移寄存器存放的数码将从低位到高位，依次串行输入。
（）4、八位二进制能表示十进数的最大值是256. （）5、表示一位十进制数至少需要二位二进制。
（）6、触发器实质上就是一种功能最简单的时序逻辑电路，是时序逻辑存储记忆的基础。
（）7、数码寄存器存放的数码可以并行输入也可以串行输入。
（）8、显示器属于时序逻辑电路类型。
（）9、计数器、寄存器和加法器都属于时序逻辑电路。
（）10、时序逻辑电路具有记忆功能。
（）11、用4个触发器可构成4位二进制计数器。
数电例题[1]
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第四章例题解析【例1】电路如图4.15所示，试画出Q 1和Q 2的波形。
设两个触发器的初始状态均为“0”。
解答：对JK 触发器：J=Q 2，K=1，有nn n Q Q Q 1211=+ 对D 触发器： nn Q D Q Q D 1121,===+有有上述两方程画出Q 1和Q 2的波形图，如图4.16所示。
【例2】图4.17所示触发器电路中，A 和B 的波形已知，试对应画出Q 0～Q 3的波形。
设各触发器初态为0。
解答：①对图4.17（a ）0010Q D Q n ==+，且在A 的上升沿翻转。
因0,110==Q Q R D 故时输出端被置为0。
n nn Q Q D Q 10111==+，且在B 的上升沿翻转。
②对图4.17（b ）n n n n Q Q K Q J Q 222212=+=+，且在A 的下降沿翻转。
因为0332==Q Q R D ，所以时输出端被置为0。
n n n n n Q Q Q K Q J Q 3233313=+=+，且在B 的下降沿翻转。
Q 0、Q 1、Q 2、Q 3的波形如图4.18所示。
【例3】试画出主从结构RS 触发器转换成D 、T 、T ’及JK 型触发器的电路。
解答：RS 型触发器的特性方程为1=•+=+S R Q R S Q n n（1）RS →DD 触发器的特性方程为：n n n DQ D Q D D Q +=+==+)1(1 与RS 触发器的特性方程比较可得： S=D D R =根据方程式S=D ，D R =画出逻辑电路图，如图4.19所示。
（2）RS →TT 触发器的特性方程为：n n n Q T Q T Q+=+1与RS 触发器的特性方程比较可得：T R Q T S n==,但是当1,1==nQ T 时，出现R=1、S=1，不满足R ·S=0的约束条件。
故将T 触发器的特性方程变换为nn n n n n Q Q T Q T Q T Q T Q +=+=+1 与RS 触发器的特性方程联解可得：n n TQ R Q T S ==,根据方程式画出逻辑电路图，如图4.20所示。
习题答案
习题四答案画出图由或非门组成的基本RS 触发器输出端Q 、Q 的电压波形，输入端S 、R 的电压波形如图中所示。
图解答：已知或非门构成的RS 触发器的特征方程如下：⎩⎨⎧=+=+01RS Q R S Q nn 根据输入端S 、R 的波形图，得出输出端Q 、Q 的电压波形见图。
在图电路中，若CP 、S 、R 电压波形如图中所示，试画出Q 、Q 端与之对应的电压波形。
假定触发器的初始状态为0=Q 。
图 解答： 见图图一种特殊的RS 触发器如图所示。
1） 试列出状态转换真值表； 2） 写出次态方程；3） R 与S 是否需要约束条件图 解答：1）① CP=0时，SS=1,RR=1,期间n n Q Q =+1，状态保持。
② CP=1时，⎪⎩⎪⎨⎧+=⋅=⋅==RS R S RR S SS RRR即在CP=1的情况下：若R=0，S=0。
则RR=1，SS=1，有n n Q Q =+1，状态保持。
若R=0，S=1。
则RR=1，SS=0，有11=+n Q 。
若R=1，S=0。
则RR=0，SS=1，有01=+n Q 。
若R=1，S=1。
则RR=0，SS=1，有01=+n Q 。
电路的状态转换真值表如下表所示：2） 求次态方程：由上述状态转换真值表，不难得出次态方程：)(1S Q R CP Q CP Q n n n +⋅⋅+⋅=+3）R 与S 无需约束条件。
已知主从结构JK 触发器J 、K 和CP 的电压波形如图所示，试画出Q 、Q 端对应的电压波形。
设触发器的初始状态为0=Q 。
图 解答：见图图如图示是主从JK 触发器CP 和J 、K 的电压彼形，试画出主触发器M Q 端和从触发器Q 端的工作波形。
设Q 初始态为0。
图解答：见图图如图示电路，设该TTL 触发器的初态为0，试画出在CP 作用下的Q 端波形图。
图解答：根据图示可知该触发器的1=J ，n Q K =。
由时钟下降沿触发。
因此111≡+=⋅+⋅=+=+n n n n n n n n Q Q Q Q Q Q K Q J Q 在CP 作用下的Q 端波形图如图所示：图已知主从JK 触发器CP 、J 、K 和D R ，D S 的波形如图所示，画出输出端Q 的波形，设触发器初始状态为1。
哈工大数字电子技术基础习题册-标准答案-章
哈工大数字电子技术基础习题册2010-答案6-7章————————————————————————————————作者：————————————————————————————————日期：2第6章 触发器【6-1】已知由与非门构成的基本RS 触发器的直接置“0”端和直接置“1”端的输入波形如图6.1所示，试画出触发器Q 端和Q 端的波形。
R d S d Q Q图 6.1解：基本RS 触发器Q 端和Q 端的波形可按真值表确定，要注意的是，当d R 和d S 同时为“0”时，Q 端和Q 端都等于“1”。
d R 和d S 同时撤消，即同时变为“1”时，Q 端和Q 端的状态不定。
见图6.1（b ）所示，图中Q 端和Q 端的最右侧的虚线表示状态不定。
R d S d QQ不定状态图6.1（b ） 题6-1答案的波形图【6-2】触发器电路如图 6.2(a)所示，在图(b)中画出电路的输出端波形，设触发器初态为“0”。
QQR d S dd S d Q QR(a) (b)图6.2解：此题是由或非门构成的RS 触发器，工作原理与由与非门构成的基本RS 触发器一样，只不过此电路对输入触发信号是高电平有效。
参照题6-1的求解方法，即可画出输出端的波形，见图6.2(c)。
d S d Q QR 不定状态图6.2(c)【6-3】试画出图6.3所示的电路，在给定输入时钟作用下的输出波形，设触发器的初态为“0”。
C11J 1K R SQ“1”CPYZCP图 6.3解：见图6.3(b)所示，此电路可获得双相时钟。
CPQQYZ图6.3(b)【6-4】分析图6.4所示电路，列出真值表，写出特性方程，说明其逻辑功能。
Q QD CP图6.4解：1．真值表(CP=0时，保持；CP=1时，如下表）D n Q n Q n+10 0 00 1 01 0 11 1 12．特性方程Q n+1=D n3．该电路为锁存器（时钟型D触发器）。
CP=0时，不接收D的数据；CP=1时，把数据锁存，但该电路有空翻。
各触发器的工作波形图的画法
负向触发器的应用案例
负向触发器在电路中通常用于控制信号的反相 传输，如数字逻辑门电路中的非门等。
在负向触发器的应用中，当输入信号达到一定 阈值时，触发器输出与输入信号相反的电平， 从而控制后续电路的逻辑状态。
负向触发器的波形图通常表示输入信号与输出 信号之间的关系，通过观察波形图可以了解触 发器的逻辑功能和性能。
正向触发器的工作波形图
总结词
正向触发器的工作波形图在逻辑状态为0时处于高电平，为1 时处于低电平。
详细描述
正向触发器在输入信号从低电平变为高电平时被触发，其输 出信号从高电平变为低电平。在逻辑状态为0时，正向触发器 的输出信号保持在高电平状态；在逻辑状态为1时，其输出信 号变为低电平。
负向触发器的工作波形图
信号的稳定性
分析工作波形图可以评估触发 器输出信号的稳定性，判断触
发器是否正常工作。
工作波形图在电路设计中的应用
验证电路设计
通过绘制工作波形图，可以验证电路 设计的正确性，确保电路按照预期工 作。
优化电路性能
通过分析工作波形图，可以发现电路 中存在的问题，并针对性地进行优化， 提高电路性能。
指导参数调整
总结与展望
05
总结与展望
05
工作波形图在触发器中的重要性
直观展示触发器的工作过 程
工作波形图能够以图形化的方式直观地展示 触发器的工作过程，帮助理解其工作原理和 特性。
辅助故障诊断
通过观察工作波形图，可以分析触发器的性能和可 能存在的问题，有助于故障诊断和排查。
优化设计
通过对工作波形图的比较和分析，可以发现 触发器的不足之处，为优化设计提供依据。
双向触发器的应用案例
双向触发器在电路中通常用于控制信号的双向传输，如数字逻辑门电路中 的与非门、或非门等。
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触发器画波形试题
1、图示电路中，设触发器的初始状态均为“0”，试画出输出Q1、Q2的波形。
2、如图所示逻辑电路，试画出Q1、Q2、Q3的波形（各触发器初态为1）。
3、电路如图所示，试根据已知输入信号波形，画出输出Q1、Q2波形。
（设各触发器初始状态均为0）
4、分析如图所示的逻辑电路。
设触发器的初态均为0，试根据输入波形，画出Q1、Q2、Y对应的输出波形。
5、设触发器的初始状态为0，已知时钟脉冲CP及A、B端的波形如图所示，画出J、Q 和Q 的波形。
6、如图所示电路，已知各触发器初态均为0，试画出6各CP脉冲作用下Q1、Q2和Z 端的输出波形图。
7、分析如图逻辑电路，设触发器的初始状态均为0，试画出6个CP脉冲下的Q1、Q2、Y 的输出波形。
8、触发器电路如图所示，当A＝1时,根据CP 和的波形画出Q0、Q1的波形。
解：根据题意，波形图如下：
9、触发器电路如图所示，设各触发器的初态为Q2Q1Q0=001，试画出6个CP作用下Q2、Q1和Q0的波形。
解：根据题意，波形图如下：。