D锁存器
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5.3 D锁存器
5.3.1 D锁存器的电路结构 5.3.2 典型的D 锁存器集成电路 5.3.3 D 锁存器的动态特性
5.3.1 D锁存器的电路结构
1. 传输门控D锁存器 (1) 逻辑电路图
C
D
TG1
G1 Q
C C TG2 C
C
C
G3
G4
E
Q G2
逻辑符号
D 1D
Q
E C1
Q
(2)工作原理
(a) E=1时
D
tSU
tH
tW
E
TpLH
TpHL
Q
有建立时间tSU、保持时间tU 、脉冲宽度tW等。
E=1 D=0
S =0 R=1
D=1
S =1 R=0
Q=0 Q=1
5.3.2 典型的D锁存器集成电路 74HC/HCT373 八D锁存器
OE
LE
C1
Q0
C1
D0
1D
C1
Q1
C1
D1
1D
…
…
…
C1
Q7
C1
D7
1D
74HC/HCT373的功能表
工作模式
使能和读锁存 器
(传送模式)
锁存和读锁存 器
锁存和禁止输 出
置0
百度文库11 1 0
置1
E=0,
Q不变
E=1
Q=D
(4) 工作波形
C G1
D
TG1
Q
D
C
C TG2 C
E
G2
C
C
G3
G4
E
QQ Q
2. 逻辑门控D锁存器 逻辑电路图
D锁存器的功能表
R=S
G4
Q4 G2
E
G5
D
S=D
G3
Q3 G1
ED Q Q
Q
功能
0
×
不 变
不变
保持
Q
10 0 1
置0
11 1 0
置1
E=0 Q不变
输入 OE LE Dn LHL
内部锁存器 状态
L
LHH
H
L L L*
L
L L H*
H
H××
×
H××
×
输出 Qn L
H
L H 高阻 高阻
L*和H*表示门控电平LE由高变低之前瞬间Dn的逻辑电平。
5.3.3 D锁存器的动态特性
定时图:表示电路动作过程中,对各输入信号的 时间要求以及输出对输入信号的响应时间。
C
D
TG1
G1 Q
TG1导通, TG2断开
C C TG2 C
Q=D
TG1
G1
D
Q
Q G2
C
C
G3
G4
E
TG2
Q G2
(b) E=0时
TG2导通, TG1断开 Q 不变
D TG1
TG2
G1 Q
Q G2
(3) 逻辑功能
TG1
G1
D
Q
TG2
Q G2
ED
D锁存器的功能表
QQ
功能
0 × 不变 不变 保持
10 0 1
5.3.1 D锁存器的电路结构 5.3.2 典型的D 锁存器集成电路 5.3.3 D 锁存器的动态特性
5.3.1 D锁存器的电路结构
1. 传输门控D锁存器 (1) 逻辑电路图
C
D
TG1
G1 Q
C C TG2 C
C
C
G3
G4
E
Q G2
逻辑符号
D 1D
Q
E C1
Q
(2)工作原理
(a) E=1时
D
tSU
tH
tW
E
TpLH
TpHL
Q
有建立时间tSU、保持时间tU 、脉冲宽度tW等。
E=1 D=0
S =0 R=1
D=1
S =1 R=0
Q=0 Q=1
5.3.2 典型的D锁存器集成电路 74HC/HCT373 八D锁存器
OE
LE
C1
Q0
C1
D0
1D
C1
Q1
C1
D1
1D
…
…
…
C1
Q7
C1
D7
1D
74HC/HCT373的功能表
工作模式
使能和读锁存 器
(传送模式)
锁存和读锁存 器
锁存和禁止输 出
置0
百度文库11 1 0
置1
E=0,
Q不变
E=1
Q=D
(4) 工作波形
C G1
D
TG1
Q
D
C
C TG2 C
E
G2
C
C
G3
G4
E
QQ Q
2. 逻辑门控D锁存器 逻辑电路图
D锁存器的功能表
R=S
G4
Q4 G2
E
G5
D
S=D
G3
Q3 G1
ED Q Q
Q
功能
0
×
不 变
不变
保持
Q
10 0 1
置0
11 1 0
置1
E=0 Q不变
输入 OE LE Dn LHL
内部锁存器 状态
L
LHH
H
L L L*
L
L L H*
H
H××
×
H××
×
输出 Qn L
H
L H 高阻 高阻
L*和H*表示门控电平LE由高变低之前瞬间Dn的逻辑电平。
5.3.3 D锁存器的动态特性
定时图:表示电路动作过程中,对各输入信号的 时间要求以及输出对输入信号的响应时间。
C
D
TG1
G1 Q
TG1导通, TG2断开
C C TG2 C
Q=D
TG1
G1
D
Q
Q G2
C
C
G3
G4
E
TG2
Q G2
(b) E=0时
TG2导通, TG1断开 Q 不变
D TG1
TG2
G1 Q
Q G2
(3) 逻辑功能
TG1
G1
D
Q
TG2
Q G2
ED
D锁存器的功能表
功能
0 × 不变 不变 保持
10 0 1