集成计数器及寄存器
北京科技大学数电实验四 Quartus II集成计数器及移位寄存器应用
北京科技大学实验报告学院:高等工程师学院专业:自动化(卓越计划)班级:自E181姓名:杨威学号:41818074 实验日期:2020 年5月26日一、实验名称:集成计数器及其应用1、实验内容与要求(1)用74161和必要逻辑门设计一个带进位输出的10进制计数器,采用同步置数方法设计;(2)用两个74161和必要的逻辑门设计一个带进位输出的60进制秒计数器;2、实验相关知识与原理(1)74161是常用的同步集成计数器,4位2进制,同步预置,异步清零。
引脚图功能表其中X。
3、10进制计数器(1)实验设计1)确定输入/输出变量输入变量:时钟信号CLK、复位信号CLRN;输出变量:计数输出QD、QC、QB、QA,进位输出RCO,显示译码输出OA、OB、OC、OD、OE、OF、OG2)计数范围:0000-10013)预置数值:00004)置数控制端LDN:计数到1001时输出低电平5)进位输出RCO:计数到1001时输出高电平画出如下状态转换表:CP QDQCQBQA0 00001 00012 00103 00114 01005 01016 01107 01117 10009 100110 0000(2)原理图截图仿真波形如下功能验证表格CLRN QD QC QB QA RCO0 0 0 0 0 01 0 0 0 1 01 0 0 1 0 01 0 0 1 1 01 0 1 0 0 01 0 1 0 1 01 0 1 1 0 01 0 1 1 1 01 1 0 0 0 01 1 0 0 1 11 0 0 0 0 04、60进制秒计数器(1)实验设计1)确定输入/输出变量输入变量:时钟信号CLK、复位信号CLRN;输出变量:计数十位输出QD2、QC2、QB2、QA2和计数个位输出QD1、QC1、QB1、QA1,进位输出RCO2)计数范围:0000 0000-0101 10013)预置数值:0000 00004)置数控制端LDN1(个位):计数到0101 1001时输出低电平5)清零端CLRN2(十位):计数到0110时输出低电平6)ENT:个位计数到1001时输出高电平7)进位输出RCO:计数到1001时输出高电平画出如下状态转换表CP QD2QC2QB2QA2QD1QC1QB1QA1CPQD2QC2QB2QA2QD1QC1QB1QA1CPQD2QC2QB2QA2QD1QC1QB1QA10 0000 0000 20 0010 0000 40 0100 00001 0000 0001 21 0010 0001 41 0100 00012 0000 0010 22 0010 0010 42 0100 00103 0000 0011 23 0010 0011 43 0100 00114 0000 0100 24 0010 0100 44 0100 01005 0000 0101 25 0010 0101 45 0100 01016 0000 0110 26 0010 0110 46 0100 01107 0000 0111 27 0010 0111 47 0100 01118 0000 1000 28 0010 1000 48 0100 10009 0000 1001 29 0010 1001 49 0100 100110 0001 0000 30 0011 0000 50 0101 000011 0001 0001 31 0011 0001 51 0101 000112 0001 0010 32 0011 0010 52 0101 001013 0001 0011 33 0011 0011 53 0101 001114 0001 0100 34 0011 0100 54 0101 010015 0001 0101 35 0011 0101 55 0101 010116 0001 0110 36 0011 0110 56 0101 011017 0001 0111 37 0011 0111 57 0101 011118 0001 1000 38 0011 1000 58 0101 100019 0001 1001 39 0011 1001 59 0101 100160 0000 0000 (2)设计原理图截图(3)实验仿真仿真波形:仿真结果表:5、实验思考题:(1)总结任意模计数器的设计方法。
《数字电子技术》总结复习
《数字电子技术》复习一、主要知识点总结和要求1.数制、编码其及转换:要求:能熟练在10进制、2进制、8进制、16进制、8421BCD、格雷码之间进行相互转换。
举例1:(37.25)10= ( )2= ( )16=( )8421BCD解:(37.25)10= ( 100101.01)2= ( 25.4)16= ( 00110111.00100101 )8421BCD2.逻辑门电路:(1)基本概念1)数字电路中晶体管作为开关使用时,是指它的工作状态处于饱和状态和截止状态。
2)TTL门电路典型高电平为3.6 V,典型低电平为0.3 V。
3)OC门和OD门具有线与功能。
4)三态门电路的特点、逻辑功能和应用。
高阻态、高电平、低电平。
5)门电路参数:噪声容限VNH或VNL、扇出系数No、平均传输时间tpd。
要求:掌握八种逻辑门电路的逻辑功能;掌握OC门和OD门,三态门电路的逻辑功能;能根据输入信号画出各种逻辑门电路的输出波形。
举例2:画出下列电路的输出波形。
解:由逻辑图写出表达式为:,则输出Y见上。
3.基本逻辑运算的特点:与运算:见零为零,全1为1;或运算:见1为1,全零为零;与非运算:见零为1,全1为零;或非运算:见1为零,全零为1;异或运算:相异为1,相同为零;同或运算:相同为1,相异为零;非运算:零变 1, 1 变零;要求:熟练应用上述逻辑运算。
4. 数字电路逻辑功能的几种表示方法及相互转换。
①真值表(组合逻辑电路)或状态转换真值表(时序逻辑电路):是由变量的所有可能取值组合及其对应的函数值所构成的表格。
②逻辑表达式:是由逻辑变量和与、或、非3种运算符连接起来所构成的式子。
③卡诺图:是由表示变量的所有可能取值组合的小方格所构成的图形。
④逻辑图:是由表示逻辑运算的逻辑符号所构成的图形。
⑤波形图或时序图:是由输入变量的所有可能取值组合的高、低电平及其对应的输出函数值的高、低电平所构成的图形。
⑥状态图(只有时序电路才有):描述时序逻辑电路的状态转换关系及转换条件的图形称为状态图。
数字电路-实验指导书汇总
数字电路-实验指导书汇总TPE-D型系列数字电路实验箱数字逻辑电路实验指导书实验⼀门电路逻辑功能及测试实验⼆组合逻辑电路(半加器、全加器及逻辑运算)实验三时序电路测试及研究实验四集成计数器及寄存器实验⼀门电路逻辑功能及测试⼀、实验⽬的1、熟悉门电路逻辑功能。
2、熟悉数字电路实验箱及⽰波器使⽤⽅法。
⼆、实验仪器及器件1、双踪⽰波器;2、实验⽤元器件74LS00 ⼆输⼊端四与⾮门 2 ⽚74LS20 四输⼊端双与⾮门 1 ⽚74LS86 ⼆输⼊端四异或门 1 ⽚74LS04 六反相器 1 ⽚三、预习要求1、复习门电路⼯作原理及相应逻辑表达式。
2、熟悉所⽤集成电路的引线位置及各引线⽤途。
3、了解双踪⽰波器使⽤⽅法。
四、实验内容实验前检查实验箱电源是否正常。
然后选择实验⽤的集成电路,按⾃⼰设计的实验接线图接好连线,特别注意Vcc 及地线不能接错(Vcc=+5v,地线实验箱上备有)。
线接好后经实验指导教师检查⽆误可通电实验。
实验中改动接线须先断开电源,接好后在通电实验。
1、测试门电路逻辑功能⑴选⽤双四输⼊与⾮门74LS20 ⼀只,插⼊⾯包板(注意集成电路应摆正放平),按图接线,输⼊端接S1~S4(实验箱左下⾓的逻辑电平开关的输出插⼝),输出端接实验箱上⽅的LED 电平指⽰⼆极管输⼊插⼝D1~D8中的任意⼀个。
⑵将电平开关按表置位,分别测出输出逻辑状态值及电压值填表。
表2、异或门逻辑功能测试⑴选⼆输⼊四异或门电路74LS86,按图接线,输⼊端1、2、4、5 接电平开关输出插⼝,输出端A 、B 、Y 接电平显⽰发光⼆极管。
⑵将电平开关按表的状态转换,将结果填⼊表中。
表3、逻辑电路的逻辑关系⑴⽤ 74LS00 双输⼊四与⾮门电路,按图、图接线,将输⼊输出逻辑关系分别填⼊表,表中。
⑵写出两个电路的逻辑表达式。
4、逻辑门传输延迟时间的测量⽤六反相器(⾮门)按图接线,输⼊80KHz 连续脉冲(实验箱脉冲源),⽤双踪⽰波器测输⼊、输出相位差。
U2B芯片应用原理
U2B芯片应用原理一、U211B芯片的基本原理U211B芯片采用先进的CMOS工艺制造,具有低功耗、高交叉耦合电压和强抗干扰能力等特点。
它内部集成了计数器、移位寄存器、数据缓冲器、I/O端口和时钟发生器等功能模块,可以实现数据的输入、输出、存储和处理等操作。
1.时钟发生器:U211B芯片内部集成了时钟发生器,可以向芯片提供稳定的时钟信号,控制芯片的工作频率和时序。
2.输入和输出:U211B芯片具有多个输入和输出引脚,可以通过这些引脚与外部设备进行数据传输和通信。
3.计数器:U211B芯片内部集成了计数器模块,可以实现计数功能。
计数器可以用于控制信号的计数、频率的计数以及时间的计数等。
4.移位寄存器:U211B芯片内部还集成了移位寄存器模块,可以实现数据的移位操作。
它可以将数据按指定的位数进行左移或右移,实现数据的分发和合并。
5.数据缓冲器:U211B芯片内部还具有数据缓冲器模块,可以暂时存储数据。
数据缓冲器可以实现数据的输入、输出和中转,提高数据的传输效率和可靠性。
二、U211B芯片的应用原理1.电源控制:U211B芯片可以通过输入/输出引脚与电源模块进行通信,实现对电源的控制和管理。
例如,通过控制引脚输出高电平或低电平信号,可以开启或关闭电源,实现电器的开关机控制。
2.数据处理:U211B芯片内部的计数器和移位寄存器模块可以实现对数据的处理。
例如,可以使用计数器模块获得时间、频率和速度等数据,并结合移位寄存器模块进行数据分析和处理。
3.通信接口:U211B芯片可以通过串行通信接口与其他设备进行数据交互。
例如,可以通过串行通信接口与计算机进行数据传输、控制和指令交互,实现设备的远程控制和监控。
4.外设控制:U211B芯片可以与各种外部设备进行连接,通过输入/输出引脚与外设进行数据传输和控制。
例如,可以通过U211B芯片的引脚与显示屏、键盘、灯光等外设进行连接,实现对外设的控制和管理。
5.信号处理:U211B芯片内部的数据缓冲器模块可以实现信号的输入、输出和存储。
集成块的分类
集成块的分类一、引言集成块是一种电子元器件,由多个功能电路组合而成,在现代电子产品中广泛应用。
随着科技的不断发展,集成块的种类也越来越多样化。
本文将介绍集成块的分类。
二、数字集成块数字集成块是由数字逻辑门组合而成的电路。
数字逻辑门包括与门、或门、非门等等。
常见的数字集成块有计数器、寄存器、加法器等等。
1. 计数器计数器是一种能够按照一定规律进行计数的电路。
它通常由触发器和逻辑门组合而成,可以实现二进制计数和十进制计数。
2. 寄存器寄存器是一种能够存储数据的电路。
它可以将输入数据保存在内部,并在需要时输出这些数据。
寄存器通常由触发器和选通逻辑组合而成。
3. 加法器加法器是一种能够对两个二进制数进行加法运算的电路。
它通常由半加器和全加器组合而成,可以实现多位二进制数相加。
三、模拟集成块模拟集成块是由模拟电路组合而成的电路。
模拟电路包括放大器、滤波器、振荡器等等。
常见的模拟集成块有运放、比较器、振荡电路等等。
运放是一种能够将输入信号放大的电路。
它通常由差分放大器和反馈电路组合而成,可以实现不同增益和频率响应的信号放大。
2. 比较器比较器是一种能够对两个信号进行比较的电路。
它可以将一个信号与一个参考电平进行比较,并输出高或低电平。
3. 振荡电路振荡电路是一种能够产生周期性波形的电路。
它通常由反馈网络和放大器组合而成,可以实现正弦波、方波、三角波等不同类型的波形输出。
四、混合集成块混合集成块是由数字和模拟电路组合而成的电路。
它可以同时处理数字信号和模拟信号,广泛应用于通信、控制系统等领域。
常见的混合集成块有DAC(数模转换器)、ADC(模数转换器)、PLL(锁相环)等等。
1. DACDAC是一种能够将数字信号转换为模拟信号输出的电路。
它通常由数字信号处理电路和模拟输出电路组合而成,可以实现高精度的模拟信号输出。
2. ADCADC是一种能够将模拟信号转换为数字信号输出的电路。
它通常由模拟输入电路和数字信号处理电路组合而成,可以实现高精度的模拟信号采集。
时序逻辑电路
3 . 异步减 法计 数器
(1)3位递减计数器的状态
(2)电路组成
二 、 十进制计数器
十进制递减计数器的状态
1.电路组成
异步十进制加法计数器
2.工作原理
(1)计数器输入0~9个计数脉冲时,工作过程与4位二进制异步加法计数器完 全相同,第9个计数脉冲后,Q3Q2Q1Q0状态为1001。 (2)第10个计数脉冲到来后,此时计数器状态恢复为0000,跳过了1010~1111 的6个状态,从而实现842lBCD码十进制递增计数的功能。
④ 最 高 位 触 发 器 FF 3 是 在 Q 0 、 Q 1 、 Q 2 同 时 为 1 时 触 发 翻 转 , 即 FF 0 ~ FF 2 原均为 1 ,作加 l 计数时,产生进位使 FF 3 翻转为 l 。
(2)电路组成
4位二进制同步加法计数器逻辑图
工
程
应
用
计数不正常的故障检测 第一步,先查工作电源是否正常;第二步,检查触 发器的复位端是否被长置成复位状态;第三步,用示波器观测计数脉冲是否加到 了触发器的CP端;第四步,替换触发器,以确定集成电路是否损坏。
第二节 计数器
在数字系统中,能统计输入脉冲个数的电路称为计数器。
一 、二进 制计 数器 1 . 异步二 进制 加法计 数器
每输入一个脉冲,就进行一次加 1 运算的计数器称为加法 计数器,也称为递增计数器。 4 个 JK 触发器构成的异步加 法计数器如下图所示。
图中 FF 0 为最低位触发器,其控制端 C l 接收输入脉冲,输 出信号 Q 0 作为触发器 FF 1 的 CP , Q 1 作为触发器 FF 2 的 CP , Q 2 作为 FF 3 的 CP 。各触发器的 J 、 K 端均悬空,相当于 J = K =1 ,处于计数状态。各触发器接收负跳变脉冲信号时 状态就翻转,它的时序图见下图。
第7章 常用时序逻辑功能器件
5
第七章 常用时序逻辑功能器件
*** 中规模集成计数器
学习应注意以下几点: (1)编码 自然二进制/8421十进制 (2)模数 5进制、10进制、16进制 (3)加、减、可逆 (4)清0、置数端 同步还是异步
6
第七章 常用时序逻辑功能器件
74x161(74LS161 ,74HCT161): 4位二进制同步加法计数器 74x160: 8421十进制加法计数器(实验五) 74x290:异步二—五—十进制计数器 74x390:异步二—十进制计数器 主要任务: 读功能表掌握计数器使用方法 学会使用集成计数器构成任意进制计数器的方法
RCO ET Q D Q C Q B Q A
10
第七章 常用时序逻辑功能器件
74x161计数状态
1
CR D D D D 1 CET 0 1 2 3 TC 1 CEP 74x161 CP > Q Q Q Q PE 0 1 2 3
1
M=16
11
第七章 常用时序逻辑功能器件
1)异步清零。CR=0 时, 计数器输出直 接清零 Q3Q2Q1Q0 = 0000.无需CP 2)同步并行预置制数。
31
第七章 常用时序逻辑功能器件
基本寄存器 按照功能
Q0
FF0
Q1
FF1
移位寄存器 并行
串行
按照存、取 数据方式
D0
D1
应用: 存储代码、串/并行转换、数值计算、缓冲区
32
第七章 常用时序逻辑功能器件
一、 集成中规模双向移位寄存器74x194 P284 DSR:右移串行输入端 Q0 Q1 Q2 Q3 CP S1 S0 DSL:左移串行输入端 VCC DI3,2,1,0 :并行输入端 Q3~ Q0:数据输出端 74x194 CP:时钟脉冲输入端 D GND 上升沿触发 CR DSRDI0DI1 DI2 DI3 SL CR CR :清零端, =0时清零
计数器-寄存器
4.5.3 显示译码器
用来驱动各种显示器件,从而将用二进制代码表示 的数字、文字、符号翻译成人们习惯的形式直观地显示 出来的电路,称为显示译码器。
1、数码显示器abFra bibliotekcda
f
b
g
e
c
d
ef gh (a) 外形图
a b c d e f g h
(b) 共阴极
+VCC a b c d e f g
h (c) 共阳极
0 01 1
0111
00 00
整数部分:高位的 BI / RBO 与低位的RBI 相连
小数部分:低位的 BI / RBO 与高位的RBI 相连
加法计数器
二进制计数器 减法计数器 可逆计数器 加法计数器
同步计数器 十进制计数器 减法计数器
可逆计数器
计
数
N进制计数器
·
器
·
二进制计数器
·
异步计数器 十进制计数器
·
N进制计数器
· ·
计数器是一种应用十分广泛的时序电路,除 用于计数、分频外,还广泛用于数字测量、运算 和控制,从小型数字仪表,到大型数字电子计算 机,几乎无所不在,是任何现代数字系统中不可 缺少的组成部分。
寄存器分为基本寄存器和移位寄存器两大类。基 本寄存器的数据只能并行输入、并行输出。移位寄存 器中的数据可以在移位脉冲作用下依次逐位右移或左 移,数据可以并行输入、并行输出,串行输入、串行 输出,并行输入、串行输出,串行输入、并行输出。
寄存器的应用很广,特别是移位寄存器,不仅可 将串行数码转换成并行数码,或将并行数码转换成串 行数码,还可以很方便地构成移位寄存器型计数器和 顺序脉冲发生器等电路。
把代码状态的特定含义翻译出来的过程称 为译码,实现译码操作的电路称为译码器。
计数器和寄存器
指令寄存器(Instruction Register): 用于存储当前正在执行的指令。
程序计数器(Program Counter):用 于存储下一条要执行的指令的地址。
状态寄存器(Status Register):用于存储 CPU的状态信息,如进位标志、零标志等。
03 计数器和寄存器在数字系 统中的应用
分布式部署
将计数器或寄存器进行分布式部署,提高处理能力和可扩展性。
缓存优化
合理利用缓存技术,减少不必要的计算和存储操作,提高性能。
总结:计数器与寄存器在
06 电子信息技术领域的重要 性
对电子信息技术发展的影响
1 2 3
推动数字电路发展
计数器和寄存器作为数字电路的基本组成单元, 对数字电路技术的发展起到了关键作用。
数字系统中计数器应用举例
时钟发生器
在数字系统中,计数器常被用作时钟发生器 ,通过计数器的定时功能产生精确的时序信 号,用于驱动和控制数字电路的各个部分。
定时器
在数字系统中,计数器常被用作定时 器,通过设定计数器的初值和计数范 围,实现精确的延时和定时功能。
频率分频器
计数器还可以作为频率分频器使用,将输 入的高频信号分频为低频信号,以满足数 字系统中不同部分对时钟频率的需求。
作用
在数字系统中,计数器广泛应用 于定时、分频、产生节拍脉冲和 进行数字运算等。
工作原理与分类
工作原理
计数器通过接收输入信号(通常是脉冲信号),并在每个输 入信号的上升沿或下降沿进行计数操作。根据计数器的设计 和配置,它可以实现向上计数、向下计数或双向计数。
分类
根据计数器的功能和结构,可以将其分为同步计数器和异步 计数器。同步计数器在每个时钟周期内只进行一次计数操作 ,而异步计数器则可能在每个时钟周期内进行多次计数操作 。
时序逻辑实验报告
一、实验目的1. 理解时序逻辑电路的基本概念和工作原理。
2. 掌握时序逻辑电路的设计方法和测试方法。
3. 熟悉常用中规模集成计数器和寄存器的逻辑功能和使用方法。
二、实验原理时序逻辑电路是指其输出不仅取决于当前输入信号,还取决于电路的过去状态。
本实验主要涉及计数器和寄存器两种时序逻辑电路。
计数器:计数器是一种能够对输入脉冲进行计数的时序逻辑电路。
常见的计数器有二进制计数器、十进制计数器和可编程计数器等。
寄存器:寄存器是一种用于存储二进制信息的时序逻辑电路。
常见的寄存器有D型寄存器、移位寄存器和计数寄存器等。
三、实验设备1. 数字电子技术实验箱2. 示波器3. 信号源4. 集成芯片:74LS163、74LS00、74LS20等四、实验内容1. 计数器设计(1)设计一个4位二进制加法计数器,实现0-15的循环计数。
(2)设计一个10进制计数器,实现0-9的循环计数。
2. 寄存器设计(1)设计一个D型寄存器,实现数据的存储和读取。
(2)设计一个移位寄存器,实现数据的右移和左移。
3. 时序逻辑电路测试(1)测试计数器的计数功能。
(2)测试寄存器的存储和读取功能。
五、实验步骤1. 计数器设计(1)根据计数器的功能要求,设计电路图。
(2)根据电路图,选择合适的集成芯片。
(3)搭建实验电路。
(4)测试计数器的计数功能。
2. 寄存器设计(1)根据寄存器的功能要求,设计电路图。
(2)根据电路图,选择合适的集成芯片。
(3)搭建实验电路。
(4)测试寄存器的存储和读取功能。
3. 时序逻辑电路测试(1)测试计数器的计数功能。
(2)测试寄存器的存储和读取功能。
六、实验结果与分析1. 计数器设计(1)4位二进制加法计数器能够实现0-15的循环计数。
(2)10进制计数器能够实现0-9的循环计数。
2. 寄存器设计(1)D型寄存器能够实现数据的存储和读取。
(2)移位寄存器能够实现数据的右移和左移。
3. 时序逻辑电路测试(1)计数器的计数功能正常。
时序逻辑电路(寄存器和计数器)
单向移位寄存器的工作过程
要使寄存的数码D3D2D1D0=1011,一般先对寄存器 清零,然后将被存放数码从高位到低位按移位脉冲节
拍依次送到D0端(称为串行输入方式)。当第一个C
P下降沿到来时,D0=1,则Q3Q2Q1Q0=0001;当
第二个CP下降沿到来时,D0=0,则Q3Q2Q1Q
0=0010,经过4个移位脉冲后,寄存器状态为Q3Q2Q1
转。
同步3位二进制加法计数器波形图
电 路 评价
比较同步3位二进制加法计数器和异步3位二进制加法计数器
的工作波形,它的逻辑状态完全相同。
不同的是:异步计数器各触发器的状态更新是逐级进行的,工
作速度较低,工作频率不能太高;而同步计数器各触发器的
,
,提高了计数器的
工作速度。
05 十进制计数器
十进制计数器的分类
同步十进制加法计数器
十进制 计数器
同步十进制减法计数器 异步十进制加法计数器
异步十进制减法计数器
异步十进制加法计数器电路图
异步十进制加法计数器电路图
构成:由4位二进制计数器 和一个用于计数器清零 的 门电路 组成。 差异:与二进加法计数器 的主要差异是跳过了二进制数码1010~1111的6个状 态。
中,使
中内容不变。
Q3Q2Q1Q0=D3D2 D1D0。
练习
01
有一个左移位寄存器,当预先置入
1011后,其串行输入固定接0,在
CP作用下,四位数据的移位
过程是?
练习
01
有一个左移位寄存器,当预先置入 1011后,其串行输入固定接0,在
CP作用下,四位数 据的移位过程是?(答案)
1011 0110 1100 1000 0000
数电_常用的时序逻辑功能器件
寄存器 存放二进制数,传输二进制信息 ,即代 码的寄存、移位、传输。 统计时钟脉冲的个数(数数、计数),分 频、定时、产生节拍脉冲。
计数器
7.1 计数器
7.1.1 二进制计数器
7.1.2 非二进制计数器 7.1.3 集成计数器
7.2 寄存器和移位寄存器
7.2.1 寄存器
f Q0
f Q1
f Q2
1 f CP 2
1 f CP 4
1 f CP 8
Q1
Q2
3tpd
8
图 7.1.3
说明:
计数脉冲的最小周期 Tmin= ntpd。 计数器也可作为分频器。
异步计数器工作速度慢。
2. 二进制同步计数器(分析)
为了提高计数速度,我们将CP脉冲同时接到全部 FF,使FF的状态变换与CP脉冲同步。这种方式的计 数器称为同步计数器。
00
01
11
10
D0
00 01 11 10
00
01
11
10
D0 Q0
0 0 x 0
1 1 x 0
0 0 x x
1 1 x x
1 1 x 1
0 0 x 0
0 0 x x
1 1 x x
(3)画出逻辑电路图
D3 Q3Q0 Q2Q1Q0 D2 Q2Q1 Q2Q0 Q2Q1Q0
D1 Q1Q0 Q3Q1Q0
n 1 n Q2 Q2
1. 二进制异步加计数器
•状态转换表
n Q2
n 1 n Q0 Q0
(CP由01时,此式有效) (Q0由10时,此式有效) (Q1由10时,此式有效)
Q1n1 Q1n
数字电子技术 第6章 寄存器与计数器
68
工作原理分析
69
74LS90具有以下功能:(1)异步清零。(2)异步置9。(3) 正常计数。(4)保持不变。
70
例6-7 分别采用反馈清零法和反馈置9法,用 74LS90构成8421BCD码的8进制加法计数器。 解:(1)采用反馈清零法。
71
(2)采用反馈置9法。
首先连接成8421BCD码十进制计数器,然后在此基础 上采用反馈置9法。8进制加法计数器的计数状态为 1001、0000~0110,其状态转换图如图(a)所示。
41
6.4.1
集成同步二进制计数器
其产品多以四位二进制即十六进制为主,下面 以典型产品 74LS161为例讨论。
42
① 异步清零。当CLR=0时,不管其它输入信号的状 态如何,计数器输出将立即被置零。
43
② 同步置数。当CLR=1(清零无效)、LD=0时, 如果有一个时钟脉冲的上升沿到来,则计数器输出 端数据Q3~Q0等于计数器的预置端数据D3~D0。
13
例6-1 对于图6-4所示移位寄存器,画出下图所示输入 数据和时钟脉冲波形情况下各触发器输出端的波形。 设寄存器的初始状态全为0。
14
2. 集成电路移位寄存器 常用集成电路移位寄存器为74LS194,其逻辑符号和 引脚图如图所示。
15
16
例6-2 利用两片集成移位寄存器74LS194扩展成一 个8位移位寄存器。
连 接 规 律 加 法 计 数 减 法 计 数 T'触发器的触发沿 上 升 沿 下 降 沿
CPi Q i 1
CPi Qi 1
CPi Q i 1
例子
25
CPi Qi 1
6.2.2
异步非二进制计数器
集成计数器及寄存器的实验原理
集成计数器及寄存器的实验原理引言集成计数器和寄存器是数字电路中非常重要的组件,它们用于进行数字信号的计数与存储。
在本实验中,我们将探讨集成计数器和寄存器的原理以及它们在实际电路中的应用。
一、集成计数器的原理1.1 什么是集成计数器集成计数器是一种能够计数连续数字信号的电子器件。
它可以根据输入端的时钟信号来完成计数操作,输出端则会按照特定的规律输出计数结果。
1.2 集成计数器的工作原理集成计数器通常是由触发器构成的。
触发器是一种存储单元,它能够存储一个二进制位,并在时钟信号的作用下改变存储状态。
集成计数器的工作原理可以通过以下步骤来理解:1.初始状态下,集成计数器的触发器处于复位状态,输出端的计数值为0。
2.当时钟信号来临时,触发器将存储状态改变为下一个二进制数值,输出端的计数值也随之改变。
3.当再次收到时钟信号时,触发器再次改变存储状态,计数值也相应地改变。
4.不断重复以上步骤,集成计数器可以持续计数,输出端的计数值会随着每个时钟周期递增。
1.3 集成计数器的分类集成计数器可以根据工作模式和计数范围进行分类。
常见的集成计数器包括二进制计数器、十进制BCD计数器、环形计数器等。
二、寄存器的原理2.1 什么是寄存器寄存器是一种能够存储多个二进制数据的器件。
它可以将输入的数据暂时存储起来,并在需要的时候提供给其他电路使用。
2.2 寄存器的工作原理寄存器通常是由多个触发器构成的。
每个触发器能够存储一个二进制位,这样多个触发器组合起来就能够存储更多的二进制数据。
寄存器的工作原理可以通过以下步骤来理解:1.初始状态下,所有触发器处于复位状态,寄存器中的数据为0。
2.当输入信号到达时,触发器将存储状态改变为对应的输入数据。
3.在需要时,寄存器的输出端将提供存储的数据给其他电路使用。
4.如果需要修改寄存器中的数据,可以将新的数据输入到寄存器中,触发器会相应地改变存储状态。
2.3 寄存器的分类寄存器可以根据功能和位数进行分类。
时序逻辑电路知识要点复习总结
《时序逻辑电路》知识要点复习一、时序逻辑电路1、时序逻辑电路:电路的输出状态不仅与同一时刻的输入状态有关,也与电路原状态有关。
时序逻辑电路具有记忆功能。
2、时序逻辑电路分类:可分为两大类:同步时序电路与异步时序电路。
(1)同步时序电路:各触发器都受到同一时钟脉冲控制,所有触发器的状态变化都在同一时刻发生。
(2)异步时序电路:各触发器没有统一的时钟脉冲(或者没有时钟脉冲), 各触发器状态变化不在同一时刻发生。
计数器、寄存器都属于时序逻辑电路。
3、时序逻辑电路由门电路和触发器组成,触发器是构成时序逻辑电路的基本单元。
二、计数器1、计数器概述:(1)计数器:能完成计数,具有分频、定时和测量等功能的电路。
(2)计数器的组成:由触发器和门电路组成。
2、计数器的分类:按数制分:二进制计数器、十进制计数器、N 进制(任意进制)计数器; 按计数方式分:加法计数器、减法计数器、可逆计数器; 按时钟控制分:同步计数器、异步计数器。
3、计数器计数容量(长度或模):计数器能够记忆输入脉冲的数目,就称为计数器的计数容量(或计数长度或计数模),用M 表示。
3位二进制同步加法计数器:M=2^8,n 位4、二进制计数器(1)异步二进制加法计数器:如下图电路中,四个JK 触发器顺次连接起来,把上一触发器的Q 端输出作为下一个触发器的时钟信号,CP 0=CP CP F Q OJ1-K1-IJ2—K2—1J3—K3—1Qq’QQ 。
为计数输出,Q ;i 为进位输出,Rd 为异步复位(清0)二进制同步加法计数器:M=2n, n 位二进制计数器需要用n 个触发器。
C?2=Q1 CP3= Q2,Jo =Ko-l这样构成了四位异步二进制加计数器。
30,Qy。
U在计数前清零,QAQ1Q 产0000;第一个脉冲输入后,Q3Q 2Q I Q O =OOO1;第二个脉冲输入后,Q3Q 2Q I Q O =OO1O ;第三个脉冲输入后,Q3Q 2Q>Q O =OO11,……,第15个脉冲输入后,Q3Q 2QiQo=lllb第16个脉冲输入后,Q3Q-QQ°=0000,并向高位输出一个进位信号,当下一个脉冲来时,进 入新的计数周期。
实验五--时序逻辑电路实验报告
实验五时序逻辑电路(计数器和寄存器)-实验报告一、实验目的1.掌握同步计数器设计方法与测试方法。
2.掌握常用中规模集成计数器的逻辑功能和使用方法。
二、实验设备设备:THHD-2型数字电子计数实验箱、示波器、信号源器件:74LS163、74LS00、74LS20等。
三、实验原理和实验电路1.计数器计数器不仅可用来计数,也可用于分频、定时和数字运算。
在实际工程应用中,一般很少使用小规模的触发器组成计数器,而是直接选用中规模集成计数器。
2.(1) 四位二进制(十六进制)计数器74LS161(74LS163)74LSl61是同步置数、异步清零的4位二进制加法计数器,其功能表见表5.1。
74LSl63是同步置数、同步清零的4位二进制加法计数器。
除清零为同步外,其他功能与74LSl61相同。
二者的外部引脚图也相同,如图5.1所示。
表5.1 74LSl61(74LS163)的功能表清零预置使能时钟预置数据输入输出工作模式R D LD EP ET CP A B C D Q A Q B Q C Q D0 ××××()××××0 0 0 0 异步清零1 0 ××D A D B D C D D D A D B D C D D同步置数1 1 0 ××××××保持数据保持1 1 ×0 ×××××保持数据保持1 1 1 1 ××××计数加1计数3.集成计数器的应用——实现任意M进制计数器一般情况任意M进制计数器的结构分为3类,第一类是由触发器构成的简单计数器。
第二类是由集成二进制计数器构成计数器。
第三类是由移位寄存器构成的移位寄存型计数器。
第一类,可利用时序逻辑电路的设计方法步骤进行设计。
数电实验四——精选推荐
实验四:时序逻辑电路(集成寄存器和计数器)一、实验目的:1.熟悉中规模集成计数器的逻辑功能和使用方法;掌握用集成计数器组成任意模数为M的计数器。
2.加深理解移位寄存器的工作原理及逻辑功能描述;熟悉中规模集成移位寄存器的逻辑功能和使用方法;掌握用移位寄存器组成环形计数器的基本原理和设计方法。
二、知识点提示和实验原理:㈠计数器:计数器的应用十分广泛,不仅可用来计数,也可用于分频、定时和数字运算。
计数器种类繁多,根据计数体制不同,计数器可分为二进制计数器和非二进制计数器两大类。
在非二进制计数器中,最常用的是十进制计数器,其他的称为任意进制计数器。
根据计数器的增减趋势的不同,计数器可分为加法计数器和减法计数器。
根据计数脉冲引入方式不同,计数又可分为同步计数器和异步计数器。
在实际工程应用中,一般很少使用小规模的触发器组成计数器,而是直接选用中规模集成计数器。
用集成计数器实现任意M进制计数器:一般情况任意M进制计数器的结构分为3类,第一种是由集成二进制计数器构成,第二种为移位寄存器构成的移位寄存型计数器,第三种为集成触发器构成的简单专用计数器。
当M较小时通过对集成计数器的改造即可以实现,当M较大时,可通过多片计数器级联实现。
实现方法:(1)当所需计数器M值小于集成计数器本身二进制计数最大值时,用置数(清零)法构成任意进制计数器;⑵当所需计数器M值大于集成计数器本身二进制计数最大值时,可采用级联法构成任意进制计数器。
常用的中规模集成器件:4位二进制计数器74HC161,十进制计数器74HC160,加减计数器74HC191、74HC193,异步计数器74LS290。
所有芯片的电路、功能表见教材。
㈡寄存器:寄存器用来寄存二进制信息,将一些待运算的数据、代码或运算的中间结果暂时寄存起来。
按功能划分,寄存器可分为数码寄存器和移位寄存器两大类。
数码寄存器用来存放数码,一般具有接收数码、保持并清除原有数码等功能,电路结构和工作原理郡比较简单。
集成计数器及寄存器的实验原理
集成计数器及寄存器的实验原理一、引言计数器和寄存器是数字电路中常见的组件,它们在数字系统中具有重要的作用。
本文将介绍集成计数器及寄存器的实验原理。
二、集成计数器1. 计数器概述计数器是一种能够在输入时将其值逐次增加或减少的电路。
它通常由触发器和逻辑门组成,其中触发器用于存储当前计数值,逻辑门用于控制计数操作。
2. 集成计数器集成计数器是一种将多个触发器和逻辑门集成到一个芯片中的计数器。
它具有体积小、功耗低、可靠性高等优点,因此被广泛应用于数字系统中。
3. 集成计数器实验原理(1)74LS161集成计数器74LS161是一种4位二进制同步上升/下降计数器。
它包含四个D型触发器和多个逻辑门,可以实现二进制加法和减法运算。
当输入CLK信号时,74LS161会根据模式控制信号(MODE)进行相应的操作。
当MODE为0时,74LS161处于上升模式,每次CLK上升沿时将当前值加1;当MODE为1时,74LS161处于下降模式,每次CLK上升沿时将当前值减1。
(2)实验步骤① 将74LS161芯片插入实验板中,并连接电源和接地。
② 连接CLK、CLR、LOAD、A0、A1、A2输入信号。
③ 根据实验要求设置MODE模式控制信号。
④ 设置计数器的初始值。
⑤ 连接LED灯,观察计数器输出结果。
三、集成寄存器1. 寄存器概述寄存器是一种能够存储数据的电路。
它通常由多个触发器组成,可以存储不同位数的二进制数据。
2. 集成寄存器集成寄存器是一种将多个触发器集成到一个芯片中的寄存器。
它具有体积小、功耗低、可靠性高等优点,因此被广泛应用于数字系统中。
3. 集成寄存器实验原理(1)74LS173集成寄存器74LS173是一种4位带清零同步并行加载触发器。
它包含四个D型触发器和多个逻辑门,可以实现4位二进制数据的并行输入和输出操作,并且支持清零操作。
当输入CLR信号为低电平时,74LS173的所有输出都被清零;当输入LOAD信号为低电平时,74LS173会将并行输入的4位二进制数据加载到触发器中,此时输出与输入相同。
数字集成器件的种类与特点
数字集成器件的种类与特点数字集成器件是一种将数字电路功能集成在单个芯片上的电子器件。
它由数字逻辑门电路、存储器、时钟电路和输入输出接口等组成。
数字集成器件的种类很多,常见的有逻辑门、触发器、计数器、存储器和数据选择器等。
每种数字集成器件都有其特点和应用范围。
逻辑门是数字集成器件的基础,它根据输入的电平信号产生相应的输出电平信号。
常见的逻辑门有与门、或门、非门、与非门、或非门和异或门等。
逻辑门的特点是具有简单的结构和高速的响应速度,可以实现各种逻辑运算和控制功能。
逻辑门广泛应用于数字电路中,如计算机、通信设备和工控系统等。
触发器是一种用于存储和传递信息的数字集成器件。
触发器的特点是具有稳定的存储功能和较快的响应速度。
触发器可以分为RS触发器、D触发器、JK触发器和T触发器等。
触发器广泛应用于时序电路和存储器等数字系统中,如时钟模块、计数器和寄存器等。
计数器是一种用于计数和记忆次数的数字集成器件。
计数器的特点是具有稳定的计数功能和高速的计数速度。
计数器可以分为二进制计数器、十进制计数器和分频器等。
计数器广泛应用于计数器、时钟分频器和频率合成器等数字系统中。
存储器是一种用于存储和读取信息的数字集成器件。
存储器的特点是具有大容量的存储空间和快速的读写速度。
存储器可以分为随机存储器(RAM)和只读存储器(ROM)等。
存储器广泛应用于计算机和通信设备等数字系统中,如内存、硬盘和闪存等。
数据选择器是一种用于选择和传递数据的数字集成器件。
数据选择器的特点是具有多路选择和高速传输的功能。
数据选择器可以分为多路选择器和多路复用器等。
数据选择器广泛应用于多路选择器、数据交换机和数据选择器等数字系统中。
数字集成器件是一种将数字电路功能集成在单个芯片上的电子器件。
它具有逻辑运算、存储和传输等功能。
不同种类的数字集成器件具有不同的特点和应用范围。
透过数字集成器件的研究和应用,可以实现数字系统的高性能和高可靠性。
随着科技的不断发展,数字集成器件的种类和功能将会进一步扩展和完善,为数字系统的发展提供更多可能性。
- 1、下载文档前请自行甄别文档内容的完整性,平台不提供额外的编辑、内容补充、找答案等附加服务。
- 2、"仅部分预览"的文档,不可在线预览部分如存在完整性等问题,可反馈申请退款(可完整预览的文档不适用该条件!)。
- 3、如文档侵犯您的权益,请联系客服反馈,我们会尽快为您处理(人工客服工作时间:9:00-18:30)。
实验六 集成计数器及寄存器
四、实验内容
1、集成计数器74LS90功能测试。 • 74LS90 是二一五一十进制异步计数器。具有下述功能: 1)直接置0(R0(1) •R0(2) =1),直接置9(S9(1) •S9(2) =1) 2)二进制计数(Cp1输入;Qa输出) 3)五进制计数(CP2输入 ;Qd,Qc,Qb输出)
实验六 集成计数器及寄存器
实验六 集成计数器及寄存器
实验六 集成计数器及寄存器
五、实验报告
1. 整理实验内容和各实验数据。 2.画出实验内容上、2所要求的电路图及波形图。
3.总结计数器使用特点。
实验六 集成计数器及寄存器
下次预习内容
实验八 波形产生及单稳态触发器
实验六 集成计数器及寄存器
六、实验结束
出 2 分频信号,即实现二进制计数。当 1不加信号,计数脉冲从 CP2码,最高位 输入时, D、 码接法,先模 5计数,后模2计数,由 QACP 、Q D、 QC、 Q01 B、 输出 5421 BCD 置 9 都是异步操作,而且置 9是优先的,所以称 R R02 为异步清 0端,SQ 91 、 、QB实现五进制计数。 Q AC 作进位输出,波形对称。 SQ 为异步置 9端。
注意:
R0 均为高电平有效 0 、R9 × 0 × × 为下降沿触发 0 × 0 CP
1 ↓ QD
QDQCQB输出 QDQCQBQA输出 8421BCD码 QAQDQCQB输出 5421BCD码
1
1
不
变
保
持
当 R01R02 , S91S =0 0 。 当满足 R=1 01R 02=0 、 S 91时,无论时钟如何,输出全部清 S92=0时电路才能执行计数操作,根据 CP1、CP2的各种接 实现十进制计数有两种接法。一种是 8421 BCD码接法,先模 2 计数,后模 5计数,由 92 74LS90 功能表 法可以实现不同的计数功能。当计数脉冲从 CP 输入,CP2不加信号时, QABCD 端输 Q D、 C、 Q B、QA 输出8421 BCD 码,最高位 QD1 作进位输出。另一种是 5421 当 SQ S =1 时,无论时钟和清 0信号 R 、R 如何,输出就置 9。这说明清 0、
清 0 0 × 1 置 9 × 0 1 时 CP1 × × ↓ 钟 CP2 × × 1 ↓ QA ↓ R0(1)、R0(2) 1 0 × 1 × 0 S9(1)、S9(2) QD 0 1 QA
输 QC 0 0 输
出 QB 0 0 0 1 出 QA 功 能
异步清 0 异步置 9 二进制计数 五进制计数 十进制计数 十进制计数
QA
8421BCD码连接方式
QB QC QD 注意:QD是高位
CP1
二进制
CP2
五进制
2-5分频十进制计数器
实验六 集成计数器及寄存器
二进制计数(CP1输入QA输出)的波形如下:
五进制计数(CP2输入QDQCQB输出)的波形如下:
实验六 集成计数器及寄存器
四、实验内容
2 、十进制计数(两种接法)
4、采用整体反馈清零构成60进制计数器:
(1)首先将每片74LS90连接成8421BCD码的10进制 计数器;
(2)然后将低位片的进位信号QD送给高位片的CPA, 从而串接成100进制计数器; (3)在此基础上,采用“整体反馈清零”或“整体 反馈置数”方法构成小于100的任意进制计数器。
实验六 集成计数器及寄存器
按计数 方式分: 按时钟 控制分:
按开关 元件分:
实验六 集成计数器及寄存器 集成计数器74LS90的引脚图 时钟脉冲下降沿触发计数器状态改变,
二进制时钟 信号
计数输出 端
五进制时 钟信号
清零输入 端
置9输入 端
实验六 集成计数器及寄存器 74LS90 的全部功能如表11.14 所示。
实验六 集成计数器及寄存器 输 入
1、整理好工具,把连接线拉直并整齐放到一起; 2、关闭所用仪器电源开关、把仪器放好; (探头不用拔掉) 3、整理好抽屉方可离开; 4、清理个人周围卫生。 请大家自觉遵守!谢谢!
8421BCD码
5421BCD码
实验六 集成计数器及寄存器
十进制的输出波形如下:
实验六 集成计数器及寄存器 3、任意进制计数器设计方法
六进制计数器
八进制计数器
实验六 集成计数器及寄存器
连接上面的电路,实验所得的波形如下:
实验六 集成计器及寄存器
45进制计数 器(选作)
实验六 集成计数器及寄存器
实验六 集成计数器及寄存器
实验六 集成计数器及寄存器
一、实验目的
1、熟悉集成计数器逻辑功能和各控制端作用。
2、掌握74LS90实现任意进制计数的方法。
实验六 集成计数器及寄存器
二、实验仪器
1、数字电路实验箱一台
2、双踪示波器
3、器件
74LS90 74LS00 十进制计数器 二输入端四与非门 2片 1片
实验六 集成计数器及寄存器
1、计数器
计数器是一个用以实现计数功能的时序部件, 主要用来累计和记忆输入脉冲的个数,它不仅可 以用来对脉冲计数,还常用作数字系统的定时、 分频、执行数字运算以及其他一些特定的逻辑功 能。
实验六 集成计数器及寄存器
计数器的分类 按数制分: 二进制计数器 十进制计数器 N 进制(任意进制)计数器 加法计数器 减法计数器 可逆计数 同步计数器 异步计数器 TTL 计数器 CMOS 计数器