停车位智能计费系统的设计
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当reset为1时，系统启动，start=0表示汽 车处于汽车服务状态，此时服务时间计数器计 数，在2分钟服务时间内，费用计数器不变；服 务时间超过2分钟后，每增加1分钟，费用计数 器增加1元，此时停停车位车智能时计费间系统的计设计数器保持不变。
整体设计框图
时 钟 信
复
位 信
停车 计时 脉冲
汽车 服务 计时
clk
distance[7..0]
start distance_enable
reset
inst
start distance_enable time_enable
inst4
select_clk
scan_led
clk1 distance[7..0] s[7..0] m[7..0] f ee[7..0]
inst6
dis tance[7..0]
A [3..0]
B [3..0] 4' h1 --
Add0
+
ADDER
fee[7..0]
clk1
a[3..0]
PRE
D
Q
ENA CLR
8' hFF --
Mux0
SEL[3..0]
DATA[15..0]
OUT
8' h00 --
MUX
Mux1
SEL[3..0]
DATA[15..0]
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
• 停车计时模块仿真结果
•
图3-5 计程模块功能仿真
• 从波形图可以看出在时钟的控制下，当reset为高电平且start
为高电平的时候distance开始计数，当计到大于三的时候输
出了distance_enable为高电平。准备对第4小时以后的脉冲
2. s[7:0]等待计时的输入（秒）。
确定输入状态
当reset为1时，费用计数器为8元，系统启 动，start=1表示停车计时开始，停车计时模块 每产生一个脉冲，停车时间计数器加1；时间4 小时内，费用保持8不变，超过4小时，费用计 数器进行加计数，每增加1小时费用加1元，此 时汽车服务时间计数器不变。
题目：停车位智能计费系统的设计
停车位智能计费系统的设计
大作业摘要
我此次大作业是对停车计费进行改进，由人工计 费转变为智能计费从而满足社会的需求！本设计 实现了停车计费所需的一些基本功能，计费金额 包括初始金额、加时计费、汽车服务计费等。该 设计采用模块化设计，在Quartus II软件平台下 ，采用Verilog HDL 硬件描述语言描述和模拟仿 真了分频模块、计时模块、计费模块、服务计时 模块，完成了停车智能计费仿真设计和硬件电路 的实现。过程比较艰辛，尽管完成了计费的智能 化结果但是还是存在一些问题，如程序的复杂， 并非完全不需要人工等！我也将在此后的累积知 识的日子里完善此程序！
号
号
脉冲
分 频
控制器
器
停
汽
车
车
计 费
计
服
时
务
计
停车位智能计费系统的设计
时
停车位智能计费系统的设计
reset
停车位智能计费系统的设计
方案论证
该设计采用模块化设计，在Quartus II软 件平台下，采用Verilog HDL 硬件描述语 言描述和模拟仿真，选择此方案的理由为 ：没学过其他关于此方面的程序！
停车位智能计费系统的设计
设计的背景、目的和意义
• 在中国有很多受欢迎的大酒店，停车场是 不可或缺的配备，因此停车收费也是酒店 收入的一部分！
• 我将做一个自动计费系统来解决停车计费 的多种步骤及问题！
• 这种系统将使停车计费变得简单，在节省 了人力的同时也完成了高效的要求！
停车位智能计费系统的设计
OUT
8' hFF --
MUX
Mux2
SEL[3..0]
DATA[15..0]
OUT
8' h00 --
MUX
Mux3
SEL[3..0]
DATA[15..0]
OUT
MUX
Decoder0
IN[3..0]
OUT[15..0]
DECODER
dis p_dat[3..0]
PRE
D
Q
ENA CLR
Decoder1
停车位智能计费系统的设计
CLK RESET
div 1
INPUT VCC
clk_50M clk1
INPUT VCC
reset
inst2
电路图
control
f eemokuai
select_clk reset clk
f ee[7..0]
inst5
div clk_50M clk reset
inst1
distancemokuai
dig[7..0] seg[7..0]
OUTPUT OUTPUT
dlg[7..0] seg[7..0]
START
INPUT
VCC
timemokuai
clk
s[7..0]
reset
m[7..0]
start time_enable
inst3
停车位智能计费系统的设计
RTL图
s [7..0] m [7..0]
IN[3..0]
OUT[15..0]
DECODER
WideOr0 WideOr1
WideOr2 WideOr3
1' h1 --
s eg[7..0]
WideOr4
WideOr5
WideOr6
r_dig[7..0]
PRE
D
Q
ENA CLR
dig[7..0]
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
进行加计费。
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
• 计时模块的仿真结果
• 1.两分钟之内（包括两分钟）的仿真结果如下所示：
• 从波形图可以看出在clk的控制下当start为低电平reset为高 电平的时候时间计数，time_enable为低电平。
•
计时模块功能仿真（2分钟内）
设计任务及要求
• 该停车计费系统将实现功能： • 1、停车时间≤4小时，且汽车服务累计时间≤2分
钟，基础计费为8.0元。 • 2、停车时间4小时外，以每小时1.0元，服务累计
时间2分钟外，以每分钟1.0元计费。 • 3、能显示停车时间、来自百度文库务累计时间和最后的总费
用。 • 4、能通过修改程序来对计费要求实现改变。
停车位智能计费系统的设计
确定输入和输出变量
输入：1. Clk_50M全局时钟。在时钟上升沿，计算
费用。
2. reset整体复位，在reset=0时，等待计时 为
0，输出初始费用为8。 3. start选择计费模式
Start=1，计时计 费
Start=0，汽车服 务计费 输出：1. m[7:0]等待停车时位智间能计的费系输统的入设计(分) 。
整体设计框图
时 钟 信
复
位 信
停车 计时 脉冲
汽车 服务 计时
clk
distance[7..0]
start distance_enable
reset
inst
start distance_enable time_enable
inst4
select_clk
scan_led
clk1 distance[7..0] s[7..0] m[7..0] f ee[7..0]
inst6
dis tance[7..0]
A [3..0]
B [3..0] 4' h1 --
Add0
+
ADDER
fee[7..0]
clk1
a[3..0]
PRE
D
Q
ENA CLR
8' hFF --
Mux0
SEL[3..0]
DATA[15..0]
OUT
8' h00 --
MUX
Mux1
SEL[3..0]
DATA[15..0]
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
• 停车计时模块仿真结果
•
图3-5 计程模块功能仿真
• 从波形图可以看出在时钟的控制下，当reset为高电平且start
为高电平的时候distance开始计数，当计到大于三的时候输
出了distance_enable为高电平。准备对第4小时以后的脉冲
2. s[7:0]等待计时的输入（秒）。
确定输入状态
当reset为1时，费用计数器为8元，系统启 动，start=1表示停车计时开始，停车计时模块 每产生一个脉冲，停车时间计数器加1；时间4 小时内，费用保持8不变，超过4小时，费用计 数器进行加计数，每增加1小时费用加1元，此 时汽车服务时间计数器不变。
题目：停车位智能计费系统的设计
停车位智能计费系统的设计
大作业摘要
我此次大作业是对停车计费进行改进，由人工计 费转变为智能计费从而满足社会的需求！本设计 实现了停车计费所需的一些基本功能，计费金额 包括初始金额、加时计费、汽车服务计费等。该 设计采用模块化设计，在Quartus II软件平台下 ，采用Verilog HDL 硬件描述语言描述和模拟仿 真了分频模块、计时模块、计费模块、服务计时 模块，完成了停车智能计费仿真设计和硬件电路 的实现。过程比较艰辛，尽管完成了计费的智能 化结果但是还是存在一些问题，如程序的复杂， 并非完全不需要人工等！我也将在此后的累积知 识的日子里完善此程序！
号
号
脉冲
分 频
控制器
器
停
汽
车
车
计 费
计
服
时
务
计
停车位智能计费系统的设计
时
停车位智能计费系统的设计
reset
停车位智能计费系统的设计
方案论证
该设计采用模块化设计，在Quartus II软 件平台下，采用Verilog HDL 硬件描述语 言描述和模拟仿真，选择此方案的理由为 ：没学过其他关于此方面的程序！
停车位智能计费系统的设计
设计的背景、目的和意义
• 在中国有很多受欢迎的大酒店，停车场是 不可或缺的配备，因此停车收费也是酒店 收入的一部分！
• 我将做一个自动计费系统来解决停车计费 的多种步骤及问题！
• 这种系统将使停车计费变得简单，在节省 了人力的同时也完成了高效的要求！
停车位智能计费系统的设计
OUT
8' hFF --
MUX
Mux2
SEL[3..0]
DATA[15..0]
OUT
8' h00 --
MUX
Mux3
SEL[3..0]
DATA[15..0]
OUT
MUX
Decoder0
IN[3..0]
OUT[15..0]
DECODER
dis p_dat[3..0]
PRE
D
Q
ENA CLR
Decoder1
停车位智能计费系统的设计
CLK RESET
div 1
INPUT VCC
clk_50M clk1
INPUT VCC
reset
inst2
电路图
control
f eemokuai
select_clk reset clk
f ee[7..0]
inst5
div clk_50M clk reset
inst1
distancemokuai
dig[7..0] seg[7..0]
OUTPUT OUTPUT
dlg[7..0] seg[7..0]
START
INPUT
VCC
timemokuai
clk
s[7..0]
reset
m[7..0]
start time_enable
inst3
停车位智能计费系统的设计
RTL图
s [7..0] m [7..0]
IN[3..0]
OUT[15..0]
DECODER
WideOr0 WideOr1
WideOr2 WideOr3
1' h1 --
s eg[7..0]
WideOr4
WideOr5
WideOr6
r_dig[7..0]
PRE
D
Q
ENA CLR
dig[7..0]
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
进行加计费。
停车位智能计费系统的设计
停车位智能计费系统的设计
停车位智能计费系统的设计
• 计时模块的仿真结果
• 1.两分钟之内（包括两分钟）的仿真结果如下所示：
• 从波形图可以看出在clk的控制下当start为低电平reset为高 电平的时候时间计数，time_enable为低电平。
•
计时模块功能仿真（2分钟内）
设计任务及要求
• 该停车计费系统将实现功能： • 1、停车时间≤4小时，且汽车服务累计时间≤2分
钟，基础计费为8.0元。 • 2、停车时间4小时外，以每小时1.0元，服务累计
时间2分钟外，以每分钟1.0元计费。 • 3、能显示停车时间、来自百度文库务累计时间和最后的总费
用。 • 4、能通过修改程序来对计费要求实现改变。
停车位智能计费系统的设计
确定输入和输出变量
输入：1. Clk_50M全局时钟。在时钟上升沿，计算
费用。
2. reset整体复位，在reset=0时，等待计时 为
0，输出初始费用为8。 3. start选择计费模式
Start=1，计时计 费
Start=0，汽车服 务计费 输出：1. m[7:0]等待停车时位智间能计的费系输统的入设计(分) 。