数电实验报告半加全加器
实验一、半加器、全加器实验报告
（7）编程下载 （tools/programmer）
2.验证半加器、全加器的真值表。
根据管脚锁定的方案，操作仪器，记录数据。
半加器： 全加器：
输入
a
b
0
0
0
1
1
0
1
1
输出
sh
ch
输入
a
b
ci-1
0
0
0
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1
输出
si
ci
思考组合逻辑电路的特点： 六、实验总结（总结本次实验收获，实验中应该注意的事项）
实验一、 半加器 全加器设计 实验报告
专业班级：
学号：
姓名：
一、实验目的
1.初步掌握 Quartus 开发系统的使用 2.掌握原理图的设计方法 3．掌握组合逻辑电路的设计方法，理解组合电路的特点 二、实验原理
加法运算是计算机中最基本的一种算术运算。能完成两个一位二进制数的相加运算并
求得“和”及“进位”逻辑电路，称为半加器。全加器是完成两个一位二进制数相加，并考虑低 位来的进位，即相当于将三个一位二进制数相加的电路。
工程文件必须保存在
，建立工程文件时注意选择使用的器件的 device family
是
， devicBiblioteka 名称是。（2）在工程文件中添加源文件（file/new）
在出现的对话框中,选择 Design Files 中的选择
（Block Diagram/Schematic File /
数电实验报告半加全加器
数电实验报告半加全加器实验目的：掌握半加器和全加器的原理和应用，了解半加器和全加器的构造和工作原理。
实验器材：逻辑电路实验箱、7400四与非门、7402四与非门、7408四与门、7432四或门、7447数码显示器、开关、电源、跳线等。
实验原理：半加器和全加器是数字电路中常用的基本逻辑电路，用于对二进制进行加法运算，主要用于数字电路中的算术逻辑单元(ALU)。
1.半加器实验原理：半加器是一种能够对两个二进制位进行加法运算的电路。
半加器有两个输入端和两个输出端，输入端分别为A和B，输出端分别为S和C。
其中，A和B分别为要加的两个二进制数位，S为运算结果的个位，并且用S=A⊕B表示；C为运算结果的十位（进位），C=A·B表示。
半加器的真值表和逻辑符号表达式如下：```A，B，S，C0，0，0，00，1，1，01，0，1，01，1，0，1```2.全加器实验原理：全加器是一种能够对两个二进制位和一个进位信号进行加法运算的电路。
全加器有三个输入端和两个输出端，输入端分别为A、B和Cin，输出端分别为S和Cout。
其中，A和B分别为要加的两个二进制数位，Cin 为上一位的进位信号，S为运算结果的个位，并且用S=A ⊕ B ⊕ Cin表示；Cout为运算结果的十位（进位），Cout=(A·B) + (A·Cin) + (B·Cin)表示。
全加器的真值表和逻辑符号表达式如下：```A ，B ， Cin ， S ， Cout0，0，0，0，00，0，1，1，00，1，0，1，00，1，1，0，11，0，0，1，01，0，1，0，11，1，0，0，11，1，1，1，1```实验步骤：1.首先，按照实验原理连接逻辑门实验箱中的电路。
将7400四与非门的1、2号引脚分别连接到开关1、2上，将开关3连接到7400的3号引脚，将开关4连接到7400的5号引脚，将7400的6号引脚连接到LED1上，表示半加器的进位输出。
实验五 半加器和全加器
实验五半加器和全加器实验五半加器和全加器一、实验目的1(掌握组合逻辑电路的分析和设计方法。
2(验证半加器、全加器、奇偶校验器的逻辑功能。
二、实验原理使用中、小规模集成门电路分析和设计组合逻辑电路是数字逻辑电路的任务之一。
本实验中有全加器的逻辑功能的测试，又有半加器、全加器的逻辑设计。
通过实验要求熟练掌握组合逻辑电路的分析和设计方法。
实验中使用的二输入端四异或门的电路型号为74LS86，四位二进制全加器的型号为74LS83A，其外引线排列及逻辑图如下:14 13 12 11 10 9 8VCC=1 =174LS86=1 =1GND1 2 3 4 5 6 774LS86引脚排列16 15 14 13 12 11 10 9C C GND B AΣ 44011 BΣ4174LS83AA 2A Σ AB V Σ B 4333CC221 2 3 4 5 6 7 874LS83引脚排列74LS83A是一个内部超前进位的高速四位二进制串行进位全加器，它接收两个四位二进制数(A~A，B~B)，和一个进位输入(C)，并对每一位产生二进制和14140 (Σ~Σ)输出，还有从最高有效位(第四位)产生的进位输出(C)。
该组件有144越过所有四个位产生内部超前进位的特点，提高了运算速度。
另外不需要对逻辑电平反相，就可以实现循环进位。
三、实验仪器和器件1(实验仪器(1)DZX-2B型电子学综合实验装置(2)万用表(MF47型)2(器件(1)74LS00(二输入端四与非门)(2)74LS86(二输入端四异或门)(3)74LS83(四位二进制全加器)(4)74LS54(双二双三输入端与或非门)四、实验内容1(设计用纯与非门组成的半加器，分析、验证其逻辑功能;解:?根据设计任务列出真值表输入输出A B Y C0 0 0 00 1 1 01 0 1 01 1 0 1?根据真值表写出逻辑表达式C=AB Y,AB，AB?对逻辑表达式进行化简Y =A?B C=AB?根据所用逻辑门的类型将化简后的逻辑表达式整理成符合要求的形式Y =A?B= C=AB,AB AAB,BAB?根据整理后的逻辑表达式画出逻辑图? Y2 & 接A 逻=AB Y? 辑1& & YY 1 接电Y=A AB 电2平 ? B 平& Y=B AB ?3 Y3 显Y=A?B 示 ? & C=AB C图5-1 半加器设计参考图?根据逻辑图装接实验电路，测试其逻辑功能并加以修正表5-1’(验证) 表5-1(分析)输入输出输入逐级输出Y B C B A B Y C A B YYYY C 1 2 3A 0 1 A 0 1 0 0 0 0 0 0 1 1 1 0 00 0 1 0 0 0 0 1 1 0 0 1 1 1 0 1 01 1 1 0 0 1 1 0 1 0 1 0 1 0 1 1 01 1 0 1 1 1 0 1 1 0 1 卡诺图Y= A?B C=AB 2(设计用异或门组成半加器，并测试其逻辑功能; 解:???步骤同上?根据所用逻辑门的类型将化简后的逻辑表达式整理成符合要求的形式Y =A?B C= AB,AB?根据整理后的逻辑表达式画出逻辑图?根据逻辑图装接实验电路，测试其逻辑功能并加以修正表5-2输入输出接接=1 A Y ? 逻电A B Y C 辑平显电0 0 0 0 平示 B ? C ? & & 0 1 1 0 图5-2测量由异或门组成的半加器的逻辑功能 1 0 1 01 1 0 12(设计用74LS54、74LS86、74LS00组成全加器，并测试其逻辑功能;解:?根据设计任务列出真值表输入输出 ?根据真值表写出逻辑表达式 Y C A B C 00 0 0 0 0 Y,ABC，ABC，ABC，ABC00000 1 0 1 0C,ABC，ABC，ABC，ABC00001 0 0 1 01 1 0 0 1 ?对逻辑表达式进行化简0 0 1 1 0，，，，，，，，Y,AB，ABC，AB，ABC,A,BC，A,BC0 1 1 0 1 00001 0 1 0 1 ，，，，，，,A,BC，A,BC,A,B,C0001 1 1 1 1，，，，，，C,ABC，C，AB，ABC,AB，A,BC0000?根据所用逻辑门的类型将化简后的逻辑表达式整理成符合要求的形式，， Y,A,B,C0，， C,AB，A,BC0?根据整理后的逻辑表达式画出逻辑图?根据逻辑图装接实验电路，测试其逻辑功能并加以修正表5-3接电平显示 C 输入输出 Y A B CY C 074LS00 & 0 0 0 0 0 ? 0 1 0 1 0 ?1 0 0 1 0 ?1 =1 =11 1 0 0 1 & & & & 0 0 1 1 0 1/2 74LS860 1 1 0 1 ? ? ? ? ? ? ? 1 0 1 0 1 ? A B C0 1 1 1 1 1 74LS54 接逻辑电平图5-34(分析四位二进制全加器74LS83A的逻辑功能;接电平显示Σ Σ Σ Σ 4321接接电“0” CC4 0 FAFAFAFA4 3 2 1 平或显“1” ? ? 示 ? ?74LS83A A/AA/AB/BB/B24 13 24 24接逻辑电平图5-4 分析四位二进制全加器74LS83A的逻辑功能表5-4输出输入C=0 C=1 00B/BA/A B/B A/A ΣΣΣΣCΣΣΣΣC24 2413131 2 3 4 4 1 2 3 4 4 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 1 1 0 1 0 0 0 1 1 0 0 0 0 1 0 1 0 1 0 0 0 1 1 0 0 0 0 1 1 0 1 0 1 0 1 1 0 1 0 0 1 0 0 0 1 0 10 1 1 0 1 0 0 1 0 1 1 1 1 1 0 0 0 0 0 1 0 1 1 0 1 1 1 1 0 0 0 0 0 1 0 11 1 0 0 1 0 1 1 0 1 0 1 1 0 0 0 0 1 0 1 0 1 1 0 1 0 1 0 0 1 1 1 1 1 0 0 0 0 0 1 1 0 1 0 1 1 1 1 0 0 0 0 0 1 1 0 1 1 0 0 1 0 1 1 0 1 0 1 1 1 0 00 0 1 0 1 1 0 1 0 1 1 1 0 1 1 0 0 1 1 0 1 0 1 1 1 1 1 0 1 0 0 1 1 0 1 01 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1*5(用加法器74LS83A实现BCD码和余三码之间的相互转换。
实验二组合逻辑电路实验(半加器、全加器)
掌握 验证 学会
实验目的
组合逻辑电路的功能测试
数 法半字加电器路和实全验加箱器及的示逻波辑器功的能使用方 二进制数的运算规律
实验设备
序号 名称
型号与规格 数量
1 数字电路实验箱
THD-1
1
2 二输入四与非门
74LS00
3
3 二输入四异或门
74LS86
0
0
1
0
1
1
1
0
1
1
1
输出
Y1
Y2
（1）按上图接线（注意数字编号与芯片管脚编号对应） （2）写出Y2的逻辑表达式并化简。 （3）图中A、B、C接实验箱下方的逻辑开关，Y1，Y2接实验箱上方的电平显示发光管。 （4）按表格要求，拨动开关，改变A、B、C输入的状态，填表写出Y1，Y2的输出状态。 （5）将运算结果与实验结果进行比较 。
输入
Ai
Bi
Ci-1
0
0
0
输出
Si
Ci
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1
认真复习，加强练习， 巩固成果，学以致用！
Goodbye!
每个小组在数字电路试验箱上找到本次实验所需要的芯片 ，并查看芯片形状是否完好，芯片管脚有没有插牢。
2、查看数字电路实验箱
74LS86
74LS00
3、了解芯片
芯片管脚示意图
4、实验内容与结果(一)
1.组合逻辑电路功能测试 （选用芯片74LS00）
半加器和全加器及其应用
实验二半加器和全加器及其应用一、实验目的1.掌握全加器和半加器的逻辑功能。
2.熟悉集成加法器的使用。
3.了解算数运算电路的结构。
二、实验设备1.数字电路试验箱；2.74LS00，74SL86。
三、实验原理半加器(m =0半加，m=1为半减）能实现两个一位二进制数的算术加法及向高位进位，而不考虑低位进位的逻辑电路。
它有两个输入端，两个输出端。
半加器电路是指对两个输入数据位进行加法，输出一个结果位和高位的进位，不考虑输入数据的进位的加法器电路。
是实现两个一位二进制数的加法运算电路。
数据输入A 被加数、B加数，数据输出S和数（半加和）、进位C0。
同理,能对两个1位二进制数进行相减不考虑低位来的借位求得差及借位的逻辑电路称为半减器.设减数和被减数分别用A和B,表示差用S，表示向高位的借位用C0。
全加器，全减器(m =0为全加，m=1为全减)全加器是实现两个一位二进制数及低位来的进位数相加（即将三个一位二进制数相加），求得和数及向高位进位的逻辑电路。
根据全加器功能，其真值表如下表所示。
表中A及B分别代表被加数及加数，C1是低位来的进位，S代表相加后得到的和位，C0代表向高位的进位。
图中C1是进位输入端，C0是进位输出端。
同理,能对两个1位二进制数进行相减并考虑低位来的借位求得差及借位的逻辑电路称为全减器.设减数和被减数分别用A和B表示低位来的借位用C1,表示差用S，表示向高位的借位用C0。
四、实验内容实验一、实现半加器，半减器，当M为0时实现逻辑变量A、B的半加功能，当M为1时实现逻辑变量A、B的半减功能。
实验二、实现全加器，全减器，当M为0时实现逻辑变量A、B的全加功能，C i为进位值。
当M为1时实现逻辑变量A、B的全减功能，C i为借位值。
五、实验数据1实现半加、半减器（1）真值表（2）卡诺图S的卡诺图：S=A⊕B（3）C0的卡诺图S=B (M⊕A)2实现全加器(1)真值表S的卡诺图：S=A⊕(B⊕C)C0的卡诺图:C0=BC i+(B⊕C)(M⊕A)六．实验电路图及仿真半加半减的实现全加全减的实现七．实验心得通过本次实验，我将理论知识以及实践知识相结合，进一步了解到74LS00,74SL86芯片的原理，并提升了自己的实际动手能力。
(Multisim数电仿真)半加器和全加器教学总结
(M u l t i s i m数电仿真)半加器和全加器实验3.5 半加器和全加器一、实验目的：1．学会用电子仿真软件Multisim7进行半加器和全加器仿真实验。
2．学会用逻辑分析仪观察全加器波形：3．分析二进制数的运算规律。
4. 掌握组合电路的分析和设计方法。
5．验证全加器的逻辑功能。
二、实验准备：组合电路的分析方法是根据所给的逻辑电路，写出其输入与输出之间的逻辑关系(逻辑函数表达式或真值表)，从而评定该电路的逻辑功能的方法。
一般是首先对给定的逻辑电路，按逻辑门的连接方法，逐一写出相应的逻辑表达式，然后写出输出函数表达式，这样写出的逻辑函数表达式可能不是最简的，所以还应该利用逻辑代数的公式或者卡诺图进行简化。
再根据逻辑函数表达式例Array如：要分析如图3.5.1所示电路的逻辑功能。
图3.5.11.写输出函数Y的逻辑表达式：W=..........................................3.5.1AABBABWWCX=.........................................3.5.2WCCXXDY=..........................................3.5.3DXD2.进行化简：W+=A=....................................................3.5.4 AB+BABBABAWCWC+=....................…..3.5.5=++X+ACABCACBBCABDCCBBYXDDXDAA+=++A++=DBCDABCCDB+...........................…...3.5.6A+A+CABDBCDCDBA3. 列真值表：表3.5.1：4.功能说明：逻辑图是一个检奇电路。
输入变量的取值中，有奇数个1 则有输出，否则无输出。
组合电路的设计目的就是根据实际的逻辑问题，通过写出它的真值表和逻辑函数表达式，最终找到实现这个逻辑电路的器件,将它们组成最简单的逻辑电路。
组合逻辑电路(半加器全加器及逻辑运算)实验报告
《数字电路与逻辑设计实验》实验报告实验名称：组合逻辑电路(半加器全加器及逻辑运算)实验器材（芯片类型及数量）7400 二输入端四与非门，7486 二输入端四异或门，7454 四组输入与或非门一、实验原理1、组合逻辑电路的分析方法：（1）从输入到输出，逐步获取逻辑表达式（2）简化逻辑表达式（3）填写真值表（4）通过真值表总结出该电路的功能（5）选择芯片型号，绘制电路图，测试并验证之前的分析是否正确2、组合逻辑电路的设计方法：（1）根据实际逻辑问题的因果关系，定义输入输出变量的逻辑状态（2）根据设计要求，按逻辑功能列出真值表，填写卡诺图（3）通过卡诺图或真值表得到逻辑表达式（4）根据逻辑方程式画出图表，进行功能试验二、实验内容及原理图1、完成与非门、异或门、与或非门逻辑功能测试。
2、测试由异或门和与非门组成的半加器的逻辑功能。
根据半加器的逻辑表达式可知，半加器和位Y是A、B的异或而进位Z是A、B相与，故半加器可用一个继承异或门和两个与非门构成如图2.1。
AYBZ图2.1 半加器电路结构图（1）按照图2.1完成电路连接。
（2）按照表2.1改变A 、B 状态，并填表。
3、 测试全加器的逻辑功能。
SiG9CiA iB iC i-1图2.2 全加器电路结构图（1）写出图2.2的逻辑功能表达式（Y S i C i ） Y = Ai ⊕ Bi Si = Ai ⊕ Bi ⊕ Ci -1 Ci = AiBi + (Ai ⊕ Bi) Ci -1 （2）根据逻辑功能表达式列出真值表（3）按原理图选择与非门并接线测试，将结果记入表2.2。
4、 用异或、与或非门和与非门实现全加器的逻辑功能。
全加器可以用两个半加器和两个与门一个或门组成，在实验中，常用一块双异或门、一个与或非门和一个与非门实现。
（1）画出用异或门、与或非门和非门实现全加器的逻辑电路图，写出逻辑表达式。
Y = Ai ⊕ Bi Si = Ai ⊕ Bi ⊕ Ci -1 Ci = AiBi + (Ai ⊕ Bi) Ci -1（2）找出异或门、与或非门和与非门器件按自己画的图接线。
半加器和全加器(中科大数电实验)概要
实验报告要求
整理实验数据，列写实验任务的设计过程，画出设计的逻 辑电路图，并注明所用集成电路的引脚号。
拟定记录测量结果的表格。 总结用门电路实现半加器和全加器的方法。 总结用四位二进制全加器74LS283设计代码转换电路的方
法。
思考题
全部采用与非门设计，实现一位全加器。
用两块四位全加器设计一个二—十进制加法器，并做以下运算： 1） （3）10 +（5）10 = 2） （6）10 +（6）10 = 3） （9）10 +（8）10 =
将8421BCD码的输出分别接至译码／驱动器CC4511的对应输
入口D、C、B、A，接上+5V显示器的电源，观测8421BCD码
与LED数码管显示的对应数字是否一致，及译码显示是否正常。
根据加法法则可列出半加器的真 值表（表1）和逻辑电路（图1） 如右：
由真值表可得出半加器的逻辑表 达式：
表1 半加器真值表
Ai Bi 00 01 10 11
Si Ci 00 10 10 01
Ai Bi
=1
Si
&
Ci
(a) 半加器电路
图
Ai
∑
Si
Bi
CO
Ci
(b) 半加器符号
图 1 半加器电路图及符号
74LS283
逻辑笔可用来查错
电源用+5v
管脚对应关系：1~7孔对应1~7脚 12~18孔对应8~14脚 8,9,10,11为空孔
数码管A为最低位， D为最高位，A~D 为别对应283输出
的S1~S4
数码管的电源，用 一根导线相连
实验内容与步骤
用74LS283实现并行四位全加，将A置为1001，B置为0000~1001，依 次计算A+B并记录结果。
半加器全加器的工作原理和设计方法实验报告
半加器全加器的工作原理和设计方法实验报告
一、实验目的
1、了解数字电路的基本运算电路，如半加器和全加器。
二、实验器材
集成电路IC：74LS86、74LS83A、定时器CD4017
三、实验原理
1、半加器
半加器的功能是对两个二进制位的加法进行部分运算，即进行逐位相加，得到次位的进位信号和本位的和信号，半加器的运算法则如下：
• 0+0=0，S=0，C=0
其中，S为和信号，C为进位信号。
半加器的逻辑电路图如图1所示：
其中，传输门XOR gate为异或门，SUM为和信号输出端，CARRY为进位信号输出端。
2、全加器
图2. 全加器逻辑电路图
四、实验内容
将集成电路74LS86的引脚定义为X1、X2、不连、SUM、CARRY，输入进位信号CARRY 为不连，依次连接如图3所示，将本位输入信号接到X1和X2引脚上，再将SUM和CARRY 引脚接到示波器上，调节示波器显示参数，观察和进位信号输出情况。
将全加器的电路图按照原理图进行布线，如图4所示：
五、实验结果
将X1和X2输入信号分别输入1和0，观察示波器上和进位信号输出情况如图5所示：
图5. 半加器实验结果
该结果表明，1+0=1，和信号S=1，进位信号C=0，符合半加器的逻辑运算法则。
3、实验验证了半加器和全加器的逻辑运算法则和逻辑电路设计方法。
(Multisim数电仿真)半加器和全加器
实验3.5半加器和全加器、实验目的:1. 学会用电子仿真软件Multisim7进行半加器和全加器仿真实验。
2 •学会用逻辑分析仪观察全加器波形：3. 分析二进制数的运算规律。
4. 掌握组合电路的分析和设计方法。
5. 验证全加器的逻辑功能。
、实验准备:组合电路的分析方法是根据所给的逻辑电路，写出其输入与输出之间的逻辑关系（逻辑函数表达式或真值表），从而评定该电路的逻辑功能的方法。
一般是首先对给定的逻辑电路，按逻辑门的连接方法，逐一写出相应的逻辑表达式，然后写出输出函数表达式，这样写出的逻辑函数表达式可能不是最简的，所以还应该利用逻辑代数的公式或者卡诺图进行简化。
再根据逻辑函数表达式写出它的真值表，最后根据真值表分析出函数的逻辑功能。
例如：要分析如图3.5.1所示电路的逻辑功能。
图3.5.11. 写输出函数丫的逻辑表达式：W 二AAB ABB ......................................... 3.5.1X =WWC WCC ....................................... 3.5.2丫= XXD XDD ........................................ 3.5.32. 进行化简：W = AAB ABB 二AB AB ................................................................... 3.5.4X =WC Wc 二 ABC ABC ABC ABC ............................................... 5.5 …..3.Y =XD X D 二A BCD ABCD ABCD ABCD逻辑图是一个检奇电路。
输入变量的取值中，有奇数个 1则有输出，否则 无输出。
组合电路的设计目的就是根据实际的逻辑问题，通过写出它的真值表和逻辑 函数表达式，最终找到实现这个逻辑电路的器件，将它们组成最简单的逻辑电路。
半加器和全加器实验报告
半加器和全加器实验报告数电实验报告半加全加器实验二半加/减器与全加/减器一、实验目的:(1)掌握全加器和半加器的逻辑功能。
(2)熟悉集成加法器的使用方法。
(3)了解算术运算电路的结构。
二、实验设备:1、74LS00(二输入端四与非门)2、74LS86(二输入端四异或门)3、数字电路实验箱、导线若干。
(74LS00引脚图)三、实验原理:两个二进制数相加，叫做半加，实现半加操作的电路，称为半加器。
A表示被加数，B表示加数，S表示半加和，Co 表示向高位的进位。
全加器能进行加数、被加数和低位来的信号相加，并给出该位的进位信号以及和。
四、实验内容:用74LS00和74LS86实现半加器、全加器的逻辑电路功能。
(一)半加器、半减器M=0时实现半加，M=1时实现半减，真值表如下:(74LS86引脚图)(半加器图形符号)2、S?B?A?A?BC?B(A?M)(二)全加器、全减器S?A?B?Ci-1Ci?BCi-1?(M?A)(B?C)五、实验结果半加器:S?B?A?A?B C?B(A?M)全加器:S?A?B?Ci-1Ci?C1M?C2M其中C1?(A?B)Ci?1?AB，C2?(AB)Ci?1?AB为了方便，以下Ci?1用C表示CI?(AB?AB)CM?(AB?AB)CM?ABM?ABM?ABCM?ABCM?ABCM?ABCM?ABM?ABM?ABCM?ABCM?ABCM?ABCM?(ABCM?ABCM?ABCM?ABCM ?BC?ABCM?ABCM?ABCM?ABCM?(M?A)(B?C)(BC)则Ci?BCi-1?(M?A)(B?C)六、心得体会本次实验做的是半加/减器和全加/减器两个电路，比上次实验复杂很多，因此充满了挑战性。
实验过程中，我认识到了在利用给定的电子元件进行实验设计来实现某一种或多种功能时，对电路的化简非常重要，而且要符合给定元件的限定条件，只有将电路化简成为能够与给定元件相符的情况下才能达到实验目的。
《数字电路》组合逻辑电路(半加器全加器及逻辑运算)实验报告
《数字电路》组合逻辑电路（半加器全加器及逻辑运算）实验一、实验目的1、掌握组合逻辑电路的功能测试。
2、验证半加器和全加器的逻辑功能。
3、学会二进制数的运算规律。
二、实验原理数字电路分为组合逻辑电路和时序逻辑电路两类。
任意时刻电路的输出信号仅取决于该时刻的输入信号，而与信号输入前电路所处的状态无关，这种电路叫做组合逻辑电路。
分析一个组合电路，一般从输出开始，逐级写出逻辑表达式，然后利用公式或卡诺图等方法进行化简，得到仅含有输入信号的最简输出逻辑函数表达式，由此得到该电路的逻辑功能。
两个一位二进制数相加，叫做半加，实现半加操作的电路称为半加器。
两个一位二进制数相加的真值表见表5-1，表中Si表示半加和，Ci表示向高位的进位，Ai、Bi表示两个加数。
表5-1 半加器真值表从二进制数加法的角度看，表中只考虑了两个加数本身，没有考虑低位来的进位，这也就是半加一词的由来。
由表5-1可直接写出半加器的逻辑表达式：+、Ci=AiBi由逻辑表达式可知，半加器的半加和Si是Ai、Bi的异或，Si=AiBi AiBi而进位Ci是Ai、Bi相与，故半加器可用一个集成异或门和一个与门组成。
两个同位的加数和来自低位的进位三者相加，这种加法运算就是全加，实现全加运算的电路叫做全加器。
如果用Ai、Bi分别表示A、B两个多位二进制数的C-表示低位（第i-1位）来的进位，则根据全加运算的规则可列出真第i位，1i值表如表5-2。
表5-2 全加器的真值表利用卡诺图可求出Si 、Ci 的简化函数表达式：i i i i-1i i i i i i S =A B C C =(A B )C +A B ⊕⊕⊕可见，全加器可用两个异或门和一个与或门组成。
如果将数据表达式进行一些变换，半加器还可以用异或门、与非门等元器件组成多种形式的电路（见图5-2，图5-3）。
三、实验仪器及材料 器件：(1) 74LS00 二输入端四与非门 3片 (2) 74LA86 二输入端四异或门 1片 (3) 74LS54 四组输入与或非门 1片四、实验内容及步骤1、组合逻辑电路功能测试。
实验二：半加器、全加器及其应用
实验⼆：半加器、全加器及其应⽤数字电路实验报告姓名：班级：学号：同组⼈员：实验⼆半加器、全加器及其应⽤⼀、实验⽬的1．了解74LS00、74LS86芯⽚的内部结构和功能； 2．了解全加器和全减器的结构和功能； 3．进⼀步熟悉逻辑电路的设计和建⽴过程。
⼆、实验设备1、数字电路试验箱2、74LS00、74LS86三、实验原理1、半加/减器原理两个⼆进制数相加/减，能实现半加/减。
实现半加操作的电路叫做半加器。
表1是半加/减器的真值表。
图1是半加器的符号。
A 表⽰被加数，B 表⽰加数，S 表⽰半加和，C 表⽰向⾼位的进/借位，M 为控制端，当M 为1时是半减器，M 为0时是半加器。
表1半加/减控制端图12、全加/减器原理全加器能进⾏加数、被加数和低位来的进位信号相加，并根据求和的结果给出该位的进位信号。
图2是全加器的符号，如果⽤A i 、B i 分别表⽰A 、B 的第i 位，C i-1表⽰为相邻低位来的进位数，S i 表⽰为本位和数（称为全加和），C i 表⽰为向相邻⾼位的进位数。
则根据全加运算规则可列出全加器的真值表；同理，全减器真值表也可列出。
如表2（M 为1表⽰全减，M 为0表⽰全加）。
加/减控制端图2表23、画卡诺图并化简得到逻辑表达式半加/减器逻辑表达式：S=A⊕BCO=（M⊕A）B=((（M⊕A）B)’1)’全加/减器逻辑表达式：S i=A⊕B⊕C i-1C i=BC +（B⊕C i-1）（A⊕M）=((BC) ’（（B⊕C i-1）（A⊕M））’)’四、实验内容半加/减器器的电路图为简明起见，在此不画出，仅画出全加/减器的电路图。
电路图说明：开关从左⾄右依次控制A、B、Ci-1、M。
全加/减器电路图M=0时为全加器，A=0,B=Ci-1=1时，实验结果如下图：M=1时为全减器，A=1,B=1，Ci-1=1时，实验结果如下图：五、实验结果1、半加、减验证结果：Array结论：验证结果符合半加、半减真值表的结果。
一位全加器半加器的实验报告
一、实验原理
全加器是一个能对两个一位二进制数及来自低位的“进位”进行相加，产生本位“和”及向高位“进位”的逻辑电路。
该电路有3个输出变量，分别是两个加数Ai，Bi和一个低进位Ci—-1,2个输出变量。
分别是本位Si和向高进位Ci。
二、实验过程
1，使用中小规模集成电路来设计组合电路是最常见的逻辑电路。
根据设计任务的要求建立输入，输出变量，并列出真值表。
2设计步骤，
1）根据题意列出真值表，再填入卡诺图。
2）由卡诺图得出逻辑表达式，并演化成“与非”的形式
3）根据逻辑表达式画出用“与非门”构成的逻辑电路
4）用实验验证逻辑功能
在实验装置适当位置选定3个14插座，按照集成块定位标记插好集成块74LS20
按图接好，输入端至逻辑开关。
实验提示：
对于非门而言，如果一个与门中的一条或几条如入引脚不被使用，则需将他们接高电平，如果一个与门不被使用，则需将此与门的至少一条输入引脚接低电平。
三、实验数据
半加器功能测试
A B S C
0 0 0 0
0 1 1 0
1 0 1 0
1 1 0 1 全加器功能测试
A i
B i
C i S i C i+1
0 0 0 0 0
0 0 1 1 0
0 1 0 1 0
0 1 1 0 1
1 0 0 1 0
1 0 1 0 1
1 1 00 1
1 1 1 0 1
四、实验所得
学会了全加器，半加器的接法，从原理上懂得了选择器的使用方法。
实验六 半加器和全加器实验
实验六半加器和全加器实验一、实验概述本实验是通过使用74LS00和74LS86来验证半加器和全加器的功能。
二、实验目的1、掌握半加器的工作原理及电路组成2、掌握全加器的工作原理及电路组成3、学习及掌握组合逻辑电路的设计、调试方法三、实验预习要求1、查出74LS86、74LS00芯片的引脚图及其各引脚功能2、推导由与非门构成半加器、全加器的逻辑表达式3、按实验内容要求设计半加器、全加器的实验线路图四、实验原理1、半加器两个二进制数相加，叫做半加，实现半加操作的电路，称为半加器。
表6.4-1是半加器的真值表，图6.4-1为半加器的符号，A表示加数；B表示被加数；S表示半加和；C表示向高位的进位。
A图6.4-1 表6.4-1从二进制数加法的角度看，真值表中只考了两个加数本身，没有考虑低位来的进位，这就是半加器一词的由来。
由真值表可得半加器逻辑表达式2、全加器全加器能进行加数、被加数和低位来的进位信号相加，并根据求和的结果给出该位的进位信号。
图6.4-2是全加器的符合，如果用Ai 、Bi 表示A 、B 两个数的第i 位，Ci-1表示为相邻低位来的进位数，Si 表示为本位和数（称为全加和），Ci 表示为向相邻高位的进位数，则根据全加运算规则可列出全加器的真值表如表6.4-2。
图6.4-2表6.4-2利用图形法可以很容易地求出S 、C 的简化函数表达式。
五、 Proteus 使用的元器件1. LOGICPROBE(BIG) //逻辑探头（大）。
2. LOGICSTATE //逻辑状态输入。
AB C B A B A B A S =⊕=+=A B C 1-⊕⊕=i i i i C B A S ii i i i i B A C B A C +⊕=-1)(3.74LS86 //四2输入异或门。
4.74LS00 //2输入4与非门。
六、实验要求1、半加器控制半加器的A、B端的电平，观察Y、Z的结果是否跟真值表一样。
2、全加器控制全加器的Ai、Bi和Ci-1端的电平，观察Si、Ci的结果是否跟真值表一样。
半加器和全加器结课报告
半加器和全加器结课报告今天我们来聊聊半加器和全加器这俩有点神秘的东西，大家可能一听到这些词，脑袋就“嗡”地一声，觉得这又是数学课上搞不懂的东西。
别怕，今天咱就用最接地气的方式，把它们拆开讲。
说白了，半加器和全加器不过就是加法器，不是用来做饭的那种加法，而是用来做数字加法的。
不过，它们也确实有点“加法神器”的意思，别看它们看起来小巧，功能可不简单。
咱们慢慢来说，保证让你听了心情愉快。
半加器就像是那种不愿意麻烦别人、独自搞定事情的小角色。
它能做的事很简单，就是两个数字相加，但它只能处理两个数字的相加，结果里面能出来两个东西：一个是“和”，一个是“进位”。
你要是问，啥叫进位？简单来说，就是当你加起来的数字超过了9，咱们就得像小学数学里学的那样，进位到十位。
就这么简单。
举个例子，比如你加1和1，这个加法没啥问题，结果是2，可要是加9和9，那就不得了了，结果是18，8放到个位，1得进位，进到十位。
半加器就帮你完成这件事，但它不能处理更复杂的加法。
你别小看它，这个小小的半加器，可是在加法世界里默默地立下了赫赫战功。
接下来是全加器。
全加器可不是闲着的，它的任务可是相当繁重。
全加器能够做什么呢？它不仅仅能完成两个数字相加，还能处理“进位”的情况。
啥意思呢？就是说它不仅能加两个数，还能把从上一步进来的“进位”一起加进去。
你想啊，生活中有多少次我们加起来的数字都不止个位数，常常是有个进位的。
举个简单的例子，假如你有两个数字，1和1，算出来是2，对吧？没问题。
但假如你加的数字是9和5，再加上上一步的进位1，这不就成了15吗？这时候就需要全加器来“撑场面”了。
它不仅计算当前的和，还会把“进位”也处理得妥妥的。
听到这里，你可能会想，半加器和全加器到底有啥区别，难道它们不是差不多的？对，表面上看，半加器和全加器做的事是一样的，但一旦细细想来，全加器比半加器更强大。
就像你去超市买东西，半加器就像是你拿着购物车，自己挑东西，可是全加器呢，它就是那个既能挑东西，又能帮你算好钱，甚至还能算清找零的“大管家”。
实验二半加器全加器
A3 A2 A1 A0 5 12 V CC GND S3 15 2
B3 B2
7483
S2 S1 6 S0 9 CO 14
电气工程与自动化学院
College of Electrical Engineering and Automation
预习要求
输 入 端 A 0 0 1 1 B 0 1 0 1
输 出 端 Y
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2．用异或门构成半加器 电路如图2-2-4所示，输入端接 逻辑开关，输出端接LED显示。 表2-2-3 半加器输入、输出电 将实验结果填入表2-2-3中， 平关系数据表 判断结果是否正确，写出和S 及进位CO的逻辑表达式。
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表2-2-4 1位二进制全加器真值表
输 入 端
A 0 0 0 0 1 1 1 1 B 0 0 1 1 0 0 1 1 CI 0 1 0 1 0 1 0 1
输 出 端
S CO
4． 4位二进制加法器7483功能测试 电路如图2-2-5所示，和分别为2个4位二进制数，令 B3B2B1B0=0110，A3A2A1A0接逻辑开关，输出端接 LED显示，验证7483的逻辑功能，将实验结果填入 表2-2-5中。
S A B CI
CO AB BCI ACI
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实验二--组合逻辑电路实验(半加器、全加器)
掌握 验证 学会
实验目的
组合逻辑电路的功能测试
数 法半字加电器路和实全验加箱器及的示逻波辑器功的能使用方 二进制数的运算规律
实验设备
序号 名称
型号与规格 数量
1 数字电路实验箱
THD-1
1
2 二输入四与非门
74LS00
3
3 二输入四异或门
74LS86
1
4 二输入端四或非门 74LS02
1
实验内容与步骤
1. 组合逻辑电路功能测试 2.用异或门（74LS86）和与非门组成的半加
器电路 3.全加器组合电路的逻辑功能测试 4. 用与非门实现逻辑函数 F AB AC BC *5.用异或门、或非门、与非门组成的全加器
电路的逻辑功能测试（选做）
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1
输出
Y1
Y2
（1）按上图接线（注意数字编号与芯片管脚编号对应） （2）写出Y2的逻辑表达式并化简。 （3）图中A、B、C接实验箱下方的逻辑开关，Y1，Y2接实验箱上方的电平显示发光管。 （4）按表格要求，拨动开关，改变A、B、C输入的状态，填表写出Y1，Y2的输出状态。 （5）将运算结果与实验结果进行比较 。
5、记录实验结果（二）
2.用异或门（74LS86）和与非门（74LS00）组成的半加器电路
输入
A
B
0
0
0
1
1
0
1
1
输出
Y
Z
（1）在数字电路实验箱上插入异或门和与非门芯片。输入端A、B接逻辑开 关，Y，Z接电平显示发光管。 （2）按表格要求，拨动开关，改变A、B输入的状态，填表写出y、z的输出 状态，并根据真值表写出y、z逻辑表达式。
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实验二 半加/减器与全加/减器
一、 实验目的：
（1） 掌握全加器和半加器的逻辑功能。
（2） 熟悉集成加法器的使用方法。
（3） 了解算术运算电路的结构。
二、 实验设备：
1、 74LS00 （二输入端四与非门）
2、 74LS86 （二输入端四异或门）
3、 数字电路实验箱、导线若干。
Ver 4B 4A 4¥ 3B 3A 3Y
1A IB !Y 2A 2B 2Y GND
（74LS86引脚图）
三、 实验原理：
两个二进制数相加，叫做半加，实现半加操作的电路，称为半加器。
A 表示
被加数，B 表示加数，S 表示半加和，Co 表示向高位的进位。
全加器能进行加数、被加数和低位来的信号相加，并给出该位的进位信号以 及和。
四、 实验内容：
用74LS00和74LS86实现半加器、全加器的逻辑电路功能。
（一）半加器、半减器
M=0寸实现半加，M=1时实现半减，真值表如下：
（74LS00引脚
）
功能M A B S C
半加00000 00110 01010 01101
半减10000 10111 11010 11100
—s
+/-
——co
M （半加器图形符号）
2、
⑴S真值表:
00011110 00110 11001
A
⑵C真值表:
00011110 00000 10101 C 二B（A二M）
（二）全加器、全减器
S
CO
C^BC i-1 ・（M ㊉ A ）（B ㊉ C ）
、实验结果
半加器： S 二 AB AB = A 二 B
C =B （A 二 M ）
全加器： S = A 二 B - C i-1
G 二GM C 2M
CI B
+/一
其中G = （A 二B）G J AB , C2 二（AL B）Cj J ■ AB
为了方便，以下Cij用C表示
C I= （AB AB）C M（AB AB）CM ABM ABM
二A B C M A BC M ABCM ABCM ABM ABM
=ABC M A BC M ABCM ABCM （ABC M AB C M ABCM ABCM
=BC ABCM ABCM ABCM ABCM
=（M 二A）（B 二C）（BC）
贝U C i = BC i-1・（M 二A）（B 二C）
六、心得体会
本次实验做的是半加/减器和全加/减器两个电路，比上次实验复杂很多，因此充满了挑战性。
实验过程中，我认识到了在利用给定的电子元件进行实验设计来实现某一种或多种功能时，对电路的化简非常重要，而且要符合给定元件的限定条件，只有将电路化简成为能够与给定元件相符的情况下才能达到实验目的。
化简电路和连接电路需要注意细节，这就需要我们熟练掌握各类化简方式，保持清晰的思路；同样，错综复杂的电线容易让人眼花缭乱，这就需要高度的注意力
与逻辑分析能力。