数字逻辑模拟试卷3答案
《数字逻辑》自测题答案
A B
，当X=1时，它的功能
。
X Y(t ) 0 A B/0
1
1/ 1
1/ 0 1/ 1
0/1
D
0/0
1/ 1
D/0 B C / 0 A /1 C D / 0 B /1 D A /1 C /1
Y(t 1) / Z(t )
X 0 Q1Q0 00 01/ 0
1
EN / CP D Q D锁存器 Q D触发器
16. 画出具有循环进位的余3码加1计数器的Moore型状态图。
其它/0
0011/0
0100/0
0101/0
0110/0
0111/0
1100/1
1011/0
1010/0
1001/0
1000/0
17. 由74LS138译码器及逻辑门构成的组合逻辑电路如下，其中输入信号A7~A0 为地址变量。试填写表格。
0
0 1
0000
0000 0110
0011
0100 1011
8421码 X3 X2 X1 X0
0
≥1 &
0 W
0
0100 0101
0110
0111 1000
1
1 1
0110
0110 0110
1100
1101 1110
X3 X2 X1 X2 X0
1001
结论：
1
0110
1111
将8421码转换为2421码
（1）F
3
（2）功能：三变量一致检测电路
x3 x2 x1 en d0 d1 d2 d3 d4 d5 d6 d7
（3）module same(A,B,C,F); input A,B,C; output F;
《数字逻辑》第3章习题答案
题
【3-1】填空： (1) 逻辑代数中有三种最基本运算： 与 、 或 和 非 ，在此基础上又派生出五种基本运算， 分别为 与非 、 或非 、 异或 、 同或 、和 与或非 。 (2) 与运算的法则可概述为：有 0 出 0 ，全 1 出 1 ；类似地，或运算的法则为 有”1”出”1”， 全”0”出”0” 。 (3) 摩根定理表示为： A B = A B ； A B = A B 。 (4) 函数表达式 Y= AB C D ，则其对偶式为 Y ' = ( A B)C D 。 积的形式结果应为 M ( 0,1,2,4,5,8,9,10)。 (5) 函数式 F=AB+BC+CD 写成最小项之和的形式结果应为 m ((3,6,7,11,12,13,14,15))， 写成最大项之
0 0 1 1 1 1
1 1 0 0 1 1
0 1 0 1 0 1
1 1 0 0 1 0
【3-8】写出下列函数的反函数 F ，并将其化成最简与或式。 (1) F1 ( A D )( B C D)( AB C ) (2) F2 ( A B )( BCD E )( B C E )(C A) (3) F3 A B C A D (4) F4 ( A B)C ( B C ) D 解： (1) F1 AD C (2) F2 AB A C E (3) F3 AB AC A D (4) F4 BC C D ABD A B C 【3-9】用对偶规则，写出下列函数的对偶式 F ，再将 F 化为最简与或式。 (1) F1 AB B C A C (2) F2 A B C D (3) F3 ( A C )( B C D)( A B D) ABC (4) F4 ( A B )( A C )( B C )(C D) (5) F5 AB C CD BD C 解：题中各函数对偶函数的最简与或式如下： (1) F1 A BC AB C (2) F2 A B D A C D (3) F3 AC A BD (4) F4 A BC B C CD (5) F5 ABC D (6) F6 AB C D 【3-10】已知逻辑函数 F A B C , G=A⊙B⊙C，试用代数法证明： F G 。 解：
数字逻辑模拟试卷3答案
0
1
0
0
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1
1
1
1
1
精品
4.画出状态图如图 6 所示。 5.画出波形图如图 7 所示。
CP D Q1 Q2 Q3
6.说明逻辑功能。
.
图7
八、试用 4 位二进制计数器 74lLS161 接成 12 进制计数器，要求： 1． 分别采用反馈清零法实现，画出逻辑接线图（可适当添加门电路）； 2． 画出状态转换图。（8 分） （74LS161 功能表如图所示）
清零 预置 使能 时钟
预置数据输入
输出
RD LD EP ET CP D0 D1 D2 D4 Q0 Q1 Q2 Q3
0
X XX X XXXX 0 0 0 0
1
0 XX
ABCDABC D
1
1 0 X X X XX X 保
持
1
1 X 0 X X X X X保
持
1
1 11
X X X X计
数
精品
数字逻辑模拟试卷附答案
XX 大 学 试 题课程名称 数字逻辑电路设计 开课学院使用班级 考试日期苏 大 学 试题 第3 页苏大 学 试题第4 页四、根据下图波形写出其逻辑关系表达式Z=F(A,B,C) （10分）A B C Z五、分析题：某同步时序逻辑电路如图所示。
（12分）(1) 写出该电路激励函数和输出函数； (2) 画出输出矩阵和激励矩阵； (3) 画出状态表和状态图；(4）设各触发器的初态均为0，试画出下图中Q1、Q2和Z 的输出波形。
数字逻辑模拟试卷2答案一、填空题（每空1分，计20分） 1、(45)6=(35)8=(11101)2=(00101001)84212、若X= 138/512，则[X]反=（0.01000101），[－X]补=（1.10111011）。
3、若[X]补=101100，则X=（-100100），[X/2]补=（110110）。
4、若X=10100110，[X]Gray 码=(11110101)。
5、用n 位补码（含一位符号位）表示定点整数，其表示的数值范围是(-2n-1～2n-1-1)6、VHDL 程序一般由（实体）和结构体两部分组成,其中结构体的基本描述方法有(数据流描述法)、行为描述法和结构描述法。
7、信息码1010对应的奇校验汉明码的长度是（7位）。
8、函数F= A+BC 的反函数是（)(C B A ）。
9、集成芯片的集成度是以（等效门电路的数量）来衡量的。
10、三态门的三种输出状态是高电平、低电平和（高阻状态）。
11、正负逻辑的约定中，正逻辑是指（高电平表示1；低电平表示0）。
12、触发器的触发方式有直接电平触发、电平触发和（脉冲触发）、（边沿触发）几种。
13、对组合逻辑电路而言，PLD 的理论依据是（任何组合逻辑函数都可以用与-或式表示）。
14、ISP 指的是（在系统可编程技术）二、选择题（每题有一个或多个正确答案，每题1分计10分）1、A2、D3、B ，C4、A ，D5、A ，B ，D6、A ，B ，C7、A ，B ，C8、B9、B ，D 10、C 三、按要求化简下列函数（14分）1．用代数法求函数 F = A B + A B C + B C 的最简“与-或”表达式。
数字逻辑考题及答案
数字逻辑试题1答案一、填空：（每空1分，共20分）1、（20.57）8=（10.BC）162、(63.25)10=(111111.01)23、（FF）16=(255)104、[X]原=1.1101，真值X=-0.1101，[X]补=1.0011。
5、[X]反=0.1111，[X]补=0.1111。
6、-9/16的补码为1.0111，反码为1.0110。
7、已知葛莱码1000，其二进制码为1111，已知十进制数为92，余三码为110001018、时序逻辑电路的输出不仅取决于当时的输入，还取决于电路的状态。
9、逻辑代数的基本运算有三种，它们是_与_、_或__、_非_。
10、FAB1，其最小项之和形式为_。
FA B AB11、RS触发器的状态方程为_Q n1SRQ n_，约束条件为SR0。
12、已知F1AB、F2ABAB，则两式之间的逻辑关系相等。
13、将触发器的CP时钟端不连接在一起的时序逻辑电路称之为_异_步时序逻辑电路。
二、简答题（20分）1、列出设计同步时序逻辑电路的步骤。
（5分）答：（1）、由实际问题列状态图（2）、状态化简、编码（3）、状态转换真值表、驱动表求驱动方程、输出方程（4）、画逻辑图（5）、检查自起动2、化简FABABCA(BAB)（5分）答：F03、分析以下电路，其中RCO为进位输出。
（5分）答：7进制计数器。
4、下图为PLD电路，在正确的位置添*，设计出FAB函数。
（5分）15分注：答案之一。
三、分析题（30分）1、分析以下电路，说明电路功能。
（10分）解：XY m(3,5,6,7)m(1,2,4,7)2分ABCiXY0000000101010010111010001101101101011111该组合逻辑电路是全加器。
以上8分2、分析以下电路，其中X为控制端，说明电路功能。
（10分）解：FXA B C XABCXABCXABCXABCXABC4分FX(ABC)X(A B C ABC)4分所以：X=0完成判奇功能。
数字逻辑第3章答案
F， A B[(C D)E G]
5 (1) 如果已知 X + Y 和 X + Z 的逻辑值相同,那么 Y 和 Z 的逻
辑值一定相同。正确吗?为什么? (2) 如果已知 XY 和 XZ 的逻辑值相同,那么那么 Y 和 Z 的逻辑值
一定相同。正确吗?为什么? (3)如果已知 X + Y 和 X + Z 的逻辑值相同,且 XY 和 XZ 的逻辑
(1) F(A, B,C, D) BD AD CD CD ACD ABD
(2) F(A, B,C, D) (AB AB) C (AB AB) C
解答
G(A, B,C, D) AB BC AC (A B C) ABC
(1) 当 b a 时，令 a=1,b=0 能得到最简“与-或”表达式： F BC CD ACD （3 项）
(2) 当 a=1,b=1 时，能得到最简的“与-或”表达式：
F BC CD AC （3 项）
11 用列表法化简逻辑函数
F(A, B,C, D) m(0,2,3,5,7,8,10,11,13,15)
10
0
0
01 0 0 1 1
1
1
10 0 0 1 1
1
1
11 0 1 0 1
0
0
4 求下列函数的反函数和对偶函数： (1) F AB AB
(2) F A B A C C DE E
(3) F (A B)(C DAC)
(4) F A B CD E G
值相同，那么 Y = Z。正确吗?为什么? (4) 如果已知 X+Y 和 X·Y 的逻辑值相同,那么 X 和 Y 的逻辑值
数字逻辑课程三套作业及答案
数字逻辑课程三套作业及答案一、单选题。
1.(4分)如图某1-229（D）A.(A)B.(B)C.(C)D.(D)知识点：第五章解析第五章译码器2.(4分)如图某1-82（C）A.(A)B.(B)C.(C)D.(D)知识点：第二章解析第二章其他复合逻辑运算及描述3.(4分)N个触发器可以构成最大计数长度（进制数）为（D）的计数器。
A.NB.2NC.N2次方D.2N次方知识点：第九章解析第九章计数器4.(4分)n个触发器构成的扭环型计数器中，无效状态有（D）个。
A.A．nB.B.2nC.C．2n－1D.D．2n-2n知识点：第九章解析第九章集成计数器5.(4分)如图某1-293（A）A.(A)B.(B)C.(C)D.(D)知识点：第十一章解析第十一章数字系统概述6.(4分)如图某1-317A.(A)B.(B)C.(C)D.(D)知识点：第二章解析第二章其他复合逻辑运算及描述7.(4分)EPROM是指（C）A.A、随机读写存储器（D）B.B、只读存储器C.C、光可擦除电可编程只读存储器D.D、电可擦可编程只读存储器知识点：第十章解析第十章只读存储器8.(4分)如图某1-407（B）A.(A)B.(B)C.(C)D.(D)知识点：第十一章解析第十一章数字系统概述9.(4分)为实现将JK触发器转换为D触发器，应使（A）A.J=D,K=D非B.B.K=D,J=D非C.C.J=K=DD.D.J=K=D非知识点：第六章解析第六章各种触发器的比较10.(4分)一位8421BCD码计数器至少需要（B）个触发器。
A.3B.B.4C.C.5D.D.10知识点：第九章解析第九章计数器11.(4分)为把50Hz的正弦波变成周期性矩形波，应当选用（A）A.A、施密特触发器B.B、单稳态电路C.C、多谐振荡器D.D、译码器知识点：第六章解析第六章集成触发器12.(4分)下列描述不正确的是（A）A.a．D触发器具有两个有效状态，当Q=0时触发器处于0态B.b．移位寄存器除具有数据寄存功能外还可构成计数器。
数字逻辑试题及答案
数字逻辑试题及答案一、选择题（每题2分，共20分）1. 以下哪个是数字逻辑电路中的基本逻辑运算？A. 加法B. 减法C. 乘法D. 与运算2. 一个3输入的与门，当所有输入都为高电平时，输出为：A. 低电平B. 高电平C. 浮空D. 不确定3. 一个D触发器的Q端在时钟信号上升沿触发时，其状态变化为：A. 保持不变B. 从0变到1C. 从1变到0D. 从D输入端状态变化4. 在数字电路中，以下哪个不是布尔代数的基本定理？A. 幂等律B. 交换律C. 反演律D. 分配律5. 一个4位二进制计数器在计数到31后，下一个状态是：A. 00000B. 00001C. 11111D. 不能确定6. 以下哪个不是数字逻辑电路设计中的优化方法？A. 布尔代数简化B. 逻辑门替换C. 增加冗余D. 逻辑划分7. 一个异或门的真值表中，当输入相同，输出为：A. 0B. 1C. 无法确定D. 无输出8. 在数字电路中，同步计数器与异步计数器的主要区别在于：A. 计数范围B. 计数速度C. 电路复杂度D. 计数精度9. 以下哪个不是数字逻辑电路中的存储元件？A. 触发器B. 寄存器C. 计数器D. 逻辑门10. 一个简单的数字逻辑电路设计中，如果需要实现一个2输入的或门，至少需要几个与门？A. 1B. 2C. 3D. 4答案：1. D2. B3. D4. C5. B6. C7. A8. B9. D10. A二、填空题（每空2分，共20分）1. 数字逻辑电路中最基本的逻辑运算包括______、或运算、非运算。
2. 一个2输入的与门，当输入都为高电平时，输出为______。
3. 布尔代数的基本定理包括______、结合律、分配律等。
4. 一个D触发器的Q端在时钟信号上升沿触发时，Q端状态与______相同。
5. 4位二进制计数器的计数范围是从______到1111。
6. 数字逻辑电路设计中的优化方法包括布尔代数简化、逻辑门替换、______等。
数字逻辑考题及答案
数字逻辑试题1答案一、填空：（每空1分，共20分）1、（20.57）8 =（ 10.BC ）162、(63.25) 10= ( 111111.01 )23、（FF ）16= ( 255 )104、[X]原=1.1101，真值X= -0.1101，[X]补 = 1.0011。
5、[X]反=0.1111，[X]补= 0.1111。
6、-9/16的补码为1.0111，反码为1.0110 。
7、已知葛莱码1000，其二进制码为1111，已知十进制数为92，余三码为1100 01018、时序逻辑电路的输出不仅取决于当时的输入，还取决于电路的状态 。
9、逻辑代数的基本运算有三种，它们是_与_ 、_或__、_非_ 。
10、1⊕⊕=B A F ，其最小项之和形式为_ 。
AB B A F +=11、RS 触发器的状态方程为_n n Q R S Q +=+1_，约束条件为0=SR 。
12、已知B A F ⊕=1、B A B A F +=2，则两式之间的逻辑关系相等。
13、将触发器的CP 时钟端不连接在一起的时序逻辑电路称之为_异_步时序逻辑电路 。
二、简答题（20分）1、列出设计同步时序逻辑电路的步骤。
（5分）答：（1）、由实际问题列状态图（2）、状态化简、编码（3）、状态转换真值表、驱动表求驱动方程、输出方程（4）、画逻辑图（5）、检查自起动2、化简)(B A B A ABC B A F +++=（5分）答：0=F3、分析以下电路，其中RCO 为进位输出。
（5分）答：7进制计数器。
4、下图为PLD 电路，在正确的位置添 * ， 设计出B A F ⊕=函数。
（5分）5分 注：答案之一。
三、分析题（30分）1、分析以下电路，说明电路功能。
（10分）解： ∑∑==)7,4,2,1()7,6,5,3(m Y m X 2分A B Ci X Y0 0 0 0 00 0 1 0 10 1 0 0 10 1 1 1 01 0 0 0 11 0 1 1 01 1 0 1 01 1 1 1 18分2、分析以下电路，其中X 为控制端，说明电路功能。
《数字逻辑》总复习测试题参考答案
目录
• 测试题答案概述 • 选择题答案解析 • 填空题答案解析 • 简答题答案解析 • 计算题答案解析
01
测试题答案概述
测试题答案的解析
测试题1答案解析
这道题考查了基本逻辑门的功能和特点，通 过分析题目中的逻辑表达式，可以确定使用
的逻辑门类型和输入输出关系。
测试题2答案解析
解析：此题考查了触发器的功能，C选项代表了边沿触发器的特性，即在时钟信号的上升沿或下降沿时，触发器 会进行状态更新。
03
填空题答案解析填空题一答案及解析来自答案1010解析
根据二进制数的定义，二进制数由0和1组成，逢2进1。因此，将十进制数10转换为二进制数得到1010。
填空题二答案及解析
答案：8
测试题答案的注意事项
注意单位的统一
在解题过程中，需要注意单位的一致性，避免出现单位混淆或单位 错误的情况。
考虑边界条件
在分析逻辑电路或可编程逻辑器件的应用时，需要考虑各种边界条 件和极端情况，以确保电路的可靠性和稳定性。
重视细节
在解题过程中，需要注意细节问题，如符号的规范使用、电路连接方 式的正确性等，这些细节问题可能会影响最终结果的正确性。
05
计算题答案解析
计算题一答案及解析
答案
11010010
解析
根据二进制加法规则，1010+101=1101，然后后缀一个 0，得到11010010。
计算题二答案及解析
答案：3
解析：根据逻辑或运算规则，当两个输入信 号中至少有一个为高电平时，输出信号为高 电平。因此，A、B、C中至少有一个为高电
02
选择题答案解析
选择题一答案及解析
数字逻辑模拟卷 含答案
《数字逻辑》模拟试卷一、单项选择1、PROM 和PA L 的结构是（ A ）。
A .PROM 的与阵列固定B . PROM 或阵列不可编程C .PAL 与阵列全译码D . PAL 的与阵列可编程，ROM 或阵列不可编程2、设图中所有触发器的初始状态皆为0，找出图中触发器在时钟信号作用下，输出电压波形恒为0的是（ C ）。
3、下列各函数等式中无冒险现象的函数式有（ D ）。
A .B A AC C B F ++= B .B A BC C A F ++= C .B A B A BC C A F +++=D .C A B A BC B A AC C B F +++++=E .B A B A AC C BF +++= 4、二进制码10101010所对应的格雷码为（ D ）。
A .10111100B . 11111001C .00110101D .111111115、凡在数值上或时间上不连续变化的信号，例如只有高低电平的矩形波脉冲信号，称为（ C ）。
A ．直流信号B .模拟信号C .数字信号D .交流信号6、半导体存储器（ B ）的内容在掉电后会丢失。
A .MROMB .RAMC .EPROMD .E 2 PROM7、边沿式D 触发器是一种（ C ）稳态电路。
A .无B .单C .双D .多8、某移位寄存器的时钟脉冲频率为100KH Z ，欲将存放在该寄存器中的数左移8位，完成该操作需要（ B ）时间。
A .10μSB .80μSC .100μSD .800ms二、填空题1、8-3线优先编码器，输入、输出均为低电平有效。
若输入01234567I I I I I I I I 为11010010，且7I 的优先级别最高、0I 的优先级别最低，则输出012Y Y Y 为___010__。
2、=D 35.625）（()H A .23码）（8421BCD 0101 0010 0101.0110 0011 =3、已知N 的补码是1,01101011，则N 的原码是 1,10010101 ，N 的反码是 1,01101010 ，N 的真值是 －10010101 （或-149） 。
数字逻辑电路期末试卷及答案 (3)
第1页，共8页第2页，共8页院系： 专业班级： 学号： 姓名： 座位号：20 -20 学年第 学期期末考试试卷《数字逻辑电路》（A ）卷一、选择题（每小题2分，共20分）1、下列数中最大的数是 【D 】 A 、（3C ）16 B 、（57）8C 、（70）10D 、（1110010）22、8个输入端的编码器按二进制数编码时，输出端的个数是 【B 】 A 、2个 B 、3个C 、4个D 、8个3、逻辑电路中的晶体管一般工作在【B 】A 、放大区B 、饱和区或截至区C 、截至区D 、饱和区4、同步时序电路和异步时序电路比较，其差异在于后者 【B 】 A 、没有触发器； B 、没有统一的时钟脉冲控制； C 、没有稳定状态； D 、输出只与内部状态有关；5、n 个变量的逻辑函数全部最大项的个数有 【C 】 A 、n B 、2n C 、2nD 、2n -16、555定时器的结构如图1.1所示，如果芯片的5脚悬空；RD =V CC =5V ，6脚输入4V 电压，2脚输入2V 电压，下列关于555电路说法正确的是 【 A 】U CC U CO U 6(TH)(TR)U oR D U 2放电端图1.1（题1.6图）A 、U O 输出低电平，放电开关V 1导通；B 、U O 输出高电平，放电开关V 1截止；C 、U O 输出低电平，放电开关V 1截止；D 、U O 输出高电平，放电开关V 1导通； 7、图1.2所示用74LS161（同步16进制计数器，Cr 异步清零端、LD 同步置数端、OC 进位输出端，P 、T 计数允许端）构成的计数器正确的说法是 【D 】A 、同步置数法组成的9进制计数器；B 、异步置数法组成的8进制计数器；C 、同步置数法组成的10进制计数器；D 、异步复位法组成的9进制计数器； 图1.2（ 题1.7图） 8、要使由与非门组成的基本RS 触发器保持原状态不变，D S 、D R 端输入的信号应取 【A 】 A 、1==D D S RB 、10==D D S R 、C 、01==D DS R 、 D 、0==D D S R9、为获得输出频率非常稳定的脉冲信号，应采用 【C 】A 、对称多谐振荡器B 、555定时器组成的对称多谐振荡器第3页，共8页第4页，共8页装订线内不许答题 C 、石英晶体振荡器 D 、单稳态触发器 10、下列关于TTL 与非门闲置输入端的处理不正确的是 【D 】 A 、直接接电源电压VccB 、与有用输入端并联使用C 、外界干扰小时，可以剪断或悬空D 、直接接地1、二进制数-110011的补码是 1001101 。
数字逻辑试卷及答案
《数字电路与逻辑设计》模拟试卷1试题卷注意：1.试卷保密，考生不得将试卷带出考场或撕页，否则成绩作废。
请监考老师负责监督。
2.请各位考生注意考试纪律，考试作弊全部成绩以零分计算。
3.本试卷满分100分，答题时间为90分钟。
4.本试卷分为试题卷和答题卷，所有答案必须答在答题卷上，答在试题卷上不给分。
一、单项选择题(本大题共10小题，每小题2分，共20分)在每小题列出的四个选项中只有一个选项是符合题目要求的，请将正确选项前的字母填在答题卷相应题号处。
1. 下列四个数中，最大的数是 B 。
[A] (AF)16[B] (001010000010)8421BCD[C] (10100000)2[D] (198)102. 触发器有两个稳态，存储8位二进制信息要 B 个触发器。
[A] 2 [B] 8 [C] 16 [D] 323. 下列门电路属于双极型的是 A 。
[A] OC门[B] PMOS [C] NMOS [D] CMOS4. 对于钟控RS触发器，若要求其输出“0”状态不变，则输入的RS信号应为 A 。
[A] RS=X0 [B] RS=0X [C] RS=X1 [D] RS=1X5. 以下各电路中， B 可以产生脉冲定时。
[A] 多谐振荡器 [B] 单稳态触发器[C] 施密特触发器 [D] 石英晶体多谐振荡器 6. 下列逻辑电路中为时序逻辑电路的是 C 。
7. 同步时序电路和异步时序电路比较，其差异在于后者 B 。
[A] 没有触发器 [B] 没有统一的时钟脉冲控制[C] 没有稳定状态 [D] 输出只与内部状态有关 8. 当用专用输出结构的PAL 设计时序逻辑电路时，必须还要具备有 A 。
9. 当用异步I/O 输出结构的PAL 设计逻辑电路时，它们相当于 A 。
[A] 组合逻辑电路 [B] 时序逻辑电路[C] 存储器 [D] 数模转换器10. 要构成容量为4K×8的RAM ，需要 D 片容量为256×4的RAM 。
数字逻辑考题及答案解析
数字逻辑试题1答案一、填空：（每空1分，共20分） 1、（20.57）8 =（ 10.BC ）16 2、(63.25) 10= ( 111111.01 )2 3、（FF ）16= ( 255 )104、[X]原=1.1101，真值X= -0.1101，[X]补 = 1.0011。
5、[X]反=0.1111，[X]补= 0.1111。
6、-9/16的补码为1.0111，反码为1.0110 。
7、已知葛莱码1000，其二进制码为1111， 已知十进制数为92，余三码为1100 01018、时序逻辑电路的输出不仅取决于当时的输入，还取决于电路的状态 。
9、逻辑代数的基本运算有三种，它们是_与_ 、_或__、_非_ 。
10、1⊕⊕=B A F ，其最小项之和形式为_ 。
AB B A F += 11、RS 触发器的状态方程为_n n Q R S Q +=+1_，约束条件为0=SR 。
12、已知B A F ⊕=1、B A B A F +=2，则两式之间的逻辑关系相等。
13、将触发器的CP 时钟端不连接在一起的时序逻辑电路称之为_异_步时序逻辑电路 。
二、简答题（20分）1、列出设计同步时序逻辑电路的步骤。
（5分） 答：（1）、由实际问题列状态图 （2）、状态化简、编码（3）、状态转换真值表、驱动表求驱动方程、输出方程 （4）、画逻辑图 （5）、检查自起动2、化简)(B A B A ABC B A F +++=（5分） 答：0=F3、分析以下电路，其中RCO 为进位输出。
（5分） 答：7进制计数器。
4、下图为PLD 电路，在正确的位置添 * ， 设计出B A F ⊕=函数。
（5分）5分 注：答案之一。
三、分析题（30分）1、分析以下电路，说明电路功能。
（10分）解： ∑∑==)7,4,2,1()7,6,5,3(m Y m X 2分A B Ci X Y 0 0 0 0 0 0 0 1 0 1 0 1 0 0 1 0 1 1 1 0 1 0 0 0 1 1 0 1 1 0 1 1 0 1 0 111118分* *2、分析以下电路，其中X 为控制端，说明电路功能。
数字逻辑试卷及答案
《数字电路与逻辑设计》模拟试卷1试题卷注意：1.试卷保密，考生不得将试卷带出考场或撕页，否则成绩作废。
请监考老师负责监督。
2.请各位考生注意考试纪律，考试作弊全部成绩以零分计算。
3.本试卷满分100分，答题时间为90分钟。
4.本试卷分为试题卷和答题卷，所有答案必须答在答题卷上，答在试题卷上不给分。
一、单项选择题(本大题共10小题，每小题2分，共20分)在每小题列出的四个选项中只有一个选项是符合题目要求的，请将正确选项前的字母填在答题卷相应题号处。
1. 下列四个数中，最大的数是 。
[A] (AF)16 [B] (001010000010)8421BCD[C] (10100000)2 [D] (198)104. 对于钟控RS 触发器，若要求其输出“0”状态不变，则输入的RS 信号应为 。
5. 以下各电路中， 可以产生脉冲定时。
[A] 多谐振荡器 [B] 单稳态触发器[A] 2 [B] 8 [C] 16 [[A] OC 门 [B] PMOS [C] NMOS [D] CMOS [A] RS=X0 [B] RS=0X [C] RS=X1 [D] RS=1X[C] 施密特触发器 [D] 石英晶体多谐振荡器7. 同步时序电路和异步时序电路比较，其差异在于后者 。
[A] 没有触发器 [B] 没有统一的时钟脉冲控制[C] 没有稳定状态 [D] 输出只与内部状态有关9. 当用异步I/O 输出结构的PAL 设计逻辑电路时，它们相当于 。
[A] 组合逻辑电路 [B] 时序逻辑电路[C] 存储器 [D] 数模转换器二、多项选择题(本大题共5小题，每小题3分，共15分)在每小题列出的四个选项中有二至四个选项是符合题目要求的，请将正确选项前的字母填在答题卷相应题号处。
多选、少选、错选均无分。
11．逻辑变量的取值１和０可以表示：。
[A]开关的闭合、断开； [B]电位的高、低；[C]真与假； [D]电流的有、无；[A]全部输入是0； [B]全部输入是1；[C]任一输入为0，其他输入为1； [D]任一输入为1；[A] 变量译码器 [B] 加法器 [C] 数码寄存器 [D] 数据选择器 [A] 触发器 [B] 晶体管 [C] MOS 管 [D] 电容 [A] 2 [B] 4 [C] 8 [D] 32[A]用电压表测量指针不动；[B]相当于悬空；[C]电压不高不低；[D]测量电阻指针不动；[A]0；[B]1；[C]Q；[D] ；[A]边沿D触发器；[B]主从RS触发器；[C]同步RS触发器；[D]主从JK触发器；三、判断题(本大题共10小题，每小题2分，共20分)，正确的填T，错误的填F，请将答案填在答题卷相应题号处。
数字逻辑模拟卷__含答案 2
《数字逻辑》模拟试卷一、单项选择1、PROM 和PA L 的结构是（ A ）。
A .PROM 的与阵列固定B . PROM 或阵列不可编程C .PAL 与阵列全译码D . PAL 的与阵列可编程，ROM 或阵列不可编程2、设图中所有触发器的初始状态皆为0，找出图中触发器在时钟信号作用下，输出电压波形恒为0的是（ C ）。
3、下列各函数等式中无冒险现象的函数式有（ D ）。
A .B A AC C B F ++= B .B A BC C A F ++= C .B A B A BC C A F +++=D .C A B A BC B A AC C B F +++++=E .B A B A AC C BF +++= 4、二进制码10101010所对应的格雷码为（ D ）。
A .10111100B . 11111001C .00110101D .111111115、凡在数值上或时间上不连续变化的信号，例如只有高低电平的矩形波脉冲信号，称为（ C ）。
A ．直流信号B .模拟信号C .数字信号D .交流信号6、半导体存储器（ B ）的内容在掉电后会丢失。
A .MROMB .RAMC .EPROMD .E 2 PROM7、边沿式D 触发器是一种（ C ）稳态电路。
A .无B .单C .双D .多8、某移位寄存器的时钟脉冲频率为100KH Z ，欲将存放在该寄存器中的数左移8位，完成该操作需要（ B ）时间。
A .10μSB .80μSC .100μSD .800ms二、填空题1、8-3线优先编码器，输入、输出均为低电平有效。
若输入01234567I I I I I I I I 为11010010，且7I 的优先级别最高、0I 的优先级别最低，则输出012Y Y Y 为___010__。
2、=D 35.625）（()H A .23码）（8421BCD 0101 0010 0101.0110 0011 =3、已知N 的补码是1,01101011，则N 的原码是 1,10010101 ，N 的反码是 1,01101010 ，N 的真值是 －10010101 （或-149） 。
(完整版)1数字逻辑试卷及答案参考
XXXX 大学XXXX-XXXX 学年第一学期期末考试试题及答案考试科目：数字逻辑电路 试卷类别：3卷 考试时间：120 分钟 XXXX 学院 ______________系级班姓名学号毛题号一二三四总分得分一、选择题1． 八进制（273）8中，它的第三位数2 的位权为___B___。
A ．(128)10B ．(64)10C ．(256)10D ．(8)102. 已知逻辑表达式B C A AB F ++=，与它功能相等的函数表达式_____B____。
A ．AB F = B ．C AB F += C ．C A AB F +=D ． C B AB F +=3. 相邻两组编码只有一位不同的编码是 DA ．8421BCD 码B. 5421BCD 码C. 余3码D.循环码4．对于如图所示波形,其反映的逻辑关系是___B_____。
A ．与关系B ． 异或关系C ．同或关系D ．无法判断5． 连续异或2012个1的结果是____A_____。
A ．0B ．1C ．不确定D ．逻辑概念错误得分评卷人t 6. 与逻辑函数D C B A F +++= 功能相等的表达式为___C_____。
A ． DC B A F +++= B ．D C B A F +++=C ． D ．D C B A F =D C B A F ++=7．下列所给三态门中，能实现C=0时，F=；C=1时，F 为高阻态的AB 逻辑功能的是____A______。
8. 如图所示电路，若输入CP 脉冲的频率为100KHZ ，则输出Q 的频率为_____D_____。
A ． 500KHzB ．200KHzC ． 100KHzD ．50KHz 9．下列器件中，属于时序部件的是_____A_____。
A ． 计数器B ． 译码器C ． 加法器D ．多路选择器10．下图是共阴极七段LED 数码管显示译码器框图，若要显示字符“5”，则译码器输出a ～g 应为____C______。
《数字逻辑》作业参考答案
《数字逻辑》作业参考答案一、单项选择题1．C 2．B 3．D 4．C 5．A 6．D 7．A 8．A二、请根据真值表写出其最小项表达式1．2．三、用与非门实现1．四、用或非门实现1．五、逻辑电路如图所示，请分析出该电路的最简与或表达式，并画出其真值表。
1真值表略 LCABC AB Y ++=2．六、用与非门设计一个举重裁判表决电路。
设举重比赛有3个裁判，一个主裁判和两个副裁判。
杠铃完全举上的裁决由每一个裁判按一下自己面前的按钮来确定。
只有当两个或两个以上裁判判明成功，并且其中有一个为主裁判时，表明成功的灯才亮。
七、设计一个楼上、楼下开关的控制逻辑电路来控制楼梯上的路灯，使之在上楼前，用楼下开关打开电灯，上楼后，用楼上开关关灭电灯；或者在下楼前，用楼上开关打开电灯，下楼后，用楼下开关关灭电灯。
八、①试分析下图中用何种触发器，并写出该触发器的特性方程。
②分析该时序逻辑电路的功能。
1．有效循环的6个状态分别是0～5这6个十进制数字的格雷码，并且在时钟脉冲CP 的作用下，这6个状态是按递增规律变化的，即：000→001→011→111→110→100→000→…所以这是一个用格雷码表示的六进制同步加法计数器。
当对第6个脉冲计数时，计数器又重新从000开始计数，并产生输出Y ＝1。
2．当输入X ＝0时，在时钟脉冲CP 的作用下，电路的4个状态按递增规律循环变化，即：00→01→10→11→00→…当X ＝1时，在时钟脉冲CP 的作用下，电路的4个状态按递减规律循环变化，即：00→11→10→01→00→…可见，该电路既具有递增计数功能，又具有递减计数功能，是一个2位二进制同步可逆计数器。
3． 在时钟脉冲CP 的作用下，电路的8个状态按递减规律循环变化，即：000→111→110→101→100→011→010→001→000→…电路具有递减计数功能，是一个3位二进制异步减法计数器4．有效循环的6个状态分别是0～5这6个十进制数字的格雷码，并且在时钟脉冲CP的作用下，这6个状态是按递增规律变化的，即：000→001→011→111→110→100→000→…所以这是一个用格雷码表示的六进制同步加法计数器。
数字逻辑、数电试卷【含答案】 (3)
第一章1.1 将下列二进制数转换为等值的十进制数和十六进制数。
（100010111 ）2 ；（1101101 ）2 ；（0.01011111 ） 2 ；（11.001 ）2 。
1.2 将下列十六进制数转换为等值的二进制数和十进制数。
（8C ）16 ；（3D.BE ）16 ；（8F .FF ）16 ；（10.00 ）16 。
1.3 将下列十进制数转换为等值的二进制数和十六进制数。
（37 ）10 ；（51 ）10 ；（25.25 ）10 ；（0.75 ）10 。
1.4 用逻辑代数的基本公式和常用公式将下列逻辑函数化为最简与或式。
（ 1 ）=1（ 2 ） B（ 3 ） 1（ 4 ）AD（ 5 ）略1.5 将下列函数化为最小项表达式。
（ 1 ）（ 2 ）（ 3 ）1.6 用卡诺图化简法将下列逻辑函数化为最简与或式。
（ 1 ）（ 2 ）（ 3 ）（ 4 ）（ 5 ），约束条件为B+非A*D+AC1.7 逻辑代数中三种最基本的逻辑运算是什么？与或非1.8 任意两个不同的最小项之积恒为。
11.9 逻辑变量A 、B 、C 的全部最小项之和恒为。
11.10 8421BCD 码（10001000 ）对应的余3 码为。
（1011 1011）1.11 函数的最简与或式是。
A; ;; ;1.12 的原函数。
C; ;1.13 以下的逻辑式中，正确的是。
D则则第二章2.1 在逻辑电路中，以1 表示高电平，以0 表示低电平的逻辑关系称为逻辑。
正2.2 用于实现基本逻辑运算的电子电路通称为。
2.3 要封锁一个或门（即输出恒为高电平），可将其中一个输入端接电平。
高2.4 要封锁一个与门（即输出恒为低电平），可将其中一个输入端接电平。
低2.5 三态输出门电路的三种输出状态是、和。
高阻，高电平，低电平2.6 输出能实现线与（即输出端并联）的门电路有。
ocod门2.7 若将8 个三态门的输出端共用一条数据线，则在任何时刻应至少有个三态门的输出端处于高阻状态。
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题号一 二 三 四 五 六 七 八 九 十
总分
应得分 20 8 6 8 16 8 16 8 10
实得分
试卷共 7 页，请先查看试卷有无缺页，然后答题。 一、选择填空(每题 2 分，共 20 分)
1．2005 个 1 连续异或的结果是 ( b )。
(a)0
(b)1
(c)不唯一
(d)逻辑概念错误
2．用卡诺图化简具有无关项的逻辑函数时，若用圈 1 法，在包围圈内的 x 是按 ( b )处理；
在包围圈外的 x 是按 ( )处理。
(a)1,1
(b)1,0
(c)0,0
(d)不确定
3．用三态门可以实现“总线”连接，但其“使能”控制端应为( d )。
(a)固定接 0 (b) 固定接 1
(c)同时使能
(d)分时使能
4．TTL 门电路输人端对地所接电阻 R≥RON 时，相当于此端 ( a )。 (a)接逻辑“1” (b)接逻辑“0” (c)接 2.4V 电压 (d) 逻辑不定
0
0
1
1
0
1
0
1
1
0
1
1
1
0
0
1
1
精品
.
1
1
1
0
0
1
由真值表写出其逻辑表达式
四、分析下图组合电路（要求写出输出表达式，列出真值表，说明其功能）(8 分)
&
I0
1
I1
1
&
I2
1
&
I3
1
&
解：首先写出其输出表达式
≥ Y1 1
≥ Y0 1
然后列出真值表如下
0
0
1
0
0
1
0
1
0
0
1
0
1
0
0
0
1
1
功能是：编码器
b) 画状态表和状态转换图。
c) 画出输出端 Q1、Q2、Q3 的波形。
d) 说明电路的逻辑功能。（16 分）
Q1
Q2
Q3
D
J
J
J
C
C
C
1
K
K
K
CP
CP
精品
D
Q1
.
解： 1.写出驱动方程
2.写出状态方程
3.列出状态表 D
0
0
0
0
0
0
0
0
0
0
1
0
1
0
0
0
1
0
1
0
0
0
0
1
1
1
1
0
0
1
0
0
0
0
0
0
1
0
1
.
上海应用技术学院 2009—2010 学年第 2 学期
《数字电子技术》期（末）（A）试卷
课程代码: B203115 学分: 3 考试时间: 100 分钟
课程序号: 1862 1863 1864 1865
班级：
学号：
姓名:
我已阅读了有关的考试规定和纪律要求，愿意在考试中遵守《考场规则》，如有违反将 愿接受相应的处理。
五、设三台用电设备（A、B、C）耗电功率分别为 10、20、30KW，这三台设备的投入是随
机的组合，而自备电源的容量为 35KW。试设计电源过载保护逻辑电路，当过载时输出 L 为
1，不过载时输出 L 为 0。 要求：
1．列出真值表；
2．写出最简逻辑表达式；
3．画出用与非门构成的逻辑电路图。
4. 画出用八选一数据选择器 74LS151 构成的逻辑电路图并写出相应输出表达式。（16 分）
（2）画出 Q，1 , 2 的波形。（8 分）
精品
.
cp
解：写出 JK 触发器的特性方程
由于 JK 均取 1，此时 JK 触发器处于翻转状态。 同时输出Φ1 和Φ2 的表达式如下
由此画出其波形图如图 5 所示。
CP Q
Q Φ1 Φ2
图5
七、图示电路中，已知 CP、D 的波形，设初态为 0，
a) 写出驱动方程、状态方程和输出方程；
5．多路数据选择器 MUX 的输入信号可以是( d )。
(a)数字信号 (b)模拟信号
(c)数模混合信号 (d)数字和模拟信号
6．两个与非门构成的基本 RS 锁存器，当 Q=1、 =0 时，两个输入信号 R=1 和 S＝1。触发
器的输出 Q 会 ( b ) 。
(a)变为 0
(b)保持 1 不变
(c)保持 0 不变 精品
1
0
0
1
1
11Leabharlann 2.写出逻辑表达式并化简3．用与非门来实现如图 3 所示。
精品
.
A B C
&
&
&
图3
4.用数据选择器 74LS151 来实现如图 4 所示。
E
D7 D6 D5 D4
D3
1
D2
D1
D0
0
A
S2
B
S1
C
S0
74LS151
Y
L
图4
六、双相时钟发生器如下图所示，
（1）写出 JK 触发器的特性方程；
74LS151 功能表：
74LS151 逻辑图：
精品
.
输入
输出
G
CB A
YW
1
01
0
00 0
D0
D0
0
001
D1
D1
0
01 0
D2
D2
0
01 1
D3
D3
0
10 0
D4
D4
0
101
D5
D5
0
11 0
D6
D6
0
1 11
D7
D7
解：
1.列出真值表
A
B
C
L
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
(b)单稳态触发器
(c)多谐振荡器
(d)集成定时器
10．把模拟量转换成为相应数字量的转换器件称为( d )。
(a)数—模转换器 (b)DAC (c)D／A 转换器 (d)ADC
二、用卡诺图法化简函数（8 分） (1) 解：本题的卡诺图如图 1 所示：
C
0 11 0
011 0 B
0 111 A
0 111
其化简结果为：
D 图1
精品
.
(2) 解：本题的卡诺图如图 2 所示：
C
其化简结果为：
1 1 ××
1 ××1
B
0 1 ×0
A
0 1 ××
D 图2
三、.写出图示逻辑电路出端的逻辑表达式。（6 分）
+VC
A
&
B
C
&
&
F1
解：首先写出其真值表如下表
A
B
C
L
0
0
0
1
1
0
0
0
1
1
0
1
0
1
0
1
1
0
0
1
1
1
0
1
1
清零 预置 使能 时钟
预置数据输入
输出
RD LD EP ET CP D0 D1 D2 D4 Q0 Q1 Q2 Q3
0
X XX X XXXX 0 0 0 0
1
0 XX
ABCDABC D
1
1 0 X X X XX X 保
持
1
1 X 0 X X X X X保
持
1
1 11
X X X X计
(d)无法确定
. 7．某触发器的状态是在 CP 的下降沿发生变化，它的电路符号应为（ b ）。
（a）
（b）
（c）
(d)
8．欲把串行数据转换成并行数据，可用（ c ）。
(a)计数器
(b)分频器
(c)移位寄存器
(d)脉冲发生器
9．数字系统中，常用( a )电路，将输入缓变信号变为矩形脉冲信号。
(a)施密特触发器
0
1
0
0
1
1
0
1
0
0
0
1
1
1
1
1
0
1
0
0
0
0
0
1
1
0
0
1
0
1
1
1
0
1
0
1
0
1
1
0
1
1
1
1
1
1
1
0
0
0
0
1
1
1
0
1
0
1
1
1
1
1
0
1
0
1
1
1
1
1
1
1
1
精品
4.画出状态图如图 6 所示。 5.画出波形图如图 7 所示。
CP D Q1 Q2 Q3
6.说明逻辑功能。
.
图7
八、试用 4 位二进制计数器 74lLS161 接成 12 进制计数器，要求： 1． 分别采用反馈清零法实现，画出逻辑接线图（可适当添加门电路）； 2． 画出状态转换图。（8 分） （74LS161 功能表如图所示）