《数字电路逻辑设计》期末考试题4

《数字电路》期末考试题四

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一、填空题：（每空1分，共27分）

1、数字电路中最基本的三种逻辑运算是 、 和 。

2、一个逻辑函数，如果有n 个变量，则有 个最小项；任何一个逻辑函数可以化成一组 之和表达式，称为 表达式。

3、数据比较器的逻辑功能是对输入的 个数据进行比较，它有 、 和 三个输出端。

4、描述一个时序逻辑电器的功能，必须使用三个方程式，它们是 、 和 。

5、触发器异步置0，须使S D = ，R D = ，而与 和 无关。（设异步控制端低电平有效）。

6、触发器有 个稳态，它可记录 位二进制码，存储8位二进制信息需要 个触发器。

7、如图（a ）所示电路中，CP 脉 冲的频率为2KHZ ，则输出端Q 的 频率为 ；在（b ）所示电 路中，CP 脉冲的频率为4KHZ ，则

输出端Q 的频率为 。

8、加法器分 加法器和 加法器两种。

9、八位移位寄存器，串行输入时经 个CP 脉冲后，8位数码全部移入寄存器中；若该寄存器已存满8位数码，欲将其串行输出，则需经 个CP 脉冲后，数码才能全部输出。 10、在某计数器的三 个触发器输出端Q 1Q 2Q 3 观察到如图所示波形， 由波形图可知该计数器

是模 计数器。 二、选择题：（每题2分，共30分）

1、若输入变量A 、B 全都为1时，输出F=0，则其输入与输出的关系是 。 A 、非 B 、与 C 、与非 D 、或

2、在 情况下，函数C B A F ++=运算的结果是逻辑“1”。 A 、全部输入是“0” B 、任一输入是“0” C 、仅一输入是“0” D 、全部输入是“1”

3、逻辑表达式C B A ⋅⋅= 。

A 、A+B+C

B 、

C B A ++ C 、C B A ++

D 、C B A ⋅⋅ 4、n 个变量的最小项是 。

A 、 n 个变量的积项，它包含全部n 个变量，每个变量可用原变量或反变量

B 、 n 个变量的和项，它包含全部n 个变量，每个变量可用原变量或反变量

C 、 n 个变量的积项，它包含全部n 个变量，每个变量仅为原变量

D 、 n 个变量的和项，它包含全部n 个变量，每个变量仅为反变量 5、最小项D C B A 的逻辑相邻项是 。

A 、ABCD

B 、A B

C

D C 、BCD A D 、D C B A 6、在下列逻辑电路中，不是组合逻辑电路的有 。

A 、译码器

B 、编码器

C 、全加器

D 、寄存器 7、八路数据分配器，其地址输入端有 个。

A 、8

B 、4

C 、3

D 、16

8、JK 触发器在CP 脉冲作用下，欲使Q n+1=Q n ，则输入信号不能为 。 A 、J=K=0 B 、J=Q ，K=Q C 、J=Q ，K=Q D 、J=Q ，K=0

9、一个四位二进制减法计数器的起始值为1001，经过100个CP 脉冲作用后之后的值为 。

A 、1100

B 、0100

C 、1101

D 、0101 10、组合逻辑电路通常由 组合而成。

A 、门电路

B 、触发器

C 、寄存器

D 、计数器 11、两个TTL 或非门构成的基本RS 触发器如右图， 如图R=S=0，则触发器的次态应为 。 A 、置0 B 、置1 C 、Q n+1=Q n D 、ϕ=+1n Q

12、用n 个触发器构成的计数器，可得到的最大计数长度（即计数模）为 。 A 、n B 、2n C 、n 2 D 、2n

13、同步时序电路和异步时序电路比较，其差异在于后者 。 A 、没有触发器 B 、没有统一的时钟脉冲控制 C 、没有稳定状态 D 、输出只与内部状态有关 14、下列触发器中没有约束条件的是 。

A 、基本RS 触发器

B 、主从RS 触发器

C 、钟控RS 触发器

D 、边沿D 触发器

15、用计数器产生000101序列，至少需要 个触发器。 A 、2 B 、3 C 、4 D 、8

三、分析题：（共43分）

1、 用卡诺图求函数F （A ，B ，C ，D ）=∑)11,10,9,8,6,4,3,2,1,0(m 的最简与或式。（7分）

2、晶体管电路如图所示，试判断晶体管处于什么状态。（7分）

5、分析如图所示电路的逻辑功能，检查能否自启动，作出全状态转换图。（11分）3、将JK触发器转化为D触发器，并画出转化电路图。（7分）

4、如图所示电路为D触发器构成的计数器，写出各触发器CP端的脉冲信号，驱动方程，

状态方程，并画出CP脉冲作用下的输出波形，指明计数器的功能。（11分）