第 3 章 逻辑门电路总结

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第三章 门电路 - 第二部分

第三章 门电路 - 第二部分

负载 高电平输出等效电路
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TTL反相器的静态输出特性
1. 高电平输出特性
T4、D2导通,T2、T5截止。电流流出门(拉电流) •空载时:vO= vOH ≈ 5-2×0.7=3.6V •加上负载RL时: 当RL较大,iL< 5mA时,由于是射极跟随器输出, 内阻低,输出电平随输出电流iL的变化不大,基 本保持为VOH 。 随着RL的减小,iL增大,R4上的压降也随之增大, 最终使T4的集电结变为正偏,T4进入饱和状态, 失去射极跟随功能,输出vO随iL绝对值的增加而 几乎线性地降低。 受功耗限制,实际器件高电平输出时iL的最大值 比5mA小得多,74系列手册上规定iL不能超过 0.4mA。
I A + I B = 2 I IH ≤
2. 或非门
或非门的输入端和输出 端电路与反相器相同, 所以输入特性和输出特 性也和反相器一样。
A
A+B

A+B
A+B

B
输入特性:当输入为高或低电平时,总电流均等于各输入端电流之和。 与输入端个数有关。
动态电流
当输出从低电平转换为高电平的过程中,T4从截止变为导通,T5从深 度饱和变为截止, T5转换所需的时间比T4长,因此在过渡过程中会出 现短时间内T4和T5同时导通的状态,此时有很大的瞬时电流流过T4和 T5 ,使电源电流出现尖峰脉冲。
尖峰电流的影响:使电源电流平均值加大了。 在计算电源容量时应考虑尖峰电流的影响。应 采取措施抑制尖峰电流导致的系统内部噪声。
输入特性:输入电流与输入电压之间的关系,即iI = f(vI)
电流为正
iI
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TTL反相器的静态输入特性

数字电路基础知识

数字电路基础知识

第三章 数字电路基础知识1、逻辑门电路(何为门)2、真值表3、卡诺图4、3线-8线译码器的应用5、555集成芯片的应用一. 逻辑门电路(何为门)在逻辑代数中,最基本的逻辑运算有与、或、非三种。

每种逻辑运算代表一种函数关系,这种函数关系可用逻辑符号写成逻辑表达式来描述,也可用文字来描述,还可用表格或图形的方式来描述。

最基本的逻辑关系有三种:与逻辑关系、或逻辑关系、非逻辑关系。

实现基本逻辑运算和常用复合逻辑运算的单元电路称为逻辑门电路。

例如:实现“与”运算的电路称为与逻辑门,简称与门;实现“与非”运算的电路称为与非门。

逻辑门电路是设计数字系统的最小单元。

1.1.1 与门“与”运算是一种二元运算,它定义了两个变量A 和B 的一种函数关系。

用语句来描述它,这就是:当且仅当变量A 和B 都为1时,函数F 为1;或者可用另一种方式来描述它,这就是:只要变量A 或B 中有一个为0,则函数F 为0。

“与”运算又称为逻辑乘运算,也叫逻辑积运算。

“与”运算的逻辑表达式为:F A B =⋅ 式中,乘号“.”表示与运算,在不至于引起混淆的前提下,乘号“.”经常被省略。

该式可读作:F 等于A 乘B ,也可读作:F 等于A 与B 。

由“与”运算关系的真值表可知“与”逻辑的运算规律为:00001100111⋅=⋅=⋅=⋅= 表2-1b “与”运算真值表简单地记为:有0出0,全1出1。

由此可推出其一般形式为:001A A AA A A⋅=⋅=⋅=实现“与”逻辑运算功能的的电路称为“与门”。

每个与门有两个或两个以上的输入端和一个输出端,图2-2是两输入端与门的逻辑符号。

在实际应用中,制造工艺限制了与门电路的输入变量数目,所以实际与门电路的输入个数是有限的。

其它门电路中同样如此。

1.1.2 或门“或”运算是另一种二元运算,它定义了变量A 、B 与函数F 的另一种关系。

用语句来描述它,这就是:只要变量A 和B 中任何一个为1,则函数F 为1;或者说:当且仅当变量A 和B 均为0时,函数F 才为0。

第3章逻辑门电路PPT 共126页

第3章逻辑门电路PPT   共126页

电位被钳 在2.1V
全反偏
“1” A B C
R1 3k
b1 c1 T1
+5V
R2
R4
1V
T2 T3
T4
R5
截止
F
全导通
T5
R3
(2-24)
全反偏
“1” A
B C
R1 3k
R2
b1 c1 T1
T2
逻辑关系:全1则0。
R3
+5V
uF =0.3V F
T5
饱和
输入、输出的逻辑关系式: F ABC
(2-25)
RP的临界值可计算如下:
1.4V=
R1RPRP(5 - V be1)
=
4 . 3 RP R1 RP
RP=1.4KΩ(R1=3K Ω)为安全起见,如要求输入等 效为低电平时,对TTL门电路应使RP小于1 K Ω; 如要求输入等效为高电平时,对TTL门电路应使RP 大于2K Ω。
(2-39)
例能3正.5确.3地综在传合图送以3到上.5.门两20G种所2的情示输况的入,电端应路,取中要R,P求为≤0v保.o618证=KV门OHG时1输vI2出≥V的IH高(、min低),电平 vO1=VOL也时就,是v说I2≤GV1I和L(Gm2a之x)间,的试串计联算电RP阻的应最小大于允许值是多少?已知 G1和G26均80为7,4系否列则反当相vO器1=V,OLV时C可C=能5超V,过VVILO(H=m3ax.)4V, VOL=0.2V, VIH(min)=2.0V, VIL(max)=0.8V。 G1和G2的输入特性和输出特性 见图3.5.12和图3.5.14、图3.5.16。
(2-27)
1. 输出高电平UOH、输出低电平UOL UOH2.4V UOL 0.4V 便认为合格。 典型值UOH=3.4V UOL=0.3V 。

数字逻辑第3章 门电路

数字逻辑第3章 门电路

逻辑式:Y=A + B
逻辑符号: A 1
B
Y
电压关系表
uA uB uY
0V 0V 0V 0V 3V 2.3V 3V 0V 2.3V 3V 3V 2.3V
真值表
ABY
0
0
0
0
1
1
1
0
1
1
1
1
三、三极管非门
5V
利用二极管的压降为0.7V, 保证输入电压在1V以下时,
电路可靠地截止。
A(V) Y(V) <0.8 5 >2 0.2
II H &
II L &
… …
NOH
I OH (max) I IH
N MIN ( NOH , NOL )
NOL
IOL(max) I IL
六、CMOS漏极开路门(OD)门电路(Open Drain)
1 . 问题的提出
普通门电路
在工程实践中,往往需要将两个门的输出端 能否“线与”?
并联以实现“与”逻辑功能,称为“ 线与 。
输入 0 10% tr tf
tPHL
输出
tPLH
tr:上升时间
tf:下降时间 tw:脉冲宽度 tPHL:导通传输时间
tPLH:截止传输时间
平均传输延迟时间 (Propagation delay)
tpd= tpHL+ tpLH 2
5、功耗: 静态功耗:电路的输出没有状态转换时的功耗。 动态功耗:电路在输出发生状态转换时的功耗。
PMOS
NMOS
3、增强型MOSFET的开关特性
iD管可变子类型恒
VGS1 击开/关的条(件1)N沟道增强开型/M关O的S等FE效T电:路

第三章逻辑门电路

第三章逻辑门电路
2.74L系列——为低功耗TTL系列,又称LTTL系列。 3.74H系列——为高速TTL系列。
4.74S系列——为肖特基TTL系列,进一步提高了速度。如图示。
5.74LS系列——为低功耗肖特基系列。 6.74AS系列——为先进肖特基系列,
它是74S系列的后继产品。
7.74ALS系列——为先进低 功耗肖特基系列,
t
50%
主要取决于存储时间ts, 5管门电路 tpd=40ns
o tpHL tpLH
t
4、功耗
静态功耗:当电路的输出没有状态转换时的 功耗。 例如:便携计算机、手机和PDA等。 动态功耗:CMOS电路在输出发生状态转换时的 功耗。
5、延时——功耗积
Dp tpdPD
tpd=(tPLH+tPHL)/2用平均传输延迟时间, tPLH---由低电平转换到高电平所花的时间.
SN (1)
74 (2)
S (3)
195 (4)
J 封装的4位并行移位寄存器 (5)
司制造的采用陶瓷双列直插
封装形式 J:陶瓷双列直插封装 器件种类:4位并行移位寄存器 器件系列:肖特基74TTL电路系列 产品系列 74系列 制造厂商 SN:美国TEXAS公司制造
TTL集成逻辑门电路系列简介
1.74系列——为TTL集成电路的早期产品,属中速TTL器件。
输入电压在3.5V~5.0V范围对应高电平逻辑1 输入电压在0~1.5V范围对应低电平逻辑0
输入低电平上限VIL、输入高电平下限VIH、 输出低电平上限VOL、输出高电平下限VOH、
2.噪声容限
1
VOH(min) VNH VIH(min) VIL(max) VNL
1
在保证输出高、低电平基本不变 的条件下,输入电平的允许波动 范围称为输入端噪声容限。

数字模拟电路---第三章 逻辑门电路(1)

数字模拟电路---第三章 逻辑门电路(1)

路。

简称门电路。

5V一、TTL 与非门图3-1 典型TTL 与非门电路3.2 TTL 集成门电路•数字集成电路中应用最广的为TTL 电路(Transister-Transister-Logic 的缩写)•由若干晶体三极管、二极管和电阻组成,TTL 集成电路有54/74系列 ①输出高电平UOH 和输出低电平UOL 。

 •输出高电平U OH:至少有一个输入端接低电平时的输出电平。

•输出低电平U OL:输入全为高电平时的输出电平。

• 电压传输特性的截止区的输出电压UOH=3.6V,饱和区的输出电压UOL=0.3V。

一般产品规定U OH≥2.4V、U OL<0.4V时即为合格。

 二、TTL与非门的特性参数③开门电平U ON 和关门电平U OFF 。

 开门电平U ON 是保证输出电平达到额定低电平(0.3V )时,所允许输入高电平的最低值,表示使与非门开通的最小输入电平。

通常U ON =1.4V ,一般产品规定U ON ≤1.8V 。

 关门电平U OFF 是保证输出电平为额定高电平(2.7V 左右)时,允许输入低电平的最大值,表示与非门关断所允许的最大输入电平。

通常U OFF ≈1V ,一般产品要求U OFF ≥0.8V 。

5). 扇入系数Ni和扇出系数N O 是指与非门的输入端数目。

扇入系数Ni是指与非门输出端连接同类门的个数。

反扇出系数NO映了与非门的带负载能力。

6)输入短路电流I IS 。

 当与非门的一个输入端接地而其余输入端悬空时,流过接地输入端的电流称为输入短路电流。

7)8)平均功耗P 指在空载条件下工作时所消耗的电功率。

三、TTL门电路的改进 74LS系列 性能比较好的门电路应该是工作速度既快,功耗又小的门电路。

因此,通常用功耗和传输延迟时间的乘积(简称功耗—延迟积或pd积)来评价门电路性能的优劣。

74LS系列又称低功耗肖特基系列。

74LS系列是功耗延迟积较小的系列(一般t pd<5 ns,功耗仅有2 mW) 并得到广泛应用。

3门电路 (简)

3门电路 (简)

门的多余输入端接地。
一般,接电源时需接上拉电阻;接地时需接下拉电阻。 典型值1-10k。 +5V 上拉电阻保持 1k
高电平
A B
F
下拉电阻保持 低电平
A B
C
F
C 1k
3.3 CMOS门电路

电路设计与安装应尽量消除噪声,保证电路稳定工作。
( 1)在每一块插板的电源线上,并接几十 μF 的低频去 耦电容和 0.01~0.047μF 的高频去耦电容,以防止 TTL 电路 的动态尖峰电流产生的干扰。 (2) 整机装置应有良好的接地系统。
表1 各种系列门电路的主要参数
表2 常用集成门电路(TTL系列)
型 号 74LS00 74LS02 74LS04 74LS05 74LS08 74LS13 74LS30 名 称 四2输入与非门 四2输入或非门 六反相器 六反相器 四2输入与门 双4输入与非门 8输入与非门 施密特触发 OC门 主要功能
1. TTL门驱动CMOS门
(1)电平不匹配
TTL门作为驱动门,它的UOH≥2.4V,UOL≤0.5V;
CMOS门作为负载门,它的UIH≥3.5V,UIL≤1V。
可见,TTL门的UOH不符合要求。
(2)电流匹配 CMOS电路输入电流几乎为零,所以不存在问题。
3.5 TTL电路与CMOS电路的接口电路
当EN= 0时,TG导通,F=A; 当EN= 1时,TG截止,F为高阻输出。
3.3 CMOS门电路
CMOS系列及命名方法
74 FAM nn
HC( High-speed CMOS ,高速 CMOS 系列); 例: 74HC04商用高 HCT(High-speed CMOS, 前缀:74—商用系列;54—军用系列。 速CMOS 六反相 TTL compatible ,与 TTL兼 容的高速CMOS 系列); 助记符:以字母表示系列类型。 器; VHC(Very High-speed CMOS,甚高速 CMOS商用 系 74HCT00 功能数字:以数字表示电路的 列); 高速 CMOS 四 -二 VHCT: Very High-speed 逻辑功能。 CMOS, TTL compatible,与 输入与非门。 TTL兼容的甚高速CMOS 系 列)。

数电第三章门电路

数电第三章门电路
15
§3.4 TTL门电路
数字集成电路:在一块半导体基片上制作出一个 完整的逻辑电路所需要的全部元件和连线。 使用时接:电源、输入和输出。数字集成电 路具有体积小、可靠性高、速度快、而且价 格便宜的特点。
TTL型电路:输入和输出端结构都采用了半导体晶 体管,称之为: Transistor— Transistor Logic。
输出高电平
UOH (3.4V)
u0(V)
UOH
“1”
输出低电平
u0(V)
UOL
UOL (0.3V)
1
(0.3V)
2 3 ui(V)
1 2 3 ui(V)
阈值UT=1.4V
传输特性曲线
理想的传输特性 28
1、输出高电平UOH、输出低电平UOL UOH2.4V UOL 0.4V 便认为合格。 典型值UOH=3.4V UOL 0.3V 。
uA t
uF
截止区: UBE< 死区电压, IB=0 , IC=ICEO 0 ——C、 E间相当于开关断开。
+ucc
t
4
0.3V
3.2.3MOS管的开关特 恒流区:UGS>>Uth , UDS
性: +VDD
0V ——D、S间相当于 开关闭合。
R
uI
Uo
Ui
NMO S
uO
夹断区: UGS< Uth, ID=0 ——D、S间相当于开关断开。
3.3.4 其它门电路
一、 其它门电路
其它门电路有与非门、或非门、同或门、异或门等等,比如:
二、 门电路的“封锁”和“打开”问题
A B
&
Y
C
当C=1时,Y=AB.1=AB

数字电子技术基础第三章逻辑门电路

数字电子技术基础第三章逻辑门电路
ts 的大小是影响三极管速度的最主要因素,要提高三极 管的开关速度就要设法缩短ton与toff ,特别是要缩短ts 。
数字电子技术基础第三章逻辑门电路
第一节 常见元器件的开关特性
3.MOS管的开关特性
A、MOS管静态开关特性
在数字电路中,MOS管也是作为 开关元件使用,一般采用增强型的 MOS管组成开关电路,并由栅源电压 uGS控制MOS管的导通和截止。
时间。
toff = ts +tf 关断时间toff:从输入信号负跃变的瞬间,到iC 下降到 0.1ICmax所经历的时间。
数字电子技术基础第三章逻辑门电路
第一节 常见元器件的开关特性
2.三极管的开关特性
B、晶体三极管动态开关特性
ton和toff一般约在几十纳秒(ns=10-9 s)范围。通常都
有toff > ton,而且ts > tf 。
0 .3V 3 .6V 3 .6V
1V 5V
3 .6V
数字电子技术基础第三章逻辑门电路
第三节 TTL和CMOS集成逻辑门电路
1.TTL集成逻辑门电路
3 .6V 3 .6V 3 .6V
2.1V
0 .3V
数字电子技术基础第三章逻辑门电路
第三节 TTL和CMOS集成逻辑门电路
1.TTL集成逻辑门电路
数字电子技术基础第三章逻辑门电路
❖ 2.教学重点:不同元器件的静态开关特性,分立元件门电路 和组合门电路,TTL和CMOS集成逻辑门电路基本功能和电气特 性。
❖ 3.教学难点:组合逻辑门电路、TTL和CMOS集成逻辑门4.课时 安排: 第一节 常见元器件的开关特性 第二节 基本逻辑门电路 第三节 TTL和CMOS集成逻辑门电路

第三章门电路

第三章门电路

2) 工作原理 VA=0V
“0” (0V) A G
+VDD S
VGS< VGS(th) <0
导通
T2 PMOS
D
“1”
D
F (+VDD)
T1 NMOS
S
VGS< VGS(th) >0
截止
VA= VDD
“1” A
G
(+VDD)
+VDD S
VGS> VGS(th) <0
截止
T2 PMOS
D F “0”
VGS(th)P VI VDD ,T2导通
所以VI 在0 ~ VDD ,T1和T2至少一个导通 VI VO之间为低电阻
双向模拟开关
3.5 TTL门电路 3.5.1 半导体三极管的开关特性
双极型三极管的开关特性 (BJT, Bipolar Junction Transistor)
双极型三极管的基本开关电路
低电平:VIL=0
• VI=VIH D截止,VO=VOH=VCC
• VI=VIL D导通,VO=VOL=0.7V
3.2 分立元件门电路
3.2.2 二极管与门
+5V
VA
VB
VF
3V A
R 3.9K
D1
0V
F 0V
0V 0.7V 3V 0.7V
D2
0V B
3V 0V 0.7V 3V 3V 3.7V
逻辑变量
• 只用于IC内部电路
•数字集成电路:在一块半导体基片上制作出一 个完整的逻辑电路所需要的全部元件和连线。 使用时接:电源、输入和输出。数字集成电路 具有体积小、可靠性高、速度快、而且价格便 宜的特点。

第3章-逻辑门电路

第3章-逻辑门电路

3 逻辑门电路3.1 MOS 逻辑门电路3.1.2 求下列情况下TTL 逻辑门的扇出数:(1)74LS 门驱动同类门;(2)74LS 门驱动74ALS 系列TTL 门。

解:首先分别求出拉电流工作时的扇出数N OH 和灌电流工作时的扇出数N OL ,两者中的最小值即为扇出数。

从附录A 可查得74LS 系列电流参数的数值为I OH =0.4mA ,I OL =8mA ,I IH =0.02mA,I IL =0.4mA ;74ALS 系列输入电流参数的数值为I IH =0.02mA ,I IL =0.1mA ,其实省略了表示电流流向的符号。

(1) 根据(3.1.4)和式(3.1.5)计算扇出数74LS 系列驱动同类门时,输出为高电平的扇出数0.4200.02OH OH IH I mA N I mA=== 输出为低电平的扇出数 8200.4OL OL IL I mA N I mA ===所以,74LS 系列驱动同类门时的扇出数N O 为20。

(2) 同理可计算出74LS 系列驱动74ALS 系列时,有0.4200.02OH OH IH I mA N I mA=== 8800.1OL OL IL I mA N I mA === 所以,74LS 系列驱动74ALS 系列时的扇出数N O 为20。

3.1.4 已知图题3.1.4所示各MOSFET 管的T V =2V ,忽略电阻上的压降,试确定其工作状态(导通或截止)。

解:图题3.1.4(a )和(c )的N 沟道增强型MOS ,图题3.1.4(b )和(d )为P 沟道增强型MOS 。

N 沟道增强型MOS 管得开启电压V T 为正。

当GS V <V T 时,MOS 管处于截止状态;当GS V ≥V T ,且DS v ≥(GS V —V T )时,MOS 管处于饱和导通状态。

对于图题3.1.4(a ),GS V =5V ,DS v =5V ,可以判断该MOS 管处于饱和导通状态。

理论三 逻辑门电路

理论三 逻辑门电路
逻辑门电路
1
课前预备
熟练数制间的转换
重、难点
基本逻辑运算及基本逻辑门电路
1.基本逻辑运算及基本逻辑门电路
概念
在数字电路中往往用输入信号表示“条件”,用输出信号表示“结果”,而
条件与结果之间的因果关系称为逻辑关系,能实现某种逻辑关系的数字电
子电路称为逻辑门电路。
基本的逻辑关系有:与逻辑、或逻辑、非逻辑;
能实现非逻辑功能的电路称为非门电路,又称 反相器 ,简称非

非门电路的电路图形符号
非逻辑函数表达式: =

非逻辑功能为:“有0出1,有1出0”
2.复合逻辑运算
几种常用的复合逻辑运算
• 与非
或非
与或非
几种常用的复合逻辑运算
• 异或
• Y= A B
A
B
Y
0
0
0
0
1
1
1
0
1
1
1
0
几种常用的复合逻辑运算
与之相应的基本逻辑门电路有:与门、或门、非门。来自逻辑代数中的三种基本运算
与(AND)
或(OR)
非(NOT)
以A=1表示开关A合上,A=0表示开关A断开;
以Y=1表示灯亮,Y=0表示灯不亮;
三种电路的因果关系不同:
一、与逻辑和与门电路
1.与逻辑关系
当一件事情的几个条件全部具备之后,这件事情才能发生,否则不
三极管、MOS管和电阻等分立元件组成,也可以由集成电路组成。
与逻辑的真值表
与逻辑功能为:
“有0出0,全1出1”
与门电路的电路图形符号
逻辑表达式Y=A·B或
Y=AB
二、或逻辑和或门电路

《电子线路》教案——第三章 逻辑门电路

《电子线路》教案——第三章  逻辑门电路

第一节逻辑门电路(一)教学目的:让学生掌握与门电路的工作原理及符号教学重点:与门电路的逻辑关系教学难点:与门电路的工作原理教学方法:讲授法教学课时:一课时教学过程:一、复习提问:晶体管反相是如何工作的?加速电容有何作用?二、新授:(一)概述:1、逻辑门电路的定义:是指具有多个输入端和一个输出端的开关电路。

2、逻辑电路中0和1的含义:表示两种对立的状态。

并不表示数量的大小。

0和1分别称为逻辑0和逻辑1 3、正、负逻辑体制:若1表示高电平,0表示低电平,称为正逻辑;若1表示低电平,0表示高电平,则称为负逻辑4、基本的逻辑门电路有:与门、或门、非门8.3.1 与门电路一、与逻辑关系当一件事情的几个条件全部具备之后,这件事情才能发生,否则不发生。

这样的因果关系称为与逻辑关系。

举例说明:以开锁为例和书上的开关串联为例。

让学生联系生活说明有哪些常见的与逻辑。

(讨论)二、与门电路1、电路图电路如右图8-9所示3、真值表4、逻辑符号图8-10 与门逻辑符号对于与门电路要重点讲解,但对于其他门电路在相同内容和相似的分析过程中不再重复。

以留给学生一定的思考空间,也为学生的个性化发展提供的前提。

4、逻辑函数式Y=A·B (中间的点乘也可以去掉)小结:与逻辑关系的定义(强调所有条件均具备)第一节逻辑门电路(二)教学目的:让学生掌握门电路的基本类型教学重点:门电路的逻辑关系教学难点:各门电路的逻辑关系与逻辑表式与真值表的联系教学方法:讲授法教学过程:一、复习提问:1、什么叫与逻辑关系?与门电路的符号怎么画?其功能是什么?二、新授:(一) 或门电路:1、或逻辑关系在决定一件事的各种条件中,到少具备一个条件,这件事就会发生。

这样的因果关系称为或逻辑关系。

举例说明:以开锁为例和书上的开关并联为例。

让学生联系生活说明有哪些常见的或逻辑。

(讨论)2、或门电路(1)、电路图电路如下图8-12所示图8-12 二极管或门电路(1)、真值表V a、V b有一个是高电平(5V):V o 为高电平;V a、V b两个都为低电3、逻辑符号图8-13 或门逻辑符号4、逻辑函数式Y =A +B(二)、非门电路:1、1、非逻辑关系:事情和条件总是呈相反状态。

第3章逻辑门电路2.

第3章逻辑门电路2.

A R3
图2.2.13 有源泄放TTL与非门
有源泄放回路在转换过程中提高开关速度的原因
是它的等效电阻是可变的。在输入由低电平全部变为 高电平的瞬间,有源泄放回路 AB 两端呈现高阻抗, 使V5迅速饱和,缩短了开启时间tON;在输入由高电平 变为低电平的瞬间,有源泄放回路 AB 两端呈现低阻 抗,使V5加快截止,缩短了关闭时间tOFF(分析略)。 另外,有源泄放回路还能提高电路的抗干扰能力,
流不仅会使导通门的输出低电平抬高,而且还可能因功耗太
大而损坏两个门的输出管,这是不允许的。为了克服一般
TTL门不能直接相连的缺点,提出了OC门。
+UCC R4 V3 V4 R3 V5 +UCC R4 V3 V4 R3 F2 = 0 V5 IL F1 = 1
图2.2.17 两个TTL门输出端相连
+UCC R1 V1 V2 V5 R3 F R2 RL
铝—硅二极管),它的正向导通电压为0.4V~0.5V, 比一般硅管的正向导通电压 0.6V~0.7V低 0.2V。 这样,当三极管的 c结进入正偏后, SBD首先导 通, c 结的正偏电压被钳在 0.4V~0.5V ,使三极 管不会进入深饱和,而只能工作在微饱和状态, 从而大大提高了门电路的工作速度。当有源泄放
图 2.2.16
&
F1
F
&
F2
必须指出的是,并不是所有形式的与非门都能接成
“线与”电路。例如,一般的TTL与非门,由于采用了推拉 式输出电路,无论是输出高电平还是低电平,输出电阻都比 较低,只有几至几十 Ω。如果将两个输出端直接相连,当一 个门的输出为高电平,另一个门输出为低电平时,则会形成 一条自 +UCC 到地的低阻通路,会有一股很大的电流从截止 门的V4管灌入到导通门的V5管,如图2.2.17所示。这个大电

数字电子技术基础:第三章 逻辑门电路

数字电子技术基础:第三章 逻辑门电路

逻辑符号
C
vI /vO
TG
vO /vI
C
C
υo/ υI
2. CMOS传输门电路的工作原理
vI /vO
5V到+5V
C
+5V
TP +5V vO /vI
5V TN
5V
C
设TP:|VTP|=2V, TN:VTN=2V
I的变化范围为-5V到+5V。
c=0=-5V, c =1=+5V
1)当c=0, c =1时 GSN= -5V (-5V到+5V)=(0到-10)V
在由于电路具有互补对称的性质,它的开通时间与关 闭时间是相等的。平均延迟时间:<10 ns。
动态功耗
CMOS反相器的PD与f和 2 VDD
CMOS反相器从一个稳定状态转变到另一个稳定状态时所产生的功耗
PD=PC+PT
分布电容CL充放电引起的功耗: PC CL fVD2D
CMOS管瞬时交替导通引起的功耗:PT CPD fVD2D
74标准系列 74LS系列
74AS系列
74LVC 74VAUC 低(超低)电压 速度更加快 与TTL兼容 负载能力强 抗干扰 功耗低
74ALS
3.1 概述
门电路:实现基本逻辑/复合逻辑运算的单元电路
逻辑状态的描述—— 正逻辑:高电平→1,低电平→0 负逻辑:高电平→0,低电平→1
缺点:功耗较大/速度较慢
VDD VIH(min) I OH(total) I IH(total)
… …
I0H(total) &1
+V DD RP
&
&1
IIH(total) &

《数字电子技术》第3章 组合逻辑电路

《数字电子技术》第3章 组合逻辑电路
Y1 I2 I3 I6 I7
Y3 ≥1 I9 I8
Y3
I2I3I6I7
&
Y0 I1 I3 I5 I7 I9
I1I3I5I7I9
I9 I8
逻辑图
Y2
Y1
Y0
≥1
≥1
≥1
I7I6I5I4
I3I2
(a) 由或门构成
Y2
Y1
I1 I0 Y0
&
&
&
I7I6I5I4
I3I2
(b) 由与非门构成
A
消除竞争冒险
B
C
Y AB BC AC
2
& 1
1
3
&
4
&
5
≥1
Y
3.2 编码器
编码
将具有特定含义的信息编 成相应二进制代码的过程。
编码器(即Encoder)
实现编码功能的电路
被编 信号
编 码 器
编码器
二进制编码器 二-十进制编码器
二进制 代码 一般编码器
优先编码器 一般编码器 优先编码器
(1) 二进制编码器
A B F AB AB B
&
&
00
1
01
0
C
&
F &
10 11
0F AABA BC1 AB &
1
AAB BC AB
(4)分析得出逻辑功A能 A B B C AB
A =1
同或逻辑 AB AB B
F
F AB AB A☉B
3.1.3 组合逻辑电路的设计
组合逻辑电路的设计就是根据给出的实际逻 辑问题求出实现这一关系的逻辑电路。

《数字电子技术基础》第3章 门电路

《数字电子技术基础》第3章 门电路
VDD
导通
TP vI vO
TN
vo=―1” 截止
vI=1
VDD
截止
T1 vI
vO T2
vo=―0” 导通
静态下,无论vI是高电平还是低电平,T1、T2总有 一个截止,因此CMOS反相器的静态功耗极小。
二、电压传输特性和电流传输特性
T1导通T2截止
电 压 传 输 特 性
T1T2同时导通
T2导通T1截止
噪声电压作用时间越短、电源电压越高,交流噪声容 限越大。
三、动态功耗
反相器从一种稳定状态突然变到另一种稳定状态的过
程中,将产生附加的功耗,即为动态功耗。
动态功耗包括:负载电容充放电所消耗的功率PC和 PMOS、NMOS同时导通所消耗的瞬时导通功耗PT。 在工作频率较高的情况下,CMOS反相器的动态功耗 要比静态功耗大得多,静态功耗可忽略不计。
VNL VIL (max) VOL (max)
测试表明:CMOS电路噪声容限 VNH=VNL=30%VDD,且随VDD的增加而加大。
噪声容限--衡量门电路的抗干扰能力。 噪声容限越大,表明电路抗干扰能力越强。
§3.3.3 CMOS反相器的静态输入输出特性
一、输入特性 因为MOS管的栅极和衬底之间存在着以SiO2 为介质的输入电容,而绝缘介质非常薄,极易被
S1
输 入v I 信 号 输 vo 出 信 号
S2
图3.1.3 互补开关电路
互补开关电路由于两个开关总有一个是断开的, 流过的电流为零,故电路的功耗非常低,因此在数字 电路中得到广泛的应用
3.1 概述
4. 数字电路的概述 (1)优点: 在数字电路中由于采 用高低电平,并且高低电 平都有一个允许的范围, 如图3.1.1所示,故对元器 件的精度和电源的稳定性 的要求都比模拟电路要低, 抗干扰能力也强。

第3章逻辑门与组合逻辑1

第3章逻辑门与组合逻辑1

A
A B
B
L H
F
L L
A
0 0
B
0 1
F
0 0
A
1 1
B
1 0
F
1 1

F
L L
H
H 与门电路
L
H
L
H
1
1
0
1
0
1
0
0
1
0
1
0
用电平表示与 门的功能。 注意:不管 是正逻辑还是负 逻辑,电平关系 是一样的。
用正逻辑描述 与门的逻辑功能, 结果为与运算。
用负逻辑描 述“与门”的 逻辑功能。结 果为或运算。
栅极加高电平, 漏极与源极间导 通,D-S相当于接 通的开关
栅极加低电平, 漏极与源极间截 止,D-S相当于断 开的开关
PMOS管:
S G G 加低电平 D D
− − − − −
S
+ + + + +
VDD BP
VDD
加高电平 G
− −
S
+ +
VDD
截止 D
PMOS管的符号 G 栅极 S 源极 D 漏极 BN 衬底
结论:正逻辑下的与门 ,在负逻辑下却实现或逻辑运算。
照此分析,可得如下结论: • 正逻辑下的或门 ,在负逻辑下实现与运算; • 正逻辑下的非门 ,在负逻辑下仍然实现非运算。 为便于区分采用何种逻辑,在逻辑符号的输入端上加一个小圆圈表 示负逻辑下的门电路符号。 常用逻辑门的正逻辑和负逻辑符号如下: 正逻辑
A 1 F 50%
A
F
tPLH
50% tPHL
从输入波形上升沿的50%处,到输出波形下降沿的50%处之间的时间间 隔定义为前沿延迟tPLH,定义tPHL为类似的后沿延迟,则平均时延为:
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EXIT
逻辑门电路
一、三极管的开关作用及其条件
iC 临界饱和线 M T IC(sat) S
放大区
IB(sat)
uI=UIL
三极管为什么能用作开关? 饱 Q + 怎样控制它的开和关? uBE 和 区
O UCE(sat) B uBE < Uth
负载线
A N C
截止区
uCE
三极管关断的条件和等效电路
当输入 uI 为低电平,使 uBE < Uth时,三极管截止。
逻辑门电路
第3章
逻辑门电路
概 述 三极管的开关特性
TTL 集成逻辑门 CMOS 集成逻辑门 集成逻辑门的应用
本章小结
EXIT
逻辑门电路
3.1
主要要求:
概 述
了解逻辑门电路的作用和常用类型。 理解高电平信号和低电平信号的含义。
EXIT
逻辑门电路
一、门电路的作用和常用类型
按逻辑功能不同分 指用以实现基本逻辑关系和 门电路 (Gate Circuit) 常用复合逻辑关系的电子电路。 与门 或门 非门 异或门 与非门 或非门 与或非门 按电路结构不同分
上例中三极管反相 器的工作波形是理想波 形,实际波形为 :
t
UCE(sat) O
EXIT
逻辑门电路
二、三极管的动态开关特性
uI
UIH
UIL O iC 0.9IC(sat) IC(sat) 0.1IC(sat) O uO VCC ton toff t
uI 正跳变到 iC 上升到 0.9IC(sat) 所需的时间 ton 称 为三极管开通时间。
逻辑门电路
(2) 对应输入波形画出输出波形 三极管截止时, iC 0,uO +5 V 三极管饱和时, uO UCE(sat) 0.3 V
uI UIH
O uO/V 5
UIL
t
可见,该电路在输入低 电平时输出高电平,输入高 电平时输出低电平,因此构 成三极管非门。由于输出信 号与输入信号反相,故又称 三极管反相器。
逻辑门电路
(三) TTL 与非门的外特性及主要参数
1. 电压传输特性和噪声容限 截止区:与非门 u u /V /V 输出电压随输入电压变化的特性 O O 处于关门状态。 U U
3.6 3.6 3.0 3.0 A A B B OH OH
uI 较小时工作于AB 段, 2.0 2.0 这时uV 、V5 截止,VBC 、 段, 较大时工作于 u 2很大时工作于 3CD II 1.0 1.0 U U OL OL D C C D V 段,这时 V V 工作于 这时 V2、 V 饱和,输出恒为 4 导通,输出恒为高电平, 2、 5 5 0.3 0.3 U ,称与非门工 放大区, u 的微小增大 低电平, U 0.3V,称与非 00 OH 3.6V I OL uIu /V 1.0 1.0 2.0 2.0 I/V 引起 uO 急剧下降,称与 作在截止区或处于关门状 门工作在饱和区或处于开门状 STTL STTL 与非门电压传输特性曲线 与非门电压传输特性曲线 电压传输特性测试电路 态。 非门工作在转折区。 态。 饱和区:与非门 处于开门状态。 EXIT
2 5

5V 截止
微饱和 放大
2
3.6 V
截止
因此,输入有低电平时,输出为高电平。
EXIT
逻辑门电路
2.
TTL与非门的工作原理
输入均为高电平时,输出低电平 VCC 经 R1 使 V1 集电结和 V2、 V5 发射结导通,使uB1 = 1.8 V。 1.8 V 导通 因此,V1 发射结反偏而集电极 1V 截止 倒置放大 正偏,称处于倒置放大状态。 3.6 V 0.3 V 饱和 这时 V2、V5 饱和。 3.6 V 深 uC2 = UCE2(sat) + uBE5 3.6 V 饱 = 0.3 V + 0.7 V = 1 V 和 使 V3 导通,而 V4 截止。 V4 截止使 V5 的等效集电极 电阻很大,使 IB5 >> IB5(sat) ,因 此 V5 深度饱和。 TTL 电路输入端悬 uY = UCE5(sat) 0.3 V 注意 空时相当于输入高电平。 输出为低电平 综上所述 因此,输入均为高电平时,输出为低电平。 ,该电路实现了与非逻辑功能,即 Y ABC EXIT
逻辑门电路
三、抗饱和三极管简介
SBD B C C
B
E 抗饱和三极管的开关速度高
E
① 没有电荷存储效应 在普通三极管的基极和集电极之间并 ② SBD 的导通电压只有 0.4 V 而非 0.7 V, 接一个肖特基势垒二极管 简称 SBD) 。 因此 UBC = 0.4 V 时,( SBD 便导通,使 UBC 钳在 0.4 V 上,降低了饱和深度。
iB 0,iC 0,C、极管 截止状态 等效电路
Uth为门限电压 EXIT
逻辑门电路
一、三极管的开关作用及其条件
iC 临界饱和线 uI 增大使 iB 增大, S 为放大和饱和的交界点,这时的 放大区 从而工作点上移, iC 增 iB 称临界饱和基极电流,用 IB(sat) 表示; T M S 大,uCEI减小。 相应地,IC(sat) 为临界饱和集电极电流; IC(sat) B(sat) UBE(sat) 为饱和基极电压; 饱 Q UCE(sat) 为饱和集电极电压。对硅管, 和 截止区 UBE(sat) 0.7V, UCE(sat) 0.3V。在临 A 区 界饱和点三极管仍然具有放大作用。 O U N u
EXIT
逻辑门电路
3.3
TTL 集成逻辑门
主要要求:
了解 TTL 与非门的组成和工作原理。 掌握 TTL 基本门的逻辑功能和主要外特性。
了解集电极开路门和三态门的逻辑功能和应用。
了解 TTL 集成逻辑门的主要参数和使用常识。
EXIT
逻辑门电路
一、TTL 与非门的基本组成与外特性
(一)典型 TTL 与非门电路
是构成数字电路的基本单元之一
CMOS 集成门电路 用互补对称 MOS 管构成的逻辑门电路。
TTL 集成门电路 输入端和输出端都用 三极管的逻辑门电路。
CMOS Complementary Metal-Oxide-Semiconductor TTL 即即 Transistor-Transistor Logic 按功能特点不同分 普通门 输出 三态门 CMOS (推拉式输出) 开路门 传输门 EXIT
输入级主要由多发射极管 V1 输出级 和基 V 中间级起倒相放大作 CC 除V 外,采 由 V4 V 极电阻 R1 组成,用以实现输入变量 A 、 +5V R4 3、 4、 用, V2 集电极 C2抗 和发射极 R2 R1 50 用 了 饱和三极 R B900 、C 的与运算。 4、R5和V5 8.2 k E2 同时输出两个逻辑电平 管 ,组成。其中 用以提高门 C2 VD1 ~ VD3 B1 V3为输入钳位二极管,用以 相反的信号,分别驱动 V 3 。 电 路 工 作 速 度 V V3 和 V4 构 抑制输入端出现的负极性干扰。正常信 4 和 V 。 R5 5 V2 V4 不会工作于饱 V1 成复合管, 号输入时, V VD3不工作,当输入的 3.5 k C1 Y D1 ~ RB、RC 和 V 6 构成有 E 和 状 态 , 因 此用 2 与 V 构成推 负极性干扰电压大于二极管导通电压时, 5 V5 源泄放电路,用以减小 V5 R 普通三极管。 C RB 二极管导通,输入端负电压被钳在 拉式输出结 -0.7 逻辑符号 250 管开关时间,从而提高门 500 VD1 VD2 VD3 构,提高了 V上,这不但抑制了输入端的负极性干 V6 电路工作速度。 扰,对 V1 还有保护作用。 负载能力。 输入级 中间倒相级 输出级 STTL系列与非门电路 EXIT
t
uI 负跳变到 iC 下降到 0.1IC(sat) 所需的时间 toff 称 为三极管关断时间。 通常 toff > ton
UCE(sat) O
开关时间主要由于电 通常工作频率不高时, 荷存储效应引起,要提高 可忽略开关时间,而工作 开关速度,必须降低三极 频率高时,必须考虑开关 管饱和深度,加速基区存 速度是否合适,否则导致 储电荷的消散。 不能正常工作。 EXIT t
I B(sat) I C(sat) VCC RC

EXIT
逻辑门电路
[例]下图电路中 = 50,UBE(on) = 0.7 V,UIH = 3.6 V,UIL = 0.3 V,为使 三极管开关工作,试选择 RB 值,并对应输入波形画出输出波形。
+5 V uI
1 k
UIL
UIH
O
t
解:(1)根据开关工作条件确定 RB 取值 uI = UIL = 0.3 V 时,三极管满足截止条件 uI = UIH = 3.6 V 时,为使三极管饱和,应满足 iB > IB(sat) U IH 0.7 V 3.6 0.7 V 2.9 V 因为 iB = RB RB RB V 5V I B(sat) CC 0.1 mA βRC 50 1 k 所以求得 RB < 29 k,可取标称值 27 k。 EXIT
逻辑门电路
二、高电平和低电平的含义
高电平和低电平为某规定范围的电位值,而非一固定值。
1
高电平
0
高电平
高电平信号是多大的信号?低 由门电路种类等决定 电平信号又是多大的信号? 低电平 0 低电平 1
正逻辑体制
负逻辑体制
EXIT
逻辑门电路
3.2 三极管的开关特性
主要要求:
理解三极管的开关特性。 掌握三极管开关工作的条件。
饱 和 区
截止区
O UCE(sat) B uBE < Uth A N C uCE
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