数字电子与逻辑设计期末试卷A卷)
数字电子技术期末试卷标准答案及评分标准(A卷)
班级：__________ 学号: __________姓名: __________阅卷教师: _____________ 成绩: _______________一、判断题（将答案添入下表，每题1分，共10分。
正确选“√”，错误选“×”） 1 2 3 4 5 6 7 8 9101．在时间和幅度上都断续变化的信号是数字信号，因为说话时语音是断续的，所以是数字信号。
（ ）2．若两个函数具有不同的逻辑函数式，则两个逻辑函数必然不相等。
（ ） 3．N 变量逻辑函数全部2N 个最大项之积恒等于1。
（ ） 4．因为逻辑表达式A+B+AB=A+B 成立，所以AB=0成立。
（ ）。
5．TTL 集电极开路门输出为１时由外接电源和电阻提供输出电流。
（ ） 6．异步时序电路是指的各级触发器类型不同的电路。
（ ）7．D 触发器的特征方程Q n+1=D ，而与Q n 无关，所以，D 触发器不是时序电路。
（ ） 8．D/A 转换器的最大输出电压的绝对值可达到基准电压V REF 。
（ ）9．施密特触发器可用于将正弦波变换成三角波。
（ ）10．SRAM 是指静态RAM ，DRAM 是指动态RAM ；对相同容量的SRAM 和DRAM 而言，前者造价高，响应速度也快。
（ ）二、试将下列函数化为最简与或形式（10分，每题5分，要有解题步骤，否则不给分）（1）D C B A D C B A D B A AD Y +++=（2）化简逻辑函数D C B A BCD A D C B A D C B A F ⋅⋅++⋅⋅=),,,(；给定约束条件：0=+++⋅+⋅++⋅D C B A D ABC ABCD D C B A D C AB D C B A CD B A三、已知电路如图所示，写出F1、F2、F3、F 与输入变量A 、B 、C 、D 之间的逻辑表达式。
（本题10分）阅卷教师: _____________ 成绩: _______________四、设计一个能被2 或3 整除的逻辑电路，其中被除数A、B、C、D是8421BCD编码。
电子科技大学期末数字电子技术考试题a卷-参考答案
电子科技大学二零零九至二零一零学年第 二 学期期 末 考试数字逻辑设计及应用 课程考试题 A 卷（120分钟）考试形式：闭卷 考试日期2010年7月12日课程成绩构成：平时 20 分， 期中 20 分， 实验 0 分， 期末 60 分一、To fill your answers in the blanks （1’×25）1. If [X]10= - 110, then [X]two's-complement =[ ]2,[X]one's-complement =[ ]2. (Assumed the number system is 8-bit long) 2. Performing the following number system conversions: A. [10101100]2=[ 0 ]2421B. [1625]10=[01001 ]excess-3C. [ 1010011 ]GRAY =[10011000 ]8421BCD3. If ∑=C B A F ,,)6,3,2,1(, then F D ∑=C B A ,,( 1，4，5，6 )=C B A ,,∏(0，2，3，7 ).4. If the parameters of 74LS-series are defined as follows: V OL max = 0.5 V , V OH min = 2.7 V , V IL max = 0.8 V , V IH min = 2.0 V , then the low-state DC noise margin is 0.3V ,the high-state DC noise margin is 0.7V .5. Assigning 0 to Low and 1 to High is called positive logic. A CMOS XOR gate in positive logic is called XNOR gate in negative logic.6. A sequential circuit whose output depends on the state alone is called a Moore machine.7. To design a "001010" serial sequence generator by shift registers, the shift register should need 4 bit as least.8. If we use the simplest state assignment method for 130 sates, then we need at least8state variables.9. One state transition equation is Q*=JQ'+K'Q. If we use D flip-flop to complete the equation, the D input terminal of D flip-flop should be have the function D= JQ'+K'Q.10.Which state in Fig. 1 is ambiguous D11.A CMOS circuit is shown as Fig. 2, its logic function z= A’B’+ABFig. 1 Fig. 212.If number [A]two's-complement =01101010 and [B]one's-complement =1001, calculate [A-B]two's-complement and indicate whether or not overflow occurs.(Assumed the number system is 8-bit long)[A-B]two's-complement = 01110000, overflow no13. If a RAM’s capacity is 16K words × 8 bits, the address inputs should be 14bits; We need 8chips of 8K ⨯8 bits RAM to form a 16 K ⨯ 32 bits ROM..14. Which is the XOR gate of the following circuit A .15.There are 2n－n invalid states in an n-bit ring counter state diagram.16.An unused CMOS NOR input should be tied to logic Low level or 0 .17.The function of a DAC is translating the Digital inputs to the same value of analogoutputs.二、Complete the following truth table of taking a vote by A,B,C, when more than two of A,B,C approve a resolution, the resolution is passed; at the same time, the resolution can’t go through if A don’t agree.For A,B,C, assume 1 is indicated approval, 0 is indicated opposition. For the F,A B C F三、The circuit to the below realizes a combinational function F of four variables. Fill in the Karnaugh map of the logic function F realized by the multiplexer-based circuit. (6’)四、(A) Minimize the logic function expressionF = A·B + AC’ +B’·C+BC’+B’D+BD’+ADE(H+G) （5’）F = A·B + AC’ +B’·C+BC’+B’D+BD’ = A·(B ’C )’ +B’·C+BC’+B’D+BD’= A +B’·C+BC’+B’D+BD’+C ’D (或= A +B’·C+BC’+B’D+BD’+CD ’)= A +B’·C+BD’+C ’D (或= A + BC’+B’D +CD ’)(B) To find the minimum sum of product for F and use NAND-NAND gates to realize it （6’）),,,(Z Y X W F Π(1,3,4,6,9,11,12,14)------3分 F= X ’Z ’+XZ -----2分 =( X ’Z ’+XZ)’’=(( X ’Z ’)’(XZ)’)’ ------1分五、Realize the logic function using one chip of 74LS139 and two NAND gates.（8’）∑=)6,2(),,(C B A F ∑=)3,2,0(),,(E D C GF(A,B,C)=C’∑(1,3) ---- 3分 G(C,D,E)=C’∑(0,2,3) ----3分-六、Design a self-correcting modulo-6 counter with D flip-flops. Write out the excitation equations and output equation. Q2Q1Q0 denote the present states, Q2*Q1*Q0* denote the next states, Z denote the output. The state transition/output table is as following.（10’）Q2Q1Q0Q2*Q1*Q0*Z000 100 0100 110 0110 111 0111 011 0011 001 0001 000 1激励方程式：D2=Q0’（2分，错-2分）D1=Q2 （2分，错-2分）D0=Q1 （2分，错-2分）修改自启动：D2=Q0 +Q2Q1’（1分，错-1分）D1=Q2+Q1Q0’（1分，错-1分）D0=Q1+Q2Q0 （1分，错-1分）输出方程式：Z=Q1’Q0 （1分，错-1分）得分七、Construct a minimal state/output table for a moore sequential machine, that will detect the input sequences: x=101. If x=101 is detected, then Z=1.The input sequences DO NOT overlap one another. The states are denoted with S0~S3.（10’）For example:X：0 1 0 1 0 0 1 0 1 0 1 1 0 1 1 0 0 0 1 1 ……Z：0 0 0 1 0 0 0 0 1 0 0 0 0 1 0 0 0 0 0 0 ……state/output table八、Please write out the state/output table and the transition/output table and theexcitation/output table of this state machine.（states Q2 Q1=00~11, use the state name A~D ）（10’）Transition/output table State/output table Excitation/output table（4分） （3分） （3分）评分标准：转移/输出表正确，得4分；每错一处扣0.5分，扣完4分为止；由转移/输出表得到状态/输出表正确，得3分；每错一处扣0.5分，扣完3分为止；激励/输出表正确，得3分；每错一处扣0.5分，扣完3分为止。
电子技术及数字逻辑试卷A及答案
绝密★启用前黑龙江外国语学院继续教育学院 2014 年 秋 季学期《电子技术及数字逻辑》试卷（ A 卷）一、 填空题（本大题共 9小题，每空 1分，共 15分）1.N 型半导体是在本征半导体中掺入 价元素，其多数载流子是 ，少数载流子是 。
2.稳压管的稳压区是其工作在 。
3.数字系统使用 的物理元件，与此相对应，采用的记数制和编码制也都以 数 为基础。
4.使用布尔代数定律时，利用 规则. 规则. 规则可得到更多的公式。
5.放大电路必须加上合适的 才能正常工作。
6.运放的共模抑制比定义为 。
7.直接写出函数F=[(AB+C)D+E]B 的反演函数为 。
8.三极管工作在饱和区时，发射结应为 偏置，集电结应为 偏置。
9.为提高放大电路的输入电阻，应引入 反馈；为降低放大电路输出电阻。
二、选择题（本大题共15小题，每题2分，共30分）1.当温度升高时，二极管的反向饱和电流将 。
A ．增大 B.减小 C.不变2.互补输出级采用共集形式是为了使 。
A.电压放大倍数大B.不失真输出电压大C.带负载能力强3.测试放大电路输出电压幅值与相位的变化，可以得到它的频率响应，条件是 。
A. 输入电压幅值不变，改变频率B. B.输入电压频率不变，改变幅值C.输入电压的幅值与频率同时变化 4.交流负反馈是指 。
A ．阻容耦合放大电路中所引入的负反馈B ．只有放大交流信号时才有的负反馈C ．在交流通路中的负反馈5.功率放大电路的最大输出功率是在输入电压为正弦波时，输出基本不失真情况下，负载上可能获得的最大 。
A ．交流功率B ．直流功率C ．平均功率 6.滤波电路应选用 。
A ．高通滤波电路 B. 低通滤波电路 C. 带通滤波电路7.放大电路中，测得某三极管三个电极电位U 1.U 2.U 3分别为U 1=3.3V ，U 2=2.6V ，U 3=15V 。
由此可判断该三极管为 。
A ．NPN 硅管 B. NPN 锗管 C. PNP 硅管 d.PNP 锗管8.与八进制数(47.3)8等值的数为 。
第一学期《数字电子技术》课程期末考试试卷A和答案数字电路与逻辑设计
北京信息科技大学2008~2009学年第一学期《数字电子技术》课程期末考试试卷A课程所在学院：自动化学院适用专业班级：测控0601-03考试形式：闭卷注意：所有答案写在答题纸上，写在试卷上无效。
一、填空题(本题满分20分，共含10道小题，每小题2分)1∙(7AC1)16=( )2=( 1=( )]0。
2.具有推挽式输出级的TT1电路(是/否)可以将输出端并联使用，普通的CMOS门(是/否)可以将输出端并联使用。
(输入端的状态均为不定)3.相同编号的最小项和最大项存在的关系为o4.(+1oo"的原码为，反码为，补码为o5.若A是逻辑变量，则A㊉I=。
二、逻辑函数式的化筒(12分)1 .利用公式法化简为最简与或式：F=AB∖A f CD+(AD+3'C')')(4+B)2 .利用卡诺图法将逻辑函数化简为最简与或式：y(A,B,G=>z(OJ2,4),给定约束条件为m3+rτ‰t+mβ+rr‰j=O下面电路图中，写出输出信号是什么状态(高电平、低电平或高阻态)，已知乂为74系四、试用一片8选1数据选择器74HC151产生逻辑函数：Y=AB r CD÷48（C÷r＞）+ABXCΦZ））÷ABC r 要求给出设计的全过程，并画出逻辑电路图。
（12分）s ,A2A4YO O O OO O O1O∣O O1O D1O O11O1O OO1O1/人O11O2O11151X X X高阻五、TT1主从JK触发器的输入波形如图所示，画出输出端Q的波形（12分）CP六、分析如图时序逻辑电路的逻辑功能，写出电路的驱动方程、状态方程和输出方程，画出电路的状态转换图，说明电路的功能以及能否自启动。
（14分）CP七、 试用一片4位同步二进制计数器741S163接成十进制计数器（允许附加必要的门电路,采用清零法），并作简要说明。
741S163的引脚图如下所示。
期末考试数字电子技术试题及答案(DOC)
数字电子技术基础试题（一）一、填空题 : （每空1分，共10分）1． (30.25) 10 = ( ) 2 = ( ) 16 。
2 . 逻辑函数L = + A+ B+ C +D = 。
3 . 三态门输出的三种状态分别为：、和。
4 . 主从型JK触发器的特性方程= 。
5 . 用4个触发器可以存储位二进制数。
6 . 存储容量为4K×8位的RAM存储器，其地址线为条、数据线为条。
二、选择题： (选择一个正确的答案填入括号内，每题3分，共30分 )1.设图1中所有触发器的初始状态皆为0，找出图中触发器在时钟信号作用下,输出电压波形恒为0的是：（）图。
图 12.下列几种TTL电路中，输出端可实现线与功能的电路是（）。
A、或非门B、与非门C、异或门D、OC门3.对CMOS与非门电路，其多余输入端正确的处理方法是（）。
A、通过大电阻接地（>1.5KΩ）B、悬空C、通过小电阻接地（<1KΩ）D、通过电阻接V CC4.图2所示电路为由555定时器构成的（）。
A、施密特触发器B、多谐振荡器C、单稳态触发器D、T触发器5.请判断以下哪个电路不是时序逻辑电路（）。
图2A、计数器B、寄存器C、译码器D、触发器6．下列几种A/D转换器中，转换速度最快的是（）。
图2A、并行A/D转换器B、计数型A/D转换器C、逐次渐进型A/D转换器D、双积分A/D转换器7．某电路的输入波形 u I 和输出波形 u O 如图 3所示，则该电路为（）。
图3A、施密特触发器B、反相器C、单稳态触发器D、JK触发器8．要将方波脉冲的周期扩展10倍，可采用（）。
A、10级施密特触发器B、10位二进制计数器C、十进制计数器D、10位D/A转换器9、已知逻辑函数与其相等的函数为（）。
A、B、C、D、10、一个数据选择器的地址输入端有3个时，最多可以有（）个数据信号输出。
A、4B、6C、8D、16三、逻辑函数化简（每题5分，共10分）1、用代数法化简为最简与或式Y= A +2、用卡诺图法化简为最简或与式Y= + C +A D，约束条件：A C + A CD+AB=0四、分析下列电路。
《数字逻辑》期末考试A卷参考答案
《数字逻辑》期末考试 A 卷参考答案
一、判断题：下面描述正确的打‘√’，错误的打‘×’ （每小题1 分，共 10 分）
1、为了表示 104 个信息，需 7位二进制编码 [√ ]
2、 BCD码能表示0 至 15 之间的任意整数[× ]
3、余 3码是有权码[× ]
4、 2421 码是无权码 [ × ]
5、二值数字逻辑中变量只能取值0 和 1，且表示数的大小 [ × ]
6、计算机主机与鼠标是并行通信[× ]
7、计算机主机与键盘是串行通信[√ ]
8、占空比等于脉冲宽度除于周期[√ ]
9、上升时间和下降时间越长，器件速度越慢
10、卡诺图可用来化简任意个变量的逻辑表达式[√]
[×]
二、写出图中电路的逻辑函数表达式。
（每小题 5 分，共10 分）
1、 F=A B
2、 F=AB CD
三、选择题：（多选题，多选或少选不得分，每小题 2 分，共 20 分）。
济南大学数字电子技术期末考AB卷及参考答案
济南⼤学数字电⼦技术期末考AB卷及参考答案济南⼤学学年学期考试试卷9（卷）课程数字电⼦技术授课教师考试时间考试班级姓名学号1．⼗进制数25⽤8421BCD码表⽰为。
A.10 101B.0010 0101C.100101D.101012.以下表达式中符合逻辑运算法则的是。
A.C·C=C2B.1+1=10C.0<1D.A+1=13. 当逻辑函数有n个变量时，共有个变量取值组合.A. nB. 2nC. n2D. 2n4．A+BC= 。
A .A+B B.A+C C.（A+B）（A+C） D.B+C5．在输⼊情况下，“与⾮”运算的结果是逻辑0。
A．全部输⼊是0 B.任⼀输⼊是0 C.仅⼀输⼊是0 D.全部输⼊是1 6．若在编码器中有50个编码对象，则要求输出⼆进制代码位数为位。
A.5B.6C.10D.507.⼀个16选⼀的数据选择器，其地址输⼊（选择控制输⼊）端有个。
A.1B.2C.4D.168．四选⼀数据选择器的数据输出Y与数据输⼊Xi和地址码Ai之间的逻辑表达式为Y= 。
A.3XAAXAAXAAXAA121111+++ B.1X C.11XAA D.3XAA19．在下列逻辑电路中，不是组合逻辑电路的有。
A.译码器B.编码器C.全加器D.寄存器10．⽤三线-⼋线译码器74LS138和辅助门电路实现逻辑函数122AAAY+=，应。
A.⽤与⾮门，76541YYYYYYY= B.⽤与门，32YYY=C.⽤或门，32YYY+= D.⽤或门，76541YYYYYYY+++++=11．⼀位8421BCD码计数器⾄少需要个触发器。
A.3B.4C.5D.1012．⼀个容量为1K×8的存储器有个存储单元。
A.8B.8KC.8000D.819213．⼀个容量为512×1的静态RAM具有。
A.地址线9根，数据线1根B.地址线1根，数据线9根C.地址线512根，数据线9根D.地址线9根，数据线512根14．图1⽰为采⽤共阴极数码管的译码显⽰电路，若显⽰码数是2，译码器输出端应为。
大学数字电路与逻辑设计考试试题
审核人： 试卷分类（A 卷或B 卷） B 学期： 2010 至 2011 学年度 第 一 学期 课程： 数字电路与逻辑设计 课程代号： 005A1080 使用班级： 信息工程学院08级 姓名： 学号：一、基本题（301. 用公式法化简函数C BC A C B A Y ++••=1（5分）答案：C B A B A C C B C A C B A Y +)+•(=++••=1（1分）=C B A B C +)+(（1分） =C B A C B C ++•（1分） =)++(B A B C （1分）=C （1分）2. 试用卡诺图法将下面逻辑函数化成最简与－或式。
（必须画出卡诺图，圈“1”，8分）∑∑)13,12,11,10,8,7,4,2(+15,14,9,6,10(=2d m Y ），答案： C B BC Y •+=23. 已知74LS00为四个2输入与非门，其20=OL I mA ，1=OH I mA ，2=IL I mA ，μA 50=IH I ，计算74LS00最多可驱动几个同类门。
（6分）答案：IL OL ≥I N I L ，10=≤IL OL L I I N (2分)；IH H OH 2≥I N I ，10=2≤IH OH H I IN （2分）；故10=H N （2分）4. 画出图1.1所示D 触发器对应CLK 、、D 的Q 端波形。
（4分）答案：AB CD0001111010001101111111××××××××1.1图Q PR PR(a)字量为100000时，输出模拟电压O v 为3.6V ，计算输入数字量为10101000时，输出电压时多少?（7分） 答案：（1）=O v -ii i D V 22∑78REF （3分） （2）=6.3-78REF2×2V ；=REFV -7.2V （2分）输入数字量为10101000时， =O v -V 725.4=)2+2+2(22.73578（2分）二（10分）、图2（a ）由集成3线-8线译码器74HC138构成的逻辑电路，试分析其逻辑功能。
数字电路与逻辑设计期末复习试题3套(大学期末复习资料).docx
试题一一、填空题。
(每空1分，共30分)。
1、(11001.01)2 =( )8=( )|6=( )102、十进制整数转换成二进制时采用 ______ 法；十进制小数转换成二进制时采用 _______ 法。
3、由三种最基本的逻辑关系有导出的几种常用的逻辑运算 ________ 、4、逻辑函数有四种表示方法，它们分别是 _______ 、_____ 、____ 和 _______ O5、消除竞争冒险的方法有 _____ 、______ 、_____ 等。
6、按逻辑功能分类，触发器可分为 _______ 、_______ 、________________ 等四种类型。
7、从结构上看，吋序逻辑电路的基本单元是 ___________ 。
8、J K触发器特征方程为____________ o9、A/D转换的一般步骤为：取样、 _______ 、_______ 、编码。
10、___________________________________________________ 一个EPROM有18条地址输入线，其内部存储单元有_____________ 个。
11、_____________________________ D/A转换器的主要参数有、和o12、__________________________________________________ 就逐次逼近型和双积分型两种A/D转换器而言，____________________ 的抗干扰能力强， _______ 的转换速度快。
二、选择题。
(每题1分，共15分)1、以下说法正确的是()：(A)数字信号在大小上不连续，时间上连续，模拟信号则反之；(B)数字信号在大小上连续，时间上不连续，模拟信号则反之；(C)数字信号在大小和时间上均连续，模拟信号则反之；(D)数字信号在大小和吋间上均不连续，模拟信号则反之；2、A+BC=()。
(A)A+B (B) A+C (C) (A+B) (A+C) (D) B+C3、具有“有1出0、全0出1”功能的逻辑门是()。
大学《数字电路与逻辑设计》期末试卷含答案
大学《数字电路与逻辑设计》试题一、选择、填空、判断题（30分，每空1分）1.和CMOS相比，ECL最突出的优势在于D 。
A.可靠性高B. 抗干扰能力强B.功耗低 D. 速度快2.三极管的饱和深度主要影响其开关参数中的C 。
A.延迟时间t dB. 上升时间t rC. 存储时间t sD. 下降时间t f3.用或非门组成的基本RS触发器的所谓“状态不确定”是发生在R、S 上加入信号D 。
A.R=0, S=0B. R=0, S=1C. R=1, S=0D. R=1, S=14.具有检测传输错误功能的编码是：C 。
A. 格雷码B. 余3码C. 奇偶校验码5.运用逻辑代数的反演规则，求函数F=A̅[B+(C̅D+E̅G)]的反函数F̅：B 。
A.A+B̅C+D̅E+GB.A+B̅(C+D̅)(E+G̅)C.A̅+B(C̅+D)(E̅+G)6.下列叙述中错误的有：C 。
A. 逻辑函数的标准积之和式具有唯一性。
B. 逻辑函数的最简形式可能不唯一。
C. 任意两不同的最小项之和恒等于1。
7. 函数F=(A+B+C̅)(A ̅+D)(C+D)(B+D+E)的最简或与式为：A 。
A.F=(A+B+C ̅)(A ̅+D)(C+D)B.F=(A+B+C ̅)(A ̅+D)C.F=ABC̅+A ̅D+CD 8. 逻辑函数F (A,B,C,D )=∑(1,3,4,5,6,8,9,12,14)，判断当输入变量ABCD 分别从(1) 0110→1100，(2) 1111→1010时是否存在功能冒险：B 。
A. 存在，存在 B. 不存在，存在C.不存在，不存在9. 对于K ＝3的M 序列发生器，反馈函数为Q 2⊕Q 0，则产生M 序列：C 。
A. 1010100 B. 1110101 C. 111010010. 在进行异步时序电路的分析时，由于各个触发器的时钟信号不同，因此我们应该把时钟信号引入触发器的特征方程，对于D 触发器，正确的是：A 。
数电期末考试题及答案
数电期末考试题及答案一、单项选择题（每题2分，共20分）1. 在数字电路中，最基本的逻辑运算是（）。
A. 与、或、非B. 与、或、异或C. 与、或、同或D. 与、或、非、异或答案：A2. 一个触发器可以存储（）位二进制信息。
A. 1B. 2C. 3D. 4答案：A3. 以下哪个不是组合逻辑电路的特点？（）A. 输出只依赖于当前输入B. 输出与输入之间没有记忆功能C. 输出与输入之间存在记忆功能D. 输出与输入之间存在时间延迟答案：C4. 一个4位二进制计数器可以计数的最大值是（）。
A. 15B. 16C. 8D. 7答案：B5. 一个D触发器的输出Q与输入D的关系是（）。
A. Q=DB. Q=非DC. Q=D的延迟D. Q=D的反相延迟答案：A6. 在数字电路中，以下哪个不是基本的逻辑门？（）A. 与门B. 或门C. 非门D. 与非门答案：D7. 一个3线-8线译码器可以译码的输入信号个数是（）。
A. 3B. 4C. 5D. 6答案：B8. 一个8位寄存器可以存储的最大十进制数是（）。
A. 255B. 256C. 511D. 512答案：C9. 在数字电路中，以下哪个不是时序逻辑电路的特点？（）A. 输出不仅依赖于当前输入，还依赖于电路的状态B. 输出与输入之间存在记忆功能C. 输出与输入之间没有记忆功能D. 输出与输入之间存在时间延迟答案：C10. 一个JK触发器的输出Q与输入J和K的关系是（）。
A. Q=JB. Q=KC. Q=J+KD. Q=J⊕K答案：D二、填空题（每题2分，共20分）1. 在数字电路中，一个3位二进制计数器可以计数的最大值是______。
答案：72. 一个4线-16线译码器可以译码的输入信号个数是______。
答案：43. 一个8位二进制计数器可以计数的最大值是______。
答案：2554. 一个D触发器的输出Q与输入D的关系是Q=______。
答案：D5. 在数字电路中，一个与非门的输出是输入的______。
数字电路与逻辑设计考核试卷
D.触发器
12.以下哪些是数字电路设计中常用的设计原则？( )
A.最小化原则
B.最优化原则
C.模块化原则
D.可测试性原则
13.以下哪些部件可以实现数字信号的放大和驱动？( )
A.逻辑门
B.触发器
C.译码器
D.驱动器
14.以下哪些是常见的数字电路测试方法？( )
A.静态测试
B.动态测试
C.功能测试
A. RS触发器
B.加法器
C. D触发器
D. JK触发器
2.以下哪些逻辑门可以实现“逻辑非”功能？( )
A.非门
B.或非门
C.与非门
D.异或门
3.以下哪些编码方式属于二进制编码？( )
A. BCD码
B.格雷码
C.汉明码
D. 8421码
4.以下哪些是组合逻辑电路的例子？( )
A.译码器
B.计数器
C.多路选择器
4.二进制编码中，8421码是一种______编码方式。
5.在时序逻辑电路中，触发器在______的作用下改变状态。
6.数字电路设计中，为了减少“竞争-冒险”现象，可以采取增加______或使用______等方法。
7.在数字电路中，______用于实现数据的串行到并行转换，而______用于实现数据的并行到串行转换。
A.时钟信号
B.同步复位
C.异步复位
D.双沿触发
（结束）
三、填空题（本题共10小题，每小题2分，共20分，请将正确答案填到题目空白处）
1.在数字电路中，基本逻辑门包括与门、或门、非门和______门。
2.一个触发器能够存储一个二进制位，通常称为一个______。
3.在组合逻辑电路中，输出仅仅取决于输入信号的______和______。
《数字电路与数字逻辑》期末考试试卷A卷(1)
广西科技大学2015—2016学年第 1 学期课程考核试题 考核课程 数字电路与数字逻辑 （ A 卷）考核班级 软件141、142 学生数 80 印数 85 考核方式 闭卷 考核时间 120 分钟一、 选择题（每题2分，共20分）1． 数字9的BCD 码是1001，那么它的余三码是（ A ）A 1100B 1001C 0110D 11112． 若输入变量A 、B 全为1时，输出F 为1，其余情况下，F 为0，那么F 与AB 的关系是（ B ）A B A F ⊕= B B A F ⋅= C B A F += D B A F +=3． 二进制数1100转换成十六进制数是（ C ）A 12HB 0AHC 0BHD 0CH4． 逻辑表达式=⋅+B A A （ C ）A B A ⋅ B B C A D A5． 组合逻辑电路通常由（ A ）组合而成。
A 门电路B 计数器C 触发器D 寄存器6． 时序逻辑电路中一定包含（ C ）A 门电路B 计数器C 触发器D 寄存器7． 有2个与非门构成的基本RS 触发器，如果要触发器输出保持不变，则（）QA 00=S RB 01=S RC 10=S RD 11=S R8． T 触发器，如果T 端为高电平，那么CP 脉冲来的时候，输出Q 应（ ）A 为0B 为1C 保持不变D 翻转9． 时序逻辑电路输出状态的改变（ ）A 仅与该时刻输入信号的状态有关B 仅与时序电路的原状态有关C 与时序电路的原状态无关D 与A 、B 两项皆有关10．以下（ B ）不是解决组合逻辑电路中竞争冒险现象的方法。
A 增加冗余项B 使用卡诺图化简C 增加选通脉冲D 改变设计方法二、 使用卡诺图法化简以下逻辑函数（每题5分，共20分）1． ∑=)15,14,13,11,9,8,5,4,0(),,,(m D C B A F2． ∑=)13,10,8,5,2,1,0(),,,(m D C B A F3． ∑=)14,13,12,7,6,5,4(),,,(m D C B A F4． ∑∑+=)11,10,9,8()15,13,5,4,3,2(),,,(d m D C B A F三、 问答题（每题10分，共40分）1．分析下图所示的组合逻辑电路。
2019年西安邮电大学《数字电路与逻辑设计》期末考试A卷(含答案)
共6 页第 1 页年月日西安邮电学院课程考试试题（ A 卷）考试用（2019——2020 学年度第1 学期）课程名称：数字电路与逻辑设计试卷类型：（A、B、C）考试专业、年级：电子0801-0808、通工0801-0816、科技0801-0804光电0801-0804、光信息0801-0803题号一二三四五六七八九总分得分阅卷人一．填空题（每空2分，共20分）1．十六进制数(16F) 十六进制用 8421 余 3 码表示为。
，F A B C2．函数F A B B C 的最小项表达式为, ,mF 的与非与非表达式为(允许反变量输入)，F 的反演式为，F 的对偶式为，3．某 TTL 与非门的标准输入高电平为 3.6 伏，标准输入低电平为 0.3 伏，关门电平V OFF 0.8V ,开门电平V ON 1.8V , 则低电平噪声容限V ,NL高电平噪声容限V 。
NH4. 要构成容量为 4K×8bit 的 RAM，需要片容量为 256×8bit 的 RAM。
5. 一个初始状态为 0001 的模值为 12 的四位二进制同步递加计数器经过 33 个 CP 脉冲后，其状态为。
6. 一组合逻辑电路的输入、输出波形如下图所示，A、B 为输入信号，F 为输出信号，则输出信号 F 与输入信号 A、B 的逻辑关系为F＝ABF说明：1、除填空题、图解及特要求外一般不留答题空间。
总印1600 份（附答题纸1 页）二．选择题：（30 分）注意：1.每道题的正确答案只有一个，请将正确答案填入第二题答题栏中，以横线划过答题栏所选的答案，例如：2.题中涉及到的中规模器件的功能表，附在试卷纸的最后一页。
第二题答题栏题 1 2 3 4 5 6 7 8 9 10号选 A A A A A A A A A A择 B B B B B B B B B B答 C C C C C C C C C C案 D D D D D D D D D DE E E E E E E E E E1．TTL 与非门电路如右图所示，输出F＝A．0 B. 1C．AB D. A BE. A B2．下图所示电路中，Y1 ＝A. F=0B. F= A B C D EC. F= ABC DED. F= ABC DEE. 以上答案都不对2．装订试卷，考生答卷时不得拆开或在框外留写标记，否则按零分计。
数电期末考试题及答案
数电期末考试题及答案一、选择题（每题2分，共20分）1. 在数字电路中，逻辑“与”运算的输出为高电平的条件是：A. 所有输入都为高电平B. 至少一个输入为高电平C. 所有输入都为低电平D. 至少一个输入为低电平答案：A2. 下列哪个不是数字电路的特点？A. 抗干扰能力强B. 运算速度快C. 体积小D. 功耗大答案：D3. 在数字电路中，一个触发器的输出状态由以下哪个因素决定？A. 当前输入B. 过去的输入C. 外部控制信号D. 以上都是答案：D4. 以下哪个不是组合逻辑电路的特点？A. 输出只依赖于当前的输入B. 输出与输入之间存在时间延迟C. 没有反馈回路D. 输出状态随输入状态变化而变化答案：B5. 一个D触发器的输出Q与输入D的关系是：A. Q始终等于DB. Q始终等于D的反相C. Q在时钟上升沿等于DD. Q在时钟下降沿等于D答案：C6. 在数字电路中，一个计数器的输出在每个时钟脉冲后：A. 增加1B. 减少1C. 保持不变D. 随机变化答案：A7. 一个7段显示器可以显示多少个不同的数字？A. 7B. 10C. 16D. 64答案：B8. 以下哪个逻辑门不是基本逻辑门？A. 与门B. 或门C. 非门D. 异或门答案：D9. 在数字电路中，一个寄存器的主要用途是：A. 存储数据B. 放大信号C. 产生时钟信号D. 进行算术运算答案：A10. 以下哪种类型的存储器是易失性的？A. ROMB. RAMC. EPROMD. EEPROM答案：B二、填空题（每题2分，共20分）1. 在数字电路中，逻辑“或”运算的输出为低电平的条件是_______。
答案：所有输入都为低电平2. 一个完整的数字系统通常包括_______和_______两个部分。
答案：输入/输出系统、中央处理单元3. 在数字电路中，一个D触发器的输出Q在时钟信号的_______沿更新。
答案：上升4. 一个4位的二进制计数器能够表示的最大数值是_______。
数字电子技术试题(含答案)
系：_____________ 专业：_______________ 班级：_________ 准考证号： 姓名：_____________期 末 考 试 试 题 （卷）密 封 线 密 封 线 以 内 不 准 作 任 何 标 记 密 封 线考试试题（卷A ）专业: 考试科目： 数字电子技术 适用班级： 题 号一 二 三 四 五 总分分 数 评卷人 复查人一、单项选择题：（请在答题纸答题）（每小题2分，共20分） 1、十进制数35转换为二进制数为（ ）A. 11001B.100011C. 10101D.110110 2、十六进制数A05CH 转换为二进制数为（ ）A.1011 0000 0101 1011B.1010 0010 0101 1000C.1010 0000 0101 1100D.1000 0010 0110 1010 3、十进制数86转换为BCD 码应为（ ）A.01010110B.10000110C.00111001D.01101000 4、已知Y=A+BC ，则下列说法正确的是（ ）A.当A=0、B=1、C=0时，Y=1B.当A=0、B=0、C=1时，Y=1C.当A=1、B=0、C=0时，Y=1D.当A=1、B=0、C=0时，Y=0 5、下列逻辑代数基本运算关系式中不正确的是（ ）A.A+A=AB.A ·A=AC.A+0=0D.A+1=16、二输入端的或非门，其输入端为A 、B ，输出端为Y,则其表达式Y= （ ）A.ABB. A BC.ABD.A+B 7、基本RS 触发器如图所示，欲使该触发器保持原态，则输入信号为（ ）A.S=R=0B.S=R=1C.S=1 R=0D.S=0 R=18、要使JK 触发器处于计数状态，则必须使（ ）A.J=K=1B.J=K=0C.J=0，K=1D.J=1，K=0 9、下列触发器中没有计数功能的是（ ）A.RS 触发器B.T 触发器C.JK 触发器D.T ˊ触发器 10、组合电路中的冒险，偏“0”冒险Y = （ ）A. AAB.A A +C.A+0D.A+1二、填空题：（请在答题纸答题）（每空2分，共30分）1、逻辑函数的表示方法有___________、___________、___________、___________、___________五种形式。
- 1、下载文档前请自行甄别文档内容的完整性，平台不提供额外的编辑、内容补充、找答案等附加服务。
- 2、"仅部分预览"的文档,不可在线预览部分如存在完整性等问题,可反馈申请退款(可完整预览的文档不适用该条件!)。
- 3、如文档侵犯您的权益，请联系客服反馈,我们会尽快为您处理(人工客服工作时间：9:00-18:30)。
湖州师范学院求真学院 2010 — 2011学年第 二 学期
《数字电子与逻辑设计》期末考试试卷（A 卷）
适用班级 102831/102832 考试时间 120 分钟
学院 班级 学号 姓名 成绩
一、（每小题3分，共27分）选择题
1．下列四个数中与十进制数（163）10不相等的是 。
（A ）（A3）16 （B ）（10100011）2 （C ）（000101100011）8421BCD （D ）（100100011）8 2．将TTL 与非门作非门使用，则多余输入端应做 处理。
（A ）全部接高电平 （B ）部分接高电平，部分接地 （C ）全部接地 （D ）部分接地，部分悬空
3．由或非门构成的基本RS 触发器，输入S 、R 的约束条件是 。
（A ）SR=0 （B ）SR=1 （C ）S+R=0 （D ）S+R=1 4．T 触发器，在T=1时，加上时钟脉冲，则触发器 。
（A ）保持原态 （B ）置0 （C ）置1 （D ）翻转 5．下列等式不成立的是 。
（A ）B A B A A +=+
（B ）BC A C A B A +=++))(( （C ）BC AB BC C A AB +=++ （D ）1=+++B A AB B A B A 6．如果编码0100表示十进制数4，则此码不可能是( )。
(A.) 8421BCD 码 (B.) 5421BCD 码 (C.) 2421BCD 码 (D.) 余3码
7．下逻辑图的逻辑表达式为（ ）。
（A ）Y=AB·CD (B) Y=AB+CD (C) Y=AB+CD (D) Y= AB·CD 8．下列关于异或运算的式子中，不正确的是（ ）。
(A.) A ⊕A = 0 (B.) A ⊕A = 1 (C.) A ⊕0 = A (D.) A ⊕1 = A 9．标准与或是是由（ ）构成的逻辑表达式。
(A.)与项相或 (B.) 最小项相或 (C.) 最大项相与 (D.) 或项相与
二、（14分）如图所示为一工业用水容器示意图，图中虚线表示水位，A 、B 、C 电极被水浸没时会有信号输出，试用与非门构成的电路来实现下述控制作用：水面在A 、B 间，为正常状态，亮绿灯G ；水面在B 、
C 间或在A 以上为异常状态，点亮黄灯Y ；水面在C 以下为危险状态，
点亮红灯R 。
要求用最少的与非门画出逻辑电路图。
A
B C
三、（12分）电路如图所示，请画出在输入信号作用下，对应的输出Q1，Q2，L3的波形。
（设触发器均为边沿触发器，且初态为0）
四、（9分）试画出用3线—8线译码器74HC138和门电路产生如下多
输出逻辑函数的逻辑图。
B
“1” C C
A
B
C
Q1
Q2
L3
1D
C1
A
Q2
Q2
=
1J
C1
A
Q1
Q1
1K
1
B
C
五、（8分）试写出该电路的逻辑表达式。
得分
A
1
2
3
B
C D 1 2 3 4 5 6 7 8 9 10 1 2 3
4 5 6
7 8 9
10 11 12
1 2 3 4 5 6 7 8 9 10
六、（15分）译码器真值表如下表所示，试用74HC138实现该译码器。
真值表
选择输入
D C B A
译码输出0 1 2
3 4 5 6 7 8 9
0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1
0 1 0 0
1 0 0 0 1 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 0 1 1 1 1 1 1 1 1 1
1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0
七、（15分）分析下图，写出各触发器的激励方程、电路的状态方程
和输出方程，画出状态表和状态图，概述电路的逻辑功能。