QuartusII原理图设计方法
quartus 2应用2.4 原理图输入设计方法
2.4 原理图输入设计方法利用EDA工具进行原理图输入设计的优点是，设计者能利用原有的电路知识迅速入门，完成较大规模的电路系统设计，而不必具备许多诸如编程技术、硬件语言等新知识。
Quartus Ⅱ提供了功能强大，直观便捷和操作灵活的原理图输入设计功能，同时还配备了适用于各种需要的元件库，其中包含基本逻辑元件库（如与非门、反向器、D触发器等）、宏功能元件（包含了几乎所有74系列的器件），以及功能强大，性能良好的类似于IP Core的巨功能块LPM库。
但更为重要的是，Quartus Ⅱ还提供了原理图输入多层次设计功能，使得用户能设计更大规模的电路系统，以及使用方便精度良好的时序仿真器。
以传统的数字电路实验相比为例，Quartus Ⅱ提供原理图输入设计功能具有显著的优势：①能进行任意层次的数字系统设计。
传统的数字电路实验只能完成单一层次的设计，使得设计者无法了解和实现多层次的硬件数字系统设计；②对系统中的任一层次，或任一元件的功能能进行精确的时序仿真，精度达0.1ns，因此能发现一切对系统可能产生不良影响的竞争冒险现象；③通过时序仿真，能对迅速定位电路系统的错误所在，并随时纠正；④能对设计方案作随时更改，并储存入档设计过程中所有的电路和测试文件；⑤通过编译和编程下载，能在FPGA或CPLD上对设计项目随时进行硬件测试验证。
⑥如果使用FPGA和配置编程方式，将不会有任何器件损坏和损耗；⑦符合现代电子设计技术规范。
传统的数字电路实验利用手工连线的方法完成元件连接，容易对学习者产生误导，以为只要将元件间的引脚用引线按电路图连上即可，而不必顾及引线的长短、粗细、弯曲方式、可能产生的分布电感和电容效应以及电磁兼容性等等十分重要的问题。
以下将详细介绍原理图输入设计方法，但读者应该更多地关注设计流程，因为除了最初的图形编辑输入外，其它处理流程都与文本（如VHDL文件）输入设计完全一致。
2.4.1 1位全加器设计向导1 为本项设计建立文件夹任何一项设计都是一项工程（Project），都必须首先为此工程建立一个放置与此工程相关的所有文件的文件夹，此文件夹将被EDA软件默认为工作库（Work Library）。
ALtera Quartus II 原理图设计方法
CLICK
CLICK
3
电子设计自动化EDA
P97，第3段
CLICK
4
电子设计自动化EDA
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5
电子设计自动化EDA
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电子设计自动化EDA
原理图设计
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电子设计自动化EDA
8
电子设计自动化EDA
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Libraries
primitives
logic
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电子设计自动化EDA
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电子设计自动化EDA 波形仿真
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电子设计自动化EDA
Mouse Right Click
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电子设计自动化EDA
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电子设计自动化EDA
CLICK CLICK
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电子设计自动化EDA
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电子设计自动化EDA
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电子设计自动化EDA
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在此区域连续单击鼠标右键
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电子设计自动化EDA
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按住鼠标左键，移动，选定一个区域
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电子设计自动化EDA
CLICK
CLICK
26
电子设计自动化EDA
保存
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电子设计自动化EDA
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电子设计自动化EDA 引脚分配
CLICK
CLICK
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电子设计自动化EDA
DOUBLE CLICK
DOUBLE CLICK
30
电子设计自动化EDA
输入引脚编号：240
编译
31
电子设计自动化EDA
数字电路Quartus II 原理图输入法设计
数字电路与逻辑设计实验报告实验1 Quartus II 原理图输入法设计【实验目的】 (1)【实验仪器和器件】 (1)【实验内容】 (1)【设计过程】 (2)【实验过程】 (3)【故障分析及解决】 (5)【实验总结】 (5)【实验目的】1）熟悉用Quartus II原理图输入法进行电路设计和仿真2）掌握Quartus II图形模块的生成和调用3）熟悉实验板的使用【实验仪器和器件】1）计算机2）直流稳压电源3）数字电路与逻辑设计实验开发板【实验内容】1）用逻辑门设计实现一个半加器，仿真验证其功能生成新的半加器图形模块2）使用半加器图形模块和逻辑门实现全加器，仿真验证其功能，下载到实验板测试，用拨码开关设定输入信号，LED显示输出信号3）用74LS138和逻辑门实现函数F = (~C·~B·~A)+(~C·B·~A)+(C·~B·~A)+(C·B·A)，并仿真验证其功能，下载到实验板测试。
用拨码开关设定输入信号，LED显示输出信号。
【设计过程】1.设计半加器：可知半加器函数S = A⊕B，C = AB。
故设计为然后点击File -> Create/Update -> Create Files for Current File 将创建半加器的模块bsf 文件储存在工程目录内，方便下次调用2.设计全加器：在原目录下新建工程，创建原理图，直接导入半加器模块，将两个半加器组合附加2输入或门组成全加器，如图：3.用74138设计函数F = (~C·~B·~A)+(~C·B·~A)+(C·~B·~A)+(C·B·A)：输入由高位到低位依次为A B C，添加非门和或门，组成函数：【实验过程】1.按照以上工程创建工程和原理图2.编译原理图，修正错误，使编译通过3.创建waveform vector仿真文件，将所有原理图输入、输出引脚添加至列表。
Quartus原理图设计
（2）添加文件
（3）选择目标芯片
（4）指定其它EDA工具
Project name: adder Top-level design entity: adder Device assignments:
Family name: ACEX1K
Device: EP1K10TC100-3
（3）编辑波形
a）设置仿真时间 Edit | End Time
b）设置栅格时间 Edit | Grid Size
c）波形编辑工具箱
找节点 未初始化
缩放视图
替换节点 强制未知
强制低电平
强制高电平
高阻抗 弱低电平 无关 计数值 任意值 对齐网格
弱未知 弱高电平 翻转波形 时钟信号 随机值 排序
（2）添加编程文件
（3）启动编程
√
primitives | pin
bidir input output
真值表 a 0 0 1 b 0 1 0 cout 0 0 0 sout 0 1 1
1
1
1
0
cout a b sout a b
半加器原理图
（4）保存文件 File | Save As
2 创建工程 File | New Project Wizard
d）设置时钟
e）设置节点顺序
f）设置节点属性
输入信号波形
（4）设置时序仿真模式 Assignment | Settings Simulator Settings
（5）观看仿真结果 Processing | Start Simulation View | Fit in Window
半加器时序仿真波形图
创建工作目录 D :\ PLD \ adder
QuartusII及其原理图设计
QuartusII及其原理图设 计
45
QUARTUS II –习题一
1-7 基于Quartus II，用74194（4位双向移位寄存器）设 计一个“”序列产生器电路，进行编译和仿真，查看仿真结果。 1-8 基于Quartus II软件，用D触发器和适当的门电路实现 一个输出长度为15的m序列产生器，进行编译和仿真，查看 仿真结果。
QUARTUS II –Functional Simulation功能仿真
QuartusII及其原理图设 计
35
QUARTUS II –Functional Simulation功能仿真
QuartusII及其原理图设 计
36
QUARTUS II –Timing Simulation功能仿真
时序仿真：通过功能仿真验证设计文件的正确性， 就压考虑综合电路遇到的时延问题。时序仿真同时 验证电路的逻辑和时序正确性。
1、图表模块编辑是主要的顶层设计的主要方法 2、原理图编辑是传统的设计输入方法 3、用户可以利用加入QUARTUS II提供的LPMs，宏功 能等函数以及用户自己的库函数来设计 4、提供“智能”的模块链接和映射
QuartusII及其原理图设 计
6
QUARTUS II –图表模块设计流程
QuartusII及其原理图设 计
16
QUARTUS II QUARTUS II –原理图设计例子
4、进行软件仿真Example.vwf：左侧右键->Insert Node or Bus（或直接双击），在对话框中选择Node Finder，导入输入输出端
双击
QuartusII及其原理图设 计
18
QUARTUS II –原理图设计例子
QuartusII开发原理图+
2.1 Quartus Ⅱ软件简介
➢ 输出系统测试组件。 ➢ 输出生成系统基于存储器映射和组成的
定制软件开发套件(SDK)。 SOPC Builder使设计者能够集中精力 在用户逻辑设计上，无需手工完成系统 集成任务从而提升了系统性能。
2.1 Quartus Ⅱ软件简介
3．在设计周期的早期就对IO引脚进行 分配和确认 QuartusⅡ软件可以进行预先的I／
2.2.2 用原理图方法设计2-4译码器
图2.14 摆放好所有元器件 (3)连接各元器件并命名，有节点标识
2.2.2 用原理图方法设计2-4译码器
原理图和图表模块编辑时所用到的工 具按钮，如图2.15所示。熟悉这些工具的 基本性能，可以大大提高设计速度。
图2.15 编辑工具按钮
2.2.2 用原理图方法设计2-4译码器
2.2.2 用原理图方法设计2-4译码器
图2.9 器件类型设置
2.2.2 用原理图方法设计2-4译码器
（4） 结束设置 单击图2.8中的“Next”按钮后进入
最后确认的对话框，如图2.9所示。从图 中可以看到建立的工程名称、选择的器 件等信息，如果无误的话，单击 “Finish”按钮，出现如图2.10所示的 窗口，在资源管理窗口中可以看到新建 的名称“2_4decoder”工程。
图2.22 列出输入/输出节 点
2.2.2 用原理图方法设计2-4译码器
（3） 在图2.22界面中单击“>>”按钮， 则将所有输入/输出复制到右边的一侧。也 可以只选择其 中的一部分， 根据情况而定， 如图2.23所示。
图2.23 选择输入/输出节点
2.2.2 用原理图方法设计2-4译码器
（4） 在图2.23界面中单击“OK”按钮 后，返回“Inter Node or Bus”对话框。 此时，在“Name”和“Type”栏里出现了 “Multiple Items”，如图2.24所示。
QuartusII原理图设计
QuartusII原理图设计一．实验项目Quartus II原理图设计二．实验目的1.学习EDA集成工具软件Quartus II的使用；2.熟悉基于PLD的EDA设计流程；3.学会使用原理图设计小型数字电路；4.掌握对设计进行综合、仿真、指定引脚和配置下载的方法。
三．实验设备及工具Quartus II 18.1四．实验内容与步骤0、准备工作：创建Quartus II项目菜单“File/New Project Wizard”,逐步设置：工作目录、项目名和实体名；是否添加设计文件；选择器件；是否使用第三方EDA工具。
1、设计输入：采用原理图输入方式新建文件（菜单File/New...）选择原理图文件类型（Block Diagram/Schematic File），扩展名*.bdf放置器件：在原理图的空白处双击鼠标左键（或者工具按钮）->选择元件库->选择元件->双击放置元件放置端口：input、output连线：将鼠标移到一个端口，则鼠标自动变为‘¬’形状。
一直按住鼠标的左键并将鼠标拖到第二个端口。
放开左键，一条连接线就画好了。
连线需要转折，则松开鼠标按钮，再按下按钮继续拖动即可。
修改端口名称：注意，一个设计中不允许有重复的端口名。
保存文件：最好先建一个子目录，指定文件名，把文件保存在这个目录下。
2、编译、综合在Processing菜单选择Start Compilation项（或者紫色的编译按钮），则自动进行编译，并且软件左侧出现Status状态窗口，给出编译步骤和执行进度。
若设计无错误，则给出编译报告和其他处理步骤的报告。
若有错误，则根据错误提示修改设计文件，重新编译。
3、进行仿真：功能仿真、时序仿真新建“激励信号”的波形文件：（菜单File/New...）选择波形文件类型（Wector Waveform File），扩展名*.vwf，打开波形编辑窗口选择要仿真的节点：在“Name”列空白处，右键菜单，如上图所示。
QuartusII原理图设计方法
一、Quartus II设计流程介绍 6）显示由新建工程指南建立的工程文件摘要，在界面顶部标题栏 将显示工程名称和存储路径,如图2.7所示。
图2.7 新建工程摘要对话框
§ 2.1
二、编辑设计图形文件
1.建立原理图文件
Quartus II原理图输入法
图2.8 执行File-New…命令
§ 2.1
1.建立原理图文件
3、设置输入信号波形 先用鼠标左键单击并拖动鼠标选择要设置的区域，单击工具箱 中按钮Forcing High(1)则该区域变为高电平。
图2-45 设置后的波形
§ 2.1
四、时序仿真设计文件
Quartus II原理图输入法
4、进行功能仿真
设置输入信号后保存文件，文件名默认，执行 Processing-Start simulation命令，进行仿真
II设计流程介绍
2）选择项目存放目录、填写项目名称，注意项目顶层设计实 体名称必须和项目名称保持一致。
工程项目目录 项目名称
项目顶层设计实体名称
图2.3
工程项目基本设置P39
§ 2.1
Quartus II原理图输入法
一、Quartus II设计流程介绍 3）完成上述操作后，按Next按钮将会弹出加入文件对话框，如图 2.4所示。
图2-46执行 编译命令
§ 2.1
四、时序仿真设计文件
4、进行功能仿真
Quartus II原理图输入法
§ 2.1
五、生成元件符号
Quartus II原理图输入法
执行File-Create/Update-Create Symbol File for Current File命令 将本设计电路封装成一个元件符号，供以后在原理图编辑器下进行 层次设计时调用。
实验二 QuartusII原理图设计方法
实验二QuartusII原理图设计方法一、实验目的1.熟悉利用QuartusII的原理图输入方法设计简单组合电路；2.掌握层次化设计方法。
二、实验任务1.使用原理图设计方法完成半加器和全加器的设计。
（1）打开QuartusII软件新建工程。
进入创建项目（project）向导第一行是项目地址、第二行是项目名称、第三行是该项目顶层实体的名称。
没有要添加的文件，点击next选择器件类型选择仿真工具进入索引页面（summary），观察是否有错误，没有错误。
点击finish，完成项目的创建。
选择菜单file→New，弹出对话框，选择Block Diagram/Schematic File，点击OK直接在原理图上双击，出现对话框，在name栏中输入元件名。
点击ok。
依次添加其他其他元件完成半加器设计。
点击工具栏中的compile，进行编译正确无误后进入下一步骤。
（3）使用ModelSim-Altera仿真首先我们可以点击菜单栏的Processing→Start→Start Test Bench Template Writer，随后弹出提示“Test Bench Template Writer was successful”，那么我们就已经创建了一个Verilog 测试脚本，在此脚本中，我们可以设计一些测试激励输入并且观察相应输出，借此我们就能够验证原工程的设计代码是否符合要求。
我们打开工程路径下的/simulation/modelsim 文件夹，可以看到一个名为h_adder.vt 的测试脚本文件创建了。
我们可以在Quartus II 中打开这个文件，并且将其重新编辑如下：完成测试脚本编写，我们接着需要打开菜单栏的Assigement→Settings 选项，选择Category→EDA Tool Setting→Simulation，在右边的相关属性中做如图所示的设置，在选中Comple test bench 后，我们要点击后面的Test Benches…按钮去选择刚才创建的测试脚本。
EDA技术与应用讲义 第3章 原理图输入设计方法 QUARTUS II版本
有了HDL语言后？
硬件设计人员 的工作过程
已经 类似与
软件设计人员，那么
这种模式的好处是？
让我们先看看原来是如何做的－>
Compiler Netlist Extractor （编译器网表提取器）
❖ The Compiler module that converts each design file in a project (or each cell of an EDIF Input File) into a separate binary CNF. The filename(s) of the CNF(s) are based on the project name. Example
电路的模块划分
❖ 人工 根据电路功能 进行 模块划分
❖ 合理的模块划分 关系到
1. 电路的性能 2. 实现的难易程度
❖ 根据模块划分和系统功能 确定： PLD芯片型号
模块划分后，就可以进行 具体设计 了
设计输入
一般EDA软件允许3种设计输入：
1. HDL语言 2. 电路图 3. 波形输入
图形设计输入的过程
件电路图设计 5. 综合调试 6. 完成
设计的几个问题
❖ 如何组织多个设计文件的系统？，项目的概 念。
❖ 时钟系统如何设计？
❖ 电路的设计功耗
❖ 高速信号的软件和硬件设计
The end.
以下内容 为 正文的引用，
可不阅读。
常用EDA工具软件
❖ EDA软件方面，大体可以分为两类：
1. PLD器件厂商提供的EDA工具。较著名的如：
❖ 第三方工具软件是对CPLD/FPGA生产厂家开发软件的补 充和优化，如通常认为Max+plus II和Quartus II对 VHDL/Verilog HDL逻辑综合能力不强，如果采用专用的 HDL工具进行逻辑综合，会有效地提高综合质量。
1、Altera Quartus II 教程(基于Altera DE2板和原理图设计)
目前，FPGA 的主要发展动向是：随着大规模 FPGA 器件的发展，系统设计进入“片上可 编程系统”（SOPC）的新纪元；芯片朝着高密度、低压、低功耗方向挺进；国际各大公司都 在积极扩充其 IP（知识产权）库，以优化的资源更好的满足用户的需求，扩大市场；特别是 引人注目的所谓 FPGA 动态可重构技术的开拓，将推动数字系统设计观念的巨大转变。
Altera Quartus II 入门教程
（基于Altera DE2 板和原理图设计）
广东工业大学自动化学院电子信息科学与技术系
1
徐迎晖
2009 秋
目录
一、FPGA 简介 ............................................................................................ 1 二、DE2 板及 Altera 公司产品简介........................................................... 4 三、Quartus II 使用基础 .............................................................................. 8
四、设计实例 ..................................................................................... 33
功能要求............................................................ 33 设计思路............................................................ 34 方案设计............................................................ 34 详细设计............................................................ 36 设计的实现 .......................................................... 37 评价与改进 .......................................................... 41
Quartus II原理图设计1
• Table 6-52.
• • • • • • • • • • • • • • • • • • •
4-input,8-bit multiplexer
module vrmux4in8bc(YOE_L,EN_L,S,A,B,C,D,Y); input YOE_L,EN_L; input[1:0] S; input[1:8] A,B,C,D; output[1:8] Y; reg [1:8]Y; always @(YOE_L or EN_L or S or A or B or C or D) begin if(~ YOE_L==1'b0) Y=8'bz; else if (~EN_L==1'b0) Y=8'b0; else case (S) 2'd0:Y= A; 2'd1:Y=B; 2'd2:Y=C; 2'd3:Y=D; default :Y=8'bx; endcase end endmodule
• Table 6-22
• • • • • • • • • • • • • • • • • • • • • • • • • • module vr74x138b(G1,G2A_L,G2B_L,A,Y_L); input G1,G2A_L,G2B_L; input [2:0] A; output [0:7] Y_L; reg G2A,G2B; reg [0:7] Y_L,Y; always @(G1 or G2A_L or G2B_L or A or Y_L) begin G2A=~G2A_L; G2B=~G2B_L; Y_L=~Y; if(G1 & G2A & G2B) case (A) 0:Y_L=8'b10000000; 1:Y_L=8'b01000000; 2:Y_L=8'b00100000; 3:Y_L=8'b00010000; 4:Y_L=8'b00001000; 5:Y_L=8'b00000100; 6:Y_L=8'b00000010; 7:Y_L=8'b00000001; default: Y_L=8'b00000000; endcase else Y_L=8'b00000000; end endmodule
FPGA轻松学习用QuartusII通过原理图完成与门电路设计
FPGA轻松学习用QuartusII通过原理图完成与门电路设计打开QuartusII软件，程序主界面如下：1，新建一个工程点击File——>New Project Wizard，打开创建新工程向导，这里你将完成工程的基本设定选项。
1，Project name and directory——工程的名称与目录2，Name of the top-level design entity——顶层设计实体的名称3，Project files and libraries——项目文件与库4，Target device family and device——目标设备的族类5，EDA tool settings——EDA工具设定这里一般设定好工程名称和目录，顶层设计实体名称以及目标设备族类就可以了，其他的暂时直接使用默认项就可以了。
2，新建一个设计文件通过点击File——>New打开新建文件选择框，由于我们这里使用原理图描述实现的，则文件类型选择Design Files——>Block Diagram/Schematic File，就新建了一个原理图文件，将其保存起来，注意命名要跟前面设置的顶层设计实体名称相同。
3，编写设计文件接下来开始在文件中绘制原理图，这里首先完成与门的添加，点击左侧工具栏中的Symbol Tool按钮，打开Symbol选择框，选择primitives——>logic——>and2，点击OK后即可在原理图中添加一个2输入的与门了。
在同样通过Symbol Tool中的加入和primitives——>pin——>output加入输入和输出引脚，然后在原理图中把他们用Orthogonal Node Tool即导线连接起来，双击输入输出引脚，为他们设定好名字，pinA，pinB，pinC，就完成了原理图中的设计。
4，编译（分析综合）点击Processing——>Start——>Start Analysis & Synthesis，进行分析综合，就好像是对程序进行编译，等待片刻，如果没有错误，编译报告会输出出来。
Quartus系列：QuartusII原理图输入设计
Quartus系列：QuartusII原理图输⼊设计
1.新建⼀个项⽬,点击"File->New..."弹出如下对话框:
2.建⽴原理图设计平台:
3.在原理图绘制区双击⿏标左键,即可弹出元件符号窗⼝,如下图所⽰:
4.添加元件,在红⾊框部分输⼊要查找的元件名,如果库中存在对应元件,则对应元件符号会显⽰在对话框右侧的绘制区,单击"OK"即可完成对应元件加⼊到原理图绘制窗⼝中:
5.绘制连接原理图,当⿏标放到元件端点处时,⿏标会⾃动捕捉对应的连接处,按下左键拖动⾄⽬标出,再次松开⿏标即可完成⼀次连线操作如下图所⽰:
6. 完成连线后也可对相应的端⼝名进⾏命名,⿏标左键双击端⼝名，如图⽰74138电路A端连接的input端⼝命名为A,如下图所⽰:
完成管脚命名后保存设计,即完成原理图的设计.
7.在下拉菜单Processing中选择Start Compilation，启动编译:
8.⼯程编译完成后，设计结果是否满⾜设计要求，可以通过时序仿真来分析；建⽴波形⽮量⽂件(具体仿真⽮量如何建⽴可参考"Quartus II 功能仿真设置流程").
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quartus2的原理图设计及应用
Quartus2的原理图设计及应用1. 介绍Quartus2是一款由Intel（原Altera）公司开发的用于FPGA（现场可编程逻辑门阵列）设计的集成开发环境（IDE）。
它提供了丰富的工具和功能，使得原理图设计和FPGA应用开发变得更加易于实现。
本文将介绍Quartus2的原理图设计流程以及其在实际应用中的一些常见用途。
2. Quartus2的原理图设计流程Quartus2的原理图设计流程主要包括项目创建、电路图绘制、电路仿真和综合、布局与布线以及生成最终的比特流文件等步骤。
2.1 项目创建在Quartus2中创建一个项目是第一步，可以通过选择项目名称、项目文件夹路径等信息来进行项目设置。
在项目创建时，需要选择目标FPGA器件的型号和设计目标等参数，以便Quartus2能够进行正确的综合和布局布线。
2.2 电路图绘制在项目创建完成后，可以使用Quartus2提供的电路图设计工具来进行电路图绘制。
电路图设计工具提供了丰富的元件库和线连接工具，可根据需求绘制各种逻辑电路和模块。
2.3 电路仿真与综合完成电路图绘制后，可以使用Quartus2提供的仿真工具对设计的电路进行仿真，并验证其功能和性能。
通过仿真结果，可以进一步调整和优化电路设计。
在电路仿真验证通过后，可以进行综合操作，将电路转化为FPGA的可编程逻辑。
Quartus2的综合工具会根据目标FPGA器件的特性和约束，生成逻辑元件的门级描述。
2.4 布局与布线综合完成后，需要进行布局和布线，将逻辑元件映射到FPGA的实际物理位置上，并通过连线完成逻辑之间的连接。
Quartus2的布局布线工具会根据目标FPGA 器件的布局规则和约束，自动完成布线。
2.5 生成比特流文件布局布线完成后，最后一步是生成最终的比特流文件（bitstream），该文件包含了FPGA的配置信息。
生成比特流文件后，可以通过下载到目标FPGA器件上进行验证和调试。
3. Quartus2在实际应用中的常见用途3.1 数字逻辑设计Quartus2广泛应用于数字逻辑设计领域，可用于设计各种逻辑电路，如加法器、多路选择器、寄存器等。
2.实验二 QuartusII原理图输入法层次化设计
fadd instab cs co实验二 QuartusII 原理图输入法层次化设计一、实验目的1. 掌握原理图文件的设计方法2. 掌握调用模块设计原理图文件的方法3. 掌握原理图文件层次化设计的方法 二、 实验器材 计算机与QuartusII 工具软件三、实验原理1、按照原理图设计法的步骤操作，根据图1设计一个一位全加器，编译仿真通过后，把fadd.bdf 文件生成fadd.bsf 符号文件，以备在项目二中调用该符号。
2、 按图2设计一个四位二进制加法器，设计原理图前，需将1中的fadd.bdf 和fadd.bsf 文件复制到此项目目录下 四、实验步骤（一）设计一位全加器1. 在D 盘下新建文件夹：D:\fadd2. 新建项目fadd ：1）打开QuartusII2）File →New Project Wizard …… 3）选择项目文件夹路径：D:\fadd 4）输入项目名和文件名：fadd 5）点击“Next ”，直到最后。
3. 建立原理图文件fadd ：1）File →New2）选择第二项：Block Diagram/Schematic File 4. 画电路图（见图1）1）选择器件：GND 、vcc 、74151、input 、output 。
2）连线：节点线。
3）修改输入输出名称。
输入：a 、b 、c 。
输出：s 、co 。
5. 保存设计图形文件。
Save ：路径（D:\fadd ） 6. 点击图标，对文件进行编译。
如有错误，重复第4、5步。
7. 执行File →Create/Update →Create Symbol Files for Current File 命令，生成符号文件hadd.bsf 。
（二）设计四位二进制加法器1、在D盘下新建文件夹：D:\add42、将项目（一）中的fadd.bdf和fadd.bsf文件复制到此项目目录下3、新建项目add4：a)打开QuartusIIb)File→New Project Wizard ……c)选择项目文件夹路径：D:\add4d)输入项目名和文件名：add4e)点击“Next”，直到最后。
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QuartusⅡ原理图输入设计法学习：
1. 建立工程项目（工程目录、名称和选择合适器件）
2. 编辑设计图形文件（放置元件、连线、设定输入输出管脚名称）
3. 编译设计图形文件（检查电路是否有错误）
4. 时序仿真设计文件（得到仿真波形验证设计结果）
5. 生成元件符号
图2.13 Symbol对话框
§ 2.1
1）元件的选择与放置
Quartus II原理图输入法
2.编辑输入原理图文件
其它元件可以通过复制和
选择重新插入新元件得到
图2.16 放置元件后的界面图
§ 2.1
1）元件的选择与放置
Quartus II原理图输入法
2.编辑输入原理图文件
打开pin引脚子库，选择input管脚和插入逻辑 元件一样插入原理图中 图2.21 放置管脚
一、Quartus II设计流程介绍 6）显示由新建工程指南建立的工程文件摘要，在界面顶部标题栏 将显示工程名称和存储路径,如图2.7所示。
图2.7 新建工程摘要对话框
§ 2.1
二、编辑设计图形文件
1.建立原理图文件
Quartus II原理图输入法
图2.8 执行File-New…命令
§ 2.1
1.建立原理图文件
II设计流程介绍
2）选择项目存放目录、填写项目名称，注意项目顶层设计实 体名称必须和项目名称保持一致。
工程项目目录 项目名称
项目顶层设计实体名称
图2.3
工程项目基本设置P39
§ 2.1
Quartus II原理图输入法
一、Quartus II设计流程介绍 3）完成上述操作后，按Next按钮将会弹出加入文件对话框，如图 2.4所示。
§ 2.1
1）元件的选择与放置
Quartus II原理图输入法
2.编辑输入原理图文件
元件放置完成
§ 2.1
2）连接各个元件符号
Quartus II原理图输入法
2.编辑输入原理图文件
把鼠标移置一个input元件连接处，单击鼠标左键，移到要与之相连的非门元件
的连接处，松开鼠标即可连接两个要连的元件如图2.24所示
1、新建用于仿真的波形文件
执行File-New…命令，可建立和编辑的文件有三类：器件设计文件Device Design Files、软件文件Software Files和其他文件Other Files。
波形文件
图2.30 新建波形文件
§ 2.1
四、时序仿真设计文件
Quartus II原理图输入法
1、新建用于仿真的波形文件
3、设置输入信号波形 先用鼠标左键单击并拖动鼠标选择要设置的区域，单击工具箱 中按钮Forcing High(1)则该区域变为高电平。
图2-45 设置后的波形
§ 2.1
四、时序仿真设计文件
Quartus II原理图输入法
4、进行功能仿真
设置输入信号后保存文件，文件名默认，执行 Processing-Start simulation命令，进行仿真
选择器件的封装形
式、引脚数目和速
度级别约束可选器 选择Cyclone系列 件的范围。
图2.5 选择器件对话框
§ 2.1
Quartus II原理图输入法
一、Quartus II设计流程介绍 5） 图2.6 询问是否选择其他EDA工具
图2.6 选择其他EDA工具
§ 2.1
Quartus II原理图输入法
§ 2.1
三、编译设计图形文件
Quartus II原理图输入法
执行Processing-Start Compilation,如图2.27进行编译
编译结束后会出现错误和警告提示
图2.27 执行编译命令
图2.29 输出信号对输入信 号延时时间报告
§ 2.1
四、时序仿真设计文件
Quartus II原理图输入法
选中后使该文件添加 到刚建立的工程中去
图2.10 将文件添加到工程中
§ 2.1
Quartus II原理图输入法
2.编辑输入原理图文件
如图2.11，右侧空白处就是原理图的编辑区
图2.11 图形编辑界面
§ 2.1
比较器的完整原理图
Quartus II原理图输入法
2.编辑输入原理图文件
2.12
比较器的原理图
1）选择菜单命令File|New Project Wizard 将弹出如图2.2所示对话框。
可先在电脑中建立工程项目存 放的目录如： D:\EDA_book\code\Chapter2\ BiJiaoQi
图2.2 New Project Wizard 对话框
§ 2.1
一、 Quartus
Quartus II原理图输入法
Quartus II原理图输入法
弹出新建文件对话框如图2.9 AHDL文本文件
流程图和原理图文件
网表文件 在线系统文件 Verilog HDL文本文件
VHDL文本文件
图2.9 新建文件对话框
§ 2.1
1.建立原理图文件
Quartus II原理图输入法
执行File-Save as…命令，把它另存为文件名是BiJiaoQi的原理图 文件，后缀名为.bdf
§ 2.1
五、生成元件符号
Quartus II原理图输入法
生成的符号存放在本工程目录下，文件名BiJiaoQi，文件后缀名.bsf
§ 2.1
Quartus II原理图输入法
Quartus II设计软件界面如图1所示
图1
Quartus II 软件界面
§ 2.1
Quartus II原理图输入法
一、Quartus II设计流程介绍 与Max+plusⅡ软件一样， Quartus II软件的开发流程也概括为设计 输入、设计编译、设计仿真、和设计下载等过程，下面分别加以描述。 1．新建一个工程 利用Quartus II提供的新建工程指南建立一个工程项目。
§ 2.1
Quartus II原理图输入法
2.编辑输入原理图文件
3）设定各输入、输出引脚名
双击任意一个input元件，将会弹出图2.25所示的引脚属性编辑对话框
图2.25 引脚属性编辑对话框
§ 2.1
Quartus II原理图输入法
2.编辑输入原理图文件
3）设定各输入、输出引脚名
编辑好所有引脚后保存
鼠标在该处单击右键，出现 2.32所示菜单，选择Insert Node or Bus命令
图2.32
§ 2.1
四、时序仿真设计文件
Quartus II原理图输入法
1、新建用于仿真的波形文件
单击OK后出现波形编辑界面
§ 2.1
四、时序仿真设计文件
2、设置仿真时间
Quartus II原理图输入法
图2-37 波形编辑界面
图2-46执行 编译命令
§ 2.1
四、时序仿真设计文件
4、进行功能仿真
Quartus II原理图输入法
§ 2.1
五、生成元件符号
Quartus II原理图输入法
执行File-Create/Update-Create Symbol File for Current File命令 将本设计电路封装成一个元件符号，供以后在原理图编辑器下进行 层次设计时调用。
可以在File空白处选择添入已存 在的设计文件加入到这个工程 中，也可以使用User Library Pathnames按钮把用户自定义 的库函数加入到工程中使用， 完成后按Next按钮进入下一步。
图2.4 加入文件对话框
§ 2.1
Quartus II原理图输入法
一、Quartus II设计流程介绍 4）如图2.5所示是选择可编程逻辑器件对话框，选Yes为手动选择 需要的器件，选No则由编译器自动选择。
§ 2.1
1）元件的选择与放置
Quartus II原理图输入法
2.编辑输入原理图文件
双击鼠标的左键，将弹出Symbol对话框，或单击鼠标右键，在弹出的选择 对话框中选择Insert-Symbol，也会弹出该对话框。如图2.13所示P44
基本元件库 Logic子库包含与门、或门和非门
重复-插入模式选否 作为流程图模块插入符号选否
§ 2.1
四、时序仿真设计文件
2、设置仿真时间
Quartus II原理图输入法
执行Edit-End Time…命令，设置合适的时间
§ 2.1
四、时序仿真设计文件
2、设
执行Edit-Grid Size…命令，设置合适的时间
§ 2.1
四、时序仿真设计文件
Quartus II原理图输入法