补充练习题答案
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5.10 用16K×1位的DRAM 芯片组成64K×8位存储器,要求: (1) 画出该存储器的组成逻辑框图。
答案:(1)组建存储器共需DRAM 芯片数N=(64K*8)/(16K*1)=4*8(片)。
每8片组成16K×8位的存储区, A13~A0作为片内地址,用A15、A14经2:4译码器产生片选信号
,逻辑框图如下(图有误:应该每组8片,每片数据线为1根)
5.11若某系统有24条地址线,字长为8位,其最大寻址空间为多少?现用 SRAM2114(1K*4)存储芯片组成存储系统,试问采用线选译码时需要多少个2114存储芯片?
该存储器的存储容量=224 *8bit=16M 字节
注:采用线选译码,显然用于字选的地址线应该为10根(对应于1k 的芯片存储容量),那么余下24-10=14根地址线可用于片选,因此需要SRAM2114(1K*4)存储芯片数目应该为:14组*2片/组=28片。
5.12 在有16根地址总线的机系统中画出下列情况下存储器的地址译码和连接图。(根据答案改的题目)
(1)采用8K*8位存储芯片,形成64KB 存储器。 (2)采用8K*8位存储芯片,形成32KB 存储器。 (3)采用4K*8位存储芯片,形成16KB 存储器。
由于地址总线长度为16,故系统寻址空间为16
264K bit ⨯=⨯位宽位宽
(1)8K*8位存储芯片字选地址长度为13,64KB 存储器需要8个8K*8位存储芯片,故总共需要3根地址总线用于片选,地址译码为:
其连线图如下:
A0~A12
(2)8K *8位存储芯片地址长度为13,32KB 存储器需要4个8K *8位存储芯片故总共需要15根地址总线,地址译码为:
其连线图如下:
A0~A12
(3)4K *8位存储芯片地址长度为12,16KB 存储器需要4个4K *8位存储芯片故总共需要14根地址总线,地址译码为:
其连线图如下:
方案一:
A15
A14
注:Q1、Q2、Q3、Q4要有有效输出,则须C口输入为0,此时须确保为0时C口输入为0,则A14、A15信号线之后须用一个或门。
方案二:
A12
注:Q0、Q1、Q2、Q3分别对应A15、A14、A13分别取000、001、010、011时的值,可通过A12进行选择,上图有错(不对应答案中的地址);上图的地址应该是:第一片0000(A15、A14、A13、A12),第二片0011(A15、A14、A13、A12),第三片0100(A15、A14、A13、A12),第四片0111(A15、A14、A13、A12);正确的连法应该是第一、二片均从Q0接,而不是分别接Q0、Q1;第三、四片均接Q1,而不是分别接Q2、Q3。若上图
中片选CS低电平有效,则应该采用或门(地址会产生变动)。
5.13试为某8位计算机系统设计一个具有8KB ROM和40KB RAM的存储器。要求ROM用EPROM芯片2732组成,从0000H地址开始;RAM用S RAM芯片6264组成,从4000H地址开始。
查阅资料可知,2732容量为4K×8(字选线12根),6264容量为8K×8(字选线13根),因此本系统中所需芯片数目及各芯片地址范围应如下表所示:
硬件连线方式之一如下图所示:
说明:
①8位微机系统地址线一般为16位。采用全译码方式时,系统的A 0~A 12直接与6264的13根地址线相连,系统的A 0~A 11直接与2732的12根地址线相连。片选信号由74LS138译码器产生,系统的A 15~A 13作为译码器的输入。
②各芯片的数据总线(D 0~D 7)直接与系统的数据总线相连。 ③各芯片的控制信号线(RD 、WR )直接与系统的控制信号线相连。
5.15试完成下面的RAM 系统扩充图。假设系统已占用0000~ 27FFH 段内存地址空间,并拟将后面的连续地址空间分配给该扩充RAM 。
A11
A12 A13 A14 A15
下面方案的问题:
1.地址不连续,驱动设计可能会比较麻烦;
2.地址重复,浪费系统地址空间;
3.不容易理解,实际上使用可能会有问题;
5.16某计算机系统的存储器地址空间为A8000H~CFFFFH,若采用单片容量为16K*1位的SRAM芯片,
(1)系统存储容量为多少?
(2)组成该存储系统共需该类芯片多少个?
(3)整个系统应分为多少个芯片组?
(1)该计算机系统的存储器地址空间为A8000H~CFFFFH,系统存储容量为:
(D0000H-A8000H)8bit=28000H*8bit=160KB
(2)单片容量为16K*1为的SRAM芯片的存储容量为16Kbit=2KB
组成该存储系统共需该类芯片160KB/2KB=80个
(3)题目未给出该系统的数据位宽为多少,此处设为8bit位宽
则每组芯片组需要8个单片容量为16K*1为的SRAM芯片
所有整个系统应分为80/8=10个芯片组。