计算机组成原理第8讲主存储器
计算机组成原理存储器（1）（1）
计算机组成原理存储器（1）（1）1.存储器⼀、单选题（题数 54，共7 ）1在下述存储器中，允许随机访问的存储器是（）。
（1.2分）A、磁带 B 、磁盘 C 、磁⿎ D 、半导体存储器正确答案 D2若存储周期250ns，每次读出16位，则该存储器的数据传送率为（）。
（1.2分）A、4×10^6字节/秒B、4M字节/秒C、8×10^6字节/秒D、8M字节/秒正确答案 C3下列有关RAM和ROM得叙述中正确的是()。
IRAM是易失性存储器，ROM是⾮易失性存储器IIRAM和ROM都是采⽤随机存取⽅式进⾏信息访问IIIRAM和ROM都可⽤做CacheIVRAM和ROM都需要进⾏刷新（1.2分）A、仅I和IIB、仅I和IIIC、仅I，II，IIID、仅II，III，IV正确答案 A4静态RAM利⽤（）。
（1.2分）A、电容存储信息B、触发器存储信息C、门电路存储信息D、读电流存储信息正确答案 B5关于计算机中存储容量单位的叙述，其中错误的是（）。
（1.2分）A、最⼩的计量单位为位（bit），表⽰⼀位“0”或“1”B、最基本的计量单位是字节（Byte），⼀个字节等于8bC、⼀台计算机的编址单位、指令字长和数据字长都⼀样，且是字节的整数倍D、主存容量为1KB，其含义是主存中能存放1024个字节的⼆进制信息正确答案 C6若CPU的地址线为16根，则能够直接访问的存储区最⼤容量为（）。
（1.2分）A、1MB、640KC、64KD、384K正确答案 C7由2K×4的芯⽚组成容量为4KB的存储器需要()⽚这样的存储芯⽚。
（1.2分）A、2B、4C、8D、16正确答案 B8下⾯什么存储器是⽬前已被淘汰的存储器。
（1.2分）A、半导体存储器B、磁表⾯存储器C、磁芯存储器D、光盘存储器正确答案 C9下列⼏种存储器中，（）是易失性存储器。
（1.2分）A、cacheB、EPROMC、FlashMemoryD 、 C D-ROM正确答案 A10下⾯关于半导体存储器组织叙述中，错误的是什么。
计算机组成原理课件
计算机组成原理课件
计算机组成原理课件通常包括以下几个部分：1.计算机系统概述
计算机的发展历史
计算机的基本组成
计算机的工作原理
2.数据表示与运算
二进制数系统
数据的表示方法：原码、反码、补码
基本运算：加法、减法、乘法、除法、逻辑运算3.计算机硬件组成
中央处理器(CPU)
指令系统
控制器
运算器
存储器
内存
外存
输入/输出设备
输入设备
输出设备
4.计算机指令系统
指令格式
指令分类：数据传输指令、算术运算指令、逻辑运算指令、控制转移指令等
指令执行过程
5.存储系统
存储器层次结构
高速缓冲存储器（CaChe）
主存储器（内存）
辅助存储器（外存）
虚拟存储器
6.I/O系统
I/O设备的分类
I/O接口与总线
I/O控制方式：轮询、中断、直接内存访问（DMA）等
I/O设备管理
7.计算机性能评价与优化
计算机性能指标
影响计算机性能的因素
计算机性能优化方法
8.计算机体系结构
冯•诺依曼体系结构
哈佛体系结构
VonNeumann和Harvard体系结构的比较与优缺点9.多处理器系统与并行计算
多处理器系统的基本概念
多处理器系统的分类与特点
并行计算的基本概念与技术
多处理器与并行计算的应用实例。
计算机组成原理第8章习题指导
第8章CPU的结构和功能例8.1假设指令流水线分取指（IF）、译码（ID）、执行（EX）、回写（WR）四个过程段，共有10条指令连续输入此流水线。
（1）画出指令周期流程。
（2）画出非流水线时空图。
（3）画出流水线时空图。
（4）假设时钟周期为100ns，求流水线的实际吞吐率。
（5）求该流水处理器的加速比。
解:（1）根据指令周期包括IF、ID、EX、WR四个子过程，图8.1（a）为指令周期流程图。
（2）非流水线时空图如图8.1（b）所示。
假设一个时间单位为一个时钟周期，则每隔4个时钟周期才有一个输出结果。
（3）流水线时空图如图8.1（c）所示。
由图可见，第一条指令出结果需要4个时钟周期。
当流水线满载时，以后每一个时钟周期可以出一个结果，即执行完一条指令。
(a)指令周期流程(b) 非流水线时空图(c) 标准流水线时空图图8.1 例8.1答图（4）由图8.1（c）所示的10条指令进入流水线的时空图可见，在13个时钟周期结束时，CPU执行完10条指令，故实际吞吐率为：10/(100ns×13) ≈ 0.77×107条指令/秒（5）在流水处理器中，当任务饱满时，指令不断输入流水线，不论是几级流水线，每隔一个时钟周期都输出一个结果。
对于本题四级流水线而言，处理10条指令所需的时钟周期数为T4 = 4 +（10 −1）= 13。
而非流水线处理10条指令需4×10 = 40个时钟周期。
故该流水处理器的加速比为40 ÷13 ≈ 3.08 例8.2设某机有四个中断源1、2、3、4，其硬件排队优先次序按1→2→3→4降序排列，各中断源的服务程序中所对应的屏蔽字如表8.1所示。
表8.1 例8.2各中断源对应的屏蔽字中断源 屏蔽字1 2 3 41 1 1 0 12 0 1 0 03 1 1 1 14 0 1 0 1（1）给出上述四个中断源的中断处理次序。
（2）若四个中断源同时有中断请求，画出CPU执行程序的轨迹。
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IC
计算机组成原理
2.运算速度
CPU执行时间：是指CPU计算某个任务所花费的 时间，不包括I/O访问时的等待时间等。
CPU执行时间=CPU时钟周期总数×时钟周期 =指令条数×CPI ×时钟周期
从上面的公式可以看出CPU的性能与计算机 体系的关系: ⑴时钟频率反映了计算机的实现技术和生产工艺. ⑵CPI反映了计算机的实现技术和指令集结构. ⑶IC反映了计算机指令系统的设计和编译技术.
lw $15, 0($2) lw $16, 4($2) sw $16, 0($2) sw $15, 4($2)
1000 1100 0100 1111 0000 0000 0000 0000 1000 1100 0101 0000 0000 0000 0000 0100 1010 1100 0101 0000 0000 0000 0000 0000 1010 1100 0100 1111 0000 0000 0000 0100
序→机器语言目标程序。 2.编译程序(Complier)：高级语言源程序
→汇编/机器语言目标程序 3.解释程序(Interpreter )：将高级语言
语句逐条翻译成机器指令并立即执行,不 生成目标文件。
计算机组成原理
2. 计算机的解题过程
计算机组成原理
软 件
硬 件
temp = v[k]; v[k] = v[k+1]; v[k+1] = temp;
2.运算速度
时钟周期:又称为节拍周期或T周期,是时钟频率的 倒数。是处理器操作最基本的时间单位。例如，主 频为1GHz的CPU的时钟周期为1ns。
CPI：表示执行每条指令所需要的平均时钟周期数。
CPI=一个程序的CPU时钟周期数÷程序指令数量
计算机组成原理
《计算机组成原理》主干课程考试考前辅导一、题型和分值选择题5*3=15填空题5*3=15计算题3*10=30问答题3*9=27综合分析题1*13=13二、考点和典型例题（蓝色为小题考点，绿色为大题考点）第1讲：计算机系统概论•计算机的分类•计算机的性能指标•计算机的硬件p6-11冯•诺依曼型计算机主要由哪几个功能部件组成？简述它们的主要功能。
答：冯•诺依曼型计算机的硬件主要有：1）运算器，主要功能是进行加、减、乘、除等算术运算，除此之外，还可以进行逻辑运算，因此通常称为ALU （算术逻辑运算部件）；2）存储器，其功能是存储程序和数据信息；3）控制器，向计算机各部件发出控制信息的部件，其功能：控制指令的读出、解释和执行、中断事件的处理等；4）输入/输出(I/O)设备，其功能是输入程序和有关的数据，输出计算机的有关信息及运算结果等；5）适配器：其作用相当于一个转换器，它可以保证外围设备用计算机系统特性所要求的形式发送或接收信息。
•计算机系统的层次结构p13-14计算机系统是一个由硬件、软件组成的多级层次结构，由下至上各层级分别是：微程序设计级、一般机器级、操作系统级、汇编语言级、高级语言级。
•软件与硬件的逻辑等价性p14随着大规模集成电路技术的发展和软件硬化的趋势，计算机系统的软、硬件界限已经变得模糊了。
任何操作可以由软件来实现，也可以由硬件来实现；任何指令的执行可以由硬件完成，也可以由软件来完成。
这就叫“软件与硬件的逻辑等价性”。
例如原来通过编制程序实现的整数乘除法指令，现在改为直接由硬件完成。
第2讲：数据与文字的表示方法•数据格式p16-19 (不要求IEEE754标准的浮点数格式)•数的机器码表示p19-22•不同机器码之间的转换•用8位（含符号位）机器码表示整数，能表示的最大正整数和最小负整数分别原、反-127~+127 ；补、移-128~+127 •浮点数规格化p17•若浮点数据格式中阶码的基数已确定，且尾数采用规格化表示法，则浮点数表示数的范围取决于浮点数阶码的位数，而精度则取决于尾数的位数。
计算机组成原理第4章主存储器(00001)资料讲解
CS
WE
DOUT
片选读时间 taCS
CPU必须在这段时 间内取走数据
片禁止到输出的传 输延迟tPLH CS→DOUT
15
1. 静态存储器（SRAM）（6）
(2) 开关特性
写周期时序 地址对写允许WE的保持时间 th Adr
地址对写允许WE的建立时间 tsu
Adr
Adr
CS
WE
最小写允许宽度tWWE
保持1，0 的双稳态 电路
存储单元
9
1. 静态存储器（SRAM）
MOS管是金属(Metal)—氧化物(Oxid)—半导体(Semiconductor) 场效应晶体管，或者称S管有三个极：源极S（Source）、漏极D（Drian）和栅极G（Gate）.
器
控制电路
0 … 31
读/写电路 Y地址译码
CS WE DIN H ×× LLL LLH L H×
DOUT H H H DOUT
操作方式
未选 写“0” 写“1”
读
WE CS
A5 … A9
14
1. 静态存储器（SRAM）（5）
(2) 开关特性
读周期时序
Adr
地址对片选的建立时间 tsu Adr→CS
27
4.6 非易失性半导体存储器（4）
3．可擦可编程序的只读存储器（EPROM） 为了能修改ROM中的内容，出现了EPROM。其原理：
VPP(+12V)
控制栅 浮置栅
5～7V
源n+
漏n+
P型基片
28
4.6 非易失性半导体存储器（5）
3．可擦可编程序的只读存储器（EPROM） 存储1，0的原理：
计算机组成原理——主存储器考研题
计算机组成原理——主存储器考研题（2009）14.某计算机的Cache共有16块，采⽤2路组相联映射⽅式（即每组2块）。
每个主存块⼤⼩为32字节，按字节编制。
主存129号单元所在主存块应装⼊到的Cache组号是A.0B. 2C. 4D.6答案：C考点：Cache组相联映射⽅式主存按字节变址，第129号单元代表第129个字节。
主存129单元，所在的块号为129/32=4(从0开始编号)；由于Cache共有16块，采⽤2路组相联，因此共有8组，0，1，2， (7)主存的某⼀字块按模8映像到Cache某组的任⼀字块中，即主存的第0，8，16…字块可以映像到Cache第0组2个字块的任⼀字块中，⽽129号单元是位于第4块主存块中，因此将映射到Cache第4组2个字块的任⼀字块中。
21.假设某计算机的存储系统由 Cache 和主存组成，某程序执⾏过程中访存 1000 次，其中访问 Cache 缺失（未命中）50 次，则 Cache 的命中率是A 5% B.9.5%C. 50%D.95%答案：D考点：Cache命中率的计算（2010）17.下列命令组合情况，⼀次访存过程中，不可能发⽣的是( )A.TLB未命中，Cache未命中，Page未命中B.TLB未命中，Cache命中，Page命中C.TLB命中，Cache未命中，Page命中D.TLB命中，Cache命中，Page未命中答案：D考点：TLB，Cache，Page的含义。
TLB即为快表，快表只是慢表(Page)的⼩⼩副本，因此TLB命中，必然Page也命中，⽽当Page命中，TLB则未必命中，故D不可能发⽣；⽽Cache的命中与否与TLB、Page的命中与否并⽆必然联系。
（2012）17．假设某计算机按字编址，Cache 有 4 个⾏，Cache 和主存之间交换的块为 1 个字。
若 Cache 的内容初始为空，采⽤ 2 路组相联映射⽅式和 LRU 替换算法。
计算机组成原理——主存储器4
主存储器
4.1 主存储器的全机中心地位 主存与CPU 主存与I/O设备 主存与多处理机
存储器分类
1. 按存储介质分类
(1) 半导体存储器 (2) 磁表面存储器 (3) 磁芯存储器 (4) 光盘存储器 TTL 、MOS 磁头、 磁头、载磁体 硬磁材料、 硬磁材料、环状元件 激光、 激光、磁光材料
4.6
非易失型半导体存储器（ROM） 非易失型半导体存储器（ROM）
存储器名 ROM PROM EPROM 功能 只读不能写 一次性写入 可多次写入、读出 存储原理 以元件有无表 示0、1 以熔丝接通、 断开表示0、1 写:以漏源极间 有无导电沟道 存储0、1 擦:紫外线使浮 置栅电荷泄漏 写：同EPROM 擦：电擦除 写：同EPROM 擦：电一次性 整体或分区擦 除（幻灯） 存储单元元件 二极管或晶体 管 熔丝 幻灯上所示的 管子
3. 按在计算机中的作用分类
RAM 静态 RAM 动态 RAM MROM PROM EPROM EEPROM
主存储器
ROM
存 储 器
Flash Memory
高速缓冲存储器（ 高速缓冲存储器（Cache） ） 辅助存储器 磁盘 磁带 光盘
二、存储器的层次结构
1. 存储器三个主要特性的关系
／ 速度 容量 价格 位 CPU 寄存器 存 主存 CPU 机 主 快 小 高
举例 画出用16K*8位的芯片组成64K*8 16K*8位的芯片组成64K*8位存储器的连接图 画出用16K*8位的芯片组成64K*8位存储器的连接图
A15 A14 A13 A0 WE
译 码 器
CS R/W
CS R/W
CS R/W
CS R/W D0-D7
字扩展的几点结论
计算机组成原理- 第八讲
tc
127
3872 个周期 （1936 s）
128 个周期 （64 s）
刷新序号
刷新时间间隔 （ 2 m s）
“死区” 为 “死时间率” 为
0.5 s ×128 = 64 s 128/4 000 ×100% = 3.2%
② 分散刷新（存取周期为1 s ）
以 128 ×128 矩阵为例
W/R REF 0 W/R W/R REF 126 W/R REF 127 W/R W/R
0
1
1
C2= 3
C4= 5
7=0
7=0
∴ 0011 的汉明码为 1000011
3. 汉明码的纠错过程
4.2
形成新的检测位 Pi ， 其位数与增添的检测位有关，
如增添 3 位 （k = 3）， 新的检测位为 P4 P2 P1 。
以 k = 3 为例，Pi 的取值为
P1 = 1
C1 C2
3
3 5
5
6 6
W/R W/R W/R W/R REF 0.5 μs 15.6 μs W/R W/R W/R W/R REF 0.5 μs 15.6 μs
tC
0.5 μs
tC
每行每隔 2 ms 刷新一次
“死区” 为 0.5 s
将刷新安排在指令译码阶段，不会出现 “死区”
3. 动态 RAM 和静态 RAM 的比较
C2
9 21 33 45 57 11 23 35 47 59 （2 （14 （26 （38 (50 (62 3） 15） 27） 39） 51) 63) （6 （18 （30 （42 (54 7） 19） 31） 43） 55) （10 （22 （34 （46 (58 11） 23） 35） 47） 59) （4 14 （28 38 (52 62 5 15） 29 39） 53 63) 6 （20 30 （44 54
计算机专业《计算机组成原理》试卷及参考答案
一、填空题（每个空格1分，40分）1、计算机系统由＿硬件＿系统和＿软件＿系统构成，主机由＿运算器＿与＿控制器＿、存储器、输入输出接口和系统总线构成。
2、计算机系统中的主存储器是用来存放＿程序和数据＿。
计算机系统中的存储器可分为＿主存＿和＿外存＿，必须将指令放在＿主存＿。
3、1MB等于１０２４KB，或者等于２２０字节。
4、将11010.10010112转换成八进制数的结果是32.454 ，转换成十六进制的结果是1a.96H 。
5、二进制数－1011的原码是11011 ，反码是10100 ，补码是10101 。
6、浮点数加法运算的过程分为零检查、对阶、尾数相加、规格化和舍入处理和溢出检查。
7、按存储器的读写功能分，可以把存储器分为ROM 和RAM 两种类型。
8、一片容量为32k×８的SRAM存储器芯片，地址线有１５条，数据线有８条，地址范围从000016到７fffH 。
9、存储器的传输速率是＿每个存储周期传输的字节数＿。
如果t M表示存储周期，W表示存储器字长，则传输率定义为＿W/t M＿＿。
10、层次化的存储器系统一般分为三级：cache 、主存、辅存。
11、层次化存储器结构的设计是依据程序局部性原理。
12、虚拟存储器主要用于解决计算机中主存储器的容量问题。
13、cache 是一种＿高速存储器，是为了解决CPU和主存之间＿速度不匹配而采用的一项重要技术。
它与主存的替换算法有LRU＿、＿LFU＿、＿FIFO＿。
14、指令操作码字段表征指令的＿操作性质＿，而地址码字段指示＿操作数的位置。
15、程序控制方式包括＿程序查询＿方式和＿程序中断＿方式。
16、微指令的格式大体分成两类：垂直型微指令和水平型微指令。
三、应用题（共45分）1、用已知x=0.101001, y=0.111 采用不恢复余数除法求x÷y。
（9分）解：[x]补＝0.101001 [ｙ]补＝0.111 [－ｙ]补＝1.001故得商q＝q0.q1q2q3＝0.101余数r＝(0.00r3r4r5r6)＝0.0001102. 某总线在一个总线周期中并行传送4个字节的数据，假设一个总线周期等于一个总线时钟周期，总线时钟频率为33MHz，则总线带宽是多少? (2)如果一个总线周期中并行传送64位数据，总线时钟频率升为66MHz，则总线带宽是多少?（7％）[解](1)设总线带宽用Dr表示，总线时钟周期用T=1/f表示，一个总线周期传送的数据量用D表示，根据定义可得Dr = D/T = D×1/T = D×f =4B×33×1000000/s=132MB/s(2)64位=8B，Dr= D×f =8B×66×1000000/s=528MB/s3. 设有32片256K×1位的SRAM芯片，问：(1) 采用位扩展方法可构成多大容量的存储器？(2%)(2) 该存储器需要多少字节地址位？(2%) (3) 画出该存储器与CPU连接的结构图，设CPU的接口信号有地址信号、数据信号、控制信号MREQ#和R/W#。
计算机组成原理考点
1.冯·诺依曼型计算机的基本特点是什么？答：采用二进制形式表示数据和指令。
指令由操作码和地址码组成。
•将程序和数据存放在存储器中，使计算机在工作时从存储器取出指令加以执行，自动完成计算任务。
这就是“存储程序”和“程序控制”（简称存储程序控制）的概念。
•指令的执行是顺序的，即一般按照指令在存储器中存放的顺序执行，程序分支由转移指令实现。
计算机由存储器、运算器、控制器、输入设备和输出设备五大基本部件组成，并规定了5部分的基本功能。
冯•诺依曼型计算机的基本特点也可以用“存储程序”和“程序控制”来高度概括。
2.计算机硬件有哪些部件，各部件的作用是什么？答：计算机的硬件系统由有形的电子器件等构成的，它包括运算器、存储器、控制器、输入输出设备及总线系统组成。
而总线分为数据总线、地址总线、控制总线，其结构有单总线结构、双总线结构及多总线结构。
存储器（Memory）是用来存放数据和程序的部件；运算器是对信息进行运算处理的部件；控制器是整个计算机的控制核心。
它的主要功能是读取指令、翻译指令代码、并向计算机各部分发出控制信号，以便执行指令；输入设备能将数据和程序变换成计算机内部所能识别和接受的信息方式，并顺序地把它们送入存储器中；输出设备将计算机处理的结果以人们能接受的或其它机器能接受的形式送出。
1、什么是总线？以总线组成计算机有哪几种组成结构？答：总线（Bus）就是计算机中用于传送信息的公用通道，是为多个部件服务的一组信息传送连接线。
按照总线的连接方式，计算机组成结构可以分为单总线结构、双总线结构和多总线结构等（详细内容见第7章）。
2、什么是硬件、软件和固件？什么是软件和硬件的逻辑等价？在什么意义上软件和硬件是不等价的？答：计算机硬件（Hardware）是指构成计算机的所有实体部件的集合，通常这些部件由电路（电子元件）、机械等物理部件组成。
计算机软件（Software）是指能使计算机工作的程序和程序运行时所需要的数据，以及与这些程序和数据有关的文字说明和图表资料，其中文字说明和图表资料又称为文档。
计算机组成原理
输出Y /OE
二选一 F
F3 F=0000 OVR Cn+4
ALU
S
R Cn
三选一 二选一
Q寄存器
B锁存器 A锁存器 输入D
一组三选一门和 另一组二选一门 用来选择送向 ALU的 S、R输 入端的数据来源 ，包括Q寄存器、 A口、 B口、外 部输入D数据的 8 种不同组合。
B 16个 A A口地址
控制总线
接口
输入设备
输出设备
三. 定点运算器的功能与组成
完成算数与逻辑运算 ALU: 计算出结果及其特征 通用寄存器组: 存放参加运算的数据 和运算结果 (包括标志寄存器) 乘商寄存器: 用于完成硬件乘除法
数据通路(data path)
输出Y /OE
二选一 F
F3 F=0000 OVR Cn+4
输出
Fs
OVR
F1
Z
ALU
C
选通门 选通门
输入 通用寄存器组
选通门
必要完善：
单累加器变多累积器： 两个选通门均变为多路 送0还是送1到ALU处理 接收门送每个累加器。 支持寄存器移位功能： 接收门变为三选一，即 分别接收本位/低位/高 位送来的信息送累加器 与外部部件的入出联系
实现补码加减运算的逻辑电路
送入
Y 它应能接收与送出数据
通用寄存器组 乘商寄存器
选通门
选通门
实现补码加减运算的逻辑电路
输出
Fs
OVR
F1
Z
ALU
C
选通门 选通门
选择完善：
支持硬件乘除运算指令 需要增加一个Q寄存器 该寄存器应能自行移位
送入
Y 应能接收与送出数据。
计算机组成原理包健版答案
1．1 概述数字计算机的发展经过了哪几个代？各代的基本特征是什么？略。
1．2 你学习计算机知识后，准备做哪方面的应用？略。
1．3 试举一个你所熟悉的计算机应用例子。
略。
1．4 计算机通常有哪些分类方法？你比较了解的有哪些类型的计算机？` 。
1．5 计算机硬件系统的主要指标有哪些？答：机器字长、存储容量、运算速度、可配置外设等。
答：计算机硬件系统的主要指标有：机器字长、存储容量、运算速度等。
1．6 什么是机器字长？它对计算机性能有哪些影响？答：指CPU一次能处理的数据位数。
它影响着计算机的运算速度，硬件成本、指令系统功能，数据处理精度等。
1．7 什么是存储容量？什么是主存？什么是辅存？答：存储容量指的是存储器可以存放数据的数量（如字节数）。
它包括主存容量和辅存容量。
主存指的是CPU能够通过地址线直接访问的存储器。
如内存等。
辅存指的是CPU不能直接访问，必须通过I/O接口和地址变换等方法才能访问的存储器，如硬盘，u盘等。
1．8 根据下列题目的描述，找出最匹配的词或短语，每个词或短语只能使用一次。
（1）为个人使用而设计的计算机，通常有图形显示器、键盘和鼠标。
（2）计算机中的核心部件，它执行程序中的指令。
它具有加法、测试和控制其他部件的功能。
（3）计算机的一个组成部分，运行态的程序和相关数据置于其中。
（4）处理器中根据程序的指令指示运算器、存储器和I/O设备做什么的部件。
（5）嵌入在其他设备中的计算机，运行设计好的应用程序实现相应功能。
（6）在一个芯片中集成几十万到上百万个晶体管的工艺。
（7）管理计算机中的资源以便程序在其中运行的程序。
（8）将高级语言翻译成机器语言的程序。
（9）将指令从助记符号的形式翻译成二进制码的程序。
（10）计算机硬件与其底层软件的特定连接纽带。
供选择的词或短语：1、汇编器2、嵌入式系统3、中央处理器（CPU）4、编译器5、操作系统6、控制器7、机器指令8、台式机或个人计算机9、主存储器 10、VLSI答：（1）8，（2）3，（3）9，（4）6，（5）2，（6）10，（7）5，（8）4，（9）1，（10）7计算机系统有哪些部分组成？硬件由哪些构成？答：计算机系统硬件系统和软件系统组成。
计算机组成原理题附答案
计算机组成原理题解指南第一部分：简答题第一章计算机系统概论1．说明计算机系统的层次结构;计算机系统可分为：微程序机器级,一般机器级或称机器语言级,操作系统级,汇编语言级,高级语言级;第四章主存储器1．主存储器的性能指标有哪些含义是什么存储器的性能指标主要是存储容量. 存储时间、存储周期和存储器带宽;在一个存储器中可以容纳的存储单元总数通常称为该存储器的存储容量;存取时间又称存储访问时间,是指从启动一次存储器操作到完成该操作所经历的时间;存储周期是指连续两次独立的存储器操作如连续两次读操作所需间隔的最小时间;存储器带宽是指存储器在单位时间中的数据传输速率;2．DRAM存储器为什么要刷新DRAM存储器采用何种方式刷新有哪几种常用的刷新方式DRAM存储元是通过栅极电容存储电荷来暂存信息;由于存储的信息电荷终究是有泄漏的,电荷数又不能像SRAM存储元那样由电源经负载管来补充,时间一长,信息就会丢失;为此必须设法由外界按一定规律给栅极充电,按需要补给栅极电容的信息电荷,此过程叫“刷新”;DRAM采用读出方式进行刷新;因为读出过程中恢复了存储单元的MOS栅极电容电荷,并保持原单元的内容,所以读出过程就是再生过程;常用的刷新方式由三种：集中式、分散式、异步式;3．什么是闪速存储器它有哪些特点闪速存储器是高密度、非易失性的读/写半导体存储器;从原理上看,它属于ROM型存储器,但是它又可随机改写信息；从功能上看,它又相当于RAM,所以传统ROM与RAM的定义和划分已失去意义;因而它是一种全新的存储器技术;闪速存储器的特点：1固有的非易失性,2廉价的高密度,3可直接执行,4固态性能;4．请说明SRAM的组成结构,与SRAM相比,DRAM在电路组成上有什么不同之处SRAM存储器由存储体、读写电路、地址译码电路、控制电路组成,DRAM还需要有动态刷新电路;第五章指令系统1．在寄存器—寄存器型,寄存器—存储器型和存储器—存储器型三类指令中,哪类指令的执行时间最长哪类指令的执行时间最短为什么寄存器-寄存器型执行速度最快,存储器-存储器型执行速度最慢;因为前者操作数在寄存器中,后者操作数在存储器中,而访问一次存储器所需的时间一般比访问一次寄存器所需时间长;2．一个较完整的指令系统应包括哪几类指令包括：数据传送指令、算术运算指令、逻辑运算指令、程序控制指令、输入输出指令、堆栈指令、字符串指令、特权指令等;3．什么叫指令什么叫指令系统指令就是要计算机执行某种操作的命令一台计算机中所有机器指令的集合,称为这台计算机的指令系统;第六章中央处理部件CPU1．指令和数据均存放在内存中,计算机如何从时间和空间上区分它们是指令还是数据;时间上讲,取指令事件发生在“取指周期”,取数据事件发生在“执行周期”;从空间上讲,从内存读出的指令流流向控制器指令寄存器;从内存读出的数据流流向运算器通用寄存器;2．简述CPU的主要功能;CPU主要有以下四方面的功能：1指令控制程序的顺序控制,称为指令控制;2操作控制 CPU管理并产生由内存取出的每条指令的操作信号,把各种操作信号送往相应部件,从而控制这些部件按指令的要求进行动作;3时间控制对各种操作实施时间上的控制,称为时间控制;4数据加工对数据进行算术运算和逻辑运算处理,完成数据的加工处理;3．举出CPU中6个主要寄存器的名称及功能;CPU有以下寄存器：1指令寄存器IR：用来保存当前正在执行的一条指令;2程序计数器PC：用来确定下一条指令的地址;3地址寄存器AR：用来保存当前CPU所访问的内存单元的地址;4缓冲寄存器DR：<1>作为CPU和内存、外部设备之间信息传送的中转站;<2>补偿CPU和内存、外围设备之间在操作速度上的差别;<3>在单累加器结构的运算器中,缓冲寄存器还可兼作为操作数寄存器;5通用寄存器AC：当运算器的算术逻辑单元ALU执行全部算术和逻辑运算时,为ALU提供一个工作区;6状态条件寄存器：保存由算术指令和逻辑指令运行或测试的结果建立的各种条件码内容;除此之外,还保存中断和系统工作状态等信息,以便使CPU和系统能及时了解机器运行状态和程序运行状态;4．比较水平微指令与垂直微指令的优缺点;1水平型微指令并行操作能力强、效率高、灵活性强,垂直型微指令则较差; 2水平型微指令执行一条指令的时间短,垂直型微指令执行时间长;3由水平型微指令解释指令的微程序,具有微指令字比较长,但微程序短的特点,而垂直型微指令正好相反;4水平型微指令用户难以掌握,而垂直型微指令与指令比较相似,相对来说比较容易掌握5．什么是指令周期什么是机器周期什么是时钟周期三者之间的关系如何指令周期是完成一条指令所需的时间;包括取指令、分析指令和执行指令所需的全部时间;机器周期也称为CPU周期,是指被确定为指令执行过程中的归一化基准时间,通常等于取指时间或访存时间时钟周期是时钟频率的倒数,也可称为节拍脉冲或T周期,是处理操作的最基本单位;一个指令周期由若干个机器周期组成,每个机器周期又由若干个时钟周期组成;6．什么是RISCRISC指令系统的特点是什么RISC是精简指令系统计算机,它有以下特点：1选取使用频率最高的一些简单指令,以及很有用但不复杂的指令;2指令长度固定,指令格式种类少,寻址方式种类少;3只有取数/存数指令访问存储器,其余指令的操作都在寄存器之间进行;4大部分指令在一个机器周期内完成;5CPU中通用寄存器数量相当多;6以硬布线控制为主,不用或少用微指令码控制;7一般用高级语言编程,特别重视编译优化工作,以减少程序执行时间;7．什么是CISCCISC指令系统的特点是什么CISC是复杂指令系统计算机的英文缩写;其特点是：1指令系统复杂庞大,指令数目一般多达2、3百条; 2寻址方式多3指令格式多 4指令字长不固定5可访存指令不加限制 6各种指令使用频率相差很大7各种指令执行时间相差很大 8大多数采用微程序控制器8．什么叫指令什么叫微指令二者有什么关系指令,即指机器指令;每一条指令可以完成一个独立的算术运算或逻辑运算操作;控制部件通过控制线向执行部件发出各种控制命令,通常把这种控制命令叫做微命令,而一组实现一定操作功能的微命令的组合,构成一条微指令;许多条微指令组成的序列构成了微程序,微程序则完成对指令的解释执行;第七章存储系统1．什么是存储保护通常采用什么方法当多个用户共享主存时,为使系统能正常工作,应防止由于一个用户程序出错而破坏其它用户的程序和系统软件,还要防止一个用户程序不合法的访问不是分给它的主存区域;为此,系统提供存储保护;通常采用的方法是：存储区域保护和访问方式保护;第九章输入输出I/O设备1．何谓CRT的显示分辨率、灰度级分辨率是指显示器所能表示的像素个数;像素越密,分辨率越高,图像越清晰;分辨率取决于显像管荧光粉的粒度、荧光屏的尺寸和CRT电子束的聚焦能力;同时刷新存储器要有与显示像素数相对应的存储空间,用来存储每个像素的信息;灰度级是指黑白显示器中所显示的像素点的亮暗差别,在彩色显示器中则表现为颜色的不同;灰度级越多,图像层次越清楚逼真;2．什么是刷新存储器其存储容量与什么因素有关为了不断提供刷新图像的信号,必须把一帧图像信息存储在刷新存储器,也叫视频存储器;其存储容量由图像灰度级决定;分辨率越高,灰度级越多,刷新存储器容量越大;第十章输入输出I/O系统1．外围设备的I/O控制方式分哪几类各具什么特点外围设备的I/O控制方式分类及特点：1程序查询方式：CPU的操作和外围设备的操作能够同步,而且硬件结构比较简单2程序中断方式：一般适用于随机出现的服务,且一旦提出要求应立即进行,节省了CPU的时间,但硬件结构相对复杂一些;3直接内存访问DMA方式：数据传输速度很高,传输速率仅受内存访问时间的限制;需更多硬件,适用于内存和高速外设之间大批交换数据的场合;4通道方式：可以实现对外设的统一管理和外设与内存之间的数据传送,大大提高了CPU的工作效率;5外围处理机方式：通道方式的进一步发展,基本上独立于主机工作,结果更接近一般处理机;2．总线的一次信息传送过程大致分哪几个阶段分五个阶段：请求总线、总线仲裁、寻址目的地址、信息传送、状态返回或错误报告;3．一个计算机系统中的总线,大致分为哪几类一个计算机系统中的总线分为三类：1同一部件如CPU内部连接各寄存器及运算部件之间的总线,称为内部总线;2同一台计算机系统的各部件,如CPU、内存、通道和各类I/O接口间互相连接的总线,称为系统总线;3多台处理机之间互相连接的总线,称为多机系统总线;4．说明总线结构对计算机系统性能的影响;1最大存储容量单总线系统中,最大内存容量必须小于由计算机字长所决定的可能的地址总线;双总线系统中,存储容量不会受到外围设备数量的影响2指令系统双总线系统,必须有专门的I/O指令系统单总线系统,访问内存和I/O使用相同指令3吞吐量总线数量越多,吞吐能力越大5．中断处理过程包括哪些操作步骤中断处理过程如下：1设备提出中断请求2当一条指令执行结束时CPU响应中断3CPU设置“中断屏蔽”标志,不再响应其它中断请求4保存程序断点PC5硬件识别中断源转移到中断服务子程序入口地址6用软件方法保存CPU现场7为设备服务8恢复CPU现场9“中断屏蔽”标志复位,以便接收其它设备中断请求10返回主程序6．画出中断处理过程的流程图;解：图如下：7．中断接口中有哪些标志触发器功能是什么中断接口中有四个标志触发器：1准备就绪的标志RD：一旦设备做好一次数据的接受或发送,便发出一个设备动作完毕信号,使RD标志置“1”;在中断方式中,该标志用作为中断源触发器,简称中断触发器;2允许中断触发器EI：可以用程序指令来置位;EI为“1”时,某设备可以向CPU发出中断请求；EI为“0”时,不能向CPU发出中断请求,这意味着某中断源的中断请求被禁止;设置EI标志的目的,就是通过软件来控制是否允许某设备发出中断请求;3中断请求触发器IR：它暂存中断请求线上由设备发出的中断请求信号;当IR标志为“1”时,表示设备发出了中断请求;4中断屏蔽触发器IM：是CPU是否受理中断或批准中断的标志;IM标志为“0”时,CPU可以受理外界的中断请求,反之,IM标志为“1”时,CPU不受理外界的中断;还有一个称为工作触发器：BS：设备“忙”的标志,表示设备正在工作; 8．CPU响应中断应具备哪些条件1在CPU内部设置的中断允许触发器必须是开放的;2外设有中断请求时,中断请求触发器必须处于“1”状态,保持中断请求信号;3外设接口中断允许触发器必须为“1”,这样才能把外设中断请求送至CPU;4当上述三个条件具备时,CPU在现行指令结束的最后一个状态周期响应中断;9．请说明程序查询方式与中断方式各自的特点;程序查询方式,数据在CPU和外围设备之间的传送完全靠计算机程序控制,优点是硬件结构比较简单,缺点是CPU效率低,中断方式是外围设备用来“主动”通知CPU,准备输入输出的一种方法,它节省了CPU时间,但硬件结构相对复杂一些;10．简要描述外设进行DMA操作的过程及DMA方式的主要优点;1外设发出DMA请求2CPU响应请求,DMA控制器从CPU接管总线的控制3由DMA控制器执行数据传送操作4向CPU报告DMA操作结束5主要优点是数据传送速度快第二部分：其他题型一、选择题：1、完整的计算机系统应包括;A、运算器、存储器、控制器B、外部设备和主机C、主机和实用程序D、配套的硬件设备和软件系统2、计算机系统中的存储器系统是指;A、RAM存储器B、ROM存储器C、主存储器D、主存储器和外存储器3、至今为止,计算机中的所有信息仍以二进制方式表示的理由是;A、节约元件B、运算速度快C、物理器件性能所致D、信息处理方便4、冯·诺依曼机工作方式的基本特点是;A、多指令流单数据流B、按地址访问并顺序执行指令C、堆栈操作D、存储器按内部选择地址5、某寄存器中的值有时是地址,因此只有计算机的才能识别它;A、译码器B、判断程序C、指令D、时序信号6、50年代,为了发挥的效率,提出了技术,从而发展了操作系统,通过它对进行管理和调度;A、计算机,操作系统,计算机B、计算,并行,算法C、硬设备,多道程序,硬软资源D、硬设备,晶体管,计算机7、计算机硬件能直接执行的只有;A、符号语言B、机器语言C、机器语言和汇编语言D、汇编语言8、在机器数中, 的零的表示形式是唯一的;A、原码B、补码C、反码D、原码和反码9、针对8位二进制数,下列说法中正确的是;C、＋1的移码等于－127的反码D、0的补码等于－1的反码10、计算机系统中采用补码运算的目的是为了;A、与手工运算方式保持一致B、提高运算速度C、简化计算机的设计D、提高运算的精度11、某机字长32位,采用定点小数表示,符号位为1位,尾数为31位,则可表示的最大正小数为,最小负小数为;A、＋231－1B、－1－2－32C、＋1-2－31≈+1D、－1－2－31≈－112、某机字长32位,采用定点整数表示,符号位为1位,尾数为31位,则可表示的最大正整数为,最小负整数为;A、+231-1B、-1-2-32C、+230-1D、-231-113、用n＋1位字长其中1位符号位表示定点整数时,所能表示的数值范围是;A、0≤|N|≤2n+1-1B、0≤|N|≤2n-1C、0≤|N|≤2n-1-114、用n＋1位字长其中1位符号位表示定点小数时,所能表示的数值范围是;A、0≤|N|≤1-2－n+1B、0≤|N|≤1-2-nC、0≤|N|≤1-2-n+115、定点8位字长的字,采用2的的补码形式表示8位二进制整数,可表示的数范围为;A、-127～+127B、-2-127～＋2-127C、2-128～2+127D、-128～+12716、IEEE754标准规定的32位浮点数格式中,符号位为1位,阶码为8位,尾数为23位;则它所能表示的最大规格化正数为;A、＋2－223×2+127B、＋1－223×2+127C、＋2－223×2+255D、2＋127－22317、IEEE754标准规定的64位浮点数格式中,符号位为1位,阶码为11位,尾数为52位;则它所能表示的最小规格负数为;A、－2－252×2-1023B、－2－2－52×2+1023C、－1×2－1024D、－1－252×2＋204718、假定下列字符码中有奇偶校验位,但没有数据错误,采用偶校验的码是;19、若某数x的真值为－,在计算机中该数表示为,则该数所用的编码方法是码;A、原B、补C、反D、移20、长度相同但格式不同的2种浮点数,假设前者阶码长、尾数短,后者阶码短、尾数长,其他规定均相同,则它们可表示的数的范围和精度为;A、两者可表示的数的范围和精度相同B、前者可表示的数的范围大但精度低C、后者可表示的数的范围大且精度高D、前者可表示的数的范围大且精度高21、在浮点数原码运算时,判定结果为规格化数的条件是;A、阶的符号位与尾数的符号位不同B、尾数的符号位与最高数值位相同C、尾数的符号位与最高数值位不同D、尾数的最高数值位为122、若浮点数用补码表示,则判断运算结果是否为规格化数的方法是;A、阶符与数符相同B、阶符与数符相异C、数符与尾数小数点后第1位数字相异D、数符与尾数小数点后第1位数字相同23、运算器虽有许多部件组成,但核心部分是;A、数据总线B、算术逻辑运算单元C、多路开关D、通用寄存器24、在定点二进制运算器中,减法运算一般通过来实现;A、原码运算的二进制减法器B、补码运算的二进制减法器C、补码运算的十进制加法器D、补码运算的二进制加法器25、在定点运算器中,无论采用双符号位还是单符号位,必须有,它一般用来实现;A、译码电路,与非门B、编码电路,或非门C、溢出判断电路,异或门D、移位电路,与或非门26、下列说法中正确的是;A、采用变形补码进行加减法运算可以避免溢出B、只有定点数运算才有可能溢出,浮点数运算不会产生溢出C、只有带符号数的运算才有可能产生溢出D、只有将两个正数相加时才有可能产生溢出27、在定点数运算中产生溢出的原因是;A、运算过程中最高位产生了进位或借位B、参加运算的操作数超出了机器的表示范围C、运算的结果超出了机器的表示范围D、寄存器的位数太少,不得不舍弃最低有效位28、存储器是计算机系统中的记忆设备,它主要用来;A、存放数据B、存放程序C、存放数据和程序D、存放微程序29、存储单元是指;A、存放一个二进制信息位的存储元B、存放一个机器字的所有存储元集合C、存放一个字节的所有存储元集合D、存放两个字节的所有存储元集合30、计算机的存储器采用分级存储体系的主要目的是;A、便于读写数据B、减小机箱的体积C、便于系统升级D、解决存储容量、价格和存取速度之间的矛盾31、存储周期是指;A、存储器的读出时间B、存储器的写入时间C、存储器进行连续读和写操作所允许的最短时间间隔D、存储器进行连续写操作所允许的最短时间间隔32、和外存储器相比,内存储器的特点是;A、容量大,速度快,成本低B、容量大,速度慢,成本高C、容量小,速度快,成本高D、容量小,速度快,成本低33、某计算机字长16位,它的存储容量64KB,若按字编址,那么它的寻址范围是;A、0～64KB、0～32KC、0～64KBD、0～32KB34、某SRAM芯片,其存储容量为64K×16位,该芯片的地址线和数据线数目为;A、64,16B、16,64C、64,8D、16,1635、某DRAM芯片,其存储容量为512K×8位,该芯片的地址线和数据线数目为;A、8,512B、512,8C、18,8D、19,836、某机字长32位,存储容量1MB,若按字编址,它的寻址范围是;A、0～1MB、0～512KBC、0～256KD、0～256KB37、某计算机字长32位,其存储容量为4MB,若按字编址,它的寻址范围是;A、0～1MB、0～4MBC、0～4MD、0～1MB38、某计算机字长32位,其存储容量为4MB,若按半字编址,它的寻址范围是;A、0～4MBB、0～2MBC、0～2MD、0～1MB39、某计算机字长为为32位,其存储容量为16MB,若按双字编址,它的寻址范围是;A、0～16MBB、0～8MC、0～8MBD、0～16MB40、某SRAM芯片,其容量为512×8位,加上电源端和接地端,该芯片引出线的最小数目应为;A、23B、25C、50D、1941、相联存储器是按进行寻址的存储器;A、地址指定方式B、堆栈存取方式C、内容指定方式D、地址指定与堆栈存取方式结合42、主存储器和CPU之间增加cache的目的是;A、解决CPU和主存之间的速度匹配问题B、扩大主存储器的容量C、扩大CPU中通用寄存器的数量D、既扩大主存容量又扩大CPU通用寄存器数量43、采用虚拟存储器的主要目的是;A、提高主存储器的存取速度B、扩大主存储器的存储空间,并能进行自动管理和调度C、提高外存储器的存取速度D、扩大外存储器的存储空间44、在虚拟存储器中,当程序在执行时, 完成地址映射;A、程序员B、编译器C、装入程序D、操作系统45、下列说法中不正确的是;A、每个程序的虚地址空间可以大于实地址空间,也可以小于实地址空间B、多级存储体系由cache、主存和虚拟存储器构成C、cache和虚拟存储器这两种存储器管理策略都利用了程序的局部性原理D、当cache未命中时,CPU可以直接访问主存,而外存与CPU之间则没有直接通路46、虚拟段页式存储管理方案的特点为;A、空间浪费大、存储共享不易、存储保护容易、不能动态连接B、空间浪费小、存储共享容易、存储保护不易、不能动态连接C、空间浪费大、存储共享不易、存储保护容易、能动态连接D、空间浪费小、存储共享容易、存储保护容易、能动态连接47、在cache的地址映射中,若主存中的任意一块均可映射到cache内的任意一块的位置上,则这种方法称为;A、全相联映射B、直接映射C、组相联映射D、混合映射48、指令系统中采用不同寻址方式的目的主要是;A、实现存储程序和程序控制B、缩短指令长度,扩大寻址空间,提高编程灵活性C、可以直接访问外存D、提供扩展操作码的可能并降低指令译码难度49、单地址指令中为了完成两个数的算术运算,除地址码指明的一个操作数外,另一数常需采用;A、堆栈寻址方式B、立即寻址方式C、隐含寻址方式D、间接寻址方式50、对某个寄存器中操作数的寻址方式称为寻址;A、直接B、间接C、寄存器D、寄存器间接51、寄存器间接寻址方式中,操作数处在;A、通用寄存器B、主存单元C、程序计数器D、堆栈52、变址寻址方式中,操作数的有效地址等于;A、基值寄存器内容加上形式地址位移量B、堆栈指示器内容加上形式地址C、变址寄存器内容加上形式地址D、程序计数器内容加上形式地址53、堆栈寻址方式中,设A为累加器,SP为堆栈指示器,Msp为SP指示的栈顶单元,如果进栈操作的动作是：A→Msp,SP－1→SP,那么出栈操作的动作应为;A、Msp→A,SP+1→SPB、SP+1→SP,Msp→AC、SP－1→SP,Msp→AD、Msp→A,SP－1→SP54、程序控制类指令的功能是;A、进行算术运算和逻辑运算B、进行主存与CPU之间的数据传送C、进行CPU和I/O设备之间的数据传送D、改变程序执行的顺序55、运算型指令的寻址与转移性指令的寻址不同点在于;A、前者取操作数,后者决定程序转移地址B、后者取操作数,前者决定程序转移地址C、前者是短指令,后者是长指令D、前者是长指令,后者是短指令56、指令的寻址方式有顺序和跳跃两种方式;采用跳跃寻址方式,可以实现;A、堆栈寻址B、程序的条件转移C、程序的无条件转移D、程序的条件转移或无条件转移57、下列几项中,不符合RISC指令系统的特点是;A、指令长度固定,指令种类少B、寻址方式种类尽量减少,指令功能尽可能强C、增加寄存器的数目,以尽量减少访存次数D、选取使用频率最高的一些简单指令,以及很有用但不复杂的指令58、中央处理器是指;A、运算器B、控制器C、运算器和控制器D、运算器,控制器和主存储器59、在CPU中跟踪指令后继地址的寄存器是;A、主存地址寄存器B、程序计数器C、指令寄存器D、状态条件寄存器60、操作控制器的功能是;A、产生时序信号B、从主存取出一条指令C、完成指令操作码译码D、从主存取出指令,完成指令操作码,产生有关的操作控制信号61、指令周期是指;A、CPU从主存取出一条指令的时间B、CPU执行一条指令的时间C、CPU从主存取出一条指令加上执行这条指令的时间D、时钟周期时间62、同步控制是;A、只适用于CPU控制的方式B、只适用于外围设备控制的方式C、由统一时序信号控制的方式D、所有指令执行时间都相同的方式63、请在以下叙述中选出两个正确描述的句子;A、同一个CPU周期中,可以并行执行的微操作叫相容性操作B、同一个CPU周期中,不可以并行执行的微操作叫相容性微操作C、同一个CPU周期中,可以并行执行的微操作叫相斥性微操作D、同一个CPU周期中,不可以并行执行的微操作叫相斥性微操作64、微程序控制器中,机器指令与微指令的关系是;A、每一条机器指令由一个微指令来执行B、每一条机器指令由一段用微指令编成的微程序来解释执行C、一段机器指令组成的程序可由一条微指令来执行D、一条微指令由若干条机器指令组成65、为了确定下一条微指令的地址,通常采用断定方式,其基本思想是;A、用程序计数器PC来产生后继续微指令地址B、用微程序计数器 PC来产生后继微指令地址C、通过微指令控制字段由设计者指定或者由设计者指定的差别字段控制产生后继微指令地址D、通过指令中指定一个专门字段来控制产生后继微指令地址66、下面描述的RISC机器基本概念中正确的句子是;A、RISC机器不一定是流水CPUB、RISC机器一定是流水CPUC、RISC机器有复杂的指令系统D、CPU配备很少的通用寄存器67、描述流水CPU基本概念中正确的句子是;。
计算机组成原理存储器(1)(1)
1.存储器一、单选题（题数 54，共7 ）1在下述存储器中，允许随机访问的存储器是（）。
（1.2分）A、磁带 B 、磁盘 C 、磁鼓 D 、半导体存储器正确答案 D2若存储周期250ns，每次读出16位，则该存储器的数据传送率为（）。
（1.2分）A、4×10^6字节/秒B、4M字节/秒C、8×10^6字节/秒D、8M字节/秒正确答案 C3下列有关RAM和ROM得叙述中正确的是()。
IRAM是易失性存储器，ROM是非易失性存储器IIRAM和ROM都是采用随机存取方式进行信息访问IIIRAM和ROM都可用做CacheIVRAM和ROM都需要进行刷新（1.2分）A、仅I和IIB、仅I和IIIC、仅I，II，IIID、仅II，III，IV正确答案 A4静态RAM利用（）。
（1.2分）A、电容存储信息B、触发器存储信息C、门电路存储信息D、读电流存储信息正确答案 B5关于计算机中存储容量单位的叙述，其中错误的是（）。
（1.2分）A、最小的计量单位为位（bit），表示一位“0”或“1”B、最基本的计量单位是字节（Byte），一个字节等于8bC、一台计算机的编址单位、指令字长和数据字长都一样，且是字节的整数倍D、主存容量为1KB，其含义是主存中能存放1024个字节的二进制信息正确答案 C6若CPU的地址线为16根，则能够直接访问的存储区最大容量为（）。
（1.2分）A、1MB、640KC、64KD、384K正确答案 C7由2K×4的芯片组成容量为4KB的存储器需要()片这样的存储芯片。
（1.2分）A、2B、4C、8D、16正确答案 B8下面什么存储器是目前已被淘汰的存储器。
（1.2分）A、半导体存储器B、磁表面存储器C、磁芯存储器D、光盘存储器正确答案 C9下列几种存储器中，（）是易失性存储器。
（1.2分）A、cacheB、EPROMC、FlashMemoryD 、 C D-ROM正确答案 A10下面关于半导体存储器组织叙述中，错误的是什么。
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ROM（PROM，EPROM，E2PROM）芯片：
A0……A10
CS
常见：×8
2K×8 ROM
D0 …… D7
OE
§4.4 存储器的组成与控制
单个存储器芯片的容量往往不能满足需要，用存储器容量的 扩展技术实现所要求容量的存储器。
（1）位扩展 存储器芯片的位数K小于所设计的存储器的位数N。
用L字×K位的存储器芯片构成L字×N位的存储器， 存储器芯片数 = N/K
R /W A0…A8 R /W CS
A0
A0…A8 R /W CS A0…A8 R /W CS A0…A8 R /W CS
…
…
…
A8 A9 A10
A器0 2 Y 0
-
A1 4 Y 1
译 码
Y2
S
Y3
由片选线区分每个芯片的地址范围
（3）字位扩展
用L字×K位的存储器芯片构成M×N的存储器，需要 （M/L）×（N/K）个存储器芯片。 片选信号CS 由高位地址译码产生。 低位地址直接与存储器芯片的地址线连接。
由系统规定
Bm是存储器被连续访问时可以提供的数据传输率（bit/s）
Bm= W/Tm 当总线宽度w与存储器字长W不一致时，Bm= w / Tm
提高主存带宽的措施：
缩短存取周期，增加存储字长W，增加存储体。
主存储器的基本操作
处理器
R/W
地址寄存器AR 数据寄存器DR
主存储器
地址总线 数据总线 控制总线
例1：用64K×4的RAM芯片构成64K×8的存储器。
D0 … D3 D4 … D7
I/O0 I/O1 I/O2 I/O3
64K×4 RAM
A0……A15 R /W CS
I/O0 I/O1 I/O2 I/O3
64K×4 RAM
A0……A15R /W CS
R /W
A…0 A15
CS
存储器芯片的地址系统一定是既有RAM又有ROM。 ② 如果处理器有 MREQ 等控制线，在产生片选信号时必须用到。 ③ 要连接处理器的全部地址线和数据线。 The main memory is the central storage unit in a computer system.
（1）位扩展
列地址译码 Column Address
A3
A2
地 Y0 址 Y1 译 Y2 码 Y3 器
存储单元00 存储单元01 存储单元10 存储单元11
读三
写态
控输 制出
I/O
CS R /W
存储器芯片外部：（符号，引脚）
SRAM芯片：
A0……A19
CS
常见：×8，×4
1M×4 RAM
I/O0 I/O1 I/O2 I/O3 R /W
例3：用1K×4位的RAM芯片构成2K×8位的RAM
RAM and ROM are connected to a CPU through the data and address buses. The low-order lines in the address bus select the byte within the chips and other lines in the address bus select a particular chip through its chip select inputs. The more chips that are connected, the more external decoders are required for selection among the chips.
主存储器的读写时序
1．存储器读的时序 处理器把要访问的存储单元地址送上地址总线，发存储器读命令
Address
存储器读周期
地址总线AB
CS
Data
数据总线DB
R /W
被选中的存储器芯片对地址译码，打开三态门将选中的单元 内容送上数据总线DB，处理器从DB读入数据。
2．存储器写的时序
处理器把要访问的存储单元地址送上地址总线AB，把要写 的数据送上数据总线DB，发存储器写命令。
（2）字扩展 存储器芯片的字数小于所设计的存储器的要求。 用L字×K位的存储器芯片构成M字×K位的存储器，
存储器芯片数= M/L
存储器容量的扩展
（3）字位扩展 存储器芯片的字数和位数都小于所设计的存储器的要求。
用L字×K位的存储器芯片构成M字×N位的存储器， 需要（M/L）×（N/K）个存储器芯片。
计算机组成原理第8讲 主存储器
2、存取速度
⑴ 存取时间Ta （访问时间， Memory Access Time ） 从启动一次存储器操作到完成该操作所经历的时间。
取决于存储器芯片 ⑵ 存储周期 Tm （读写周期，Memory Cycle Time） 连续启动2次独立的存储器操作所间隔的最小时间。
一般Tm > Ta ⑶ 主存带宽Bm
（2）字扩展
例2：用512×4位的RAM芯片构成2k×4位的存储器。 D3 将各个存储器芯片的地址线、数据线、读写控制线并联
…
D0
I/O0 I/O1 I/O2 I/O3 I/O0 I/O1 I/O2 I/O3 I/O0 I/O1 I/O2 I/O3 I/O0 I/O1 I/O2 I/O3
512×4 RAM 512 ×4 RAM 512 ×4 RAM 512 ×4 RAM
…
…
…
A9
A10 A0 器 2 Y 0
-
A11 A1
4 Y1
译
码 Y2
S
Y3
用1K×4位的RAM芯片构成2K×8位的RAM
（4）与CPU连接
D7
…
D4
D3
…
D0
I/O0 I/O1 I/O2 I/O3 I/O0 I/O1 I/O2 I/O3 I/O0 I/O1 I/O2 I/O3 I/O0 I/O1 I/O2 I/O3
1024×4 RAM
1024×4 RAM
1024×4 RAM
1024×4 RAM
A0…A9 R /W CS
R /W
A0
A0…A9 R /W CS A0…A9 R /W CS A0…A9 R /W CS
Address
CS
Data
存储器写周期
地址总线AB 数据总线DB
R /W
被选中的存储器芯片对地址译码，将DB上的数据写入选中的 存储单元。
半导体存储器芯片
存储器芯片内部：
地址线条数N，
A1
可寻址2N单元
A0
Row Address
4×4 存储矩阵
行 00
A1 地 01 址 10
A0
译 11 码
11 10 01 00