集成触发器功能测试及应用
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（2）图2是防抖动开关电路。图中K是 一乒乓开关，当开关K从A点扳动到B 点时，用示波器观察输出Q的变化；反 之当K再由B点扳动到A点时，观察输 出Q的变化，并记录。 把开关K去掉，用一导线模拟开关从A 点扳动到B点时，由于机械弹性产生多 次反弹，使B点产生抖动脉冲，观察记 录输出Q的变化情况。 该电路可以作为单脉冲发生器，可产 生脉冲的上升沿和下降沿，可作为后 面实验需要的单脉冲触发信号。
八. 思考题
1. 异步时序逻辑电路的缺点是什么？ 2. 如何采用D触发器构成JK触发器？试画出电路图。 3. 试设计一时序脉冲产生电路，要求输出Y0、Y1、Y2、Y3 与输入时钟CP脉冲满足图7 所示的时序关系。 4. 试设计一单脉冲产生电路，要求按下按键开关，输出 脉冲为上升沿；按下按键开关不动，输出脉冲为高电平； 松下按键开关，输出脉冲为下跳沿；松下按键开关，输出 脉冲为低电平。要求该电路防抖动、且有一定的带负载能力。
三.预习要求
1. 了解常用触发器的结构及特点。 2. 掌握触发器的逻辑功能及触发特性。 3. 掌握时序逻辑电路的分析方法。 4．熟悉同步时序逻辑电路和异步时序逻辑 电路的特点。 5. 查阅本实验所用集成触发器的资料并画 出实验电路连接图。
四.基本实验
1. 基本RS触发器功能测试及简单应用
74LS74的触发边沿。
表2
R 0 1 1 1 1 1 S 1 0 1 1 1 1 D × × 0 0 1 1 Qn × × 0 1 0 1 Q n+1
图3
3. 集成JK触发器74LS112组成的计数器测试 74LS112是下降沿触发的双JK触发器，具有置数和清零 功能，其管脚排列如图4 。
图4
六. 创新实验内容
利用集成D触发器74LS74设计一个十进制加法计数
器（同步和异步均可），画出实验电路图，自拟实验步
骤和测试方法。
七.实验报告要求
1. 整理实验数据及表格，说明触发器的逻辑功能 及触发特点并说明防抖动电路的工作原理。 2. 画出示波器观察计数器的输出波形图，说明计 数器输出波形与CP脉冲的关系。 3. 分析同步计数器与异步计数器的工作特点并记 录延迟时间的测试结果。 4. 总结实验过程中遇到的问题及解决问题的方 法。 5. 回答思考题。
（ 1 ）由集成与非门 74LS00 组成的电路如图 1 所示，根据输 入信号R、S的不同的输入状态的变化，测试触发器输出 Q 和 Q 的状态，并填入表1 。
Q Q Q Q
表1
S 1 1 Q Q
R
G1 & & G2 R
1 S1
R (a) 图1
S (b)
注意观察当R、S输入触发信号同时由00变化到11时，输出和 状态变化情况；观察当R、S输入触发信号不同时由00变化到 11时，输出和状态变化情况。体会触发器状态“不定”和 “不变”的含义。
+5V G1 1kΩ 1kΩ S R G2 &
Q
&
Q
A
K
B
74LS00
图2
2. 集成D触发器74LS74逻辑功能测试 双D触发器74LS74的管脚图及符号见图3，将74LS74集
成电路连接好并施加正确的电源电压，找到信号对应的管
脚。图2电路的输出Q作为D触发器的CP脉冲（也可采用其 它的单脉冲源），按表2 测试D触发器的逻辑功能。 （1）测试D触发器的异步置“0”和异步置“1”功能。 （2）将D触发器的置“0”和置“1”端子均接高电平（或悬 空），在输入D端接入不同的电平及设置触发器原状态不 同的值，每输入CP一个单脉冲，测量其触发器的输出状 态，并把所有的测试结果记录表2中，记录D触发器
&
Z
&
F2
Q2
J
F1
Q1
F0
J
Q0
J
1
C
Q2
C
Q1
C
Q0
K
K
K
CP
图5
（2）按图6连接好电路。对该电路完成同图5实验完全 相同的实验内容，记录实验数据并与上述电路进行比较。
&
Z
&
F2
Q2
J
1
Q1
F1
J
1
Biblioteka Baidu
F0
Q0
J
1
CP
C
Q2
C
Q1
C
Q0
K
K
K
图6
五.提高实验内容
设计一可逆计数的异步3位二进制计数器，试采用 74LS112集成JK触发器完成，画出实验电路并测试。
（1）按图5 连接好电路并施加正确的电源电压。计数脉 冲CP端加入频率为10kHz的TTL方波信号，用示波器观 察并记录CP、Q0、Q1、Q2、Z的波形，并比较它们频率 之间的关系。 当CP脉冲的频率提高到1MHz，用示波器观察CP、 Q0、Q1、Q2、Z的波形的变化，测量并记录Q0、Q1、Q2、 Z信号分别对应CP脉冲的延迟时间。
实验7
集成触发器功能测试及应用
一.实验目的
1. 掌握各种触发器的逻辑功能及测试方法。 2. 掌握触发器组成电路的动态测试方法。 3. 了解触发器组成简单同步时序电路和异步 时序电路的特点。 4. 进一步熟悉电子仪器的使用方法。
二.实验仪器及器材
实验仪器：双踪示波器，交流毫伏表，函数 发生器，直流稳压电源，万用表，数字电子 电路实验平台。 实验元器件：74LS74、74LS112、74LS00、 拨动开关等
CP
Y0
Y1
Y2
Y3
图7
八. 思考题
1. 异步时序逻辑电路的缺点是什么？ 2. 如何采用D触发器构成JK触发器？试画出电路图。 3. 试设计一时序脉冲产生电路，要求输出Y0、Y1、Y2、Y3 与输入时钟CP脉冲满足图7 所示的时序关系。 4. 试设计一单脉冲产生电路，要求按下按键开关，输出 脉冲为上升沿；按下按键开关不动，输出脉冲为高电平； 松下按键开关，输出脉冲为下跳沿；松下按键开关，输出 脉冲为低电平。要求该电路防抖动、且有一定的带负载能力。
三.预习要求
1. 了解常用触发器的结构及特点。 2. 掌握触发器的逻辑功能及触发特性。 3. 掌握时序逻辑电路的分析方法。 4．熟悉同步时序逻辑电路和异步时序逻辑 电路的特点。 5. 查阅本实验所用集成触发器的资料并画 出实验电路连接图。
四.基本实验
1. 基本RS触发器功能测试及简单应用
74LS74的触发边沿。
表2
R 0 1 1 1 1 1 S 1 0 1 1 1 1 D × × 0 0 1 1 Qn × × 0 1 0 1 Q n+1
图3
3. 集成JK触发器74LS112组成的计数器测试 74LS112是下降沿触发的双JK触发器，具有置数和清零 功能，其管脚排列如图4 。
图4
六. 创新实验内容
利用集成D触发器74LS74设计一个十进制加法计数
器（同步和异步均可），画出实验电路图，自拟实验步
骤和测试方法。
七.实验报告要求
1. 整理实验数据及表格，说明触发器的逻辑功能 及触发特点并说明防抖动电路的工作原理。 2. 画出示波器观察计数器的输出波形图，说明计 数器输出波形与CP脉冲的关系。 3. 分析同步计数器与异步计数器的工作特点并记 录延迟时间的测试结果。 4. 总结实验过程中遇到的问题及解决问题的方 法。 5. 回答思考题。
（ 1 ）由集成与非门 74LS00 组成的电路如图 1 所示，根据输 入信号R、S的不同的输入状态的变化，测试触发器输出 Q 和 Q 的状态，并填入表1 。
Q Q Q Q
表1
S 1 1 Q Q
R
G1 & & G2 R
1 S1
R (a) 图1
S (b)
注意观察当R、S输入触发信号同时由00变化到11时，输出和 状态变化情况；观察当R、S输入触发信号不同时由00变化到 11时，输出和状态变化情况。体会触发器状态“不定”和 “不变”的含义。
+5V G1 1kΩ 1kΩ S R G2 &
Q
&
Q
A
K
B
74LS00
图2
2. 集成D触发器74LS74逻辑功能测试 双D触发器74LS74的管脚图及符号见图3，将74LS74集
成电路连接好并施加正确的电源电压，找到信号对应的管
脚。图2电路的输出Q作为D触发器的CP脉冲（也可采用其 它的单脉冲源），按表2 测试D触发器的逻辑功能。 （1）测试D触发器的异步置“0”和异步置“1”功能。 （2）将D触发器的置“0”和置“1”端子均接高电平（或悬 空），在输入D端接入不同的电平及设置触发器原状态不 同的值，每输入CP一个单脉冲，测量其触发器的输出状 态，并把所有的测试结果记录表2中，记录D触发器
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Z
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F2
Q2
J
F1
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1
C
Q2
C
Q1
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K
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CP
图5
（2）按图6连接好电路。对该电路完成同图5实验完全 相同的实验内容，记录实验数据并与上述电路进行比较。
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图6
五.提高实验内容
设计一可逆计数的异步3位二进制计数器，试采用 74LS112集成JK触发器完成，画出实验电路并测试。
（1）按图5 连接好电路并施加正确的电源电压。计数脉 冲CP端加入频率为10kHz的TTL方波信号，用示波器观 察并记录CP、Q0、Q1、Q2、Z的波形，并比较它们频率 之间的关系。 当CP脉冲的频率提高到1MHz，用示波器观察CP、 Q0、Q1、Q2、Z的波形的变化，测量并记录Q0、Q1、Q2、 Z信号分别对应CP脉冲的延迟时间。
实验7
集成触发器功能测试及应用
一.实验目的
1. 掌握各种触发器的逻辑功能及测试方法。 2. 掌握触发器组成电路的动态测试方法。 3. 了解触发器组成简单同步时序电路和异步 时序电路的特点。 4. 进一步熟悉电子仪器的使用方法。
二.实验仪器及器材
实验仪器：双踪示波器，交流毫伏表，函数 发生器，直流稳压电源，万用表，数字电子 电路实验平台。 实验元器件：74LS74、74LS112、74LS00、 拨动开关等
CP
Y0
Y1
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图7