数字电子技术随堂练习答案
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答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.答题： A. B. C. D.
1.函数式Y=AB´+A´BD+CD´的对偶式为（）
A．B．
C．D．
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2.运用反演定理写出函数Y=A´D´+A´B´C+AC´D+CD´的反函数Y´为（）。A．
B．
C．
D．
答题： A. B. C. D.（已提交）
3.函数Y(A,B,C)=A´BC+AC´+B´的最小项之和的形式为（）。
A．
C．
D．
答题： A. B. C. D.（已提交）
4.函数转换成与非－与非式为（）。
A．
B．
C．
D．
答题： A. B. C. D.（已提交）
B．F=(( (A+B)'+(A'+B')')') '
C．F= ( (AB)'+(A'B')')'
D．F= ( (A+B)'+(A'+B')')'
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6.某逻辑电路的状态表如图2-1所示，其输入变量为A，B，C，输出为F，则F的逻辑式为（）。A．F=A'B'C+ABC
B．F=A'BC'+ABC
C．F=A'B'C'+ABC
D．F=AB'C'+ABC
图2-1
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7.函数的卡诺图如图2-2所示，其最简“与或”表达式为（）。
图2-2
A．
B．
C．
D．
答题： A. B. C. D.
1.图3-1（a）、（b）、（c）、（d）中74系列TTL门电路的输出状态为低电平的是（）。A．Y1 B．Y2 C．Y3 D．Y4
（a）（b）（c）（d）
图3-1
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2.图3-2（a）、（b）、（c）、（d）中74HC系列CMOS门电路的输出状态为低电平的是（）。A．Y1 B．Y2 C．Y3 D．Y4
（a）（b）（c）（d）
图3-2
答题： A. B. C. D.（已提交）
答题： A. B. C. D.
CMOS与非门多余的输入端在使用时（
答题： A. B. C. D.
答题： A. B. C. D.
TTL电路相比，CMOS电路最突出的优势在于（
答题： A. B. C. D.
答题： A. B. C. D.
CMOS门电路中，三态输出门、OD
答题： A. B. C. D.
门电路中，能实现总线连接方式的门为（
答题： A. B. C. D.
欲使漏极开路的CMOS 门电路实现
答题： A. B. C. D.
答题： A. B. C. D.
12.图3-3中由74系列TTL与非门组成的电路中，门G输出高电平/低电平时流出其输出端的电流分别为（）。已知与非门的输入电流为IIL= -1.6mA，IIH=40uA。
图3-3
A．3IIH、3IIL B．3IIH、6IIL C．6IIH、3IIL D．6IIH、6IIL
答题： A. B. C. D.（已提交）
13.图3-4中由74系列TTL或非门组成的电路中，门G输出高电平/低电平时流出其输出端的电流分别为（）。已知或非门的输入电流为IIL= -1.6mA，IIH=40uA。
图3-4
A．3IIH、3IIL B．6IIH、6IIL C．3IIH、6IIL D．6IIH、3IIL
答题： A. B. C. D.
某集成电路芯片，查手册知其最大输出低电平
答题： A. B. C. D.
1.图4-1中Y的逻辑函数式为（）。
A．
B．
C．
D．
图4-1
答题： A. B. C. D.（已提交）
2.用3线-8线译码器74HC138设计的逻辑电路如图4-2所示，74HC138的功能表如图4-3所示。、则输出Y3、Y2、Y1、Y0的函数式分别为（）。
A．、、
、
B．、、
、
C．、、
、
D．、、
、
图4-2 图4-3
答题： A. B. C. D.（已提交）
3.用8选1数据选择器74LS152设计的逻辑电路如图4-4所示，74LS152的功能表如图4-5所示。则其输出F的函数式为（）。
A.
B．
C.
D．
图4-4 图4-5
答题： A. B. C. D.
答题： A. B. C. D.
答题： A. B. C. D.
答题： A. B. C. D.
4.在时钟脉冲作用下，图5-1所示电路的功能是（）。
图5-1
A. B. C. D.
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5.逻辑电路如图5-2所示，A=“1”时，脉冲来到后D触发器（）。Q¢
图5-2
A．具有计数器功能 B．置“0” C．置“1” D．保持原状态