基于VHDL的频率计设计开题报告

2.通过锁存模块实现对计数器结果的锁存，并将其送入译码模块。
3.通过译码模块实现对计数结果的译码，让其直观地显示于数码管上。
4.通过系统模块编译、仿真实现对各模块功能的整合，实现整个系统的功 能。
基准频率信号
被测信 号
FPGA
频
率
脉 冲 同
测 量
步 检 测
机 运
电 路
算 模
块
BCD
显
码 转
译 码
示 电 路
研究内容
1.比较分析常用频率计的原理和差别，选择适合本设计的设计方法。
2.根据选定的设计方法，依自顶而下的设计方法对频率计进行总体方案的 设计和模块的划分。
3.用VHDL语言对各个模块和顶层电路进行设计。
4.在QuartusII环境下对设计进行测试和仿真。
5.对频率计的附件电路进行设计，完成总体的频率计设计，使其成为一个 完整系统。
6.基于VHDL的频率计的方案研究。
主要研究（设计）方法
本设计通过频率控制模块，将时钟信号clk 两分频后分别取反赋 给锁存使能和计数使能端，这样计数完成后就能实现数据的锁存。当 计数使能和时钟信号同时出现低电平的时候，计数复位信号有效，将 计数器清零，从新开始计数。
1.通过计数器模块实现对输入信号周期的计数。
换
频率计原理框图Байду номын сангаас
论文进度
9月~10月 完成资料收集，对比设计方案 11月~12月 完成系统模块的整体设计，完成初稿的文字整理 1月~2月 进一步完成系统的仿真测试，对系统进行细化修改 3月~4月 完成论文的定稿
谢谢
开题报告
题目：基于VHDL的频率计设计
开题人：周勇 班级：A1121 02 专业：电子信息工程 指导老师：罗静
研究意义及使用价值
数字频率计在电子技术中扮演着一个重要的角色，因此数字频率 计是一种最基本的测量仪器，它被广泛应用于航天、电子、测控等领 域，许多测量方案和测量结果都与频率有着十分密切的关系，因此频 率的测量在电子产品的研究与生产中显得尤为重要。在电子技术中， 频率是最基本的参数之一，频率是周期性信号在单位时间（1S）内的 变化次数。而频率检测也是电子测量领域的最基本也是最重要的测量 之一。频率信号抗干扰能力强、易于传输，可以获得较高的测量精度， 所以测频率方法的研究越来越受到重视。以往的测频仪都是在低频段 利用测周的方法、高频段用测频的方法，其精度往往会随着被测频率 的下降而下降。该设计采用等精度测量方法，解决了这个问题。