8086结构
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8088cpu中biu的总线控制电路与外部交换数据的总线宽度是8位总线控制电路与专用寄存器组之间的数据总线宽度也是8位而eu的内部总线是16位这样对16位数的存储器读写操作要两个读写周期才可以完构
8086微处理器结构 2.1 8086微处理器结构 8086CPU的引脚 的引脚、 2.2 8086CPU的引脚、系统配置及时序 2.3 8086存储器组织 8086存储器组织
例3：判断下列两数相加后标志寄存器中各相关位的值。 ：判断下列两数相加后标志寄存器中各相关位的值。
0 1 0 1 1 0 1 0 0 0 0 1 1 1 0 0 0 1 0 0 0 0 1 1 1 1 0 0 0 1 1
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最高位没有进位 ∴ CF=0； ； 位中1的个数为偶数个 低8位中 的个数为偶数个 ∴ PF=1； 位中 ； 第三位向第四位有进位 ∴ AF=1； ； 运算结果本身≠0 ∴ ZF=0； ； 运算结果本身 运算结果最高位为1 运算结果最高位为 ∴SF=1； ；
16位段地址寄存器： 16位段地址寄存器： 位段地址寄存器 CS-----------代码段寄存器 CS------代码段寄存器 DS-----------数据段寄存器 DS------数据段寄存器 ES-----------附加段寄存器 ES------附加段寄存器 SS-----------堆栈段寄存器 SS------堆栈段寄存器 16位指令指针寄存器IP:存放下一条要执行指令的偏移 16位指令指针寄存器IP:存放下一条要执行指令的偏移 位指令指针寄存器IP: 地址。 地址。 20位物理地址加法器：将16位逻辑地址变换成存储器 20位物理地址加法器 位物理地址加法器： 16位逻辑地址变换成存储器 写所需要的20位物理地址， 20位物理地址 读/写所需要的20位物理地址，实际上完成地址加法操 作。
12.RESET：复位信号 13.INTR：可屏蔽终端请求信号 14.INTA：中断响应信号 15.NMI：不可屏蔽中断请求信号 16.TEST：测试信号 17.HOLD 17.HOLD：总线保持请求信号 18.HLDA：总线保持响应信号 19.CLK：时钟信号 20.Vcc（+5V）,GND(地)
5.标志寄存器PSW 5.标志寄存器PSW 标志寄存器
(1)CF (2)PF (3)AF (4)ZF (5)SF (6)OF
----进位标志位，运算中最高位有进位为1 无进位为0 ----进位标志位，运算中最高位有进位为1，无进位为0 进位标志位 ----奇偶校验位 运算结果低8位有偶数个1 奇偶校验位， 奇数个为0 ----奇偶校验位，运算结果低8位有偶数个1为1，奇数个为0 ----辅助进位标志位，低4位向高4位有进位为1，无进位为0 ----辅助进位标志位， 位向高4位有进位为1 无进位为0 辅助进位标志位 ----全零标志位 运算结果为0 ZF=1； 全零标志位， ----全零标志位，运算结果为0， ZF=1；否则 ZF=0 ----符号标志位 运算结果为负数时为1 否则为0 符号标志位， ----符号标志位，运算结果为负数时为1，否则为0 ----溢出标志位 运算结果溢出为1 否则为0 溢出标志位， ----溢出标志位，运算结果溢出为1，否则为0
运算结果为运算结果为-1DE5H 标志位CF=0,PF=1,AF=0,ZF=0,SF=1,OF=0 标志位CF=0,PF=1,AF=0,ZF=0,SF=1,OF=0 ----单步标志位 (7)TF ----单步标志位 ----中断标志位 (8)IF ----中断标志位 (9)DF ----方向标志位 ----方向标志位
2.指针和变址寄存器: 2.指针和变址寄存器: 指针和变址寄存器 主要指BP,SP,SI,DI寄存器 主要指BP,SP,SI,DI寄存器 BP,SP,SI,DI DS与 SI联用 （1）SS与 BP联用 （2）DS与 SI联用 SS与 BP联用 SP DI ES与DI联用 CS与IP联用 （3）ES与DI联用 （4）CS与IP联用
最高位向前没有进位， 次高位向最高位有进位 ，最高位向前没有进位，∴OF=1⊕ 0=1 ⊕
溢出” “溢出” 的含义 ： 正正相加得负， 正正相加得负， 负负相加得正
例4：判断下列两数相减后标志寄存器中各相关位的值。 ：判断下列两数相减后标志寄存器中各相关位的值。
0 1 0 1 1 0 1 0 0 0 0 1 1 1 0 0 0 1 0 0 0 0 1 1 1 1 0 0 0 1 1
3.段寄存器 3.段寄存器 例子1 代码段寄存器CS存放当前代码段基地址，IP指令 例子1：代码段寄存器CS存放当前代码段基地址，IP指令 CS存放当前代码段基地址 指针寄存器存放了下一条要执行指令的段内偏移地址， 指针寄存器存放了下一条要执行指令的段内偏移地址， 其中CS 3400H，IP＝00C5H。通过组合，形成20 CS＝ 20位存 其中CS＝3400H，IP＝00C5H。通过组合，形成20位存 储单元的寻址地址为340C5H 340C5H。 储单元的寻址地址为340C5H。 34000H + 00C5H --------------340C5H 4.指令指针寄存器 指令指针寄存器IP 4.指令指针寄存器IP IP由BIU自动将其修改 IP由BIU自动将其修改
8086/8088CPU在最大模式中引脚定义 2.2.2 8086/8088CPU在最大模式中引脚定义
8086CPU在最大模式中，24~31引脚功能重新定义。 8086CPU在最大模式中，24~31引脚功能重新定义。 在最大模式中 引脚功能重新定义 总线周期状态信号，三态， 1.S2~S0：总线周期状态信号，三态，输出 2.LOCK：总线封锁信号，三态， 2.LOCK：总线封锁信号，三态，输出 总线请求信号输入/ 3.RQ/GT0、RQ/GT1：总线请求信号输入/允许信号输出 指令队列状态信号，输出， 4.QS1、QS0：指令队列状态信号，输出，高电平有效
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最高位没有借位
∴ CF=0； ；
位中1的个数为奇数个 低8位中 的个数为奇数个 ∴ PF=0； 位中 ； 第三位向第四位没有借位 ∴ AF=0； ； 运算结果本身≠0 运算结果本身 运算结果最高位为0 运算结果最高位为 ∴ ZF=0； ； ∴SF=0； ；
8086CPU的引脚功能 的引脚功能、 2.2 8086CPU的引脚功能、系统配置及时序
2.1.2 8086处理器中的内部寄存器
寄存器的特殊用途: 寄存器的特殊用途:
1. 数据通用寄存器 4个16位数据通用寄存器为AX、BX、CX、DX。它们 16位数据通用寄存器为AX、BX、CX、DX。 位数据通用寄存器为AX 又都可分别作为两个8位寄存器使用，并分高低字节， 又都可分别作为两个8位寄存器使用，并分高低字节，分别 命名为AH BH、CH、DH及AL、BL、CL、DL。 AH、 命名为AH、BH、CH、DH及AL、BL、CL、DL。这4个数 据通用寄存器既可用来存放源操作数， 据通用寄存器既可用来存放源操作数，又可用来存放目标操 作数和运算结果，十分灵活方便。然而， 作数和运算结果，十分灵活方便。然而，为了缩短指令代码 的长度， 8086CPU的某些指令中 的某些指令中， 的长度，在8086CPU的某些指令中，这4个寄存器隐含的 专门用途。故又分别称AX为累加器，BX为基址寄存器 AX为累加器 为基址寄存器， 专门用途。故又分别称AX为累加器，BX为基址寄存器，CX 为计数寄存器，DX为数据寄存器 为数据寄存器。 为计数寄存器，DX为数据寄存器。
由于制造工艺的限制，微处理器结构受以下限制： 由于制造工艺的限制，微处理器结构受以下限制： 引脚数限制 芯片面积限制 器件速度限制 16位微处理器的特点 位微处理器的特点： 16位微处理器的特点： 引脚功能复用 单总线 可控三态电路 总线分时复用 通常8位微机是串行执行的， 16位可并行操作 位可并行操作， 通常8位微机是串行执行的，而16位可并行操作，提出 顺序与流水线重叠的概念。 顺序与流水线重叠的概念。
2.1 8086微处理器结构 8086微处理器结构
2.1.1 8086微处理器的内部结构 8086微处理器的内部结构
1.总线接口部件BIU(Bus 1.总线接口部件BIU(Bus Interface Unit) 总线接口部件 BIU的功能 (1) BIU的功能 BIU提供了16位双向数据总线和20位地址总线 提供了16位双向数据总线和20 (2) BIU提供了16位双向数据总线和20位地址总线 BIU的组成 16位段地址寄存器 (3) BIU的组成 16位段地址寄存器 16位指令指针寄存器 16位指令指针寄存器 20位物理地址加法器 20位物理地址加法器 6字节指令队列 总线控制逻辑 BIU的基本工作原理 （4） BIU的基本工作原理 （*）
三、8086与8088CPU的不同之处 8086与8088CPU的不同之处
8086与8088CPU的主要不同： 8086与8088CPU的主要不同： 的主要不同 (1)结构：8088指令队列是4个字节，8086指令队列是个6个字节。 (1)结构：8088指令队列是4个字节，8086指令队列是个6个字节。 结构 指令队列是 指令队列是个 (2)读写数据周期 8088CPU中 BIU的总线控制电路与外部交换数据 读写数据周期： (2)读写数据周期：8088CPU中，BIU的总线控制电路与外部交换数据 的总线宽度是8 的总线宽度是8位，总线控制电路与专用寄存器组之间的数据总 线宽度也是8 EU的内部总线是16位 这样， 16位数的存 的内部总线是16 线宽度也是8位，而EU的内部总线是16位，这样，对16位数的存 储器读/写操作要两个读写周期才可以完成。 储器读/写操作要两个读写周期才可以完成。 (3)8086有16根数据线 根数据线， 8088对外的数据线只有 对外的数据线只有8 (3)8086有16根数据线，而8088对外的数据线只有8条； 8086的地址 数据复用线是16位的AD15~AD0 的地址/ 16位的AD15~AD0， 8088仅有 仅有AD7~AD0 8086的地址/数据复用线是16位的AD15~AD0，而8088仅有AD7~AD0 复用，A15~A8完全作为地址线使用 完全作为地址线使用。 复用，A15~A8完全作为地址线使用。 (4)控制信号 8088中 控制信号： IO/M信号代替M/IO，IO/M低电平时选通存 信号代替M/IO (4)控制信号：8088中，用IO/M信号代替M/IO，IO/M低电平时选通存 储器，高电平时选通I/O接口。8086用M/IO，RD，WR组合产生存 I/O接口 储器，高电平时选通I/O接口。8086用M/IO，RD，WR组合产生存 储器和I/O接口的读写控制， 8088则用IO/M，DT/R，SS0组合产 I/O接口的读写控制 则用IO/M 储器和I/O接口的读写控制，而8088则用IO/M，DT/R，SS0组合产 生存储器和I/O接口的读写控制以及中断响应。 I/O接口的读写控制以及中断响应 生存储器和I/O接口的读写控制以及中断响应。 8086把1MB的存储空间分成两个512KB，有奇地址和偶地址之分， 的存储空间分成两个512KB （5）8086把1MB的存储空间分成两个512KB，有奇地址和偶地址之分， 分别由BHE A0信号作为芯片选通线 BHE和 信号作为芯片选通线。 8088CPU的1MB存储空间 分别由BHE和A0信号作为芯片选通线。而8088CPU的1MB存储空间 不划分奇偶，引脚也没有BHE信号。A0象A19~A1一样参加地址选 BHE信号 不划分奇偶，引脚也没有BHE信号。A0象A19~A1一样参加地址选 通。
8086CPU包括20条地址线，16条数据线； 8086CPU包括20条地址线 16条数据线 包括20条地址线， 条数据线； 8086/8088CPU可工作在两种模式 最小模式 8086/8088CPU可工作在两种模式 最大模式 最小模式用于单机系统，所需控制信号由8086直接提 最小模式用于单机系统，所需控制信号由8086 8086直接提 供。 最大模式用于多机系统，所需控制信号由总线控制器 最大模式用于多机系统， 8288提供 提供。 8288提供。 24～31脚在两种不同的工作模式中具有不同的功能 24～31脚在两种不同的工作模式中具有不同的功能
最小模式下8086/8088CPU 8086/8088CPU引脚功能 2.2.1 最小模式下8086/8088CPU引脚功能
1. 8086CPU外部引脚图 8086CPU外部引脚图
2.8086CPU的引脚功能 2.8086CPU的引脚功能
16条地址数据总线 1.AD15~ AD0 ：16条地址数据总线 2.A19/S6~A16/S3:地址状态线 3.BHE/S7:高 位数据总线允许/ 3.BHE/S7:高8位数据总线允许/状态信号 4.MN/MX：最小/ 4.MN/MX：最小/大工作模式选择信号 0 5.RD： 5.RD：读选通信号 6.WR： 6.WR：写选通信号 7.M/IO： 存储器或I/O I/O端口控制信号 7.M/IO： 存储器或I/O端口控制信号 8.ALE： 8.ALE：地址锁存允许信号 9.DEN： 9.DEN：数据允许信号 10.DT/R：数据发送接收控制信号 10.DT/R： 11.READY： 11.READY：准备就绪信号
2.指令执行部件EU(Execution 2.指令执行部件EU(Execution Unit) 指令执行部件
指令执行部件的组成：算术逻辑运算单元ALU 指令执行部件的组成：算术逻辑运算单元ALU 标志寄存器PSW 标志寄存器PSW 寄存器 EU控制器 EU控制器
指令执行部件的工作过程（*） 指令执行部件的工作过程（
8086微处理器结构 2.1 8086微处理器结构 8086CPU的引脚 的引脚、 2.2 8086CPU的引脚、系统配置及时序 2.3 8086存储器组织 8086存储器组织
例3：判断下列两数相加后标志寄存器中各相关位的值。 ：判断下列两数相加后标志寄存器中各相关位的值。
0 1 0 1 1 0 1 0 0 0 0 1 1 1 0 0 0 1 0 0 0 0 1 1 1 1 0 0 0 1 1
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最高位没有进位 ∴ CF=0； ； 位中1的个数为偶数个 低8位中 的个数为偶数个 ∴ PF=1； 位中 ； 第三位向第四位有进位 ∴ AF=1； ； 运算结果本身≠0 ∴ ZF=0； ； 运算结果本身 运算结果最高位为1 运算结果最高位为 ∴SF=1； ；
16位段地址寄存器： 16位段地址寄存器： 位段地址寄存器 CS-----------代码段寄存器 CS------代码段寄存器 DS-----------数据段寄存器 DS------数据段寄存器 ES-----------附加段寄存器 ES------附加段寄存器 SS-----------堆栈段寄存器 SS------堆栈段寄存器 16位指令指针寄存器IP:存放下一条要执行指令的偏移 16位指令指针寄存器IP:存放下一条要执行指令的偏移 位指令指针寄存器IP: 地址。 地址。 20位物理地址加法器：将16位逻辑地址变换成存储器 20位物理地址加法器 位物理地址加法器： 16位逻辑地址变换成存储器 写所需要的20位物理地址， 20位物理地址 读/写所需要的20位物理地址，实际上完成地址加法操 作。
12.RESET：复位信号 13.INTR：可屏蔽终端请求信号 14.INTA：中断响应信号 15.NMI：不可屏蔽中断请求信号 16.TEST：测试信号 17.HOLD 17.HOLD：总线保持请求信号 18.HLDA：总线保持响应信号 19.CLK：时钟信号 20.Vcc（+5V）,GND(地)
5.标志寄存器PSW 5.标志寄存器PSW 标志寄存器
(1)CF (2)PF (3)AF (4)ZF (5)SF (6)OF
----进位标志位，运算中最高位有进位为1 无进位为0 ----进位标志位，运算中最高位有进位为1，无进位为0 进位标志位 ----奇偶校验位 运算结果低8位有偶数个1 奇偶校验位， 奇数个为0 ----奇偶校验位，运算结果低8位有偶数个1为1，奇数个为0 ----辅助进位标志位，低4位向高4位有进位为1，无进位为0 ----辅助进位标志位， 位向高4位有进位为1 无进位为0 辅助进位标志位 ----全零标志位 运算结果为0 ZF=1； 全零标志位， ----全零标志位，运算结果为0， ZF=1；否则 ZF=0 ----符号标志位 运算结果为负数时为1 否则为0 符号标志位， ----符号标志位，运算结果为负数时为1，否则为0 ----溢出标志位 运算结果溢出为1 否则为0 溢出标志位， ----溢出标志位，运算结果溢出为1，否则为0
运算结果为运算结果为-1DE5H 标志位CF=0,PF=1,AF=0,ZF=0,SF=1,OF=0 标志位CF=0,PF=1,AF=0,ZF=0,SF=1,OF=0 ----单步标志位 (7)TF ----单步标志位 ----中断标志位 (8)IF ----中断标志位 (9)DF ----方向标志位 ----方向标志位
2.指针和变址寄存器: 2.指针和变址寄存器: 指针和变址寄存器 主要指BP,SP,SI,DI寄存器 主要指BP,SP,SI,DI寄存器 BP,SP,SI,DI DS与 SI联用 （1）SS与 BP联用 （2）DS与 SI联用 SS与 BP联用 SP DI ES与DI联用 CS与IP联用 （3）ES与DI联用 （4）CS与IP联用
最高位向前没有进位， 次高位向最高位有进位 ，最高位向前没有进位，∴OF=1⊕ 0=1 ⊕
溢出” “溢出” 的含义 ： 正正相加得负， 正正相加得负， 负负相加得正
例4：判断下列两数相减后标志寄存器中各相关位的值。 ：判断下列两数相减后标志寄存器中各相关位的值。
0 1 0 1 1 0 1 0 0 0 0 1 1 1 0 0 0 1 0 0 0 0 1 1 1 1 0 0 0 1 1
3.段寄存器 3.段寄存器 例子1 代码段寄存器CS存放当前代码段基地址，IP指令 例子1：代码段寄存器CS存放当前代码段基地址，IP指令 CS存放当前代码段基地址 指针寄存器存放了下一条要执行指令的段内偏移地址， 指针寄存器存放了下一条要执行指令的段内偏移地址， 其中CS 3400H，IP＝00C5H。通过组合，形成20 CS＝ 20位存 其中CS＝3400H，IP＝00C5H。通过组合，形成20位存 储单元的寻址地址为340C5H 340C5H。 储单元的寻址地址为340C5H。 34000H + 00C5H --------------340C5H 4.指令指针寄存器 指令指针寄存器IP 4.指令指针寄存器IP IP由BIU自动将其修改 IP由BIU自动将其修改
8086/8088CPU在最大模式中引脚定义 2.2.2 8086/8088CPU在最大模式中引脚定义
8086CPU在最大模式中，24~31引脚功能重新定义。 8086CPU在最大模式中，24~31引脚功能重新定义。 在最大模式中 引脚功能重新定义 总线周期状态信号，三态， 1.S2~S0：总线周期状态信号，三态，输出 2.LOCK：总线封锁信号，三态， 2.LOCK：总线封锁信号，三态，输出 总线请求信号输入/ 3.RQ/GT0、RQ/GT1：总线请求信号输入/允许信号输出 指令队列状态信号，输出， 4.QS1、QS0：指令队列状态信号，输出，高电平有效
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最高位没有借位
∴ CF=0； ；
位中1的个数为奇数个 低8位中 的个数为奇数个 ∴ PF=0； 位中 ； 第三位向第四位没有借位 ∴ AF=0； ； 运算结果本身≠0 运算结果本身 运算结果最高位为0 运算结果最高位为 ∴ ZF=0； ； ∴SF=0； ；
8086CPU的引脚功能 的引脚功能、 2.2 8086CPU的引脚功能、系统配置及时序
2.1.2 8086处理器中的内部寄存器
寄存器的特殊用途: 寄存器的特殊用途:
1. 数据通用寄存器 4个16位数据通用寄存器为AX、BX、CX、DX。它们 16位数据通用寄存器为AX、BX、CX、DX。 位数据通用寄存器为AX 又都可分别作为两个8位寄存器使用，并分高低字节， 又都可分别作为两个8位寄存器使用，并分高低字节，分别 命名为AH BH、CH、DH及AL、BL、CL、DL。 AH、 命名为AH、BH、CH、DH及AL、BL、CL、DL。这4个数 据通用寄存器既可用来存放源操作数， 据通用寄存器既可用来存放源操作数，又可用来存放目标操 作数和运算结果，十分灵活方便。然而， 作数和运算结果，十分灵活方便。然而，为了缩短指令代码 的长度， 8086CPU的某些指令中 的某些指令中， 的长度，在8086CPU的某些指令中，这4个寄存器隐含的 专门用途。故又分别称AX为累加器，BX为基址寄存器 AX为累加器 为基址寄存器， 专门用途。故又分别称AX为累加器，BX为基址寄存器，CX 为计数寄存器，DX为数据寄存器 为数据寄存器。 为计数寄存器，DX为数据寄存器。
由于制造工艺的限制，微处理器结构受以下限制： 由于制造工艺的限制，微处理器结构受以下限制： 引脚数限制 芯片面积限制 器件速度限制 16位微处理器的特点 位微处理器的特点： 16位微处理器的特点： 引脚功能复用 单总线 可控三态电路 总线分时复用 通常8位微机是串行执行的， 16位可并行操作 位可并行操作， 通常8位微机是串行执行的，而16位可并行操作，提出 顺序与流水线重叠的概念。 顺序与流水线重叠的概念。
2.1 8086微处理器结构 8086微处理器结构
2.1.1 8086微处理器的内部结构 8086微处理器的内部结构
1.总线接口部件BIU(Bus 1.总线接口部件BIU(Bus Interface Unit) 总线接口部件 BIU的功能 (1) BIU的功能 BIU提供了16位双向数据总线和20位地址总线 提供了16位双向数据总线和20 (2) BIU提供了16位双向数据总线和20位地址总线 BIU的组成 16位段地址寄存器 (3) BIU的组成 16位段地址寄存器 16位指令指针寄存器 16位指令指针寄存器 20位物理地址加法器 20位物理地址加法器 6字节指令队列 总线控制逻辑 BIU的基本工作原理 （4） BIU的基本工作原理 （*）
三、8086与8088CPU的不同之处 8086与8088CPU的不同之处
8086与8088CPU的主要不同： 8086与8088CPU的主要不同： 的主要不同 (1)结构：8088指令队列是4个字节，8086指令队列是个6个字节。 (1)结构：8088指令队列是4个字节，8086指令队列是个6个字节。 结构 指令队列是 指令队列是个 (2)读写数据周期 8088CPU中 BIU的总线控制电路与外部交换数据 读写数据周期： (2)读写数据周期：8088CPU中，BIU的总线控制电路与外部交换数据 的总线宽度是8 的总线宽度是8位，总线控制电路与专用寄存器组之间的数据总 线宽度也是8 EU的内部总线是16位 这样， 16位数的存 的内部总线是16 线宽度也是8位，而EU的内部总线是16位，这样，对16位数的存 储器读/写操作要两个读写周期才可以完成。 储器读/写操作要两个读写周期才可以完成。 (3)8086有16根数据线 根数据线， 8088对外的数据线只有 对外的数据线只有8 (3)8086有16根数据线，而8088对外的数据线只有8条； 8086的地址 数据复用线是16位的AD15~AD0 的地址/ 16位的AD15~AD0， 8088仅有 仅有AD7~AD0 8086的地址/数据复用线是16位的AD15~AD0，而8088仅有AD7~AD0 复用，A15~A8完全作为地址线使用 完全作为地址线使用。 复用，A15~A8完全作为地址线使用。 (4)控制信号 8088中 控制信号： IO/M信号代替M/IO，IO/M低电平时选通存 信号代替M/IO (4)控制信号：8088中，用IO/M信号代替M/IO，IO/M低电平时选通存 储器，高电平时选通I/O接口。8086用M/IO，RD，WR组合产生存 I/O接口 储器，高电平时选通I/O接口。8086用M/IO，RD，WR组合产生存 储器和I/O接口的读写控制， 8088则用IO/M，DT/R，SS0组合产 I/O接口的读写控制 则用IO/M 储器和I/O接口的读写控制，而8088则用IO/M，DT/R，SS0组合产 生存储器和I/O接口的读写控制以及中断响应。 I/O接口的读写控制以及中断响应 生存储器和I/O接口的读写控制以及中断响应。 8086把1MB的存储空间分成两个512KB，有奇地址和偶地址之分， 的存储空间分成两个512KB （5）8086把1MB的存储空间分成两个512KB，有奇地址和偶地址之分， 分别由BHE A0信号作为芯片选通线 BHE和 信号作为芯片选通线。 8088CPU的1MB存储空间 分别由BHE和A0信号作为芯片选通线。而8088CPU的1MB存储空间 不划分奇偶，引脚也没有BHE信号。A0象A19~A1一样参加地址选 BHE信号 不划分奇偶，引脚也没有BHE信号。A0象A19~A1一样参加地址选 通。
8086CPU包括20条地址线，16条数据线； 8086CPU包括20条地址线 16条数据线 包括20条地址线， 条数据线； 8086/8088CPU可工作在两种模式 最小模式 8086/8088CPU可工作在两种模式 最大模式 最小模式用于单机系统，所需控制信号由8086直接提 最小模式用于单机系统，所需控制信号由8086 8086直接提 供。 最大模式用于多机系统，所需控制信号由总线控制器 最大模式用于多机系统， 8288提供 提供。 8288提供。 24～31脚在两种不同的工作模式中具有不同的功能 24～31脚在两种不同的工作模式中具有不同的功能
最小模式下8086/8088CPU 8086/8088CPU引脚功能 2.2.1 最小模式下8086/8088CPU引脚功能
1. 8086CPU外部引脚图 8086CPU外部引脚图
2.8086CPU的引脚功能 2.8086CPU的引脚功能
16条地址数据总线 1.AD15~ AD0 ：16条地址数据总线 2.A19/S6~A16/S3:地址状态线 3.BHE/S7:高 位数据总线允许/ 3.BHE/S7:高8位数据总线允许/状态信号 4.MN/MX：最小/ 4.MN/MX：最小/大工作模式选择信号 0 5.RD： 5.RD：读选通信号 6.WR： 6.WR：写选通信号 7.M/IO： 存储器或I/O I/O端口控制信号 7.M/IO： 存储器或I/O端口控制信号 8.ALE： 8.ALE：地址锁存允许信号 9.DEN： 9.DEN：数据允许信号 10.DT/R：数据发送接收控制信号 10.DT/R： 11.READY： 11.READY：准备就绪信号
2.指令执行部件EU(Execution 2.指令执行部件EU(Execution Unit) 指令执行部件
指令执行部件的组成：算术逻辑运算单元ALU 指令执行部件的组成：算术逻辑运算单元ALU 标志寄存器PSW 标志寄存器PSW 寄存器 EU控制器 EU控制器
指令执行部件的工作过程（*） 指令执行部件的工作过程（