02-N进制计数器-课件
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当某计数器为M进制，而M＜N时，求N进制的方法是： 先用2片或2片以上的芯片级联成模为K（K>N）进制的计数器，当模为K 的计数器计数到状态SN-1（同步清零端或置数端归零）或SN（异步清零端 或置数端归零）时，强行使计数器返回到0，再重新开始计数。
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THE END
谢谢观赏
数电课程团队
12
（2）求归零逻辑：CR LD PN 1 P11, P P QnQnQn
N 1
11
31 0
（3）画连线图：
Q0 Q1 Q2 Q3
Q0 Q1 Q2 Q3 &
&
1
1 CTT CTP
CP
74LS163
CO 1
CTT CTP
LD
CP
CR
74LS163
CO LD
1 CR
D0 D1 D2 D3 (a) 用同步清零端 CR 归零
2 用异步清零端或置数端归零构成N进置计数器 3 写出状态SN的二进制代码。 4 求归零逻辑，即求异步清零端或置数控制端信号的逻辑表达式。 5 画连线图。
6
二、N进制计数器的设计
例1 用74LS163来构成一个十二进制计数器。
解：（1）写出状态SN-1的二进制代码：SN-1＝S12-1＝S11＝1011
3
一、集成N进制计数器
基本工作方式
1 二进制计数：将计数脉冲由CP0输入，由Q0输出
2 五进制计数：将计数脉冲由CP1输入，由Q3 、Q2、 Q1 输出
3
8421BCD码十进制计数：将Q0与CP1相连, 计数脉冲CP由CP0输入
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一、集成N进制计数器
74LS290的功能表
R0A R0B S9A S9B CP0 CP1 Q3 Q2 Q1 Q0
（2）求归零逻辑：CR CT / LD PN P12, P P QnQn
N
1
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（3）画连线图：
Q0 Q1 Q2 Q3
Q0 Q1 Q2 Q3
CP1
CP CP0
74LS197
& 1
CT/LD
CR
CP1 CP CP 0
74LS197
&
CT/LD 1
CR
D0 D1 D2 D3 (a) 用异步清零端 CR 归零
1 1 0 × × × 0 000 1 1 × 0 × × 0 000 0 × 1 1 × × 1 001 × 0 × 0 ↓ 0 计数 × 0 0 × 0 ↓ 计数 0 × × 0 ↓ Q0 计数 0 × 0 × Q3 ↓ 计数
功能说明 异步清零 异步清零 异步置9 1位二进制计数 五进制计数 8421BCD码十进制计数 5421BCD码十进制计数
D0 D1 D2 D3 (a) 用异步清零端 CR 归零
D0～D3可随意处理
D0 D1 D2 D3 (b) 用同步置数端 LD 归零
D0～D3必须都接0
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二、N进制计数器的设计 2、计数器为M进制，当M＜N时，求N进制： 例4 用74LS290构成24进制计数器。 解： 一片74LS290最大为十进制，不能直接构成24进制，需要先用2片74LS290
D0～D3可随意处理
D0 D1 D2 D3 (b) 用异步置数端 CT/LD 归零
D0～D3必须都接0
74LS197为16 进制异步加法 计数器，清零、 置数均采用异 步方式
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二、N进制计数器的设计
例3 用74LS161来构成一个十二进制计数器。
解：74LS161为16进制同步加法计数器，清零采用异步方式、置数采用同步方式.
5
二、N进制计数器的设计
1、计数器为M进制，当M>N时，求N进制：
利用集成计数器的清零端和置数端实现归零，从而构成按自然态序 进行计数的N进制计数器。
1 用同步清零端或置数端归零构成N进置计数器 1 写出状态SN-1的二进制制端信号的逻辑表达式。 3 画连线图。
D0～D3可随意处理
D0 D1 D2 D3 (b) 用同步置数端 LD 归零
D0～D3必须都接0
74LS163为16 进制同步加法 计数器，清零、 置数均采用同 步方式
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二、N进制计数器的设计
例2 用74LS197来构成一个十二进制计数器。
解：（1）写出状态SN的二进制代码： SN＝S12＝1100
级联成100进制，再利用归零法，构成24进制。
两片74LS290串行级联构成的二十四进制计数器
10
小结
计数器可利用触发器和门电路构成。但在实际工作中，主要是利用集成 计数器来构成。在用集成计数器构成N进制计数器时，需要利用清零端或置 数控制端，让电路跳过某些状态来获得N进制计数器。
当某计数器为M进制，而M>N时，求N进制的方法是： 当模为M的计数器计数到状态SN-1（同步清零端或置数端归零）或SN（异 步清零端或置数端归零）时，强行使计数器返回到0，再重新开始计数。
用异步清零端CR 归零
用 同 步 置 数 端 LD 归 零
SN＝S12＝1100 CR Q3nQ2n
Q0 Q1 Q2 Q3
SN-1＝S11＝1011 LD Q3nQ1nQ0n
Q0 Q1 Q2 Q3
&
&
1
CTT CTP
74LS161
CO 1
LD
CP
CR
1
CTT CTP
CO 74LS161
LD
CP
1 CR
《脉冲数字电子技术及应用》
长沙航空职业技术学院
1
4-5 N进制计数器
内容提要： 一、集成N进制计数器 二、N进制计数器的设计
2
一、集成N进制计数器
74LS290为二-五-十进制计数器，在74 LS 290内部有四个触发器，第一 个触发器有独立的时钟输入端CP0(下降沿有效)和输出端Q0，构成二进制计 数，其余三个触发器以五进制方式相连，其时钟输入为CP1(下降沿有效)， 输出端为Q1、Q2、Q3。
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（2）求归零逻辑：CR LD PN 1 P11, P P QnQnQn
N 1
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（3）画连线图：
Q0 Q1 Q2 Q3
Q0 Q1 Q2 Q3 &
&
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1 CTT CTP
CP
74LS163
CO 1
CTT CTP
LD
CP
CR
74LS163
CO LD
1 CR
D0 D1 D2 D3 (a) 用同步清零端 CR 归零
2 用异步清零端或置数端归零构成N进置计数器 3 写出状态SN的二进制代码。 4 求归零逻辑，即求异步清零端或置数控制端信号的逻辑表达式。 5 画连线图。
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二、N进制计数器的设计
例1 用74LS163来构成一个十二进制计数器。
解：（1）写出状态SN-1的二进制代码：SN-1＝S12-1＝S11＝1011
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一、集成N进制计数器
基本工作方式
1 二进制计数：将计数脉冲由CP0输入，由Q0输出
2 五进制计数：将计数脉冲由CP1输入，由Q3 、Q2、 Q1 输出
3
8421BCD码十进制计数：将Q0与CP1相连, 计数脉冲CP由CP0输入
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一、集成N进制计数器
74LS290的功能表
R0A R0B S9A S9B CP0 CP1 Q3 Q2 Q1 Q0
（2）求归零逻辑：CR CT / LD PN P12, P P QnQn
N
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（3）画连线图：
Q0 Q1 Q2 Q3
Q0 Q1 Q2 Q3
CP1
CP CP0
74LS197
& 1
CT/LD
CR
CP1 CP CP 0
74LS197
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CT/LD 1
CR
D0 D1 D2 D3 (a) 用异步清零端 CR 归零
1 1 0 × × × 0 000 1 1 × 0 × × 0 000 0 × 1 1 × × 1 001 × 0 × 0 ↓ 0 计数 × 0 0 × 0 ↓ 计数 0 × × 0 ↓ Q0 计数 0 × 0 × Q3 ↓ 计数
功能说明 异步清零 异步清零 异步置9 1位二进制计数 五进制计数 8421BCD码十进制计数 5421BCD码十进制计数
D0 D1 D2 D3 (a) 用异步清零端 CR 归零
D0～D3可随意处理
D0 D1 D2 D3 (b) 用同步置数端 LD 归零
D0～D3必须都接0
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二、N进制计数器的设计 2、计数器为M进制，当M＜N时，求N进制： 例4 用74LS290构成24进制计数器。 解： 一片74LS290最大为十进制，不能直接构成24进制，需要先用2片74LS290
D0～D3可随意处理
D0 D1 D2 D3 (b) 用异步置数端 CT/LD 归零
D0～D3必须都接0
74LS197为16 进制异步加法 计数器，清零、 置数均采用异 步方式
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二、N进制计数器的设计
例3 用74LS161来构成一个十二进制计数器。
解：74LS161为16进制同步加法计数器，清零采用异步方式、置数采用同步方式.
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二、N进制计数器的设计
1、计数器为M进制，当M>N时，求N进制：
利用集成计数器的清零端和置数端实现归零，从而构成按自然态序 进行计数的N进制计数器。
1 用同步清零端或置数端归零构成N进置计数器 1 写出状态SN-1的二进制制端信号的逻辑表达式。 3 画连线图。
D0～D3可随意处理
D0 D1 D2 D3 (b) 用同步置数端 LD 归零
D0～D3必须都接0
74LS163为16 进制同步加法 计数器，清零、 置数均采用同 步方式
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二、N进制计数器的设计
例2 用74LS197来构成一个十二进制计数器。
解：（1）写出状态SN的二进制代码： SN＝S12＝1100
级联成100进制，再利用归零法，构成24进制。
两片74LS290串行级联构成的二十四进制计数器
10
小结
计数器可利用触发器和门电路构成。但在实际工作中，主要是利用集成 计数器来构成。在用集成计数器构成N进制计数器时，需要利用清零端或置 数控制端，让电路跳过某些状态来获得N进制计数器。
当某计数器为M进制，而M>N时，求N进制的方法是： 当模为M的计数器计数到状态SN-1（同步清零端或置数端归零）或SN（异 步清零端或置数端归零）时，强行使计数器返回到0，再重新开始计数。
用异步清零端CR 归零
用 同 步 置 数 端 LD 归 零
SN＝S12＝1100 CR Q3nQ2n
Q0 Q1 Q2 Q3
SN-1＝S11＝1011 LD Q3nQ1nQ0n
Q0 Q1 Q2 Q3
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CTT CTP
74LS161
CO 1
LD
CP
CR
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CTT CTP
CO 74LS161
LD
CP
1 CR
《脉冲数字电子技术及应用》
长沙航空职业技术学院
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4-5 N进制计数器
内容提要： 一、集成N进制计数器 二、N进制计数器的设计
2
一、集成N进制计数器
74LS290为二-五-十进制计数器，在74 LS 290内部有四个触发器，第一 个触发器有独立的时钟输入端CP0(下降沿有效)和输出端Q0，构成二进制计 数，其余三个触发器以五进制方式相连，其时钟输入为CP1(下降沿有效)， 输出端为Q1、Q2、Q3。