DSP硬件开发教程

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v DSPs硬件系统组成 v DSPs芯片的选择 v DSPs最小系统设计 v DSPs的结构及外设接口 v DSPs系统设计
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DSPs芯片的选择（4）
v 数据格式
Ø 定点 vs. 浮点
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DSPs芯片的选择（5）
v 电源管理和功耗
Ø 降低工作电压 Ø “休眠”或“空闲”模式 Ø 可编程时钟分频器
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DSPs芯片的选择（1）
v GPP vs. DSPs vs. ASIC
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3.电源—加电顺序需求
DSPs的一些I/O管脚是双向的，方向 由内核控制。I/O电压一旦被加上以后， I/O管脚就立即被驱动，如果此时还没加 核电压，那么I/O的方向可能就不确定是 输入还是输出。如果是输出，且这时与 之相连的其它器件的管脚也处于输出状 态，那么就会造成时序的紊乱或者对器 件本身造成损伤。这种情况下，就需要 核电压比I/O电压先加载，至少是同时加 载。
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DSPs芯片的选择（6）
v 成本
Ø 选择越便宜的处理器，功能越少，片上 存储器也越小 Ø 价格还依赖于批量 Ø 处理器的价格在持续下跌
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1.功能设置（1）
设置内容 设置管脚 数值
B’00’ 片内锁相环模式 CLKMODE[1:0] B’01’ B’10’ B’11’ 芯片的ENDIAN模式 BEA20 B’0’ B’1’ B’00’ 芯片的引导模式 BEA[19:18] B’01’ B’10’ B’11’ B’00’ EMIFA接口时钟选择 BEA[17:16] B’01’ B’10’ B’11’
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DSPs系统组成
A/D
DSP
D/A、 数 字 IO 等
MEM
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程序 ROM
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远见品质 设置内容 设置管脚
1.功能设置（2）
数值
B’00’ EMIFB接口时钟选择 BEA[15:14] B’01’ B’10’ B’11’ PCI接口由EEPROM自 动配置 UTOPIA接口使能 PCI接口使能 HPI宽度选择 McBSP2接口使能 B’0’ BEA13 B’1’ B’0’ B’1’ B’0’ B’1’ B’0’ B’1’ B’0’ B’1’
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2.程序ROM—自加载
指令 1 低 8bit 指令 1 中 8bit 指令 1 中 8bit 指令 1 高 8bit 指令 2 低 8bit • • • 片外程序 ROM 或 Flash
Boot 自加载 指令 1 字 32bit（或指令包） • • • 片内程序 RAM
加载后 PC 指针
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DSPs硬件开发
刘国满
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含义
1倍频 6倍频 12倍频 保留或20倍频 Big Endian Little Endian 无加载 主机加载 8bit ROM加载 保留 AECLKIN管脚外输入 1/4 CPU时钟 1/6 CPU时钟 保留
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最小系统组成（1）
一个DSPs要能够正常的运行程 序完成简单的任务，并能够通过 JTAG被调试，它的最小系统应该 包括DSPs芯片、电源、时钟源、复 位电路、JTAG电路、程序ROM以 及对芯片所做的设置。
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百度文库
v DSPs硬件系统组成 v DSPs芯片的选择 v DSPs最小系统设计 v DSPs的结构及外设接口 v DSPs系统设计
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最小系统组成（2）
电源
I/O 电压 核 电压
时钟 源
时钟 管理
复位 电路
DSPs
‘上下拉’ 功能 设置 EMIF 接口 JTAG 口 JTAG 电路
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2.程序ROM—编程（1）
SST39VFxxx的软件命令序列:
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DSPs芯片的选择（2）
v DSPs的速度
Ø 算法计算的时间 < 系统提供的时间 Ø 时间估算最可靠的方法是对信号处理算法的 “核心”功能（往往占运算量80％以上，但代 码小于20％）进行编程仿真（Simulation） Ø 选择要有富裕量，以便系统功能的增加或升 级。
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含义
BECLKIN管脚外输入 1/4 CPU时钟 1/6 CPU时钟 保留 禁止(PCI_EN=0时必须禁止) 使能(初始化时刻McBSP2_EN 必须为0) 禁止(McBSP1使能) 使能(McBSP1禁止) 禁止 使能 HPI16 HPI32 禁止 使能
BEA11 PCI_EN HD5 McBSP2_EN
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2.程序ROM—编程（2）
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DSPs芯片的选择（3）
v 存储器容量
Ø 内存 Ø 外存
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2.程序ROM—接口
BCE1 AOE AWE BEA[N+1:1] EMIFB BED[7:0] ARE VDD ARDY
CE OE WE A[N:0] FLASH D[7:0]
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