第21章触发器和时序逻辑电路08机械
数字电子技术之时序逻辑电路介绍课件
时序逻辑电路的特点
STEP1
STEP2
STEP3
STEP4
存储功能：能够存储 输入信号的状态，并 在一定条件下输出相 应的信号
反馈机制：通过反馈 机制实现对输入信号 的响应和输出信号的 控制
定时功能：能够实现 对输入信号的定时控 制，并在一定条件下 输出相应的信号
设计思路：使用D 触发器构成计数器， 每个D触发器输出 连接到下一个D触 发器的输入
设计步骤：
确定触发器的个数 和类型
设计触发器的连接 方式
编写触发器的逻辑 方程
设计电路的仿真和 测试
设计结果：实现一 个4位二进制计数器， 能够正常计数并输 出正确的计数值
谢谢
设计原则
01
正确性：保证 电路的功能正 确，满足设计 要求
02
简洁性：尽量 减少电路的复 杂度，降低成 本
03
可靠性：保证 电路在各种情 况下都能正常 工作
04
灵活性：便于 修改和扩展， 适应不同的需 求
05
性能优化：提 高电路的速度、 功耗和面积等 性能指标
设计实例
设计要求：实现一 个4位二进制计数 器
04
状态图分析步骤：绘制状态图、分析状态转换、确定输出信号
05
状态图分析优点：直观、易于理解和分析复杂电路
状态表分析法
状态表：描 述时序逻辑 电路状态的 表格
状态转换： 状态表列出 了电路在各 种输入条件 下的状态转 换关系
状态方程： 描述状态转 换关系的数 学方程
状态图：用 图形方式表 示状态转换 关系的方法
组合逻辑电路与时序 逻辑电路的区别：组 合逻辑电路只对当前 的输入信号进行响应， 而时序逻辑电路对过 去的输入信号和当前 的输入信号进行响应。
触发器和时序逻辑电路电子技术课件ppt知识介绍
• D触发器：具有一个数据输入端D和一个时钟信号输入端CP。在CP的上升沿或 下降沿到来时，会将D端的输入数据锁存到输出端Q。具有数据锁存功能，适用 于数据传输和存储等应用场合。
组合逻辑控制信号产生
通过组合逻辑电路产生控制信号，实 现对时序逻辑电路的控制，如计数器 、寄存器等。
时序逻辑状态转换
在时序逻辑电路中，通过组合逻辑电 路实现状态转换，控制数据的流动和 处理。
状态机设计原理及实例分析
状态机基本概念
介绍状态机的定义、分类、状态转换图等基本概念。
状态机设计步骤
详细阐述状态机设计的步骤，包括状态编码、状态转 换表、状态转换图、控制逻辑设计等。
特性分析
触发器具有以下特性
记忆功能
能够保持输出状态不变，直到下一个触发信号的到来。
触发方式多样
可根据不同的触发方式进行设计，如电平触发、边沿触发 等。
逻辑功能灵活
可实现多种逻辑功能，如与、或、非等。
时序配合方便
可与其它时序逻辑电路方便地进行配合，实现复杂的时序 逻辑功能。
常见类型及其特点
• 基本RS触发器：具有两个输入端R和S，以及两个输出端Q和Q'。当R和S的输入 信号不同时，Q和Q'的输出状态会发生变化。具有直接置位和复位的功能，但 存在约束条件，即R和S不能同时为1。
触发器分类
根据触发方式的不同，触发器可分为电平触发器和边沿触发器两大类。其中，电平触发器又可分为基 本RS触发器、同步RS触发器、D触发器等；边沿触发器可分为正边沿触发器和负边沿触发器等。
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电工学（吉培荣著）课后答案下载电工学（吉培荣著）课后答案下载本书是普通高等教育“十一五”国家级规划教材。
本书是根据当前教学改革形势，在第六版的基础上作了精选、改写、调整、补充而修订编写的。
全书分上、下两册出版。
上册是电工技术部分;下册是电子技术部分。
各章均附有习题。
另编有配套立体化教材(见第七版序言)。
本书可作为高等学校工科非电类专业上述两门课程的教材，也可供社会读者阅读。
本书(第七版)由哈尔滨工程大学张保郁教授审阅。
本书第三版于1987年获全国优秀教材奖，第四版于1997年获国家级教学成果二等奖和国家级科学技术进步三等奖，第五版于获全国普通高等学校优秀教材二等奖，第六版于获国家级教学成果二等奖，并于获第七届全国高校出版社优秀畅销书一等奖，此外还被评为“高等教育百门精品课程教材建设计划”精品项目。
电工学（吉培荣著）：内容简介第1章电路的基本概念与基本定律1.1电路的作用与组成部分1.2电路模型1.3电压和电流的参考方向1.4欧姆定律1.5电源有载工作、开路与短路1.5.1电源有载工作1.5.2电源开路1.5.3电源短路1.6基尔霍夫定律1.6.1基尔霍夫电流定律1.6.2基尔霍夫电压定律1.7电路中电位的概念及计算习题第2章电路的分析方法2.1电阻串并联连接的等效变换2.1.1电阻的串联2.1.2电阻的并联2.2电阻星形联结与三角形联结的等效变换 2.3电源的两种模型及其等效变换2.3.1电压源模型2.3.2电流源模型2.3.3电源两种模型之间的等效变换2.4支路电流法2.5结点电压法2.6叠加定理2.7戴维宁定理与诺顿定理2.7.1戴维宁定理2.7.2诺顿定理2.8受控电源电路的分析2.9非线性电阻电路的分析习题第3章电路的暂态分析第4章正弦交流电路第5章三相电路第6章磁路与铁心线圈电路第7章交流电动机第8章直流电动机第9章控制电机第10章继电接触器控制系统第11章可编程控制器及其应用第12章工业企业供电与安全用电第13章电工测量附录部分习题答案中英文名词对照参考文献第14章半导体器件14.1半导体的导电特性14.1.1本征半导体14.1.2N型半导体和P型半导体 14.2PN结及其单向导电性14.3二极管14.3.1基本结构14.3.2伏安特性14.3.3主要参数14.4稳压二极管14.5双极型晶体管14.5.1基本结构14.5.2电流分配和放大原理14.5.3特性曲线14.5.4主要参数14.6光电器件14.6.1发光二极管14.6.2光电二极管14.6.3光电晶体管习题第15章基本放大电路15.1共发射极放大电路的组成15.2放大电路的`静态分析15.2.1用放大电路的直流通路确定静态值 15.2.2用图解法确定静态值15.3放大电路的动态分析15.3.1微变等效电路法15.3.2图解法15.4静态工作点的稳定15.5放大电路的频率特性15.6射极输出器15.6.1静态分析15.6.2动态分析15.7差分放大电路15.7.1静态分析15.7.2动态分析15.7.3共模抑制比15.8互补对称功率放大电路15.8.1对功率放大电路的基本要求15.8.2互补对称放大电路15.8.3集成功率放大电路15.9场效晶体管及其放大电路15.9.1绝缘栅场效晶体管15.9.2场效晶体管放大电路习题第16章集成运算放大器16.1集成运算放大器的简单介绍16.1.1集成运算放大器的特点16.1.2电路的简单说明16.1.3主要参数16.1.4理想运算放大器及其分析依据 16.2运算放大器在信号运算方面的应用 16.2.1比例运算16.2.2加法运算16.2.3减法运算16.2.4积分运算16.2.5微分运算16.3运算放大器在信号处理方面的应用 16.3.1有源滤波器16.3.2采样保持电路16.3.3电压比较器16.4运算放大器在波形产生方面的应用 16.4.1矩形波发生器16.4.2三角波发生器……第17章电子电路中的反馈第18章直流稳压电源第19章电力电子技术第20章门电路和组合逻辑电路第21章触发器和时序逻辑电路第22章存储器和可编程逻辑器件第23章模拟量和数字量的转换附录部分习题答案中英文名词对照参考文献电工学（吉培荣著）：图书目录点击此处下载电工学（吉培荣著）课后答案。
21章 题库——时序逻辑电路+答案
第21章 触发器和时序逻辑电路一、填空题1、JK 触发器的特性方程为：=+1n Q ________________________。
2、时钟触发器按照结构和触发方式不同可分为：_________、__________、_________和主从式触发器四种。
3、T 触发器的特性方程为=+1n Q _________________。
4、4个触发器组成的寄存器可以存储__________位二进制数。
5、将JK 触发器的J 端连在Q 端上，K 端接高电平。
假设)(t Q =0，则经过50个CP 脉冲作用后，它的状态)50(+t Q =_____。
6、对于时钟RS 触发器，若要求其输出“0”状态保持不变，则输入的RS 信号应为________。
7、组成计数器的各个触发器的状态能在时钟信号到达时同时翻转,它属于__________ 计数器。
（填“同步”或“异步”）8、当JK 触发器的输入J=1，K=0时，触发器的次态Q n+1=____________。
9、若要构成十二进制计数器，最少要用__________个触发器。
10、构成一个模6的同步计数器最少要________个触发器。
11、一个 JK 触发器有____个稳态，它可存储____位二进制数。
二、选择题1、下列触发器中有空翻现象的是_________。
A 、同步式触发器B 、维持阻塞式触发器C 、主从式触发器D 、边沿式触发器 2、在以下各种电路中，属于时序电路的有__________。
A 、译码器B 、计数器C 、数据选择器D 、编码器 3、JK 触发器当J=K=1时，Q n+1=__________。
A 、0B 、1C 、Q nD 、 Q n4、下列触发器中逻辑功能最多是_______。
A 、J-K 触发器B 、D 触发器C 、T 触发器D 、T ′触发器 5、在CP 有效的情况下，当输入端D=0时，则D 触发器的输出端=+1n Q ________。
触发器和时序逻辑电路chapter21
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21.1 双稳态触发器
21.1.1 R－S 触发器 21.1.2 主从J－K 触发器 21.1.3 维持阻塞D 触发器 21.1.4 触发器逻辑功能转换
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21.1 双稳态触发器
为“？”状态
J=1, K=1时，每来 一个时钟脉冲，状 态翻转一次，即具 有计数功能。
Q1
Q0
Q
Q
F从
SCR
SD
C
RD
Q
Q
F主 S C R
1
J
1 0
CK
0
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(2)J=0，K=1 设触发器原 态为“1”态
翻转为“0”态 设触发器原 态为“0”态
为“？”态
Q1
& G3
& G4
发器的状态由 R，S的状态决 定。
S
1 C
打开
R
总目录 章目录 返回 上一页 下一页
当C=1时
触发器状态由R，S 输入状态决定。
Q
.
& G1
Q
.
& G2
1 SD 1 (1) S=0, R=0 打开
& G3
1 RD 1 & G4
触发器保持原态
S0
1 C
打开
R0
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例：JK 触发器工作波形
下降沿触发翻转
C J K Q
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21.1.3 维持阻塞 D 触发器 Q 1.电路结构
电工与电子技术(A)II测试题(2011-2012学年第1学期 )
2011-2012学年第一学期 电工与电子技术(A)II 测试题第16 17章 集成运算放大器和反馈一、填空题（共5个空，每空2分，填在对应的横线上，总计10分）1．要使运算放大器工作于线性区，必须引入 ；2．集成运算放大器工作于非线性区，u +为同相输入， u –为反相输入，U o(sat)为饱和值的大小为12V 。
当u +> u –时， u o = V ；当u +< u –时，u o = V ； 3．在同相输入比例运放电路中，设R 1=10k Ω，R F =100k Ω，则闭环电压放大倍数A u f = ，平衡电阻R 2= Ω。
二、选择题（每小题四个备选答案中选出一个正确答案，共5小题，每小题2分，总计10分）1． 下列条件中符合理想运算放大器条件之一是 (A) 开环放大倍数 →0 (B) 差模输入电阻→∞ (C) 开环输出电阻→∞ (D) 共模抑制比 →02．要提高放大电路的输入电阻，降低输出电阻应采用______负反馈。
(A) 并联电压 (B) 并联电流 (C) 串联电压 (D) 串联电流3．如图2-1所示的电压比较器，其转输特性曲线为 。
（A ）（B ） （C） （D ）4．图2-2所示电路的反馈类型是______负反馈。
(A) 并联电压 (B) 并联电流 (C) 串联电流 (D) 串联电压u iｉｉｉ ｉ０图2-15．运算放大器电路如图2-3所示，其最大输出电压为±12V ，已知1-=i u V ，则输出电压0u 为（ ）。
(A) 12V (B) －12V (C) 1V (D) -1Vi u三、计算下列各题(共3小题，总计30分)1．如图3-1所示是一个电压电流变换电路，R L 是负载电阻，试求负载电流i o 与输入电压u i 的关系，并说明它是何种类型的负反馈电路。
（10分）2．电路如图3-2所示，Ω=k 101R ，Ω=k 202R ，Ω=k 100F R ，V 2.01=i u ，V 5.02-=i u ，求输出电压 。
第21章 触发器和时序逻辑电路
1
&
&
a
b
1
1
D1 0 CP
返回
0
1
Q
Q
C正沿到达时c、
& e
& f
d开启，使c=1，
d=0。
1
0
Q翻转为1
&
&
c1
d
0
1
&
&
a
b
1
1
D 1C
返回
C正沿过后， d=0将c封锁, 并使b=1，维 持d=0。
Q
0 & e
Q1 &
f
因此以后 C=1期间D的 变化不影响 输出。
1
& c
0
& a
0 &
d
1 &
移位脉冲
• F0
• F1
• F2
F3
CP
CP
D0
D0
10 1 1
Q0
Q0
1
Q1
Q1
1
Q2
Q2
0
Q3
Q3
1
3. 中规模双向移位寄存器
VCC Q0 Q1 Q2 Q3 CP SB SA 74LS194
Cr DSR D0 D1 D2 D3 DSL GND
DSR：右移串行输入端
DSL：左移串行输入端 D3~ D0：并行输入端 Q3~ Q0：数据输出端
G2
1 RD 1
0 SD 0
输出保持：Q 1 Q 0
返回
RD 1, S D 0 时，触发器原状态若为“0”，
则新状态为“1”。若原状态为“1”，则新状 态仍为“1”。即无论原状态如何，基本RS触 发器都输出“1”，所谓“置位”状态。
触发器和时序逻辑电路
课题十四：【学习内容】触发器按照其稳定工作状态分为多中类型，为了实现一定程序的运算，需要含有记忆功能的元件-触发器，它的输出状态不仅决定于当时的输入状态，而且还与电路的原来工作状态有关。
【学习重点】RS触发器的性质【学习难点】RS触发器的工作波形图RS触发器的“空翻”现象【学习内容】双稳态触发器组合电路和时序电路是数字电路的两大类。
门电路式组合电路的基本单元；触发器是时序电路的基本单元。
触发器按其稳定工作状态可分为双稳定触发器，单稳定触发器，无稳态触发器（多谐振荡器）等。
双稳态触发其按其逻辑功能可分为RS触发器，JK触发器,D触发器和T触发器等；按其结构可分为主从触发器和维持阻塞型触发器等。
基本RS触发器可由两个“与非”门交叉连接而成，如下图所示。
基本RS触发器可由两个“与非”门交叉连接而成，如下图所示。
Q与是基本触发器的输出端，两者的逻辑状态在正常条件下能保持相反。
这种触发器有两种稳定状态：一个状态是Q=1，=0，称为置位状态（“1”态）；另一个状态是Q=0，=1，称为复位状态（“0”态）。
相应的输入端分别称为直接置位端或直接置“1”端（）和直接复位端“0”端（）。
基本RS触发器输出与输入的逻辑关系。
1）=1，=0所谓=1，就是将端保持高电位；而=0，就是在端加一个负脉冲。
设触发器的初始状态为“1”态，即Q=1，=0。
这时“与非”门G2有一个输入端为“0”，其输出端变为“1”；而“与非”门G1的两个输入端全为“1”，其输出端Q变为“0”。
因此，在端加负脉冲后，触发器就由“1”态翻转为“0”态。
如果它的初始态为“0”态，触发器仍保持“0”态不变。
2）=0，=1设触发器的初始状态为“0”态，即Q=0，=1。
这是“与非”门G1有一个输入端为“0”，其输出端Q变为“1”；而“与非”门G2的两个输入端全为“1”，其输出端变为“0”。
因此，在端加负脉冲后，触发器就由“0”态翻转为“1”态。
如果它的初始状态为“1”态，触发器人保持“1”太不变。
时序逻辑电路触发器
基本触发器的功能表
RD SD
11 01 10 00
保持原状态 01 10 1 1*
注意： 1，低电平有效 2，置/复位
7
8
小结
1. 触发器是双稳态器件，只要令RD=SD=1， 触发器即保持原态。稳态情况下，两输出
互补。一般定义Q为触发器的状态。
2. 在控制端加入负脉冲，可以使触发器状态变化。
c
输出端 Q
b SD
d
直接置位端
R
S
CP
输入端
同步置/复位
12
触发方式
边沿触发：只在CP的有效沿（上升沿或下降沿）接收 输入信号并进行状态更新。（抗干扰强！）
电平触发：在CP的有效电平（高电平或低电平）接收 输入信号并进行状态更新。
Q
Q
C
C
负沿 触发
正沿 触发
13
主从触发方式：
S
&G 7
&G
&1
清零
&2
赛前先清零 CP
输出为零 发光管不亮
26
+5V 开启
D1
Q1
Q1
1
D2
Q2
D3
Q2 Q3
D4
Q3 Q4
CLR CP Q4
& 2 & 1 反相端都为1
清零
&2
1
CP
27
+5V
D1 =0 D2
=1
Q1
Q1 Q2
D3
Q2 Q3
D4
Q3 Q4
CLR CP Q4
0
&2
&1
被封
时序逻辑电路的结构
时序逻辑电路的结构时序逻辑电路是一种数字电路，其输出不仅取决于当前的输入，还与之前的输入序列有关。
这种电路主要由组合逻辑电路和存储元件组成，存储元件用来存储状态信息。
下面将从五个方面详细介绍时序逻辑电路的结构。
1.输入和输出信号时序逻辑电路具有一组输入信号和一组输出信号。
输入信号用于改变电路的状态，而输出信号则表示电路的当前状态。
与组合逻辑电路不同的是，时序逻辑电路的输出信号不仅与当前的输入信号有关，还与其内部存储的状态信息有关。
2.存储元件存储元件是时序逻辑电路的核心部分，用于存储状态信息。
常见的存储元件包括触发器和寄存器等。
触发器在特定的时钟脉冲边缘触发下，根据输入信号的变化更新内部状态；寄存器则能够保存一个二进制数位的序列，常用于实现计数器、移位器等功能。
3.逻辑门逻辑门是实现逻辑运算的电路元件，用于处理输入信号并产生输出信号。
在时序逻辑电路中，逻辑门通常与存储元件配合使用，以实现特定的功能。
常见的逻辑门有与门、或门、非门等，这些门电路能够实现基本的逻辑运算。
4.时钟信号时钟信号是时序逻辑电路中控制电路运行的关键信号。
时钟信号通常是一个周期性的脉冲信号，用于控制触发器的触发时刻和状态更新。
在同步时序逻辑电路中，所有存储元件都在同一时钟信号的控制下进行状态更新。
5.反馈信号反馈信号是指从时序逻辑电路的输出端返回的信号，用于影响电路的下一个状态。
反馈信号通常由存储元件的输出提供，并作为输入信号的一部分影响下一个状态的计算。
通过适当的反馈设计，可以实现各种复杂的时序逻辑功能，如计数器、移位器等。
时序逻辑电路是一种重要的数字电路类型，其结构包含输入和输出信号、存储元件、逻辑门、时钟信号和反馈信号等方面。
通过这些组成部分的协同工作，时序逻辑电路能够实现各种复杂的逻辑功能，并在数字系统中得到广泛应用。
了解时序逻辑电路的结构和工作原理对于设计、分析和应用数字系统具有重要意义。
第21章触发器和时序逻辑电路课件
克服办法：采用 JK 触发器或 D 触发器
二、JK触发器
1、结构和逻辑图
SD
J-K触发器是由两个可 J
控R-S触发器构成。
CP
K
S 主Q CP触
发 R 器Q
S 从Q
Q
CP触
发 R 器Q
Q
还通过一个“非”门将
RD
两个触发器联系起来。
分别称为主触发器和从
1
触发器。这种触发器具 主从型J-K触发器逻辑图
但在数字系统中，为了能实现按一 定程序进行运算，需要记忆功能。本章 将讨论的触发器及由其组成的时序逻辑 电路中，它的输出状态不仅决定于当时 的输入状态，而且还与电路的原来状态 有关，也就是时序电路具有记忆功能。
组合电路和时序电路是数字电路 的两大类。
门电路是组合电路的基本单元；
触发器是时序电路的基本单元。
在C = 1期间，触发器保持“1”不变
& G2
1 RD
封锁
& G4
0
1 0
C
& G6
1
D
结论：
D触发器状态表 C=0时，时钟控制
C上升沿前接收信 号，上降沿时触发 器翻转，（ 其Q的 状态与D状态一致； 但Q的状态总比D
D
Qn+1
电路关闭，触发器的 输出状态保持不变。
0 1
0
1
C=01时，时钟控 制电路打开，输出状
2、主触发器是同步RS触发器，在CP=1期间，输 入信号都对主触发器起控制作用。
3、在CP=1期间，J、K输入电平发生变化，不管
变化多少次，触发器只翻转一次。
例21.1.2： 主从J、K触发器的波形如图所示，已知触 发器的原状态为0，试画出输出波形。
电工学下册(电子技术)知识点总结
电子技术知识点总结模拟电路处理模拟信号，数字电路处理数字信号第14章半导体器件1.本征半导体概念2.N型和P型半导体的元素、多数载流子和少数载流子、“复合〞运动3.PN结的单向导电性，扩散运动，漂移运动4.二极管的伏安特性、等效电阻〔14.3.8〕5.稳压二极管的工作区6.三极管的放大电流特性〔非放大电压〕、输出特性曲线〔放大区、截止区、饱和区〕，判断硅管和锗管、PNP型和NPN型〔14.5.1，14.5.2,14.5.3〕第15章根本放大电路1.共发射极放大电路的组成、静态分析、动态分析，计算电压放大倍数〔远大于1，输入输出电压反相〕、输入电阻〔高〕、输出电阻〔低〕2.静态工作点的稳定：分压式偏置放大电路的组成3.非线性失真：饱和失真〔静态工作点高〕、截止失真〔静态工作点低〕4.射极输出器的组成、静态分析〔估算法、图解法〕、动态分析〔微变等效电路法、图解法〕，计算电压放大倍数〔接近1，但小于1，输入输出电压同相〕、输入电阻〔高〕、输出电阻〔低〕5.多级放大电路的放大倍数，耦合方式三种：变压器耦合、阻容耦合〔静态工作点相对独立〕、直接耦合〔静态工作点相互影响，零点漂移〕6.差分(差动)放大电路：针对缓慢变化的信号，采用直接耦合，共模信号，差模信号，抑制零点漂移，电路对称性要好7.功率放大电路状态：甲类、甲乙类、乙类，为防止交越失真，需工作在甲乙类状态下第16章集成运算放大器1.理想运算放大器的理想化条件：开环电压放大倍数∞，差模输入电阻∞，开环输出电阻0，共模抑制比∞，工作区：线性区和饱和区2.虚短、虚断3.运算放大器的比例运算、加法运算和减法运算4.电压比拟器第17章电子电路中的反应1.负反应对放大电路工作性能的影响：降低放大倍数、提高放大倍数的稳定性、改善波形失真2.深度负反应的条件〔AF>>1〕第18章直流稳压电源1.整流电路的作用2.滤波器的作用3.稳压环节的作用第20章门电路和组合逻辑电路1.二进制、十六进制和十进制的转化2.根本逻辑门电路概念：与、或、非3.逻辑代数运算：交换律、结合律、分配律、吸收律、反演律4.常用的组合逻辑电路：加法器、编码器、译码器5.例：判奇电路第21章触发器和时序逻辑电路1.触发器的触发条件、触发时间、功能2.可控RS触发器可能会出现空翻现象3.JK触发器如何转化为T触发器和D触发器4.常用的时序逻辑电路：存放器〔数码和移位〕、计数器。
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R CP
RD
SD
Q
S
Q
R
主触发器
1
J1
0
CP
0
K
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(2) J=0，K=1 设触发器原 态为“1‖态
1 Q 0
0 Q 1 Q
电工学
Q
从触发器
S 翻转为“0‖态 设触发器原 态为“0‖态
SD 0
R CP 1 RD Q 1R 1 0 1
1 2 3
74LS290
4
5
6
7
R9(1) NC R9(2) Q2 Q1 NC GND
Q3 Q2 Q1 Q0 R 9(1) R 9(2) S Q 1J & C1 1K R Q 1J Q 1J Q S 1J C1
∧
∧
∧
∧
C1 1K R&
C1 1K R &
CP 1
1K R
CP 2 R 0(1) R 0(2)
SD RD RD(Reset Direct)-直接置“0”端(复位 低电平有效 端) SD(Set Direct)-直接置“1”端(置位端)
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电工学
2. 可控 RS 触发器 基本R-S触发器
Q
Q
& G1
& G2
SD
导引电路（或控制电路） & G3 & G4
0 0
& G1
& G2
0
SD
1
RD 1
1
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电工学
(4) SD=0，RD = 0
―1‖态
当信号SD= RD = 0 同时变为1时，由 于与非门的翻转 时间不可能完全 相同，触发器状 态可能是“1‖态， 也可能是“0‖态， 不能根据输入信 号确定。
SD S CP R RD CP高电平时触发器状态由R、S确定 Qn—时钟到来前触发器的状态 Qn+1—时钟到来后触发器的状态
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电工学
例：画出可控 R－S 触发器的输出波形 可控 R－S状态表 CP
S
R Q 0 Q 1 不定
S 0 0 1 1
R 0 1 0 1
1 1
Q
Q
1 0 若先翻转
& G1
1 1 SD 0 0 1 1 1
& G2
1 1 RD 0
若G1先翻转，则触发器为“0‖态
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电工学
基本 R－S 触发器状态表
逻辑符号
SD
1 0 1 0
RD
0 1 1 0
Q
0 1 不变
功能 置0 置1 保持
Q
Q
同时变 1后不确定
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电工学
组合逻辑电路：任何时刻电路的输出状态 只取决于该时刻的输入状态，而与该时刻以前 的电路状态无关。
时序逻辑电路：任何时刻电路的输出状态 不仅决定于该时刻的输入状态，而且还与电路 原来的状态有关。具有记忆功能。
门电路是组合逻辑电路的基本单元； 触发器是时序电路的基本单元。
1
0
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0
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& G4
打开
1 CP
R
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电工学
当 CP = 1 时
Q
Q
触发器状态由R，S 输入状态决定。
1 SD
打开
& G1
& G2
(1) S=0, R=0
1
& G3
1
& G4
RD 1
触发器保持原态 S0
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打开
1 CP
R 0
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电工学
S JQ R KQ
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C K CP
R
J
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电工学
2. 工作原理
1
Q
Q
CP 0
从触发器封锁 从触发器状态保 持不变。 主触发器打开 主触发器状态 由J、K决定，接 收信号并暂存。
0
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Q
S
SD
Q C R
RD
从触发器
Q
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触发器保持 “0‖态不变
0 Q 0 & G1
1 SD1 复位 0
Q1 1
& G2
RD 0
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电工学
(2) SD=0，RD = 1
设原态为“0‖ 态
0Q 1
& G1
Q1
0
& G2 1 RD 1
翻转为“1‖ 态
0 SD 0
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电工学
21.1 双稳态触发器
双稳态触发器： 是一种具有记忆功能的逻辑单元电路，它能储存 一位二进制码。 特点： 1. 有两个稳定状态“0‖态和“1‖态； 2. 能根据输入信号将触发器置成“0‖或“1‖态； 3. 输入信号消失后，被置成的“0‖或“1‖态能保 存 下来，即具有记忆功能。
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Q
Q
Q
从触发器
Q
S
SD
R CP
RD
Q
S
Q
R
1 1
主触发器
0 J 1 CP K
0 0
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分析JK触发器 的逻辑功能 (1)J=1, K=1 设触发器 原态为“0‖ 态 翻转为“1‖态
状态不变 0
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Q0 1
Q1 0 Q
电工学
Qn+1 Qn
0 1 不定
CP高电平时触发 不定 器状态由R、S确定
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电工学
存在问题： 时钟脉冲不能过宽，否则出现空翻现 象，即在一个时钟脉冲期间触发器翻 转一次以上。 S CP Q=S Q=R 0 0 1 1 R 0 1 0 1 Qn+1 Qn
电工学
第21章 触发器和时序逻辑电路
21.1 双稳态触发器 21.2 寄存器 21.3 计数器 21.4 555定时器及其应用 21.5 应用举例
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电工学
第21章 触发器和时序逻辑电路
本章要求
1. 掌握 R－S、J－K、D 触发器的逻辑功能及 不同结构触发器的动作特点; 2. 掌握寄存器、移位寄存器、二进制计数器、 十进制计数器的逻辑功能，会分析时序逻辑 电路; 3. 学会使用本章所介绍的各种集成电路; 4. 了解集成定时器及由它组成的单稳态触发器 和多谐振荡器的工作原理。
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电工学
Vcc RCO Q0 Q1 Q2 Q3 ET LD
16 15 14 13 12 11 10 9
（1）4位二进制同步加法计数器74161
74161
1
2
3
4
5
6
7
8
RD CP D0 D1 D2 D EP GND 3
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电工学
设原态为“1‖ 态 结论: 不论 触发器原来 为何种状态， 当 SD=0， RD=1时， 将使触发器 置“1‖或称 为置位。
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触发器保持 “1‖态不变 Q0 1Q 0 1 & G1 & G2
0
SD 0 置位
1
RD 1
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电工学
(3) SD=1，RD = 1
状态不变
Q
从触发器
S
SD 1
R
主从状 态一致 RD
CP
Q
S 1
0 Q 0R
1 0 1
主触发器
11 1 J
0 1
1 0 K
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0 CP
电工学
(1) J=1, K=1 设触发器原 态为“1‖态
跳转
Q1
Q0
Q
从触发器
Q
S 为“？”状态 J=1, K=1时，每来 一个时钟脉冲，状 态翻转一次，即具 有计数功能。
若先翻
& G1 当时钟由 1变 0 后 触发器状态不定 1 SD 1
& G2 1
0 1
& G3
1 0 RD 1
& G4
S1
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1 CP
R1
0
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电工学
可控RS状态表 S 0 0 1 1 R 0 1 0 1 Qn+1 Qn 0 1 不定
跳转
逻辑符号 Q Q
J CP K
0
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