我的数电05
关于数电第五版阎石课件
转换步骤:
(1)写出已有触发器和待求触发器的特性方程。
(2)变换待求触发器的特性方程,使之形式与已有 触发器的特性方程一致。
(3)比较已有和待求触发器的特性方程,根据两个 方程相等的原则求出转换逻辑。
(4)根据转换逻辑画出逻辑电路图。
JK 触发器→RS触发器
变换RS触发器的特性方程,使之形式与 JK触发器的特性 方程一致:
1 1
J=1 K=1 时, Q=0,G 7 输出0,主触发器置1,CLK↓,Q *=1; Q=1,G 8 输出0,主触发器置0,CLK↓,Q *=0。
Q *=Q′
JK 触发器的特性表
JKQ
Q*
0
0
0
0
0
0
1
1
0
1
0
0
0
1
1
0
1
0
0
1
1
0
1
1
1
1
0
1
1
1
1
0
功能
Q* ? Q
保持
Q* ? 0 置 0
例5.4.3
第二三个CLK==1 1期期间间,, Q=10,,J=J0=,KK==11,, 主触发 发器器被被置置1,0虽;然虽然CLK C下L降K沿下到降达沿时到又达回时到 又J=0回, 从到触K=发0器, 但保从持触输 发出器Q *输=1出。Q *=0.
1 0 11 0
四、边沿触发的触发器
1.用两个电平触发 D触发器组成的边沿触发器
CP
CP D Q2
5.6 触发器的逻辑功能及其描述方法
一、触发器按逻辑功能的分类
按 逻
SR触发器
辑
功
JK 触发器
数电第五版第五章课后习题及答案演示精品PPT课件
【题5.15】已知CMOS边沿触发方式JK触发器各输入端 的电压波形如图P5.15所示,试画出Q,Q’端对应的电压 波形。
20
解:根据JK触发器逻辑功能的定义和边沿触发方式的动作特 点,画出的Q,Q’ 端电压波形如图A5.15。
21
【题5.18】设图P5.18中各触发器的初始状态皆为Q=0,试画 出在CLK信号连续作用下各触发器输出端的电压波形
10
解:根据SR触发器逻辑功能的定义及脉冲触发方式的动作特 点,即可画出图A5.8中Q和Q’的电压波形。
11
【题5.9】 若主从结构SR触发器的CLK,S,R, 各输入端电压波 形如图P5.9所示, =1,试画出Q,Q’ 端对应的电压波形。
12
解:根据SR触发器逻辑功能的定义及脉冲触发方式的动作特 点,即可画出Q,Q’的电压波形,如图A5.9所示。
学习要点: 1、不同电路结构触发器的动作 特点; 2、不同逻辑功能触发器的特性;
1
【题5.1】 画出图P5.1由与非门组成的SR锁存器输出端Q,Q’的 电压波形,输入端 , 的电压波形如图中所示。 解:见图A5.1.
No Image
2
3
【题5.4】图P5.4所示为一个防抖动输出的开关电路。当拨动 开关S时,由于开关触点接通瞬间发生振颤 , 和 的电压波 形如图中所示,试画出Q,Q’端对应的电压波形。
从高电平跳变成低电平以后电路的工作过程与上述过 程类似。这样就得到了图A5.20的 电压波形。
25
【题5.21】 在图P5.21所示的主从JK触发器电路中,CLK 和 A 的电压波形如图中所示,试画出 Q 端对应的电压波形。设触 发器的初始状态为 Q = 0.
26
写在最后
经常不断地学习,你就什么都知道。你知道得越多,你就越有力量 Study Constantly, And You Will Know Everything. The More
数字电路的基础知识
数字电路的基础知识数字电路是电子电路的一种,它使用离散的电压和电流信号来处理和存储数字信息。
数字电路由逻辑门、触发器和寄存器等基本逻辑单元组成。
逻辑门是数字电路的基础构建模块,常见的逻辑门包括与门、或门、非门和异或门等。
它们根据输入信号的真值表来决定输出信号的逻辑运算结果。
触发器是一种存储器件,用于存储和传输二进制数据。
最常见的触发器是D触发器,它具有一个数据输入端和一个时钟输入端,通过时钟上升沿或下降沿来传输数据。
触发器还可以用来实现计数器和状态机等功能。
寄存器是一种具有多个存储单元的存储器件,用于存储多位二进制数据。
寄存器通常由多个触发器级联构成,可以在时钟信号的控制下进行数据的并行或串行传输。
数字电路的设计和分析常常使用布尔代数和逻辑表达式。
布尔代数是一种数学系统,用于表示和操作逻辑关系。
逻辑表达式使用布尔运算符(如与、或、非)和变量(如A、B、C)来描述逻辑关系,进而用于设计和分析数字电路的功能和性能。
在数字电路中,信号一般使用二进制编码。
常用的二进制编码方式有二进制码、格雷码和BCD码等。
二进制码是最常见的编码方式,将每个数位上的值表示为0或1。
格雷码是一种特殊的二进制编码,相邻的编码只有一个比特位的差异,用于避免由于数字信号传输引起的误差。
BCD码是二进制编码的十进制形式,用于表示和处理十进制数字。
数字电路在计算机、通信、控制系统等领域有广泛的应用,例如计算机的中央处理器、内存和输入输出接口等都是基于数字电路的设计实现。
希望这些基础知识能够帮助你对数字电路有更好的理解。
数电课件康华光电子技术基础-数字部分(第五版)完全
只读存储器是一种只能写入一次数据的存储器,写入后数据无法修改或删除。
ROM的优点是可靠性高、集成度高、功耗低等。
ROM的分类:根据编程方式的不同,可以分为掩膜编程ROM和紫外线擦除编程ROM。
RAM的分类
根据存储单元的连接方式不同,可以分为静态随机存取存储器(SRAM)和动态随机存取存储器(DRAM)。
门电路的定义
门电路的分类
门电路的作用
根据工作原理和应用领域,门电路可分为与门、或门、非门、与非门、或非门等。
门电路在数字电路中起到信号传输、逻辑控制和状态转换等作用。
03
02
01
CMOS(Complementary Metal-Oxide Semiconductor)门电路采用互补晶体管实现逻辑运算,具有低功耗和高可靠性的特点。
发展趋势
随着微电子技术和计算机技术的不断发展,数字电路正朝着高速、高可靠性、低功耗、微型化的方向发展。同时,随着物联网、云计算、大数据等新兴技术的兴起,数字电路的应用领域将进一步拓展。
PART
02
数字逻辑基础
REPORTING
逻辑变量只有0和1两种取值,表示真和假、开和关等对立的概念。
逻辑变量
包括逻辑与、逻辑或、逻辑非等基本逻辑运算,以及与非、或非、异或等常用逻辑运算。
详细描述
THANKS
感谢观看
REPORTING
公式化简法
利用卡诺图的特点,通过圈0和填1的方式对逻辑函数进行化简。
卡诺图化简法
利用吸收律对逻辑函数进行化简,如A+A↛B=A+B。
吸收法
将多个相同或相似的项合并为一个项,如A+AB=A。
合并法
PART
03
数电作业05-06 (2)
CP 1
1K C1 1J (d)
Qn+1=1
Qn+1=JQn + KQn
Q1n 1 Q 1
n Q2 1 0
n
CP Q1
Q2 Q3
Q Q
n 1 3 =0
5.4.5
负边沿JK 触发器
Qn+1=JQn + KQn
J1=K1=1
J 2 K 2 X Q1
图示电路是用反馈置数法构成的计数器。 反馈信号从TC引出 ,置数输入是0101 则计数状态从0101→1111,其模为16-5=11, 即为11进制计数器。
状态图
Q3 Q2 Q1 Q0
0101 1111 1110
0110
0111
1000 1001 1011 1010
11进制计数器
1101 1100
有效循环状态
状态图
Q3 Q2 Q1 Q0
0000 1010 1001
0001
0010
0011 0100 0110 0101
11进制计数器
1000 0111
反馈信号属于有 效循环状态
6.4.14 分析图示电路是几进制计数器,画出状态图。
1
•
•
•
1
1 CP
•
CR D0 D1 D2 D3 CET TC 74HCT161 CEP CP Q0 Q1 Q2 Q3 PE
第5章作业
5.2.4 门控SR锁存器信号波形如图所示,画出Q和Q的 波形。设初态Q=0。 E S R Q Q E
R S Q Q 0 1 0 X X 1 0 0 1 0 1 1 1 0 1 1 1
S E
不变 不变 0 1 同S 1 0 不定
数电第五版答案阎石第一三章
数电第五版答案阎⽯第⼀三章1.1⼆进制到⼗六进制、⼗进制(4)(11.001)2=(3.2) 16=(3.125) 10(3) Y (A B)(A C)AC BC第⼀章(1)Y=A+B(3)Y=1(2)Y ABC A BC(4)Y ABCD ABD ACD解:Y BC AB CC A B C 1(A + A =1)解:Y AD(BC B C) AD(B C C) AD(5)Y=0(7)Y=A+CD(6)Y AC (CD :AB) BC(BAD CE)解:Y BC(B AD CE) BC(B AD) CE ABCD(CE) ABCDE(0.63D70A )16(2)(127) 10=(1111111) 2=(7F) 16(4) (25.7)10(11001.101 1 0011)2(19.B3)16⑻丫解:A Y A (B C)(A B C)(A B A (B C)(A B C)(AC A A (ABC \ BCBC)(A B C)BC(A B C) AABC (9)Y BCA D AD(10)Y AC AD AEF BDE BDE1.9 (a)Y ABC BC(b)Y ABC ABC(c) Y 1AB ACD,Y 2AB ACDACD , ACD(d) 丫 1 AB AC BC,Y 2ABC ABCABC ABC1.10 求下列函数的反函数并化简为最简与或式 Y A C D (1)Y ABC ACBC解: Y ABCAC Be A BC A (B B)C (AA)BCA BC ABC ABC ABC ABC A B CABC ABC⑵YABCD ABCD ABCD ABCD ABCDA BCDACD(B C D) ABCD将函数化简为最⼩项之和的形式ABC(3)(0.01011111) 2=(0.5F) 16=(0.37109375) 10 1.2⼗进制到⼆进制、⼗六进制(1)(17) 10=(10001) 2=(11) 16 (3) (0.39)10 (0.0110 0011 1101 0111 0000 1010) 2 1.8⽤公式化简逻辑函数 (1) Y AC BC 解:丫 (A B)(A C)AC BC[(AB)(A C) AC] BC(5)Y(AB AC BCAD AC BCD C 解:丫 (A D)( A C)(BAC)(BC)C D)C AC(A D)(B D)1.11(3) Y A B CD解:Y A(BCDBCD BCD BCD BCD BCD BCD BCD)B(ACDACDA CD A CD ACD ACD ACDACD) (AB AB AB AB)CDABCD ABCDABCD ABCD ABCDABCD ABCD ABCDA B CD A B C D A BCD A BCDABCD (13)⑷ Y ABCD ABCD ABCD ABCD ABCD ABCD ABCD ABCD(5) Y LMN LMN LMN LMN LMN LMN 1.12 将下列各函数式化为最⼤项之积的形式(1) Y (A B C)(A B C)(A B C) (2)(5) Y M o M 3 M 5 1.13⽤卡诺图化简法将下列函数化为最简与或形式:1.20将下列函数化为最简与或式(1) Y ACD BCD AD (2) Y B AD AC(3) Y A BCA BD(5) Y 1(6)YCDBD ACY (A B C)(A B C)(A B C)(3) Y M o M 3 M 4 M 6 M 7Y M 0 M 4 M 6 M 9 M 12 M 13(1) Y A D (2) Y AB AC BCCD AB AC BC0 i r:0 J 1i1 1[1JLi)D AB(6)(9)E p0 011〕 0ABACY AB AC BC Y BD AD BCA CD(8) Y(A,B,C,D) m (0,1,2,3,4,6,8,9,10,11,14) (10) Y (A ,B ,C)10 0 J 0 0 D 1j i11B CD AD1 0 0 11Y ABC ABC ABC(1) YABCD (2) ⑶ YAB D AC(4)⑸ Y A B D E CEBDE AD A C DEY CD ACD YBC BD00 01 II 10,1 JIt LCM 01.11 1001 11 101.14化简下列逻辑函数3.1解:由图可写出 Y i 、Y 2的逻辑表达式:Y 1 ABC (A B C) ―AC ―BCABC ABC ABC ABC Y 2 AB AC BC真值表:ABC Yi Yi0 0 0 0 Q0 & 1 0 1 0 ;J 曲真值表知,电路是⼀亍⼀位全加器。
数电课件 ch05-1锁存器和触发器
5.1
双稳态存储单元电路
5.1.2 双稳态存储单元电路
1. 电路结构
G1 1 Q
反馈
电路有两个互补的输出端
G2 1 Q
Q端的状态定义为电路输出状态。
2、逻辑状态分析 ——电路具有记忆1位二进制数据的功能。 如Q=1 双稳态存储单元电路
G1 1 V O1 Q 1
如Q=0
G1 V I 11 V O1
υ O 1 (= υ I2 ) 稳态点 (Q = 1 ) d e
G1 V I1 1 V O1 Q
Q=1
G
1
G c 介稳态
2
1 V I2 G2 V O2
Q
0
点
Q=0
a b 稳态点 (Q=0) υ I1 (= υ O 2 )
图中两个非门的传输特性 正反馈
0 V I1
1
1
Q 0
Hale Waihona Puke 01V I2
1 V O2 G2
Q 0
0
V I2
1 V O2 G2
Q 1
某一时刻,电路究竟处于1态 or 0态?
3. 模拟特性分析
O1 = I2
I1 = O2
若在电路的一个非门输入端施加 足够幅值的脉冲信号,使电路越 过介稳态点,则电路从一种稳态 转变为另一种稳态。
引言
1、组合逻辑电路和时序逻辑电路的工作特征 组合逻辑电路: 任意时刻电路的输出状态只与该当前的输入信号有关,而
且与电路原来的状态无关。
时序逻辑电路: 任意时刻电路的输出状态不仅与该当前的输入信号有关, 而且与电路原来的状态有关。
2、组合逻辑电路和时序逻辑电路的结构特征 组合逻辑电路: 时序逻辑电路: 由逻辑门电路组成,电路中不存在反馈。 由组合逻辑电路和存储电路组成, 电路中存在反馈。 锁存器和触发器是构成时序逻辑电路的基本逻辑单元 。 3、组合逻辑电路和时序逻辑电路的功能特征 组合逻辑电路: 时序逻辑电路:
数字电子技术基础第五版阎石课件
2006年
24
8.4 通用阵列逻辑GAL
要使用GAL器件,就要先进行设计。GAL器件的开发 工具包括硬件开发工具和软件开发工具。硬件开发工 具有编程器,软件开发工具有ABEL-HDL程序设计语言 和相应的编译程序。编程器的主要用途是将开发软件 生成的熔丝图文件按JEDEC格式的标准代码写入选定 的GAL器件。
8.1 概 述
图8.1.1 PLD电路中门电路的惯用画法 (a)与门
(b)输出恒等于0的与门 (c)或门 (d)互补输出的缓冲器 (e)三态输出的缓冲器
2006年
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1
图8.1.1 PLD电路中门电路的惯用画法
(a)与门(b)输出恒等于0的与门(c)或门 (d)互补输出的缓冲器(e)三态输出的缓冲器
辑模式(c)单乘积项模式 图8.8.7 输入/输出单元( IOC )的电路结构 图8.8.8 IOC的各种组态 图8.8.9 ispLSI器件的编程接口 图8.8.10 ispGDS22的结构框图 图8.8.11 ispGDS22的输入/输出单元( IOC )
支持不同厂家生产的,各种型号的PAL,GAL, EPLD,FPGA产品开发。
PLD开发系统包括软件和硬件俩部分。 开发系统软件是指PLD专用的编程语言和相 应的汇编程序或编译程序。开发系统软件大体
上可以分为汇编型,编译型和原理图收集型三
种。
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8.8 在系统可编程逻辑器件(ISP-PLD)
图8.8.1 ispGAL16z8的电路结构框图 图8.8.2 ispGAL16z8编程操作流程图 图8.8.3 ispLSI1032的电路结构框图 图8.8.4 ispLSI1032的逻辑功能划分框图 图8.8.5 通用逻辑模块(GLB)的电路结构 图8.8.6 GLB的其它几种组态模式(a)高速旁路模式(b)异或逻
数电课件第五章锁存器和触发器
不同类型的触发器具有不同的工 作特性和应用场景,可以根据实 际需求选择合适的触发器类型。
03 锁存器和触发器的应用
在时序逻辑电路中的应用
存储数据
锁存器和触发器可以用于存储数 据,在时序逻辑电路中作为寄存 器使用,保存数据以便后续处理。
控制信号
锁存器和触发器可以用于控制信号 的传递,在时序逻辑电路中作为控 制门使用,根据输入信号的变化来 控制输出信号的输出。
数电课件第五章锁存器和触发器
目录
• 锁存器概述 • 触发器概述 • 锁存器和触发器的应用 • 锁存器和触发器的实例分析 • 总结与展望
01 锁存器概述
定义与特点
01
02
定义:锁存器是一种具 特点 有存储功能的电路,能 在特定条件下保存数据, 即使在电源关闭或电路 其他部分出现故障的情 况下也能保持数据的完 整性。
分析
通过仿真验证了74HC74的触发器功能,并对其工作原理有了更深入的理解。
05 总结与展望
锁存器和触发器的重要性和应用价值
锁存器和触发器是数字电路中的基本元件,在时序逻辑电路和组合逻辑 电路中有着广泛的应用。
锁存器能够存储二进制数据,在数字系统中起到数据存储和传输的作用; 触发器则能够记忆二进制数据的状态,常用于实现时序逻辑电路如计数 器和寄存器等。
03
04
05
具有记忆功能,能够保 存前一个状态;
在时钟信号的驱动下, 通常由逻辑门电路构成, 完成数据的存储和读取; 如与门、或门和非门等。
工作原理
在时钟信号的控制下,锁存器在数据输入端接收数据,并在数据输出端输出数据。
当时钟信号处于低电平状态时,锁存器处于关闭状态,无法接收新的数据输入。
数字电子技术基础第五版阎石门电路
TTL与非门举例
7400是一种典型的 TTL 与非门器件,内部含有 4个2输入端 与非门,共有14个引脚。引脚排列图如图所示。
二、集电极开路的门电路
1.推拉式输出电路结构的局限性
① 输出电平不可调
② 负载能力不强,尤其是高电平输出
③ 输出端不能并联使用
一是会抬高
1
(不能构成“线与”结构) 门2的低电平,
4.异或门
? A=0,B=0 ,T2 T3导通, T4 T5截止,T7 T9导通, T8截止,输出为0
? A=1,B=1 ,T6 T7导通, T8截止输出为0
? A=0,B=1 ,或者A=1,B=0 : T3导通,T6截止,T4 T5必 有一个导通,T7 截止,T9 截止,T8导通,输出为1
Y ? A? B
二是会因功
耗过大损坏
门电路.
0
OC门(Open Collector )
线与结构
yes
no
2、OC门的结构特点
VCC ?
RL
? 输出端为 OC三极管 T5,T5可承受较大电压、电流 , 如SN 7407 : 40 mA / 30V
正逻辑
正逻辑 高电平:1 低电平:0
负逻辑 低电平:1 高电平:0
实际中高 /低电平都有一个允许的范围
在数字电路中,对电子元件、器件参数精度的要 求及其电源的稳定度的要求比模拟电路要低。
3.2 分立元件门电路
3.2.1 半导体二极管和半导体三极管的开关特性
数字电路中的晶体二极管、三极管和 MOS管工作在开关状态。 导通状态:相当于开关闭合 截止状态:相当于开关断开。
当A和B同为高电平时, VB1 ? 2.1V , T4截止, T2和 T5导通, VO ? VOL ? 0
数电课后习题第五章答案
本章习题5.1分析图题4.1a 电路的逻辑功能,列出逻辑功能表,画出R、S 输入图b 信号时的输出波形。
题5.1 逻辑功能表解: 见题5.1 逻辑功能表和波形图。
5.2画出图题5.2各触发器在时钟脉冲作用下的输出波形。
(初态为“0”) 解:波形见题5.2图。
5.3 画出图题4.3中各不同触发方式的D 触发器在输入信号作用下的输出波形 (初态为0)。
Q n S R Q n+1 Q —n+1 功能0 1 0 1 0 置位1 1 0 1 0 置位00 1 0 1 复位10 1 0 1 复位00 0 0 1 保持10 0 1 0 保持0 1 1 1 1 非法11111非法解:波形见题5.3图。
5.4 图题5.4a由CMOS或非门和传输门组成的触发器,分析电路工作原理,说明触发器类型。
如果用两个图a的电路构成图b电路,说明图b电路是什么性质的触发器。
解:图a为同步D触发器,CP为使能控制,低电平有效。
当CP=“0”时,TG1通、TG2断,触发器根据D信号改变状态;当CP=“1”时,TG1断、TG2通,触发器状态保持。
逻辑符号如图5.2a。
图b为主从D触发器,时钟CP的上升沿有效,逻辑符号如图5.2b。
5.5 画出图题5.5(a)所示电路在输入图(b)信号时的输出波形。
解:当A=“1”时,CP的下降沿使Q=“1”。
当Q=“1”且 CP =“1”时,Q复位。
波形见题5.5图。
5.6画出图题5.6(a)电路的三个输出Q2、Q1、Q0在图(b)信号输入时的波形变化图(初始状态均为“0”)。
分析三个输出信号和输入信号的关系有何特点。
解:波形见题5.6图。
输出信号按位序递增顺序比输入滞后一个CP周期。
5.7 画出图题5.7所示电路的三个输出Q2、Q1、Q0在时钟脉冲作用下波形变化图(初始状态均为“0”)。
若三个输出组成三位二进制码,Q2为最高位,分析输出码和时钟脉冲输入个数之间的关系。
解:波形见题5.7图,输出码随时钟输入递减:“000”→“111”→“110” →“101” →“100” →“011” →“010” →“011” →“001” →“000”,每8个时钟周期循环一次。
数电第五版(阎石)第五章课后习题及答案pptx
03
习题三答案ຫໍສະໝຸດ 习题三第1题答案1.1 逻辑函数的表示方法 1.1答案:逻辑函数有多种表示方法, 如真值表、逻辑表达式、波形图和卡
诺图等。
1.2 逻辑函数的化简方法
1.2答案:逻辑函数的化简方法包括代 数法、公式法和卡诺图法等。
1.3 逻辑函数的运算规则
1.3答案:逻辑函数的运算规则包括与、 或、非等基本运算,以及与或、与非、 或非等复合运算。
习题一第3题答案
总结词
卡诺图化简
答案
通过卡诺图化简,我们得到最简的逻 辑表达式为(F = A'B + A'C + BC)。
02
习题二答案
习题二第1题答案
总结词
逻辑函数的表示方法
详细描述
逻辑函数的表示方法有真值表、逻辑表达式、逻辑图和波形图等。这些表示方法各有特 点,可以根据具体需求选择使用。真值表可以清晰地表示输入和输出之间的逻辑关系; 逻辑表达式简化了函数表示,便于分析和计算;逻辑图能够直观地展示逻辑函数的结构
习题三第2题答案
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2.1 逻辑函数的化简步骤
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2.1答案:逻辑函数的化简步骤包括合并项、消去项和简 化表达式等。
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2.2 逻辑函数的化简技巧
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2.2答案:逻辑函数的化简技巧包括利用运算规则、消去 项和合并项等。
在此添加您的文本16字
和功能;波形图则可以反映函数在时间序列上的动态变化。
习题二第2题答案
总结词
逻辑函数的化简方法
详细描述
逻辑函数的化简方法有多种,包括公式化简法、卡诺 图化简法和布尔代数化简法等。公式化简法基于逻辑 代数的基本公式和规则,通过简化表达式得到最简结 果;卡诺图化简法利用卡诺图的性质,通过图形直观 地找出最小项的组合,从而得到最简逻辑函数表达式 ;布尔代数化简法则通过代数运算简化逻辑函数。这 些化简方法各有优缺点,应根据具体情况选择使用。
数电第五版习题答案
数电第五版习题答案数电第五版习题答案数电(数字电子技术)是电子工程中的一门重要课程,它研究的是数字信号的处理与传输。
在学习数电的过程中,习题是检验自己理解和掌握程度的重要方式。
本文将为大家提供数电第五版习题的答案,希望能够帮助大家更好地学习和理解数电知识。
第一章:数字系统基础1. 逻辑电平的表示方式有哪些?答案:逻辑电平的表示方式有两种,分别是“0”和“1”。
其中,“0”表示低电平,也可以表示逻辑假;“1”表示高电平,也可以表示逻辑真。
2. 什么是布尔代数?答案:布尔代数是一种数学工具,用于描述和分析逻辑运算。
它基于两个值(真和假)和三种基本运算(与、或、非),通过逻辑运算符号和真值表来表示和计算逻辑运算。
3. 什么是逻辑函数?答案:逻辑函数是指逻辑输入和逻辑输出之间的关系。
它可以用真值表、逻辑表达式或逻辑图形来表示。
逻辑函数是数字系统中最基本的组成单元。
第二章:组合逻辑电路1. 什么是组合逻辑电路?答案:组合逻辑电路是由逻辑门和逻辑功能块组成的电路。
它的输出仅取决于当前输入的状态,与过去的输入状态无关。
2. 什么是编码器?答案:编码器是一种组合逻辑电路,它将多个输入信号编码为较少数量的输出信号。
常见的编码器有BCD编码器和优先编码器。
3. 什么是译码器?答案:译码器是一种组合逻辑电路,它将二进制代码转换为相应的输出信号。
常见的译码器有BCD译码器和十六进制译码器。
第三章:时序逻辑电路1. 什么是时序逻辑电路?答案:时序逻辑电路是由组合逻辑电路和存储器件(如触发器)组成的电路。
它的输出不仅取决于当前输入的状态,还与过去的输入状态有关。
2. 什么是触发器?答案:触发器是一种存储器件,用于存储和稳定输入信号的状态。
常见的触发器有RS触发器、D触发器、JK触发器和T触发器。
3. 什么是计数器?答案:计数器是一种时序逻辑电路,用于计数和存储输入脉冲的数量。
常见的计数器有二进制计数器、BCD计数器和同步计数器。
精选数电第五版阎石课后习题及答案
? 0.68k?
故????的取值范围应为:
R 0.68k? ? L ? 4.29k?
2020/2/8
30
【题3.29】试说明下列各种门电路哪些可以将输出端并联使 用(输入端的状态不一定相同): (1)具有推拉式输出级的TTL电路; (2)TTL电路的OC门; (3)TTL电路的三态输出门; (4)互补输出结构的CMOS门; (5)CMOS电路的OD门; (6) CMOS电路三态输出门。 解:(1)、(4)不可; (2)、(3)、(5)、(6)可以
用电表使用5V量程,内阻为20KΩ/V。
解:这时相当于??12 端经过一个100KΩ的电阻接地。假定与非 门输入端多发射极三极管每个发射结的导通压降为0.7V,则有
(1)??12 ≈ 1.4V (3)??12 ≈ 1.4V
(2) ??12 ≈ 0.2V (4) ??12 ≈ 0V
(5) ??12 ≈ 1.4V
解:在满足V OL ? 0.4V 的条件下,求得
可驱动的负载门数目为:
NL
?
IOL (max) I IL
?
16 1.6
? 10
在满足V OH ? 3.2V 的条件下,求得可
驱动的负载门数目为:
NH
?
1 IOH (max) 2 IIH
?
1 0.4 ? 103 ? 5 2 40
故最多驱动5个与非门
2020/2/8
电平满足V OH
?
V 3.2V , OL
?
0.4V
。与非门的输入电流为?????≤?
I V I -1.6mA, IH
?
40? A。 OL
?
0.4V
时输出电流最大值为
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A、B为输入信号 (+3V或0V) F 为输出信号 VCC=+5V
表2-1 电路输入与输出电压的关系 A 0V 0V 3V 3V
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B 0V 3V 0V 3V
F 0.7V 0.7V 0.7V 3.7V
19
3. 逻辑赋值并规定高低电平
用逻辑1表示高电平(此例为≥+3V) 用逻辑0表示低电平(此例为≤0.7V) 4. 真值表
3. 逻辑赋值并规定高低电平
用逻辑1表示高电平(此例为≥+2.3V) 用逻辑0表示低电平(此例为≤0V) 4. 真值表
A 0V 0V 3V 3V
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表2-4 二极管或门的真值表 F 0V 2.3V 2.3V 2.3V
B 0V 3V 0V 3V
A 0 0 1 1
B 0 1 0 1
F 0 1 1 1
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二ห้องสมุดไป่ตู้管与门电路
A 0V 0V 3V 3V B 0V 3V 0V 3V F 0.7V 0.7V 0.7V 3.7V
用正逻辑
A 0 0 1 1
B 0 1 0 1
F 0 0 0 1
用负逻辑
A 1 1 0 0
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正与门
B 1 0 1 0
F 1 1 1 0
正与门相当于负或门
结束 放映
第二章
逻辑门电路
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1
复习
什么是高电平?什么是低电平? 什么是状态赋值? 什么是正逻辑?什么是负逻辑? 二极管与门、或门有何优点和缺点?
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2
门电路:实现基本和常用逻辑运算的电子电路,叫 逻辑门电路,与基本逻辑关系相对应。
门电路的主要类型:与门、或门、与非门、或 非门、异或门等。 一般采用 正逻辑 门电路的输出状态与赋值对应关系: 正逻辑:高电位对应“1”;低电位对应“0”。 负逻辑:高电位对应“0”;低电位对应“1”。 混合逻辑:输入用正逻辑、输出用负逻辑;或者输 入用负逻辑、输出用正逻辑。
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图20 TTL反相器的输入伏安特性 (a)测试电路 (b)输入伏安特性曲线
iC
iB/μA
U CC / RC
ICS
IBS
截止区
0
饱和区
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UBES 输入特性
uBE/V
0
IB=0
UCES 输出特性 UCC
uCE
11
当输入信号uI=UIH=3.2V时
U IH U BES U IH iB RB RB
iC
UCC
Rc
将三极管刚刚从放大进入饱和时
的状态称为:临界饱和状态。 临界饱和集电极电流:
2. 三极管的开关时间(动态特性) 从二极管已知, PN结存在电容效 应
在饱和与截止两 个状态之间转换 时,iC的变化将滞 后于VI,则VO的 变化也滞后于VI
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(1) 开启时间ton 三极管从截止到饱和所需的时间。 ton = td +tr td :延迟时间 tr :上升时间
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当输入低电平时,VT4截止,VT3导通(为射极输 出器),其输出电阻很小,带负载能力很强。 可见,无论输入如何,VT3和VT4总是一管导通而 另一管截止。 这种推拉式工作方式,带负载能力很强。
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40
2.3.2、 TTL反相器外部特性
1. 电压传输特性 电压传输特性:输出电压uO与输入电压uI的关 系曲线。
IB=0
uCE
(1) 截止状态
条件:发射结反偏 特点:电流约为0
开关等效电路
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(2)饱和状态
条件:发射结正偏,集电结正偏 特点:UBES=0.7V,UCES=0.3V/硅
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14
图2.9 三极管开关等效电路 (a) 截止时 (b) 饱和时
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(2) 关闭时间toff 三极管从饱和到截止所需的时间。 toff = ts +tf ts :存储时间(几个参数中最长的;饱和越深越长) tf :下降时间 toff > ton 。 开关时间一般在纳秒数量级。高频应用时需考虑。
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2.2
分立元件门电路
门电路的概念: 实现基本和常用逻辑运算的电子电路,叫逻辑 门电路。实现与运算的叫与门,实现或运算的叫或 门,实现非运算的叫非门,也叫做反相器,等等。
0.3V
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结论:输出与输入反相,实现了非的逻辑功能
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(3) 采用推拉式输出级利于提高开关速度和负载能力 VT3组成射极输出器,优点是既能提高开关速度, 又能提高负载能力。 当输入高电平时,VT4饱和, uB3=uC2=0.3V+0.7V=1V,VT3和VD截止,VT4的集电 极电流可以全部用来驱动负载。
1. 电路组成
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图2.17 TTL反相器的基本电路
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(1) 输入级
P N N
P
N
N
当输入低电平时, uI=0.2V,发射结正向导 通, uB1=0.9V 当输入高电平时, uI=3.4V,发射结受后级 电路的影响将反向截止。 uB1由后级电路决定。
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(2) 中间级
A 0V 0V 3V 3V B 0V 3V 0V 3V F 0.7V 0.7V 0.7V 3.7V 表2-2 二极管与门的真值表
A 0 0 1 1
B 0 1 0 1
F 0 0 0 1
A、B全1, F才为1。
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可见实现了与逻辑
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5. 逻辑符号
6. 工作波形(又一种表示逻辑功能的方法) 7. 逻辑表达式 F=A B
ICS U CC U CES U CC RC RC
ui=3.2V iC
RB
iB
T
uO uCE
U CC / RC
UCC 临界饱和基极电流: IBS RC
可靠饱和条件为:iB≥IBS 定义饱和深度:
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ICS
IBS
C UCES
B
UBES
0
iB S I BS
E
UCC UCES 等效电路 输出特性 12
A 0.3V 3.6V F +VCC 0.3V
图2-15 非门 (a) 电路 (b)逻辑符号
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3. 逻辑赋值并规定高低电平
用逻辑1表示高电平(此例为≥+3.6V) 用逻辑0表示低电平(此例为≤0.3V) 4. 真值表
表2-4 三极管非门的真值表 A 0.3V 3.6V F +VCC 0.3V A 0 1 F 1 0
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二极管与门 (a)电路 (b)逻辑符号 (c)工作波形
21
2.2.2 二极管或门电路
1. 电路 2. 工作原理
A、B为输入信号(+3V或0V) F 为输出信号
电路输入与输出电压的关系 A B F 0V 0V 0V 0V 3V 2.3V 3V 0V 2.3V 3V 3V 2.3V
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分立元件门电路和集成门电路: 分立元件门电路:用分立的元件和导线连接起 来构成的门电路。简单、经济、功耗低,负载差。 集成门电路:把构成门电路的元器件和连线都 制作在一块半导体芯片上,再封装起来,便构成了 集成门电路。现在使用最多的是CMOS和TTL集成门 电路。 18
2.2.1 二极管与门电路
1. 电路 2. 工作原理
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获得高、低电平的基本原理
S开------VO输出高电平,对应“1” 。 S合------VO输出低电平,对应“0” 。
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高/低电平都允许 有一定的变化范 围 在数字电路中,对电压值为多少并不重要, 4 只要能判断高低电平即可。
开关接通
正向导通:
二极管 反向截止: 开关 作用 三极管 (C,E)
负或门
30
2.3
TTL门电路
TTL集成逻辑门电路的输入和输出结构均采用
半导体三极管,所以称晶体管—晶体管逻辑门电路, 简称TTL电路。 TTL电路的基本环节是反相器。 简单了解TTL反相器的电路及工作原理,重点 掌握其特性曲线和主要参数(应用所需知识)。
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2.3.1 TTL反相器的工作原理
UCC iC iC
iB
B
C
0
EuBE/V
等效电路 输入特性
Rc T
U CC / RC
uO
ICS
IBS
截止区
RB
ui=0.3V
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饱和区 uCE 0
iB
IB=0
输出特性
UCC
uCE
10
2.三极管的饱和条件和等效电路 在模拟电路中,为了不产生失真,通常规定饱和时UCES=1V。
在数字电路中,为了更接近理想开关,规定饱和时UCES=0.3V。 由于三极管的输入特性很陡,通常认为饱和时的UBES和导 通时的UBE相等(硅管:0.7V,锗管0.3V)
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2. 逻辑状态赋值
在数字电路中,用逻辑 0 和逻辑 1 分别表示输入、 输出高电平和低电平的过程称为逻辑赋值。 经过逻辑赋值之后可以得到逻辑电路的真值表, 便于进行逻辑分析。
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2.2.3 非门(反相器)
1. 电路 2. 工作原理
A为输入信号 (+3.6V或0.3V) F 为输出信号