ADC入门基础知识
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采样保持电路（S/H） 子ＡＤ电路 ＭＤＡＣ电路（乘法数模转换器） 误差校正电路 基准源 时钟电路 数字编码电路
39
采样保持电路
采样保持电路
40
采样开关
41
三种机制产生误差 1、沟道电荷注入 2、时钟馈通 3、KT/C噪声
42
沟道电荷注入
43
时钟馈通
44
KT/C噪声
45
误差的消除
以上误差的存在，对于高速高精度 Pipeline ADC 来说是很 不利的，因此需要采取一定措施来减小。
2n
对输入信号进行采样，并把输入信号与相对应的参 考电压相比较，后将比较结果输入到优先编码的编 码电路进行编码，最终输出N位的二进制编码。
25
Flash A/D转换器结构图
全并行A/D转换器结构图
ቤተ መጻሕፍቲ ባይዱ
3bit FlashADC 的基本框架
26
Flash ADC优缺点
全并行结构的ADC实现一次转换只需要整个电路 比较一次,所以其转换速率非常快。
数字校正 运用算法逻辑等后台处理技 术来消除电路对温度及误差 匹配等方面所产生的影响
缺点
模拟校正 采用电容误差平均技术
需要一个额外的始终周期， 这样便降低了电路速度。
6
高转换速度
A/D转换电路的速度主要是受运放建立时间和比 较器响应速度的影响。因此必须优化单级电路的建 立特性，提高运放的增益可以保证系统精度的同时 确保运放的大宽带、提高运放的压摆率设计、压摆 区和线性建立区的合理分割等。目前国际上已经产 品化的 ADC 采样速率最高可以达到 2.2GSPs （Maxiam公司的 MAX109）
4
发展方向
在未来,模数转换芯片的主要发展方向是 1、高分辨率 2、高转换速度 3、低功耗 4、单电源低电压 5、单片化
5
高分辨率
高分辨率：目前分辨率最高可以达到 31 bit（TI公司的ADS1282） 10bit及以上分辨率的A/D转换电路，它所达到的精度超过了现在工艺能 实现的最大电容匹配，所以必须采用一定的校正措施。校正技术分为：
但对于一个n位的全并行结构ADC,它需要 2n 1 个并行比较器和参考电压,随着ADC位数的提高,其电 路复杂程度会随着指数上升。因此,这种结构主要用 来设计高速、中低分辨率（≤6bit）的ADC。
27
两步式模数转换器
两步式模数转换器是由一个两级位数相同的Flash ADC(分 别用于高位和低位量化)。一个D/A转换器和一个减法器构成。 两步式模数转换器的工作原理为:
第一步,采样保持电路输入信号,在保持阶段,第一个Flash ADC对输入信号进行量化,产生高位的数据,然后这个数据通过一 个D/A转换器转换回模拟量,并与输入的模拟信号相减。
第二步,相减所得的余量被送入第二季Flash ADC中进行量 化,并产生低位的数据。
最终的输出结果是由高位的数据和低位的数据组合而成。
34
∑-∆型ADC结构图
35
∑-∆ADC的优缺点及应用
∑-∆ADC实际上是以最低的分辨率(l位)来实现模拟信号 的数字化。为了提高分辨率,要再对比较器的输出进行数字 滤波。它的最高分辨率现在可以达到24位,但这却是以牺牲 速度换取的。每输出一次完整的结果,都需要对输入信号采 样很多次。
∑-∆ADC的特点是模拟电路的比例小,对模拟电路的要求 降低,结构比较简单。∑-∆ADC现在主要是应用在音频、图像 处理和ADSL通信等领域。
减小电荷注入效应和时钟馈通效应引起的误差的方法有很多 种，用得较多的有两种：采用虚拟开关和采用全差分采样电路。
虚拟开关将沟道电荷和时钟馈通引起的电荷变化用另一晶体 管来消除；
差分电路将这些误差转换为共模干扰来减小其影响，但需要 系统有较高的共模抑制比和使 KT/C 噪声增加到原来的两倍， 这可以通过增加采样电容大小来减小，但会增加功耗。
其中，N是ADC的位数。
19
信噪失真比 信噪失真比：基本的信号功耗与所有谐 波失真，混叠谐波以及所有的噪声功耗之和 的比值。它是衡量模数转换器最重要的指标。 与输入信号频率、幅度等因素有关。
20
无杂散动态范围
21
总谐波失真（Total Harmonic Distortion）
总谐波失真：整个频带中各次谐波的功率之 和。
36
pipeline ＡＤＣ
pipeline ADC的系统结构示意图 pipeline ADC的基本单元 Pipeline ADC（1bit） Pipeline ADC（1.5bit） Pipeline ADC 的优缺点
37
Pipeline ADC的系统结构示意图
38
pipeline ADC的基本单元
逐次逼近型ADC完成n位数字转换需要N个时钟周期来完成。 因此,当分辨率提高时,转换器的速度就会相应的降低。
逐次逼近型ADC的静态误差会受到DAC线性度的限制,通过校 准或者微调DAC可以获得非常高的分辨率。
因此逐次逼近型ADC常用于高分辨率、低速的系统及设备。
33
∑-∆ADC
∑-∆ADC线性度很高,但同时对器件的匹配要求不高。∑∆ADC通常由一个积分器、一个比较器、一个1位的DAC和 一个数字滤波器构成,其结构如下图。∑-∆ADC首先将输入信 号与DAC输出相减得到一个差值,这个差值通过积分器积分, 得到的电压值通过比较器与基准电压进行比较,从而得到一位 数字输出。然后,这个数字量作为DAC的输入进入下一个转换 周期。
46
子ＡＤ电路示意图
47
子ＡＤ电路的组成
参考电压发生器 比较器 编码电路
48
基准源
参考电压发生器
分压电路
49
比较器
使用开环运算放大器作为比较器 采用前置放大器+锁存放大器的预放大锁存比较器 直接采用锁存比较器
50
预放大锁存比较器
51
比较器的误差
比较器的主要误差为失调和噪声。 其中失调主要是锁存放大器中元件的不匹配造成的，特别 是动态锁存器，其失调很容易达到 100mV 左右。 噪声方面主要有回馈噪声和热噪声。回馈噪声是指由于比 较器输出端的电压的快速变化通过寄生电容耦合到输入端， 使得输入信号产生较大的毛刺，这些毛刺即为回馈噪声。它 可以通过将输出与输入进行隔离来降低耦合作用来削弱。
目录
1、ADC是什么 2、背景、发展 3、现状 4、发展方向 5、ADC的基本框架 6、Nyquist采样定理 7、ADC的输入输出 8、ADC的性能参数 9、CMOS ADC 的结构 10、pipeline ADC 11、集成电路的设计方法
1
ADC是什么 ADC：模拟——数字转换器
模拟——数字转换器和数字——模拟转 换器是模拟系统和数字系统之间的桥梁，是 现代微电子数字通讯系统中非常重要的模块。
CMOS ADC 的结构有很多种，其中主要包括 Flash ADC 两步式ADC 逐次逼近型ADC ∑-∆ADC Pipeline ADC
24
Flash ADC 的基本架构以及工作原理
全并行ADC（Flash ADC）原理： 假如一个n位的全并行结构ADC，通常是由 2n 1
个并行比较器，2n 1 个参考电压及二进制译码电路 组成。基准间隔是 Vref 即一个LSB。每一个比较器
14
微分非线性误差（DNL）
15
积分非线性误差（INL）
16
失调误差
失调误差：零输入时Ａ／Ｄ转换器输入－输出特性 曲线的偏移。
17
增益误差
增益误差：满量程输出时，实际的模拟输入信号和理想的模拟 输入信号间的差值。增益误差使传输特性曲线绕坐标原点相对 于理想特性曲线发生了一定角度的偏移。
18
信噪比
THD
Vk
2 2
Vk
2 3
Vk 42
VkN2
100 %
V fund
22
转换速度
转换速度是指 ADC 每秒将输入的模拟信 号转换成数字信号的次数，其单位为 ksps 或 Msps（kilo/Million Samples per Second）。
23
CMOS ADC 的结构
2
背景、发展 随着CMOS制作工艺的迅猛发展，越来越 多的信号被移到数字领域来处理，从而达到 降低成本，降低功耗，提高速度的目的。 这就使我们迫切需要一种低功耗、低电 压而且能够用标准深亚微米技术实现的ADC。
3
现状
国内在高性能芯片的研究和设计方面还比较落 后,这就造成了各种高性能芯片的巨大需求和国内芯 片产业落后之间的巨大矛盾。而且,由于一些高端芯 片产品受到国外的进口限制,这对我国国防现代化发 展以及民用电子通信工业的发展非常不利。这就迫 使我们必须自己研究设计出高速、高精度的模数转 换器。
我国从 70 年代开始研制 ADC，至今已经有 8 bit、10 bit、 12 bit、14 bit 的 ADC产品，但产品性能还远远达不到高端应 用的要求，与国外水平相差甚远；高端 ADC还处于高校和研究所 的研究开发阶段。
8
低功耗、低电压、单片化 单元电路的一些优化设计也可以降低功 耗，如动态偏置、开关电容动态共模反馈以 及动态比较器等。低电压是现在应用发展的 一个趋势，主要有运放的rail-to-rail设计、 模拟开关的电压自举等方法。
31
逐次逼近型ADC结构图
32
逐次逼近型ADC的适用系统
逐次逼近型ADC的转换周期是从采样模拟信号开始的,采样 值与DAC初始化输出结果相减,输出的差被比较器量化,该比较器 通过输出的结果指示SAR增加还是减小DAC的输出,然后输入采样 减去新的DAC输出,该过程一直重复,直到满足所要求的精度为止。
13
分辨率（Resolution）
ADC的分辨率是指转换器所能分辨的最小
量化信号的能力。对于一个二进制N位分辨率
的ADC,假设满摆幅的输入范围为 Vref ,所能分
辨的最小电平则为
LSB
Vref 2N
同时,分辨率通常
随着噪声和非线性的增加而下降,因此,描述
ADC真正的分辨率还应包括噪声和非线性。
7
矛盾与解决
在集成电路设计中，速度和精度两者相互对立：如果追求高 速度，就必须降低精度，比如 Maxiam 公司的MAX109，采样速率 达到 2.2 GSPs，但分辨率只有 8bit；如果追求高精度，就必须 降低速度，如 TI 公司的 ADS1282，分辨率达到 31 bit，但采 样速率只有 4KSPs；然而最常见的情况是根据不同的应用在两者 之间进行折中。
28
两步式A/D转换器结构图
29
两步式模数转换器的优缺点
两步式ADC的转换时间比全并行ADC的转换时间长,但相对于 其他结构的ADC而言,还是非常快的。
n
对于一个n位分辨率的模数转换器,两步式ADC只需要2*22 2 个比较器,这远远少于全并行ADC所需要的比较器。大大节省了 芯片的功耗和面积。
与全并行ADC相比,两步式ADC还增加了一个DAC和一个减法 器。这样可以在减法器后面增加一个剩余信号放大器以避免过
n
小的剩余信号,通常选择增益为 G 22 的运算放大器来简化设 计,这样做的好处可以使两个并行转换器共用相同的参考电压。
30
逐次逼近型ADC
逐次逼近型ADC也被称为二进制搜索ADC,它是用一个高 速高精度的比较器将模拟输入信号与前一次得到的模数转换 结果通过DAC后的输出相比较,以此来得到从MSB到LSB的每一 位。逐次逼近型ADC除了需要一个比较器外,还要包含一个采 样保持电路、一个逐次逼近寄存器(SAR)和一个数模转换器 (DAC)。逐次逼近型ADC的结构如下图所示。
分辨率（Resolution） 微分非线性（Differential Nonlinearity简称 DNL） 积分非线性（Integral Nonlinearity 简称 INL） 失调误差 增益误差 信噪比（Signal to Noise Ratio） 无杂散动态范围（Spurious Free Dynamic Range 简称 SFDR） 总谐波失真（Total Harmonic Distortion，THD） 转换速度
9
ADC的基本框架
10
Nyquist 采样定理
Nyquist 采样定理:
fin
1 2
fs
其中， fin 是输入信号的频率
fs 是采样频率 被采样的信号只有在满足采样定理的情况下,才
能够被重构还原。
11
ADC的输入输出 下图是3位ADC的理想输入输出曲线。
12
ADC的性能参数
ADC 的性能参数主要有：
信噪比指ＡＤＣ输出信号功耗和噪声功耗间的比值，用
ｄＢ表示。
SNR 10 log Psignal Pnoise
其中，信号是指频谱图中基波分量的有效值，噪声＝总能量
－信号能量和谐波的能量。理想的ＡＤＣ噪声主要来自量化
噪声。对于正弦输入信号，信噪比的理论最大值为：
SNR (6.02N 1.76)dB
39
采样保持电路
采样保持电路
40
采样开关
41
三种机制产生误差 1、沟道电荷注入 2、时钟馈通 3、KT/C噪声
42
沟道电荷注入
43
时钟馈通
44
KT/C噪声
45
误差的消除
以上误差的存在，对于高速高精度 Pipeline ADC 来说是很 不利的，因此需要采取一定措施来减小。
2n
对输入信号进行采样，并把输入信号与相对应的参 考电压相比较，后将比较结果输入到优先编码的编 码电路进行编码，最终输出N位的二进制编码。
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Flash A/D转换器结构图
全并行A/D转换器结构图
ቤተ መጻሕፍቲ ባይዱ
3bit FlashADC 的基本框架
26
Flash ADC优缺点
全并行结构的ADC实现一次转换只需要整个电路 比较一次,所以其转换速率非常快。
数字校正 运用算法逻辑等后台处理技 术来消除电路对温度及误差 匹配等方面所产生的影响
缺点
模拟校正 采用电容误差平均技术
需要一个额外的始终周期， 这样便降低了电路速度。
6
高转换速度
A/D转换电路的速度主要是受运放建立时间和比 较器响应速度的影响。因此必须优化单级电路的建 立特性，提高运放的增益可以保证系统精度的同时 确保运放的大宽带、提高运放的压摆率设计、压摆 区和线性建立区的合理分割等。目前国际上已经产 品化的 ADC 采样速率最高可以达到 2.2GSPs （Maxiam公司的 MAX109）
4
发展方向
在未来,模数转换芯片的主要发展方向是 1、高分辨率 2、高转换速度 3、低功耗 4、单电源低电压 5、单片化
5
高分辨率
高分辨率：目前分辨率最高可以达到 31 bit（TI公司的ADS1282） 10bit及以上分辨率的A/D转换电路，它所达到的精度超过了现在工艺能 实现的最大电容匹配，所以必须采用一定的校正措施。校正技术分为：
但对于一个n位的全并行结构ADC,它需要 2n 1 个并行比较器和参考电压,随着ADC位数的提高,其电 路复杂程度会随着指数上升。因此,这种结构主要用 来设计高速、中低分辨率（≤6bit）的ADC。
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两步式模数转换器
两步式模数转换器是由一个两级位数相同的Flash ADC(分 别用于高位和低位量化)。一个D/A转换器和一个减法器构成。 两步式模数转换器的工作原理为:
第一步,采样保持电路输入信号,在保持阶段,第一个Flash ADC对输入信号进行量化,产生高位的数据,然后这个数据通过一 个D/A转换器转换回模拟量,并与输入的模拟信号相减。
第二步,相减所得的余量被送入第二季Flash ADC中进行量 化,并产生低位的数据。
最终的输出结果是由高位的数据和低位的数据组合而成。
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∑-∆型ADC结构图
35
∑-∆ADC的优缺点及应用
∑-∆ADC实际上是以最低的分辨率(l位)来实现模拟信号 的数字化。为了提高分辨率,要再对比较器的输出进行数字 滤波。它的最高分辨率现在可以达到24位,但这却是以牺牲 速度换取的。每输出一次完整的结果,都需要对输入信号采 样很多次。
∑-∆ADC的特点是模拟电路的比例小,对模拟电路的要求 降低,结构比较简单。∑-∆ADC现在主要是应用在音频、图像 处理和ADSL通信等领域。
减小电荷注入效应和时钟馈通效应引起的误差的方法有很多 种，用得较多的有两种：采用虚拟开关和采用全差分采样电路。
虚拟开关将沟道电荷和时钟馈通引起的电荷变化用另一晶体 管来消除；
差分电路将这些误差转换为共模干扰来减小其影响，但需要 系统有较高的共模抑制比和使 KT/C 噪声增加到原来的两倍， 这可以通过增加采样电容大小来减小，但会增加功耗。
其中，N是ADC的位数。
19
信噪失真比 信噪失真比：基本的信号功耗与所有谐 波失真，混叠谐波以及所有的噪声功耗之和 的比值。它是衡量模数转换器最重要的指标。 与输入信号频率、幅度等因素有关。
20
无杂散动态范围
21
总谐波失真（Total Harmonic Distortion）
总谐波失真：整个频带中各次谐波的功率之 和。
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pipeline ＡＤＣ
pipeline ADC的系统结构示意图 pipeline ADC的基本单元 Pipeline ADC（1bit） Pipeline ADC（1.5bit） Pipeline ADC 的优缺点
37
Pipeline ADC的系统结构示意图
38
pipeline ADC的基本单元
逐次逼近型ADC完成n位数字转换需要N个时钟周期来完成。 因此,当分辨率提高时,转换器的速度就会相应的降低。
逐次逼近型ADC的静态误差会受到DAC线性度的限制,通过校 准或者微调DAC可以获得非常高的分辨率。
因此逐次逼近型ADC常用于高分辨率、低速的系统及设备。
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∑-∆ADC
∑-∆ADC线性度很高,但同时对器件的匹配要求不高。∑∆ADC通常由一个积分器、一个比较器、一个1位的DAC和 一个数字滤波器构成,其结构如下图。∑-∆ADC首先将输入信 号与DAC输出相减得到一个差值,这个差值通过积分器积分, 得到的电压值通过比较器与基准电压进行比较,从而得到一位 数字输出。然后,这个数字量作为DAC的输入进入下一个转换 周期。
46
子ＡＤ电路示意图
47
子ＡＤ电路的组成
参考电压发生器 比较器 编码电路
48
基准源
参考电压发生器
分压电路
49
比较器
使用开环运算放大器作为比较器 采用前置放大器+锁存放大器的预放大锁存比较器 直接采用锁存比较器
50
预放大锁存比较器
51
比较器的误差
比较器的主要误差为失调和噪声。 其中失调主要是锁存放大器中元件的不匹配造成的，特别 是动态锁存器，其失调很容易达到 100mV 左右。 噪声方面主要有回馈噪声和热噪声。回馈噪声是指由于比 较器输出端的电压的快速变化通过寄生电容耦合到输入端， 使得输入信号产生较大的毛刺，这些毛刺即为回馈噪声。它 可以通过将输出与输入进行隔离来降低耦合作用来削弱。
目录
1、ADC是什么 2、背景、发展 3、现状 4、发展方向 5、ADC的基本框架 6、Nyquist采样定理 7、ADC的输入输出 8、ADC的性能参数 9、CMOS ADC 的结构 10、pipeline ADC 11、集成电路的设计方法
1
ADC是什么 ADC：模拟——数字转换器
模拟——数字转换器和数字——模拟转 换器是模拟系统和数字系统之间的桥梁，是 现代微电子数字通讯系统中非常重要的模块。
CMOS ADC 的结构有很多种，其中主要包括 Flash ADC 两步式ADC 逐次逼近型ADC ∑-∆ADC Pipeline ADC
24
Flash ADC 的基本架构以及工作原理
全并行ADC（Flash ADC）原理： 假如一个n位的全并行结构ADC，通常是由 2n 1
个并行比较器，2n 1 个参考电压及二进制译码电路 组成。基准间隔是 Vref 即一个LSB。每一个比较器
14
微分非线性误差（DNL）
15
积分非线性误差（INL）
16
失调误差
失调误差：零输入时Ａ／Ｄ转换器输入－输出特性 曲线的偏移。
17
增益误差
增益误差：满量程输出时，实际的模拟输入信号和理想的模拟 输入信号间的差值。增益误差使传输特性曲线绕坐标原点相对 于理想特性曲线发生了一定角度的偏移。
18
信噪比
THD
Vk
2 2
Vk
2 3
Vk 42
VkN2
100 %
V fund
22
转换速度
转换速度是指 ADC 每秒将输入的模拟信 号转换成数字信号的次数，其单位为 ksps 或 Msps（kilo/Million Samples per Second）。
23
CMOS ADC 的结构
2
背景、发展 随着CMOS制作工艺的迅猛发展，越来越 多的信号被移到数字领域来处理，从而达到 降低成本，降低功耗，提高速度的目的。 这就使我们迫切需要一种低功耗、低电 压而且能够用标准深亚微米技术实现的ADC。
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现状
国内在高性能芯片的研究和设计方面还比较落 后,这就造成了各种高性能芯片的巨大需求和国内芯 片产业落后之间的巨大矛盾。而且,由于一些高端芯 片产品受到国外的进口限制,这对我国国防现代化发 展以及民用电子通信工业的发展非常不利。这就迫 使我们必须自己研究设计出高速、高精度的模数转 换器。
我国从 70 年代开始研制 ADC，至今已经有 8 bit、10 bit、 12 bit、14 bit 的 ADC产品，但产品性能还远远达不到高端应 用的要求，与国外水平相差甚远；高端 ADC还处于高校和研究所 的研究开发阶段。
8
低功耗、低电压、单片化 单元电路的一些优化设计也可以降低功 耗，如动态偏置、开关电容动态共模反馈以 及动态比较器等。低电压是现在应用发展的 一个趋势，主要有运放的rail-to-rail设计、 模拟开关的电压自举等方法。
31
逐次逼近型ADC结构图
32
逐次逼近型ADC的适用系统
逐次逼近型ADC的转换周期是从采样模拟信号开始的,采样 值与DAC初始化输出结果相减,输出的差被比较器量化,该比较器 通过输出的结果指示SAR增加还是减小DAC的输出,然后输入采样 减去新的DAC输出,该过程一直重复,直到满足所要求的精度为止。
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分辨率（Resolution）
ADC的分辨率是指转换器所能分辨的最小
量化信号的能力。对于一个二进制N位分辨率
的ADC,假设满摆幅的输入范围为 Vref ,所能分
辨的最小电平则为
LSB
Vref 2N
同时,分辨率通常
随着噪声和非线性的增加而下降,因此,描述
ADC真正的分辨率还应包括噪声和非线性。
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矛盾与解决
在集成电路设计中，速度和精度两者相互对立：如果追求高 速度，就必须降低精度，比如 Maxiam 公司的MAX109，采样速率 达到 2.2 GSPs，但分辨率只有 8bit；如果追求高精度，就必须 降低速度，如 TI 公司的 ADS1282，分辨率达到 31 bit，但采 样速率只有 4KSPs；然而最常见的情况是根据不同的应用在两者 之间进行折中。
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两步式A/D转换器结构图
29
两步式模数转换器的优缺点
两步式ADC的转换时间比全并行ADC的转换时间长,但相对于 其他结构的ADC而言,还是非常快的。
n
对于一个n位分辨率的模数转换器,两步式ADC只需要2*22 2 个比较器,这远远少于全并行ADC所需要的比较器。大大节省了 芯片的功耗和面积。
与全并行ADC相比,两步式ADC还增加了一个DAC和一个减法 器。这样可以在减法器后面增加一个剩余信号放大器以避免过
n
小的剩余信号,通常选择增益为 G 22 的运算放大器来简化设 计,这样做的好处可以使两个并行转换器共用相同的参考电压。
30
逐次逼近型ADC
逐次逼近型ADC也被称为二进制搜索ADC,它是用一个高 速高精度的比较器将模拟输入信号与前一次得到的模数转换 结果通过DAC后的输出相比较,以此来得到从MSB到LSB的每一 位。逐次逼近型ADC除了需要一个比较器外,还要包含一个采 样保持电路、一个逐次逼近寄存器(SAR)和一个数模转换器 (DAC)。逐次逼近型ADC的结构如下图所示。
分辨率（Resolution） 微分非线性（Differential Nonlinearity简称 DNL） 积分非线性（Integral Nonlinearity 简称 INL） 失调误差 增益误差 信噪比（Signal to Noise Ratio） 无杂散动态范围（Spurious Free Dynamic Range 简称 SFDR） 总谐波失真（Total Harmonic Distortion，THD） 转换速度
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ADC的基本框架
10
Nyquist 采样定理
Nyquist 采样定理:
fin
1 2
fs
其中， fin 是输入信号的频率
fs 是采样频率 被采样的信号只有在满足采样定理的情况下,才
能够被重构还原。
11
ADC的输入输出 下图是3位ADC的理想输入输出曲线。
12
ADC的性能参数
ADC 的性能参数主要有：
信噪比指ＡＤＣ输出信号功耗和噪声功耗间的比值，用
ｄＢ表示。
SNR 10 log Psignal Pnoise
其中，信号是指频谱图中基波分量的有效值，噪声＝总能量
－信号能量和谐波的能量。理想的ＡＤＣ噪声主要来自量化
噪声。对于正弦输入信号，信噪比的理论最大值为：
SNR (6.02N 1.76)dB