北邮数字逻辑与数字系统实验ppt

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实验四 简单时序电路
实验内容:
1.双D构成的二进制计数器：按设计接线， 将Q0，Q1，Q2，Q3复位；由时钟端CLK输 入单脉冲，记录输出状态；由时钟端CLK 输入连续脉冲，观测输出波形。 2.用74LS73构成一个二进制计数器，重做 内容1的实验。
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实验一 基本门电路与三态门
与非门逻辑电路：
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实验一 基本门电路与三态门
74LS00实验电路：
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实验一 基本门电路与三态门
或非门逻辑电路：
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实验一 基本门电路与三态门
数字逻辑与数字系统实验
北京邮电大学 计算机科学与技术学院系统结构实验室 2012年11月
TEC-5计算机组成与数字逻辑 实验系统简介
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TDS-1001数字存储示波器简介
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实验一 基本门电路与三态门
实验目的 ： 1. 掌握TTL与非门，或非门和异或门输入与 输出之间的逻辑关系； 2. 熟悉TTL中，小规模集成电路的外形，管 脚和使用方法； 3. 掌握三态门逻辑功能和使用方法； 4. 掌握用三态门构成总线的方法和特点； 5. 掌握TEC5数字电路实验系统的使用方法； 6. 初步学会用示波器测量简单数字波形。
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实验一 基本门电路与三态门
74LS125实验电路1：
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实验一 基本门电路与三态门
74LS125构成总线实验电路：
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实验一 基本门电路与三态门
实验报告要求： 画出实验接线图或逻辑电路图； 真值表表示出实验结果； 记录实验现象； 分析实验结果；
异步十进制计数器实验电路:
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实验四 简单时序电路
异步十进制计数器输出波形:
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实验四 简单时序电路
自循环计数器实验电路:
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实验四 简单时序电路
自循环计数器输出波形:
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3.画出实验2的电路图。 4.写出实验3中,用单次脉冲做计数脉冲时， Q3，Q2，Q1，Q0的状态转移表；画出连 续时钟下Q3，Q2，Q1，Q0的波形； 5.画出实验4的电路图。用单次脉冲做计数 脉冲时，Q3，Q2，Q1，Q0的状态转移表。
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实验五 在系统编程实验1
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实验四 简单时序电路
D触发器构成的二进制计数器输出波形:
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实验四 简单时序电路
JK触发器构成的二进制计数器实验电路:
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实验四 简单时序电路
JK触发器构成的二进制计数器输出波形:
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实验四 简单时序电路
实验目的: 用VHDL语言设计一个8421码十进制计数 器及七段数码管显示系统。 学习使用ispEXPERT软件。 学习ISP器件的编程和下载。
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实验五 在系统编程实验1
实验所用的器件和设备 ISP1032 TEC-5数字电路实验系统 逻辑笔 示波器
1片； 1台； 1个； 1台；
74LS28(02)实验电路：
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实验一 基本门电路与三态门
异或门逻辑电路：
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实验一 基本门电路与三态门
74LS86实验电路：
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实验一 基本门电路与三态门
三态门逻辑电路：
74LS125的控制端G为低电平有效
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实验四 简单时序电路
3.异步十进制计数器：按设计接线，将Q0， Q1，Q2，Q3复位；由时钟端CLK输入单脉 冲，记录输出状态；由时钟端CLK输入连 续脉冲，观测输出波形。
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实验四 简单时序电路
4.自循环寄存器： (1)用双D触发器74LS74构成一个4位自循环 寄存器。方法是第1级的Q端接第2的D端， 依此类推，最后第4级的Q端接第1级的D端。 4个D触发器的CLK端连接在一起，然后接 单脉冲时钟。 (2)将Q0，Q1，Q2，Q3清0，再将Q0置1，按 单脉冲按钮，观察并记录Q0，Q1，Q2，Q3 的值。
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实验四 简单时序电路
实验报告要求: 1.写出实验内容1中，用单次脉冲做计数脉 冲时，Q3，Q2，Q1，Q0的状态转移表； 画出连续时钟下Q3，Q2，Q1，Q0的波形； 2./Q3，/Q2，/Q1，/Q0构成计数器吗？如 果是，那么是递增还是递减？
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实验四 简单时序电路
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实验一 基本门电路与三态门
实验内容： 分别测试74LS00，74LS28（02）， 74LS86一个逻辑门的输入与输出之间的 逻辑关系； 当74LS125的输出负载为74LS00一个与非 门输入端，当与非门另一输入端分别接 高，低电平时，测试74LS125的三态输出 和74LS00的输出；
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实验三 触发器
实验内容： 1.用74LS00构成一个RS触发器。R′,S′ 端接电平开关输出, Q,Q′端接电平指示 灯。改变R,S的电平，观测并记录Q,Q′ 的值。
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实验三 触发器
2.双D触发器74LS74中一个触发器功能测试。 （1）将CLR(复位), PR(置位)引脚接实验 台电平开关输出，Q,Q′引脚接电平指示 灯。改变CLR, PR的电平，观察并记录 Q,Q′的值。
输
Q2 0 0 0 0 1 1 1 1 0 0
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实验三 触发器
（2）在（1）的基础上，置CLR, PR引脚为 高电平，D(数据)引脚接电平开关输出， CP(时钟)引脚接单脉冲。在D为高电平和 低电平的情况下，分别按单脉冲按钮， 观察Q,Q′的值，记录下来。
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实验三 触发器
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实验二
数据选择器和译码器
实验内容: 测试74LS153中一个4选1数据选择器的逻 辑功能。 测试74LS139中一个2-4译码器的逻辑功能。
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实验二
数据选择器和译码器
实验提示: 74LS153的数据输入端C0~C3分别接实验 台上的10MHZ，1MHZ，500KHZ，100KHZ脉 冲源，改变数据选择端A，B和使能端G的 电平，观察各组合条件下数据选择器的 输出波形。 74LS139的译码输出Y0~Y3接电平指示灯， 改变使能端G和选择端B，A的电平，观测 并记录指示灯的显示状态。
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典型设计框图
Ya 七段 译码器 Yb Yc Yd Ye Yf Yg
a f
g e d c b
十进制 CLK CLR 计数器
Q3 Q2 Q1 Q0
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十进制计数器计数顺序表
计数
Q3 0 1 2 3 4 5 6 7 8 9 0 0 0 0 0 0 0 0 1 1
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实验三 触发器
双JK触发器实验电路图：
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实验三 触发器
JK触发器J=1，K=1时的输出波形：
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实验三 触发器
实验报告要求 总结触发器逻辑功能及特点。 整理实验中测试的结果，填好真值表， 画出波形图。 比较不同类型触发器的触发方式有什么 不同。
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实验四 简单时序电路
实验提示: 74LS73引脚11是GND，引脚4是VCC。 D触发器74LS74是上升沿触发，JK触发器 74LS73是下降沿触发。
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实验四 简单时序电路
D触发器构成的二进制计数器实验电路:
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集成电路芯片简介
数字电路实验中所用到的集成电路芯片 都是双列直插式的。现以74LS00芯片为 例，其引脚排列规则如图所示：
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实验一 基本门电路与三态门
实验器件和设备： 二输入四与非门：74LS00； 二输入四或非门：74LS28（02）； 二输入四异或门：74LS86； 四总线缓冲器（三态输出）：74LS125； TEC5数字电路实验系统； V-212 20MHZ双踪示波器。
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实验四 简单时序电路
实验目的 ： 掌握简单时序电路的分析,设计,测试方法。
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实验四 简单时序电路
实验器件和设备: 双J-K触发器：74LS73； 双D触发器器：74LS74； 四2输入与非门：74LS00； TEC5数字电路实验系统； V-212 20MHZ双踪示波器。
实验提示 ： 注意74LS73芯片的GND引脚是11，VCC引 脚是4 。
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实验三 触发器
RS室
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实验三 触发器
D触发器实验电路：
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实验三 触发器
D触发器输出波形：
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实验二
数据选择器和译码器
74LS139实验电路:
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实验二
数据选择器和译码器
实验报告要求: 画出实验接线图或逻辑电路图； 根据实验结果写出74LS139的真值表； 根据实验结果写出74LS153的真值表； 记录实验现象； 分析74LS139和74LS153中引脚G的功能。
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实验一 基本门电路与三态门
用74LS125两个三态门构成一条总线。两 控制端分别由高，低电平控制；两输入 端分别接1MHZ，500KHZ信号；用示波器 观察三态门的输出波形。
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实验一 基本门电路与三态门
实验提示： 注意认清所用器件型号和管脚，VCC与 实验台的+5V插孔连接，GND与实验台的 GND连接； 实验台的电平开关输出作为器件的输入， 拨动开关则改变器件的输入电平； 器件输出接实验台的电平指示灯，“1” 亮，“0”灭； 74LS125的控制端G为低电平有效。
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实验二 数据选择器和译码器
实验目的 ： 熟悉数据选择器的逻辑功能。 熟悉译码器的逻辑功能。
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实验二 数据选择器和译码器
实验器件和设备: 双4选1数据选择器74LS153； 双2-4线译码器74LS139； TEC5数字电路实验系统； TDS-1001 40MHZ双踪示波器。
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实验三 触发器
实验目的： 掌握RS触发器、D触发器、JK触发器的工 作原理。 学会正确使用RS触发器、D触发器、JK触 发器。
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实验三 触发器
实验器件和设备： 二输入四与非门：74LS00； 双D触发器：74LS74； 双JK触发器：74LS73； TEC5数字电路实验系统； V-212 20MHZ双踪示波器。
（3）在（1）的基础上，将D引脚接1MHz脉 冲源，CP引脚接10MHz脉冲源。用双踪示 波器同时观测D端和CP端，记录波形；同 时观测D端，Q端，记录波形。分析原因。 3. 制定对双JK触发器74LS73 一个JK触发 器的测试方案，并进行测试。
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实验三 触发器
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实验二
数据选择器和译码器
74LS153实验电路:
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实验二
数据选择器和译码器
74LS153实验电路:
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实验二
数据选择器和译码器
74LS139实验电路:
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