第十三、十四章 系统设计-TMS320F28335 DSP原理、开发及应用-符晓

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D(15:0) A(19:1) A(0) WE OE CS
外扩32位RAM的连接
16-bit SRAM
TMS320F28335
Select XWE1
XD(31:16) XD(15:0) XA(19:1)
XA0/XWE1 XWE0 XRD XR/W XZCS0 XZCS6 XZCS7
XREADY XCLKOUT
reserved
0x004000 0x005000 0x006000 0x007000 0x008000 0x009000 0x00A000 0x00B000 0x00C000 0x00D000 0x00E000 0x00F000 0x010000
XINTF Zone 0 (4Kw) PF 3 (4Kw) PF 1 (4Kw) reserved PF 2 (4Kw)
0x3FFFC0 0x3FFFFF
PASSWORDS (8w)
reserved ADC calibration data
reserved User OTP (1Kw)
reserved L0 SARAM (4Kw) L1 SARAM (4Kw) L2 SARAM (4Kw) L3 SARAM (4Kw)
第十三、十四章 系统设计
TMS320F28335 XINTF内存映射
0x000000 0x000400 0x000800
Data Program M0 SARAM (1Kw) M1 SARAM (1Kw)
0x000D00 PIE Vectors
(256 w)
0x000E00
PF 0 (6Kw)
0x002000
选择引导方式 调用ADC_cal 跳转到SARAM
ExitBoot
跳转到 0x000000
继续执行
Boot to SARAM引导方式流程
JTAG 仿真系统
(基于IEEE 1149.1边界扫描标准)
被测系统
Emulator Pod
SCAN IN
TMS320C2000
H
E
A
D
E
R
TMS320C2000
reserved XINTF Zone 6 (1Mw) XINTF Zone 7 (1Mw)
FLASH (256Kw)
0x33FFF8 0x340000 0x380080 0x380090 0x380400 0x380800 0x3F8000 0x3F9000 0x3FA000 0x3FB000 0x3FC000 0x3FE000
TMS320F28335 XINTF的信号
TMS320F28335
XD(31:16) XD(15:0) XA(19:1)
XA0/XWE1 XWE0 XRD XR/W XZCS0 XZCS6 XZCS7
XREADY XCLKOUT
XHOLD XHOLDA
数据总线
地址总线 写使能选通 读使能选通 读写信号线 区域片选
reserved
Boot ROM (8Kw)
BROM Vectors (64w)
Data Program
双映射: L0, L1, L2, L3
CSM保护的: L0, L1, L2, L3, OTP FLASH, ADC CAL, Flash regs in PF0
DMA可访问: L4, L5, L6, L7, XINTF Zone 0, 6, 7
硬件等待状态
共享存储器支持
外扩16位RAM的连接
TMS320F28335
16-bit SRAM
Select XA0
XD(31:16) XD(15:0) XA(19:1)
XA0/XWE1 XWE0 XRD XR/W XZCS0 XZCS6 XZCS7
XREADY XCLKOUT
XHOLD XHOLDA
L0 SARAM (4Kw) L1 SARAM (4Kw) L2 SARAM (4Kw) L3 SARAM (4Kw) L4 SARAM (4Kw) L5 SARAM (4Kw) L6 SARAM (4Kw) L7 SARAM (4Kw)
0x010000 0x100000
0x200000 0x300000
XRDLEAD
XRDACTIVE DSP latches data
XRDTRAIL
valid address
SRAM ta(A)
读操作的时序
valid data
XTIMING6 XTIMING7 XINTCNF2 XBANK XREVISION XRESET
0x0000-0B3A
1
XINTF版本寄存器
0x0000-0B3D
1
XINTF复位寄存器
引导方式的选择
复位
InitBoot
选择引导方式 调用ADC_cal 跳转到Flash
ExitBoot
跳转到 0x33FFF6
由用户编写 的跳转程序 决定下一条
指令地址
Boot to Flash引导方式流程
复位
InitBoot
SCAN OUT
仿真器和DSP连接示意图
小于6英寸
DSP JTAG接头
DSP硬件系统基本结构
电源电路
复位电路
时钟电路 JTAG 电路
TMS320F28335 DSP
XINTF
FPGA或外 部存储器
GPIO
电平转换及 驱动电路
AD输入前端 处理电路
XINTF的寄存器
地址单元
大小(×16bit)
寄存器说明
0x0000-0B20
2
XINTF区域0的时序寄存器
0x0000-0B2C
2
XINTF区域6的时序寄存器
0x0000-0B2E
2
XINTF区域7的时序寄存器
0x0000-0B34
2
XINTF配置寄存器
0x0000-0B38
1
XINTF区域切换控制寄存器
XHOLD XHOLDA
Low word
D(15:0) A(18:0)
WE OE CS
Hi word
D(15:0) A(18:0)
WE OE CS
16-bit SRAM
XINTF的时序
三个外部区域: 0, 6, 7 每个区域有独立的读、写时序 XREADY信号可用于延长等待时间
XZCS XRD XA[19:0] XD[…]
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