第8章 PCI总线标准
PCI总线
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1.1 PCI总线的特点
• 1．高性能 • 2．猝发传输模式 • 3．不受微处理器限制 • 4．采用总线主控和同步操作 • 5. 减少存取延迟 • 6．适用于各种机型 • 7．兼容性强 • 8．低成本、高效益 • PCI的芯片采用超大规模集成电路，节省布线空间，为微机的小型化和多功能化提
• 对于5V PCI标准连接器而言，如果PCI适配卡仅支持32位操作，则只用到管脚B1/Al 到B62/A62，管脚B63/A63到B94/A94只用于64位PCI适配卡。
• PCI局部总线的信号线共有100根，在一个PCI应用系统中，有主设备和从设备。从 设备至少需要47根信号线，主设备则需要49根信号线。利用这些信号线可以处理数 据、地址，实现接口控制、仲裁及系统功能。下面按功能分组说明5V PCI标准连接 器的引脚意义。
• 桥也叫桥连器，是一个总线转换部件，其功能是连接两条计算机总线，使总线间相互通讯。它可以 把一条总线的地址空间映射到另一条总线的地址空间，可以使系统中每一台总线主设备（Master） 能看到同样的一份地址表。
• 在PCI规范中，提出了三种桥的设计： • （1）主桥，就是CPU至PCI的桥。 • （2）标准总线桥，即PCI至标准总线如ISA、EISA、微通道之间的桥。例如INTEL设计的SATUNG
微型计算机原理与接口技术
PCI总线
• 随着微型计算机技术的广泛应用和不断发展，无论是办公自动化还是工业应用，对 微型计算机性能的要求都越来越高。在CPU从80286发展到386、486及目前的 Pentium水平的情况下，其数据宽度及工作频率也在不断提高。
PCI标准
PCIPCIPCI总线系统要求有一个PCI控制卡，它必须安装在一个PCI插槽内。
这种插槽是目前主板带有最多数量的插槽类型，在当前流行的台式机主板上，ATX结构的主板一般带有5～6个PCI插槽，而小一点的MATX主板也都带有2～3个PCI插槽。
根据实现方式不同，PCI控制器可以与CPU 一次交换32位或64位数据，它允许智能PCI辅助适配器利用一种总线主控技术与CPU并行地执行任务。
PCI允许多路复用技术，即允许一个以上的电子信号同时存在于总线之上。
普通PCI总线带宽一般为133MB/s(在32bit/33Mhz下)或者266MB/s（在32bit/66Mhz下）。
对于普通的声卡、百兆网卡、Modem 卡等扩展设备一般使用的是133MB/s的传输速率，这种设备的金手指特征一般是与PCI插槽对应（长-短），而对于部分PCI显卡、千兆网卡、磁盘阵列卡、USB2.0或者火线卡等需要较高带宽的PCI设备一般可以使用266MB/s的带宽，这种设备的特征是金手指一般是三段式（短-长-短）。
至于设备是否工作在66Mhz下可以通过软件everest查看，在PCI设备栏中选中需要观察设备并查看“66Mhz操作”是否为“已支持”，如果显示为“不支持”则表示这个设备最多只能使用133MB/s的带宽。
Intel在2001年春季的IDF上，正式公布了旨在取代PCI总线的第三代I/O技术，该规范由Intel支持的AWG(Arapahoe Working Group)负责制定。
2002年4月17日，AWG正式宣布3GIO1.0规范草稿制定完毕，并移交PCI-SIG（PCI特别兴趣小组，PCI-Special Interest Group）进行审核。
开始的时候大家都以为它会被命名为SerialPCI(受到串PCI行ATA的影响)，但最后却被正式命名为PCI Express，Express意思是高速、特别快的意思。
PCI总线是一种不依附于某个具体处理器的局部总线。
pcie规范
pcie规范PCIe（Peripheral Component Interconnect Express）是一种高速串行总线规范，用于在计算机系统中连接各种外部设备和扩展卡。
PCIe是一种基于总线结构的互联技术，它提供了更高的带宽和更快的数据传输速度，以满足现代计算需求日益增长的需求。
本文将详细介绍PCIe规范，包括其历史、特点、工作原理以及应用领域。
PCIe的历史可以追溯到1992年，当时英特尔、IBM和康柏就开始开发PCI（Peripheral Component Interconnect）总线规范，用于取代传统的ISA和VLB总线。
PCI总线规范在1993年发布，迅速成为标准计算机接口，并在20世纪90年代普及开来。
然而，随着计算机性能的不断提升和多媒体、网络等应用的广泛应用，PCI总线的带宽和性能已经无法满足需求。
为了提供更高的带宽和更快的数据传输速度，PCI-SIG（PCI Special Interest Group）于2004年发布了PCI Express规范，即PCIe 1.0版本。
PCIe采用了全新的串行总线结构，以替代传统的并行总线。
相较于PCI总线，PCIe具有更高的数据传输速度、更低的延迟、更高的带宽和更好的可伸缩性。
PCIe的特点主要体现在以下几个方面：1. 高速传输：PCIe提供了多个版本，每个版本都有不同的数据传输速率。
当前最常见的PCIe 3.0版本，具有每条通道8 Gbps的传输速度，每条通道相当于一个全双工的高速通道。
2. 可伸缩性：PCIe采用点对点连接的拓扑结构，每个设备都有一个独立的通道，与其他设备无冲突。
这种可伸缩性使得PCIe可以支持大量的设备以及更复杂的系统架构。
3. 低延迟：由于PCIe采用了串行传输，相较于并行总线具有更低的延迟，能够更快地处理数据。
4. 热插拔支持：PCIe支持热插拔特性，即可以在计算机运行时插入或拔出设备，而不需要重启计算机。
PCI总线标准协议(中文版)
8.4.2 PCI总线信号定义在一个PCI应用系统中，如果某设备取得了总线控制权，就称其为"主设备"；而被主设备选中以进行通信的设备称为"从设备"或"目标节点''。
对于相应的接口信号线，通常分为必备的和可选的两大类，为了进行数据处理、寻址、接口控制、仲裁等系统功能， PCI接口要求作为目标的设备至少需要47条引脚，若作为主设备则需要49条引脚。
下面对主设备与目标设备综合考虑，并按功能分组将这些信号表示在图8．19中。
其中，必要的引脚在左边，任选的引脚在右边。
一．信号类型说明图8．19 PCI引脚示图为了叙述方便，将PCI信号按数传方向及驱动特性划分为五种类型，各种类型的规定 如下：in：输入信号。
out：输出驱动信号。
t/s：表示双向三态输入／输出驱动信号。
s／t／s：持续三态（Sustained Tri-State），表示持续的并且低电平有效的三态信号。
在某一时刻只能属于一个主设备并被其驱动。
这种信号从有效变为浮空（高阻状态）之前必须保证使其具有至少一个时钟周期的高电平状态。
另一主设备要想驱动它，至少要等到该信号的原有驱动者将其释放（变为三态）一个时钟周期之后才能开始。
同时，如果此信号处于持续的非驱动状态时，在有新的主设备驱动它之前应采取上拉措施，并且该措施必须由中央资源提供。
o/d：漏极开路（Open Drain）可作线或形势允许多个设备共同使用，二． PCI总线信号定义PCI总线的信号线共有100根，下面按功能分组进行说明。
1．系统引线CLK in：时钟输入，为所有PCI上的接口传送提供时序。
其最高频率可达66MHz，最低频率一般为0（DC），这一频率也称为PCI的工作频率。
对于PCI的其他信号，除、、、之外，其余信号都在CLK的上升沿有效（或采样）。
in：复位，用来使PCI专用的特性寄存器和定时器相关的信号恢复规定的初始状况。
第8章 PCI总线标准
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8.1.3
PCI插槽和扩展卡 PCI插槽和扩展卡
PCI插槽 1. PCI插槽
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2.PCI插卡 2.PCI插卡 PCI
5V32位PCI卡尺寸 位 卡尺寸
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8.2
PCI总线命令及总线协议 PCI总线命令及总线协议
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C/BE[3:0]#： T/S， C/BE[3:0]#： T/S，总线命令和字节使能 多路复用信号线 多路复用信号线 PAR： T/S，针对AD[31:00]和C/BE[3:0]# PAR： T/S，针对AD[31:00]和 AD[31:00] 进行奇偶校验 校验位. 奇偶校验的 进行奇偶校验的校验位.
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3）接口控制信号
FRAME# ：S/T/S：帧周期信号,帧有效周期表示一次传输的开 S/T/S：帧周期信号,帧有效周期表示一次传输的开 始和持续。 始和持续。 S/T/S：主设备准备好信号( IRDY# ：S/T/S：主设备准备好信号(Initiator Ready) S/T/S：从设备准备好信号( TRDY# ：S/T/S：从设备准备好信号(Target Ready) TRDY#同时有效 才能从主设备传送数据到从设备。 同时有效, 注: IRDY#, TRDY#同时有效,才能从主设备传送数据到从设备。 S/T/S：从设备发出的要求主设备终止当前的数据传 STOP# ：S/T/S：从设备发出的要求主设备终止当前的数据传 送的信号。 送的信号。 LOCK#： S/T/S： LOCK#： S/T/S：锁定信号 IDSEL：IN，初始化设备选择信号（片选信号） IDSEL：IN，初始化设备选择信号（片选信号） S/T/S，设备选择信号， DEVSEL# ：S/T/S，设备选择信号，由从设备驱动
微机原理及接口第八章习题解答
“微机系统原理与接口技术”第八章习题解答（部分）1. 什么叫总线和总线操作？为什么各种微型计算机系统中普遍采用总线结构？答：总线是模块与模块之间传送信息的一组公用信号线；而模块间信息传送时与总线有关的操作统称为总线操作；模块间完成一次完整信息交换的时间称为一个总线操作周期。
总线标准的建立使得各种符合标准的模块可以很方便地挂在总线上，使系统扩展和升级变得高效、简单、易行。
因此微型计算机系统中普遍采用总线结构。
2．微机总线有哪些种类？其数据传输的主要过程是什么？答：微机中目前普遍采用的总线标准包括系统内总线标准和系统外总线标准两类：系统内总线标准一般指微机主板插槽（系统扩展板）遵循的各种标准，如PC/XT总线标准、ISA 总线标准（PC/AT总线标准）、VL总线标准（VESA具备总线标准）、PCI局部总线标准等；系统外总线标准指系统互连时遵循的各种标准，多表现为微机对外的标准接口插头，有时也称为接口标准，如EIA RS-232异步串行接口标准、USB通用串行接口标准、IEEE-488通用并行接口标准等。
一个总线操作周期一般分为四个阶段，即：总线请求及仲裁阶段、寻址阶段、传数阶段和结束阶段。
在含有多个主控制器的微机系统中，这四个阶段都是必不可少的；而在仅含一个主控制器的单处理器系统中，则只需要寻址和传数两个阶段。
3．计算机系统与外部设备之间相互连接的总线称为系统外总线（通信总线）；用于连接微型机系统内各插件板的总线称为系统内总线（板级总线）；CPU内部连接各寄存器及运算部件之间的总线称为片内总线。
4．一次总线的信息传送过程大致可以分为4个阶段，依次为总线请求及仲裁阶段、寻址阶段、传数阶段和结束阶段。
8．同步总线有哪些优点和缺点？主要用在什么场合？答：同步并行总线时序是指总线上所有信号均以同步时钟为基准，所有接在总线上的设备的信息传输也严格与同步时钟同步。
同步并行总线的优点是简单、易实现；缺点是无法兼容总线上各种不同响应速度的设备，因为同步时钟的速度必须以最慢的响应设备为准，这样总线上的高速设备将无法发挥其高速性能。
pci总线结构介绍
PCI总线简介
PCI是外围设备互连（Peripheral Component Interconnect）的简称 ，作为一种通用的总线接口标准，它在目前的计算机系统中得到了非常 广泛的应用。PCI提供了一组完整的总线接口规范，其 目的是描述如何 将计算机系统中的外围设备以一种结构化和可控化的方式连接在一起， 同时它还刻画了外围设备在连接时的电气特性和行为规约，并且详细定 义了计 算机系统中的各个不同部件之间应该如何正确地进行交互。 pci总线在x86体系中比较常见，在arm体系的cpu里基本没有pci总线
PCI配置寄存器
（一）pci配置寄存器 每个pci设备都有一个私有的至少256字节的地址空间，前64字节是标准 的（每个pci设备都有），后面的空间依赖设备来配置。 配置寄存器里包含了如下信息： 1.此pci设备的设备信息,如厂商id，设备id等 2.此设备工作时需要的io地址和mem地址起始地址以及长度 3.设备的irq号等 （二）配置寄存器的作用 1.linux内核启动时会从pci设备的配置寄存器里读取内存/IO起始地址 以及irq，并把这些信息赋值给struct pci_dev的相应成员； 2.pci驱动也会读写配置寄存器获得/保存设备相关的信息。 （三）配置寄存器的初始化 系统启动时，BIOS会为每个pci设备分配内存、IO空间以及irq号，并写 入相应pci设备的配置寄存器里去。
物理结构
设备注册
资源分配 设备和驱动的匹 配方式
驱动和设备的匹配
当调用pci_register_driver(struct pci_driver *drv)时，系统会 遍历pci总线上的所有的pci设备，并拿每个pci设备来和驱动进行匹配： pci_bus_match->pci_match_device->pci_match_one_device
PCI标准规范
总线的布线有什么特殊要求PCI总线的布线有什么特殊要求 作者:kyoman_hu 来自:中国PCB技术网论坛 时间:2004-12-27我们可以从下面的几点来分析一下PCI：1 首先，PCI系统是一个同步时序的体统，而且是Common clock方式进行的。
2 PCI的电平特点是依靠发射信号叠加达到预期的电平设计。
3 PCI系统一般是多负载的情况，一个PCI的桥片最多按照PCI的规范可以带6个负载（好像一般系统也不会操作5个）。
4 PCI的拓扑结构可以是菊花链等多种拓扑结构，选择什么样的拓扑结构需要根据系统的布局和仿真结果进行设计。
5 另外PCI的AD信号线是双向的，需要在布局和仿真的时候关注PCI的slave和Master 之间的关系。
指导了上面的几个问题我们可以根据PCI规范以及PCI的仿真结果大致得到下面的几个约束：1 PCI的各个时钟之间的Skew不要大于2ns。
2 PCI的flight time不要超过10ns（自己拿一个系统计算就知道为什么这样规定了），这个是针对33M PCI进行越是的，这个延时只的信号从一个设备传输到另一个设计后，经过反射回到最初的芯片的传输延时，包括，PCB走线延时，和因为驱动器buffer（包括拓扑）造成的信号畸变的延时。
3 PCI的阻抗设计需要根据实际的系统进行仿真决定，PCI规范的推荐值在50－110ohm之间。
4 需要考虑一些特殊的信号走线的延时，比如REQ＃。
可以查一下规范我记着应该有特殊的要求。
5 PCI规范上面规定的2.5"和1.5"的大小那是为了规范各个不同的PCI厂家的规范进行的。
如果你在系统的板上面进行设计，只要计算的时序满足要求就可以了。
6 如果存在PCI的桥片，这些桥片一般都会通过PLL或者DLL的时钟调节PCI设计的setup 和hold时间，这些时钟的处理可以根据实际的芯片进行调整，一般的要求是延时和PCI CLk 的一样，记住这里的延时不仅仅是指PCB走线的延时。
中国PCI指南
使用Web应用服务器，如Tomcat、Nginx等，负责处理HTTP请求和响应。
应用服务器
采用关系型数据库管理系统，如MySQL、Oracle等，以及非关系型数据库，如MongoDB、Redis等。
数据存储
平台架构
所有数据集中存储在一个大型数据库中，适用于单一数据中心。
集中式架构
将数据分散到多个数据库中，适用于分布式架构。
分片式架构
将数据分散到多个分片中，每个分片部署在不同的节点上，适用于大规模应用。
分布式架构
数据库架构
中国PCI编程模型
03
01
C/CC/C是目前使用最为广泛的基础编程语言，可用于实现各种复杂的功能，包括数据处理、算法实现、内存管理等。
编程语言
02
Python：Python是一种易学易用的编程语言，适合用于数据分析、机器学习、Web开发等应用领域。
局域网
01
适用于中小型规模，通过交换机、路由器等设备实现网络隔离与传输。
网络架构
广域网
02
适用于大型规模，通过多种传输协议与技术实现数据传输与通信。
互联网
03
适用于跨地域、跨行业、跨国界的业务，通过虚拟专用网络(VPN)等实现安全、高速、稳定的远程连接。
系统架构
选择稳定、安全、易用的操作系统作为基础，如Windows Server、Linux等。
与IoT结合
物联网技术可以帮助企业实现全面的智能化和自动化，将PCI与IoT技术相结合，可以更好地满足企业的数据处理和安全需求，促进产业升级和发展。
PCI和新技术结合方向
中国PCI指南总结
06
PCI指南对于中国心血管病的预防和治疗具有重要的意义。它为医生和患者提供了科学、规范的治疗依据，有利于提高心血管病的诊疗水平，并推动中国心血管健康事业的发展。
PCI总线与PCI Express
PCI总线的发展
最早提出的PCI 总线属于32位总
线，工作在33MHz 频率之下，传输带宽
达到了133MB/s，基本上满足了当时处理
器的发展需要。随着对更高性能的要求，
1993年又提出了64位的PCI 总线，后来 又把PCI 总线的频率提升到66MHz .目前 广泛采用的是32位、33MHz 的PCI 总线。
在通讯领域的应用
Thanks!
PCI总线与PCI Express
微型计算机系统中使用 的各种芯片、各种板卡 内元器件之间、各板卡 之间的连接，都是通过 总部件之间传送信息的公共 通信干线，它是由导线组成 的传输线束。
一般所说的总线包括系统总线和局部总线。 系统总线是指连 接计算机系统内 部（板、卡）和 传输信息的一组 信号线。ISA、 EISA总线等属于 系统总线。
（2）ISA总线
ISA（Industrial Standard Architecture）总线标准是IEEE委 员会和Intel等公司，于1984年为16位微型计算机推出的系统总线标准， 它是对PC总线的拓展，以适应8/16位数据总线要求。ISA总线有98条引脚。
PCIe是什么？PCIe标准和PCIe布线规则总结概述
PCIe是什么？PCIe标准和PCIe布线规则总结概述PCI-Express(peripheral component interconnect express)是一种高速串行计算机扩展总线标准，它原来的名称为“3GIO”，是由英特尔在2001年提出的，旨在替代旧的PCI，PCI-X和AGP总线标准。
PCIe属于高速串行点对点双通道高带宽传输，所连接的设备分配独享通道带宽，不共享总线带宽，主要支持主动电源管理，错误报告，端对端的可靠性传输，热插拔以及服务质量(QOS)等功能。
PCIe交由PCI-SIG（PCI特殊兴趣组织）认证发布后才改名为“PCI-Express”，简称“PCI-E”。
它的主要优势就是数据传输速率高，目前最高的16X 2.0版本可达到10GB/s，而且还有相当大的发展潜力。
PCI Express也有多种规格，从PCI Express 1X到PCI Express 32X，能满足将来一定时间内出现的低速设备和高速设备的需求。
PCI-Express最新的接口是PCIe 3.0接口，其比特率为8GB/s，约为上一代产品带宽的两倍，并且包含发射器和接收器均衡、PLL改善以及时钟数据恢复等一系列重要的新功能，用以改善数据传输和数据保护性能。
INTEL、IBM、LSI、OCZ、三星(计划中)、SanDisk、STEC、SuperTalent和东芝(计划中)等，而针对海量的数据增长使得用户对规模更大、可扩展性更强的系统所应用，PCIe 3.0技术的加入最新的LSI MegaRAID控制器及HBA产品的出色性能，就可以实现更大的系统设计灵活性。
当然，主流主板都能能支持PCI Express 1.0 16X，也有部分较高端的主板支持PCI Express 2.016X。
PCIe标准PCI Express卡适合其物理尺寸或更大的插槽（使用×16作为最大的），但可能不适合更小的PCI Express插槽;例如，×16卡可能不适合×4或×8插槽。
pci总线标准协议
pci总线标准协议PCI总线标准协议。
PCI（Peripheral Component Interconnect）总线是一种用于连接外部设备和主板的总线标准，它是一种高速、并行的总线结构，可以支持多种设备的连接。
PCI总线标准协议是为了规范PCI总线的通信协议而制定的，它规定了PCI设备之间的通信方式、数据传输规范和电气特性等，对于PCI设备的互操作性和兼容性起到了重要的作用。
首先，PCI总线标准协议规定了PCI设备之间的通信方式。
PCI设备之间的通信是通过地址、数据和控制信号进行的，协议规定了这些信号的传输方式和时序要求，确保了设备之间的正常通信。
同时，协议还规定了总线仲裁、数据传输和中断请求等机制，保证了多个设备之间的协调工作。
其次，PCI总线标准协议规定了数据传输的规范。
在PCI总线上，数据传输是通过读写操作进行的，协议规定了数据传输的时序、速率和错误检测等要求，保证了数据的可靠传输。
此外，协议还规定了总线的带宽分配和数据缓冲机制，以提高数据传输的效率和可靠性。
另外，PCI总线标准协议还规定了PCI设备的电气特性。
由于PCI总线是一种并行总线，对于信号的电平和时序要求非常严格，协议规定了总线上信号的电气特性，包括电压、电流和信号波形等，以确保设备能够正常工作并且不会对其他设备造成干扰。
总的来说，PCI总线标准协议是对PCI总线通信协议的规范，它规定了PCI设备之间的通信方式、数据传输规范和电气特性等，保证了设备之间的互操作性和兼容性。
在实际应用中，遵循PCI总线标准协议可以有效地提高系统的稳定性和可靠性，同时也为设备的设计和开发提供了统一的标准，促进了整个行业的发展。
总的来说，PCI总线标准协议是一项非常重要的技术规范，它为PCI设备的设计、开发和应用提供了统一的标准，保证了设备之间的互操作性和兼容性。
在实际应用中，遵循PCI总线标准协议可以有效地提高系统的稳定性和可靠性，同时也为设备的设计和开发提供了统一的标准，促进了整个行业的发展。
PCI总线
PCI总线随着Windows图形用户界面的迅速发展，以及多媒体技术的广泛应用，要求系统具有高速图形处理和I/O吞吐能力。
为了适应计算机的这种发展要求，Intel公司首先提出了PCI（ Peripheral ComponentInterconnect ）总线概念。
之后Intel联合IBM、Compaq、AST、HP、 Apple、NCR、DEC 等100多家公司共同开发总线，并于1993年推出了PCI总线标准。
目前PCI已称为一种新的总线标准，广泛用于微机、工作站以及便携式计算机中。
1. PCI总线的特点PCI 总线主要有以下一些特点：（1）数据传输率高PCI的数据总线宽度为32位，并可扩充到64位。
它以33.3MHz或66.6MHz的时钟频率工作，若采用32位数据总线，数据传送速率可达133 MB／s；而采用64位宽度，则最高传输速率可达266 MB／s。
（2）支持猝发传输(Burst Transmission)通常的数据传输是先输出地址后进行数据操作，即使所要传输数据的地址是连续的，每次也要有输出和建立地址的阶段。
而PCI支持猝发数据传输周期，该周期在一个地址相位(phase)后可跟若干个数据相位。
这意味着传输从某一个地址开始后，可以连续对数据进行操作，而每次的操作数地址是自动加l形成的。
显然，这减少了无谓的地址操作，加快了传输速度。
这种传输方式对使用高性能图形设备尤为重要。
（3）支持多主设备在同一条PCI总线上可以有多个主设备，各个主设备通过总线仲裁竞争总线控制权。
相比之下，在ISA总线系统中，DMA控制器和CPU对总线的争用是不平等的，DMA控制器采用“周期窃取”法向 CPU申请总线，得到CPU允许后才能使用总线。
而PCI总线专门设有总线占用请求和总线占用允许信号，各个主设备平等竞争总线。
（4）独立于处理器传统的系统总线(如ISA总线 ) 实际上是CPU引脚信号的延伸或再驱动，而PCI总线以一种独特的中间缓冲器方式独立于处理器，并将CPU子系统与外围设备分开。
PCI总线原理
PCI即Peripheral Component Interconnect，中文意思是“外围器件互联”，是由PCISIG (PCI Special Interest Group)推出的一种局部并行总线标准。
在现在电子设备中应用非常广泛，下面我详细介绍下PCI总线的工作原理，希望对大家有所帮助。
♦PCI总线的过去现在和未来PCI总线是由ISA(Industy Standard Architecture)总线发展而来的，ISA并行总线有8位和16位两种模式，时钟频率为8MHz，总线带宽为：8bit*8MHz=64Mbps=8MB/s 或16bit*8MHz= 128Mbps =16MB/s。
在计算机出现初期的386/486时代，ISA总线的带宽已经算是很宽的了，满足CPU的需求可以说是绰绰有余了。
1987年，IBM公司推出32位MAC(MicroChannel Architecture)总线，总线带宽达到40MB/s，迫于IBM的压力，Compaq、AST、Epson、HP、Olivetti和NEL等9家公司联合于1988年9月推出EISA(Extended ISA)总线，EISA总线仍然保持ISA总线的8MHz时钟频率，但将总线位宽提高到32位，总线带宽为：32bit*8MHz=256Mbps = 32MB/s，并且与ISA总线完全兼容。
随着计算机技术的继续发展，CPU的处理速度越来越快，EISA总线的32MB/s 带宽已经满足不了CPU的需求，CPU外围总线带宽已经成为制约计算机处理能力继续提高的瓶颈。
1991年下半年，Intel公司首选提出PCI总线的概念，并与IBM、Compaq、AST、HP、DEC等100多家公司成立PCISIG组织，联合推出PCI总线。
PCI总线支持32位和64位两种位宽，时钟频率为33MHz，总线带宽：32bit*33MHz= 1056Mbps =132MB/s 或64bit*33MHz=2112Mbps=264MB/s。
总线标准有哪些
总线标准有哪些总线标准是指在计算机系统中，不同设备之间进行数据传输的接口标准。
它规定了数据传输的格式、速率、传输方式等，是计算机系统中非常重要的一部分。
在现代计算机系统中，有许多不同的总线标准，每种标准都有其特定的应用场景和优势。
下面将介绍几种常见的总线标准。
首先，我们来介绍一下最常见的总线标准之一——PCI总线标准。
PCI （Peripheral Component Interconnect）总线是一种用于连接计算机内部外设的标准总线。
它具有高带宽、高速度的特点，适用于连接硬盘、显卡、网卡等高速数据传输设备。
PCI总线标准有多个版本，包括PCI、PCI-X和PCI Express，它们分别适用于不同的应用场景和需求。
另外一种常见的总线标准是USB（Universal Serial Bus）总线。
USB总线是一种用于连接外部设备的标准总线，它具有热插拔、即插即用的特点，适用于连接键盘、鼠标、打印机、摄像头等外部设备。
USB总线标准也有多个版本，包括USB 1.0、USB 2.0、USB 3.0和最新的USB 4.0，每个版本都在传输速率、功耗管理等方面进行了改进。
除了PCI和USB总线标准，还有一种常见的总线标准是SATA（Serial ATA）总线。
SATA总线是一种用于连接存储设备的标准总线，它适用于连接硬盘、固态硬盘等存储设备。
SATA总线标准也有多个版本，包括SATA 1.0、SATA 2.0、SATA 3.0等，每个版本都在传输速率、数据完整性等方面进行了改进。
此外，还有一种重要的总线标准是PCIe（Peripheral Component Interconnect Express）总线。
PCIe总线是一种用于连接高性能扩展卡的标准总线，它具有高带宽、低延迟的特点，适用于连接显卡、网卡、存储控制器等高性能扩展设备。
PCIe 总线标准也有多个版本，包括PCIe 1.0、PCIe 2.0、PCIe 3.0和PCIe 4.0，每个版本都在传输速率、数据完整性等方面进行了改进。
pci e总线标准
pci e总线标准PCI Express（Peripheral Component Interconnect Express）是一种计算机总线标准，用于连接外部设备到计算机。
它是一种高速串行通信接口，用于连接内部硬件设备，如图形卡、网络适配器和存储设备。
PCIe总线标准已经成为现代计算机系统中最常见的总线标准之一，其高速、可靠和灵活的特性使其成为了许多计算机硬件设备的首选接口。
PCIe总线标准最初由英特尔公司于2004年引入，并在随后的几年内不断发展和演进。
它取代了旧的PCI和AGP总线标准，为计算机系统提供了更高的带宽和更低的延迟。
PCIe总线标准采用了不同的版本，包括PCIe 1.0、PCIe 2.0、PCIe 3.0和PCIe 4.0，每个版本都提供了不同的数据传输速率和带宽。
PCIe总线标准的设计采用了一种点对点连接的架构，这意味着每个设备都直接连接到主板上的PCIe插槽，而不需要共享带宽或资源。
这种架构使得PCIe总线标准能够支持高性能的设备，并且在多设备同时工作时不会出现性能瓶颈。
PCIe总线标准还支持热插拔功能，这意味着用户可以在计算机运行的情况下插入或拔出PCIe设备，而不会影响系统的稳定性或性能。
这为用户提供了更大的灵活性和便利性，使他们能够随时升级或更换硬件设备。
除了传统的PCIe插槽，PCIe总线标准还引入了M.2接口，这是一种更小、更紧凑的接口，用于连接固态硬盘和无线网卡等设备。
M.2接口可以通过PCIe总线标准提供更高的带宽和更快的数据传输速率，使得这些设备能够更好地发挥性能。
总的来说，PCIe总线标准是一种高速、可靠和灵活的计算机总线标准，它已经成为了现代计算机系统中最常见的接口之一。
它的设计和特性使得它能够支持高性能的设备，并且为用户提供了更大的灵活性和便利性。
随着技术的不断发展，PCIe 总线标准将继续演进和改进，为计算机硬件设备的发展提供更好的支持和基础。
局部总线(PCI、PCI Express)
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1.1PCI总线
PCI总线系统结构
PCI总线结构中HOST-PCI桥与PCI总线相连，这个桥提供了数据缓冲功能， 是一个低延迟的访问通道，使处理器能够访问PCI设备，PCI设备也能够访 问主存。桥电路中包含有PCI总线控制器，有多个设备申请使用总线时，能 够进行裁决和分配总线的使用权。实际上，HOST-PCI桥是一个高速的I/O 协处理器。
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1.1PCI总线
PCI总线的特点
传输效率高
PCI总线采用33.3MHz/66.6MHz的时钟频率。在33.3MHz时钟频率时，数据总 线宽度32位，最大数据传输率达到133MB/s。如果数据总线宽度升级到64位， 则数据传输率可达到266MB/s。
多总线共存
PCI总线是通过桥芯片进行不同标准信号之间的转换。通过HOST-PCI桥芯片， 实现PCI与CPU总线相连接；通过PCI-ISA/EISA桥芯片，实现PCI与ISA或者 EISA相连接。这样，使得多种总线可以共存于一个系统中，慢速和高速设备就 可以分别挂在不同的总线上。
另外的桥接器用于形成多级总线结构，有PCI-ISA，PCI-USB，PCI-PCI等， 使得系统中不同类型的设备共存，合理地分配资源。
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图11.1PCI总线系统结构
SCSI 控制器
高速I/O
高速缓存 CACHE
PCI局部总线规范
PCI局部总线规范——版本2.1目录一( 简要介绍二( 信号定义三( 总线操作四( 电器规范五( 机械规范六( 配置空间第一章简要介绍外围组件接口技术(Peripheral Component Interconnect PCI)是一种新型的高带宽、处理器无关的总线系统。
它既可以作为中间层的总线也可以作为周边总线系统使用。
与其他普通总线规范想对照，PCI 总线为高速I/O设备提供了更好的支持(比如图形适配器、网络接口控制器、磁盘控制器，等等)。
现行的标准允许在33Mhz下使用64根数据线，纯传输速率可达2.11Gbps。
但是PCI吸引人的地方不在于它的高速度，它适应了现代I/O设备对系统的要求，并且只需要很少的芯片就可以实现并支持其他总线系统。
PCI被设计为支持各种处理器环境，所以它提供了很多通用的功能，这些功能是构筑在同步时序和中央仲裁机制基础上的。
PCI局部总线是为了在高集成化外围控制设备，系统/存储器等之间提供一种交互的机制。
下图是一个典型的PCI局部总线系统的结构。
PCI局部总线有如下特点:高性能、低费用、易用性、耐用性、可靠性、灵活性、软件兼容性。
这些特点在后面可以看出。
第二章总线定义PCI能够作为32或64位总线使用。
它们可以按照功能不同化为以下几组: 1(系统引脚:包括时钟和重启引脚。
2(地址和数据引脚:包括32条传输地址和数据的引线，其余的引线是为了配合它而使用的。
3(接口控制引脚:用来保持master和target之间通信的一致性。
4(仲裁引脚:和其他的PCI信号线不同，这些不是共享的数据线。
每一个PCI master都有它自己的仲裁信号线来直接和ARBITOR相连接。
5(错误监测引脚:用于奇偶校验和其他错误的报告。
除此而外，PCI还提供了另外50条可选的信号线来支持中断、缓存、及64位扩展等功能。
对于只做target 设备的PCI设备而言，至少需要47个管脚;而对于用作master的设备而言，至少需要48个管脚。
PCI总线标准协议（中文版）
PCI总线标准协议（中⽂版）8.4.2 PCI总线信号定义在⼀个PCI应⽤系统中，如果某设备取得了总线控制权，就称其为"主设备"；⽽被主设备选中以进⾏通信的设备称为"从设备"或"⽬标节点''。
对于相应的接⼝信号线，通常分为必备的和可选的两⼤类，为了进⾏数据处理、寻址、接⼝控制、仲裁等系统功能， PCI接⼝要求作为⽬标的设备⾄少需要47条引脚，若作为主设备则需要49条引脚。
下⾯对主设备与⽬标设备综合考虑，并按功能分组将这些信号表⽰在图8．19中。
其中，必要的引脚在左边，任选的引脚在右边。
⼀．信号类型说明图8．19 PCI引脚⽰图为了叙述⽅便，将PCI信号按数传⽅向及驱动特性划分为五种类型，各种类型的规定如下：in：输⼊信号。
out：输出驱动信号。
t/s：表⽰双向三态输⼊／输出驱动信号。
s／t／s：持续三态（Sustained Tri-State），表⽰持续的并且低电平有效的三态信号。
在某⼀时刻只能属于⼀个主设备并被其驱动。
这种信号从有效变为浮空（⾼阻状态）之前必须保证使其具有⾄少⼀个时钟周期的⾼电平状态。
另⼀主设备要想驱动它，⾄少要等到该信号的原有驱动者将其释放（变为三态）⼀个时钟周期之后才能开始。
同时，如果此信号处于持续的⾮驱动状态时，在有新的主设备驱动它之前应采取上拉措施，并且该措施必须由中央资源提供。
o/d：漏极开路（Open Drain）可作线或形势允许多个设备共同使⽤，⼆． PCI总线信号定义PCI总线的信号线共有100根，下⾯按功能分组进⾏说明。
1．系统引线CLK in：时钟输⼊，为所有PCI上的接⼝传送提供时序。
其最⾼频率可达66MHz，最低频率⼀般为0（DC），这⼀频率也称为PCI的⼯作频率。
对于PCI的其他信号，除、、、之外，其余信号都在CLK的上升沿有效（或采样）。
in：复位，⽤来使PCI专⽤的特性寄存器和定时器相关的信号恢复规定的初始状况。
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4.仲裁信号
• REQ# T/S：总线占用请求信号 • GNT# T/S：总线占用允许信号
5.错误报告信号
• PERR# S/T/S：数据奇偶校验错误报告信号 • SERR# O/D：系统错误报告信号
6.中断信号
PCI有4条中断线，分别是INTA#、INTB#、INTC#、 INTD# ，电平触发，多功能设备可以任意选择一 个或多个中断线，单功能设备只能用INTA#。
1．配置空间的寻址方法 访问PCI设备配置空间时的必要条件： 1)只有当输入目标设备的IDSEL信号有效。 配置访问不使用地址总线的AD[31:11]。 。利用地址总线的高21位产生IDSEL。 。桥设备通过译码产生IDSEL。 2)且在地址期内AD[1:0]为00时，才能被 作为配置访问的目标设备。 3) AD[7:2]配合C/BE#信号选择配置寄存器。
图8.1 PCI总线接口信号
2.地址与数据接口信号
1.
AD[31:00] T/S：它们是地址、数据多路复用的输入/输出信号 在FRAME#有效的第1个时钟，AD[31:00]上传送的是32位地址，称为 地址期。
2.
在IRDY#和TRDY#同时有效时，AD[31:00]上传送的为32位数据，称为 数据期。注: 一次总线传输=地址期+数据期+数据期+…
7. 64位总线扩展信号
• AD[63:32] T/S：扩展的32位地址和数据多路复用线 • C/BE[7:4]# T/S：总线命令和字节使能多路复用扩展 信号线 • REQ64# S/T/S，64位传输请求信号ACK64# S/T/S： 64位传输允许信号 • PAR64 T/S：奇偶双字节校验
(4)基址寄存器(BADR)
PCI设备的配置空间可以在微处理器决定的地址 空间中浮动，以便简化设备的配置过程。 • 地址映射:系统初始化代码在引导操作系统之前， 必须建立一个统一的地址映射关系，以确定系统 中有多少存储器和I/O控制器，它们需要占用多 少地址空间。当确定这些信息之后，系统初始化 代码便可以把I/O控制器映射到合理的地址空间 并引导系统。 • 基址寄存器:为了使这种映射能够做到与相应的 设备无关，在配置空间的头区域中安排了一组供 映射时使用的基址寄存器。
第8章 PCI局部总线
PCI总线概述 总线命令及总线协议
PCI总线的数据传输
总线仲裁与总线配置
PCI总线控制芯片S5933
PCI总线的特点：
1)高传输效率:133~266MB/S 2)支持突发传输(顺序读/写一批数据) 3)独立于处理器(不依附于某个具体处理器) 4)支持两种电压下的扩展卡(5V,3.3V) 5)支持多总线主控方式 6)存取时间延迟小 7)数据的完整性和可靠性 8)具有即插即用功能(自动选择未使用中断和地址) 9)合理的管脚安排
无DEVSEL#信号时的处理。
8.3 PCI总线的数据传输过程 8.3.1．总线上的读操作
等待 等待 4读数据 等待 6读数据 8最后读
交换期
从设备
提供
8.3.2 总线上的写操作
3,4写数据 5,6,7等待 8最后
8.3.3 传输的终止过程
1.由主设备提出的终止 (1) 传输结束 (2) 超时(GNT#信号在内部延时计数器满后仍无效) 撤消FRAME#，建立IRDY#，直到TRDY#有效 后传输完最后一个数据。 2.由从设备提出的终止(发出STOP#信号) (1) 死锁后重试 (2) 断开（8个时钟周期内从设备不能对主设备做出 响应）。 发出STOP#信号并保持其有效，直到FRAME#撤 消为止。
举例1：基址寄存器的值=FFFFFF01h =11111111111111111111111100000001b
位0=1，表示是一个I/O地址空间映射 位[31:2] 第一个为1的是位8，表示映射的I/O空
间为256。 这意味着I/O映射的基地址应该起始于256的整 数倍。
0/1类配置空间访问时在AD总线的地址期 内出现在AD总线上的信息格式：
0类访问 ：
31 10 7 0
保留
功能编号
寄存器编号
00
一类访问：
31 23 15 10 7 0
保留
总线编号
设备编号
功能编号
寄存器编号
01
1类配置空间访问
• 对（通过PCI/PCI桥连接的）下一级PCI总线上的目标设备 （配置寄存器）所进行的访问。 • 地址期：AD[10∶8]用于选择物理设备的八种功能之一。 AD [7∶2]为选择该功能设备的配置寄存器号；AD[15∶11] 用于选择第二级总线上的某个设备的IDSEL信号有效， AD[23∶16] 放总线号，AD[1∶0]必须为01。 • 一旦PCI/PCI桥检测到1类配置访问，就有三种情况，须分 别进行处理。 • 桥片中也有桥配置空间寄存器，存放有总线号和次级总线 号等信息。
PCI总线上的所有传输操作中，FRAME#、 IRDY#、TRDY#和STOP#遵循的规则：
1. 当STOP#信号有效时，FRAME#应该在其后的2~3个 时钟周期内尽快撤消，但撤消时应使IRDY#有效， 从设备应无条件的保持STOP#的有效状态直到 FRAME#撤消为止。FRAME#撤消后，STOP#也应该 紧跟着撤消。 2. 在任何时钟的上升沿，如果STOP#和TRDY#同时有 效，就表示是传输的最后周期，IRDY#要在下一 个时钟的上升沿之前撤消，表示传输的结束。 3. 对于被目标设备终止的传输，主设备要继续完成 它，就必须用下一个未传输的数据的地址来重试 访问。
3、配置空间头区域(64DW)及功能
(1)设备识别 头区域有7个寄存器（字段）用于设备的识别。 (2)设备控制 表现在命令寄存器为发出和响应PCI总线命令提 供了对设备粗略的控制。 (3)设备状态 状态寄存器用于记录PCI总线有关操作的状态 信息。 注意：该寄存器的有些位是只可清不可置，对这些 位的写，被解释为对该位清零。 例如，为了清位14而不影响其他位，应向该寄存器 写0100 0000 0000 0000B
PCI设备的配置空间为即插即用(PnP)提供支持，完 全实现设备的再定位。 • PCI设备是一个物理设备，包括嵌入在PCI总线上的 PCI器件或者是插入PCI插槽上的PCI卡 • PCI功能是一个PCI物理设备可能包含的具有独立功 能的逻辑设备，一个PCI设备可以包含1～8个PCI功 能。如：一个PCI卡上可以包含一个独立的打印机 模块，两个独立的数据采集器和一个独立的RS-485 通信模块等。PCI规范要求每个功能都配备一个 256B(64DW) 的配置空间。
8.4 总线仲裁与总线配置
8.4.1 PCI总线仲裁机制
• PCI总线采用集中式的同步仲裁方法 • 握手方式:请求(REQ#)-允许(QET#)
1.发REQ,请求 占用总线
2.允许
占用
总线仲裁过程:
1 6 2 3 7 4 5 8 9
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8.4.2 PCI总线的配置空间
PCI设备的配置空间(64DW的配置寄存器)
8.1.2 PCI信号定义
主设备:取得总线控制权的设备. 从设备:被主设备选中进行数据交换的设备. 信号类型: IN 单向输入信号,OUT:单向输出信号 T/S:双向三态输入/输出信号. S/T/S:持续且低电平有效的三态信号(主设备产生). O/D: 漏极开路. #: 低电平有效 1.系统接口信号 • CLK IN：PCI系统总线时钟。最高 33MHz/66MHz，最低0Hz。 PCI大部分信号在 CLK的上升沿有效。 • RST#: IN 复位信号
11空闲 00数据 01等待 10最后
PCI总线传输的一般规则：
(1) FRAME# 和IRDY#信号定义了总线的忙/ 闲状态。 (2) 一旦FRAME#信号被置为无效，在同一传 输期间不能重新设置。 (3) 除非设置了IRDY#信号有效，一般情况下 不能设置FRAME#信号无效。 (4) 一旦主设备设置了IRDY#信号，直到当前 数据期结束为止，主设备一般不能改变 IRDY#信号和FRAME#信号的状态。 (5) 在完成最后一个数据期之后的时钟周期， 主设备必须使IRDY#信号无效。
C/BE[3:0]# T/S：它们是总线命令和字节使能多路复用信号线
PAR T/S：针对AD[31:00]和C/BE[3:0]#进行奇偶校验的校验位.
3.接口控制信号
FRAME# S/T/S：帧周期信号,帧有效周期表 示一次传输的开始和持续。Cycle Frame) IRDY# S/T/S：主设备准备好信号(Initiator Ready) TRDY# S/T/S：从设备准备好信号(Target Ready) 注: IRDY#, TRDY#同时有效,才能从主设备传送 数据从设备. STOP# S/T/S：从设备发出的要求主设备终 止当前的数据传送的信号。 LOCK # S/T/S：锁定信号 IDSEL IN：初始化设备选择信号 DEVSEL# S/T/S：设备选择信号
在系统启动的时候由BIOS代码执行设备配置。 一旦即插即用OS（如Windows2000）启动后， 控制就传递给OS，OS接管设备管理。 定义一个PCI设备配置空间的目的在于提供一 套适当的配置措施，使之实现完全的设备再 定位而无需用户干预安装、配置和引导，并 由与设备无关的软件进行系统地址映射。 所有PCI设备都必须实现PCI协议规定必需的 配置寄存器，以便系统加电的时候利用这些 寄存器的信息来进行系统配置。对PCI的配置 访问实际上就是访问设备的配置寄存器。
2. 配置空间访问的类型
0类配置空间访问
• 对（正在运行的）当前PCI总线上的目标设备配置 寄存器所进行的访问。 • 被配置访问的目标设备必须在地址期采样到其 IDSEL输入信号有效，并且AD[1∶0]必须为00。 • 地址期，AD[10∶8]用于选择物理设备的八种功能 之一。AD [7∶2]为选择该功能设备的配置寄存器 号(双字号）；AD[1∶0]必须为00。 • 数据期，AD[31∶0]传送的是配置读/写数据