数电实验 计数器电路
青岛科技大学数电实验七 计数器
6
Q
K
7
Q
K
6
Q
C D
K
14
15
14
15
Rd
青岛科技大学自动化与电子工程学院
数
字
电
子
技 术
青岛科技大学自动化与电子工程学院
实验电路2 (图7.3）
Q3 Q2 Q1 Q0
上升沿触发
4
10
U1 B
SD SD
U1 A
SD
10
4
数
9
U2 B Q D C LK
C D
U2 A Q
SD
字
8
QDBiblioteka C LK12 11青岛科技大学自动化与电子工程学院
实验电路1 (图7.1-2）
Q3 Q2 Q1
四位二进制加法计数器
Q0
数
10 10 4
Single Pulse 下降沿触发
4
U1 B
字
电
SD
SD
SD
Q
J C LK
Q
J C LK
Q
J C LK
Q
SD
9
11 13
1
U1 A 5 3 1
C D
U2 B 9 11 13 12 7 4 A LS1 1 2
青岛科技大学自动化与电子工程学院
注意事项
数
字
电
子
技 术
采用触发器时应注意悬空脚的使用，最 好不悬空，应接高电平。 电路中的芯片一定要接电源。 要求画出计数器的状态表、状态图和时 序图如：十进制计数器的状态图如下：
0000 0001 0010 0011
1001
0100
1000
数电计数器实验报告
数电计数器实验报告数电计数器实验报告引言：数电计数器是数字电路中常见的一种组合逻辑电路，用于实现对输入信号进行计数的功能。
在本次实验中，我们将通过搭建一个四位二进制计数器的电路，来深入了解计数器的工作原理和应用。
实验目的：1. 熟悉计数器的基本原理和工作方式；2. 掌握计数器的设计与搭建方法；3. 理解计数器在数字系统中的应用。
实验器材：1. 74LS161四位二进制同步计数器芯片；2. 74LS47七段数码管芯片；3. 电路连接线、电源等。
实验步骤：1. 按照电路原理图，连接74LS161计数器芯片和74LS47七段数码管芯片；2. 将74LS161的CLK输入引脚连接到一个可调的方波发生器，用于提供时钟信号；3. 将74LS161的RST引脚连接到一个开关，用于手动复位计数器；4. 将74LS161的QA~QD引脚连接到74LS47的A~D引脚，用于输出计数结果；5. 将74LS47的LT引脚连接到一个LED灯，用于指示计数溢出。
实验原理：计数器是由触发器和逻辑门组成的组合逻辑电路。
在本次实验中，我们使用74LS161芯片作为计数器，它具有四位二进制计数功能。
74LS161芯片内部包含四个D触发器，每个触发器的输出与下一个触发器的时钟输入相连，形成级联的工作方式。
当时钟信号上升沿到来时，触发器会根据输入信号的状态进行状态转移，从而实现计数功能。
实验结果：通过调节方波发生器的频率，我们可以观察到七段数码管上显示的数字不断变化。
当计数器达到最大值时，LED灯会亮起，指示计数溢出。
通过手动复位开关，我们可以将计数器重新复位为0，重新开始计数。
实验分析：1. 在实验过程中，我们发现计数器的工作稳定性较好，能够准确地进行计数；2. 通过改变方波发生器的频率，我们可以调整计数器的计数速度，从而实现不同的计数效果；3. 计数器的应用非常广泛，比如在时钟、计时器、频率分频器等数字系统中都有广泛的应用。
实验总结：通过本次实验，我们深入了解了数电计数器的工作原理和应用。
数电计数器实验报告
数电计数器实验报告数电计数器实验报告引言：数电计数器是数字电路中常见的一种组合逻辑电路，用于计数和记录输入脉冲的次数。
本实验旨在通过搭建一个基本的二进制计数器电路，探究计数器的工作原理，并验证其计数功能的正确性。
实验装置和步骤：实验中所用的装置包括集成电路、数字示波器、电源等。
首先，我们按照电路原理图搭建计数器电路，并连接相应的输入和输出信号线。
然后，我们通过给计数器电路提供时钟信号，观察输出信号的变化情况。
最后，我们通过改变输入信号的频率和幅度，测试计数器的稳定性和可靠性。
实验结果：在实验中，我们观察到计数器电路的输出信号随着时钟信号的输入而变化。
当时钟信号的边沿触发计数器时，计数器按照设定的计数规则进行计数，并输出相应的二进制码。
例如，当计数器为4位二进制计数器时，输入一个时钟脉冲，计数器的输出变化为0001、0010、0011、0100，依次类推。
当计数器达到最大计数值时，会自动归零重新计数。
实验分析：通过实验我们发现，计数器的计数规则是按照二进制码进行计数的。
每一位计数器都有两种状态，0和1，通过时钟信号的输入，计数器的状态会发生变化。
当计数器达到最大计数值时，会自动归零，这是因为计数器的位数是有限的，无法继续计数。
计数器的位数越多，能够计数的范围就越大。
此外，我们还发现计数器的计数速度与输入时钟信号的频率有关。
当时钟信号的频率较高时，计数器的计数速度也会相应增加。
然而，当时钟信号的频率过高时，计数器可能无法跟上时钟信号的输入，导致计数器的计数出错。
因此，在实际应用中，我们需要根据具体的需求来选择合适的计数器和时钟频率。
实验总结：通过本次实验，我们深入了解了数电计数器的工作原理和计数功能。
计数器作为一种常见的组合逻辑电路，广泛应用于各种计数和测量系统中。
在实际应用中，我们需要根据具体的需求选择合适的计数器和时钟频率，以确保计数器的稳定性和可靠性。
未来展望：随着科技的不断发展，计数器的功能和性能也在不断提升。
数电实验四 计数器
CLR
LOAD
ENP
ENT
工作状态
X
0
X
X
X
置零↑10X NhomakorabeaX
预置数
X
1
1
0
1
保持
X
1
1
X
0
保持（C=0）
↑
1
1
1
1
计数
实验结果：数码管显示为从0到9之间变化。
2、74HC(LS)160构成模6计数器（基本命题）
设计用与非门74HC(LS)00及计数器74HC(LS)160实现模6计数器的实验电路图，搭接电路，
用集成计数器芯片可方便地构成任意模计数器，方法有反馈清零法和反馈置数法两种。
实验用器件管脚介绍：
1、74HC(LS)00（四二输入与非门）管脚如下图所示。
2、74HC(LS)160（4位十进制计数器）管脚如下图所示。
四、实验内容与步骤
1、测试74HC(LS)160的逻辑功能（基本命题）
例如，74HC(LS)160工作于计数模式时，接通电源后，利用数码管显示说明其确为模10计数器。
100计数器。
五、
实验结果：个位数码管随时间显示0、1、2、3、4、5、6、7、8、9，十位数码管显示个位进位计数结果，按0、1、2、3、4、5、6、7、8、9变化。
五、实验心得：
本次实验，通过对计数器工作过程的探索，基本上了解了数码计数器的工作原理，以及74HC160的数字特点，让我更进一步掌握了如何做好数字电子数字实验，也让我认识到自身理论知识的不足和实践能力的差距，以及对理论结合实践的科学方法有了更深刻理解。除此之外，对电路图要多次核对，确认其是否正确。对线路要多次检查，防止有线路故障。
数字电路实验计数器
实验八计数器一、实验目的1．熟悉由集成触发器构成的计数器电路及其工作原理。
2．熟悉掌握常用中规模集成电路计数器及其应用方法。
二、实验原理和电路所谓计数，就是统计脉冲的个数，计数器就是实现“计数”操作的时序逻辑电路。
计数器的应用十分广泛，不仅用来计数，也可用作分频、定时等。
计数器种类繁多。
根据计数体制的不同，计数器可分成二进制（即2”进制）计数器和非二进制计数器两大类。
在非二进制计数器中，最常用的是十进制计数器，其它的一般称为任意进制计数器。
根据计数器的增减趋势不同，计数器可分为加法计数器—随着计数脉冲的输入而递增计数的；减法计数器—随着计数脉冲的输入而递减的；可逆计数器—既可递增，也可递减的。
根据计数脉冲引入方式不同，计数器又可分为同步计数器—计数脉冲直接加到所有触发器的时钟脉冲（CP）输入端；异步计数器—计数脉冲不是直接加到所有触发器的时钟脉冲（CP）输入端。
1.异步二进制加法计数器异步二进制加法计数器是比较简单的。
图 1.8.1(a)是由4个JK（选用双JK74LS112）触发器构成的4位二进制（十六进制）异步加法计数器，图1.8.1(b)和（c）分别为其状态图和波形图。
对于所得状态图和波形图可以这样理解：触发器FF O（最低位）在每个计数沿（CP）的下降沿（1 → 0）翻转，触发器FF1的CP端接FF0的Q0端，因而当FF O（Q O）由1→ 0时，FF1翻转。
类似地，当FF1（Q1）由1→0时，FF2翻转，FF2（Q2）由1→0时，FF3翻转。
4位二进制异步加法计数器从起始态0000到1111共十六个状态，因此，它是十六进制加法计数器，也称模16加法计数器（模M=16）。
从波形图可看到，Q0 的周期是CP周期的二倍；Q1 是Q0的二倍，CP的四倍；Q2是Q1 的二倍，Q0的四倍，CP的八倍；Q3是Q2的二倍，Q1的四倍，Q0的八倍，CP的十六倍。
所以Q0 、Q1、Q2、Q3分别实现了二、四、八、十六分频，这就是计数器的分频作用。
数电计数器实验报告
数电计数器实验报告实验名称：数电计数器实验实验目的：通过实验，了解和掌握数电计数器的原理和工作方式，以及计数器的应用。
实验原理：计数器是一种能够实现数字计数功能的电子元件。
主要由触发器、逻辑门和时钟信号组成。
触发器主要用于储存和传递信号，逻辑门用于控制和处理信号，时钟信号用于控制计数时间。
实验器材：1. 7400四路或五路与门2. 7432四路或五路或六路或七路与非门3. 7474触发器4. 555定时器5. LED灯6. 电源实验步骤：1. 将触发器与逻辑门按照电路图连接，并确保连接正确无误。
2. 将555定时器连接到电路中，并设置合适的时钟频率。
3. 将LED灯连接到电路中，用于显示计数结果。
4. 打开电源，观察LED灯的亮灭情况，并记录计数结果。
5. 可以尝试改变定时器的频率，观察LED灯的计数速度。
实验结果分析：通过实验观察和记录计数结果，可以得出计数器的工作原理和特点。
可以发现，当时钟信号输入时，计数器会根据触发器和逻辑门的控制逻辑实现数字计数功能。
实验结论：1. 数电计数器是一种能够实现数字计数功能的电子元件。
2. 计数器由触发器、逻辑门和时钟信号组成，触发器用于储存和传递信号，逻辑门用于控制和处理信号，时钟信号用于控制计数时间。
3. 数电计数器在实际应用中具有广泛的用途，如计时器、频率计等。
实验中可能遇到的问题和解决方法：1. 连接错误：检查电路连接，确保连接正确无误。
2. LED灯未亮起：检查电路连接，确保连接正确无误。
3. 计数不准确：检查时钟信号的频率，确保设置合适的计数速度。
实验改进思路：1. 尝试使用不同型号的触发器和逻辑门，比较它们的计数效果和特点。
2. 尝试使用其他电子元件，如译码器、多路选择器等，扩展计数器的功能和应用场景。
3. 尝试使用计数器的级联连接，实现更复杂的计数功能和应用。
数电实验报告计数器
数电实验报告计数器计数器是数字电路中常见的一种电路元件，用于计数和显示数字。
在数电实验中，我们通常会设计和实现各种类型的计数器电路，以探究其工作原理和性能特点。
本文将介绍数电实验中的计数器的设计和实验结果，并探讨其应用和改进。
一、设计和实现在数电实验中，我们通常使用逻辑门和触发器来实现计数器电路。
逻辑门用于控制计数器的输入和输出，而触发器则用于存储和更新计数器的状态。
以4位二进制计数器为例，我们可以使用四个触发器和适当的逻辑门来实现。
触发器的输入端连接到逻辑门的输出端，而逻辑门的输入端连接到触发器的输出端。
通过适当的控制信号，我们可以实现计数器的正向计数、逆向计数、清零和加载等功能。
在实验中，我们需要根据设计要求选择适当的逻辑门和触发器，并将其连接起来。
然后，通过给逻辑门和触发器提供适当的输入信号，我们可以观察计数器的输出结果，并验证其正确性和稳定性。
二、实验结果在实验中，我们设计了一个4位二进制计数器，并通过适当的输入信号进行了测试。
实验结果表明，计数器能够正确地进行正向计数和逆向计数，并能够在达到最大计数值或最小计数值时自动清零。
此外，我们还观察到计数器的输出信号在计数过程中保持稳定，并且能够及时响应输入信号的变化。
这说明计数器具有较高的稳定性和响应速度，适用于各种计数应用场景。
三、应用和改进计数器在数字电路中有广泛的应用，例如频率分频、时序控制、计时器等。
通过适当的设计和连接，我们可以实现各种复杂的计数功能，满足不同的应用需求。
在实验中，我们还可以对计数器进行改进和优化，以提高其性能和功能。
例如，我们可以增加计数器的位数，以扩大计数范围；我们还可以添加输入输出接口，以实现与其他电路元件的连接和通信。
此外，我们还可以使用更高级的计数器电路，如同步计数器、环形计数器等，以实现更复杂的计数功能。
这些改进和扩展将进一步提高计数器的灵活性和实用性。
总结：通过数电实验，我们了解了计数器的设计和实现原理，并验证了其在实际应用中的性能和功能。
数电实验6(计数器设计)
⑴ CPA接单正脉冲，观察各触发器的输出状态，纪录于表6-4 中。
⑵ CPA接单正脉冲，输出端QD QCQB QA对应接至七段译码/驱 动电路CD4511的输入端D、C、B、A，观察数码管的变化。
2/5十进制计数器74LS90的管脚图：
计数脉冲从CPA输入（下降沿有效）， QA与CPB相连， QD QCQB QA输出
异步复位、置位输入端 R01 R02 S91 S92 HHLX HHXL XXHH XLXL LXLX LXXL XLLX
输出端 QD QC QB QA
LLLL LLLL HLLH 计数 计数 计数 计数
BCD码九进制加法计数器示意图
··
+5V
QD QC QB QA
VCC 74LS90 CPB
·
GND
触发器的 驱动方程
J0 = K0 =1 J1 = Q2Q0, K1 = Q0
J 2 = Q1Q0, K 2 = Q0
逻辑图（用2片74LS112和1片74LS00组成）
·Q FF2 1J C1 Q 1K
Q2
1&
1&
00- 4 00-3
Q FF1 1J Q C1
1K
·
Q1
· 00-2 00-1
Q FF0 1J
下周实验： RC环形振荡器和单稳态触发器
请确认本次实验集成电路芯片：74112两 片、7400一片、7490一片的安插位置。
从逻辑开关右面插孔连接+5V和
注意：不要在数电箱面板上写字！
实验六 计数器的设计
6.1实验目的
1、学习用集成触发器组成同步和异步计数器并测试其逻 辑功能。 2、学习用集成计数器组件组成任意进制计数器的方法并 测试其逻辑功能。
数字电路 实验 计数器及其应用 实验报告
实验六计数器及其应用一、实验目的1．学习用集成触发器构成计数器的方法2．掌握同步计数的逻辑功能、测试方法及功能扩展方法3．掌握构成任意进制计数器的方法二、实验设备和器件1．+5V直流电源2．双踪示波器3．连续脉冲源4．单次脉冲源5．逻辑电平开关6．逻辑电平显示器7．译码显示器8．CC4013×2（74LS74）CC40192×3（74LS192）CC4011（74LS00）CC4012（74LS20）三、实验原理计数器是一个用以实现计数功能的时序部件，它不仅可用来计脉冲数，还常用作数字系统的定时、分频和执行数字运算以及其它特定的逻辑功能。
计数器种类很多。
计数器计数时所经历的独立状态总数为计数器的模（M）。
计数器按模可分为二进计数器（M=2n）、十进计数器（M=10n）和任意进制计数器（M≠2n、M≠10n）。
按计数脉冲输入方式不同，可分为同步计数和异步计数。
按计数值增减趋势分为：加法计数器、减法计数器和可逆（加/减）计数器。
1．用D触发器构成异步二进制加/减计数器图6-1是用四只D触发器构成的四位二进制异步加法计数器，它的连接特点是将每只D触发器接成T 触发器，再由低位触发器的Q端和高一位的CP端相连接。
若将图6-1稍加改动，即将低位触发器的Q端与高一位的CP端相连接，即构成了一个4位二进制减法计数器。
2．中规模十进制计数器、十六进制计数器（1）CC40192是同步十进制可逆计数器，具有双时钟输入，并具有清除和置数等功能。
当清除端CR为高电平“1”时，计数器直接清零；CR置低电平则执行其它功能。
当CR为低电平，置数端LD也为低电平时，数据直接从置数端D0、D1、D2、D3置入计数器。
当CR为低电平，LD为高电平时，执行计数功能。
执行加计数时，减计数端CP D接高电平，计数脉冲由CP U输入；在计数脉冲上升沿进行8421码十进制加法计数。
执行减计数时，加计数端CP U接高电平，计数脉冲由减计数端CP D 输入，表6-2为8421码十进制加、减计数器的状态转换表。
数电实验报告：计数器及其应用-计数器应用实验报告
数字电子技术实验报告实验四：计数器及其应用一、实验目的：1、熟悉常用中规模计数器的逻辑功能。
2、掌握二进制计数器和十进制计数器的工作原理和使用方法。
二、实验设备：1、数字电路实验箱；2、74LS90。
三、实验原理：1、计数是一种最简单基本运算，计数器在数字系统中主要是对脉冲的个数进行计数，以实现测量、计数和控制的功能，同时具有分频功能。
计数器按计数进制分有：二进制计数器，十进制计数器和任意进制计数器；按计数单元中触发器所接收计数脉冲和翻转顺序分有：异步计数器，同步计数器；按计数功能分有：加法计数器，减法计数器，可逆（双向）计数器等。
2、74LS90是一块二-五-十进制异步计数器，外形为双列直插，NC表示空脚，不接线，它由四个主从JK触发器和一些附加门电路组成，其中一个触发器构成一位二进制计数器；另三个触发器构成异步五进制计数器。
在74LS90计数器电路中，设有专用置“0”端R0（1），R0（2）和置“9”端S9（1）S9（2）。
其中前两个为异步清0端，后两个为异步置9端。
CP1, CP2为两个时钟输入端；Q0~Q3为计数输出端。
当R1=R2=S1=S2=0时，时钟从CP1引入，Q0输出为二进制；从CP2引入，Q3输出为五进制。
时钟从CP1引入，二Q0接CP1,则Q3Q2Q1Q0输出为十进制（8421码）；时钟从CP2引入，而Q3接CP1，则Q0Q3Q2Q1输出为十进制（5421码）。
四、实验原理图及实验结果：1、实现0～9十进制计数。
1）实验原理图如下：（函数信号发生器：5V 3Hz 偏移2.5V方波）2）实验结果：解码器上依次显示0~9十个数字。
2、实现六进制计数。
1）实验原理图如下：（函数信号发生器：5V 3Hz 偏移2.5V方波）2）实验结果：解码器上依次显示0~5六个数字。
3、实现0、2、4、6、8、1、3、5、7、9计数。
1）实验原理图如下：（函数信号发生器：5V 3Hz 偏移2.5V方波）2）实验结果：解码器上依次显示0、2、4、6、8、1、3、5、7、9十个数字。
数电 计数器 实验报告
数电计数器实验报告数电计数器实验报告引言：计数器是数字电路中常见的一种组合逻辑电路，它可以实现对输入信号进行计数的功能。
在本次实验中，我们将通过搭建一个4位二进制计数器的电路，深入了解计数器的工作原理和应用。
一、实验目的本次实验的目的是通过搭建一个4位二进制计数器的电路，学习计数器的基本原理，掌握计数器的设计和应用方法。
二、实验原理计数器是由触发器和逻辑门组成的组合电路。
触发器是一种存储器件，可以存储一个比特的数据。
逻辑门则负责对输入信号进行处理和控制。
在计数器中，触发器的输出被连接到逻辑门的输入，逻辑门的输出又反馈到触发器的输入，形成了一个闭环。
当输入信号发生变化时，逻辑门会根据其输入信号的状态改变输出信号的状态，从而实现计数器的计数功能。
三、实验材料本次实验所需的材料如下：1. 电路板2. 74LS74触发器芯片3. 74LS08与门芯片4. 74LS32或门芯片5. 连线材料6. 电源四、实验步骤1. 将74LS74触发器芯片插入电路板上的指定位置，并连接电源。
2. 使用连线材料将74LS74触发器芯片的引脚与74LS08与门芯片和74LS32或门芯片的引脚相连，按照电路图进行正确的连接。
3. 检查电路连接是否正确，确保没有短路或接触不良的情况。
4. 打开电源，观察计数器的输出情况。
5. 将输入信号接入计数器，观察计数器的计数变化。
五、实验结果与分析通过实验，我们成功搭建了一个4位二进制计数器的电路。
当输入信号发生变化时，计数器能够按照二进制方式进行计数。
例如，当输入信号从0变为1时，计数器的输出会从0000变为0001；当输入信号再次变为0时，计数器的输出会继续递增，变为0010，0011，0100，以此类推。
实验结果表明，计数器能够准确地对输入信号进行计数，并按照预期的方式输出计数结果。
六、实验总结本次实验通过搭建一个4位二进制计数器的电路，深入了解了计数器的工作原理和应用。
我们学习了计数器的基本原理，掌握了计数器的设计和应用方法。
数电计数器实验报告
数电计数器实验报告
实验名称：数电计数器实验报告
一、实验目的
了解数码计数器的基本原理和工作方式，掌握计数原理及电路实现方法，培养实验操作能力。
二、实验内容
1. 设计一个基本的二进制计数器电路
2. 加深对计数器的理解并搭建计数器电路
三、实验器材
1. 计数器芯片：CD74HC161E
2. 电源电源适配器
3. 示波器
4. 直流电压表
5. 万用表
四、实验步骤
1. 将芯片和电路板连接
2. 将电路电源设置到好
3. 用直流电压表测试电路板工作电压是否正常
4. 用万用表检查所连接线路的连通状况
5. 用示波器测量芯片输出波形是否正常
六、实验结果
在实验过程中，我们成功地节点了一个基本的二进制计数器电路，并顺利地搭建了计数器电路。
计数器能够正常工作，实验目
标全部达到。
七、实验结论
通过实验，我们深入了解了数码计数器的基本原理和工作方式，培养了实验操作的能力，并通过实验获得了实际操作的经验。
八、实验感想
通过这次实验，我们深刻认识到了学习知识的重要性。
掌握计
数器原理是我们今后从事电子学领域必要的基础，因此我们要保
持深入学习、不断拓展知识面的心态。
同时，在操作实验过程中，我们也要注重细节、沉着冷静，并时刻保持对失误的辨识、纠正
和处理能力。
数电实验：计数器电路
实验5计数器实验电路1实验目的1.1掌握计数器的工作原理及特性1.2采用触发器及集成计数器构成任意进制计数器 2实验仪器与元器件2.1实验仪器数字电路实验箱、数字万用表、示波器 2.2 芯片 74LS00/74ls04 74LS48 74LS161共阴数码管电位器电阻等其它元件若干3预习要求3.1 预习计数器相关内容。
3.2 作出预习报告。
4实验原理计数器是用来实现计数功能的时序部件,它能够计脉冲数,还可以实现定时、分频、产生节拍脉冲和脉冲序列等。
计数器的种类很多，按时钟脉冲输入方式的不同，可以分为同步计数器和异步计数器。
按进位体制不同，可以分二进制和非二进制计数器。
按计数的增减趋势，可分加法或减法计数器等。
目前，无论是TTL 还是CMOC 集成电路，都有品种齐全的中规模集成计数电路。
作为使用者可以借助器件手册提供的功能表和工作波形以及引脚分布图，就能正确地使用这些器件。
4.1异步计数器异步计数器是指计数脉冲不是直接加到所有触发器的时钟脉冲端。
这样，当一个计数脉冲作用后，计数器中某些触发器的状态发生变化，而其它触发器保持原来状态，即计数器中各触发器状态的更新与输入时钟脉冲异步。
在设计模为整数N 的异步计数器时，如果KN 2=，则为二进制计数器，例如设计一个4位二进制计数器，1624==N ，K=4，用4个触发器级联即可。
如果N 不等于2的整次幂，则是非二进制计数器，这时，可将N 写N=1*2N K其中1N 为奇数,这样由模为K 2和模为1N 的两个计算器级联而成,其中模为1N 的计数器通常用反馈的方法构成.例如设计一个异步十进制计数器,可令K2=12,1N =5,就是用一个模2计数器和一个模5计数,再由低位所示。
采用双JK 触发器74LS76，通过分析状态转换表，可得到各触发器控制输入端的逻辑方程如下。
表6.1 十进制加法计数器状态转换表（1）第一位触发器0Q ，每来一个时钟脉冲CP ，其状态翻转一次，则100==K J 。
计数器数电实验报告
计数器数电实验报告《计数器数电实验报告》实验目的：本次实验旨在通过搭建计数器电路，加深学生对数电原理的理解，提高学生的动手能力和实验操作技能。
实验原理：计数器是一种能够按照特定规律对输入信号进行计数的电路。
在本次实验中，我们将使用集成电路74LS90和74LS47来搭建一个模4计数器。
74LS90是一个可递增或递减的4位二进制计数器，而74LS47是一个BCD-7段译码器，用于将二进制计数转换为7段数码管的显示。
实验材料：1. 74LS90集成电路2. 74LS47集成电路3. 7段数码管4. 电源5. 连接线6. 示波器实验步骤：1. 将74LS90和74LS47集成电路插入实验面包板中，并连接好电源和连接线。
2. 根据电路原理图连接好各个元件，确保连接正确无误。
3. 接通电源，调节示波器观察输出波形，验证计数器的工作状态。
4. 通过改变输入信号的方式，观察计数器的不同工作模式，并记录观察结果。
实验结果：经过实验操作，我们成功搭建了一个模4计数器电路，并通过示波器观察到了正确的计数输出波形。
在改变输入信号的情况下，我们也观察到了计数器的不同工作模式，验证了电路的正常工作。
实验结论：通过本次实验，我们深入了解了计数器的工作原理和实验操作技能。
通过动手搭建电路和观察波形，我们加深了对数电原理的理解，提高了实验操作的能力。
同时，我们也发现了实验中可能存在的问题和改进的空间，为今后的实验操作提供了宝贵的经验。
总结：本次实验不仅让我们了解了计数器的原理和工作方式，还提高了我们的动手能力和实验操作技能。
通过实验，我们对数电原理有了更深入的理解，为今后的学习和实践打下了坚实的基础。
数字电路 时序逻辑电路——计数器实验实验报告
肇庆学院电子信息与机电工程学院数字电路课实验报告12电气(1) 班姓名王园园学号201124101167 实验日期2014年5 月26 日实验合作者：李俊杰老师评定实验题目：时序逻辑电路——计数器实验一、实验目的（一）掌握由集成触发器构成计数器的方法。
（二）熟悉中规模集成计数器74LS161计数器的逻辑功能及使用方法。
（三）学习中规模集成计数器74LS192计数器的逻辑功能及使用方法。
（四）学习计数器清零端和置数端的功能、同步和异步的概念。
二、实验仪器：DZX-1型电子学综合实验装置UT52万用表芯片74LS00 74LS161 74LS192三、实验内容图5-1 74LS161构成N进制计数器目标电路图图5-2 74LS161引脚排列图用十六进制同步加法计数器74LS161构成N进制计数器的设计（异步清零，同步置数）1．按图5-1接好。
从CP端输入时钟脉冲。
2．将M端接高电平，并把计数结果记录下来。
如下表5-23．将M端接低电平，并把计数结果记录下来。
4．如果将清零端和置数端接线交换，重复2、3步骤，计数器的N分别等于多少？答：2，3步骤N都为16接线交换后，LD=1输入无效。
加法计数器计数溢出后CO=1 => CR=0触发异步清零，然后CO=0 => CR=1，计数器重新从零开始加法计数，所以N=15（二）．用74LS192构成7进制减法计数器。
74LS192，十进制同步加减计数器（双时钟），其清零功能为异步；置数功能也为异步；其余功能参见管脚排列图。
图5-3 74LS192引脚排列图图5-4 74LS192构成7进制减法计数器按照图5-4接线，记录下实验结果四、实验分析与结论：1.由实验第（一）4可以看出，74ls161是异步清零，同步置数的。
数字电路技术实验之计数器
实验七计数器一、实验目的1. 熟悉中规模集成计数器的逻辑功能及使用方法。
2. 掌握用中规模集成计数器构成任意进制计数器的方法。
3. 学习用集成触发器构成计数器的方法。
二、实验原理计数器是一个用以实现计数功能的时序部件，它不仅可以用来对脉冲计数，还常用作数字系统的定时、分频和执行数字运算以及其他特定的逻辑功能。
计数器是由基本的计数单元和一些控制门所组成，计数单元则由一系列具有存储信息功能的各类触发器构成，这些触发器有RS触发器、T触发器、D触发器及JK触发器等。
计数器在数字系统中应用广泛，如在电子计算机的控制器中对指令地址进行计数，以便顺序取出下一条指令，在运算器中作乘法、除法运算时记下加法、减法次数，又如在数字仪器中对脉冲的计数等等。
计数器种类很多，按构成计数器中的各触发器是否使用一个时钟脉冲源来分，有同步计数器和异步计数器；根据计数进制的不同，分为二进制计数器、十进制计数器和任意进制计数器；根据计数的增减趋势，又分为加法、减法和可逆计数器；如按预置和清除方式来分，则有并行预置、直接预置、异步清除和同步清除等；按权码来分，则有“8421”码，“5421”码、余“3”码等计数器及可编程序功能计数器等等。
目前，无论是TTL还是CMOS集成电路，都有品种较齐全的中规模集成计数电路。
使用者只要借助于器件手册提供的功能表和工作波形图以及引出端的排列，就能正确地运用这些器件。
1.十进制计数器74LS90（二、五分频）74LS90是模二-五-十异步计数器。
具有计数、清除、置9功能。
74LS90包含M=2和M=5两个独立的下降沿触发计数器，清除端和置9端两计数器公用，没有预置端。
模2计数器的时钟输入端为A(CP1)，输出端为Q A；模5计数器的时钟输入端为B(ＣP2)。
输出端由高位到低位为Q D、Q C、Q B；异步置9端为Ｓ91和Ｓ92，高电平有效。
即只要S91·S92=1，则输出Q D Q C Q B Q A为1001；异步清除端为R01和R02，当R01·R02＝１，且S91·S92＝０时，输出Q D Q C Q B Q A＝0000；只有R01·R02＝０，S91·S92=０，即两者全无效时，74LS90才能执行计数操作。
计数器数电实验报告
计数器数电实验报告计数器数电实验报告引言：计数器是数字电路中常见的一个模块，用于计算和记录输入信号的脉冲数。
本次实验旨在通过设计和实现一个4位二进制计数器，加深对计数器原理和数电实验的理解。
一、实验目的本实验的目的是通过设计和实现一个4位二进制计数器，加深对计数器原理和数电实验的理解。
二、实验器材1. 数字逻辑实验箱2. 7400、7402、7404、7476、7490等集成电路芯片3. 连线和电源线三、实验原理计数器是一种用于记录输入脉冲数量的电子电路。
常见的计数器有二进制计数器、BCD计数器等。
本实验中，我们将设计一个4位二进制计数器，即计数范围为0-15。
四、实验步骤1. 按照电路原理图连接实验箱中的集成电路芯片，确保连接正确。
2. 将电源线接入实验箱，确保电路正常供电。
3. 通过按下实验箱上的开关，给计数器输入脉冲信号。
4. 通过观察计数器输出端的LED灯亮灭情况，判断计数器是否正常工作。
5. 调整输入脉冲信号的频率，观察计数器的计数变化情况。
五、实验结果与分析经过实验，我们成功地设计和实现了一个4位二进制计数器。
当输入脉冲信号的频率较低时，我们可以清晰地观察到计数器的计数变化，LED灯依次亮起。
当输入脉冲信号的频率较高时，我们可以看到LED灯快速闪烁，但我们无法逐个数清楚。
这是因为计数器的计数速度跟不上输入脉冲信号的频率。
六、实验总结通过本次实验，我们深入了解了计数器的原理和工作方式。
计数器作为数字电路中常见的模块，广泛应用于各个领域。
通过设计和实现一个4位二进制计数器，我们不仅加深了对计数器的理解，还掌握了实验中常用的集成电路芯片的连接方法。
然而，本次实验还存在一些问题。
首先，计数器的计数范围仅为0-15，无法满足更大范围的计数需求。
其次，计数器的计数速度受限于输入脉冲信号的频率，当频率过高时无法逐个数清楚。
对于这些问题，我们可以进一步改进和优化设计，以满足不同的应用需求。
在今后的学习和实践中，我们将继续深入研究和应用计数器的原理，探索更多的应用场景和设计方法。
数字电路实验报告——计数器
第六次实验报告 实验十 计数器一、 实验目的要求掌握CC40192可予置数同步十进制加/减计数器逻辑功能及测试方法 二、 实验仪器、设备直流稳压电源、电子电路调试器、万用表、CC40192、CC4011、CC4547 三、 实验线路、原理框图 (一) C C40192的逻辑符号、功能表、管脚排列（1） CC40192可予置数同步十进制加/减计数器，它是中规模CMOS 集成电路。
它的逻辑符号如图1所示：图1（2） CC40192的管脚排列如图2所示：图2B C PE 0-+加法进位：0C =+CP Q Q 03即当加法计数器时，当Q 3Q 2Q 1Q 0=1001且+CP 在0（底电平）时，0C 输出负脉冲，向高位进位。
减法进位：0B =-•CP Q Q Q Q 0123即当减法计数时，在Q3Q2Q1Q0=0000且-CP 在0（底电平）时0B 出负脉冲，向高位借位。
（二）CC4011是CMOS 四2输入与非门，它具有4个独立的2输入与非门。
管脚排列图如 图3所示：图3（三）CC4547是七段数码锁存/译码/驱动器，它的管脚排列和逻辑功能与CC4513相同 （1）CC4513的管脚排列如图4所示：图4（2）CC4513的逻辑功能表如下表所示：1A 1B 1Y 2Y 2B 2A V SS的实验线路图如图5所示：图5四、 实验方法步骤1、 按图5接线：清零端R 、置数端PE 、数据输入端D A 、D B 、D C 、D D 分别接逻辑开关，输出端Q A 、Q B 、Q C 、Q D 分别接实验台上译码器（CC4547）对应输入端A 、B 、C 、D ，CP 接单次脉冲源。
本实验采用2输入与非门CC4011。
2、 测试CC40192的逻辑功能 （1） 清除令R=1，其它输入为任意状态，这时Q D Q C Q B Q A =0000，译码显示为0字。
清除功能完成后，置R=0。
（2） 置数令R=0,+CP ,-CP 任意，数据输入端输入任意一组二进制数D A D B D C D D =dcba ，令PE=0，观脉冲察计数器输出dcba 是否已被置入。
数字电路实验 计数器的设计
数字电路与逻辑设计实验报告实验七计数器的设计姓名：黄文轩学号：17310031班级：光电一班一、实验目的熟悉J-K触发器的逻辑功能，掌握J-K触发器构成异步计数器和同步计数器。
二、实验器件1.数字电路实验箱、数字万用表、示波器。
2.虚拟器件: 74LS73，74LS00, 74LS08, 74LS20三、实验预习1. 复习时序逻辑电路设计方法①根据设计要求获得真值表②画出卡诺图或使用其他方式确定状态转换的规律③求出各触发器的驱动方程④根据已有方程画出电路图。
2. 按实验内容设计逻辑电路画出逻辑图Ⅰ、16进制异步计数器的设计异步计数器的设计思路是将上一级触发器的Q输出作为下一级触发器的时钟信号，置所有触发器的J-K为1，这样每次到达时钟下降沿都发生一次计数，每次前一级触发器从1变化到0都使得后一级触发器反转，即引发进位操作。
画出由J-K触发器组成的异步计数器电路如下图所示：使用Multisim仿真验证电路正确性，仿真图中波形从上到下依次是从低位到高位触发器的输出，以及时钟信号。
：可以看出电路正常执行16进制计数器的功能。
Ⅱ、16进制同步计数器的设计较异步计数器而言，同步计数器要求电路的每一位信号的变化都发生在相同的时间点。
因此同步计数器各触发器的时钟脉冲必须是同一个时钟信号，这样进位信息就要放置在J-K 输入端，我们可以把J-K端口接在一起，当时钟下降沿到来时，如果满足进位条件(前几位触发器输出都为1)则使JK为1，发生反转实现进位。
画出由J-K触发器和门电路组成的同步计数器电路如下图所示使用Multisim仿真验证电路正确性，仿真图中波形从上到下依次是从低位到高位触发器的输出，计数器进位输出，以及时钟信号。
：可以看出电路正常执行16进制计数器的功能，且每到15就输出进位信号，我们可以判断电路正确。
Ⅲ、使用JK触发器模仿74LS194功能，实现可以左移和右移的寄存器。
使用触发器和门电路实现74LS194的功能，可以由以下电路图得到：(图中JK触发器与反相器共同构建D触发器)由于实验箱器件数目的限制，我们只能实现有左移和右移功能的寄存器。
数字电路实验3 计数器
实验八计数器一、实验目的1．熟悉由集成触发器构成的计数器电路及其工作原理。
2．熟悉掌握常用中规模集成电路计数器及其应用方法。
二、实验原理和电路所谓计数，就是统计脉冲的个数，计数器就是实现“计数”操作的时序逻辑电路。
计数器的应用十分广泛，不仅用来计数，也可用作分频、定时等。
计数器种类繁多。
根据计数体制的不同，计数器可分成二进制（即2”进制）计数器和非二进制计数器两大类。
在非二进制计数器中，最常用的是十进制计数器，其它的一般称为任意进制计数器。
根据计数器的增减趋势不同，计数器可分为加法计数器—随着计数脉冲的输入而递增计数的；减法计数器—随着计数脉冲的输入而递减的；可逆计数器—既可递增，也可递减的。
根据计数脉冲引入方式不同，计数器又可分为同步计数器—计数脉冲直接加到所有触发器的时钟脉冲（CP）输入端；异步计数器—计数脉冲不是直接加到所有触发器的时钟脉冲（CP）输入端。
1.异步二进制加法计数器异步二进制加法计数器是比较简单的。
图 1.8.1(a)是由4个JK（选用双JK74LS112）触发器构成的4位二进制（十六进制）异步加法计数器，图1.8.1(b)和（c）分别为其状态图和波形图。
对于所得状态图和波形图可以这样理解：触发器FF O（最低位）在每个计数沿（CP）的下降沿（1 → 0）翻转，触发器FF1的CP端接FF0的Q0端，因而当FF O（Q O）由1→ 0时，FF1翻转。
类似地，当FF1（Q1）由1→0时，FF2翻转，FF2（Q2）由1→0时，FF3翻转。
4位二进制异步加法计数器从起始态0000到1111共十六个状态，因此，它是十六进制加法计数器，也称模16加法计数器（模M=16）。
从波形图可看到，Q0 的周期是CP周期的二倍；Q1 是Q0的二倍，CP的四倍；Q2是Q1 的二倍，Q0的四倍，CP的八倍；Q3是Q2的二倍，Q1的四倍，Q0的八倍，CP的十六倍。
所以Q0 、Q1、Q2、Q3分别实现了二、四、八、十六分频，这就是计数器的分频作用。
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实验5 计数器实验电路
1实验目的
1.1掌握计数器的工作原理及特性
1.2采用触发器及集成计数器构成任意进制计数器
2实验仪器与元器件
2.1实验仪器
数字电路实验箱、数字万用表、示波器
2.2芯片
74LS00/74ls04 74LS48 74LS161 共阴数码管电位器电阻等其它元件若干
3预习要求
3.1 预习计数器相关内容。
3.2 作出预习报告。
4实验原理
计数器是用来实现计数功能的时序部件,它能够计脉冲数,还可以实现定时、分频、产生节拍脉冲和脉冲序列等。
计数器的种类很多，按时钟脉冲输入方式的不同，可以分为同步计数器和异步计数器。
按进位体制不同，可以分二进制和非二进制计数器。
按计数的增减趋势，可分加法或减法计数器等。
目前，无论是TTL还是CMOC集成电路，都有品种齐全的中规模集成计数电路。
作为使用者可以借助器件手册提供的功能表和工作波形以及引脚分布图，就能正确地使用这些器件。
4.1异步计数器
异步计数器是指计数脉冲不是直接加到所有触发器的时钟脉冲端。
这样，
当一个计数脉冲作用后，计数器中某些触发器的状态发生变化，而其它触发器保持原来状态，即计数器中各触发器状态的更新与输入时钟脉冲异步。
在设计模为整数N 的异步计数器时，如果K N 2=，则为二进制计数器，例
如设计一个4位二进制计数器，1624==N ，K=4，用4个触发器级联即可。
如果N 不等于2的整次幂，则是非二进制计数器，这时，可将N 写N=1*2N K 其中1N 为奇数,这样由模为K 2和模为1N 的两个计算器级联而成,其中模为1N 的计数器通常用反馈的方法构成.例如设计一个异步十进制计数器,可令
K 2=12,1N =5,就是用一个模2计数器和一个模5计数器级联.图7.1所示集成
接在各位触发器的时钟脉冲输入端，当计数脉冲来到时，应该翻转的触发器在同一时刻翻转。
因此，同步计数器的工作速度比异步计数器快。
同步计数器的设计可按“状态表+卡诺图+写出各触发器控制输入端的逻辑方程”，进行，然后画出逻辑电路。
也可以根据状态表中各触发器输出的变化规律，直接写出各触发器控制输入端的逻辑方程，最后画出逻辑电路图。
例如设计一个同步十进制加法计数器，其状态转换表如表7.1所示。
采用双JK 触发器74LS76，通过分析状态转换表，可得到各触发器控制输入端的逻辑方程如下。
表6.1 十进制加法计数器状态转换表
（1）第一位触发器0Q ，每来一个时钟脉冲CP ，其状态翻转一次，则100==K J 。
（2）第二位触发器1Q ，在10=Q 时，来一个时钟脉冲CP ，其状态翻转一次，而在13=Q 时不翻转，故301Q Q J =，.01Q K =。
（3）第三位触发器2Q ，在时再来一个101==Q Q 时钟脉冲CP 其状态就翻转，故0122Q Q K J ==。
（4）第四位触发器3Q ，在1012===Q Q Q 时，再来一个钟脉冲CP 其状态就翻0Q 。
由
此画出的逻辑电路如图7.2所示。
4.3 集成计数器
实际工作中,人们很少使用中、小规模触发器构成各种计数器，而是直接选
用集成电路计数器产品。
集成计数器的类型很多，例如有:LS/HC 系列和CMOS 序列的2×5进制异步计数器74LS90、74LS390（双2×5），2×6进制异步计数器74LS92，可预置同步4位二进制计数器74LS161/C40161，可预置双时钟同步可逆BCD 计数器74LS192/C40192等。
下面介绍集成计数器74LS161。
（1）集成计数器74LS161
74LS161是4位二进制同步加计数器。
图7.3是它的引脚分布图，其中RD 是异步清零端，LD 是预置数控制端，A 、B 、C 、D 是预置数据输入端，EP 和ET 是计数使能（控制）端，RCO （D C B A Q Q Q ETQ ）是进位输出端，它的设置为多片集成计数器的级联提供了方便。
它的逻辑功能见表6.2
表6.2 74LS161的功能表
Vcc RCO QA QB QC QD ET LD
R D
根据表7.2可知, 74LS161具有下列功能. ①异步清零 当R D =0时,不管其它输入端的状态如何(包括时钟信号CP),计数器输
出将被直接置零,称为异步清零。
②同步并行预置数
当R D =1，LD=0、时钟
脉冲CP 的上升沿到达时，不管其它控制信号什么状态，A 、B 、C 、D 输入端的数据将分别被Q A ~Q D 所接收。
如果没有时钟脉冲上升沿到达，尽管LD=0也不能将预置数据置入Q A ~Q D 。
所以这个置数操作要与CP 上升沿同步，且A ~D 的数据同时置入计数器，称为同步并行预置数。
③保持 在R D =LD=1的条件下，当ET ·EP=0,即两个计数使能端中有0时,不管有无CP 脉冲作用,计数器都将保持原有状态不变,停止计数，需要说明的是，当EP=0，ET=1时，进位输出RCO 也保持不变。
而当ET=0时，不管EP 状态如何，进位输出RCO=0。
④计数 当RD=LD=EP=ET=1时，随着CP 脉冲，按8421码循环计数。
当计数状态达到1111时，其RCO=1产生进位输出。
4.4 用集成计数器构成任意进制计数器
虽然集成计数器的种类很多，也不可能包罗任意进制的计数器，当需要用
到某进制的计数器时，可以利用计数器所特定的功能外加适当的电路来构成。
下面介绍两种情况的实现方法，其一是反馈清零法，其二是反馈置数法。
4.4.1反馈清零法
反馈清零法用于有清零输入端的集成计数器。
当计数器的清零端加低电平时，不管计数器处于状态，计数器回到全零状态。
又可以重新进行计数。
如图7.4所示。
就是用反馈清零法将74LS161构成九进制加计数器。
工作原理自行分析。
4.4.2反馈置数法
反馈置数法适用于具有预置数功能的集成计数器。
对于具有同步预置数功
能的计数器来说，在计数过程中，可以将它输出的任何一个状态通过译码，产生一个预置数控制信号反馈到预置数控制端，当下一个CP 脉冲作用后，计数器就会把预置数输入信号状态置入输出端，预置信号消失后，计数器就从被置入的状态开始重新计数。
如图7.5所示，采用反馈置数法，，工作原理自行分析。
5实验内容 5.1 测试中规模集成计数器74LS161
的逻辑功能 自拟实验步骤以及测试中规模集成计数器74LS161
5.2用74LS161构成10进制的加法计数器，并进行数码显示。
（1）画出逻辑电路图
（2）自拟实验步骤以及测试10进制加法计数器功能用的表格。
5.3时钟脉冲由多谐振荡器产生，并且能够在一定范围调节振荡器的频率。
6实验报告及思考题
6.1整理实验数据，记录实验结果。
6.2写出用74LS161构成10进制的加法计数器的分析过程以及多谐振荡器的工作过程。
6.3在实验中出现的问题进行分析。