MEMS ASIC路在何方——可编程ASIC解决方案
纵使传感器厂商对ASIC（专用集成电路）要求变得更高，一些领先的ASIC供应商依然迎头赶上，推出可编程ASIC及其开发平台以加速产品上市。Si-Ware和acam都推出可编程ASIC解决方案，满足MEMS传感器厂商的定制化需求，他们第一款ASIC产品分别面向高性能惯性传感器和压力传感器。
中国微纳技术俱乐部王懿/译
纵使传感器厂商对ASIC（专用集成电路）要求变得更高，一些领先的ASIC供应商依然迎头赶上，推出可编程ASIC及其开发平台以加速产品上市。
Si-Ware和acam都推出可编程ASIC解决方案，满足MEMS传感器厂商的定制化需求，他们第一款ASIC产品分别面向高性能惯性传感器和压力传感器。
对于高性能MEMS传感器，ASIC是非常重要的一部分，可占其成本的三分之一。目前，MEMS 领域正朝着小型化、智能化方向发展：信号更微弱、器件更多功能、融合算法更复杂，因此ASIC越来越复杂、越来越昂贵！据Yole统计，2012年MEMS ASIC市场规模约为34亿美元。然而，一些ASIC供应商嗅到新商机：市场需要一种解决方案来代替单纯的客户定制设计，以缩短开发时间和降低成本。虽然标准的传感器ASIC可以满足一些常规应用，但是无法满足汽车级和工业级压力传感器的可编程需求——允许用户定制开发传感应用固件。
图1 MEMS传感器ASIC芯片的市场预测
Si-Ware提供可编程ASIC开发平台以加快惯性传感器研发
Si-Ware是一家无晶圆厂芯片设计公司，为高性能单轴惯性传感器提供可编程ASIC方案，用户可以对电容范围、驱动频率和输出参数做一些调整。目前，Tronics为其高性能单轴陀螺仪选用Si-Ware可编程ASIC。Si-Ware还提供一套可编程ASIC开发板（其中MEMS传感器芯片放在子板上）和PC软件，以帮助用户评估和展现MEMS传感器芯片特性，同样这也有助于评估和选用ASIC。“这可以将MEMS传感器设计周期从12-18个月降低到6-9个月，” Si-Ware商务拓展副总裁Scott Smyser说道，“尽管这款ASIC是为高性能单轴传感器开发的，但是该开发板是一个通用的传感器平台，并已经帮助许多用户快速获得MEMS传感器芯片
信息，加速了ASIC研发工作。用户产品包括2轴陀螺仪、6轴加速度计+陀螺仪组合传感器等。我们负责ASIC设计、流片和测试工作，交给客户高质量芯片。”
虽然MEMS传感器制造商正推动产业更快发展，但是他们也需要越来越复杂的设计。“随着MEMS传感器芯片本身的量产工作已经改善很多，并且芯片尺寸逐步减小，成本也逐步降低，但是ASIC功能却越来越复杂。” Scott Smyser指出，“ASIC厂商一定要集成更多功能，基本上可以向MCU看齐。因此，我们现在把更多的精力投入到ASIC功能上，而不是给MEMS 器件建模。”
在MEMS业务部分，Si-Ware最近推出了MEMS光谱仪芯片（1 x 1 cm2），该芯片可以实现在手持设备应用（如智能手机），目前Si-Ware已将该技术成功授权给日本滨松集团。另外，时钟产品部门也宣布了最新消息：即将发布全硅CMOS振荡器。
acam为电容式传感器提供多功能可编程ASIC解决方案
同样提供ASIC开发平台和评估板的公司是acam——一家德国无晶圆厂ASIC供应商，然而其主营业务是非MEMS传感器的工业市场，为暖通空调系统和工厂控制系统提供压力、湿度、力、流程传感器的信号调理电路。但是现在acam开始关注MEMS领域，为MEMS传感器厂商提供电容式MEMS传感器的ASIC芯片。前2代ASIC用于商业化的中档压力传感器和湿度传感器，第3代ASIC已经在噪声方面做了改善，可用于高性能压力和惯性传感器。当MEMS传感器芯片连接到ASIC评估板时，内置的前端信号调理电路通过8个电容通道提供原始数据。固件上的48位DSP通常由外部微控制器来操作，如校正非线性、传感器融合功能、通过温湿度情况计算露点以控制空调系统。用户也可以自己编写软件以实现其它功能，如特定的阈值应用或滤波器。目前现有的解决方案可以帮助用户减少开发时间，降低成本，但是对于一些特定的应用，芯片过多的功能会占用较大的芯片面积，反而增加了成本。因此，acam正在为用户考虑以提供精简的或定制的解决方案。
图2 acam公司的传感器评估板
“客户选择我们的主要原因是高分辨率、宽电容范围（从fF到nF），” acam美国区销售经理Ralf Emberger说道，“acam使用的技术不是…模拟-数字?转换技术，而是…时间-数字?转换技术，具有非常高的分辨率和低噪声，但是一些人并不熟悉。”此外，acam还宣称具有在传
感器芯片上集成全CMOS IP核的能力。“我几乎可以肯定，全球将采用更先进的集成方法将压力传感器与CMOS集成，可用于胎压监测系统。”
大趋势仍然是满足更复杂的设计要求
总体来看，MEMS器件成本分为3部分：（1）MEMS芯片约占三分之一；（2）封装和测试约占三分之一；（3）ASIC及IC组件约占三分之一。需要说明的是：简单的加速度计和麦克风ASIC约占成本15%，复杂的汽车级陀螺仪和MEMS振荡器ASIC约占34%。
ASIC价值很可能会增加，因为随着MEMS芯片缩小和信号减弱，对信号调理的要求越来越苛刻；另外MEMS传感器从单轴到多轴，从分立到组合，需要更多传感器校准和应用算法；还有其它新兴的MEMS器件也将需要复杂的ASIC，如微测辐射热计需要逐个像素控制，MEMS扬声器需要高压激活和闭环控制。这些挑战意味着即使传统MEMS大厂也需要将一些复杂的ASIC设计业务外包，以节省人力成本。
电气自动化专业笔试面试最常见的16个问题
电气自动化专业面试最常见的16个问题 电气自动化 1. 硅材料与锗材料的二极管导通后的压降各为多少？在温度升高后，二极管的正向压降，反向电流各会起什么变化？试说出二极管用途（举3个例子即可） 硅材料二极管:导通电压约0.5~0.7V,温度升高后正向压降降低,反向电流增加. 锗材料二极管:导通电压约0.1~0.3V,温度升高后正向压降降低,反向电流增加. 二极管主要功能是其单向导通.有高低频之分,还有快恢复与慢恢复之分,特殊的:娈容二极管,稳压二极管,隧道二极管，发光二极管，激光二极管，光电接收二极管，金属二极管（肖特基），，，用途：检波，整流，限幅，吸收（继电器驱动电路），逆程二极管（电视行输出中）． 2. 如何用万用表测试二极管的好坏？在选用整流二极管型号时，应满足主要参数有哪些？如何确定？ 3. 在发光二极管LED电路中，已知LED正向压降UF=1.4V，正向电流IF=10mA，电源电压5V，试问如何确定限流电阻。 4. 三极管运用于放大工作状态时，对NPN管型的，各极电位要求是：c极b极，b极e极，而对PNP管型，是c极b
极，b极e极。 5. 场效应管是型控制器件，是由极电压，控制极电流，对P沟道及N沟道场效应管，漏极电压的极性如何？ 6. 集成运算放大器作为线性放大时，信号从同相端输入，试画出其电路图，并说明相应电阻如何取？ 7. 说出一个你熟悉的运算放大器的型号，指出输入失调电压的意义。 8. 试画出用运算放大器组成比例积分电路的电路图，说明各元件参数的选择。 9. 某电子线路需要一组5V，1A的直流稳压电源，请设计一个电源线路，并说明所需元件的大致选择。 10. 在一台电子设备中需要±15V两组电源，负载电流200mA，主用三端集成稳压器，1、画出电路图，2、试确定变压器二次侧电压有效值及容量。 11. TTL电路和CMOS电路是数字电子电路中最常用的，试说出TTL电路和CMOS电路主要特点及常用系列型号。 12. 什么是拉电流？什么是灌电流？TTL带动负载的能力约为多少？是拉电流还是灌电流？ 13. 在51系列单片机中，PO□，P1□、P2□、P3□引脚功能各是什么？ 14. 单片机有哪些中断源？中断处理的过程有哪些？中断服务程序的入口地址是由用户决定，对吗？
各大公司笔试题-数电
1、同步电路和异步电路的区别是什么（仕兰微电子） 2、什么是同步逻辑和异步逻辑（汉王笔试） 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 3、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求（汉王笔试） 线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc门来实现，由于不用 oc 门可能使灌电流过大，而烧坏逻辑门。同时在输出端口应加一个上拉电阻。 4、什么是Setup 和Holdup时间（汉王笔试） 5、setup和holdup时间,区别.（南山之桥） 6、解释setup time和hold time的定义和在时钟信号延迟时的变化。（未知） 7、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA 上海笔试试题） Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold time 不够，数据同样不能被打入触发器。 建立时间(Setup Time)和保持时间（Hold time）。建立时间是指在时钟边沿前，数据信号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果不满足建立和保持时间的话，那么DFF将不能正确地采样到数据，将会出现 metastability 的情况。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间，那么超过量就分别被称为建立时间裕量和保持时间裕量。 8、说说对数字逻辑中的竞争和冒险的理解，并举例说明竞争和冒险怎样消除。（仕兰微电子） 9、什么是竞争与冒险现象怎样判断如何消除（汉王笔试） 在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消去项，二是在芯片外部加电容。 10、你知道那些常用逻辑电平TTL与COMS电平可以直接互连吗（汉王笔试） 常用逻辑电平：12V，5V，；TTL和CMOS不可以直接互连，由于TTL是在之间，而CMOS则是有在12V的有在5V的。CMOS输出接到TTL是可以直接互连。TTL接到CMOS需要在输出端口加一上拉电阻接到5V或者12V。 11、如何解决亚稳态。（飞利浦－大唐笔试） 亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚稳态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平上。在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无用的输出电平可以沿信号通道上的各个触发器级联式传播下去。 12、IC设计中同步复位与异步复位的区别。（南山之桥） 13、MOORE 与 MEELEY状态机的特征。（南山之桥） 14、多时域设计中,如何处理信号跨时域。（南山之桥） 15、给了reg的setup,hold时间，求中间组合逻辑的delay范围。（飞利浦－大唐笔试）Delay < period - setup – hold 16、时钟周期为T,触发器D1的建立时间最大为T1max，最小为T1min。组合逻辑电路最大延
VIA笔试经历文档
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VIA笔试经历文档 前言：个人简历是求职者给招聘单位发的一份简要介绍，包括个人的基本信息、过往实习工作经验以及求职目标对应聘工作的简要理解，在编写简历时，要强调工作目标和重点，语言精简，避免可能会使你被淘汰的不相关信息。写出一份出色的个人简历不光是对找工作很有用处，更是让陌生人对本人第一步了解和拉进关系的线。本文档根据个人简历内容要求和特点展开说明，具有实践指导意义，便于学习和使用，本文下载后内容可随意调整修改及打印。 刚才去参加via的笔试，这是我的第一次笔试经历，我应聘的是硬件架构设计部（graphics/videoalgorithums engineer/graphics architect）。liuqingwei也参加这次笔试，只是他应聘的是software engineer。各个部门的题目都不相同，所以这里我只贴一下我的题目 有六道大题，回答要求是英文的，由于题目是英文的，并且有很多问题我不了解，所以可能有表述不正确的地方 一、五个小题 1、似乎是关于3维曲线拟和的问题及数据的过滤 2、关于win api中的opengl函数
3、说出固定小数表示和浮点小数表示的优缺点 4、说出显卡可以优化哪些mpeg中的计算 5、说出bezier和b-spline曲线的区别 我只做了5，其他的都不知道 二、写个函数判断一个数是不是2的次方。这个题目还算简单，可能是我作的最好的一道了 三、用c++写一个函数求三个输入中最大的一个，要求用template （sigh，关于template已经忘记了） 四、题目告诉你ieee 16和32浮点数表示的规范要求将-0.25分别用ieee 16和32表示，并写一个c++函数将输入的ieee 16表示转化为ieee 32的表示。这道题应该也作的还可以，因为对ieee的浮点数表示本来就知道一些 五、用c写一个函数f（x） = x * 0.5要求只能用整数操作，并且似乎对函数的调用有特别的要求。也就是说函数的输入参数和输出的格式需特别注意。这道题目有明显的错误，所以没有作。监考的是hr部门的，问了也是白问，呵呵 六、两道证明题，选作一题 1、关于一个2维向量关于另一个向量作镜面反射的
IC设计面试笔试题目
IC设计面试笔试题目集合分类 笔试/面试题目集合分类--IC设计基础 1、我们公司的产品是集成电路，请描述一下你对集成电路的认识，列举一些与集成电路 相关的内容（如讲清楚模拟、数字、双极型、CMOS、MCU、RISC、CISC、DSP、ASIC、FPGA等的概念）。（仕兰微面试题目） 2、FPGA和ASIC的概念，他们的区别。（未知） 答案：FPGA是可编程ASIC。 ASIC:专用集成电路，它是面向专门用途的电路，专门为一个用户设计和制造的。根据一个用户的特定要求，能以低研制成本，短、交货周期供货的全定制，半定制集成电路。与门阵列等其它ASIC(Application Specific IC)相比，它们又具有设计开发周期短、设计制造成本低、开发工具先进、标准产品无需测试、质量稳定以及可实时在线检验等优点 模拟电路 1、基尔霍夫定理的内容是什么？（仕兰微电子） 2、平板电容公式(C=εS/4πkd)。（未知） 3、最基本的如三极管曲线特性。（未知） 4、描述反馈电路的概念，列举他们的应用。（仕兰微电子） 5、负反馈种类（电压并联反馈，电流串联反馈，电压串联反馈和电流并联反馈）；负反馈馈的优点（降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非线性失真，有效地扩展放大器的通频带，自动调节作用）（未知） 6、放大电路的频率补偿的目的是什么，有哪些方法？（仕兰微电子） 7、频率响应，如：怎么才算是稳定的，如何改变频响曲线的几个方法。（未知） 8、给出一个查分运放，如何相位补偿，并画补偿后的波特图。（凹凸） 9、基本放大电路种类（电压放大器，电流放大器，互导放大器和互阻放大器），优缺 点，特别是广泛采用差分结构的原因。（未知） 10、给出一差分电路，告诉其输出电压Y+和Y-,求共模分量和差模分量。（未知） 11、画差放的两个输入管。（凹凸） 12、画出由运放构成加法、减法、微分、积分运算的电路原理图。并画出一个晶体管级的 运放电路。（仕兰微电子） 13、用运算放大器组成一个10倍的放大器。（未知） 14、给出一个简单电路，让你分析输出电压的特性（就是个积分电路），并求输出端某点的 rise/fall时间。(Infineon笔试试题) 15、电阻R和电容C串联，输入电压为R和C之间的电压，输出电压分别为C上电压和R上电 压，要求绘制这两种电路输入电压的频谱，判断这两种电路何为高通滤波器，何为低通滤 波器。当RC<16、有源滤波器和无源滤波器的原理及区别?（新太硬件） 17、有一时域信号S=V0sin(2pif0t)+V1cos(2pif1t)+V2sin(2pif3t+90),当其通过低通、带通、高通滤波器后的信号表示方式。（未知） 18、选择电阻时要考虑什么？（东信笔试题） 19、在CMOS电路中，要有一个单管作为开关管精确传递模拟低电平，这个单管你会用P管 还是N管，为什么？（仕兰微电子） 20、给出多个mos管组成的电路求5个点的电压。(Infineon笔试试题) 21、电压源、电流源是集成电路中经常用到的模块，请画出你知道的线路结构，简单描述其优缺点。（仕兰微电子） 22、画电流偏置的产生电路，并解释。（凹凸） 23、史密斯特电路,求回差电压。（华为面试题） 24、晶体振荡器,好像是给出振荡频率让你求周期(应该是单片机的,12分之一周期....) （华为面试题） 25、LC正弦波振荡器有哪几种三点式振荡电路，分别画出其原理图。（仕兰微电子） 26、VCO是什么,什么参数(压控振荡器?) （华为面试题） 27、锁相环有哪几部分组成？（仕兰微电子） 28、锁相环电路组成，振荡器（比如用D触发器如何搭）。（未知） 29、求锁相环的输出频率，给了一个锁相环的结构图。（未知）
数字电路公司笔试试题
数字电路公司笔试试题 1、同步电路和异步电路的区别是什么？（仕兰微电子） 2、什么是同步逻辑和异步逻辑？（汉王笔试） 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 电路设计可分类为同步电路和非同步电路设计。同步电路利用时钟脉冲使其子系统同步运作，而非同步电路不使用时钟脉冲做同步，其子系统是使用特殊的“开始”和“完成”信号使之同步。由于非同步电路具有下列优点--无时钟歪斜问题、低电源消耗、平均效能而非最差效能、模组性、可组合和可复用性--因此近年来对非同步电路研究增加快速，论文发表数以倍增，而Intel Pentium 4处理器设计，也开始采用非同步电路设计。 异步电路主要是组合逻辑电路，用于产生地址译码器、ＦＩＦＯ或ＲＡＭ的读写控制信号脉冲，其逻辑输出与任何时钟信号都没有关系，译码输出产生的毛刺通常是可以监控的。同步电路是由时序电路(寄存器和各种触发器)和组合逻辑电路构成的电路，其所有操作都是在严格的时钟控制下完成的。这些时序电路共享同一个时钟ＣＬＫ，而所有的状态变化都是在时钟的上升沿(或下降沿)完成的。 3、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？（汉王笔试） 线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc门来实现（漏极或者集电极开路），由于不用oc门可能使灌电流过大，而烧坏逻辑门，同时在输出端口应加一个上拉电阻。（线或则是下拉电阻） 5、setup和holdup时间,区别.（南山之桥） 建立时间（setup time）是指在触发器的时钟信号上升沿到来以前，数据稳定不变的时间，如果建立时间不够，数据将不能在这个时钟上升沿被打入触发器；保持时间（hold time）是指在触发器的时钟信号上升沿到来以后，数据稳定不变的时间，如果保持时间不够，数据同样不能被打入触发器。 6、解释setup time和hold time的定义和在时钟信号延迟时的变化。（未知） 7、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA 2003.11.06 上海笔试试题） Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以
电子工程师招聘笔试题及详细解析(不看后悔)分析
一、基础题（每空1分，共40分） 1、晶体三极管在工作时，发射结和集电结均处于正向偏置，该晶体管工作在饱和_状态。 1.截止状态：基极电流Ib=0，集电极电流Ic=0，b-ePN结临界正向偏置到反向偏置， b-cPN结反向偏置。 2.放大状态：集电极电流随基极电流变化而变化，Ic=βIb，b-ePN结正向偏置，b-cPN结反向偏置。 3.饱和状态：集电极电流达到最大值，基极电流再增加集电极流也不会增加，这时的一个特征是b-ePN结、b-cPN结都正向偏置 2、TTL门的输入端悬空，逻辑上相当于接高电平。 3、TTL电路的电源电压为5V， CMOS电路的电源电压为3V-18V 。 4、在TTL门电路的一个输入端与地之间接一个10KΩ电阻，则相当于在该输入端输入低电平；在CMOS门电路的 输入端与电源之间接一个1KΩ电阻，相当于在该输入端输入高电平。 5、二进制数（11010010）2转换成十六进制数是D2。 6、逻辑电路按其输出信号对输入信号响应的不同，可以分为组合逻辑电路和时序逻辑电路两大类。 7、组成一个模为60的计数器，至少需要6个触发器。 一个触发器相当于一位存储单元，可以用六个触发器搭建异步二进制计数器，这样最多能计63个脉冲 8、在数字电路中，三极管工作在截止和饱和状态。 9、一个门电路的输出端能带同类门的个数称为扇出系数。 10、使用与非门时多余的输入脚应该接高电平，使用或非门时多余的输入脚应该接低电平。 与非门：若当输入均为高电平（1），则输出为低电平（0）；若输入中至少有一个为低电平（0），则输出为高电平（1）。所以多余的输入脚接高电平或非门：若当输入均为低电平（1），则输出为高电平（0）；若输入中至少有一个为高电平（0），则输出为低电平（1）。所以多余的输入脚接低电平 11、贴片电阻上的103代表10kΩ。 12、USB支持控制传输、同步传输、中断传输和批量传输等四种传输模式。 13、一个色环电阻，如果第一色环是红色，第二色环是红色，第三色环是黄色，第四色环是金色，则该电阻 的阻值是220kΩ±10%。 14、MOV A，40H 指令对于源超作数的寻址方式是直接寻址。 指令中直接给出操作数地址（dir）的寻址方式称为直接寻址。以寄存器中的内容为地址，该地址的内容为操作数的寻址方式称为寄存器间接寻址 15、8051系列单片机的ALE信号的作用是地址锁存控制信号。 Address lock enable ：地址锁存允许端 15、MCS-8051系列单片机字长是______位。 16、一个10位地址码、8位输出的ROM，其存储容量为。 17、队列和栈的区别是_________。 18、do……while和while……do的区别是_______。 19、在计算机中，一个字节所包含二进制位的个数是______。
ASIC设计流程中的典型问题研究
第35卷第2期2007年4月 浙江工业大学学报 J OURNAL OF ZH E J IAN G UN IV ERSIT Y OF TECHNOLO GY Vol.35No.2Apr.2007 收稿日期:2006209210 基金项目:浙江省教育厅资助科研项目(20051399) 作者简介:章旌红(1964—),女,浙江绍兴人,副教授,主要从事运动生物力学、电路与系统研究. A SIC 设计流程中的典型问题研究 章旌红,何剑春,陶东娅 (浙江工业大学信息工程学院,浙江杭州310032) 摘要:随着集成电路制造工艺的快速发展,系统芯片(SOC )及其功能ASIC 模块的研究越来越引起关注.基于ASIC 设计流程,讨论了当前ASIC 设计中逻辑综合、易测性、低功耗等一些典型问题,并以工艺独立阶段和工艺映射阶段中ASIC 综合需要解决的问题为研究重点,结合实例分析了其中的关键环节,以期作为高性能ASIC 设计优化、可测性设计、设计验证等方向分析研究的前期工作.关键词:ASIC ;逻辑综合;可测性设计;低功耗中图分类号:TN402 文献标识码:A 文章编号:100624303(2007)022******* R esearch on some typical problems in the ASIC design flow ZHAN G Jiang 2ho ng ,H E Jian 2chun ,Tao Dong 2ya (College of Information Engineering ,Zhejiang University of Technology ,Hangzhou 310032,China ) Abstract :Wit h t he fast develop ment of IC fabricating technology ,research on SOC and ASIC modules cause more attention.According to t he design flow ,some typical p roblems ,such as log 2ic synt hesis ,testability and low power dissipation ,was discussed in t he paper.And most atten 2tion was paid on t he ASIC synt hesis in t he technology independency and technology mapping p ro 2cedure separately.We hope t hat t he research is a good guide for t he st udy on design optimization ,design for test and verification. K ey w ords :ASIC ;logic synt hesis ;design for test ;low power dissipation 0 引 言 随着集成电路设计制造技术的进步,系统芯片(SOC )得到快速发展.对SOC 中完成特定功能的专用集成电路(ASIC )的研究显得越来越重要.通常,ASIC 芯片在尺寸、耗电量、发热量和成本方面比一 般的IC 部件要求更高.近年来,由于鲁棒性设计方法和自动电路综合工具在芯片设计过程中的普遍应用,从高层次的设计描述到最后的芯片布图和掩模阶段的工作难度明显降低,导致ASIC 芯片和集成 了ASIC 模块的芯片的需求迅速上升.目前,从消费 电子到空间技术领域,ASIC 和具有ASIC 模块的半导体芯片都得到了广泛应用. 笔者研究了ASIC 设计流程中逻辑综合、易测性、功耗优化等关键问题,着重讨论设计流程、设计方法、综合和物理设计方面的问题. 1 ASIC 设计流程 ASIC 的设计制造工序繁多.产品的性能要求 一旦确定下来,就需要完成从高层次设计、电路综合
电子信息笔试题
电子信息工程、通信工程、电气类等专业面试将会遇到试题大全来源：王琴的日志 模拟电路 1、基尔霍夫定理的内容是什么？（仕兰微电子） 基尔霍夫电流定律是一个电荷守恒定律,即在一个电路中流入一个节点的电荷与流出同一个节点的电荷相等. 基尔霍夫电压定律是一个能量守恒定律,即在一个回路中回路电压之和为零. 2、平板电容公式(C=εS/4πkd)。（未知） 3、最基本的如三极管曲线特性。（未知） 4、描述反馈电路的概念，列举他们的应用。（仕兰微电子） 5、负反馈种类（电压并联反馈，电流串联反馈，电压串联反馈和电流并联反馈）；负反馈的优点（降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非线性失真，有效地扩展放大器的通频带，自动调节作用）（未知） 6、放大电路的频率补偿的目的是什么，有哪些方法？（仕兰微电子） 7、频率响应，如：怎么才算是稳定的，如何改变频响曲线的几个方法。（未知） 8、给出一个查分运放，如何相位补偿，并画补偿后的波特图。（凹凸） 9、基本放大电路种类（电压放大器，电流放大器，互导放大器和互阻放大器），优缺点 ，特别是广泛采用差分结构的原因。（未知） 10、给出一差分电路，告诉其输出电压Y+和Y-,求共模分量和差模分量。（未知） 11、画差放的两个输入管。（凹凸） 12、画出由运放构成加法、减法、微分、积分运算的电路原理图。并画出一个晶体管级的运放电路。（仕兰微电子） 13、用运算放大器组成一个10倍的放大器。（未知） 14、给出一个简单电路，让你分析输出电压的特性（就是个积分电路），并求输出端某点 的rise/fall时间。(Infineon笔试试题) 15、电阻R和电容C串联，输入电压为R和C之间的电压，输出电压分别为C上电压和R 上电压，要求制这两种电路输入电压的频谱，判断这两种电路何为高通滤波器，何为低通滤波器。当RC<< period - setup ? hold 16、时钟周期为T,触发器D1的建立时间最大为T1max，最小为T1min。组合逻辑电路最大延迟为T2max,最小为T2min。问，触发器D2的建立时间T3和保持时间应满足什么条件.（华为） 17、给出某个一般时序电路的图，有Tsetup,Tdelay,Tck->q,还有clock的delay,写出决定最大时钟的因素，同时给出表达式。（威盛VIA 2003.11.06 上海笔试试题） 18、说说静态、动态时序模拟的优缺点。（威盛VIA 2003.11.06 上海笔试试题） 19、一个四级的Mux,其中第二级信号为关键信号如何改善timing。（威盛VIA2003.11.06 上海笔试试题） 20、给出一个门级的图，又给了各个门的传输延时，问关键路径是什么，还问给出输入,使得输出依赖于关键路径。（未知） 21、逻辑方面数字电路的卡诺图化简，时序（同步异步差异），触发器有几种（区别，优点），全加器等等。（未知） 22、卡诺图写出逻辑表达使。（威盛VIA 2003.11.06 上海笔试试题） 23、化简F(A,B,C,D)= m(1,3,4,5,10,11,12,13,14,15)的和。（威盛） 24、please show the CMOS inverter schmatic,layout and its cross sectionwith P- well process.Plot its transfer curve (Vout-Vin) And also explain the operation
数字IC类笔试面试题
威盛logic design engineer考题 1。一个二路选择器，构成一个4路选择器，满足真值表要求、 2。已知A,B,C三个信号的波形，构造一个逻辑结构，使得从AB可以得到C，并且说明如何避免毛刺 3。一段英文对信号波形的描述，理解后画出波形，并采用verilog实现。 4。169.6875转化成2进制和16进制 5。阐述中断的概念，有多少种中断，为什么要有中断，举例 6。这道比较搞，iq题，5名车手开5种颜色的车跑出了5个耗油量（milespergallon)，然后就说什么颜色的车比什么车手的耗油量多什么的，判断人，车，好油量的排序ft致死，看了一堆FSM和数字电路没啥用，结果基本的冬冬把自己搞死了。 不过mixedsignal里的数字部分到是很全的考察了数字的冬冬（转） 几道威盛电子的FPGA工程师试题 7、解释setup和hold time violation,画图说明,并说明解决办法. 17、给出某个一般时序电路的图,有Tsetup,Tdelay,Tck->q,还有 clock的delay,写出决定最大时钟的因素,同时给出表达式. 18、说说静态、动态时序模拟的优缺点. 19、一个四级的Mux,其中第二级信号为关键信号如何改善timing 22、卡诺图写出逻辑表达使. 23、化简F(A,B,C,D)= m(1,3,4,5,10,11,12,13,14,15)的和 28Please draw the transistor level schematic of a cmos 2 input AND gate andexplain which input h as faster response for output rising edge.(less delaytime). 30、画出CMOS的图,画出tow-to-one mux gate. 45、用逻辑们画出D触发器46、画出DFF的结构图,用verilog实现之. 68、一个状态机的题目用verilog实现73、画出可以检测10010串的状态图,并verilog实现之. 80、 Please draw schematic of a common SRAM cell with 6 transistors,point outwhich nodes can store data and which node is word line control? (威盛笔试circuit design)（转） VIA数字IC笔试试题 1。解释setup和hold time violation，画图说明，并说明解决办法。 2。说说静态、动态时序模拟的优缺点。 3。用一种编程语言写n!的算法。 4。画出CMOS的图，画出tow-to-one mux gate。 5。说出你的最大弱点及改进方法。 6。说出你的理想。说出你想达到的目标。
电子行业招聘笔试题分享
电子行业招聘笔试题分享 1、请描述一下国内的工艺现状。(仕兰微面试题目) 2、半导体工艺中，掺杂有哪几种方式?(仕兰微面试题目) 3、描述你对集成电路工艺的认识。(仕兰微面试题目) 4、列举几种集成电路典型工艺。工艺上常提到0.25,0.18指的是什么?(仕兰微面试题目) 5、描述cmos电路中闩锁效应产生的过程及最后的结果?(仕兰微面试题目) 6、解释latch-up现象和antenna effect和其预防措施.() 7、什么叫latchup?(科广试题) 8、什么叫窄沟效应? (科广试题) 9、什么是nmos、pmos、cmos?什么是增强型、耗尽型?什么是pnp、npn?他们有什么差别?(仕兰微面试题目) 10、硅栅coms工艺中n阱中做的是p管还是n管，n阱的阱电位的连接有什么要求?(仕兰微面试题目) 11、画出cmos晶体管的cross-over图(应该是纵剖面图)，给出所有可能的传输特性和转移特性。(infineon笔试试题) 12、以interver为例,写出n阱cmos的process流程,并画出剖面图。(科广试题) 13、please explain how we describe the resistance in
semiconductor. compare the resistance of a metal,poly and diffusion in tranditional cmos process.(威盛笔试题circuit design-beijing-03.11.09) 14、说明mos一半工作在什么区。(凹凸的题目和面试) 15、画p-bulk 的nmos截面图。(凹凸的题目和面试) 16、写schematic note(?)，越多越好。(凹凸的题目和面试) 17、寄生效应在ic设计中怎样加以克服和利用。() 18、unix 命令cp -r, rm,uname。(扬智电子笔试) 19、太底层的mos管物理特性感觉一般不大会作为笔试面试题，因为全是微电子物理，公式推导太罗索，除非面试出题的是个老学究。ic设计的话需要熟悉的软件: cadence,synopsys, avant，unix当然也要大概会操作。
各大公司数字电路笔试试题
1、同步电路和异步电路的区别是什么？（仕兰微电子） 2、什么是同步逻辑和异步逻辑？（汉王笔试） 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 電路設計可分類為同步電路和非同步電路設計。同步電路利用時鐘脈衝使其子系統同步運作，而非同步電路不使用時鐘脈衝做同步，其子系統是使用特殊的“開始”和“完成”信號使之同步。由於非同步電路具有下列優點--無時鐘歪斜問題、低電源消耗、平均效能而非最差效能、模組性、可組合和可複用性--因此近年來對非同步電路研究增加快速，論文發表數以倍增，而Intel Pentium 4處理器設計，也開始採用非同步電路設計。 3、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？（汉王笔试） 线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc门来实现（漏极或者集电极开路），由于不用oc门可能使灌电流过大，而烧坏逻辑门，同时在输出端口应加一个上拉电阻。（线或则是下拉电阻） 4、什么是Setup 和Holdup时间？（汉王笔试） 5、setup和holdup时间,区别.（南山之桥） 6、解释setup time和hold time的定义和在时钟信号延迟时的变化。（未知） 7、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA 2003.11.06 上海笔试试题） Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T 时间到达芯片，这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟
数字电路笔试题
数字电路 1、同步电路和异步电路的区别是什么？（仕兰微电子） 2、什么是同步逻辑和异步逻辑？（汉王笔试） 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 電路設計可分類為同步電路和非同步電路設計。同步電路利用時鐘脈衝使其子系統同步運作，而非同步電路不使用時鐘脈衝做同步，其子系統是使用特殊的“開始”和“完成”信號使之同步。由於非同步電路具有下列優點--無時鐘歪斜問題、低電源消耗、平均效能而非最差效能、模組性、可組合和可複用性--因此近年來對非同步電路研究增加快速，論文發表數以倍增，而Intel Pentium 4處理器設計，也開始採用非同步電路設計。 异步电路主要是组合逻辑电路，用于产生地址译码器、ＦＩＦＯ或ＲＡＭ的读写控制信号脉冲，其逻辑输出与任何时钟信号都没有关系，译码输出产生的毛刺通常是可以监控的。同步电路是由时序电路(寄存器和各种触发器)和组合逻辑电路构成的电路，其所有操作都是在严格的时钟控制下完成的。这些时序电路共享同一个时钟ＣＬＫ，而所有的状态变化都是在时钟的上升沿(或下降沿)完成的。 3、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？（汉王笔试） 线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc门来实现（漏极或者集电极开路），由于不用oc门可能使灌电流过大，而烧坏逻辑门，同时在输出端口应加一个上拉电阻。（线或则是下拉电阻） 4、什么是Setup 和Holdup时间？（汉王笔试） 5、setup和holdup时间,区别.（南山之桥） 6、解释setup time和hold time的定义和在时钟信号延迟时的变化。（未知） 7、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA 2003.11.06 上海笔试试题） Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold time不够，数据同样不能被打入触发器。 建立时间(Setup Time)和保持时间（Hold time）。建立时间是指在时钟边沿前，数据信号需要保持不
ASIC设计流程及工具
ASIC设计流程及工具 1.使用语言：VHDL/verilog HDL 2.各阶段典型软件介绍： 输入工具：Summit ,ultraedit Summit 公司,ultraedit 仿真工具：VCS, VSS Synopsys 公司 综合器：DesignCompile, BC Compile Synopsys 公司 布局布线工具：Preview 和Silicon Ensemble Cadence 公司 版图验证工具：Dracula, Diva Cadence 公司 静态时序分析: Prime Time Synopsys 公司 测试：DFT Compile Synopsys 公司 3.流程 第一阶段：项目策划 形成项目任务书(项目进度，周期管理等)。流程：【市场需求--调研--可行性研究--论证--决策--任务书】。 第二阶段：总体设计 确定设计对象和目标，进一步明确芯片功能、内外部性能要求，参数指标,论证各种可行方案，选择最佳方式，加工厂家，工艺水准。 流程：【需求分析--系统方案--系统设计--系统仿真】。 第三阶段：详细设计和可测性设计 分功能确定各个模块算法的实现结构，确定设计所需的资源按芯片的要求，速度，功耗，带宽，增益，噪声，负载能力，工作温度等和时间，成本，效益要求选择加工厂家，实现方式，（全定制，半定制，ASIC，FPGA等）；可测性设计与时序分析可在详细设计中一次综合获得，可测性设计常依据需要采用FullScan，PartScan等方式，可测性设计包括带扫描链的逻辑单元，ATPG，以及边界扫描电路BoundScan，测试Memory的BIST。 流程：【逻辑设计--子功能分解--详细时序框图--分块逻辑仿真--电路设计(算法的行为级，RTL级描述)--功能仿真--综合(加时序约束和设计库)--电路网表--网表仿真】。 第四阶段：时序验证与版图设计 静态时序分析从整个电路中提取出所有时序路径，然后通过计算信号沿在路径上的延迟传播，找出违背时序约束的错误(主要是SetupTime 和HoldTime),与激励无关。在深亚微米工艺中，因为电路连线延迟大于单元延迟，通常预布局布线反复较多，要多次调整布局方案，对布局布线有指导意义。 流程：【预布局布线(SDF文件)--网表仿真(带延时文件)--静态时序分析--布局布线--参数提取--SDF 文件--后仿真--静态时序分析--测试向量生成】第五阶段：加工与完备
网上常见的笔试题
网上常见的笔试题 12、画出由运放构成加法、减法、微分、积分运算的电路原理图。并画出一个晶体管级的 运放电路。(仕兰微电子) 13、用运算放大器组成一个10倍的放大器。(未知) 14、给出一个简单电路，让你分析输出电压的特性(就是个积分电路)，并求输出端某点 的rise/fall时间。(Infineon试题) 15、电阻R和电容C串联，输入电压为R和C之间的电压，输出电压分别为C上电压和R上电
压，要求绘制这两种电路输入电压的频谱，判断这两种电路何为高通滤波器，何为低通滤 波器。当RC 16、有源滤波器和无源滤波器的原理及区别?(新太硬件) 17、有一时域信号S=V0sin(2pif0t)+V1cos(2pif1t)+V2sin(2pif3t+90),当其通过低通、 带通、高通滤波器后的信号表示方式。(未知) 18、选择电阻时要考虑什么?(东信)
19、在CMOS电路中，要有一个单管作为开关管精确传递模拟低电平，这个单管你会用P管 还是N管，为什么?(仕兰微电子) 20、给出多个mos管组成的电路求5个点的电压。(Infineon 笔试试题) 21、电压源、电流源是集成电路中经常用到的模块，请画出你知道的线路结构，简单描述 其优缺点。(仕兰微电子) 22、画电流偏置的产生电路，并解释。(凹凸)
23、史密斯特电路,求回差电压。(华为题) 24、晶体振荡器,好像是给出振荡频率让你求周期(应该是单片机的,12分之一周期....) (华为面试题) 25、LC正弦波振荡器有哪几种三点式振荡电路，分别画出其原理图。(仕兰微电子) 26、VCO是什么,什么参数(压控振荡器?) (华为面试题) 27、锁相环有哪几部分组成?(仕兰微电子) 28、锁相环电路组成，振荡器(比如用D触发器如何搭)。(未知)
集成电路设计流程
集成电路设计流程 . 集成电路设计方法 . 数字集成电路设计流程 . 模拟集成电路设计流程 . 混合信号集成电路设计流程 . SoC芯片设计流程 State Key Lab of ASIC & Systems, Fudan University 集成电路设计流程 . 集成电路设计方法 . 数字集成电路设计流程 . 模拟集成电路设计流程 . 混合信号集成电路设计流程 . SoC芯片设计流程 State Key Lab of ASIC & Systems, Fudan University 正向设计与反向设计 State Key Lab of ASIC & Systems, Fudan University 自顶向下和自底向上设计 State Key Lab of ASIC & Systems, Fudan University Top-Down设计 –Top-Down流程在EDA工具支持下逐步成为 IC主要的设计方法 –从确定电路系统的性能指标开始，自系 统级、寄存器传输级、逻辑级直到物理 级逐级细化并逐级验证其功能和性能 State Key Lab of ASIC & Systems, Fudan University Top-Down设计关键技术 . 需要开发系统级模型及建立模型库，这些行 为模型与实现工艺无关，仅用于系统级和RTL 级模拟。 . 系统级功能验证技术。验证系统功能时不必 考虑电路的实现结构和实现方法，这是对付 设计复杂性日益增加的重要技术，目前系统 级DSP模拟商品化软件有Comdisco，Cossap等， 它们的通讯库、滤波器库等都是系统级模型 库成功的例子。 . 逻辑综合--是行为设计自动转换到逻辑结构 设计的重要步骤 State Key Lab of ASIC & Systems, Fudan University
威盛ASIC笔试题及心得文档
威盛ASIC笔试题及心得文档 Written test questions and experience documents of via ASIC
威盛ASIC笔试题及心得文档 前言：个人简历是求职者给招聘单位发的一份简要介绍，包括个人的基本信息、过往实习工作经验以及求职目标对应聘工作的简要理解，在编写简历时，要强调工作目标和重点，语言精简，避免可能会使你被淘汰的不相关信息。写出一份出色的个人简历不光是对找工作很有用处，更是让陌生人对本人第一步了解和拉进关系的线。本文档根据个人简历内容要求和特点展开说明，具有实践指导意义，便于学习和使用，本文下载后内容可随意调整修改及打印。 1、用给出的一些门电路，搭出表达式output=en_try? ennomask : en这一表达式 entry，en,nomask是输入 2、给出电路，将时钟域1的脉冲传到时钟域2，两个时钟域的关系未知 3、给出三分频的电路 4、用pmos和nmos表示f＝ab＋cd（表达式与原题有点出入，记不清了，大概就这个意思） 5、两段verilog程序，判断哪一段会产生latch，并修改 6、给出了电路图，问在做dft测试时可能产生什么问题，并修改
7、给了张电路图，是功放与d触发器相连，问如何减少功耗（这个我一点都不懂） 8、触发器s 1、组合电路c1、触发器s 2、组合电路c2依次相连，问的是时延、时钟等之间的 关系（是不是要考虑hold，setup时间呢？） 9、这个实在想不出了：（ 10、用方块表示cpu，硬盘，显卡，南桥（iobridge），北桥（memory bridge），usb控制 器，键盘，内存，画出计算机的结构。 11、关于计算机内存页面管理的东西，画图示意虚拟地址与物理地址的关系，简单介绍块 表 可怜我都不会做贴贴题目积攒一下rp，祝xdjm们好运 先说说题目吧 第一题：给你一堆逻辑门再给你一个逻辑表达式，让你用这些门实现这个表达式 第二题：关于时钟域的，要求把一个时钟域中的信号传递到另外一个时钟域中 第三题：画出三分频1：1的电路图 第四题：用pmos和nmos搭出一个表达式，表达式中只
MCU、硬件工程师笔试面试题
单片机笔试面试题 2007-12-18 17:20 1、简单描述一个单片机系统的主要组成模块,并说明各模块之间的数据流流向和控制流流向.简述单片机应用系统的设计原则.(仕兰微面试题目) 2、画出8031与2716(2K*8ROM)的连线图,要求采用三-八译码器,8031的P2.5,P2.4和 P2.3参加译码,基本地址范围为3000H-3FFFH.该2716有没有重叠地址?根据是什么?若 有蛐闯雒科?716的重叠地址范围.(仕兰微面试题目) 3、用8051设计一个带一个8*16键盘加驱动八个数码管(共阳)的原理图.(仕兰微面试 题目) 4、PCI总线的含义是什么?PCI总线的主要特点是什么? (仕兰微面试题目) 5、中断的概念?简述中断的过程.(仕兰微面试题目) 6、如单片机中断几个/类型,编中断程序注意什么问题;(未知) 7、要用一个开环脉冲调速系统来控制直流电动机的转速,程序由8051完成.简单原理如下:由P3.4输出脉冲的占空比来控制转速,占空比越大,转速越快;而占空比由K7-K0八 个开关来设置,直接与P1口相连(开关拨到下方时为"0",拨到上方时为"1",组成一个八 位二进制数N),要求占空比为N/256. (仕兰微面试题目) 下面程序用计数法来实现这一功能,请将空余部分添完整. MOV P1,#0FFH LOOP1 :MOV R4,#0FFH -------- MOV R3,#00H LOOP2 :MOV A,P1 -------- SUBB A,R3 JNZ SKP1 -------- SKP1:MOV C,70H MOV P3.4,C ACALL DELAY :此延时子程序略 -------- -------- AJMP LOOP1 8、单片机上电后没有运转,首先要检查什么?(东信笔试题) 9、What is PC Chipset? (扬智电子笔试) 芯片组(Chipset)是主板的核心组成部分,按照在主板上的排列位置的不同,通常分为 北桥芯片和南桥芯片.北桥芯片提供对CPU的类型和主频、内存的类型和最大容量、ISA/PCI/AGP插槽、ECC纠错等支持.南桥芯片则提供对KBC(键盘控制器)、R TC(实时时钟控制器)、USB(通用串行总线)、Ultra DMA/33(66)EIDE数据传输方式和ACPI(高级 能源管理)等的支持.其中北桥芯片起着主导性的作用,也称为主桥(Host Bridge). 除了最通用的南北桥结构外,目前芯片组正向更高级的加速集线架构发展,Intel的