数电实验报告实验二组合逻辑电路的设计方案
实验二 利用MSI设计组合逻辑电路
实验二利用MSI设计组合逻辑电路刘予歆一、实验目的1、编码器的原理理解，数据选择器的分析2、掌握MSI设计的组合逻辑电路的方法3、设计一个数据分配器4、设计一个简单的AU二、我要用的仪器：数电实验箱、数字万用表、示波器74LS00 74LS197 74LS138 74LS151三、实验原理1、数据分配器：74LS138：如图1：S0，S1，S2是地址指示输入端，用三个端口表示8个地址的数据分配。
G1是数据输入端，G1的脉冲输入信息传递到根据S0，S1，S2的指示的地址；而D0~D7端口则是数据分配后的输出，否G2A和否G2B是使能端，当两者的输入电频同时为低是使芯片工作，否则D端的输出总是高电平。
2、数据分配器：74LS151：如图2：S0，S1，S2是地址指示输入端，而D0~D7是数据输入端，根据S0，S1，S2的指示来将数据从Z端输出，而否Z端输出Z数据的反码（本实验在、暂时不用），而否E端接入低电频，使芯片工作。
四、实验内容实验一：模拟数据分配器的使用关于相关的实验一：用74LS197模拟数据输入，其中包括S0，S1，S2指示的数据分配和一个数据读入端，用示波器检测D0~D7每个输出波形，而它的真值表如表一。
实验电路如下：经过示波器检测，如图4，在波形图中，D0接入10KHZ的方波脉冲，作为clock, 而D1，D2，D3是地址输入的波形，D7~D14记录了138数据分配器的地址输出波形。
经过图4分析，经过S0，S1，S2地址调控，对应端口是G1数据输入的反码，为了图4区别无关地址输出端口的高电平，本实验G1的输入总是1，使得对应的数据分配地址输出是低电位的，在图4的波形中，我们可以从波形X 得到地址分配，从而在对应的波形X 中观察到低电位。
实验二：设计一个LU——数据选择器的应用：如表二，这是本次试验的目标，S2S1用来控制逻辑功能的选择，而Y=f(A, B), 如表三是S1，S0，A，B，Yi的真值表，对应的写出了杨树表达式。
数电实验(实验二_组合电路设计和冒险现象分析)
内容一：设计一个组合逻辑电路，它接收一个8421BCD码 B3B2B1B0，仅当2＜B3B2B1B0＜7时输出Y才为1。 设计步骤如下：
（1）了解TTL与非门（74LS00）的引脚结构图
Vcc 3A
14 13
3B
12
3Y
11
4A
10
4B
9
4Y
8
可见：芯片74LS00有14个引脚，
左上针脚接Vcc，右下针脚 接GND，含有4组与非门（每 一组左边两个引脚为输入， 右边引脚为输出）。
取B=C=D=1（拨动开关均往上拨），A端接100kHz的方波信号。 示波器的两个通道分别观察A和Y点的工作波形，波形如下：
实验内容二
设计步骤如下：
（6）观察用增加校正项的办法消除由于输入端A信号变化所引起 的逻辑冒险现象。
对于A端信号变化产生的冒险现象，可通过增加冗余项BCD来消除。
74LS00
1 2 3 4 5 6 7
1A
1B
1Y
2A
2B
2Y GND
三 实验内容一
设计步骤如下：
（2）根据题意列出真值表
三 实验内容一
设计步骤如下：
（3）利用真值表画卡诺图、化简
三 实验内容一
设计步骤如下：
（4）画出电路图
*请同学自行标注芯片引脚号！
实验内容一
设计步骤如下：
（5）电路搭试与实验验证
Y
A
1 1 1 1 1 1 1 1
B
0 0 0 0 1 1 1 1
C
0 0 1 1 0 0 1
Y
实验内容二
设计步骤如下：
（3）分析输入端B、C、D各处于什么状态时能观察到输入端A信号 变化时产生的冒险现象。
数电实验二(组合电路的分析与设计)
1 x x x x 0 x x x x 0 x x x x
A 0 B 0 0 1 1 0 0 1 1 C 0 1 0 1 0 1 0 1 Y
按左图连接电路， 按左图连接电路， 并在A、 、 接开关 接开关， 并在 、B、C接开关， Y接发光管，测定其真 接发光管， 接发光管 值表填入右表， 值表填入右表，分析其 逻辑功能。 逻辑功能。
0 0 0 1 1 1 1
实验二：SSI组合逻辑电路 实验二：SSI组合逻辑电路
一：实验目的
1、学会组合逻辑电路的分析和设计方法。 学会组合逻辑电路的分析和设计方法。 设计并验证数据选择器。 2、设计并验证数据选择器。 分析一监视交通灯的电路的逻辑功能。 3、分析一监视交通灯的电路的逻辑功能。
二：实验仪器及设备
1、数字实验箱DSB-3：1台 数字实验箱DSBDSB 2、万用表： 万用表： 1只 元器件： 7400、7410、 3、元器件： 7400、7410、7420 各一块 导线：若干。 4、导线：若干。
x x x x x x x 0 x x 0 1 x 0 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IN4 IN5 IN6 IN7 ST Y2 Y1 GND
0 x x x x 0 x x x x 0 x x x 0 0 x x 0 1 0 x 0 1 1 0 0 1 1 1 0 1 1 1 1
数电实验组合逻辑电路
实验二组合逻辑电路一、实验目的1.掌握组合逻辑电路的分析方法2.掌握组合逻辑电路的设计方法二、实验仪器数字电路实验台、数字万用表、74ls00,74ls20三、实验原理1.组合逻辑电路的分析方法组合逻辑电路时最常见的逻辑电路，可以用一些常用的门电路组合成具有其他功能的门电路。
其分析方法是根据所给的逻辑电路，写出其输入和输出之间的逻辑函数表达式或真值表，从而确定该电路的逻辑功能。
2.组合逻辑电路的设计方法组合逻辑电路是使用中、小规模集成电路来设计组合电路是最常见的逻辑电路，其分析方法是根据所给的组合逻辑电路，写出其输入与输出之间的逻辑函数表达式或者真值表，从而确定该电路的逻辑功能。
组合电路设计的一般步骤如图所示：根据设计任务的要求建立输入、输出变量，并列出真值表。
然后用逻辑代数或卡诺图化简法求出简化的逻辑表达式。
并按实际选用逻辑门的类型修改逻辑表达式。
根据简化后的逻辑表达式，画出逻辑图，用标准器件构成逻辑电路。
最后，用实验来验证设计的正确性。
2、组合逻辑电路设计举例用“与非”门设计一个表决电路。
当四个输入端中有三个或四个为“1”时，输出端才为“1”。
(1)设计步骤：根据题意列出真值表如表所示，再填入卡诺图表中。
(2)根据真值表，画卡诺图(3)由卡诺图得出逻辑表达式，并演化成“与非”的形式Z ＝ABC ＋BCD ＋ACD ＋ABD ＝ABC ACD BCD ABC ⋅⋅⋅根据逻辑表达式画出用“与非门”构成的逻辑电路如图所示。
多数表决电路 74LS20引脚图3.用实验验证逻辑功能在实验装置适当位置选定三个14P 插座，按照集成块定位标记插好集成块。
按图接线，输入端A 、B 、C 、D 接至逻辑开关输出插口，输出端Z 接逻辑电平显示输入插口，按真值表（自拟）要求，逐次改变输入变量，测量相应的输出值，验证逻辑功能，与其进行比较，验证所设计的逻辑电路是否符合要求。
三、实验内容1.设计两个2位二进制码比较器，试用最少的与非门实现改功能，要求A=B 时输出为1。
数电逻辑门电路实验报告doc
数电逻辑门电路实验报告篇一：组合逻辑电路实验报告课程名称：数字电子技术基础实验指导老师：樊伟敏实验名称：组合逻辑电路实验实验类型：设计类同组学生姓名：__________ 一、实验目的和要求（必填）二、实验内容和原理（必填）三、主要仪器设备（必填）五、实验数据记录和处理七、讨论、心得一．实验目的1.加深理解全加器和奇偶位判断电路等典型组合逻辑电路的工作原理。
2.熟悉74LS00、74LS11、74LS55等基本门电路的功能及其引脚。
3.掌握组合集成电路元件的功能检查方法。
4.掌握组合逻辑电路的功能测试方法及组合逻辑电路的设计方法。
二、主要仪器设备74LS00（与非门） 74LS55（与或非门） 74LS11（与门）导线电源数电综合实验箱三、实验内容和原理及结果四、操作方法和实验步骤六、实验结果与分析（必填）实验报告(一)一位全加器1.1 实验原理：全加器实现一位二进制数的加法，输入有被加数、加数和来自相邻低位的进位；输出有全加和与向高位的进位。
1.2 实验内容：用 74LS00与非门和 74LS55 与或非门设计一个一位全加器电路，并进行功能测试。
1.3 设计过程：首先列出真值表，画卡诺图，然后写出全加器的逻辑函数，函数如下： Si = Ai ?Bi?Ci-1 ；Ci = Ai Bi +(Ai?Bi)C i-1异或门可通过Ai ?Bi?AB?AB,即一个与非门；（74LS00），一个与或非门（74LS55）来实现。
Ci = Ai Bi +(Ai?Bi)C再取非，即一个非门（i-1?Ai Bi +(Ai?Bi)Ci-1，通过一个与或非门Ai Bi +(Ai?Bi)Ci-1，用与非门）实现。
1.4 仿真与实验电路图：仿真与实验电路图如图 1 所示。
图11实验名称：组合逻辑实验姓名：学号：1.5 实验数据记录以及实验结果全加器实验测试结果满足全加器的功能，真值表：(二)奇偶位判断器2.1 实验原理：数码奇偶位判断电路是用来判别一组代码中含 1 的位数是奇数还是偶数的一种组合电路。
组合逻辑电路的设计实验报告
竭诚为您提供优质文档/双击可除组合逻辑电路的设计实验报告篇一：数电实验报告实验二组合逻辑电路的设计实验二组合逻辑电路的设计一、实验目的1.掌握组合逻辑电路的设计方法及功能测试方法。
2.熟悉组合电路的特点。
二、实验仪器及材料a)TDs-4数电实验箱、双踪示波器、数字万用表。
b)参考元件：74Ls86、74Ls00。
三、预习要求及思考题1．预习要求：1）所用中规模集成组件的功能、外部引线排列及使用方法。
2)组合逻辑电路的功能特点和结构特点.3)中规模集成组件一般分析及设计方法.4）用multisim软件对实验进行仿真并分析实验是否成功。
2.思考题在进行组合逻辑电路设计时，什么是最佳设计方案？四、实验原理1．本实验所用到的集成电路的引脚功能图见附录2.用集成电路进行组合逻辑电路设计的一般步骤是：1）根据设计要求，定义输入逻辑变量和输出逻辑变量，然后列出真值表；2）利用卡络图或公式法得出最简逻辑表达式，并根据设计要求所指定的门电路或选定的门电路，将最简逻辑表达式变换为与所指定门电路相应的形式；3）画出逻辑图；4）用逻辑门或组件构成实际电路，最后测试验证其逻辑功能。
五、实验内容1．用四2输入异或门（74Ls86）和四2输入与非门（74Ls00）设计一个一位全加器。
1）列出真值表,如下表2-1。
其中Ai、bi、ci分别为一个加数、另一个加数、低位向本位的进位；si、ci+1分别为本位和、本位向高位的进位。
2）由表2-1全加器真值表写出函数表达式。
3）将上面两逻辑表达式转换为能用四2输入异或门（74Ls86）和四2输入与非门（74Ls00）实现的表达式。
4）画出逻辑电路图如图2-1，并在图中标明芯片引脚号。
按图选择需要的集成块及门电路连线，将Ai、bi、ci接逻辑开关，输出si、ci+1接发光二极管。
改变输入信号的状态验证真值表。
2.在一个射击游戏中，每人可打三枪，一枪打鸟(A)，一枪打鸡（b），一枪打兔子（c）。
数电实验报告
一、实验名称1. 实验一QuartusⅡ原理图输入法设计与实现2. 实验二用VHDL设计与实现组合逻辑电路（一）3. 实验三用VHDL设计与实现时序逻辑电路（二）4.实验四用VHDL设计与实现时序逻辑电路（三）(数码管动态扫描控制器)二、实验任务要求1.实验一:○1用逻辑门设计实现一个半加器，仿真验证其功能，并生成新的半加器图形模块单元；○2用上面生成的半加器模块和逻辑门设计实现一个全加器，仿真验证其功能，并下载到实验板测试，要求用拨码开关设定输入信号，发光二极管显示输出信号；○3用3线-8线译码器（74LS138）和逻辑门设计实现函数F=CBA+CBA+CBA+CBA，仿真验证其功能，并下载到实验班测试。
要求用拨码开关设定输入信号，发光二极管显示输出信号；2.实验二：○1用VHDL语言设计实现一个4位二进制奇校验器，输入奇数个…1‟时，输出为…1‟，否则输出为…0‟，仿真验证其功能，并下载到实验板测试。
要求用拨码开关设定输入信号，发光二极管显示输出信号；○2用VHDL语言设计实现一个8421码转换为余3码的代码转换器，仿真验证其功能，并下载到实验板测试。
要求用拨码开关设定输入信号，发光二极管显示输出信号；○3用VHDL语言设计实现一个共阴极7段数码管译码器，仿真验证其功能，并下载到实验班测试。
要求用拨码开关设定输入信号，发光二极管显示输出信号；3.实验三：○1用VHDL语言设计实现一个分频系数为12，分频输出信号占空比为50%的分频器。
要求在Quartus Ⅱ平台上设计程序并仿真验证设计；○2用VHDL语言设计实现一个带异步复位的8421码十进制计数器，仿真验证其功能，并下载到实验板测试。
要求用拨码开关设定输入信号，发光二极管显示输出信号；○3将分频器、8421十进制计数器、数码管译码器3个电路进行连接并下载测试。
4.实验四：○1用VHDL语言设计并实现六个数码管串行扫描电路，要求同时显示0、1、2、3、4、5这6个不同的数字图形到6个数码管上，仿真验证其功能，并下载到实验板测试；（必做）○2用VHDL语言设计并实现六个数码管循环左滚动，时钟点亮6个数码管，坐出右进，状态为：012345→123450→234501→345012→450123→501234→012345；（选做）○3用VHDL语言设计并实现六个数码管向左滚动，用全灭的数码管填充右边，直至全部变灭，然后再一次从右边一个一个地点亮。
数电实验二
数电实验二实验二：组合逻辑电路(MSI和设计)一、实验目的：1、了解集成编码器74HC148、译码器74HC138、集成数据选择器74HC151、加法器74HC283、数值比较器74HC85的管脚排列和管脚功能、性能及使用方法；2、掌握用SSI小规模集成器件设计组合逻辑电路的方法，用实验验证所设计电路的功能；3、掌握用MSI中规模集成器件设计组合逻辑电路的方法，用实验验证所设计电路的功能。
二、知识点提示：1、组合逻辑电路的设计方法(1)首先根据给出的实际逻辑问题进行逻辑设计，将给定的因果关系进行逻辑抽象，列出逻辑真值表；(2)根据真值表写出相对应的逻辑表达式，并化成适合的形式； (3)选定集成器件类型；（应该根据电路的具体要求和器件的资源情况来决定） (4)再根据逻辑表达式，画出逻辑电路图；(5)在逻辑电路图上标出对应器件管脚号，然后进行接线，实验验证其设计功能。
2、中规模集成器件电路特点中规模集成器件多数是专用的功能器件，具有某种特定的逻辑功能，可以使用这些功能器件实现组合逻辑函数，方法是逻辑函数对比法。
具体设计方法见教材。
三、实验原理：1、MSI中规模集成电路的管脚图和功能表，及使用说明。
①译码器(74HC138)一个n变量的译码器的输出包含了n变量的所有最小项。
例如，3线／8线译码器(74HCl38)8个输出包含了3个变量的全部最小项的译码。
用n变量译码器加上输出与非门电路，就能获得任何形式的输入变量不大于n的组合逻辑电路。
74LSl38是3-8线译码器，其外引脚排列如图2-1所示。
74HCl38译码器有3个使能端S1、S2、S3，当S1=l、S2=0、S3=0时允许译码，否则禁止译码，且A2、A1、A0为3个地址输入端，Y0、Y1、Y2、Y3、Y4、Y5、Y6、Y7为8个输出端。
注：74HCl38的功能表见教材P176。
图2-1 74HC138引脚排列图1②优先编码器(74HC148)74HC148是8-3线优先编码器，其外引线排列如图2-2所示。
2011-2012数电实验报告样本
实验一、组合逻辑电路的设计与制作一、实验目的：1、学会根据给定要求设计逻辑电路；2、掌握查找、选择所需器件，或根据现有器件进行设计；3、掌握按设计图纸在实验板上连接电路，排除故障，测试性能； 二、实验器材：电子实验台、74LS00×2、连接线若干 三、实验内容1、用74LS00制作一个二输入异或门电路： （1）实验设计：根据题意得真值表(表2-1)：BA B A B A B A Y •=+=（2）电路设计：图2-1 74LS00组成二输入异或门电路图（3）实验数据(表2-2)：2、用74LS00制作一个二输入同或门电路：（1）实验设计：根据题意得真值表(表2-3)：AY•=+=BABBAAB（2）电路设计：图2-2 74LS00组成二输入同或门电路图（3）实验数据(表2-4)：3、用74LS00设计制作一个三人表决电路，两人或两人以上赞成则通过： （1）实验设计：设同意的为1，不同意的为0，通过为1，不通过为0，则根据题意可得以下真值表(表2-5)：ABAC BC AB AC BC AB AC BC ABC C AB C B A BC A Y ••=••=++=+++=（2）电路设计：图2-3 74LS00组成三表决电路（3）实验数据(表2-6)：4、用74LS00A、B、C三个电源，共同向某一重要负载供电，在正常情况下，至少有两个电源处在正常状态。
否则发出报警信号（报警时，F=1，灯亮）。
（1）实验设计：设电源正常为1，不正常为0，由题意可得以下真值表(表2-7)：•=F•ACBCAB（2）电路设计：图2-4 供电系统检测控制逻辑电路图（3）实验数据(表2-8)：5、用74LS00、C ，输出为Fa 、Fb 、Fc 。
A=1，表示A 有请求；Fa=1表示能够为A 服务。
同样B=1表示B 有请求；Fb=1，表示能够为B 服务……。
A 、B 、C 的排队顺序是：A=1，最高优先级；B=1，次优先级；C=1，普通优先级。
数电实验报告实验二利用MSI设计组合逻辑电路
数电实验报告实验二利用MSI设计组合逻辑电路一、实验目的1. 学习MSI(Medium Scale Integration，即中规模集成电路)的基本概念和应用。
2.掌握使用MSI设计和实现组合逻辑电路的方法。
3.了解MSI的类型、特点及其在实际电路设计中的作用。
二、实验设备与器件1.实验设备：示波器、信号发生器、万用表。
2.实验器件：组合逻辑集成电路74LS151三、实验原理1.MSI的概念MSI是Medium Scale Integration的简称，指的是中规模集成电路。
MSI由几十个至几千个门电路组成，功能比SSI（Small Scale Integration，即小规模集成电路）更为复杂，但比LSI（Large Scale Integration，即大规模集成电路）简单。
2.74LS151介绍74LS151是一种常用的组合逻辑集成电路之一，具有8个输入端和1个输出端。
其功能是从八个输入信号中选择一个作为输出。
利用该器件可以轻松实现数据选择器、多路选择器等功能。
四、实验内容本实验的任务是利用74LS151设计一个简单的多路选择器电路。
具体实验步骤如下：1.将74LS151插入实验板中，注意引脚的正确连接。
2.将信号发生器的输出接入到74LS151的A、B、C三个输入端中，分别作为输入0、输入1、输入2、将示波器的探头分别接到74LS151的输出端Y，记录下不同输入情况下Y的输出情况。
3.分别将信号发生器的输出接入74LS151的D0、D1、D2、D3、D4、D5、D6、D7八个输入端，接通电源，记录下不同输入情况下Y的输出情况。
4.通过以上实验数据，绘制74LS151的真值表。
五、实验结果与数据处理根据实验步骤所述，我们完成了实验，并得到了以下数据：输入0：0000001111001111输入1：1111110010100101输入2：1010101001010101根据这些数据，我们可以绘制74LS151的真值表如下：输入0，输入1，输入2，输出Y--------，--------，--------，--------0，0，0，00，0，1，10，1，0，00，1，1，11，0，0，11，0，1，01，1，0，11，1，1，1六、实验总结通过本次实验，我们学习了MSI的基本概念和应用，初步掌握了使用MSI设计和实现组合逻辑电路的方法。
数电实验二 组合逻辑电路
实验二 组合逻辑电路一、实验目的1、熟悉组合逻辑电路的一些特点及一般分析、设计方法。
2、熟悉中规模集成电路典型的基本逻辑功能和简单应用设计。
二、实验器材1、直流稳压电源、数字逻辑电路实验箱、万用表、示波器2、74LS00、74LS04、74LS10、74LS20、74LS51、74LS86、74LS138、74LS148、74LS151、 74LS153三、实验内容和步骤 1、组合逻辑电路分析（1）图2-1是用SSI 实现的组合逻辑电路。
74LS51芯片是“与或非”门（CD AB Y +=）, 74LS86芯片是“异或”门（B A Y ⊕=）。
建立实验电路，三个输入变量分别用三个 逻辑开关加载数值，两个输出变量的状态分别用两只LED 观察。
观察并记录输出变 量相应的状态变化。
整理结果形成真值表并进行分析，写出输出函数的逻辑表达式， 描述该逻辑电路所实现的逻辑功能。
（2）图2-2和2-3是用MSI 实现的组合逻辑电路。
图2-2中的74LS138芯片是“3-8译码 器”，74LS20芯片是“与非”门（ABCD Y =）图2-3中的74LS153芯片是四选一 数据选择器。
建立实验电路，对两个逻辑电路进行分析，列出真值表，写出函数的逻 辑表达式，描述逻辑电路所实现的功能。
图2-1：SSI 组合逻辑电路图2-2 ：MSI 组合逻辑电路（74LS138）2、组合逻辑电路设计（1）SSI 逻辑门电路设计——裁判表决电路举重比赛有三名裁判：一个主裁判A 、两个副裁判B 和C 。
在杠铃是否完全举起裁 决中，最终结果取决于至少两名裁判的裁决，其中必须要有主裁判。
如果最终的裁决 为杠铃举起成功，则输出“有效”指示灯亮，否则杠铃举起失败。
（2）MSI 逻辑器件设计——路灯控制电路用74LS151芯片和逻辑门，设计一个路灯控制电路，要求能够在四个不同的地方都 能任意的开灯和关灯。
四、实验结果、电路分析及电路设计方案1、组合逻辑电路分析 （1）图2-1： 逻辑表达式：)()(11i i i i i i i i i i B A C S B A C B A C ⊕⊕=⊕+=--逻辑功能：实现A i 、B i 、C i-1三个一位二进制数 的加法运算功能，即全加器。
数电实验2-组合逻辑电路装测调试方法
暨南大学本科实验报告专用纸课程名称数字电子技术实验成绩评定实验项目名称组合逻辑电路装测调试方法指导教师实验项目编号071200031实验项目类型验证+设计实验地点实B406 学生姓名学号学院电气信息学院专业实验时间2016年4月19 日一、实验目的1.学习应用实验的方法分析组合逻辑电路。
2.学习数字电路设计和装测调试方法。
3.学习数字系统综合实验平台可编辑数字波形发生器使用方法。
二、实验器件、设备和仪器1. 三3输入与非门74LS10 1片2. 双4输入与非门74LS20 1片3. 4异或门74LS86 1片4. 6反相器74LS04 1片5. 四2输入与非门74LS00 1片6. PC机（数字信号显示仪） 1台7. GOS－6051示波器 1台8. 数字万用表UT56 1台9. TDS－4数字系统综合实验平台 1台三、实验原理1.芯片引脚图2.组合逻辑电路测试方法介绍数字电路静态测试方法指的是：给定数字电路若干组静态输入值，测定数字电路的输出值是否正确。
数字电路状态测试的过程是在数字电路设计好后，将其安装连接成完整的线路，把线路的输入接到逻辑电平开关上，线路的输出接到电平指示灯（LED）或用万用表测量进行电平测试,按功能表或状态表的要求，改变输入状态，观察输入和输出之间的关系是否符合设计要求。
数字电路电平测试是测量数字电路输入与输出逻辑电平（电压）值是否正确的一种方法。
静态测试是检查设计与接线是否正确无误的重要一步。
数字电路动态测试方法是：在静态测试的基础上，按设计要求在输入端加动态脉冲信号，观察输出端波形是否符合设计要求，这是动态测试，动态测试的主要目的测试电路的频率特性（如测试电路使用时的频率范围）等）及稳定特性等。
四、实验内容1.用实验方法分析由异或门组成的组合逻辑电路①用一片74LS86按图1连接逻辑电路。
②采用静态测试方法进行逻辑电路测试。
接好电路后，将输入信号用逻辑开关置入（由逻辑电平信号源提供输入信号），输出结果输出接LED指示灯通过逻辑电平指示灯进行显示测试。
数电实验二 组合逻辑电路
实验二 组合逻辑电路一、实验目的1.掌握组和逻辑电路的功能测试。
2.验证半加器和全加器的逻辑功能。
3.学会二进制数的运算规律。
二、实验仪器及器件1.仪器：数字电路学习机2.器件：74LS00 二输入端四与非门 3片 74LS86 二输入端四异或门 1片 74LS54 四组输入与或非门 1片三、实验内容1.组合逻辑电路功能测试(1).用2片74LS00按图2.1连线，为便于接线和检查，在图中要注明芯片编号及各引脚对应的编号。
(2).图中A 、B 、C 接电平开关，Y1、Y2接发光管电平显示(3).按表2.1要求，改变A 、B 、C 的状态，填表并写出Y1、Y2的逻辑表达式。
(4).将运算结果与实验比较。
Y1=A+B2.测试用异或门（74LS86）和与非门组成的半加器的逻辑功能。
根据半加器的逻辑表达式可知，半加器Y 是A 、B 的异或，而进位Z 是A 、B 相与，故半加器可用一个集成异或门和二个与非门组成，如图2.2。
(1).用异或门和与非门接成以上电路。
输入A 、B 接电平开关，输出Y 、Z 接电平显示。
(2).按表2.2要求改变A 、B 状态，填表。
3.测试全加器的逻辑功能。
(1).写出图2.3电路的逻辑表达式。
(2).根据逻辑表达式列真值表。
(3).根据真值表画逻辑函数SiCi 的卡诺图。
111S i C i4.测试用异或门、与或门和非门组成的全加器的功能。
全加器可以用两个半加器和两个与门一个或门组成，在实验中，常用一块双异或门、一个与或非门和一个与非门实现。
(1).写出用异或门、与或非门和非门实现全加器的逻辑表达式，画出逻辑电路图。
(2).连接电路图，注意“与或非”门中不用的“与门”输入端要接地。
(3).按表2.4记录Si 和Ci 的状态。
1-⊕⊕=i i C B A S ，AB C B A C i i +⊕=-1)(A i S iB i+ C i C i-1四、 1.整理实验数据、图表并对实验结果进行分析讨论。
数电实验报告 实验二 利用MSI设计组合逻辑电路
实验二利用MSI设计组合逻辑电路【实验目的】1.熟悉编码器、译码器、数据选择器等组合逻辑功能模块的功能和使用方法2.掌握用MSI设计的组合逻辑电路方法【实验仪器】1.数字电路实验箱、数字万用表、示波器2.虚拟器件：74LS00、74LS197、74LS138、74LS151 74LS73 74LS86【实验设计与分析】1.数据分配器（1）由数据分配器真值表分析可知，当D=0时，全线路输出为1，而当D=1时，F0~F7输出与地址端ABC相关，二进制地址值代表的十进制数n刚好为D’，而其他位值为1,’= A’B’C’F即F= (A’B’C’)’同理F1= (A’B’C)’F3= (A’BC)’F4= (A B’C’)’F5= （AB’C)’F6= (ABC’)’F7= (ABC)’Y O = GsS2’S1’S’即Y 0’= (Gs’S2’S1’S’)’同理Y 1’= (Gs’S2’S1’S)’Y 3’= (Gs’S2’S1S)’Y 4’= (Gs’S2S1’S’)’Y 5’=（Gs’S2S1’S)’Y 6’= (Gs’S2S1S’)’Y 7’= (Gs’S2S1S)’显然当Gs=1时， Y’= F(3)对比（2）中不同Gs条件下译码器和数据分配器的真值表可以发现，当另Gs’与数据输入D信号一致，S2~S0作为地址段输入的A B C,两者真值表一致，即使译码器变成了数据分配器。
Gs输入端有3端，令G1为数据D输入，其他两端接低电平。
（4）电路设计(5)仿真波形2.LU(Logic Unit逻辑单元)设计（1）分析LU功能，得出如下真值表利用74LS151实现数据选择，那么无需计算逻辑表达式，无需卡诺图化简（2）16行真值化简为8行真值若用2组74LS151,可联合成16路输出，若只用1组74LS151,则需要把Y的值与其中一个输入变量联合起来12351X 0=X4=S1X6=X7=S1’故简化成了设计（3）根据（1）&（2）的真值表分析，可以发现有4组输入变量，1组输出变量，其中s1通过把数据输入端的值与S1关联而简化，故利用3组变量实现了16组输出结果。
数电实验报告：实验2-组合逻辑电路138
GDOU-B-11-112广东海洋大学学生实验报告书（学生用表）实验名称课程名称课程号学院(系) 专业班级学生姓名学号实验地点实验日期实验2 组合逻辑电路——138芯片一、实验目的1、掌握中规模集成译码器的逻辑功能和使用方法2、熟悉数码管的使用二、实验原理译码器是一个多输入、多输出的组合逻辑电路。
它的作用是把给定的代码进行“翻译”，变成相应的状态，使输出通道中相应的一路有信号输出。
译码器在数字系统中有广泛的用途，不仅用于代码的转换、终端的数字显示，还用于数据分配，存贮器寻址和组合控制信号等。
不同的功能可选用不同种类的译码器。
译码器可分为通用译码器和显示译码器两大类。
前者又分为变量译码器和代码变换译码器。
1、变量译码器（又称二进制译码器），用以表示输入变量的状态，如2线－4线、3线－8线和4线－16线译码器。
若有n个输入变量，则有2n个不同的组合状态，就有2n个输出端供其使用。
而每一个输出所代表的函数对应于n个输入变量的最小项。
以3线－8线译码器74LS138为例进行分析，图6－1(a)、(b)分别为其逻辑图及引脚排列。
其中 A2、A1、A0为地址输入端，0Y～7Y为译码输出端，S1、2S、3S为使能端。
表6－1为74LS138功能表当S1＝1，2S＋3S＝0时，器件使能，地址码所指定的输出端有信号（为0）输出，其它所有输出端均无信号（全为1）输出。
当S1＝0，2S＋3S＝X时，或 S1＝X，2S＋3S＝1时，译码器被禁止，所有输出同时为1。
(a) (b)图6－1 3－8线译码器74LS138逻辑图及引脚排列表6－1件就成为一个数据分配器(又称多路分配器)，如图6－2所示。
若在S1输入端输入数据信息，2S＝3S＝0，地址码所对应的输出是S1数据信息的反码；若从2S端输入数据信息，令S1＝1、3S＝0，地址码所对应的输出就是2S端数据信息的原码。
若数据信息是时钟脉冲，则数据分配器便成为时钟脉冲分配器。
数电项目实验报告(3篇)
第1篇一、实验目的1. 理解数字电路的基本概念和组成原理。
2. 掌握常用数字电路的分析方法。
3. 培养动手能力和实验技能。
4. 提高对数字电路应用的认识。
二、实验器材1. 数字电路实验箱2. 数字信号发生器3. 示波器4. 短路线5. 电阻、电容等元器件6. 连接线三、实验原理数字电路是利用数字信号进行信息处理的电路，主要包括逻辑门、触发器、计数器、寄存器等基本单元。
本实验通过搭建简单的数字电路，验证其功能，并学习数字电路的分析方法。
四、实验内容及步骤1. 逻辑门实验（1）搭建与门、或门、非门等基本逻辑门电路。
（2）使用数字信号发生器产生不同逻辑电平的信号，通过示波器观察输出波形。
（3）分析输出波形，验证逻辑门电路的正确性。
2. 触发器实验（1）搭建D触发器、JK触发器、T触发器等基本触发器电路。
（2）使用数字信号发生器产生时钟信号，通过示波器观察触发器的输出波形。
（3）分析输出波形，验证触发器电路的正确性。
3. 计数器实验（1）搭建异步计数器、同步计数器等基本计数器电路。
（2）使用数字信号发生器产生时钟信号，通过示波器观察计数器的输出波形。
（3）分析输出波形，验证计数器电路的正确性。
4. 寄存器实验（1）搭建移位寄存器、同步寄存器等基本寄存器电路。
（2）使用数字信号发生器产生时钟信号和输入信号，通过示波器观察寄存器的输出波形。
（3）分析输出波形，验证寄存器电路的正确性。
五、实验结果与分析1. 逻辑门实验通过实验，验证了与门、或门、非门等基本逻辑门电路的正确性。
实验结果表明，当输入信号满足逻辑关系时，输出信号符合预期。
2. 触发器实验通过实验，验证了D触发器、JK触发器、T触发器等基本触发器电路的正确性。
实验结果表明，触发器电路能够根据输入信号和时钟信号产生稳定的输出波形。
3. 计数器实验通过实验，验证了异步计数器、同步计数器等基本计数器电路的正确性。
实验结果表明，计数器电路能够根据输入时钟信号进行计数，并输出相应的输出波形。
数电实验实验报告
数字电路实验报告实验一 组合逻辑电路分析一．试验用集成电路引脚图74LS00集成电路 74LS20集成电路 四2输入与非门 双4输入与非门 二．实验内容 1.实验一X12.5 VA BCD示灯：灯亮表示“1”，灯灭表示“0”ABCD 按逻辑开关，“1”表示高电平，“0”表示低电平自拟表格并记录:2.实验二密码锁的开锁条件是：拨对密码，钥匙插入锁眼将电源接通，当两个条件同时满足时，开锁信号为“1”，将锁打开。
否则，报警信号为“1”，则接通警铃。
试分析密码锁的密码ABCD 是什么？AＢＣDABCD 接逻辑电平开关。
最简表达式为：X1=AB ’C ’D 密码为： 1001 表格为：三.实验体会：1.分析组合逻辑电路时，可以通过逻辑表达式，电路图和真值表之间的相互转换来到达实验所要求的目的。
2.这次试验比较简单，熟悉了一些简单的组合逻辑电路和芯片，和使用仿真软件来设计和构造逻辑电路来求解。
实验二组合逻辑实验（一）半加器和全加器一．实验目的1.熟悉用门电路设计组合电路的原理和方法步骤二．预习内容1.复习用门电路设计组合逻辑电路的原理和方法步骤。
2.复习二进制数的运算。
3. 用“与非门”设计半加器的逻辑图。
4. 完成用“异或门”、“与或非”门、“与非”门设计全加器的逻辑图。
5. 完成用“异或”门设计的3变量判奇电路的原理图。
三．元件参考依次为74LS283、74LS00、74LS51、74LS136其中74LS51：Y=（AB+CD ）’，74LS136：Y=A ⊕B （OC 门） 四．实验内容1. 用与非门组成半加器，用或非门、与或非门、与非门组成全加器（电路自拟）NOR2SC半加器全加器2.用异或门设计3变量判奇电路，要求变量中1的个数为奇数是，输出为1，否则为0.3变量判奇电路3.“74LS283”全加器逻辑功能测试测试结果填入下表中：五．实验体会：1.通过这次实验，掌握了熟悉半加器与全加器的逻辑功能2.这次实验的逻辑电路图比较复杂，涉及了异或门、与或非门、与非门三种逻辑门，在接线时应注意不要接错。
数电综合实验报告(3篇)
第1篇一、实验目的1. 巩固和加深对数字电路基本原理和电路分析方法的理解。
2. 掌握数字电路仿真工具的使用，提高设计能力和问题解决能力。
3. 通过综合实验，培养团队合作精神和实践操作能力。
二、实验内容本次实验主要分为以下几个部分：1. 组合逻辑电路设计：设计一个4位二进制加法器，并使用仿真软件进行验证。
2. 时序逻辑电路设计：设计一个4位计数器，并使用仿真软件进行验证。
3. 数字电路综合应用：设计一个数字时钟，包括秒、分、时显示，并使用仿真软件进行验证。
三、实验步骤1. 组合逻辑电路设计：（1）根据题目要求，设计一个4位二进制加法器。
（2）使用Verilog HDL语言编写代码，实现4位二进制加法器。
（3）使用ModelSim软件对加法器进行仿真，验证其功能。
2. 时序逻辑电路设计：（1）根据题目要求，设计一个4位计数器。
（2）使用Verilog HDL语言编写代码，实现4位计数器。
（3）使用ModelSim软件对计数器进行仿真，验证其功能。
3. 数字电路综合应用：（1）根据题目要求，设计一个数字时钟，包括秒、分、时显示。
（2）使用Verilog HDL语言编写代码，实现数字时钟功能。
（3）使用ModelSim软件对数字时钟进行仿真，验证其功能。
四、实验结果与分析1. 组合逻辑电路设计：通过仿真验证，所设计的4位二进制加法器能够正确实现4位二进制加法运算。
2. 时序逻辑电路设计：通过仿真验证，所设计的4位计数器能够正确实现4位计数功能。
3. 数字电路综合应用：通过仿真验证，所设计的数字时钟能够正确实现秒、分、时显示功能。
五、实验心得1. 通过本次实验，加深了对数字电路基本原理和电路分析方法的理解。
2. 掌握了数字电路仿真工具的使用，提高了设计能力和问题解决能力。
3. 培养了团队合作精神和实践操作能力。
六、实验改进建议1. 在设计组合逻辑电路时，可以考虑使用更优的电路结构，以降低功耗。
2. 在设计时序逻辑电路时，可以尝试使用不同的时序电路结构，以实现更复杂的逻辑功能。
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实验二组合逻辑电路的设计
一、实验目的
1.掌握组合逻辑电路的设计方法及功能测试方法。
2.熟悉组合电路的特点。
二、实验仪器及材料
a) TDS-4数电实验箱、双踪示波器、数字万用表。
b) 参考元件：74LS86、74LS00。
三、预习要求及思考题
1．预习要求：
1）所用中规模集成组件的功能、外部引线排列及使用方法。
2) 组合逻辑电路的功能特点和结构特点.
3) 中规模集成组件一般分析及设计方法.
4）用multisim软件对实验进行仿真并分析实验是否成功。
2.思考题
在进行组合逻辑电路设计时，什么是最佳设计方案？
四、实验原理
1．本实验所用到的集成电路的引脚功能图见附录
2.用集成电路进行组合逻辑电路设计的一般步骤是：
1）根据设计要求，定义输入逻辑变量和输出逻辑变量，然后列出真值表；
2）利用卡络图或公式法得出最简逻辑表达式，并根据设计要求所指定的门电路或选定的门电路，将最简逻辑表达式变换为与所指定门电路相应的形式；
3）画出逻辑图；
4）用逻辑门或组件构成实际电路，最后测试验证其逻辑功能。
五、实验内容
1．用四2输入异或门（74LS86）和四2输入与非门（74LS00）设计一个一位全加器。
1）列出真值表,如下表2-1。
其中A i、B i、C i分别为一个加数、另一个加数、低位向本位的进位；S i、C i+1分别为本位和、本位向高位的进位。
2）由表2-1全加器真值表写出函数表达式。
3）将上面两逻辑表达式转换为能用四2输入异或门（74LS86）和四2输入与非门（74LS00）实现的表达式。
4）画出逻辑电路图如图2-1，并在图中标明芯片引脚号。
按图选择需要的集成块及门电路连线，将A i、B i、C i接逻辑开关，输出Si、Ci+1接发光二极管。
改变输入信
号的状态验证真值表。
2.在一个射击游戏中，每人可打三枪，一枪打鸟(A)，一枪打鸡（B），一枪打兔子（C）。
规则是：打中两枪并且其中有一枪必须是打中鸟者得奖（Z）。
试用与非门设计判断得奖的电路。
（请按照设计步骤独立完成之）
五、实验报告要求：
1．画出实验电路连线示意图，整理实验数据，分析实验结果与理论值是否相等。
2．设计判断得奖电路时需写出真值表及得到相应输出表达式以及逻辑电路图。
3．总结中规模集成电路的使用方法及功能。