74系列芯片引脚图及逻辑功能表

1A 1B 1C 2A 2B 2C 3A
74LS20 ―― 4输入端双与非门管脚图及逻辑功能表
1 A
10
1C
W 2A
20
2C
2D
A
B
C
Y L X X L X L P X
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X
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3C
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2Y
⑴
W
(1Q)
(12)
n
TRUTH TABLE
A
B
C
D Y L
X X
X
H P X
L X x : H X X L X
H X X X L H H
H
H
H
L
74LS21 —— 4输入端双与门管脚图及逻辑功能表
1 A 1日 1C 1 D 2A
A B C D Y
L
X X
X
L X
L
X X L
X
X
L
X
L
X P X
X L L H
H
H
H
H
2C 2D
1Y
2¥
(6)
TRUTH TABLE
A B
c
Y
L L L H H
X
X
L X H
X L X
X H
L
x : Dorn cars
74LS42 —— BCD/十进制译码器管脚图及逻辑功能表
BCD/DEC
1A !B ?A
23
20 2Y GHD
1C
1Y
SB
3T
^CC
A B C D 9 9
<16) B-IM.
NO
BCD INPUT DECIMAL OUTPUT D
C B A 0 1 2 3 4 B 6 7 8
9
I L L L L
H H H H H H H H H ! L L I H H
L H H H H H H H H 2
L
L H L H H
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7
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9
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H H H H H L L H H
H H H H H H H H
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H L H H H H H H H H H
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H H H H H H
H H
H
H
H
H
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H
H
H
H
H
H
H
74LS138 ―― 3-8线译码器管脚图及逻辑功能表
INPUTS
OUTPUTS
ENABLE
SELECT
QZB
O2A
G1 C B A Y0 Y1 Y2 Y3
Y4 Y5 ra Y? X X L X X X H H H H
H H H H X H X X X X H H H H H H H H H X X X X X H H
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H H H H H H L L H L L H H L 11 H H H H H L L H L H L H H L H H H H H L
L
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L
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H H H L H H
I
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H H H H L H
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H
L
Y0
Y ?
3)
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Y6
—
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TRUTH TABLE
INPUTS
OUTPUTS
SELECTED OUTPUT
ENABLE SELECT
Yo
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G
B A
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X X H
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L
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L
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H
Y1
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H L
H H L H
L H
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L
74LS148 ―― 8-3线优先编码器管脚图及逻辑功能表
1A 13 1G
2A 23 2G
{£)_ (3)_
⑴、
⑴
）
1YQ 1Y1 1~2
2Y0
2F1 2Y2 2Y3
GSJ
2
INPUTS 1 D ,
CU1PUTS
凹b
⑴
、
⑵rs ⑶z
D-/Z*
C
1/Z1 1
2/212
3/2*3 4/Z14
5 G/J J E 7/2
仃
INPUTS
OUTPUTS
E1 0 1 2
3 4
5 6 7 A2 A1 AO GS EO H
X X X X X X X X H
H H H H ―L
H
H H H H H H H H H H H L L
X X X X X X X L L
L L L
H L X
X X
X
X X
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L H L
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X 「
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X
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X: Don't Care
V18 EN d
74LS151 ――八选一数据选择器管脚图及逻辑功能表
DATA i X INPUTS 1 D f
OJTFUIS
STROBE
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门1 〔古 叮
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INPUTS
OUTPUTS
SELECT
STROBE
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w C B A S X X X H L
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o 3 D3
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1
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巧
5
74LS153 ――双4选1数据选择器管脚图及逻辑功能表
TRUTH TABLE
SELECT INPUTS DATA INPUTS STROBE
OUTPUT Y
B A W Cl Cj c 3 G
X X X X X X H
L L
L
L
X X ~
P
X
L
L
L
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X X
X
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L H L X X H
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X
X
X
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A
Daclmal cr Function Inputs
Outputs
LT
RBI
A3
A2
Al AO Bl/RBQ a b G
d 0 7
g
H n L L
L L
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2 H X L L H
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12 H X H
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13
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14 H X H H H L
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15
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H
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X X X
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RSI H L L
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X
X
岛
X
X
H
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L
L
L
L
L
L
码管
13 12 n 1D 9 15 1* 4
示译码 平有 共阳数
74LS55——双4输入与或非门
4-2-3与或非门
74LS54
z-
-
3
[
L
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74LS08——2输入4与门
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