数字电路逻辑设计课后答案
(完整版)数字电路与逻辑设计课后习题答案蔡良伟(第三版)
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求减数的补码，然后与被减数相加即可。电路图如下：
3-11
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（1）
（2）
（3）
（4）
（5）
（6）
（7）
（8）
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(1)真值表：
（2）电路图
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第四章习题
4-1
4-2
4-3
4-4
4-5
4-6
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4-8
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RSDRSJK RST
4-11
(1)转换真值表
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××××
××××
××××
××××
××××
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0×0××0×1
0××1 1×1×
人邮社数字电路逻辑设计习题答案
习题参考解答第1章基本知识1．什么是数字信号？什么是模拟信号？（注：所有蓝色标题最后均去掉！）答案：数字信号：指信号的变化在时间上和数值上都是断续的，或者说是离散的，这类信号有时又称为离散信号。
例如，在数字系统中的脉冲信号、开关状态等。
模拟信号：指在时间上和数值上均作连续变化的信号。
例如，温度、交流电压等信号。
2．数字系统中为什么要采用二进制？答案：二进制具有运算简单、物理实现容易、存储和传送方便、可靠等优点。
3．机器数中引入反码和补码的主要目的是什么？答案：将减法运算转化为加法运算，统一加、减运算，使运算更方便。
4．BCD码与二进制数的区别是什么?答案：二进制数是一种具有独立进位制的数，而BCD码是用二进制编码表示的十进制数。
5．采用余3码进行加法运算时，应如何对运算结果进行修正？为什么？答案：两个余3码表示的十进制数相加时，对运算结果修正的方法是：如果有进位，则结果加3；如果无进位，则结果减3。
为了解决四位二进制运算高位产生的进位与一位十进制运算产生的进位之间的差值。
6．奇偶检验码有哪些优点和不足？答案：奇偶检验码的优点是编码简单，相应的编码电路和检测电路也简单。
缺点是只有检错能力，没有纠错能力，其次只能发现单错，不能发现双错。
7．按二进制运算法则计算下列各式。
答案：（1）110001 （2）110.11 （3）10000111 （4）1018．将下列二进制数转换成十进制数、八进制数和十六进制数。
答案：（1）（117）10 ，（165）8 ，（75）16（2）（0.8281）10 ，（0.65）8 ，（0.D4）16（3）（23.25）10 ，（27.2）8 ，（17. 4）169．将下列十进制数转换成二进制数、八进制数和十六进制数（精确到二进制小数点后4位）。
答案：（1）（1000001）2 ，（101）8 ，（41）16（2）（0.0100）2 ，（0.20）8 ，（0.40）16（3）（100001.0101）2 ，（41.24）8 ，（21.50）1610．写出下列各数的原码、反码和补码。
数字电路与逻辑设计习题答案
数字电路与逻辑设计习题答案数字电路与逻辑设计习题答案数字电路与逻辑设计是计算机科学与工程领域中的重要基础课程，它涉及到数字信号的处理和转换，以及逻辑门电路的设计和分析。
学习这门课程时，习题是巩固知识和提高能力的重要途径。
下面将给出一些常见的数字电路与逻辑设计习题的答案，希望对大家的学习有所帮助。
1. 设计一个4位二进制加法器电路，实现两个4位二进制数的相加。
答案：一个4位二进制加法器电路可以由四个全加器电路组成。
每个全加器电路有三个输入：两个被加数和一个进位输入，以及两个输出：和位和进位输出。
将四个全加器电路按位级联，将进位输出连接到下一位的进位输入，最后一个全加器的进位输出作为最高位的进位输出。
和位的输出即为两个4位二进制数的和。
2. 给定一个3输入的逻辑电路，输出为1的条件是至少有两个输入为1。
请设计一个电路，实现这个逻辑功能。
答案：可以使用与门和或门组合的方式来实现这个逻辑功能。
首先，将三个输入分别与一个与门的三个输入相连，将输出连接到一个或门的输入。
然后，将三个输入分别与一个或门的三个输入相连，将输出连接到与门的输入。
这样，当至少有两个输入为1时，与门的输出为1，或门的输出也为1。
3. 给定一个4输入的逻辑电路，输出为1的条件是输入中有奇数个1。
请设计一个电路，实现这个逻辑功能。
答案：可以使用异或门实现这个逻辑功能。
首先，将四个输入两两分组，然后将每组的输出与另一组的输出进行异或操作。
最后，将四个异或门的输出连接到一个或门的输入。
这样，当输入中有奇数个1时，异或门的输出为1，或门的输出也为1。
4. 设计一个4位比较器电路，实现两个4位二进制数的大小比较。
答案：一个4位比较器电路可以由四个比较器组成。
每个比较器有两个输入：两个被比较的位，以及一个输出：比较结果。
将四个比较器电路按位级联，将每个比较器的输出连接到下一位比较器的输入。
最后一个比较器的输出即为两个4位二进制数的大小比较结果。
5. 给定一个3输入的逻辑电路，输出为1的条件是输入中的1的个数大于等于2。
数字逻辑课后答案第二章
数字逻辑课后答案第⼆章第⼆章组合逻辑1. 分析图中所⽰的逻辑电路，写出表达式并进⾏化简2. 分析下图所⽰逻辑电路，其中S3、S2、S1、S0为控制输⼊端，列出真值表，说明 F 与 A 、B 的关系。
F1=F2=F=F 1F 2=BF = AB + B = ABA F = AB BABC CABC = AB + AC + BC + BC = AB + BC + BC1SB BS A ++32S B A ABS +1S B BS A ++3. 分析下图所⽰逻辑电路，列出真值表，说明其逻辑功能。
解： F1==真值表如下：当B ≠C 时， F1=A 当B=C=1时， F1=A 当B=C=0时， F1=0裁判判决电路，A 为主裁判，在A 同意的前提下，只要有⼀位副裁判（B ，C ）同意，成绩就有效。
F2=真值表如下：CB BC A C AB C B A +++ABCC B A ABC C B A C B A +⊕=++)(A B C F 0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 100000111AC BC AB C A C B B A ++=++当A 、B 、C 三个变量中有两个及两个以上同时为“1”时，F2 = 1 。
4.图所⽰为数据总线上的⼀种判零电路，写出F 的逻辑表达式，说明该电路的逻辑功能。
解：F=只有当变量A0~A15全为0时，F = 1；否则，F = 0。
因此，电路的功能是判断变量是否全部为逻辑“0”。
5. 分析下图所⽰逻辑电路，列出真值表，说明其逻辑功能解：因此，这是⼀个四选⼀的选择器。
6. 下图所⽰为两种⼗进制数代码转换器，输⼊为余三码，输出为什么代码？解：A B C F 0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 1000011111514131211109876543210A A A A A A A A A A A A A A A A +++301201101001X A A X A A X A A X A A F +++=这是⼀个余三码⾄8421 BCD 码转换的电路7. 下图是⼀个受 M 控制的4位⼆进制码和格雷码的相互转换电路。
数字电路与逻辑设计习题及参考答案全套
数字电路与逻辑设计习题及参考答案一、选择题1. 以下表达式中符合逻辑运算法则的是 D 。
A.C ·C=C 2B.1+1=10C.0<1D.A+1=12. 一位十六进制数可以用 C 位二进制数来表示。
A . １B . ２C . ４D . 163. 当逻辑函数有n 个变量时，共有 D 个变量取值组合？A. nB. 2nC. n 2D. 2n4. 逻辑函数的表示方法中具有唯一性的是 A 。
A .真值表 B.表达式 C.逻辑图 D.状态图5. 在一个8位的存储单元中，能够存储的最大无符号整数是 D 。
A .（256）10B .（127）10C .（128）10D .（255）106.逻辑函数F=B A A ⊕⊕)( = A 。
A.BB.AC.B A ⊕D. B A ⊕7．求一个逻辑函数F 的对偶式，不可将F 中的 B 。
A .“·”换成“+”，“+”换成“·”B.原变量换成反变量，反变量换成原变量C.变量不变D.常数中“0”换成“1”，“1”换成“0”8．A+BC= C 。
A .A+B B.A+C C.（A+B ）（A+C ） D.B+C9．在何种输入情况下，“与非”运算的结果是逻辑0。
DA ．全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是110．在何种输入情况下，“或非”运算的结果是逻辑1。
AA ．全部输入是0 B.全部输入是1 C.任一输入为0，其他输入为1 D.任一输入为111．十进制数25用8421BCD 码表示为 B 。
A .10 101B .0010 0101C .100101D .1010112．不与十进制数（53.5）10等值的数或代码为 C 。
A .(0101 0011.0101)8421BCDB .(35.8)16C .(110101.11)2D .(65.4)813．以下参数不是矩形脉冲信号的参数 D 。
A.周期B.占空比C.脉宽D.扫描期14．与八进制数(47.3)8等值的数为： BA. (100111.0101)2B.(27.6)16C.(27.3 )16D. (100111.101)215. 常用的BCD码有 D 。
数字电路逻辑设计朱正伟课后答案
A
B
C
F1
F2
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数字电路与逻辑设计中国大学mooc课后章节答案期末考试题库2023年
数字电路与逻辑设计中国大学mooc课后章节答案期末考试题库2023年1.设计一个能存放8位二进制代码的寄存器,需要的触发器级数是( )。
参考答案:82.用3级触发器可以记忆的状态数是( )。
参考答案:83.基于74161，采用清零法设计模值为十二的计数器，则反馈状态【图片】是________。
参考答案:11004.基于74161，采用置零法设计模值为十二的计数器，则反馈状态【图片】是________。
参考答案:10115.若时序电路的状态转移图如下，则下列说法正确的是________。
【图片】参考答案:CP的频率是Q1的4倍6.用卡诺图对带约束项的逻辑函数进行化简时，以下说法正确的是____。
参考答案:卡诺圈中不可以全是无关项_无关项小方格可以当0格或者1格处理，具体应以化简结果最简为准7.标准与或式就是指函数的最小项表达式。
参考答案:正确8.下图所示电路的逻辑表达式为F=A。
【图片】参考答案:错误9.JKFF的激励信号序列为J=101100和K=010110，信号的变化均在相应时钟下降沿到来前完成，则触发器的输出序列为____。
参考答案:10100010.能完成两个1位二进制数相加，不考虑低位来的进位的器件称为______。
参考答案:半加器11.十进制数(7.5)10对应的二进制数是( )2。
参考答案:111.100012.在时钟有效沿作用下，下列说法正确的是________。
参考答案:边沿DFF具有2种功能13.同步计数器是指的计数器。
参考答案:各触发器时钟端连在一起，统一由系统时钟控制14.由4级触发器构成的寄存器可以存入位二进制代码。
参考答案:415.顺序脉冲信号发生器可以用环形计数器电路构成。
参考答案:正确16.电路如下图所示，下列说法正确的是________。
【图片】参考答案:模值为7的计数器_具备自启动性17.若用DFF设计11110000移存型序列信号发生器，则下列说法正确的是________。
数字电路逻辑设计课后习题答案第四章
Q4
4-10
解：由右图写出各触发器的特征方程，有：
Q1
n +1
= [ D ] ⋅ CP ↑= ⎡ Q1n + Q 2n ⎤ ⋅ CP ↑＝⎡ Q1n Q 2n ⎤ ⋅ CP ↑ ⎣ ⎦ ⎣ ⎦
⎡ ⎤ Q 2 = [ D ] ⋅ CP ↓= ⎣ Q1n ⎦ ⋅ CP ↓
n +1
根据特征方程，可以画出在下列所示CP波形作用下 Q1和Q2的工作波形：
n +1
4-16（续） Q1 = ⎡ Q 2 ⎤ ⋅ A ↑ ⎢ ⎥ ⎣ ⎦
n +1 n
Q2
n +1
⎡Q n ⎤ ⋅ B ↑ = 1 ⎢ ⎥ ⎣ ⎦
Q1
Q2
4-17
解：由上图写出各触发器的特征方程，有：
⎧Qn+1 = ⎡JQn + KQn ⎤ ⋅ CP ↓⎫ 1⎥ ⎪ 1 ⎢ 1 ⎪ ⎣ ⎦ ⎪ ⎪ n n+1 ⎪ ⎪ ⎡(A⊕Qn )Qn + BQn ⎤ ⋅ CP ↓= ⎡ AQn + BQn ⎤ ⋅ CP ↓ ⎨J = A⊕Q ⎬ ⇒Q = ⎢ 1 1 1 1 1⎥ 1⎥ ⎢ 1 ⎣ ⎦ ⎣ ⎦ ⎪ ⎪ ⎪K = B ⎪ ⎪ ⎪ ⎩ ⎭
4-3 解： 边沿触发器在CP下跳时接收输入信号并可能 改变状态。 主从触发器CP下降沿从触发器接收主触发器 状态，并在CP＝0期间保持不变，而主触发 器被封锁，状态保持不变。
4-4
解： 由两个或非门组成的基本触发器可以看出： 当RD=SD=0时，触发器状态保持不变，即Qn+1=Qn； 当RD=0、SD=1时，Qn+1=1，Q n+1 = 0 ，触发器置1； 当RD=1、SD=0时，Qn+1=0，Q n+1 = 1 ，触发器置0； 当RD=SD=1时，Qn+1=Qn=0，若同时跳变为0，则出现状态不定的 情况。 将以上分析结果用表格的形式列出，得到该基本触发器的状态转 移真值表如下 RD 0 0 1 1 SD 0 1 0 1 Qn+1 Qn 1 0 不允许
数字逻辑电路设计第二版答案
数字逻辑电路设计第二版答案【篇一：蒋立平版数字逻辑电路与系统设计习题答案】1.1 将下列二进制数转换为等值的十进制数。
（1）（11011）2（2（10010111）2 （3）（1101101）2 （4（11111111）2 （5）（0.1001）2 （6 （0.0111）2 （7）（11.001）2 （8 （101011.11001）2题1.1 解：（1）（11011）2 =（27）10（10010111）2 =（151）10（3）（1101101）2 =（109）10 （11111111）2 =（255）10（5）（0.1001）2 =（0.5625）10 （0.0111）2 =（0.4375）10（7）（11.001）2 =（3.125）10（101011.11001）2 =（43.78125）101.3 数。
（1）（1010111）2（110111011）2 （3）（10110.011010）2（4）（101100.110011）2 题1.3 解：（1）（1010111）2 =（57）16 =（127）8（2）（110011010）2 =（19a）16 =（632）8 （3）（10110.111010）2 =（16.e8）16 =（（4）（101100.01100001）2 =（2c.61）16 =1.5 将下列十进制数表示为8421bcd码。
（1）（43）10（95.12）10 （3）（67.58）10 （（932.1）10题1.5 解：（1）（43）10 =（01000011）8421bcd（2）（95.12）10 =（10010101.00010010）8421bcd （3）（67.58）10 =（01100111.01011000）8421bcd （4）（932.1）10 =（1.7 将下列有符号的十进制数表示成补二进制数。
（1） +13 （2）?9（3）+3 （4）?题1.7解：（1） +13 =（01101）2 （（10111）2（3） +3 =（00011）2 （（11000）21.9 用真值表证明下列各式相等。
数字逻辑电路设计第三版课后答案
数字逻辑电路设计第三版课后答案数字电子技术基础试题及答案一、单项选择题(每小题1分，共10分)1、以下叙述一个逻辑函数的方法中，( )就可以唯一则表示。
A.表达式 nbsp;B.逻辑图 nbsp;C.真值表D.波形图2、在不能影响逻辑功能的情况下，CMOS与非门的多余输出端的可以( )。
A.接高电平B.接低电平 nbsp;C.悬空 nbsp;D.通过电阻接地3、一个八位二进制加法计数器，初始状态为，问经过268个输入脉冲后，此计数器的状态为( )。
A. B. C. D.4、若要将一异或非门当做反相器(非门)采用，则输出端的A、B端的相连接方式就是( )。
A.A或B中有一个接“1”B.A或B中有一个接“0”C.A和B并联采用 nbsp;D.无法同时实现5、在时序电路的状态转换表中，若状态数N=3，则状态变量数最少为( nbsp;)。
A.16B.4C.8D.26、下列几种TTL电路中，输出端可实现线与功能的门电路是( )。
A.或非门B.与非门C.异或门D.OC门7、下列几种A/D转换器中，转换速度最快的是( )。
A.循序A/D转换器 nbsp;B.计数型A/D转换器C.逐次渐进型A/D转换器D.双积分A/D转换器8、存储容量为8K×8位的ROM存储器，其地址线为( )条。
A.8B.12C.13D.149、4个触发器形成的BCD码计数器，共计( )个违宪状态。
A.6B.8C.10D.1210、以下哪一条不是消解竟之争冒险的措施( )。
A.接入滤波电路B.利用触发器C.重新加入选通脉冲D.修正逻辑设计二、填空题(每空1分，共20分)1、时序逻辑电路通常由（）和( )两分共同组成。
2、多谐振荡器是一种波形产生电路，它没有稳态，只有两个3、数字电路中的三极管通常工作于________区和________区。
4、四个逻辑变量的最小项最多有________个，任意两个最小项之积为________。
5、555定时器就是一种用途很广为的电路，除了能够共同组成________触发器、________引爆器和________三个基本单元电路以外，还可以接成各种实用电路。
人邮社数字电路逻辑设计习题答案
到二进制小数点后4位）。 答案：（1）（1000001）2
（2）（0.0100）2，
（3）（100001.0101）2 10．写出下列各数的原码、 答案：（1）原码=反码=补码=0.1011
（2）原码=1.1100， 反码=1.0011，补码=1.0100（3）原码=110110，反码=101001，补码=101010
7．按二进制运算法则计算下列各式。
答案：（1）110001（2）110.11（3）10000111（4）101 8．将下列二进制数转换成十进制数、八进制（2）（0.8281）10， （0.65）8，
（3）（23.25）10， （27.2）8，
5．采用余3码进行加法运算时，应如何对运算结果进行修正？为什
么？
答案：两个余3码表示的十进制数相加时，对运算结果修正的方 法是：如果有进位，则结果加3；如果无进位，则结果减3。为了解 决四位二进制运算高位产生的进位与一位十进制运算产生的进位之 间的差值。
6．奇偶检验码有哪些优点和不足？ 答案：奇偶检验码的优点是编码简单，相应的编码电路和检测电 路也简单。缺点是只有检错能力，没有纠错能力，其次只能发现单错， 不能发现双错。
理和规则十分熟练时化简比较方便；缺点是没有固定的规律和步骤， 技巧性强，且通常难以判断化简结果是否达到了最简单。9．用卡诺图化简逻辑函数时，应如何画卡诺圈才能求得一个函数的 最简与—或表达式？
答案：注意两点： 第一，在覆盖所有1方格的前提下，卡诺圈的 个数应达到最少；第二，在满足合并规律的前提下，每个卡诺圈的大 小应达到最大。
11.已知［N］补=1.0110，求［N］原，［N］反和N。
答案：［N］原码=1.1010,［N］反码=1.0101,N= -0.1010
数字电路与逻辑设计_华中科技大学中国大学mooc课后章节答案期末考试题库2023年
数字电路与逻辑设计_华中科技大学中国大学mooc课后章节答案期末考试题库2023年1.（）确定项目是否值得去做.答案:可行性分析2.在整个软件维护阶段所花费的全部工作中，（）所占比例最大。
答案:完善性维护3.软件是一种（）。
答案:逻辑产品4.软件维护产生的副作用，是指（）。
答案:因修改软件而造成的错误5.第一个体现结构化编程思想的程序设计语言是（）。
答案:Pascal6.面向对象技术特别强调的是（）。
答案:对象的数据结构7.关联是建立（）之间关系的一种手段。
答案:类8.为了提高模块的独立性，模块内部最好的是（）。
答案:功能内聚9.软件调试技术包括（）。
答案:演绎法10.螺旋模型最大的优点是（）。
答案:风险驱动11.以下（）内容属于项目前期的主要工作。
答案:现状分析粗略设计可行性分析12.对软件配置说法正确的是（）。
答案:软件配置项是配置管理的基本单位软件配置实际上是动态的概念软件工程过程中某一阶段的变更均要引起软件配置的变更13.以下（）属于面向对象分析建模中的动态模型。
答案:活动图序列图状态图14.需求获取的基本技术有（）等方法。
用户面谈专题讨论问卷调查原型化方法15.UML中常用的关系有（）。
答案:依赖关系关联关系泛化关系聚合关系16.通常用数据流图、数据库字典和简明算法描述表示系统的逻辑模型。
答案:正确17.软件测试是要发现软件中的所有错误。
错误18.输入/输出风格是在软件需求分析和设计阶段建立的，而不是在编码阶段建立的。
答案:正确19.软件开发小组的组成人员素质应该好，而且人数越多越好。
答案:错误20.UML支持面向对象的主要概念，并与具体的开发过程相关。
答案:错误21.在面向对象方法下，用业务用例来描述一个业务，每个业务用例都用一个活动图来进行描述。
正确22.软件工程学科出现的主要原因是软件危机的出现。
答案:正确23.软件开发工具的作用是为了延长软件产品的寿命。
答案:错误24.用黑盒法测试时，测试用例是根据程序内部逻辑设计的。
数字电路逻辑设计课后答案
《数字电路与逻辑设计》习题答案一、填空1．（51．625）10 = （110011.101 ）2= （33.A ）162．（110101.1011）2 =（35.B ）163．（1997）10= （0100 1100 1100 1010）余3BCD= （0001 1001 1001 0111）8421BCD 4．（0110 1001 1000）8421BCD= （689）10（0110 1001 1000）余3BCD = （365）105．（BF.5）16= （1011 1111. 0101）26．16；67．4位8．除2取余法，乘2取余法9．1×2 3 ＋0×2 2 ＋1×2 1 ＋1×2 0 ＋0×2－1 ＋1×2－210．2 i ，N i11．奇校验码12．1，113．与、或、非14．逻辑式、真值表、逻辑图15．输出值“1”的对应最小项相加16．三进制及三进制以上进制的算术加，二进制算术加，逻辑加，模2加17．2 n18．相邻码组之间只有一位不同19．n个相领项20．开通，延迟，上升，t ON ＝t d ＋t r21．关闭，存储，下降，t OFF ＝t s ＋t f22．从负载流（灌）入反相器（或与非门），低23．从反相器（或与非门）流（拉）到负载，高24．与非门允许多大的噪声电压叠加到输入信号的高、低电平上，而不致破坏其正常逻辑状态，抗干扰能力越强25．最多可以带动10个同类型门电路。
26．t PHL ，t PLH ，（t PHL ＋t PLH）/227．短接，短接F 1 •F 2 ，线与28．“0”，“1”，“高阻”29．PMOS，NMOS，CMOS反相器，PMOS，NMOS，CMOS传输门30．V D＋0.7V，－0.7V，极小，激增31．数字，模拟32．电路功耗低、抗干扰能力强、集成度高等33．V NL= V iL(max) －V oL(max)34．电路任一时刻的输出仅取决于该时刻的输入状态，而与电路前一时刻的状态无关35．只包含门电路（无存储元件）36．37．确定它的逻辑功能，并加以改进38．两数的本位加，不带低位的进位加，带进位加39．16个，低电平“0”，高电平“1”40．它们都有两个稳态，可以触发翻转，故具有记忆能力41．特性表、特性方程、波形图42．D、T'、T、RS、JK43．可以用CP控制其翻转时刻，同步触发器、主从触发器、边沿触发器，电平触发、主从触发、边沿触发44．主从、边沿触发器可以克服空翻，而同步触发器不能克服空翻45．两门之间因交叉耦合而产生的自锁作用46．RS＝0，R、S不能同时为“1”47．0，148．可控制的计数，计数翻转，保持原状态49．下降，上升，150．边沿触发方式51．同步时序电路，异步时序电路52．触发器53．统计计数脉冲个数54．Q i－1 Q i－2‥‥‥Q 1 Q 0 ，Q n－1 Q n－2 ‥‥‥Q 1Q 055．暂存，平移56．串/并转换57．16μS58．波形变换、整形、脉冲鉴幅二、选择题:1. A D2. B C D3. A B4. D5. C6. A B D7. D.8. C9. B10. D11. B12. A.13. B14. A B三、化简下列各题1．用代数法化简下列函数为最简与或表达式（1）F＝A B＋B C＋AC＝B（A＋C）＋AC＝B AC＋AC＝B＋AC（2）F＝C D＋CD＋C D＋C D＝（C D＋C D）＋（CD＋C D）＝C＋C＝1（3）F＝AB C＋AB＋B C＋AC＝AB＋B C＋AC＝AB＋B C（4）F＝A＋CDAD＝A＋BCD＋AD＋B＋B＋B＝A＋B2．将下列函数式化为最小项表达式（1）F＝AB＋BC＋AC＝AB（C＋C）＋（A＋A）BC＋A（B＋B）C ＝ABC＋AB C＋A BC＋A B C（2）F＝BCAB ＝AB＋BC＝AB（C＋C）＋（A＋A）BC＝ABC＋AB C＋A BC3．用代数法证明下列等式（1）左式＝（A B＋B）＋（A CD＋C）＋D＝A＋B＋A D＋C＋D＝A ＋B ＋D ＋C ＋D＝1（2）A ⊕0＝A ·0＋A ·1＝A（3）A ⊕1＝A ·1＋A ·1 ＝A（4）A ⊕A ＝A ·A ＋A ·A＝A ＋A ＝14．直接写出下列各函数的对偶式F'，并用反演规则写出其反演式F（1）F'＝（A ＋B ）（B ＋C ）（C ＋A D ）F ＝（A ＋B ）（B ＋C ）（C ＋A D ）（2）F'＝A ·）＋（E D C BF ＝A ·）＋（E D C B5．用对偶规划求下列各式的对偶等式（1）左式的对偶式为（A ＋B ）（A ＋C ）（B ＋C ＋D ）右式的对偶式为（A ＋B ）（A ＋C ）∴其对偶等式为：（A ＋B ）（A ＋C ）（B ＋C ＋D ）＝（A ＋B ）（A ＋C ）（根据对偶规则两式相等，则其对偶式也相等）（2）左式的F'1 ＝C B A ⋅⋅右式的F'2 ＝A ＋B ＋C其对偶等式为：C B A ⋅⋅＝A ＋B ＋C6．试写出下列卡诺图的最小项表达式，并用卡诺图法求其最简与或式（1）最小项表达式F （A 、B 、C ）＝∑），，，，（54310 或F ＝A B C ＋A B C ＋A BC ＋A B C ＋A B C 最简与或式F ＝A C ＋B（2）最小项表达式F （A 、B 、C 、D ）＝），，，，，（1086420∑或F ＝A B C D ＋A B C D ＋A B C D ＋A BC D ＋A B C D ＋A B C D ；最简与或式F ＝B D ＋A D7．用卡诺图法化简下列函数为最简与或式（1）F ＝A B C ＋AD ＋D （B ＋C ）＋A C ＋A D ＝A ＋B C ＋D（2）10157φ32869）＋（，（11，，，，，，，＝A B＋A C＋B D＋CD9．（1）错(2) 错(3) 对10．⋅⋅=+F⋅BCBAC1⋅B=C+⊕F⋅BCA2+⋅=3⋅⋅BCF⋅ACBA11．当控制信号BC=00时，输出是输入变量的反码。
数字电路与逻辑设计习题及参考答案全套
数字电路与逻辑设计习题及参考答案一、选择题1. 以下表达式中符合逻辑运算法则的是 D 。
A.C ·C=C 2B.1+1=10C.0<1D.A+1=12. 一位十六进制数可以用 C 位二进制数来表示。
A . １B . ２C . ４D . 163. 当逻辑函数有n 个变量时，共有 D 个变量取值组合？A. nB. 2nC. n 2D. 2n4. 逻辑函数的表示方法中具有唯一性的是 A 。
A .真值表 B.表达式 C.逻辑图 D.状态图5. 在一个8位的存储单元中，能够存储的最大无符号整数是 D 。
A .（256）10B .（127）10C .（128）10D .（255）106.逻辑函数F=B A A ⊕⊕)( = A 。
A.BB.AC.B A ⊕D. B A ⊕7．求一个逻辑函数F 的对偶式，不可将F 中的 B 。
A .“·”换成“+”，“+”换成“·”B.原变量换成反变量，反变量换成原变量C.变量不变D.常数中“0”换成“1”，“1”换成“0”8．A+BC= C 。
A .A+B B.A+C C.（A+B ）（A+C ） D.B+C9．在何种输入情况下，“与非”运算的结果是逻辑0。
DA ．全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是110．在何种输入情况下，“或非”运算的结果是逻辑1。
AA ．全部输入是0 B.全部输入是1 C.任一输入为0，其他输入为1 D.任一输入为111．十进制数25用8421BCD 码表示为 B 。
A .10 101B .0010 0101C .100101D .1010112．不与十进制数（53.5）10等值的数或代码为 C 。
A .(0101 0011.0101)8421BCDB .(35.8)16C .(110101.11)2D .(65.4)813．以下参数不是矩形脉冲信号的参数 D 。
A.周期B.占空比C.脉宽D.扫描期14．与八进制数(47.3)8等值的数为： BA. (100111.0101)2B.(27.6)16C.(27.3 )16D. (100111.101)215. 常用的BCD码有 D 。
数字电路与逻辑设计课后题答案
驱动方程 J 1 K 1 Q3
J 2 K 2 Q1 Q Q , Q 1 2 K3 3 J 3
输出方程
Y Q3
5-1
Qn 1 Q Q Q Q Q Q J 1 K 1 Q3 3 1 3 1 3 1 状态方程： 1 n 1 K 2 Q1 Q2 Q1 Q2 Q1 Q2 Q1 Q2 J 2 Q Q , Q n 1 J3 K3 1 2 3 Q3 Q1 Q2 Q3 Q3 Q3 Q1 Q2 Q3
Z1 Y1 Y 0 Y1 Y 0 Z 2 Y1 Y 0 Y1 Y 0 Z 3 Y1 Y 0 Y1 Y 0 Z 4 Y1 Y 0 Y1 Y 0
注意:与输入无效情况 相，如何改进？
3-5 试画出用3线-8线译码器74LS138和门电路产生如下多输出 逻辑函数的逻辑图。
A0
n Q1 1 Q 2 n 1 Q 2 Q1 Q 2 Y Q 2 Q1
n 1 n 1 Q1 Q2 Y 0
状态转换图：
1 1 1 1
0
0
0
1
Q2Q1
A
Y
0
0
00
01
0 0
11
0 0
10
0 0
5-3 在图电路中，若两个移位寄存器中的原始数据分别为 A3A2A1A0=1001，B3B2B1B0=0011，试问经过4个CP信号 作用以后两个寄存器中的数据如何？ 这个电路完成什么功能？
4-3 已知维持阻塞结构D触发器各输入端的电压波形如图所示， 试画出Q、 Q端对应的电压波形。
D:
Q: Q:
4-4 设图4.4中各触发器的初始状态皆为Q=0，试画出在CP 信号连续作用下各触发器输出端的电压波形。
数字电路与逻辑设计_华中科技大学中国大学mooc课后章节答案期末考试题库2023年
数字电路与逻辑设计_华中科技大学中国大学mooc课后章节答案期末考试题库2023年1.二进制并行加法器使用先行进位的主要目的是( )参考答案:提高运算速度2.关于四位二进制并行加法器74283，下面说法正确的是（）参考答案:它可以实现加法运算_它可以实现减法运算_它有9个输入端，5个输出端_它可以实现代码转换3.关于计数器74290，下面说法正确的是参考答案:其内部包含四个触发器_它可以实现模小于10的任意计数器_它可以实现8421码模10计数器4.将十进制数75.25转换成十六进制数为（）参考答案:4B.45.余3码10010101.10101000对应的二进制数为 ( )参考答案:111110.116.同步时序电路设计中，状态编码采用相邻编码法的目的是( )。
参考答案:减少电路中的逻辑门7.在正常工作时，3-8线译码器74138的使能端【图片】【图片】【图片】的值为( )参考答案:1008.相同功能的Moore型时序电路比Mealy型时序电路多一个状态，因此Moore型比Mealy型的时序电路多一个触发器。
参考答案:错误9.在设计同步时序逻辑电路时，实现相同功能，使用D触发器的电路一定比使用JK触发器的电路简单。
参考答案:错误10.组合逻辑电路在任何时刻产生的稳定输出值仅仅取决于该时刻各输入值的组合，而与过去的输入值无关。
参考答案:正确11.为了实现计数功能，集成寄存器74194的控制端S0S1可以是（）。
参考答案:01_1012.用逻辑代数公理、定理和规则可以证明【图片】。
参考答案:正确13.使用8路选择器实现4变量逻辑函数F(A,B,C,D),使用ABC作为控制变量，数据输入端D0-D7可能的值有( )。
参考答案:1_D14.带符号二进制数–00101的补码为（）参考答案:11101115.根据反演规则和对偶规则可写出逻辑函数【图片】的反函数【图片】=（），对偶函数【图片】=（）。
参考答案:；16.用卡诺图化简法求逻辑函数【图片】的最简与或表达式和最简或与表达式分别为（）。
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《数字电路与逻辑设计》习题答案一、填空1．（51．625）10 = （ 110011.101 ）2= （ 33.A ）162．（110101.1011）2 =（ 35.B ）163．（1997）10= （0100 1100 1100 1010）余3BCD= （0001 1001 1001 0111）8421BCD 4．（0110 1001 1000）8421BCD= （ 689）10（0110 1001 1000）余3BCD = （ 365）105．（BF.5）16= （1011 1111. 0101）26．16；67．4位8．除2取余法，乘2取余法9．1×2 3 ＋0×2 2 ＋1×2 1 ＋1×2 0 ＋0×2－1 ＋1×2－210．2 i ，N i11．奇校验码12．1，113．与、或、非14．逻辑式、真值表、逻辑图15．输出值“1”的对应最小项相加16．三进制及三进制以上进制的算术加，二进制算术加，逻辑加，模2加17．2 n18．相邻码组之间只有一位不同19．n个相领项20．开通，延迟，上升，t ON ＝t d ＋t r21．关闭，存储，下降，t OFF ＝t s ＋t f22．从负载流（灌）入反相器（或与非门），低23．从反相器（或与非门）流（拉）到负载，高24．与非门允许多大的噪声电压叠加到输入信号的高、低电平上，而不致破坏其正常逻辑状态，抗干扰能力越强25．最多可以带动10个同类型门电路。
26．t PHL ，t PLH ，（t PHL ＋t PLH）/227．短接，短接F 1 •F 2 ，线与28．“0”，“1”，“高阻”29．PMOS，NMOS，CMOS反相器，PMOS，NMOS，CMOS传输门30．V D ＋0.7V，－0.7V，极小，激增31．数字，模拟32．电路功耗低、抗干扰能力强、集成度高等33．V NL= V iL(max) － V oL(max)34．电路任一时刻的输出仅取决于该时刻的输入状态，而与电路前一时刻的状态无关35．只包含门电路（无存储元件）36．37．确定它的逻辑功能，并加以改进38．两数的本位加，不带低位的进位加，带进位加39．16个，低电平“0”，高电平“1”40．它们都有两个稳态，可以触发翻转，故具有记忆能力41．特性表、特性方程、波形图42．D、T'、T、RS、JK43．可以用CP控制其翻转时刻，同步触发器、主从触发器、边沿触发器，电平触发、主从触发、边沿触发44．主从、边沿触发器可以克服空翻，而同步触发器不能克服空翻45．两门之间因交叉耦合而产生的自锁作用46．RS＝0，R、S不能同时为“1”47．0，148．可控制的计数，计数翻转，保持原状态49．下降，上升，150．边沿触发方式51．同步时序电路，异步时序电路52．触发器53．统计计数脉冲个数54．Q i－1 Q i－2‥‥‥Q 1 Q 0 ，Q n－1 Q n－2 ‥‥‥Q 1 Q 055．暂存，平移56．串/并转换57．16μS58．波形变换、整形、脉冲鉴幅二、选择题:1. A D2. B C D3. A B4. D5. C6. A B D7. D.8. C9. B10. D11. B12. A.13. B14. A B 三、化简下列各题1．用代数法化简下列函数为最简与或表达式（1）F ＝A B ＋B C ＋AC ＝B （A ＋C ）＋AC＝B AC ＋AC＝B ＋AC（2）F ＝C D ＋CD ＋C D ＋C D ＝（C D ＋C D ）＋（CD ＋C D ） ＝C ＋C ＝1（3）F ＝AB C ＋AB ＋B C ＋AC ＝AB ＋B C ＋AC＝AB ＋B C（4）F ＝A ＋CD ＋B ＋B AD ＝A ＋BCD ＋AD ＋B ＝A ＋B2．将下列函数式化为最小项表达式（1）F ＝AB ＋BC ＋AC ＝AB （C ＋C ）＋（A ＋A ）BC ＋A （B ＋B ）C＝ABC ＋AB C ＋A BC ＋A B C（2）F ＝BC AB ＝AB ＋BC＝AB （C ＋C ）＋（A ＋A ）BC＝ABC ＋AB C ＋A BC3．用代数法证明下列等式（1）左式＝（A B ＋B ）＋（A CD ＋C ）＋D＝A ＋B ＋A D ＋C ＋D＝A ＋B ＋D ＋C ＋D＝1（2）A ⊕0＝A ·0＋A ·1＝A（3）A ⊕1＝A ·1＋A ·1 ＝A（4）A ⊕A ＝A ·A ＋A ·A＝A ＋A ＝14．直接写出下列各函数的对偶式F'，并用反演规则写出其反演式F（1）F'＝（A ＋B ）（B ＋C ）（C ＋A D ）F ＝（A ＋B ）（B ＋C ）（C ＋A D ）（2）F'＝A ·）＋（E D C B F ＝A ·）＋（E D C B 5．用对偶规划求下列各式的对偶等式（1）左式的对偶式为（A ＋B ）（A ＋C ）（B ＋C ＋D ）右式的对偶式为（A ＋B ）（A ＋C ）∴其对偶等式为：（A ＋B ）（A ＋C ）（B ＋C ＋D ）＝（A ＋B ）（A ＋C ）（根据对偶规则两式相等，则其对偶式也相等）（2）左式的F'1 ＝C B A ⋅⋅右式的F'2 ＝A ＋B ＋C其对偶等式为：C B A ⋅⋅＝A ＋B ＋C6．试写出下列卡诺图的最小项表达式，并用卡诺图法求其最简与或式（1）最小项表达式F （A 、B 、C ）＝∑），，，，（54310 或F ＝A B C ＋A B C ＋A BC ＋A B C ＋A B C 最简与或式F ＝A C ＋B（2） 最小项表达式F （A 、B 、C 、D ）＝），，，，，（1086420∑或F ＝A B C D ＋A B C D ＋A B C D ＋A BC D ＋A B C D ＋A B C D ； 最简与或式F ＝B D ＋A D7．用卡诺图法化简下列函数为最简与或式（1）F ＝A B C ＋AD ＋D （B ＋C ）＋A C ＋A D ＝A ＋B C ＋D（2）F ＝∑∑），，（）＋，，，，，，（1187φ151096320 ＝A B ＋A C ＋B D ＋CD9．（1）错(2) 错 (3) 对10． C B C B A F ⋅+⋅⋅=1C B C B A F ⋅+⋅⊕=2C B A C B A F ⋅⋅+⋅⋅=311．当控制信号BC=00时，输出是输入变量的反码。
当控制信号BC=01时，输出是输入变量的原码。
当控制信号BC=10时，输出为全“1”当控制信号BC=11时，输出为全“0”电路是一个原码/反码和0/1码的转换器。
12．设A 、B 、C 三个逻辑变量代表三位裁判，A 为裁判长，逻辑“1”表示按下按键，逻辑“0”表示未按按键；Y=1表示举重成功（灯亮、或铃响），Y=0表示举重失败（灯不亮、或铃不响）。
逻辑真值表.逻辑函数表达式Y= AB+ AC逻辑图13．解：根据已知条件，需满足：⎩⎨⎧≤--≥+-4.0)84(54.2)84(5max is OL L iH OH L I I R I I R 解得 Ω≤≤ΩK R L 25.3329四、分析下列各题1．按下图所示求出F 的逻辑式，并将其化简成最简与或式。
解：按图求得：F=BCD ·B ·D+D化简得：F=BCD+B+D+D=CD+B+D=C+B+D2．分析如下电路，写出F 的最简与或式（用卡诺图化简F ）。
解：F=∑（2，4，6，7）Y AC B卡诺图化简如下：F ＝BC ＋AC ＋AB3．CMOS 线路图如图所示，写出F 的逻辑式，说明它是何种门电路。
解：F ＝B A ＝B A ＋功能：为或非门4．电路如图所示，试对应于A 、B 、C 端的波形画出该电路的输出波形。
解：5．下图中片0－4均为译码器，指出当输入代码为A 4 A 3 A 2 A 1 A 0=10101时，片0-3中的哪一片工作？该片中的哪一条输出线有效？解：∵A 4 A 3 ＝10＝（A 1 A 0 ）片4 ∴（Y 2 ）片4 有效，从而使片2工作。
又因：A 2 A 1 A 0 ＝101＝（A 2 A 1 A 0 ）片2 ，所以片2的输出线Y 5 有效。
6．分析如下逻辑图，求出Y 1 、Y 2 的逻辑式，列出真值表，指出逻辑功能。
解：YABC功能：半加器Y 1 ＝A⊕BY 2 ＝A·B7．分析用四选一数据选择器构成的电路，写出Y的最简与或式。
A I 0 ＋A BI 1 ＋AB I 2 ＋ABI 3解：Y＝B＝A B＋A BC＋A B C＋ABC用卡诺图化简Y＝A C＋B C＋BC或Y＝A B＋BC＋B C8．分析如下电路，写出逻辑式，列出真值表，指出逻辑功能。
解：F1（A、B、C）=Σ（1、2、4、7）F2（A、B、C）=Σ（3、5、6、7）由真值表看出，它是全加器，F 1为本位和，F 2为向高位的进位。
五、分析下列电路1．试用一个四选一数据选择器设计实现下述逻辑功能的组合电路。
解：设计电路如下：2．用8选1数据选择器实现逻辑函数F= （2，4，5，7）。
解：实现电路如下：A BF3．用3-8线译码器实现逻辑函数F=A B ＋AC ＋B C 。
解：F=A B ＋AC ＋B C ＝ )7,6,5,4,2(直接画图得：4．试用下图所示的4选1数据选择器设计一组合电路。
从电路的输入端（A 、B 、C 、D ）输入余3BCD 码，输出为F 。
当输入十进制数码0、2、4、5、7的对应余3BCD 码时，F=1；输入其它余3BCD 码时，F=0。
（输入端允许用反变量）解：（1）依题意列真值表：FF（2）画卡诺图F ＝B D ＋A D5. D B A C B A BD A C B A Y +++=6．取片（1）和片（2）的S 1作为第四个代码输入端A 3，片（1）和片（2）的3个代码输入端A 2，A 1，A 0接在一起作为4线—16线译码器的3个代码输入端A 2，A 1，A 0。
同时使两片的2S =3S =0，如图所示。
7．Y Y Y Y Y Y Y Y Y Y Y Y Y Y Y Y A 1A 2A 0A 38．六、试画出下列各题波形1．试画出如下逻辑电路的P 端输出波形，要求对应CP 输入时钟和A 输入波形画出输出波形P 。
已知维持阻塞D 触发器的初始状态为“1”（忽略触发器的传输延迟时间）。
解：2．由主从JK 触发器组成的逻辑电路如下图所示，试对应CP 波形画出Q 的波形。
（设触发器的初始态为“0”，且画图时忽略触发器的延迟时间）。
解：PCPA CP J QK CP A QB3．逻辑电路及CP 、A 的电压波形如下图所示，试画出Q 的波形。