I2C 协议标准完全版,很详细

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I2C总线-DDC传输协议-显示器EDID结构介绍

I2C总线-DDC传输协议-显示器EDID结构介绍

EDID数据交换是显示器与信号源设备通讯说明自身性能的一种标准化方法。这种通讯是为了使显示器可以发送自身的性能特征——比如原始分辨率——到信号源设备,使这个设备生成适合于显示器要求的视频特性。用户不需要手动调节,就能最大限度地提升设备之间的兼容性,从而减少了因为不正确的设置和调整对显示图像和系统的整体可靠性所造成的影响。

一般来说,信号源设备可能是一台桌面计算机或笔记本电脑的显卡,但是现在又多了许多不同的设备,包括高清电视接收机和数字录像机、DVD和蓝光播放器,甚至还有游戏机,这就需要读取EDID并输出相应的视频。EDID最初是为了计算机模拟视频设备上的VGA接口而开发的,现在能够用于DVI、HDMI 和DisplayPort。

历史

EDID是由VESA——视频电子标准协会定义的,并在1994年和DDC标准1.0版一起推出了1.0版本。如表1。

在EDID开发之前,VGA接口的针脚4、11、12和15有时被用于定义显示器的性能。这些ID针脚带有高的或低的值用于定义不同的屏幕分辨率。VESA 通过重新定义VGA接口的针脚9、12和15,以DDC——显示数据通道的形式作为一个系列母线,扩展了这一体系。这使更多的信息得以交换,因此显示器和信号源之间能够以EDID或其他的形式进行交流。

原始的DDC协议定义了从显示器发送到视频信号源的128个字节的EDID 格式的数据。

由于显示类型和功能的不断增加,128个字节变得捉襟见肘起来,EDID和DDC都进行了扩展,因此多重128字节的数据块可以进行交换。这就是在众多消费品上所用到的E-EDID。实际上,CEA——美国消费电子产品协会以及国内定义了自己的EDID扩展包来包含额外的视频格式并支持先进的多声道音频功能。

关于I2C、UART、SPI、RS232、JTAG_ISP、概念和理解

关于I2C、UART、SPI、RS232、JTAG_ISP、概念和理解

一、UART总线和硬件结构--Universal Asynchronous Receiver/Transmitter

UART是一种通用异步串行数据总线,该总线双向通信,可以实现全双工传输和接收。因为计算机内部采用并行数据,不能直接把数据发到Modem,必须经过UART整理才能进行异步传输。串行的两条线 TXD --- UART数据发送,RXD --- UART数据接收

UART通用异步接收/发送装置,是一个并行输入成为串行输出的芯片,它是用于控制计算机与串行设备的芯片,通常集成在主板上,多数是16550AFN芯片。,有一点要注意的是,它提供了RS-232C数据终端设备接口 ,这样计算机就可以和调制解调器或其它使用RS-232C接口的串行设备通信,所以说UART是一种异步串行全双工总线,硬件映射为一个芯片,可以与使用RS-232接口的设备直接通信

二、I2C总线和硬件结构------Inter-Integrated Circuit

I2C是一种一种同步两线式串行数据总线,由PHILIPS公司1992 年开发的,I2C串行总线一般有两根信号线,一根是双向的数据线SDA,另一根是时钟线SCL。所有接到I2C总线设备上的串行数据SDA都接到总线的SDA上,各设备的时钟线SCL接到总线的SCL上,用于连接微控制器及其外围设备,一般在对芯片进行扩展中是使用,通用I/O端口也可以作为I2C总线接口。

所以说I2C是一种同步串行半双工总线,硬件映射为一个两个接口电路,对于没有I2C总线接口的,可以使用通用I/O端口来实现

米思齐i2c 参数

米思齐i2c 参数

米思齐i2c 参数

米思齐(Misiqi)I2C参数详解

I2C(Inter-Integrated Circuit)是一种双向二线制同步串行总线,它允许连接多个设备到单个总线上,并由一个主设备控制数据传输。在米思齐(Misiqi)的设备或模块中,I2C接口被广泛应用,以实现设备之间的数据通信。下面将详细介绍米思齐I2C的相关参数。

I2C地址:每个I2C设备都有一个唯一的地址,用于在总线上识别。米思齐的设备通常会在其数据手册或规格说明书中提供其I2C地址。这个地址是设备在总线上被寻址的依据。

数据格式:I2C通信通常使用8位或16位的数据格式。米思齐的设备会明确指定其数据格式,以便正确地与设备进行通信。

通信速度:I2C通信的速度可以通过调整SCL(时钟线)的频率来改变。米思齐的设备会指定其支持的I2C通信速度范围,以确保设备之间的兼容性。

电源要求:使用I2C接口的设备通常需要外部电源供电。米思齐的设备会明确其电源要求,包括电压范围和电流消耗等。

通信协议:I2C通信遵循一定的协议规范,包括起始条件、数据传输、停止条件等。米思齐的设备会遵循这些规范,以确保与其他I2C设备的兼容性。

寄存器映射:米思齐的I2C设备通常会有一系列的寄存器,用于配置和控制设备。这些寄存器的地址和功能会在设备的数据手册中详细说明。

通信模式:I2C通信有两种模式:标准模式和快速模式。米思齐的设备会根据其性能和需求选择适合的通信模式。

总的来说,了解米思齐I2C的相关参数对于正确使用和配置I2C设备至关重要。在实际应用中,建议参考设备的数据手册或规格说明书以获取最准确和详细的信息。

I2C_24C02总线通信协议实例详解(附详细示波器实测波形图)

I2C_24C02总线通信协议实例详解(附详细示波器实测波形图)

I2C详解

I2C总线是PHLIPS公司推出的一种串行总线,是具备多主机系统所需的包括总线裁决和高低速器件同步功能的高性能串行总线。I2C总线只有两根双向信号线:一根是数据线SDA,另一根是时钟线SCL。I2C总线通过上拉电阻接正电源。当总线空闲时,两根线均为高电平。连到总线上的任一器件输出的低电平都将使总线的信号变低,即各器件的SDA及SCL都是线“与”关系。在有些情况下,可能没接上拉电阻I2C也能正常通信,但是建议读者最好接上拉电阻。本文最后将给出有接上拉电阻和没接两种情况下的I2C通信波形,可以明显的看出来,接了上拉电阻波形更漂亮,通信也更稳定。本文将以24C02来详细讲解I2C 协议。因为本文的重点是讲解I2C,所以这里只简单的介绍24C02,有关24C02的更为详细的资料,读者可以查阅其数据手册,在这里就其必需的部分进行简单的讲解。

一、 AT24C02简介

AT24C02是美国ATMEL公司的低功耗CMOS串行EEPROM,它是内含256×8位(2K)存储空间,具有工作电压宽(2.5~5.5V)、擦写次数多(大于10000次)、写入速度快(小于10ms)等特点。它的典型应用电路如图1:

图1 AT24C02典型应用电路

图1中AT24C02的1、2、3脚是三条地址线,用于确定芯片的硬件地址。在本文都将其接地,表示其地址为000。第5脚SDA为串行数据输入/输出,数据通过这条双向I2C总线串行传送,第6脚SCL为串行时钟输入线。当用单片机I/O 口模拟I2C通信时,这两个引脚可以接任意的I/O口。SDA和SCL都需要接一个上拉电阻,其阻值一般为4.7K~10K。第7脚是写保护引脚,可以接IO口也可以直接接地,接地就不再具有保护功能。这里将其直接接地。

i3c和i2c引脚电平

i3c和i2c引脚电平

i3c和i2c引脚电平

1. 引言

i3c和i2c是两种常见的串行通信协议,用于连接集成电路之间的通信。在这篇文章中,我们将详细介绍i3c和i2c引脚电平的相关知识。首先,我们将简要介绍

i3c和i2c协议的基本原理,然后深入探讨它们在硬件层面上的引脚电平特性。

2. i3c引脚电平

2.1 i3c概述

i3c(MIPI I3C)是一种由移动行业处理器接口(MIPI)联盟制定的新一代串行总线标准。它具有高速数据传输、低功耗、多主机支持等特点,逐渐取代了传统的

i2c总线。i3c在硬件层面上与i2c有很多相似之处,但也有一些重要区别。

2.2 i3c引脚电平规范

根据MIPI I3C物理层规范,i3c总线上的信号分为时钟信号(SCL)和数据信号(SDA)。在正常操作中,这两个信号都是双向的。下面我们将详细介绍它们的引脚电平规范。

2.2.1 SCL引脚电平

i3c的时钟信号(SCL)由主设备控制,用于同步数据传输。根据规范,SCL的电平应该是低电平(Low)和高电平(High)两个状态。

•低电平:规范要求低电平的最大值不得超过0.4V。

•高电平:规范要求高电平的最小值不得低于0.8V。

这些要求保证了i3c总线上的时钟信号在稳定和可靠的范围内工作。

2.2.2 SDA引脚电平

i3c的数据信号(SDA)用于传输实际的数据。与SCL类似,SDA也有两个状态:低电平和高电平。根据规范,SDA的引脚电压应满足以下要求:

•低电平:规范要求低电压不能超过0.4V。

•高电压:规范要求高电压不能低于0.8V。

同样,这些要求确保了i3c总线上数据信号的可靠性和稳定性。

(完整版)SPI,UART,I2C的区别以及RS232与RS485的区别

(完整版)SPI,UART,I2C的区别以及RS232与RS485的区别

SPI,UART,I2C的区别以及RS232与RS485的区别

详细的区别:

第一个区别当然是名字:

SPI(Serial Peripheral Interface:串行外设接口);

I2C(INTER IC BUS:意为IC之间总线)

UART(Universal Asynchronous Receiver Transmitter:通用异步收发器) 第二,区别在电气信号线上:

SPI总线由三条信号线组成:串行时钟(SCLK)、串行数据输出(SDO)、串行数据输入(SDI)。SPI总线可以实现多个SPI设备互相连接。提供SPI串行时钟的SPI设备为SPI 主机或主设备(Master),其他设备为SPI从机或从设备(Slave)。主从设备间可以实现全双工通信,当有多个从设备时,还可以增加一条从设备选择线。

如果用通用IO口模拟SPI总线,必须要有一个输出口(SDO),一个输入口(SDI),另一个口则视实现的设备类型而定,如果要实现主从设备,则需输入输出口,若只实现主设备,则需输出口即可,若只实现从设备,则只需输入口即可。

I2C总线是双向、两线(SCL、SDA)、串行、多主控(multi-master)接口标准,具有总线仲裁机制,非常适合在器件之间进行近距离、非经常性的数据通信.在它的协议体系中,传输数据时都会带上目的设备的设备地址,因此可以实现设备组网。

如果用通用IO口模拟I2C总线,并实现双向传输,则需一个输入输出口(SDA),另外还需一个输出口(SCL)。(注:I2C资料了解得比较少,这里的描述可能很不完备) UART总线是异步串口,因此一般比前两种同步串口的结构要复杂很多,一般由波特率产生器(产生的波特率等于传输波特率的16倍)、UART接收器、UART发送器组成,硬件上由两根线,一根用于发送,一根用于接收。

i2c协议 vil范围

i2c协议 vil范围

i2c协议 vil范围

I2C协议中的VIL(输入低电压)指的是当一个逻辑低电平被认

为是稳定的最大电压。在I2C规范中,VIL的范围通常是0V到0.3V,这意味着在这个范围内的电压被认为是逻辑低电平。这个范围确保

了设备之间能够正确地识别逻辑高和逻辑低电平,从而实现可靠的

通信。

从电气特性的角度来看,VIL的范围确保了I2C设备在逻辑低

电平时的稳定性和可靠性。这个范围内的电压可以被准确地识别为

逻辑低电平,从而确保了数据传输的准确性。

另外,VIL的范围也受到制造工艺和器件特性的影响。不同制

造商生产的器件可能会有略微不同的VIL范围,因此在实际应用中

需要根据具体器件的规格书来确定准确的VIL范围。

总的来说,I2C协议中的VIL范围通常是0V到0.3V,这个范围

确保了逻辑低电平的稳定性和可靠性,同时也受到制造工艺和器件

特性的影响。

I2C verilog (非常详细的i2c学习心得)

I2C verilog (非常详细的i2c学习心得)

图 1. UART、SPI、I2C 总线对比 如图 1 所示,UART 的总线数只有两条,分别是 TX(发送)和 RX(接收) ,没有时钟信 号,所以 UART 需要固定的波特率,也就是两位数据的间隔要相等。而 SPI 的四条总线分别 为 SCLK(时钟) 、MISO(主器件数据输入,从器件数据输出) 、MOSI(主器件数据输出, 从器件数据输入) 、SS(从器件使能信号) ,SPI 总线由主机提供时钟,为同步通信,并且 SPI 总线有两条总线进行数据传输,可以同时进行收发数据,为双工模式。SPI 有 3 线、4 线 两种模式,3 线模式一般代表没有 SS 信号,具体情况还要视器件手册而定。I2C 有两条总线 SCL(时钟)和 SDA(数据) ,I2C 用的线更少,因为 I2C 需要有双向 IO 的支持,而且使用上 拉电阻,抗干扰能力没有其他两种强,一般用于同一板卡上芯片之间的通信,较少用于远距 离通信。 具体到 FPGA 设计这一环节,我们需要搞清这三种总线上的信号是怎么走的,UART 很简
I2C 学习心得
我最近刚做完 I2C 通信协议的编写与调试, 下面介绍一下我从一开始理解夏老师的程序, 修改程序,直到下板调试整个的学习过程,希望对大家学习 I2C 有一定的帮助。 一、 分析源代码 学习 I2C, 首先我们要知道 I2C 是一种串行总线协议。 目前几种常用的串行总线有 UART、 SPI 和 I2C,先来简单了解一下这三种串行总线。

I2C和SPI-图文

I2C和SPI-图文

I2C和SPI-图文

SPI/I2C总线

虽然现实世界中的信号都是模拟信号,但是越来越多的模拟IC产品

通过数字接口实现通讯。微处理器通过几条总线控制周边的设备,比如:

模/数转换器(ADC),数/模转换器(DAC),智能电池,端口扩展,EEPROM以及温度传感器。

与数据的平行传输接口不同,串行数据通过两条、三条或者四条数据

/时钟总线连续地传输比特数据。虽然并行的总线具有传输速度快的特点,但是串行总线具有使用较少的控制和数据线的优点。2线和3线的总线在

大多数微处理器上应用于收发数据。

串行接口在提供串行时钟的主设备和从设备/周边设备之间的进行通讯。串行接口有三种:三线、二线和单线。本文着眼于二线和三线的串行

接口。

三线的接口包括:片选线(CS或SS)、时钟线(SCLK)和数据输入/

主设备输出线(DIN或MOSI)。三线接口有时也包括一条数据输出/主设

备输入线(DOUT或MISO)。包含DOUT线的三线接口有时也叫做四线接口。为了叙述的简便,本文将三线接口和四线接口统称为三线接口。二线接口

包括一条数据线(SDA或SMBDATA)和一条时钟线(SCL或SMBCLK)。

串行外设接口(SPI),队列串行外设接口(QSPI)和MicroWire

(或MicroWire/Plu)接口都是三线接口。

芯片间总线(I2C)和SMBUS都是二线接口。这些串行接口拥有各自

的优点和缺点,见表1。

三线接口可以以更高的时钟频率工作,并且不需要上拉电阻。

SPI/QSPI和MicroWire接口都可以工作在全双工模式(数据可以在同一

I2C串行EEPROM系列中文资料

I2C串行EEPROM系列中文资料

C, I P, SN, ST, OT, MC
24LC00
2.5-5.5V 400 kHz(1)



C, I
24C00 1 千位器件
4.5-5.5V 400 kHz
C, I, E
24AA01 24LC01B 24AA014 24LC014 24C01C 2 千位器件 24AA02 24LC02B 24AA024 24LC024 24AA025 24LC025 24C02C 4 千位器件 24AA04
5: P = 8-PDIP,SN = 8-SOIC (150 mil JEDEC),ST = 8-TSSOP,OT = 5 或 6-SOT23,MC = 2x3mm DFN, MS = 8-MSOP, SM = 8-SOIC (200 mil EIAJ),MF = 5x6mm DFN, ST14 = 14-TSSOP。
1.8-5.5V 400 kHz (2) 2.5-5.5V 400 kHz 1.8-5.5V 400 kHz(2) 2.5-5.5V 400 kHz 4.5V-5.5V 400 kHz
8 字节
16 字节 16 字节
整个阵列
整个阵列 无

A0, A1, A2 A0, A1, A2
I I, E
I I C, I, E
3: VCC <2.5V,频率为 400 kHz。

i2c电平转换原理 -回复

i2c电平转换原理 -回复

i2c电平转换原理-回复

I2C(Inter-Integrated Circuit)是一种串行通信协议,被广泛应用于数字电子系统中。它允许多个设备在同一条总线上进行通信,通过只需两根线来传输数据,即串行数据线(SDA)和串行时钟线(SCL)。

然而,不同设备之间可能使用不同的电平标准,所以当连接两个不兼容的设备时,需要进行电平转换以确保它们能够正确地进行通信。本文将详细介绍I2C电平转换的原理,并一步一步回答与此相关的问题。

第一步,我们需要了解I2C总线上使用的电平标准。通常情况下,I2C 总线上的高电平(高电平逻辑1)被定义为VDD,低电平(低电平逻辑0)被定义为接地。然而,由于不同设备供电电压的差异,不同设备可能采用不同的高电平和低电平电压。典型的I2C电平标准包括3.3V、5V和1.8V 等。

第二步,要进行I2C电平转换,我们需要使用电平转换器或电平转换芯片。这些芯片的主要功能是将一个电平转换为另一个电平,以确保两个设备能够在不同电平标准下进行正确的通信。一般来说,电平转换芯片有单向和双向两种类型。

在单向电平转换中,数据只能在一个方向上进行传输。这意味着只有SDA线或SCL线可以转换电平,而另一根线保持不变。这种类型的电平转换适用于只需进行单向通信的场景,例如从3.3V设备向5V设备发送数据。

而在双向电平转换中,数据可以在两个方向上进行传输。这意味着SDA线和SCL线都需要进行电平转换。这种类型的电平转换适合于需要

双向通信的场景,例如两个不同电平标准的设备之间的数据传输。

第三步,我们需要选择适合的电平转换芯片。市面上有许多不同的电平转换芯片可供选择,以满足不同需求。在选择芯片时,需考虑以下因素:

I2C verilog (非常详细的i2c学习心得)

I2C verilog (非常详细的i2c学习心得)
I2C 学习心得
我最近刚做完 I2C 通信协议的编写与调试, 下面介绍一下我从一开始理解夏老师的程序, 修改程序,直到下板调试整个的学习过程,希望对大家学习 I2C 有一定的帮助。 一、 分析源代码 学习 I2C, 首先我们要知道 I2C 是一种串行总线协议。 目前几种常用的串行总线有 UART、 SPI 和 I2C,先来简单了解一下这三种串行总线。
在这个 I2C 实例中,为了实现两个器件的通信,我们需要一个主机和一个从机,如下图 2 所示,它们之间采用 I2C 协议进行串行通信,设计实例中的 signal 模块和 EEPROM_WR 模 块模拟主机,EEPROM 模块模拟从机。当写入数据时,EEPROM_WR 模块从 signal 模块中调 取数据,然后通过 I2C 的两条总线 SDA(数据总线)和 SCL(时钟总线)向 EEPROM 器件写 入数据。当读出数据时,EEPROM_WR 仍然通过 SDA 和 SCL 总线读出 EEPROM 中的数据,然 后输入给 signal 模块,比较读出的数据与当时写入的数据是否相同。验证读写的正确性。 在至芯科技 EP2C8‐2010 开发板上,是有 EEPROM 器件的,而 signal 模块我们可以通 过创建一个 RAM 的 IP 核来实现其功能, 所以图 2 中唯有 EEPROM_WR 模块是要写入 FPGA
DATA[7:0] RESET CLK RD Signal WR

I2C总线完全版——I2C总线的结构工作时序与模拟编程

I2C总线完全版——I2C总线的结构工作时序与模拟编程

I2C总线完全版——I2C总线的结构工作时序与模拟编程I2C(Inter-Integrated Circuit)是一种常用的串行通信接口,用

于连接微控制器、传感器、存储器等各种模块。它具有简单、低成本、高

可靠性等优点,被广泛应用于各种领域。本文将详细介绍I2C总线的结构、工作时序和模拟编程。

一、I2C总线的结构

在I2C总线结构中,还包括两类设备:主设备(Microcontroller)

和从设备(Slave Device)。主设备一般是微控制器或者芯片,负责控制

整个通信过程;从设备则是各种模块,如传感器、存储器等,被主设备控

制和访问。

二、I2C总线的工作时序

1. 开始条件(Start Condition):开始条件由主设备产生,即下降

沿信号。在开始条件下,SCL保持高电平,SDA从高电平跳变到低电平。

这个跳变信号标志着通信的开始。

2. 数据传输(Data Transfer):在数据传输过程中,主设备发出读

/写命令、地址和数据等,从设备则进行应答。

-读操作:主设备发出读命令和从设备地址,之后由从设备产生应答

信号。主设备继续读取数据,每读取一个字节,都需要由主设备发出应答

信号来确认继续传输。

-写操作:主设备发出写命令和从设备地址,之后由从设备产生应答

信号。主设备将数据发送给从设备,然后继续发送下一个数据。

3. 结束条件(Stop Condition):结束条件也由主设备产生,即上升沿信号。在结束条件下,SDA从低电平跳变到高电平,表示数据传输结束。

三、I2C总线的模拟编程

在控制器编程中,可以通过软件模拟I2C总线的通信过程,实现与从设备的数据交换。

i2c协议的使用流程

i2c协议的使用流程

i2c协议的使用流程

协议书/合同/计划书i2c协议的使用流程

一、引言

本协议书旨在详细阐述i2c协议的使用流程,以确保各方对i2c 协议的实施有清晰的理解和统一的执行标准。

二、定义

1. i2c协议:一种用于连接低速外围设备的串行通信协议,由飞利浦半导体公司(现恩智浦半导体)开发。

2. 主设备:发起通信并控制数据传输的设备。

3. 从设备:响应主设备请求并执行相应操作的设备。

三、使用流程

1. 初始化

a. 主设备通过发送起始信号(S)来初始化通信。

b. 主设备发送从设备地址,以选择需要通信的从设备。

2. 数据传输

a. 主设备发送数据至从设备,或从从设备读取数据。

b. 数据传输以字节为单位,每个字节后跟随一个应答位(A)。

3. 停止通信

a. 主设备发送停止信号(P)以结束通信。

四、协议规则

1. 数据格式

a. 数据传输采用8位数据格式,最高位先发送。

b. 每个字节后需跟一个应答位,以确认数据传输的成功。

2. 地址规则

a. 从设备地址由7位组成,最高位为读写位(R/W),用于指示数据传输方向。

b. 地址0x00保留,用于广播地址。

3. 传输速率

a. i2c协议支持多种传输速率,最高可达400kHz(快速模式)。

五、违约责任

1. 如一方未遵守本协议的规定,导致通信失败或数据错误,应承担相应的责任。

2. 双方应积极合作,解决通信过程中出现的问题。

六、协议生效与终止

1. 本协议自双方签字盖章之日起生效。

七、争议解决

1. 对于本协议的解释和执行产生的任何争议,双方应通过友好协商解决。

2. 如协商不成,任何一方均有权将争议提交至有管辖权的人民法院诉讼解决。

i2c协议标准

i2c协议标准

i2c协议标准

I2C协议标准是PHILIPS公司于1992年提出的一种通信协议。

I2C协议是一种双向、同步、串行、半双工通信协议,它需要两条总线线路,一条串行数据线(SDA)和一条串行时钟线(SCL)。

I2C协议的基本特征:

1.I2C总线每个连接到总线的器件都可以通过唯一的地址和一直存

在的简单的主机/从机关系软件设定地址。

2.I2C总线在通信时总线上发送数据的器件为发送器,接收数据的器

件为接收器。

3.I2C总线具备冲突检测和仲裁的功能来防止错误产生。

I2C总线-DDC传输协议-显示器EDID结构介绍

I2C总线-DDC传输协议-显示器EDID结构介绍

EDID数据交换是显示器与信号源设备通讯说明自身性能的一种标准化方法。这种通讯是为了使显示器可以发送自身的性能特征——比如原始分辨率——到信号源设备,使这个设备生成适合于显示器要求的视频特性。用户不需要手动调节,就能最大限度地提升设备之间的兼容性,从而减少了因为不正确的设置和调整对显示图像和系统的整体可靠性所造成的影响。

一般来说,信号源设备可能是一台桌面计算机或笔记本电脑的显卡,但是现在又多了许多不同的设备,包括高清电视接收机和数字录像机、DVD和蓝光播放器,甚至还有游戏机,这就需要读取EDID并输出相应的视频。EDID最初是为了计算机模拟视频设备上的VGA接口而开发的,现在能够用于DVI、HDMI 和DisplayPort。

历史

EDID是由VESA——视频电子标准协会定义的,并在1994年和DDC标准1.0版一起推出了1.0版本。如表1。

在EDID开发之前,VGA接口的针脚4、11、12和15有时被用于定义显示器的性能。这些ID针脚带有高的或低的值用于定义不同的屏幕分辨率。VESA 通过重新定义VGA接口的针脚9、12和15,以DDC——显示数据通道的形式作为一个系列母线,扩展了这一体系。这使更多的信息得以交换,因此显示器和信号源之间能够以EDID或其他的形式进行交流。

原始的DDC协议定义了从显示器发送到视频信号源的128个字节的EDID 格式的数据。

由于显示类型和功能的不断增加,128个字节变得捉襟见肘起来,EDID和DDC都进行了扩展,因此多重128字节的数据块可以进行交换。这就是在众多消费品上所用到的E-EDID。实际上,CEA——美国消费电子产品协会以及国内定义了自己的EDID扩展包来包含额外的视频格式并支持先进的多声道音频功能。

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THE I 2C-BUS SPECIFICATION

VERSION 2.1

JANUARY 2000

CONTENTS

1PREFACE. . . . . . . . . . . . . . . . . . . . . . . . . . .3 1.1Version 1.0 - 1992. . . . . . . . . . . . . . . . . . . . 3 1.2Version 2.0 - 198. . . . . . . . . . . . . . . . . . . . . 3 1.3Version 2.1 - 1999. . . . . . . . . . . . . . . . . . . . 3 1.4Purchase of Philips I2C-bus components . . 3 2THE I2C-BUS BENEFITS DESIGNERS

AND MANUFACTURERS. . . . . . . . . . . . . . .4 2.1Designer benefits . . . . . . . . . . . . . . . . . . . . 4 2.2Manufacturer benefits. . . . . . . . . . . . . . . . . 6 3INTRODUCTION TO THE I2C-BUS

SPECIFICATION . . . . . . . . . . . . . . . . . . . . .6 4THE I2C-BUS CONCEPT . . . . . . . . . . . . . . .6 5GENERAL CHARACTERISTICS . . . . . . . . .8 6BIT TRANSFER . . . . . . . . . . . . . . . . . . . . . .8 6.1Data validity . . . . . . . . . . . . . . . . . . . . . . . . 8 6.2START and STOP conditions. . . . . . . . . . . 9 7TRANSFERRING DATA. . . . . . . . . . . . . . .10 7.1Byte format . . . . . . . . . . . . . . . . . . . . . . . . 10 7.2Acknowledge. . . . . . . . . . . . . . . . . . . . . . . 10 8ARBITRATION AND CLOCK

GENERATION . . . . . . . . . . . . . . . . . . . . . .11 8.1Synchronization . . . . . . . . . . . . . . . . . . . . 11 8.2Arbitration . . . . . . . . . . . . . . . . . . . . . . . . . 12 8.3Use of the clock synchronizing

mechanism as a handshake. . . . . . . . . . . 13 9FORMATS WITH 7-BIT ADDRESSES. . . .13 107-BIT ADDRESSING . . . . . . . . . . . . . . . . .15 10.1Definition of bits in the first byte . . . . . . . . 15 10.1.1General call address. . . . . . . . . . . . . . . . . 16 10.1.2START byte . . . . . . . . . . . . . . . . . . . . . . . 17 10.1.3CBUS compatibility. . . . . . . . . . . . . . . . . . 18 11EXTENSIONS TO THE STANDARD-

MODE I2C-BUS SPECIFICATION . . . . . . .19 12FAST-MODE. . . . . . . . . . . . . . . . . . . . . . . .19 13Hs-MODE . . . . . . . . . . . . . . . . . . . . . . . . . .20 13.1High speed transfer. . . . . . . . . . . . . . . . . . 20 13.2Serial data transfer format in Hs-mode. . . 21 13.3Switching from F/S- to Hs-mode and

back . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2313.4Hs-mode devices at lower speed modes. . 24 13.5Mixed speed modes on one serial bus

system. . . . . . . . . . . . . . . . . . . . . . . . . . . . 24 13.5.1F/S-mode transfer in a mixed-speed bus

system. . . . . . . . . . . . . . . . . . . . . . . . . . . . 25 13.5.2Hs-mode transfer in a mixed-speed bus

system. . . . . . . . . . . . . . . . . . . . . . . . . . . . 25 13.5.3Timing requirements for the bridge in a

mixed-speed bus system. . . . . . . . . . . . . . 27 1410-BIT ADDRESSING. . . . . . . . . . . . . . . . 27 14.1Definition of bits in the first two bytes. . . . . 27 14.2Formats with 10-bit addresses. . . . . . . . . . 27 14.3General call address and start byte with

10-bit addressing. . . . . . . . . . . . . . . . . . . . 30 15ELECTRICAL SPECIFICATIONS

AND TIMING FOR I/O STAGES

AND BUS LINES. . . . . . . . . . . . . . . . . . . . 30 15.1Standard- and Fast-mode devices. . . . . . . 30 15.2Hs-mode devices. . . . . . . . . . . . . . . . . . . . 34 16ELECTRICAL CONNECTIONS OF

I2C-BUS DEVICES TO THE BUS LINES . 37 16.1Maximum and minimum values of

resistors R p and R s for Standard-mode

I2C-bus devices . . . . . . . . . . . . . . . . . . . . . 39 17APPLICATION INFORMATION. . . . . . . . . 41 17.1Slope-controlled output stages of

Fast-mode I2C-bus devices. . . . . . . . . . . . 41 17.2Switched pull-up circuit for Fast-mode

I2C-bus devices . . . . . . . . . . . . . . . . . . . . . 41 17.3Wiring pattern of the bus lines. . . . . . . . . . 42 17.4Maximum and minimum values of

resistors R p and R s for Fast-mode

I2C-bus devices . . . . . . . . . . . . . . . . . . . . . 42 17.5Maximum and minimum values of

resistors R p and R s for Hs-mode

I2C-bus devices . . . . . . . . . . . . . . . . . . . . . 42 18BI-DIRECTIONAL LEVEL SHIFTER

FOR F/S-MODE I2C-BUS SYSTEMS . . . . 42 18.1Connecting devices with different

logic levels. . . . . . . . . . . . . . . . . . . . . . . . . 43 18.1.1Operation of the level shifter . . . . . . . . . . . 44 19DEVELOPMENT TOOLS AVAILABLE

FROM PHILIPS. . . . . . . . . . . . . . . . . . . . . 45 20SUPPORT LITERATURE . . . . . . . . . . . . . 46

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