基于WEB的嵌入式视频采集压缩瘦身服务器的设计

PC2
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2、系统实现的功能
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2. 嵌入式视频采集压缩系统实现的功能
1) 支持PAL/NTSC合成视频的捕捉和采集，可以接受CCD摄像头输出的模拟视频信号，将其 采样量化为复合CCIR.601标准的数字视频信号 2) 能够对数字视频数据进行压缩和编码处理，具体采用的多媒体压缩标准可以H.263 、MJPEG MJPEG2000、 MPEG1、MPEG2等 3) 带有音频扩展接口，可以很方便的构成音频视频同步的网络视频监控系统，Audio/Video流的 复合，完全实现音视频同步 4) 视频亮度﹑对比度﹑饱和度﹑色度﹑灰度可调等 5）监控系统可对镜头进行光圈、焦距、景深距离的控制操作对云台可做全方位控制，系统可以对 云台的上下左右的转动以及配套的云台护罩的相应设备进行全方位的控制 6）通过局域网或者因特网和提供在线监控，可以在远程工作站查看，通过局域网或者因特网和实 现远程摇摄/倾斜/放缩
嵌入式微处理器模块
硬件系统
软件系统
DSP 接 口 控 制 模 块
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以 太 网 控 制 模 块
存 储 模 块
微 处 理 器 模 块
BOOT 启动 代码
uClinux 操作系统 代码
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3.4 系统的主要模块
视频采集模块：
该模块的主要功能是将从CCD摄像头输入的模拟视频信号转换为数字信号。普通CCD 摄像头的输出是 NTSC制式(或PAL 制式)的复合全电视信号CVBS 或是S-Video信号，二者 均为模拟信号。通过PHILIPS 公司的TV 解码芯片SAA7114H将模拟TV 信号解码并且模数 转换为符合CCIR.601标准的数字视频信号，并且存储到专用的视频FIFO芯片AL440B中， 等待DSP处理。 CPLD通过SAA7114H的输出状态信号以及C6202B DSP的相应输出控制信号生成FIFO AL440B 的控制信号。通过检测SAA7114H 输出的同步信号来生成 DSP 中断，通知 DSP 读 取视频FIFO中已满的一场图像数据。
F_WCK F_RCK
CCD 摄像头
CVBS S-Video
视频A/D SAA7114H
VPO BUS
AL440B FIFO
EMIF
TMS320C6202B DSP
RE
WRST RRST
IDQ IGPH IGPV IGP1 GIO1 RTS1
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EPM7128S CPLD
WE
INT0 INT1 nCE2
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3.4 系统的主要模块
ED[15:0]
8M×8bit 150MHz SDRAM 块1 CE0
TMS320C6202B DSP
ED[31:0]
ED[31:16]
LVTH162245
8M×8bit 150MHz SDRAM 块2 CE0
LSD[15:0]
4Mbits 80MHz FIFO 段1 CE2
EPM7128s CPLD SDRAM
音频A/ D、D/A
耳机、麦克风
FLASH
嵌入式操作系统 芯片 ARM-S3C4510
FLASH
SDRAM
网卡芯 片
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3.3.系统实现的创新性
（1）采用独立的双处理器的结构，一个处理器用于视频的压缩，一个处理器用于运行操作系统 实现控制功能，实现DSP的强大运算功能与嵌入式微处理器的强大控制功能相结合。 （2）操作系统uClinux内核嵌入到微处理器中，这种嵌入式操作系统内核源代码是公开的，易于 在此基础上进行开发，同时uClinux操作系统本身带有完整的网络协议栈，无需开发者移植网 络协议。 （3）独立的双处理器通信中采用DSP的扩展总线xBUS，这样可以充分利用DSP的双总线结构， 尽量减少总线带宽的冲突。 （4）压缩算法上使用了国际上最新的Motion－JPEG2000的压缩算法。 （5）对摄像头现场控制也可以通过网络进行远程控制。
nRE
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3.4 系统的主要模块 主处理器模块
模块主要是由TMS320C6202B DSP芯片，以及时钟电路等DSP外围器件 构成。DSP运行的内部时钟是264MHz，外部的SDRAM运行在132MHz 时钟。 主要实现的功能： 完成对视频AD模块输出的数字视频流的压缩编码 完成对整个硬件系统各模块的控制功能，实现数字视频流的传输控制 通过C6202B DSP的xBUS总线将压缩后的视频流传送到微控制器上 通过C6202B DSP的McBSP1模拟I2C总线，对视频AD芯片SAA7114H进 行初始化，对视频FIFO通过模拟I2C总线进行配置。 对于需要进行语音处理的，完成相应的语音压缩编码的功能。
基于WEB的嵌入式视频采集压 缩瘦身服务器的设计
西安交通大学信号与信息处理研究所 报告人：王黎明
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概述
1.系统的开发背景
2.系统实现的主要功能
3.系统实现具体方案
4.主要使用的技术
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1、系统的开发背景
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嵌入式视频采集压缩系统
因此本系统就是将两者结合起来，共同实现一个任务。
DSP总线扩展 串口 32位嵌入式 微处理器 以太网接口 扩展存储器 共享存储器 双口SRAM 高速DSP处理 和编码 ADC转换
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1.嵌入式视频采集压缩系统 开发背景（2）
（2）视频实时性要求进行硬压缩以及要求可以实现几种压缩标准
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3.4 系统的主要模块 以太网控制模块
因为S3C4510B微控制器本身内置的以太网控制器，因此在硬件的 设计上只需用实现物理层的一些协议要求。如电平转换，隔离滤波等。
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3.4 系统的主要模块
C6202B DSP与S3C4510B接口模块
DSP与微控制器的接口是通过C6202B的扩展总线xBUS实现的。这样做的优点 是充分利用DSP的带宽资源，减少总线上的冲突，减轻EMIF总线压力。 接口DSP采用异步从模式，即DSP（slave），S3C4510B（master） DSP为高速器件，S3C4510B为低速器件，况且DSP工作在从模式下，这样就无 需加入共享存储器模块，节省了开发的成本，同时也降低了开发的难度。
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1.嵌入式视频采集压缩系统 开发背景（4）
本系统将运行嵌入式操作系统的32位微处理器系统与数字信号处理器相 结合，构成一个基于视频采集压缩系统的瘦身WEB服务器。
远程监控 Internet PC4 PC1 以太网内 部监控
基于web的嵌入式视频 采集压缩瘦身服务器 PC3
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3.4系统的主要模块
DSP处理器模块
视频DSP压缩模块
硬件系统
软件系统
电 源 模 块
音 频 模 块
存 储 器 模 块
视 频 采 集 模 块
主 处 理 器 模 块
硬件 驱动 模块
视频 编码 子系 统
控制 子系 统
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3.4 系统的主要模块
嵌入式微处理器模块
开发背景
嵌入式32位微控制器系统与高性能数字信号处理器相结合 视频实时性要求进行硬压缩以及要求可以实现几种压缩标准 未来智能化网络化的需要
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1.嵌入式视频采集压缩系统 开发背景（1）
（1）运行嵌入式操作系统的32位微控制器系统与数字信号处理器相结合
数字信号处理（DSP）芯片技术发展很快，因其强大的计算能力广泛应用于通信、控 制、信号分析等领域。但作为一种专用处理器，通常不能完成一些通用微处理器完成的工 作，也就不能有效地支持各种网络协议如TCP/IP或者UDP/IP。 而运行嵌入式操作系统的32位微控制器系统能够有效支持各种网络协议，但是在处理 一些运算量较大的任务（如语音和图像信号的压缩和解压缩、数据通信中的加解密算法等） 有时就不能够胜任。
LSD[7:0]
LSD[15：8]
4Mbits 80MHz FIFO 段2 CE2 512Kbyte FLASH CE1
LSD[7:0]
EMIF数据总线技术
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3.4 系统的主要模块
TMS320C6202B DSP EA[21:2] EA[14:2] SDA[15..2]
SDRAM 块1 CE0 SDRAM 块2 CE0
ALB16244
EA[18:2]
FA[16:0] 512Kbyte
FLASH CE1
ALB16244
EMIF地址总线技术
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ห้องสมุดไป่ตู้
3.4 系统的主要模块
音频模块
系统的音频模块主要是以一块语音AD/DA芯片TLC320AD50C以及与之配 套的模拟音频输入输出电路构成。TLC320AD50C芯片最高采样率到 22.05KHz，可以满足绝大多数语音应用的要求。该芯片的数字音频输入输出 接口采用SPI模式，直接和C6202B DSP的McBSP0无缝连接。
SCLK FS CLKS0 FSR0 FSX0
AD50
DOUT DIN DR0 DX0
C6202B DSP
McBSP0
系统中AD50采用主模式方式，而DSP的McBSP接口采用从模式形式，SPI总 线通信中所需要的时钟CLK和分帧信号FS均由AD50产生并输入到DSP。
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8） 系统留有进一步完善和二次开发的余地，具有良好的软硬件接口，可以方便的集成到其它 视频处理之中
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3. 系统的实现方案
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3. 嵌入式视频采集压缩系统的实现方案
1）系统总体实现方案
2）系统总体实现框图
3）系统实现的创新性 4）系统实现的主要模块 5）系统的软件模块
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3.1. 系统的总体实现方案
本用于视频会议或者监控的嵌入式视频压缩卡系统是以SAMSUNG公司的嵌 入式ARM-S3C4510B芯片技术和TI公司的高性能C62x系列定点DSP芯片技术为 基础，以太网络（Ethernet）接口结构的嵌入式视频图像采集压缩系统，其主要 功能是将由CCD摄像头获得的模拟视频信号经A/D转换为数字视频信号后，视频 信号通过高速DSP压缩成各种符合不同压缩标准的数据码流。视频压缩后的数据 流由嵌入式微控制芯片ARM-S3C4510B通过DSP的扩展总线xBUS读出，通过嵌 入式操作系统的UDP/IP协议栈，将数据打包，并运行web服务器，等待客户服务 端通过网络访问数据流。
3.4 系统的主要模块
电源模块
DSP的电源采用两种电压供电，DSP对这两种电压有上电顺序的要求，要求内核 电源（CVdd ）先于I/O电源（DVdd）上电。考虑到DSP的功耗问题，采用TI公司的 电源模块TPS56300对DSP分别供电。 为了保证C6202B芯片在电源低于要求的电平时会产生失控状态，在系统中加入 了电源监控电路。该电路能确保DSP在系统加电过程中及电源电压低于一定门限值时 始终处于复位状态。电源监控电路采用 TI公司的TPS3707-33，同时它还可接手工复 位开关以便人工控制。 考虑到因为整个系统的器件比较多，功耗可能比较大，因此使用了一片LM1117 为系统提供3.3V的备用电源。 整个系统的电源为： 模拟 3.3v，5.0V 数字 1.5v，3.3v，5.0v
从而实现一个基于web的嵌入式视频压缩瘦身服务器。
DSP（SLAVE mode） ARM（MASTER mode）
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3.2. 系统总体实现框图
CCD 摄像头 McBSP1 TMS3206202B EMIF DSP McBSP0
FIFO
SAA7114H
CCD接口
xBUS
Local Bus
•
• •
当前PC机通用CPU的处理能力和操作系统的结构，压缩实时性不高
硬件的实时压缩是专用芯片。对于用户很难能进行二次开发。 通用DSP作为编解码芯片的视频压缩具有较强的扩展性和二次开发能力
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1.嵌入式视频采集压缩系统 开发背景（3）
（3）未来网络化的需要
Internet和Intranet已经渗透到社会生活的每个角落，当一台设备具有网络 智能时，人们可以在任何地方、任何时间、任何地点、使用任何平台随时浏览实 时的状态，并在远程实现对这台设备的监视、控制、诊断、测试和配置。 预计在不远的未来，每个设备中都将有一个IP地址，每个设备都具有远程维 护功能并都能从Internet获取智能控制。也就是嵌入式操作系统设备作为网络服 务器，拥有自己的IP地址，所面向的设备作为客户机。