JK触发器的功能分析 PPT
《电工电子技术》课件——触发器
01
02
TTL 维持阻塞 D 触发器（通 常上升沿触发）
TTL 边沿 JK 触发器（通常 下降沿触发）
03
CMOS 边沿 D 触发器和边沿 JK 触发器（通 常上升沿触发）
（二） 边沿 JK 触发器
CP 触发的边沿 JK 触发器 具有异步端的边沿 JK 触发器
可知，边沿 JK 触发器的特性方程：Q n1 JQ n KQ n
特性表：触发器次态与输入信号和电路原有状态之间关系。
次态：触发器在输 入信号变化后的状 态，用 Qn+1 表示。
现态：触发器在输 入信号变化前的状 态，用 Qn 表示。
RD SD Qn Qn+1 000×
001×
说明 状态不定
010 0
011 0
置0
100 1
101 1
置1
110 0 1 1 1 1 保持原状态不变
边沿触发器小结：
4. 边沿触发器的逻辑功能和特性方程与同步触发器 的相同，但由于触发方式不一样，因此，它们的逻 辑功能和特性方程成立的时间不同。边沿触发器的 逻辑功能和特性方程只在时钟的上升沿（或下降沿） 成立。
Qn+1 0
1 0 ××
1
0 0 × × 不定态
1 1 0×
Qn
1 1 1×
Qn
11↑0
0
11↑1
1
可得， D 触发器的特性方程：Qn＋1＝D
说明 异步置 0 异步置 1 禁用
保持
CP 时 Qn+1 = D
例：设触发器初态为 0 ，试对应输入波形画出 Q1、Q2 的波形。
D
1D
CP
C1
(a)
S
CP
JK触发器的应用设计PPT教学课件
1 0 × × ×× 1 0
1 1 × × ××
00
× ×0 0 1
00
× ×1 1 0
00
000 01
00
001 10
00
010 01
00
011 01
00
100 10
00
101 10
00
ห้องสมุดไป่ตู้
110 10
00
1 1 1 0 31
三、实验内容：
1、 按JK触发器逻辑功能表验证JK 触发器的逻辑功能
JK触发器特性方程和功能表
电路图
波形
+5V(“1”)
CP
0
Q1
0
J1 SD Q1
CP
JK1
SD
J2
Q2
Q2
JK2
Q1
K1 RD Q1
K2 RD Q2
0
0
Q2
2020/12/10
5
四、注意事项：
1、VDD接电源正极，VSS接电源负极（通常接地）， 电源绝对不允许接反。实验一般要求为+5V电源。 2、所有输入端一律不准悬空。 3、不使用的输入端应按逻辑要求直接接VDD或VSS， 在工作速度不高的电路中，允许输入端并联使用。 4、输出端不允许直接与VDD或VSS连接，不允许两个 器件输出端连接使用。 5、示波器观察多个波形时，注意选用频率最低的电 压作触发电压。
实验四 JK触发器的应用设计
2020/12/10
1
一、实验目的
• 熟悉并验证触发器的逻辑功能及相互转换的方 法 • 掌握集成JK触发器逻辑功能的测试方法 • 学习用JK触发器构成简单时序逻辑电路的方法 • 进一步熟悉用双踪示波器测量多个波形的方法
jk触发器的工作原理及工作过程
jk触发器的工作原理及工作过程
JK触发器是数字电路中的一种基本触发器，由两个交叉耦合
的门电路组成。
它们的工作原理和工作过程如下：
工作原理：
1. J (Set) 输入信号：当J输入为高电平时，会将Q输出置为高
电平。
2. K (Reset) 输入信号：当K输入为高电平时，会将Q输出置
为低电平。
3. Q 输出信号：JK触发器的输出Q与输入J、K信号以及时
钟信号有关。
4. 时钟信号：时钟信号用于控制JK触发器的工作。
在上升沿
或下降沿（取决于电路的设计）时，JK触发器根据输入信号
的状态更新输出。
工作过程：
1. 初始状态：JK触发器的初始状态由上电时输入信号的状态
确定。
当J=K=0时，Q为先前状态的保持，即保持原来的值。
2. J=1，K=0：当J为高电平而K为低电平时，触发器会被置
入Set状态，即Q被置为高电平。
3. J=0，K=1：当J为低电平而K为高电平时，触发器会被置
入Reset状态，即Q被置为低电平。
4. J=1，K=1：当J和K均为高电平时，触发器处于反转状态。
当时钟信号的边沿到来时，Q的状态将发生改变，即Q的原
始值被翻转。
5. J=0，K=0：当J和K均为低电平时，触发器继续保持前一
个状态，即Q的值不变。
6. 更新输出：无论何时发生状态的改变，输出Q都会立即更新为新的状态。
总结起来，JK触发器根据输入信号和时钟信号的组合，可以实现保持状态、置高状态、置低状态和翻转状态四种操作。
它是许多复杂数字系统以及时序逻辑电路的重要组成部分。
JK触发器ppt课件
J＝ × K＝ 0
3
表4.4 状态表
CP
JK
Qn+1
功能
1
00
Qn
保持
1
01
0
置0
1
10
1
置1
1
11
Qn 翻转（计数）
从表4.4中可知:
(1) 当J=0，K=1时，Qn+1= JQn KQn ， 置“0”。
(2) 当J=1， K=0时, Qn+1= JQn KQn ， 置“1”。
Uc1( R)
x 0
1 1
Uc2(S )
x 1
0 1
Q(U0)
0
00 1 11 0 1 保持 1
22
◆ 施密特触发器的用途
（a）波形变换
（c）脉冲幅度鉴别
（b）整形
23
（2）555定时器构成多谐振荡器
接入电阻R1、R2及 电容C便构成多谐振荡 器。
24
（3）555定时器构成单稳态触发器
◆ 电路
4.2.3基本JK触发器电路结构与动作特点
1.同步 JK
同步JK触发器的电路组成如图4.8所示。
Q
Q
&
&
SD
R
S
&
&
Q
Q
RD
SD
CP
K
CP
J
(a)
K
J
(b)
图4.8 同步JK （a） 逻辑电路; （b） 逻辑符号
1
2. 按图4.8(a)的逻辑电路，同步JK触发器的功能分析
当CP=0时，R=S=1，Qn+1=Qn触发器的状态保持不变。
JK触发器
J-K触发器J-K触发器电路图边沿JK 触发器边沿型JK触发器的状态转移真值表、特征方程、状态转移图及激励表与主从JK触发器完全一致，只不过在画工作波形图时，不用考虑一次变化现象。
采用与或非电路结构，属于下降沿触发的边沿JK触发器。
工作原理1.CP=0时，触发器处于一个稳态。
CP为0时，G3、G4被封锁，不论J、K 为何种状态，Q3、Q4均为1，另一方面,G12、G22也被CP封锁,因而由与或非门组成的触发器处于一个稳定状态，使输出Q、Q状态不变。
2.CP由0变1时，触发器不翻转，为接收输入信号作准备。
设触发器原状态为Q=0，Q=1。
当CP由0变1时，有两个信号通道影响触发器的输出状态，一个是G12和G22打开，直接影响触发器的输出，另一个是G4和G3打开，再经G13和G23影响触发器的状态。
前一个通道只经一级与门，而后一个通道则要经一级与非门和一级与门，显然CP的跳变经前者影响输出比经后者要快得多。
在CP由0变1时，G22的输出首先由0变1，这时无论G23为何种状态（即无论J、K为何状态），都使Q仍为0。
由于Q同时连接G12和G13的输入端，因此它们的输出均为0，使G11的输出Q=1，触发器的状态不变。
CP由0变1后，打开G3和G4，为接收输入信号J、K作好准备。
3.CP 由1变0时触发器翻转设输入信号J=1、K=0，则Q3=0、Q4=1，G13和G23的输出均为0。
当CP 下降沿到来时,G22的输出由1变0,则有Q=1，使G13输出为1，Q=0，触发器翻转。
虽然CP变0后，G3、G4、G12和G22封锁，Q3=Q4=1，但由于与非门的延迟时间比与门长（在制造工艺上予以保证）,因此Q3和Q4这一新状态的稳定是在触发器翻转之后。
由此可知,该触发器在CP下降沿触发翻转，CP一旦到0电平，则将触发器封锁，处于(1)所分析的情况。
总之，该触发器在CP下降沿前接受信息，在下降沿触发翻转，在下降沿后触发器被封锁。
JK触发器原理
J K触发器原理Last revision on 21 December 2020JK触发器原理JK触发器原理JK触发器是一种功能较完善，应用很广泛的双稳态触发器。
图9-5(a)所示是一种典型结构的JK触发器——主从型JK触发器。
它由两个可控RS触发器串联组成，分别称为主触发器和从触发器。
J和K是信号输入端。
时钟CP控制主触发器和从触发器的翻转。
(a)逻辑图 (b)逻辑符号图9-5 主从JK触发器当CP=0时，主触发器状态不变，从触发器输出状态与主触发器的输出状态相同。
S当CP=1时，输入J、K影响主触发器，而从触发器状态不变。
当CP从1变成0时，主触发器的状态传送到从触发器，即主从触发器是在CP下降沿到来时才使触发器翻转的。
下面分四种情况来分析主从型JK触发器的逻辑功能。
(1) J= l，K= l设时钟脉冲到来之前(CP=0)触发器的初始状态为0。
这时主触发器的R=K=0，S=J=1，时钟脉冲到来后(CP=l)，主触发器翻转成1态。
当CP从1下跳为0时，主触发器状态不变，从触发器的R=0，S=1，它也翻转成1态。
反之，设触发器的初始状态为1。
可以同样分析，主、从触发器都翻转成0态。
可见，JK触发器在J=1，K=1的情况下，来一个时钟脉冲就翻转一次，即=,具有计数功能。
(2) J=0，K=0设触发器的初始状态为0，当CP=1时，由于主触发器的R=0，S=0，它的状态保持不变。
当CP下跳时，由于从触发器的R=1，S=0，它的输出为0态，即触发器保持0态不变。
如果初始状态为1，触发器亦保持1态不变。
(3) J=1，K=0设触发器的初始状态为0。
当CP=l时，由于主触发器的R=0，S=1，它翻转成1态。
当CP下跳时，由于从触发器的R=0，S=1。
也翻转成1态。
如果触发器的初始状态为1，当CP=1时，由于主触发器的R=0，S=0，它保持原态不变；在CP从1下跳为0时，由于从触发器的R=0，S=1，也保持1态。
主从JK触发器图文.ppt
公用时钟
USC 4Q 4Q 4D 3D 3Q 3Q 时钟
CLR
CP D
CP D CLR
Q
Q
Q
Q
CLR
D CP
D CP CLR
Q
Q
清零 1Q 1Q 1D 2D 2Q 2Q GND
公用清零
74LS175管脚图
+5V
74LS175
0
D1
Q1
Q1
D2
Q2
D3
Q2 Q3
D4
Q3 Q4
CLR CP Q 4
12.7.3 JK触发器
一、 同步JK触发器 二、 主从JK触发器
二、 主从JK触发器
Q
Q
1. 电路与符号
G1 &
G3 & Q’ G5 &
& G2
从 & G4
Q’ & G6
1 G9
Q
Q
Q
Q
J CP K
G7 &
主 & G8
J
K
CP
J CP K 曾用符号
Q
Q
1J C1 1K
J CP K 国标符号
2. 动作特点
主从T触发器逻辑符号
T触发器的逻辑功能： T 0 保持，T 1 翻转
12.7.４ Ｄ触发器
一、 同步Ｄ触发器 二、 边沿Ｄ触发器
二、 边沿Ｄ触发器
维持—阻塞边沿D触发器
Q
Q
G1 &
& G2
Q
Q3
4
&
G3 L2 G4 &
L3
Q5
Q6
L1 CP
触发器教学课件PPT
8.2.1 JK触发器的电路组成和逻辑功能
二、逻辑功能 在CP=1期间： （（（4312）））翻置保转10持功功功功能能能能 当当当当JJJ=1K0、 1=、、0KK时K，01G13时时、时，，G，GG433与与3与与非非非非门门门门的的的的输输输输出出出出SSSS1Q，1Q、、R、GGG4414，门门门触的的的输，
端。
8.1.1 基本RS触发器
2. 当 = 0， =0时，具有置1功能 由于 =0，无论触发器现态为0态还是1态，与非门输出为1，使 =1；
而 门的两个输入端均为1， 与非门输出为0，使 =0，即触发器完成 置1。 端称为触发器的置1端或置位端。
3. 当 = 1， =1时，具有保持功能 若触发器原为0态，即 =0 =1， 门的两个输入均为1，
在CP=1期间，G3、G4 控制门开门，触发器输出状态由输入端R、S信 号决定，R、S输入高电平有效。触发器具有置0、置1、保持的逻辑功能。
真值表如下表所示
了解JK触发器的电路组成，熟悉JK触发器的电路图形符号; 掌握JK触发器的逻辑功能，能根据输入波形正确画出输出波形; 能识读集成JK触发器的引脚，会使用JK触发器。
C
P = 0 期 间
8.2.2 集成边沿JK触发器
一、边沿触发方式 利用CP脉冲上升沿触发的称为上升沿触发器，利用CP脉冲下降沿触发 的称为下降沿触发器。逻辑符号中下降沿触发器除了用“>”符号外，还在 CP引脚标注小圆圈。
如图所示。
8.2.2 集成边沿JK触发器
二、集成JK触发器
1.引脚排列和逻辑符号 如 图 所 示 为 7
RS 触发器，它有两个输入端 R、S ，字母上面的非号表示低电平有效， 即低电平时表示有输入信号、高电平时表示没有输入信号；Q、Q 是
jk触发器工作原理
jk触发器工作原理一、引言JK触发器是数字电路中最常用的触发器之一，它可以用于存储一个二进制位，也可以作为计数器或频率分频器的元件。
本文将详细介绍JK触发器的工作原理。
二、JK触发器的基本结构JK触发器由两个互补反馈型门电路组成。
其中，每个门电路都包括两个输入端和一个输出端。
由于门电路中存在反馈回路，因此它们可以实现状态存储功能。
三、JK触发器的输入输出JK触发器有两个输入端：J和K。
当J=1、K=0时，称为置“1”状态；当J=0、K=1时，称为置“0”状态；当J=1、K=1时，称为翻转状态；当J=0、K=0时，则保持原来的状态不变。
除了输入端外，JK触发器还有两个输出端：Q和Q’。
其中Q表示当前存储的状态值（即输出值），而Q’则表示与之相反的值（即补码）。
四、JK触发器的工作原理在初始情况下，假设Q=0，则Q’=1。
此时，在输入端J和K中分别加入高电平信号和低电平信号，则第一个门电路（记为A）输出高电平信号，第二个门电路（记为B）输出低电平信号。
因此，Q的状态被置为1，Q’的状态被置为0。
接着，在输入端K中加入高电平信号，则门电路B输出高电平信号，门电路A输出低电平信号。
此时，Q的状态被置为0，Q’的状态被置为1。
当再次在输入端J中加入高电平信号时，则门电路A又会输出高电平信号，而门电路B则会输出低电平信号。
因此，Q的状态又被置为1，Q’的状态又被置为0。
如果在输入端同时加入高电平信号，则两个门电路都会输出相反的结果。
这时候，由于反馈回路存在，JK触发器的状态就会翻转一次。
五、JK触发器的应用JK触发器可以用于计数器、频率分频器、移位寄存器等数字逻辑系统中。
例如，在计数器中，每个JK触发器都可以存储一个二进制位，并且每次计数时都会翻转一次其状态值。
这样，在多个JK触发器串联连接起来后就可以实现任意位数的二进制计数了。
六、总结综上所述，JK触发器是一种非常重要且常用的数字电路元件。
它的工作原理基于两个互补反馈型门电路，并且可以实现状态存储、计数、频率分频等功能。
主从JK触发器
一、 同步JK触发器 二、 主从JK触发器
二、 主从JK触发器
Q
Q
1. 电路与符号
G1 &
G3 & Q’ G5 &
& G2
从 & G4
Q’ & G6
1 G9
Q
Q
Q
Q
J CP K
G7 &
主 & G8
J
K
CP
J CP K 曾用符号
Q
Q
1J C1 1K
J CP K 国标符号
2. 动作特点
* 触发器的翻转分两步动作。第一步，在CP=1的期间主触发器 接受输入端的信号，被置成相应的状态，而从触发器保持；第 二步，CP下降沿到来时从触发器按照主触发器的状态变化，使 Q、 Q相应地改变状态。 * 因为主触发器本身是一个同步RS触发器，所以在CP=1的全 部时间里输入信号都将对主触发器起控制作用。 * 主从JK触发器有一次变化现象，即在CP=1期间， 主触发器 的状态只能变化一次。
电路分析
Q
0
G1 &
SD
1
1
G3 &
0
G5 &
1
G7 &
Q
1
& G2
& G4
1
& G6
0 RD
1 G9
SD
0
Q
1
G1 &
G3 &
1
G5 &
& G8
G7 &
Q
0
& G2
1
& G4
0
集成JK触发器74LS112(1)PPT课件
分析。
关键点
完整版PPT课件
8
说教材 说教法 说学法 说过程 说反思
教法
情境 教学法
引导探究式 教学法
完整版PPT课件
教法
9
学法
说教材 说教法 说学法 说过程 说反思
学法
完整版PPT课件
控制 变量法
角色 参与
10
说教材 说教法 说学法 说过程 说反思
教学准备
面包板 导线
元器件 实验单
完整版PPT课件
完整版PPT课件
13
了解说教法
说学法
说过程
说反思
完整版PPT课件
14
了解集成JK触发器74LS112
说教材
说一说
说教法
“74LS112”的含义
说学法 说过程 说反思
74——TTL 74系列 LS——低功耗肖特基系列 112——双下降沿JK触发器
完整版PPT课件
15
了解集成JK触发器74LS112
说教材
讲一讲 输入端与输出端
说教法
说学法
说过程 说反思
设计意图：意在让学生学会化整为零，掌 握化解学习难度的学习方法。
完整版PPT课件
16
探索集成JK触发器74LS112
说教材 说教法 说学法 说过程
一个JK触发器还有几个引脚？哪 些是输入端？哪些是输出端？
我们应该用什么样的方法去研究 输出与输入间的内在关联？
说教材 说教法 说学法 说过程 说反思
能力目标
知识目标
1、能说出集成JK 触发器74LS112中 “74LS112 ”的含 义。
2、能说出集成JK 触 发 器 74LS112 的 逻辑功能及应用。
JK触发器
1. 从主从RS触发器到主从JK触发器 （1）主从RS触发器有约束条件：RS=0 （2）利用两个输出端互补的特点，实现自我约束
主从RS触发器
S G8
&
G6
G4
G2
J
&
& Q
&
&
G10
Q
CP
G11
& Q
&
K
&
&
&
Q
R G7
G5
1
G1 G3
G9
主触发器
从触发器
逻辑符号
J
Q
CP
K
Q
1
主从JK触发器
2. JK 触发器的功能描述
（1） 功能表
J K Qn Qn+1 说 明
0 0
0 0
0 1
0
1
Q
n
状态不变
0 0
1 1
0 1
0 0
0
置0
1 1
0 0
0 1
1 1
置1
1
1 1
1 1
0 1
1 0
Qn
翻转
2) 状态转换真值表
Qn J K 000 001 010 011 100 101 110 111
Qn＋1 0 0 1 1 1 0 1 0
2
主从JK触发器
(3) 特性方程
JK Qn 00 01 11 10
00 0 1 1
11 0 0 1
JK 触发器次态卡诺图
4) 激励表
Qn Qn+1 J 00 0 01 1 10 X 11 X
机械电子工程：实验二(JK触发器及其应用设计)
JK触发器及其应用设计
一、实验目的
• 熟悉并验证触发器的逻辑功能及相互转换的方 法 • 掌握集成JK触发器逻辑功能的测试方法 • 学习用JK触发器构成简单时序逻辑电路的方法 • 进一步熟悉用双踪示波器测量多个波形的方法
二、实验元器件：
双JK触发器：4027 1片
VDD 16
2Q 15
2Q 14
2CP 13
2RD 12
2K 11
2J 10
2SD 9
CC4027功能表
输 入 现态 输出（次态）
CC4027
1 1Q 2 1Q 3 4 5 1K 6 1J 7 1SD 8 VSS
SD 0 1 1
RD 1 0 1
CP × × ×
J × × ×
K × × ×
Qn × × ×
Qn+1 Qn+1 0 1 1 1 0 1
1CP 1RD
0
0 0 0 0 0 0 0 0
0
0 0 0 0 0 0 0 0
×
× 0 0 0 0 1 1 1
×
× 0 0 1 1 0 0 1
0
1 0 1 0 1 0 1 0
0
1 0 1 0 0 1 1 1
1
0 1 0 1 1 0 0 0
0
01Biblioteka 1101
三、实验内容：
1、 验证JK 触发器的逻辑功能
思考题
1、如何将JK触发器转换成T触发器和D触发器？ 2、D触发器和JK触发器的逻辑功能和触发方式有 何不同？ 3、在本实验中，能用负方波代替时钟脉冲吗？为 什么？
JK触发器及其应用设计
二四分频电路图
+5V(“1”) 0 J1 SD Q1 Q1 J2 0 SD Q2 Q2 Q1 Q2
说明jk触发器的rd反、sd反端的功能
jk触发器是数字电路中的一种重要元件，它可以用来存储一个比特信息，还可以根据输入的信号进行逻辑状态转换。
在数字电路设计中，jk 触发器的rd反端和sd反端功能十分重要。
接下来，我将为大家介绍这两个端的功能，并解释它们在数字电路中的作用。
我们来看一下jk触发器的基本结构。
jk触发器由两个与非门和一个或门组成。
输入端分别为j、k，输出端分别为q、q反。
当j、k均为低电平时，q和q反的值不变；当j为高电平、k为低电平时，q为高电平，q反为低电平；当j为低电平、k为高电平时，q为低电平，q反为高电平；当j、k均为高电平时，q和q反的值取决于上一个状态。
接下来，我们分别介绍rd反端和sd反端的作用。
一、rd反端现在我们来介绍rd反端的功能。
rd反端是指当r和d都为高电平时，q输出为低电平。
这种设置是为了防止jk触发器进入禁止状态。
在数字电路中，禁止状态会导致输出的不确定性，因此需要通过设置rd反端来避免这种情况的发生。
rd反端的作用可以简单理解为“禁止输入”，当输入信号同时满足一定条件时，触发器将被禁止响应，以保证电路的稳定性和可靠性。
这样设计可以避免由于输入信号的干扰或错误导致不确定的输出结果，保证了数字电路的准确性和可靠性。
二、sd反端接下来我们来介绍sd反端的功能。
sd反端是指当s和d都为高电平时，q反输出为低电平。
这种设置是为了防止jk触发器进入复位状态。
在数字电路中，复位状态会导致输出的不确定性，因此需要通过设置sd反端来避免这种情况的发生。
sd反端的作用可以简单理解为“禁止复位”，当输入信号同时满足一定条件时，触发器将被禁止复位，以保证电路的稳定性和可靠性。
这样设计可以避免由于输入信号的干扰或错误导致不确定的输出结果，保证了数字电路的准确性和可靠性。
总结在数字电路中，jk触发器的rd反端和sd反端起着非常重要的作用。
它们分别用来防止触发器进入禁止状态和复位状态，保证了电路的稳定性和可靠性。
对于数字电路的设计和应用来说，合理设置rd反端和sd反端是至关重要的，可以有效避免因为输入信号的干扰或错误导致的不确定性和错误输出。
jk边沿触发器工作原理
jk边沿触发器工作原理小伙伴！今天咱们来唠唠JK边沿触发器这个超有趣的东西。
JK边沿触发器呢，就像是一个超级聪明又有点小脾气的小机灵鬼。
它呀，主要是用来处理数字信号的，在数字电路的世界里可是个相当重要的角色哦。
咱先从它的基本结构说起。
它是由一些逻辑门组成的，这些逻辑门就像是一群小伙伴，各自有着不同的任务，然后组合在一起就干出了大事。
这里面有与门、非门之类的逻辑门，它们相互连接，就构建起了JK边沿触发器这个独特的存在。
那它到底是怎么工作的呢？想象一下，JK触发器有两个输入，J和K，就像它的两只小耳朵，在时刻等着信号输入呢。
当有合适的时钟信号到来的时候，它就开始“行动”啦。
在时钟信号的边沿，也就是时钟信号从低电平变成高电平（上升沿）或者从高电平变成低电平（下降沿）的时候，JK触发器就像是被施了魔法一样开始工作。
如果J 输入是高电平，K输入是低电平，那这个触发器就会被置成高电平状态，就好像它听到了J的召唤，然后说“那我就变成高电平啦”。
反之，如果J是低电平，K是高电平，它就会被置成低电平状态，就像很听话地按照输入的指示来改变自己的状态。
你看，这个JK边沿触发器是不是很有趣呢？它在很多数字电路的应用里都发挥着巨大的作用。
比如说在计数器里，它就像是一个小管家，一个一个地数着脉冲信号，靠的就是它这种对输入信号和时钟信号的巧妙处理。
还有在寄存器里，它能够准确地存储数据，就像一个小盒子，按照时钟信号的节奏把数据好好地保存起来。
而且哦，它的这种边沿触发的特性让它在处理信号的时候非常精确。
不像有些电路可能会对信号的整个电平变化过程都有反应，容易出现混乱，JK边沿触发器就只在时钟信号的边沿这一特定时刻做出反应，就像一个精准的小闹钟，到点了才响。
它就像是数字电路这个大家庭里的一个小精灵，虽然小小的，但是功能超级强大。
每一个逻辑门的组合，每一次对J、K输入和时钟信号的响应，都像是它在这个数字世界里独特的舞步。
它用自己独特的工作方式，为数字电路的正常运行和各种功能的实现默默贡献着自己的力量。
jk触发器的原理
jk触发器的原理
jk触发器是一种基本的数字电路组件，用于存储和传输数据。
它由两个互补的门构成，包括两个输入端口和两个输出端口。
当特定的条件满足时，jk触发器可以改变其状态，并将当前状态传递到输出。
jk触发器的原理可以分为两个方面：时序逻辑和存储逻辑。
在时序逻辑方面，jk触发器通过时钟信号来控制数据的存储和传输。
当时钟信号为高电平时，输入端口的数据会被存储在触发器中，并在时钟信号为低电平时保持不变。
这种工作方式被称为同步触发器，因为数据的传输是同步于时钟信号的。
在存储逻辑方面，jk触发器可以根据当前状态和输入端口的数据来改变其状态。
每个输入端口都与一个门电路相关联，以决定触发器的下一状态。
具体而言，当j和k输入分别为0和1时，触发器的状态将保持不变。
当j和k输入都为1时，触发
器的状态将翻转。
当j和k输入分别为1和0时，触发器的状
态将被清除为0。
当j和k输入都为0时，触发器的状态将不
确定。
通过合理地设置j和k输入，可以实现不同的逻辑功能。
例如，将j和k端口连接为输入端口，jk触发器可以被用作计数器或
频率除法器。
总的来说，jk触发器是通过时序逻辑和存储逻辑来实现数据存储和传输的。
它是数字电路领域中常用的重要组件之一。
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㈠ 逻辑功能 描述方法： 逻辑符号、特性表、驱动表、特性方程 逻辑符号
加小圆圈：表示下降沿有效触发 不加小圆圈：表示上升沿有效触发
1.特性表 主从RS触发器的特性表
R
S
Qn+1
0
0
×
0
1
1
1
0
0
1
1
Qn
主从JK触发器的特性表
J
K
Qn+1
0
0
Qn
0
1
1
1
0
0
1
1
Qn
主从D触发器的特性表
当T=0时，Qn1 Q，n 输入时钟脉冲CP时，触发器保 持原状态不变。
T触发器的作用： 进行计数
Q
Q
Q
Q
1J C1 1K
CP T
1J C1 1K
CP T' 1
2、JK触发器→T′触发器
令J=K=1, T′触发器是T触发器T=1时的特例 T′触发器的特性方程:
将T=1代人JK触发器的特性方程
Qn1 Qn
5.状态转换图
J=1 K=X
J=0 K=X
0
J=X
1
K=0
J=X K=1
3.2 主从JK触发器
一、电路结构
从
触
发
Q
Q
器
Q
Q
FFT2
1S C1 1R
1S C1 1R
J CP K
QM
主
QM
触
FFT1
发 器
1S C1 1R
J CP K
1G
CP=1，从触发器封锁，状态不变,主触发器接收R、 S信号，状态更新； CP从 1→0,从触发器接收主触发器输出信号，状态更 新, 主触发器封锁，状态不变。 状态更新时刻：CP下降沿到达后
主从T: Qn+1=T + QQn n T
主从T´: Qn+1=
Qn
㈡ 触发方式
1.基本RS触发器 直接电平触发（低电平有效/高电平有效）,无CP 2.同步触发 CP的（高/低）电平期间触发，即在整个电平 期间接收信号RS/JK/D/T、在整个电平期间状 态相应更新。所以存在空翻。
3．边沿触发
只在CP的↑或↓边沿触发，即只在CP的↑或↓边沿 接收信号RS/JK/D/T、只在CP的↑或↓边沿状态 更新。克服空翻。 4．主从触发有主、从两个触发器，在CP的高/
D
Qn+1
0
0
1
1
主从T´触发器的特性表
T´
Qn+1
1
Qn
2、驱动表
Qn→Qn+1 R S
JK
D
T
00
×0 0×
0
0
01
0 1 1×
0
1
10
10 ×1
1
1
11 0× ×0
1
0
T´触发器的驱动表
Qn→Qn+1
T´
01
1
10
1
3、特性方程 主从RS: Qn+1=s +QRn
主从JK: Qn+1=J + QQ nn K 主从D: Qn+1=D
作业： 2， 4
1三 、具有直接置0端和置1端的边沿JK触发器
0
Q
Q
Q
Q
图所示为
下降沿触
≥1
≥1
& A & B G1 G2 & C & D
发的边沿 JK触发器
S 1J C1 1K R
CT74LS1
12的逻辑 SD J CP K RD
Q3
Q4
图
G3 &
& G4
直接（异步） 直接（异步）
置1端
置0端
0SD J CP 1
低电平期间交替工作、封锁。 只在CP的高电平期间（或低电平期间）接收信 号RS/JK/D/T、只在CP的↑或↓边沿总的输出状 态更新。
集成触发器中常见的直接置0和置1端
R D ：直接（异步）置0端 S D ：直接（异步）置1端 非号：低电平有效， 直接（异步）：不受CP的影响。
3.3 TTL边沿JK触发器
一、电路结构
Q
Q
加小圆圈： 表示下降沿 有效触发
≥1
≥1
& A & B G1 G2 & C & D
Q
Q
Q3 G3 &
Q4 & G4
1J C1 1K
J CP K
逻辑符号 中“ ^ ” 表示边沿 触发输入
J
CP K
不加小圆圈： 表示上升沿有
效触发
二、逻辑功能
特性方程： Qn1JQnKQn Q n 1为CP下降沿到来后的次态
JK触发器的功能分析
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同步JK触发器的原理与特点 主从JK触发器的原理与特点 TTL边沿JK触发器的原理与特点
3.1 同步JK触发器
同步D触发器
电路结构 电路结构
逻辑功能 逻辑功能
驱动表
驱动表
特性方程
特性方程
状态转换图
状态转换图
1．电路结构 克服同步RS触发器在R＝S＝1时出现不定状态 的另一种方法：将触发器输出端Q和 状态反馈 到输入端，这样，G3和G4的输出不会同时出现 0，从而避免了不定状态的出现。
K 1RD 0
四、JK触发器构成的T触发器和T′触发器
T触发器： 具有保持和翻转功能的触发器 T′触发器： 只具有翻转功能的触发器
1、JK触发器→T触发器：令JK触发器的J=K=T
T触发器特性方程： Qn1TQnTQn （CP下降沿到来有效）
T触发器的逻辑功能： 当T=1时，Qn1 Q，n 这时每输入一个时钟脉冲CP，触 发器的状态便翻转一次
J、K端相当于同步RS触发器的S、R端。
Q
G1 &
Q
& G2
G3 &
& G4
J CP K
Q
Q
1J C1 1K
J CP K
2.逻辑功能
同步JK触发器的特性表
3.驱动表 根据特性表可得到在CP＝1时的同步JK触发器的驱动表
大家应该也有点累了，稍作休息
大家有疑问的，可以询问和交流
4.特性方程 Qn+1=QJn +K Qn
主从RS触发器的逻辑功能和同步RS触发器的相同， 因此，它们的特性表、驱动表、特性方程也相同。
注意：
特性方程不存在约束条件 Qn+1=S+R Qn(CP下降沿到来有效) R、S信号:指CP下降沿到来前的状态 Qn+1:CP下降沿到来后的次态
二、逻辑功能
Qn+1=JQ n + K Qn（CP下降沿到来有效）