数字逻辑与数字集成电路习题
数字逻辑与数字系统设计第2-3章客观题
（）1、数字电路又称为开关电路、逻辑电路。
答案：正确（）2、二极管、三极管、场效应管是常用的开关元件。
答案：正确（）3、最基本的逻辑关系是：与、或、非。
答案：正确（）4、高电平用0表示，低电平用1表示，称为正逻辑。
答案：错误（）5、TTL型门电路比CMS型门电路开关速度快。
答案：正确（）6、逻辑表达式是逻辑函数常用的表示方法。
答案：正确（）7、用真值表表示逻辑函数，缺乏直观性。
答案：错误（）8、逻辑图是最接近实际的电路图。
答案：正确（）9、由真值表得到的逻辑函数一般都要经过化简。
答案：正确（）10、组合电路的特点是：任意时刻的输出与电路的原状态有关。
答案：错误（）11、1+A＝1答案：正确（）12、AB+A＝A（）13、将实际问题转换成逻辑问题第一步是要先写出逻辑函数表达式。
答案：错误14、异或函数与同或函数在逻辑上互为反函数。
（对）每个最小项都是各变量相“与”构成的，即n个变量的最小项含有n个因子。
（对）15、因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。
（错）16、逻辑函数F=A B+A B+B C+B C已是最简与或表达式。
（错）17、利用约束项化简时，将全部约束项都画入卡诺图，可得到函数的最简形式。
（错）18、卡诺图中为1的方格均表示逻辑函数的一个最小项。
（对）19、在逻辑运算中，“与”逻辑的符号级别最高。
（错）20、标准与或式和最简与或式的概念相同。
（对）21、数字电路中用“1”和“0”分别表示两种状态，二者无大小之分。
（对）22、格雷码具有任何相邻码只有一位码元不同的特性。
（对）23、所有的集成逻辑门，其输入端子均为两个或两个以上。
（错）24、根据逻辑功能可知，异或门的反是同或门。
（对）25、逻辑门电路是数字逻辑电路中的最基本单元。
（对）26、TTL和CMOS两种集成电路与非门，其闲置输入端都可以悬空处理。
（错）27、74LS系列产品是TTL集成电路的主流，应用最为广泛。
《数字集成电路》期末试卷(含答案)
浙江工业大学 / 学年第一学期 《数字电路和数字逻辑》期终考试试卷 A姓名 学号 班级 任课教师一、填空题（本大题共10小题，每空格1分，共10分）请在每小题的空格中填上正确答案。
错填、不填均无分。
1．十进制数（68）10对应的二进制数等于 ；2．描述组合逻辑电路逻辑功能的方法有真值表、逻辑函数、卡诺图、逻辑电路图、波形图和硬件描述语言（HDL ）法等，其中 描述法是基础且最直接。
3．1A ⊕可以简化为 。
4．图1所示逻辑电路对应的逻辑函数L 等于 。
A B L≥1&CYC图1 图25．如图2所示，当输入C 是（高电平，低电平） 时，AB Y =。
6．两输入端TTL 与非门的输出逻辑函数AB Z =，当A =B =1时，输出低电平且V Z =0.3V ，当该与非门加上负载后，输出电压将(增大，减小) 。
7．Moore 型时序电路和Mealy 型时序电路相比， 型电路的抗干扰能力更强。
8．与同步时序电路相比，异步时序电路的最大缺陷是会产生 状态。
9．JK 触发器的功能有置0、置1、保持和 。
10．现有容量为210×4位的SRAM2114，若要将其容量扩展成211×8位，则需要 片这样的RAM 。
二、选择题（本大题共10小题，每小题2分，共20分）在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。
错选、多选或未选均无分。
11．十进制数（172）10对应的8421BCD 编码是 。
【 】A ．（1111010）8421BCDB ．（10111010）8421BCDC ．（000101110010）8421BCD D ．（101110010）8421BCD12．逻辑函数AC B A C B A Z +=),,(包含 个最小项。
【 】A ．2B ．3C ．4D ．513．设标准TTL 与非门AB Z =的电源电压是+5V ，不带负载时输出高电平电压值等于+3.6V ，输出低电平电压值等于0.3V 。
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第五章时序逻辑电路S13101B在逻辑电路中，任意时刻的输出状态仅取决于该时刻输入信号的状态，而与信号作用前电路的状态无关，这种电路称为。
因此，在电路结构上一般由组合而成。
解：组合逻辑电路，门电路S13101I右图所示的波形是一个(同、异) 进制(加、减)法计数器的波形。
若由触发器组成该计数器，触发器的个数应为，它有个无效状态，分别为和。
解：同，六，加，3，2，110，111S13101N某计数器的状态转换图如图所示，试问该计数器是一个进制法计数器，它有个有效状态，个无效状态，该电路自启动。
若用JK触发器组成，至少要个。
解：七，减，七，1，能，3S13102B在任何时刻，输出状态仅仅决定于同一时刻各输入状态的组合，而与电路以前所处的状态无关的逻辑电路称为，而若逻辑电路的输出状态不仅与输出变量的状态有关，而且还与系统原先的状态有关，则称其为。
解：组合逻辑电路，时序逻辑电路。
S13102I在同步计数器中，各触发器的CP输入端应接时钟脉冲。
解：同一S13201B有四个触发器的二进制计数器，它的计数状态有( )。
A. 8B. 16C. 256D. 64解：BS13201G当C r=0时，移位寄存器处于状态( )。
A. 保持B. 左移C. 右移D. 清除解：DS13201I下图所示波形是一个进制加法计数器的波形图。
试问它有个无效状态。
A. 二B. 四C. 六D. 八解：C、DS13202B二进制加法计数器，从0 计到十进制数12时，需要个触发器构成，它有个无效状态。
A. 4B. 3C. 8D. 16解：A 、BS13202G一个五位的二进制加法计数器，由0000状态开始，按自然态序计数，问经过75个输入脉冲后，此计数器的状态为( )。
A. 01011B. 11010C. 11111D. 10011解：AS13203B下列电路为时序电路的是( )。
A. 译码器B. 编码器C. 全加器D. 计数器解：DS13204B下列电路中，不属于组合电路的是( )。
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（一）．数字逻辑基础（1）．进制与进制之间的转换（2）．与逻辑和与门电路（3）．或逻辑和或门电路（4）．非逻辑和非门电路（5）．与非门电路（6）．集成门电路（7）．逻辑代数定律与逻辑函数化简（二）．组合逻辑电路（8）．组合逻辑电路的分析与设计（9）．编码器（10）．译码器（11）．加法器（12）．数值比较器（13）．数据选择器（三）．时序逻辑电路（14）．RS触发器（15）．D触发器与数据寄存器（16）．移位寄存器（17）．JK触发器与计数器（四）．555时基电路与石英晶体多谐振荡器（18）．定时器（19）．施密特触发器（20）．多谐振荡器（五）．数模与模数转换（21）．数模转换电路DAC（22）．模数转换电路ADC（六）．半导体存储器（23）．只读存储器ROM（24）．随机存储器RAM（一）．数字逻辑基础（1）．进制与进制之间的转换1．在数字电路中，通常用数字来表示高电平，用数字来表示低电平。
2．某二进制数由4位数字组成，其最低位的权是，最高位的权是。
3．完成下列进制的转换：（00011111）2=（）10 ；（10）10=（）2 ；（1111）2=（）8 ；（10）8=（）2 ；（011111）2=（）16 ；（2A）16=（）2 。
（01010101）8421=（）10 ；（32）10=（）8421 ；4．二进制数只有（）数码。
A．0 B.1C．0、1 D.0、1、25．十六进制数只有（）数码。
A．0～F B.1～FC．0～16 D.1～166．一位十六进制数可以用（）位二进制数来表示。
A．1 B.2C．4 D.16（2）．与逻辑和与门电路7．“Y等于A与B”的逻辑函数式为。
8．与门电路是当全部输入为时，输出才为“1”。
9．开关串联的电路可以用“与”逻辑表示。
（）10．门电路可以有多个输出端。
（）11．门电路可以有多个输入端。
（）（3）．或逻辑和或门电路12．“Y等于A或B”的逻辑函数式为。
2020—2021学年非毕业班集成电路设计与集成系统专业《数字逻辑电路》期末考试题及答案(试卷A)
院系： 专业班级： 学号： 姓名： 座位号：XXX 大学2020—2021学年非毕业班集成电路设计与集成系统专业《数字逻辑电路》期末考试题及答案（试卷A ）题 号 一 二 三 四 五 总分 评卷人 分 值 20 20 10 20 30 100得 分得 分一、 选择题;（每小题2分，共20分）。
1、将幅值上、时间上离散的阶梯电平统一归并到最邻近的指定电平的过程称为（ ）。
A 、采样；B 、量化；C 、保持；D 、编码；2、8个输入端的编码器按二进制数编码时，输出端的个数是教研室主任审核(签名)： 教学主任(签名)：课程代码： 适用班级：命题教师：任课教师：院系： 专业班级： 学号： 姓名： 座位号：（ ）。
A 、2个；B 、3个；C 、4个；D 、8个；3、下列电路中，不属于组合逻辑电路的是（ ）。
A 、译码器；B 、全加器；C 、寄存器；D 、编码器；4、CMOS 数字集成电路与TTL 数字集成电路相比突出的优点是（ ）。
A 、微功耗；B 、高速度；C 、高抗干扰能力；D 、电源范围宽；5、指出下列各式中哪个是四变量A 、B 、C 、D 的最大项（ ）。
A 、ABC ；B 、A+B+C+D ；C 、D ABC ； D 、B AC ；6、同步时序电路和异步时序电路比较，其差异在于后者（ ）。
院系： 专业班级： 学号： 姓名： 座位号：A 、没有触发器；B 、没有统一的时钟脉冲控制；C 、没有稳定状态；D 、输出只与内部状态有关；7、两片74LS290芯片扩展而成的计数器，最大模数是（ ）。
A 、80；B 、20；C 、54；D 、100；8、由与非门组成的基本RS 触发器不允许输入的变量组合S 、R 为（ ）。
A 、1==S R ； B 、10==S R 、； C 、01==S R 、；D 、==S R ；9、逻辑函数的表示方法中具有唯一性的是（ ）。
A 、真值表；B 、表达式；C 、表达式；D 、卡诺图；10、将TTL 与非门作非门使用，则多余输入端应做的处理是（ ）。
东师《数字电路与数字逻辑16秋在线作业2
B.提高D/A转换速度
C.提高D/A转换速度
D.增加可靠性
正确答案：
10.触发器可以记忆（）位二值信号。
A. 1
B. 2
C. 4
D. 8
正确答案：
数字电路与数字逻辑16秋在线作业2
二、多选题（共10道试题，共30分。）
1.下列哪些属于用卡诺图化简逻辑函数时的步骤：（）。
A.将逻辑式化为标准“与或”式
A.错误
B.正确
正确答案：
4.逻辑函数Y=A + B+ C+B已是最简与或表达式。
A.错误
B.正确
正确答案：
5.占空比的公式为：q = t w / T，则周期T越大占空比q越小。
A.错误
B.正确
正确答案：
6.若两个函数具有不同的真值表，则两个逻辑函数必然不相等。
A.错误
B.正确
正确答案：
7. RAM能随时读出RAM中所存的内容，又能随时将新的内容写入RAM中
二、多选题（共10道试题，共30分。）
1. RAM的典型结构由哪几部分组成（）
A.地址译码
B.存储矩阵
C.读出电路
D.读/写控制
正确答案：
2. 555定时器电路可以应用于哪些方面（）
A.自动控制
B.定时
C.仿声
D.防盗报警
正确答案：
3.最大项具有下列性质：（）。
A.在输入变量的任何取值下必有一个最大项，而且仅有一个最大项的值为0。
A.错误
B.正确
正确答案：
14.主从JK触发器,边沿JK触发器和同步JK触发器的逻辑功能完全相同
A.错误
B.正确
习题数电参考答案（终）
习题数电参考答案（终）第⼀章数字逻辑概论1.1 数字电路与数制信号1.1.1 试以表1.1.1所列的数字集成电路的分类为依据，指出下列IC器件属于何种集成度器件：（1）微处理器；（2）计数器；（3）加法器；（4）逻辑门；（5）4兆位存储器。
解：依照表1.1.1所⽰的分类，所列的五种器件：（1）、（5）属于⼤规模；（2）、（3）属于中规模；（4）属于⼩规模。
1.1.2⼀数字信号波形如图题1.1.2所⽰，试问该波形所代表的⼆进制数是什么？解：图题1.1.2所⽰的数字信号波形的左边为最⾼位（MSB），右边为最低位（LSB），低电平表⽰0，⾼电平表⽰1。
该波形所代表的⼆进制数为010110100。
1.1.3 试绘出下列⼆进制数的数字波形，设逻辑1的电压为5V，逻辑0的电压为0V。
（1）001100110011（2）0111010 （3）1111011101解：⽤低电平表⽰0，⾼电平表⽰1，左边为最⾼位，右边为最低位，题中所给的3个⼆进制数字的波形分别如图题1.1.3（a）、（b）、（c）所⽰，其中低电平为0V，⾼电平为5V。
1.1.4⼀周期性数字波形如图1.1.4所⽰，试计算：（1）周期；（2）频率；（3）占空⽐。
解：因为图题1.1.4所⽰为周期性数字波，所以两个相邻的上升沿之间持续的时间为周期，T=10ms。
频率为周期的倒数，f=1/T=1/0.01s=100Hz。
占空⽐为⾼电平脉冲宽度与周期的百分⽐，q=1ms/10ms×100%=10%。
1.2 数制1.2.1 ⼀数字波形如图1.2.1所⽰，时钟频率为4kHz，试确定：（1）它所表⽰的⼆进制数；（2）串⾏⽅式传送8位数据所需要的时间；（3）以8位并⾏⽅式传送的数据时需要的时间。
解：该波形所代表的⼆进制数为00101100。
时钟周期T=1/f=1/4kHz=0.25ms。
串⾏⽅式传送数据时，每个时钟周期传送1位数据，因此，传送8位数据所需要的时间t=0.25ms×8=2ms。
习题册答案-《数字逻辑电路(第四版)》-A05-3096
第一章逻辑门电路§1-1 基本门电路一、填空题1.与逻辑；Y=A·B2.或逻辑；Y=A+B3.非逻辑；Y=4.与；或；非二、选择题1. A2. C3. D三、综合题1.2.真值表逻辑函数式Y=ABC§1-2 复合门电路一、填空题1.输入逻辑变量的各种可能取值；相应的函数值排列在一起2.两输入信号在它们；异或门电路3.并；外接电阻R；线与；线与；电平4.高电平；低电平；高阻态二、选择题1. C2. B3. C4. D5. B三、综合题1.2.真值表逻辑表达式Y1=ABY2=Y3==A+B 逻辑符号3.第二章组合逻辑电路§2-1 组合逻辑电路的分析和设计一、填空题1.代数；卡诺图2.n；n；原变量；反变量；一；一3.与或式；1；04.组合逻辑电路；组合电路；时序逻辑电路；时序电路5.该时刻的输入信号；先前的状态二、选择题1. D2. C3. C4. A5. A三、判断题1. ×2. √3. √4. √5. ×6. √四、综合题1.略2.（1）Y=A+B（2）Y=A B+A B(3) Y=ABC+A+B+C+D=A+B+C+D3. (1) Y=A B C+A B C+ A B C + ABC=A C+AC(2) Y=A CD+A B D+AB D+AC D(3) Y=C+A B+ A B4. （a）逻辑函数式Y= Y=AB+A B真值表逻辑功能：相同出1，不同出0 （b）逻辑函数式Y=AB+BC+AC真值表逻辑功能：三人表决器5.状态表逻辑功能：相同出1，不同出0逻辑图1. 6.Y=A ABC+B ABC+C ABC判不一致电路，输入不同，输出为1,；输入相同，输出为0。
§2-2 加法器一、填空题1.加数与被加数；低位产生的进位2.加数与被加数；低位产生的进位3.加法运算二、选择题1. A2. C三、综合题1.略2.略3.§2-3 编码器与比较器一、填空题1. 编码2. 101011；010000113. 十；二；八；十六4. 0；1；逢二进一；10；逢十进一5. 二进制编码器；二—十进制编码器6. 两个数大小或相等7. 高位二、选择题1. A2. B3. C4. B三、综合题1.略2.（1）10111；00100011（2）00011001；19（3）583. （1）三位二进制（2）1,1,0（3）1,1,14.§2-4 译码器与显示器一、填空题1. 编码器；特定含意的二进制代码按其原意；输出信号；电位；解码器2. 二进制译码器；二—十进制译码器；显示译码器3. LED数字显示器；液晶显示器；荧光数码管显示器4. 1.5～3；10mA/段左右5. 共阴极显示译码器；共阳极显示译码器；液晶显示译码器二、选择题1. A；D2. A三、判断题1.√2.×3.×4.√5.√四、综合题七段显示译码器真值表f=D C B A +D C B A +D C B A+D CB A +D C B A +D C B A =D+B A +C A +C B =DB AC AC B§2-5 数据选择器与分配器一、填空题1.多路调制器；一只单刀多掷选择开关；地址输入；数字信息；输出端2.从四路数据中，选择一路进行传输的数据选择器3.地址选择；输出端二、选择题1. D2. A；C三、判断题1. √2. ×四、综合题1.略2. Y=A B D0+A BD1+A B D2+ABD3第三章触发器§3-1 基本RS触发器与同步RS触发器一、填空题1.两个；已转换的稳定状态2.R S+RSQ n;R+S=13. R S Q n+ R S;RS=04.置0；置15.相同；低电平；高电平6.时钟信号CP7.D触发器8.空翻二、选择题1.D2.B3.A4.B5.B6.D三、判断题1. ×2. ×3. √4. ×5. ×6. ×四、综合题1.略2.3.4.5.略§3-2主从触发器与边沿触发器一、填空题1.空翻2.置0、置1、保持、翻转3.Ｄ、J Q n+K Q n4.保持、置1、清0、翻转5.电平、主从6.一次变化7.边沿触发器8.不同、做成9.置0、置1、时钟脉冲二、选择题1.A2.A3.D4.B5.A6.C7.D8.B9.A10.D三、判断题1. √2. ×3. ×4. ×5. √6. ×7. √8. √四、综合题1.2.3.4.略5.略6.§3-3触发器的分类与转换一、填空题1.T、T'2. T Q n+ T Q n、Q n3.1、04. Q n、Q n5. 16. T'7. T8. T'二、选择题1.D2.D3.D4.B5.B三、判断题1. ×2. ×3. ×4. ×四、分析解答题1.2.3.略4.略5.略第四章时序逻辑电路§4-1 寄存器一、填空题1.输入信号；锁存信号2.接收；暂存；传递；数码；移位二、选择题1. C2. B；A三、判断题1. √2. ×3. √四、综合题1.JK触发器构成D触发器，即Q n+1= D。
数字集成电路第二版答案
数字集成电路第二版答案【篇一：《数字集成电路》期末试卷a(含答案)】考试试卷 a姓名学号班级任课教师一、填空题（本大题共10小题，每空格1分，共10分）请在每小题的空格中填上正确答案。
错填、不填均无分。
1．十进制数（68）10对应的二进制数等于；2．描述组合逻辑电路逻辑功能的方法有真值表、逻辑函数、卡诺图、逻辑电路图、波形图和硬件描述语言（hdl）法等，其中描述法是基础且最直接。
3．a?1可以简化为4．图1所示逻辑电路对应的逻辑函数l等于。
abc≥1lcy图1图25．如图2所示，当输入c是（高电平，低电平）时，y?ab。
6．两输入端ttl与非门的输出逻辑函数z?ab，当a=b=1时，输出低电平且vz=0.3v，当该与非门加上负载后，输出电压将(增大，减小)。
7．moore型时序电路和mealy型时序电路相比，型电路的抗干扰能力更强。
8．与同步时序电路相比，异步时序电路的最大缺陷是会产生 9．jk触发器的功能有置0、置1、保持和的ram。
二、选择题（本大题共10小题，每小题2分，共20分）在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。
错选、多选或未选均无分。
11．十进制数（172）10对应的8421bcd编码是。
【】a．（1111010）8421bcdb．（10111010）8421bcdc．（000101110010）8421bcd d．（101110010）8421bcd12．逻辑函数z(a,b,c)?ab?ac包含【】a．2 b．3c．4d．513．设标准ttl与非门z?ab的电源电压是+5v，不带负载时输出高电平电压值等于+3.6v，输出低电平电压值等于0.3v。
当输入端a、b电压值va=0.3v，vb=3.6v和va=vb=3.6v两种情况下，输出电压值vz分别为。
a．5v，5v c．3.6v，0.3v【】b．3.6v，3.6v d．0.3v ，3.6v14．图3所示电路的输出逻辑函数z1等于。
西南民族大学数字逻辑与数字电路试题
5. 已知某函数，该函数的反函数=（
）。
6. 如果对键盘上108个符号进行二进制编码，则至少要（
）位二
进制数码。
7. 典型的TTL与非门电路使用的电路为电源电压为（ ）V，其输出高
电平为（ ）V，输出低电平为（ ）V， CMOS电路的电源电压为
（
）V。
8．74LS138是3线—8线译码器，译码为输出低电平有效，若输入为
CTP CTT
Q1
D3 D2
Q0
D1
D0
0 × × × × 0 0 74LS161
10 × ×
0 0 CP
11 0
×
×
D3 D2
CP &
1 1 × 0 × D1 D0 “1”
11 1 1
Q3 Q2 “1”
Q1 Q0 “1”
Q3 Q2
Q1 Q0
加法
计数
4．触发器电路如下图所示，试根据CP及输入波形画出输出端Q1 、Q2 的波形。设各触发器的初始状态均为“0”（6分）。
B；Y3＝A B 13. 5 二、选择题（共30分，每题2分）
14．低
1 2 3 4 5 6 7 8 9 10 11 12
ACCACA 三、判断题（每题2分，共20分）
12345
ADB C A D 6 7 8 9 10
×√××√√√×√√
四、综合题（共30分，每题10分） 1．解：（１）真值表 （2分） (2)卡诺图化简（2分）
学年：2011
行政班： 总分：
题一二三四总
号
分
得 分
一、填空题（每空1分，共20分）
1. 有一数码10010011，作为自然二进制数时，它相当于十进制数（
(完整word版)数电1-10章自测题及答案(2)
第一章绪论一、填空题1、根据集成度的不同，数字集成电路分位以下四类：小规模集成电路、中规模集成电路、大规模集成电路、超大规模集成电路。
2、二进制数是以2为基数的计数体制,十六体制数是以16为基数的计数体制。
3、二进制数只有0和1两个数码，其计数的基数是2，加法运算的进位规则为逢二进一。
4、十进制数转换为二进制数的方法是：整数部分用除2取余法，小数部分用乘2取整法，十进制数23。
75对应的二进制数为10111.11。
5、二进制数转换为十进制数的方法是各位加权系数之和，二进制数10110011对应的十进制数为179。
6、用8421BCD码表示十进制时，则每位十进制数可用四位二进制代码表示，其位权值从高位到低位依次为8、4、2、1。
7、十进制数25的二进制数是11001，其对应的8421BCD码是00100101。
8、负数补码和反码的关系式是:补码=反码+1。
9、二进制数+1100101的原码为01100101，反码为01100101，补码为01100101。
-1100101的原码为11100101，反码为10011010,补码为10011011。
10、负数-35的二进制数是—100011，反码是1011100，补码是1011101。
二、判断题1、二进制数有0~9是个数码,进位关系为逢十进一。
（）2、格雷码为无权码,8421BCD码为有权码。
（√）3、一个n位的二进制数，最高位的权值是2^n+1. （√）4、十进制数证书转换为二进制数的方法是采用“除2取余法”. (√）5、二进制数转换为十进制数的方法是各位加权系之和。
（√)6、对于二进制数负数，补码和反码相同。
（)7、有时也将模拟电路称为逻辑电路。
（）8、对于二进制数正数,原码、反码和补码都相同. (√）9、十进制数45的8421BCD码是101101。
（）10、余3BCD码是用3位二进制数表示一位十进制数. ( ）三、选择题1、在二进制技术系统中,每个变量的取值为（A ）A、0和1B、0～7C、0~10D、0~F2、二进制权值为（B ）A、10的幂B、2的幂C、8的幂D、16的幂3、连续变化的量称为( B )A、数字量B、模拟量C、二进制量D、16进制量4、十进制数386的8421BCD码为（B ）A、0011 0111 0110B、0011 1000 0110C、1000 1000 0110D、0100 1000 01105、在下列数中，不是余3BCD码的是( C ）A、1011B、0111C、0010D、10016、十进制数的权值为（D ）A、2的幂B、8的幂C、16的幂D、10的幂7、负二进制数的补码等于（D )A、原码B、反码C、原码加1D、反码加18、算术运算的基础是（A ）A、加法运算B、减法运算C、乘法运算D、除法运算9、二进制数-1011的补码是（D ）A、00100B、00101C、10100D、1010110、二进制数最高有效位（MSB）的含义是( A )A 、最大权值B 、最小权值C 、主要有效位D 、中间权值第二章 逻辑代数基础一、填空题1、逻辑代数中三种最基本的逻辑运算是与运算、或运算、非运算。
《数字电路与数字逻辑》练习题
《数字电路与数字逻辑》练习题一一、填空1．将下列二进制数转为十进制数（1001011）B =（）D （11．011）B =（）D2．将下列有符号的十进制数转换成相应的二进制数真值、原码、反码和补码（+122）=（）真值=（）原码=（）反码=（）补码3．把下列4个不同数制的数(376.125)D 、(110000)B 、(17A)H 、(67)O （按从大到小的次序排列（）>（）>()>()。
将下列各式变换成最简与或式的形式=+B AB （）=+AB A （）=++BC C A AB （）4．将下列二进制数转为十进制数（101000）B =（）D （11．0101）B =（）D5．将下列十进制数转为二进制数，八进制数和十六进制数（0．8125）=（）B =（）O =（）H（254．25）=（）B =（）O =（）H6．将下列有符号的十进制数转换成相应的二进制数真值、原码、反码和补码 （+125）=（）真值=（）原码=（）反码=（）补码（—42）=（）真值=（）原码=（）反码=（）补码7．逻辑函数C A CD AB F ++=的对偶函数F '是__________________________；其反函数F 是_________________________。
8．当j i ≠时，同一逻辑函数的最小项=⋅j i m m _________；两个最大项=+j i M M ___________。
9．（43.5）10=（_________）2=（_________）16。
10．n个输入端的二进制译码器，共有_________个输出端，对于每一组输入代码，将有_________个输出端具有有效电平。
11.将下列二进制数转为十进制数（1010001）B=（）D（11．101）B=（）D12.将下列有符号的十进制数转换成相应的二进制数真值、原码、反码和补码（+254.25）=（）真值=（）原码=（）反码=（）补码13.把下列4个不同数制的数(76.125)D、(27A)H、(10110)B、(67)O按从大到小的次序排列（）>（）>()>()。
数字逻辑与数字电路习题【有答案】
《数字逻辑与数字电路》习题案例（计算机科学与技术专业）2011年7月计算机与信息学院计算机科学技术系一、选择题1．十进制数33的余3码为 。
A. B. C. D.2．二进制小数-0.0110的补码表示为 。
A ．0.1010B ．1.1001C ．1.0110D ．1.10103．两输入与非门输出为0时，输入应满足 。
A ．两个同时为1B ．两个同时为0C ．两个互为相反D ．两个中至少有一个为04．某4变量卡诺图中有9个“0”方格7个“1”方格，则相应的标准与或表达式中共有多少个与项 ？A ． 9B ．7C ．16D ．不能确定5. 下列逻辑函数中，与A F =相等的是 。
)(A 11⊕=A F )(B A F =2⊙1 )(C 13⋅=A F )(D 04+=A F6. 设计一个6进制的同步计数器，需要 个触发器。
)(A 3 )(B 4 )(C 5 )(D 67. 下列电路中，属于时序逻辑电路的是 。
)(A 编码器 )(B 半加器 )(C 寄存器 )(D 译码器8. 列电路中，实现逻辑功能n n Q Q =+1的是 。
)(A )(B9. 的输出端可直接相连，实现线与逻辑功能。
)(A 与非门 )(B 一般TTL 门)(C 集电极开路OC 门 )(D 一般CMOS 门10．以下代码中为无权码的为 。
A . 8421BCD 码B . 5421BCD 码C . 余三码D . 格雷码11．以下代码中为恒权码的为 。
A .8421BCD 码B . 5421BCD 码C . 余三码D . 格雷码12．一位十六进制数可以用 位二进制数来表示。
A . １B . ２C . ４D . 16CP QCP QCPQ 0 CP13．十进制数25用8421BCD码表示为。
A.10 101B.0010 0101C.D.1010114．在一个8位的存储单元中，能够存储的最大无符号整数是。
A.（256）10B.（127）10C.（FF）16D.（255）1015．与十进制数（53.5）10等值的数或代码为。
《数字逻辑与数字系统》课件第二章 组合逻辑课后习题答案
第二章 组合逻辑1. 分析图中所示的逻辑电路，写出表达式并进行化简BF = AB + B = ABA F = AB BABC CABC = AB + AC + BC + BC = AB + BC + BC2. 分析下图所示逻辑电路，其中S3、S2、S1、S0为控制输入端，列出真值表，说明 F 与 A 、B 的关系。
F1=1S B BS A ++ F2=32S B A ABS +F=F 1F 2=1S B BS A ++3. 分析下图所示逻辑电路，列出真值表，说明其逻辑功能。
解：F1=C B BC A C AB C B A +++=ABC C B A ABC C B A C B A +⊕=++)(真值表如下：A B C F 0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 100000111当B ≠C 时， F1=A 当B=C=1时， F1=A 当B=C=0时， F1=0裁判判决电路，A 为主裁判，在A 同意的前提下，只要有一位副裁判（B ，C ）同意，成绩就有效。
F2=AC BC AB C A C B B A ++=++真值表如下：A B C F 0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 100001111当A 、B 、C 三个变量中有两个及两个以上同时为“1”时，F2 = 1 。
4.图所示为数据总线上的一种判零电路，写出F 的逻辑表达式，说明该电路的逻辑功能。
解：F=1514131211109876543210A A A A A A A A A A A A A A A A +++只有当变量A0~A15全为0时，F = 1；否则，F = 0。
因此，电路的功能是判断变量是否全部为逻辑“0”。
5. 分析下图所示逻辑电路，列出真值表，说明其逻辑功能解： 301201101001X A A X A A X A A X A A F +++= 真值表如下：因此，这是一个四选一的选择器。
《数字逻辑》2020年秋季学期作业A
桂林电子科技大学继续教育学院《数字逻辑》2020年秋季学期作业A1. (单选题) 逻辑表达式Y=AB可以用 ( ) 实现。
(本题2.5分)A、正或门B、正非门C、正与门D、负或门学生答案： A标准答案：C解析：得分： 02. (单选题) CMOS数字集成电路与TTL数字集成电路相比突出的优点是( )。
(本题2.5分)A、微功耗B、高速度C、高抗干扰能力D、电源范围宽学生答案： B标准答案：A解析：得分： 03. (单选题) 一块数据选择器有三个地址输入端,则它的数据输出端最多应有( )。
(本题2.5分)A、 3B、 6C、7D、8学生答案：未答题标准答案：D解析：得分： 04. (单选题) 若在编码器中有90个编码对象,则要求输出二进制代码位数为( )位。
(本题2.5分)A、 5B、 6C、7D、8学生答案：未答题标准答案：C解析：得分： 05. (单选题) 八路数据分配器,其地址输入端有( )个。
(本题2.5分)A、 1B、 2C、 3D、 4学生答案：未答题标准答案：C解析：得分： 06. (单选题) 8 位移位寄存器,串行输入时经( )个脉冲后,8位数码全部移入寄存器中(本题2.5分)A、 1B、 2C、 4D、8学生答案：未答题标准答案：D解析：得分： 07. (单选题) 基本的逻辑运算是( )。
(本题2.5分)A、异或B、与非C、与、或、非D、或非学生答案：未答题标准答案：C解析：得分： 08. (单选题) 与模拟电路相比,数字电路主要的优点有( )。
(本题2.5分)A、容易设计B、通用性强C、保密性好D、抗干扰能力强学生答案：未答题标准答案：D解析：得分： 09. (单选题) 要区分60个数符,至少需( )位二进制代码。
(本题2.5分)A、 4B、 5。
2023大学_数字逻辑试题及参考答案
2023数字逻辑试题及参考答案数字逻辑试题一. 填空题1.在数字系统里，当某一线路作为总线使用，那么接到该总线的所有输出设备(或器件)必须具有 b 结构，否则会产生数据冲突。
a. 集电极开路;b. 三态门;c. 灌电流;d. 拉电流2.TTL集成电路采用的是 b 控制，其功率损耗比较大;而MOS集成电路采用的`是 a 控制，其功率损耗比较小。
a. 电压;b.电流;c. 灌电流;d. 拉电流3. 欲将二进制代码翻译成输出信号选用 b ，欲将输入信号编成二进制代码选用 a ，欲将数字系统中多条传输线上的不同数字信号按需要选择一个送到公共数据线上选用 c ，欲实现两个相同位二进制数和低位进位数的相加运算选用 e 。
a. 编码器;b. 译码器;c. 多路选择器;d. 数值比较器;e. 加法器;f. 触发器;g. 计数器;h. 寄存器4. 卡诺图上变量的取值顺序是采用 b 的形式，以便能够用几何上的相邻关系表示逻辑上的相邻。
a. 二进制码;b. 循环码;c. ASCII码;d. 十进制码5. 根据最小项与最大项的性质，任意两个不同的最小项之积为0 ，任意两个不同的最大项之和为 1 。
a. 不确定; b. 0 ; c.数字逻辑试题二. 选择题1.分别写出(或画出)JK、D、T和T四个触发器的特征方程、真值表和状态转换图。
2.请分别完成下面逻辑函数的化简。
1). F(ABC)(DE)__(ABCDE) 答：原式[(ABC)(DE)]__(ABCDE)((ABC)DE))__((ABC)DE)DE(ABC)(ABC)DEDE((ABC)(ABC))2). F(ABC)(AC)(AB)(ABDEH) 答：原式的对偶式为：FABCACABABD(EH)A(BCCBBD(EH))A[CBBBD(EH)]=A原式(F)(A)A3.请分别说明A/D与D/A转换器的作用，说明它们的主要技术指标，并进一步说明在什么情况下必须在A/D转换器前加采样保持电路。
数字逻辑与数字电路习题
《数字逻辑与数字电路》习题案例（计算机科学与技术专业）2011年7月计算机与信息学院计算机科学技术系一、选择题1．十进制数33的余3码为 。
A. 00110110B. 110110C. 01100110D. 1001002．二进制小数-0.0110的补码表示为 。
A ．0.1010B ．1.1001C ．1.0110D ．1.10103．两输入与非门输出为0时，输入应满足 。
A ．两个同时为1B ．两个同时为0C ．两个互为相反D ．两个中至少有一个为04．某4变量卡诺图中有9个“0”方格7个“1”方格，则相应的标准与或表达式中共有多少个与项 ？A ． 9B ．7C ．16D ．不能确定5. 下列逻辑函数中，与A F =相等的是 。
)(A 11⊕=A F )(B A F =2⊙1 )(C 13⋅=A F )(D 04+=A F6. 设计一个6进制的同步计数器，需要 个触发器。
)(A 3 )(B 4 )(C 5 )(D 67. 下列电路中，属于时序逻辑电路的是 。
)(A 编码器 )(B 半加器 )(C 寄存器 )(D 译码器8. 列电路中，实现逻辑功能n n Q Q =+1的是 。
)(A )(B9. 的输出端可直接相连，实现线与逻辑功能。
)(A 与非门 )(B 一般TTL 门)(C 集电极开路OC门 )(D 一般CMOS 门 10．以下代码中为无权码的为 。
A . 8421BCD 码B . 5421BCD 码C . 余三码D . 格雷码11．以下代码中为恒权码的为 。
A .8421BCD 码B . 5421BCD 码C . 余三码D . 格雷码12．一位十六进制数可以用 位二进制数来表示。
A . １B . ２C . ４D . 16CP Q Q CP Q Q CPQ 0 CP13．十进制数25用8421BCD码表示为。
A.10 101B.0010 0101C.100101D.10101 14．在一个8位的存储单元中，能够存储的最大无符号整数是。
数字逻辑考试题.(优选)
数字逻辑考试题(一)一、填空（每空1分，共17分）1. （1011.11）B =（ ） D =（ ）H2. （16）D =（ ）8421BCD 码。
3. 三态门的输出有 输出高电平 、输出低电平 、 输出高阻态 三种状态。
4. 试举出CMOS 三个电路的优点 、 、 。
5. )(CD B B A Y +=则其对偶式Y ’为 。
6. ABC C B A C AB C B A Y ++=),,( 的最简式为Y= 。
7. 由n 位寄存器组成的扭环型移位寄存器可以构成 进制计数器。
8. 半导体存储器对存储单元的寻址一般有 和矩阵译码两种方式。
9. 一片8K ×8位的ROM 存储器有 个字，字长为 位。
10. 四位环型计数器初始状态是1000，经过5个时钟后状态为 。
11. 在RS 、JK 、T 和D 触发器中， 触发器的逻辑功能最多。
12. 设一个包围圈所包围的方格数目为S ，消去的变量数目为N ，那么S 与N 的关系式应是 。
13. 在卡诺图化简逻辑函数时，圈1求得 的最简与或式，圈0求得 的最简与或式。
二、选择（5分） 1. DE BC A Y +=的反函数为Y =（ ）。
A. E D C B A Y +++⋅= B. E D C B A Y +++⋅=C. )(E D C B A Y +++⋅=D. )(E D C B A Y +++⋅=2. 下列哪个元件是CMOS 器件（ ）。
A. 74S00B. 74LS00C. 74HC00D. 74H003. 十进制数25用8421BCD 码表示为（ ）。
A. 10101B. 0010 0101C. 100101D. 101014. 若用1表示高电平，0表示低电平，则是（ ）。
A. 正逻辑B. 负逻辑C. 正、负逻辑D. 任意逻辑5. 下逻辑图的逻辑表达式为（ ）。
A. AC BC AB Y =B. BC AC AB Y ++=C. BC AC AB Y ++=D. BC AC AB Y =6. 三态门的逻辑值正确是指它有（ ）。
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《数字逻辑》习题案例（计算机科学与技术专业、信息安全专业）2004年7月计算机与信息学院、计算机系统结构教研室一、选择题1．十进制数33的余3码为 。
A. 00110110B. 110110C. 01100110D. 1001002．二进制小数-0.0110的补码表示为 。
A ．0.1010B ．1.1001C ．1.0110D ．1.10103．两输入与非门输出为0时，输入应满足 。
A ．两个同时为1B ．两个同时为0C ．两个互为相反D ．两个中至少有一个为04．某4变量卡诺图中有9个“0”方格7个“1”方格，则相应的标准与或表达式中共有多少个与项 ？A ． 9B ．7C ．16D ．不能确定5. 下列逻辑函数中，与A F =相等的是 。
)(A 11⊕=A F )(B A F =2⊙1 )(C 13⋅=A F )(D 04+=A F6. 设计一个6进制的同步计数器，需要 个触发器。
)(A 3 )(B 4 )(C 5 )(D 67. 下列电路中，属于时序逻辑电路的是 。
)(A 编码器 )(B 半加器 )(C 寄存器 )(D 译码器8. 列电路中，实现逻辑功能n n Q Q =+1的是 。
)(A )(B9. 的输出端可直接相连，实现线与逻辑功能。
)(A 与非门 )(B 一般TTL 门)(C 集电极开路OC 门 )(D 一般CMOS 门10．以下代码中为无权码的为 。
A . 8421BCD 码B . 5421BCD 码C . 余三码D . 格雷码11．以下代码中为恒权码的为 。
A .8421BCD 码B . 5421BCD 码C . 余三码D . 格雷码12．一位十六进制数可以用 位二进制数来表示。
A . １B . ２C . ４D . 1613．十进制数25用8421BCD 码表示为 。
A .10 101B .0010 0101C .100101D .1010114．在一个8位的存储单元中，能够存储的最大无符号整数是 。
CP QCPQCP Q 0 CPA.（256）10B.（127）10C.（FF）16D.（255）1015．与十进制数（53.5）10等值的数或代码为。
A.(0101 0011.0101)8421BCDB.(35.8)16C.(110101.1)2D.(65.4)816．矩形脉冲信号的参数有。
A.周期B.占空比C.脉宽D.扫描期17．与八进制数(47.3)8等值的数为：A. (100111.011)2B.(27.6)16C.(27.3 )16D. (100111.11)218.常用的B C D码有。
A.奇偶校验码B.格雷码C.8421码D.余三码19．与模拟电路相比，数字电路主要的优点有。
A.容易设计B.通用性强C.保密性好D.抗干扰能力强20．n个变量的最小项是。
A. n个变量的积项，它包含全部n个变量B. n个变量的和项，它包含全部n个变量C. 每个变量都以原变量或者反变量的形式出现，且仅出现一次。
D. n个变量的和项，它不包含全部变量。
21．当描述同步时序电路的最简状态表中含有（）个状态时，需要两个触发器。
A． 3 B． 4 C． 2 D． 522．组合逻辑电路的结构特点，表现为（）。
A．有记忆功能 B．有反馈回路 C．不含记忆元件 D．无反馈回路23.以下表达式中符合逻辑运算法则的是。
A.C·C=C2B.1+1=10C.0<1D.A+1=124. 逻辑变量的取值１和０可以表示：。
A.开关的闭合、断开B.电位的高、低C.真与假D.电流的有、无25. 当逻辑函数有n个变量时，共有个变量取值组合？A. nB. 2nC. n2D. 2n26. 逻辑函数的表示方法中具有唯一性的是。
A.真值表B.表达式C.逻辑图D.卡诺图27.F=A B+BD+CDE+A D= 。
A.DA+ B.DB)(+ D.)BA++A+D(DBDA)(+ C.)B(D)(28.逻辑函数F=)⊕ = 。
A⊕(BAA.BB.AC.BA⊕A⊕ D.B29．求一个逻辑函数F的对偶式，可将F中的。
A.·”换成“+”，“+”换成“·”B.原变量换成反变量，反变量换成原变量C.变量不变D.常数中“0”换成“1”，“1”换成“0”E.常数不变30．A+BC= 。
A .A+B B.A+C C.（A+B）（A+C） D.B+C31．在输入情况下，“与非”运算的结果是逻辑0。
A．全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是132．在种输入情况下，“或非”运算的结果是逻辑0。
A．全部输入是0 B.全部输入是1C.任一输入为0，其他输入为1D.任一输入为133. 三态门输出高阻状态时，是正确的说法。
A.用电压表测量指针不动B.相当于悬空C.电压不高不低D.测量电阻指针不动34. 以下电路中可以实现“线与”功能的有。
A.与非门B.三态输出门C.集电极开路门D.漏极开路门35．以下电路中常用于总线应用的有。
A.T S L门B.O C门C.漏极开路门D.C M O S与非门36．逻辑表达式Y=A B可以用实现。
A.正或门B.正非门C.正与门D.负或门37．T T L电路在正逻辑系统中，以下各种输入中相当于输入逻辑“1”。
A.悬空B.通过电阻 2.7kΩ接电源C.通过电阻 2.7kΩ接地D.通过电阻510Ω接地38．对于T T L与非门闲置输入端的处理，可以。
A.接电源B.通过电阻3kΩ接电源C.接地D.与有用输入端并联39．要使T T L与非门工作在转折区，可使输入端对地外接电阻R I。
A.＞R O NB.＜R O F FC.R O F F＜R I＜R O ND.＞R O F F40．三极管作为开关使用时，要提高开关速度，可。
A.降低饱和深度B.增加饱和深度C.采用有源泄放回路D.采用抗饱和三极管41．C M O S数字集成电路与T T L数字集成电路相比突出的优点是。
A.微功耗B.高速度C.高抗干扰能力D.电源范围宽42．与C T4000系列相对应的国际通用标准型号为。
A.C T74S肖特基系列B.C T74L S低功耗肖特基系列C.C T74L低功耗系列D.C T74H高速系列43.N个触发器可以构成能寄存位二进制数码的寄存器。
A.N-1B.NC.N+1D.2N44．在下列触发器中，有约束条件的是。
A.主从J K F/FB.主从D F/FC.同步R S F/FD.边沿D F/F45．一个触发器可记录一位二进制代码，它有个稳态。
A.0B.1C.2D.3E.446．存储8位二进制信息要个触发器。
A.2B.3C.4D.847．对于T触发器，若原态Q n=0，欲使新态Q n+1=1，应使输入T=。
A.0B.1C.QD.Q48．对于T触发器，若原态Q n=1，欲使新态Q n+1=1，应使输入T=。
A.0B.1C.QD.Q49．对于D触发器，欲使Q n+1=Q n，应使输入D=。
A.0B.1C.QD.Q50．对于J K触发器，若J=K，则可完成触发器的逻辑功能。
A.R SB.DC.TD.Tˊ51．欲使J K触发器按Q n+1=Q n工作，可使J K触发器的输入端。
A.J=K=0B.J=Q,K=QC.J=Q,K=QD.J=Q,K=0E.J=0,K=Q 52．欲使J K触发器按Q n+1=Q n工作，可使J K触发器的输入端。
A.J=K=1B.J=Q,K=QC.J=Q,K=QD.J=Q,K=1E.J=1,K=Q 53．欲使J K触发器按Q n+1=0工作，可使J K触发器的输入端。
A.J=K=1B.J=Q,K=QC.J=Q,K=1D.J=0,K=1E.J=K=1 54．欲使J K触发器按Q n+1=1工作，可使J K触发器的输入端。
A.J=K=1B.J=1,K=0C.J=K=QD.J=K=0E.J=Q,K=0 55．欲使D触发器按Q n+1=Q n工作，应使输入D=。
A.0B.1C.QD.Q56．下列触发器中，克服了空翻现象的有。
A.边沿D触发器B.主从R S触发器C.同步R S触发器D.主从J K触发器57．下列触发器中，没有约束条件的是。
A.基本R S触发器B.主从R S触发器C.同步R S触发器D.边沿D触发器58．描述触发器的逻辑功能的方法有。
A.状态转换真值表B.特性方程C.状态转换图D.状态转换卡诺图59．为实现将J K触发器转换为D触发器，应使。
A.J=D,K=DB.K=D,J=DC.J=K=DD.J=K=D60.边沿式D 触发器是一种 稳态电路。
A.无B.单C.双D.多61．下列表达式中不存在竞争冒险的有 。
A.Y =B +A BB.Y =A B +B CC.Y =A B C +A BD.Y =(A +B )A D62．若在编码器中有50个编码对象，则要求输出二进制代码位数为 位。
A.5B.6C.10D.5063.一个16选一的数据选择器，其地址输入（选择控制输入）端有 个。
A.1B.2C.4D.1664.下列各函数等式中无冒险现象的函数式有 。
A.B A AC C B F ++=B.B A BC C A F ++=C.B A B A BC C A F +++=D.C A B A BC B A AC C B F +++++=E.B A B A AC C B F +++=65．函数C B AB C A F ++=，当变量的取值为 时，将出现冒险现象。
A.B =C =1B.B =C =0C.A =1，C =0D.A =0，B =066．四选一数据选择器的数据输出Y 与数据输入X i 和地址码A i 之间的逻辑表达式为Y = 。
A.3X A A X A A X A A X A A 01201101001+++ B.001X A A C.101X A A D.3X A A 0167.一个8选一数据选择器的数据输入端有 个。
A.1B.2C.3D.4E.868．在下列逻辑电路中，不是组合逻辑电路的有 。
A.译码器B.编码器C.全加器D.寄存器69．八路数据分配器，其地址输入端有 个。
A.1B.2C.3D.4E.870．组合逻辑电路消除竞争冒险的方法有 。
A. 修改逻辑设计B.在输出端接入滤波电容C.后级加缓冲电路D.屏蔽输入信号的尖峰干扰71．101键盘的编码器输出 位二进制代码。
A.2B.6C.7D.8 72．用三线-八线译码器74L S 138实现原码输出的8路数据分配器，应 。
A.A ST =1，B ST =D ，C ST =0B. A ST =1，B ST =D ，C ST =DC.A ST =1，B ST =0，C ST =DD. A ST =D ，B ST =0，C ST =073．以下电路中，加以适当辅助门电路， 适于实现单输出组合逻辑电路。