I2C总线时序详解之欧阳家百创编
I2C时序分析和基础知识总结
3、仲裁
是一个在有多个主机同时尝试控制总线但只允许其中一个控制总线并使报 文不被破坏的过程。
所有主机在SCL 线上产生它们自己的时钟来传输I2C 总线上的报文。数 据只在时钟的高电平周期有效。因此，需要一个确定的时钟进行逐位仲裁。 时钟同步通过线与连接I2C 接口到SCL 线来执行。这就是说：SCL 线的 高到低切换会使器件开始数它们的低电平周期，而且一旦器件的时钟变低电 平，它会使SCL 线保持这种状态直到到达时钟的高电平。但是，如果另一个 时钟仍处于低电平周期，这个时钟的低到高切换不会改变SCL 线的状态。因 此，SCL 线被有最长低电平周期的器件保持低电平。此时，低电平周期短的 器件会进入高电平的等待状态。 当所有有关的器件数完了它们的低电平周期后，时钟线被释放并变成高 电平，之后器件时钟和SCL线的状态没有差别，而且所有器件会开始数它们 的高电平周期。首先完成高电平周期的器件会再次将SCL线拉低，这样产生 的同步SCL 时钟的低电平周期由低电平时钟周期最长的器件决定，而高电平 周期由高电平时钟周期最短的器件决定。
•
连接到I2C总线上的器件，若具有I2C总线的硬件接口，则 很容易检测到起始和终止信号。对于不具备I2C总线硬件接 口的有些单片机来说，为了检测起始和终止信号，必须保证 在每个时钟周期内对数据线SDA采样两次。
• 接收器件收到一个完整的数据字节后，有可能需要完成 一些其它工作，如处理内部中断服务等，可能无法立刻接收 下一个字节，这时接收器件可以将SCL线拉成低电平，从而 使主机处于等待状态。直到接收器件准备好接收下一个字节 时，再释放SCL线使之为高电平，从而使数据传送可以继续 进行。
这发生在仲裁之前，这部分称为同步。
仲裁
主机只能在总线空闲的时侯启动传输。两个或多个主机可能在起始条件的 最小持续时间 （tHD; STA） 内产生一个起始条件，结果在总线上产生一个规定 的起始条件。 当SCL 线是高电平时，仲裁在SDA 线发生；这样，在其他主机发送低电 平时，发送高电平的主机将断开它的数据输出级，因为总线上的电平与它自 己的电平不相同。
iic 标准通信时序
iic 标准通信时序
IIC通信协议的时序分为四个阶段：开始信号、地址字节、数据字节和停止信号。
1. 开始信号：主设备通过拉低数据线（SDA）时钟线（SCL）仍为高电平来发送开始信号。
此时，从设备需准备好接收数据，并等待地址字节的到来。
2. 地址字节：主设备发送一个地址字节到从设备以确定通信对象。
地址字节的高七位是设备的地址，最低一位是读写控制位，通常为0表示写操作，1表示读操作。
此时，从设备会检查其地址是否与发送的地址字节匹配。
3. 数据字节：主设备和从设备之间的数据传输是通过数据字节来完成的。
主设备发送数据字节，从设备接收数据字节。
数据的传输是以字节为单位的，每个数据字节传输后都会有一个应答信号。
4. 停止信号：主设备发送停止信号作为传输的结束。
I2C总线信号时序总结
I2C总线信号时序总结I2C（Inter-Integrated Circuit）总线是一种串行通信协议，它用于在集成电路之间进行短距离的数据交换。
I2C总线信号时序对于正确实现I2C通信非常重要。
本文将详细总结I2C总线信号时序，包括起始条件、数据传输、停止条件等。
1.总线状态2.起始条件起始条件是指从I2C主设备（Master）向I2C从设备（Slave）发送数据之前的一系列信号。
起始条件由两个信号组成：SCL（时钟）和SDA（数据）。
当SCL为高电平时，SDA发生一个下降沿，表示开始传输数据。
3.数据传输在数据传输阶段，数据位通过SCL时钟控制的边缘传输。
这个过程类似于同步串行通信协议。
数据的传输在I2C总线上是以字节为单位进行的，每个字节有8位（bit）。
数据传输过程中，SCL和SDA的状态发生变化的规则如下：-当SCL为低电平时，数据线SDA可以发生变化。
此时SDA数据线的电平变化将被忽略。
-当SCL为高电平时，SDA数据线的电平变化将被读取或写入。
4.读取数据在I2C总线上进行数据读取时，接收设备通常在时钟的上升沿读取数据。
主设备将在SCL为高电平时将数据传输到SDA数据线上。
而从设备将在SCL下降沿读取数据。
5.写入数据在I2C总线上进行数据写入时，发送设备通常在时钟的下降沿写入数据。
主设备在SCL为高电平时，将数据传输到SDA数据线上。
从设备将在SCL下降沿写入数据。
6.停止条件停止条件是指在I2C通信完成后，由主设备发送的一系列信号。
停止条件由两个信号组成：SCL（时钟）和SDA（数据）。
当SCL为高电平时，SDA发生一个上升沿，表示结束传输。
对于I2C总线信号时序的更详细说明可以如下：-在起始条件中，SCL先于SDA变为高电平。
SDA变化的任何时间必须在SCL变高之前完成。
起始条件的结束是在SCL为高电平时，SDA发生一个下降沿。
-在数据传输阶段，数据的传输是由主设备控制的，每个字节8位。
i2c操作时序
i2c操作时序I2C（Inter-Integrated Circuit）是一种串行通信协议，广泛应用于各种电子设备之间的数据传输。
它由飞利浦公司（现在的NXP半导体）在1982年推出，并且成为了一种广泛采用的标准。
I2C操作时序是指在I2C总线上进行数据传输时，相关信号的时序顺序。
I2C总线上有两种设备：主设备和从设备。
主设备负责发起传输和提供时钟信号，而从设备则被动接收传输和依赖于主设备提供的时钟。
I2C总线上的所有设备共享一个共同的时钟信号（SCL线）和数据信号（SDA线）。
在I2C操作时序中，包括了以下几个步骤：1.起始条件（Start condition）：主设备发送一个低电平脉冲到SDA线，而SCL线保持高电平。
这表示一个新的传输周期的开始。
2.地址和寻址（Address and addressing）：主设备发送一个地址字节来选择要与之通信的从设备。
地址字节由从设备的7位地址和一个读/写位组成。
读写位为0表示主设备要写入数据，为1表示主设备要读取数据。
3. ACK（Acknowledge）：接收到地址字节的从设备会返回一个应答位ACK。
主设备在发送地址或数据字节后会拉低SDA线，而从设备在SCL线上的一个时钟周期后将SDA线恢复为高电平。
如果从设备正常接收到了字节，它会将SDA线拉低表示应答。
如果从设备没有正确接收到字节，它会保持SDA线为高电平。
4.数据传输（Data transmission）：主设备根据需要发送或接收数据字节。
发送时，主设备在一个时钟周期内将数据字节写入SDA线，并且引脚保持稳定直到SCL线拉高。
发送完数据字节后，主设备释放SDA线以允许从设备进行检测和准备。
接收时，主设备将SDA线释放并等待从设备发送数据位。
从设备在每个时钟周期内向SDA线写入数据字节，并且在SCL线拉高之后主设备读取该字节。
5.停止条件（Stop condition）：主设备发送一个高电平脉冲到SDA线，而SCL线保持高电平。
I2C 总线协议时序编程
void WrRoROM (uchar Data[],uchar Address,uchar Num) //写多字节函数
{ //入口 为 要写的数组 Data[]
uchar i="0"; // 地址 Address
File Name: I2C.h
Author: bill
Created: 2007/12/12
Modified: NO
Revision: keil v3.0
fose=12M
*************************************************/
uchar *PData; // 字节数 Num
PData="Data";
Start();
Send(0xa0);
Ack();
Send (Address);
uchar *PData; //字节数 Num
PData="Data";
for(i=0;i<Num;i++)
{
Start();
Send(0xa0);
_nop_();
_nop_();
_nop_();
_nop_();
Scl="1";
_nop_();
_nop_();
_nop_();
_nop_();
_nop_();
if(temp&0x80)
Sda="1";
else
Sda="0";
Scl="1";
temp="Data"<<1;
I2C操作时序问题总结(内附大量实用代码和详解)
I2C 总线在单片机操作中用到的很多。
特别是以I2C总线进行数据和命令传输的器件，比如AT24C02存储芯片等。
特此做了相关操作过程中经常用到的操作和一些操作的解释。
相信看完之后，肯定会对I2C总线有深刻的理解。
I2C总线操作(从高位开始进行读写操作)写操作时序启动之后先进行一个字节的指令写入操作，然后进行应答；在进行字节数据的传送；然后再进行应答；I2C读操作时序基本上与写操作相同，不同的是读操作只需进行指令的写入，不写数据（应该不绝对），最后主机产生非应答信号，结束数据的读取；在对E2PROM（24C02）进行操作时，写入写操作指令后，然后写入需要操作的存储器地址号，最后写入数据。
且每个存储器地址只能赋值一次，重复对该存储器地址赋值会使前一个数据丢失。
读操作过程中需对将指令改写为读指令，在读取数据时需要写入指令指明需要读出数据时的存储器地址号下面是对24C02的写操作和读操作void write_add(uchar address,uchar date){start();write_byte(0xa0); //写指令respons();write_byte(address); //写入要操作的存储器地址respons();write_byte(date); //写入存储器数据respons();stop();}uchar read_add(uchar address){uchar date;start();write_byte(0xa0); //写入指令respons();write_byte(address); //写入读取操作时，要读取的存储器地址respons();stop();start();write_byte(0xa1); //写入指令，进行读操作respons();date=read_byte(); //进行读取数据norespons();stop();return date;}void main(){init();write_add(23,0xcc); //写入存储器地址号为23中，数据为0xcc delay1(100);P1=read_add(23); //读入存储器地址号为23中的数据，并将数据赋值给P1口，通过数码管显示while(1); //停留在此处}I2C串行总线的操作程序起始信号（时钟线为高，数据线由高变低）：void AT24C04_Start(){SDA = 1; //拉高数据线 SCL = 1; //拉高时钟线 Delay5us(); //延时SDA = 0; //产生下降沿 Delay5us(); //延时SCL = 0; //拉低时钟线}结束信号：（时钟线为高，数据线由低变高）void AT24C04_Stop(){SDA = 0; //拉低数据线 SCL = 1; //拉高时钟线 Delay5us(); //延时SDA = 1; //产生上升沿 Delay5us(); //延时}字节传输：（每个字节为8位，一个字节带一个相应位）发送数据：void AT24C04_SendByte(BYTE dat){BYTE i;for (i=0; i<8; i++) //8位计数器{dat <<= 1; //移出数据的最高位SDA = CY; //送数据口SCL = 1; //拉高时钟线Delay5us(); //延时SCL = 0; //拉低时钟线，以便下一次传送数据 Delay5us(); //延时}AT24C04_RecvACK();}接收数据：BYTE AT24C04_RecvByte(){BYTE i;BYTE dat = 0;SDA = 1; //使能内部上拉,准备读取数据for (i=0; i<8; i++) //8位计数器{dat <<= 1;SCL = 1; //拉高时钟线Delay5us(); //延时dat |= SDA; //读数据SCL = 0; //拉低时钟线以便下一个数据传送 Delay5us(); //延时}return dat;数据响应：每次数据传输成功后，接收器件发送一个应答信号，当第九个信号产生时，产生应答信号的器件将SDA拉低。
I2C总线的结构、工作时序与模拟编程
I2C总线的结构、工作时序与模拟编程I2C总线（Inter Integrated Circuit）是飞利浦公司于上个世纪80年代开发的一种“电路板级”的总线结构。
与其它串行接口相比，无论从硬件结构、组网方式、软件编程都有很大的不同。
在AT89C51系统上使用汇编语言模拟I2C总线的各种信号及编程原理，为自主开发、设计具有I2C总线接口的系统打下一个良好的基础，也为其它串口的模拟编程创造一个好的思路和可行的方法。
I2C总线的主要特点1. 二线制结构。
即双向的串行数据线SDA、串行同步时钟线SCL。
总线上的所有器件其同名端都分别挂在SDA、SCL线上（见图7.1）；2. I2C总线所有器件的SDA、SCL引脚的输出驱动都为漏极开路结构（见图7.2），通过外接上拉电阻将总线上所有节点的SDA、SCL信号电平实现“线与”的逻辑关系。
这不仅可以将多个节点器件按同名端引脚直接挂在SDA、SCL线上，还使I2C总线具备了“时钟同步”、确保不同工作速度的器件同步工作；3. 系统中的所有外围器件都具有一个7位的“从器件专用地址码”,其中高4位为器件类型地址（由生产厂家制定），低3位为器件引脚定义地址（由使用者定义），主控器件通过地址码建立多机通信的机制。
因此I2C总线省去了外围器件的片选线，这样无论总线上挂接多少器件，其系统仍然为简约的二线结构；4. I2C总线上的所有器件都具有“自动应答”功能，保证了数据交换的正确性；5. I2C总线系统具有“时钟同步”功能。
利用SCL线的“线与”逻辑协调不同器件之间的速度问题；6. 在I2C总线系统中可以实现“多主机（主控器）”结构。
依靠“总线仲裁”机制确保系统中任何一个主控器都可以掌握总线的控制权。
任何一个主控器之间没有优先级，没有中心主机的特权。
当多主机竞争总线时，依靠主控器对其SDA信号的“线与”逻辑，自动实现“总线仲裁”功能；7. I2C总线系统中的主控器必须是带CPU的逻辑模块；而被控器可以是无CPU的普通外围器件，也可以是具有CPU的逻辑模块。
2019年I2C总线时序详解
I2C总线时序详解I2C总线位传输由于连接到I2C 总线的器件有不同种类的工艺（、、双极性），逻辑0（低）和逻辑1（高）的电平不是固定的，它由电源VCC的相关电平决定，每传输一个数据位就产生一个时钟脉冲。
数据的有效性SDA 线上的数据必须在时钟的高电平周期保持稳定。
数据线的高或低电平状态只有在SCL 线的时钟信号是低电平时才能改变。
I2C位传输数据有效性起始和停止条件SCL 线是高电平时，SDA 线从高电平向低电平切换，这个情况表示起始条件；SCL 线是高电平时，SDA 线由低电平向高电平切换，这个情况表示停止条件。
起始和停止条件一般由主机产生，总线在起始条件后被认为处于忙的状态起始和停止条件，在停止条件的某段时间后总线被认为再次处于空闲状态。
如果产生重复起始条件而不产生停止条件，总线会一直处于忙的状态，此时的起始条件（S）和重复起始条件（Sr）在功能上是一样的。
I2C总线数据传输字节格式发送到SDA 线上的每个字节必须为8 位，每次传输可以发送的字节数量不受限制。
每个字节后必须跟一个响应位。
首先传输的是数据的最高位（MSB），如果从机要完成一些其他功能后（例如一个内部中断服务程序）才能接收或发送下一个完整的数据字节，可以使时钟线SCL 保持低电平，迫使主机进入等待状态，当从机准备好接收下一个数据字节并释放时钟线SCL 后数据传输继续。
应答响应数据传输必须带响应，相关的响应时钟脉冲由主机产生。
在响应的时钟脉冲期间发送器释放SDA 线（高）。
在响应的时钟脉冲期间，接收器必须将SDA 线拉低，使它在这个时钟脉冲的高电平期间保持稳定的低电平。
通常被寻址的接收器在接收到的每个字节后，除了用CBUS 地址开头的数。
I2C总线数据传输和应答据，必须产生一个响应。
当从机不能响应从机地址时（例如它正在执行一些实时函数不能接收或发送），从机必须使数据线保持高电平，主机然后产生一个停止条件终止传输或者产生重复起始条件开始新的传输。
I2C总线时序详解
I2C总线时序详解之阳早格格创做由于连交到I2C 总线的器件有分歧种类的工艺（CMOS、NMOS、单极性），逻辑0（矮）战逻辑1（下）的电仄不是牢固的，它由电源VCC的相闭电仄决断，每传输一个数据位便爆收一个时钟脉冲.数据的灵验性SDA 线上的数据必须正在时钟的下电仄周期脆持宁静.数据线的下大概矮电仄状态只有正在SCL 线的时钟旗号是矮电通常才搞改变 .I2C位传输数据灵验性起初战停止条件SCL 线是下电通常，SDA 线从下电仄背矮电仄切换，那个情况表示起初条件；SCL 线是下电通常，SDA 线由矮电仄背下电仄切换，那个情况表示停止条件.起初战停止条件普遍由主机爆收，总线正在起初条件后被认为处于闲的状态起初战停止条件，正在停止条件的某段时间后总线被认为再次处于空闲状态.如果爆收沉复起初条件而不爆收停止条件，总线会背去处于闲的状态，此时的起初条件（S）战沉复起初条件（Sr）正在功能上是一般的.字节圆法收支到SDA 线上的每个字节必须为8 位，屡屡传输不妨收支的字节数量不受节造.每个字节后必须跟一个赞同位.最先传输的是数据的最下位（MSB），如果从秘密完毕一些其余功能后（比圆一个里里中断服务步调）才搞交支大概收支下一个完备的数据字节，不妨使时钟线SCL 脆持矮电仄，迫使主机加进等待状态，当从机准备佳交支下一个数据字节并释搁时钟线SCL 后数据传输继承.应问赞同数据传输必须戴赞同，相闭的响当令钟脉冲由主机爆收.正在赞同的时钟脉冲功夫收支器释搁SDA 线（下）.正在赞同的时钟脉冲功夫，交支器必须将SDA 线推矮，使它正在那个时钟脉冲的下电仄功夫脆持宁静的矮电仄.常常被觅址的交支器正在交支到的每个字节后，除了用CBUS 天面启头的数 .I2C总线数据传输战应问据，必须爆收一个赞同.当从机不克不迭赞同从机天面时（比圆它正正在真止一些真时函数不克不迭交支大概收支），从机必须使数据线脆持下电仄，主机而后爆收一个停止条件末止传输大概者爆收沉复起初条件启初新的传输.如果从机交支器赞同了从机天面，然而是正在传输了一段时间后不克不迭交支更普遍据字节，主机必须再一次末止传输.那个情况用从机正在第一个字节后不爆收赞同去表示.从机使数据线脆持下电仄，主机爆收一个停止大概沉复起初条件.如果传输中有主机交支器，它必须通过正在从机不爆收时钟的末尾一个字节不爆收一个赞同，背从机收支器报告数据中断.从机收支器必须释搁数据线，允许主机爆收一个停止大概沉复起初条件.觅址办法7位觅址第一个字节的头7 位组成了从机天面，最矮位（LSB）是第8 位，它决断了传输的一般的战戴沉复启初条件的7位天面圆法目标.第一个字节的最矮位是“0”，表示主机会写疑息到被选中的从机；“1”表示主机会背从机读疑息，当收支了一个天面后，系统中的每个器件皆正在起初条件后将头7 位与它自己的天面比较，如果一般，器件会判决它被主机觅址，至于是从机交支器仍旧从机收支器，皆由R/W 位决断.10位觅址10位觅址战7 位觅址兼容，而且不妨分离使用.10位觅址采与了死存的1111XXX 动做起初条件（S），大概沉复起初条件（Sr ）的后第一个字节的头7 位.10 位觅址不会做用已有的7 位觅址，有7 位战10 位天面的器件不妨连交I2C总线10位天面圆法到相共的I2C 总线.它们皆能用于尺度模式（F/S）战下速模式（Hs）系统.死存天面位1111XXX 有8 个推拢，然而是惟有4 个推拢11110XX 用于10 位觅址，剩下的4个推拢11111XX 死存给后绝巩固的I2C 总线.10 位从机天面是由正在起初条件（S）大概沉复起初条件（Sr ）后的头二个字节组成.第一个字节的头7 位是11110XX 的推拢，其中末尾二位（XX）是10 位天面的二个最下位（MSB）.第一个字节的第8 位是R/W 位，决断了传输的目标，第一个字节的最矮位是“0”表示主机将写疑息到选中的从机，“1 ”表示主机将背从机读疑息.如果R/W 位是“0 ”，则第二个字节是10 位从机天面剩下的8 位；如果R/W 位是“1” 则下一个字节是从机收支给主机的数据.编写原段赶快战下速模式赶快模式器件不妨正在400kbit/s 下交支战收支.最小央供是：它们不妨战400kbit/s 传输共步，不妨延少SCL 旗号的矮电仄周期去减缓传输.赶快模式器件皆背下兼容，不妨战尺度模式器件正在0~100kbit/s 的I2C 总线系统通讯.然而是，由于尺度模式器件不进与兼容，所以不克不迭正在赶快模式I2C 总线系统中处事.赶快模式I2C 总线典型与尺度模式相比有以下特殊的特性：1、最大位速率减少到400kbit/s；2、安排了串止数据（SDA）战串止时钟（SCL ）旗号的时序；3、赶快模式器件的输进有压造毛刺的功能，SDA 战SCL输进有施稀特触收器；4、赶快模式器件的输出缓冲器对付SDA 战SCL 旗号的下落沿有斜率统造功能；5、如果赶快模式器件的电源电压被闭断，SDA 战SCL 的I/O 管足必须悬空，不克不迭阻塞总线；6、连交到总线的中部上推器件必须安排以符合赶快模式I2C 总线更短的最大允许降下时间.对付于背载最大是200pF 的总线，每条总线的上推器件不妨是一个电阻，对付于背载正在200pF~400pF 之间的总线，上推器件不妨是一个电流源（最大值3mA ）大概者是一个启闭电阻电路.下速模式（Hs 模式）器件对付I2C 总线的传输速度有具大的突破.Hs 模式器件不妨正在下达3.4Mbit/s 的位速率下传输疑息，而且脆持真足背下兼容赶快模式大概尺度模式（F/S 模式）器件，它们不妨正在一个速度混同的总线系统中单背通讯.Hs 模式传输除了不真止仲裁战时钟共步中，与F/S 模式系统有相共的串止总线协媾战数据圆法.下速模式下I2C 总线典型如下：1、Hs 模式主呆板件有一个SDAH 旗号的启漏输出缓冲器战一个正在SCLH 输出的启漏极下推战电流源上推电路.那个电流源电路支缩了SCLH 旗号的降下时间，所有时侯正在Hs 模式，惟有一个主机的电流源灵验；2、正在多主机系统的Hs 模式中，不真止仲裁战时钟共步，以加速位处理本领.仲裁历程普遍正在前里用F/S 模式传输主机码后中断；3、Hs 模式主呆板件以下电仄易矮电仄是1:2 的比率爆收一个串止时钟旗号.排除了修坐战脆持时间的时序央供；4、不妨采用Hs 模式器件有内修的电桥.正在Hs 模式传输中，Hs 模式器件的下速数据（SDAH）战下速串止时钟（SCLH ）线通过那个电桥与F/S 模式器件的SDA 战SCL 线分开启去.减少了SDAH 战SCLH 线的电容背载，使降下战下落时间更快；5、Hs 模式从呆板件与F/S 从呆板件的唯一不共是它们处事的速度.Hs 模式从机正在SCLH 战SDAH输出有启漏输出的缓冲器.SCLH 管足可选的下推晶体管不妨用于推少SCLH 旗号的矮电仄，然而只允许正在Hs 模式传输的赞同位后举止；6、Hs 模式器件的输出不妨压造毛刺，而且SDAH 战SCLH 输出有一个施稀特触收器；7、Hs 模式器件的输出缓冲器对付SDAH 战SCLH 旗号的下落沿有斜率统造功能.[1]1/******************************************** **************** 函数名：读一个字节数据** 出心参数: 无** 注意：** 证明：********************************************** *************/uchar I2cReadByte( void ){uchar rbyte = 0;uchar i = 0;for(i = 0; i < 8; i++ ){rbyte = rbyte << 1; //非常注意...此语句不搁正在循环体内末尾.SDA = 1; //SDA为输进SCL = 1;NOP_5;if( SDA == 1 )rbyte = rbyte | 0x01;SCL = 0;}return rbyte;}2从天面读数据第249止为什么还要加一个I2Cstart()?3为什么循环变量定义为uchar典型？4写字节子步调void I2c_Write_n( uchar DeviceAddress, uchar ByteAddress, uchar *Wdata, uchar n)第273止，为什么战睦读子步调（第250止）一般，将末尾一位形成整呢？5步调454止——456止，十位之后便加小数面，佳像分歧过失！！6 uchar I2cReadDataFromAddr( uchar DeviceAddress, uint ByteAddress )步调第。
i2c时序图的详细讲解
i2c时序图的详细讲解i2c时序图是一种重要的工具，可以帮助开发人员更好地理解I2C总线通信交换过程。
在这篇文章中，我们将详细介绍I2C时序图的概念，并讨论其主要元素和目的。
I2C时序图是一种用于帮助开发人员更好的理解I2C总线通信流程的工具。
它按照时间顺序展示I2C总线传输的信号和事件。
时序图是一种示意图，它用不同的颜色线来描述不同的时序信号，并附上关键时间延迟和其它信息，以帮助开发人员更好理解I2C总线通信过程。
I2C时序图由4个主要元素构成，它们分别是SDA（数据线）、SCL （时钟线）、ACK（应答确认）和Rx（接收）。
每个元素都有自己的特定功能，它们是I2C总线进行数据交换的基础。
SDA（数据线）是I2C总线上的双向数据传输线，它用来传输主机和从机之间的数据。
SCL（时钟线）是I2C总线上双向同步时钟传输线，它用于同步主机和从机之间的数据传输过程，以保证数据的有效性和正确性。
ACK（应答信号）是I2C总线上的双向应答接收确认线，用于确认双方之间的数据交互过程是否完成。
Rx（接收）是I2C 总线上单向数据接收信号，用于接收从机发出的数据。
I2C总线通信过程按照以下时序运行：1.发送Start Bit，2.发送从机地址，3.发送操作位，4.发送数据，5.发送结束位，6.发送ACK信号，7.接收数据，8.发送Stop Bit。
在I2C总线通信过程中，每一步都有它的关键时间延迟。
这些延迟确保了从机的有效反应时间，同时为主机和从机之间的数据传输提供了一个稳定的数据传输环境。
I2C时序图有助于帮助开发人员理解I2C总线通信过程，并确保程序的正确性和有效性。
时序图可以帮助开发人员发现和debug I2C 总线通信中出现的问题，提高设计的可靠性和可维护性。
I2C时序图是开发I2C总线通信应用的重要工具，它可以帮助开发人员更好地理解I2C总线通信，发现和debug I2C总线通信中出现问题，并保证程序的正确性和有效性。
I2C总线读时序的详解(新手必看)
I2C总线读时序的详解（新手必看）xx2013届大一新生I2c总线协议中的读时序与ds1302时钟芯片的读时序是有很大的区别的，ds1302时钟芯片是scl下降沿读取数据的，而i2c读时序和写时序其实是同一个图，只是读时序可以看成是芯片写数据给单片机。
以下是i2c读时序程序unsigned char RcvByte(){unsigned char retc;unsigned char BitCnt;retc=0;SDA=1;//置数据线为输入方式for(BitCnt=0;BitCnt<8;BitCnt++){_Nop();SCL=0;//置时钟线为低，让芯片刷新（改变）数据，准备发送数据到数据线上，_Nop();_Nop();//延时是为了让芯片有时间释放出数据到数据线上，_Nop();_Nop();_Nop();SCL=1;//通知单片机检测数据线是高电平还是低电平_Nop();_Nop();retc=retc<<1;if(SDA==1)retc=retc+1; //读数据位,接收的数据位放入retc中_Nop();_Nop();}SCL=0;_Nop();_Nop();return(retc);}以下是读时序还要注意的细节，对比下面两段for循环中的读取8位数据的程序一unsigned char RcvByte(){unsigned char retc;unsigned char BitCnt;retc=0;SDA=1;//置数据线为输入方式for(BitCnt=0;BitCnt<8;BitCnt++){SCL=0;SCL=1;//没有时间给芯片放出数据到数据线上，就通知单片机检测电平，错误！_Nop();_Nop();_Nop();_Nop();retc=retc<<1;if(SDA==1)retc=retc+1;_Nop();_Nop();}SCL=0;_Nop();_Nop();return(retc);}上面程序没有时间给芯片放出数据到数据线上，就通知单片机检测电平，错误！再看下面程序二unsigned char RcvByte(){unsigned char retc;unsigned char BitCnt;retc=0;SDA=1;//置数据线为输入方式for(BitCnt=0;BitCnt<8;BitCnt++){SCL=1;_Nop();_Nop();_Nop();_Nop();retc=retc<<1;if(SDA==1)retc=retc+1;_Nop();_Nop();SCL=0;//执行这语句后，接下来就会执行i++，相当于延时了一段时间}//给芯片放数据到数据线上_Nop();_Nop();return(retc);}有人可能会问程序二经过循环SCL=0放在后面和前面不是一样么？跟程序一不是一样的么？其实是不一样的，这是初学者常犯的错误。
i2c通信时序
i2c通信时序i2c通信是一种常见的串行数据通信协议，被广泛应用于各种电子设备中。
它是由Philips公司（现在的NXP半导体）在1982年推出的，因此也被称为“Phillips i2c”。
i2c通信有两根信号线，分别为SCL和SDA。
SCL线是时钟信号线，它用于同步数据的传输，SDA线则是数据信号线，用于传输数据。
i2c通信中，所有设备都通过SCL线共享同一个时钟信号，因此可以实现多个设备在同一时刻进行通信。
i2c通信的时序如下：首先，主控制器（例如微处理器）向总线上发送起始条件信号，即将SCL线保持高电平的同时将SDA线从高电平拉低。
接着，主控制器发送目标设备的地址，地址是由7位或10位二进制数表示的。
发送地址时，主控制器会在SDA线上连续发送地址的每一位，每发送完一位就要等待目标设备发送ACK信号，表示已收到该位地址。
当目标设备收到地址信息后，它可以根据地址来决定如何进行后续的通信。
接下来，主控制器可以发送数据到目标设备，或从目标设备读取数据。
发送数据时，主控制器会在SDA线上连续发送每个字节的数据，每发送完一个字节就要等待目标设备发送ACK信号，表示已收到该字节数据。
而从目标设备读取数据时，则是主控制器将SDA线拉低表示要读取，接着目标设备会将数据连续发送到SDA线上，主控制器每接收到一个字节就要向目标设备发送ACK信号。
最后，主控制器发送停止条件信号，即将SCL线保持高电平的同时将SDA线从低电平拉回高电平。
发送停止条件信号后，总线就空闲了，其他设备可以继续进行通信。
总之，i2c通信是一种简单、高效的串行通信协议，在很多应用场景中都能得到广泛的应用。
掌握i2c通信的时序，能够更好地理解它的工作原理，为进行相关应用提供帮助。
I2C总线完全版——I2C总线的结构工作时序与模拟编程
I2C总线完全版——I2C总线的结构工作时序与模拟编程I2C（Inter-Integrated Circuit）是一种常用的串行通信接口，用于连接微控制器、传感器、存储器等各种模块。
它具有简单、低成本、高可靠性等优点，被广泛应用于各种领域。
本文将详细介绍I2C总线的结构、工作时序和模拟编程。
一、I2C总线的结构在I2C总线结构中，还包括两类设备：主设备（Microcontroller）和从设备（Slave Device）。
主设备一般是微控制器或者芯片，负责控制整个通信过程；从设备则是各种模块，如传感器、存储器等，被主设备控制和访问。
二、I2C总线的工作时序1. 开始条件（Start Condition）：开始条件由主设备产生，即下降沿信号。
在开始条件下，SCL保持高电平，SDA从高电平跳变到低电平。
这个跳变信号标志着通信的开始。
2. 数据传输（Data Transfer）：在数据传输过程中，主设备发出读/写命令、地址和数据等，从设备则进行应答。
-读操作：主设备发出读命令和从设备地址，之后由从设备产生应答信号。
主设备继续读取数据，每读取一个字节，都需要由主设备发出应答信号来确认继续传输。
-写操作：主设备发出写命令和从设备地址，之后由从设备产生应答信号。
主设备将数据发送给从设备，然后继续发送下一个数据。
3. 结束条件（Stop Condition）：结束条件也由主设备产生，即上升沿信号。
在结束条件下，SDA从低电平跳变到高电平，表示数据传输结束。
三、I2C总线的模拟编程在控制器编程中，可以通过软件模拟I2C总线的通信过程，实现与从设备的数据交换。
1.初始化：初始化I2C总线，包括设置SCL和SDA为输出模式、将SCL和SDA线拉高等。
2.发送开始条件：发送开始条件的命令，即将SDA线从高电平跳变到低电平，并保持SCL线为高电平。
3.写操作：通过发送写命令和从设备地址，将需要写入的数据发送给从设备。
4.读操作：通过发送读命令和从设备地址，从从设备中读取数据。
I2C时序分析和基础知识总结
I2C时序分析和基础知识总结I2C（Inter-Integrated Circuit）是一种串行通信协议，用于在集成电路之间传输数据。
它由Philips公司在1980年代初开发，并在现代的许多嵌入式系统中得到了广泛应用。
本文将对I2C的时序分析和基础知识进行总结。
一、I2C的基础知识1.主从结构：I2C通信有一个主设备和一个或多个从设备，主设备控制整个通信过程，从设备接收和响应主设备的命令。
2.总线：I2C使用双线制，包括一个双向的数据线（SDA）和一个时钟线（SCL）。
所有设备都通过这两条线连接在一起形成一个总线。
3.地址：每个从设备在总线上都有一个唯一的7位或10位地址，用于识别设备。
4. 传输速率：I2C的传输速率通常有标准模式（100Kbps）、快速模式（400Kbps）和高速模式（3.4Mbps）三种选择。
5. 触发方式：I2C通信可以通过主设备发出开始条件（start condition）和停止条件（stop condition）来触发。
二、I2C的时序分析I2C通信的时序分析主要涉及到以下几个关键的时刻：1. 开始条件（Start Condition）：主设备拉低SDA线，然后拉低SCL线，在总线上发出一个开始信号。
2.地址传输：主设备发送从设备的地址，从设备通过检测总线上的地址匹配来判断自己是否被选中。
3.数据传输：在总线上的每个时钟周期内，数据（0或1）被传输。
4. 停止条件（Stop Condition）：主设备释放SDA线，然后拉高SCL线，在总线上发出一个停止信号。
5. 确认位（ACK bit）：在数据传输后，接收设备会发送一个ACK位，以确认接收到数据。
6. 重复启动条件（Repeated Start Condition）：主设备可以在传输过程中发出一个重复启动信号，以重新寻址或不释放总线。
对于每个操作，如读取或写入数据，都需要经历上述的流程，主设备通过时钟线控制整个通信的时序。
I2C总线信号时序总结
I2C总线信号时序总结I2C（Inter-Integrated Circuit）是一种串行通信协议，用于连接微控制器、传感器、存储器等芯片之间的通信。
它的工作原理是通过两根信号线，即SCL（串行时钟线）和SDA（串行数据线），实现设备之间的通信。
下面将对I2C总线信号的时序进行详细总结。
起始条件：当SDA信号先于SCL信号变为低电平时，表示通信即将开始，这就是起始条件。
停止条件：当SCL信号先于SDA信号变为高电平时，表示通信即将结束，这就是停止条件。
在起始和停止条件之后，我们需要考虑数据传输和应答的过程。
数据传输可以分为发送和接收两个过程。
发送数据：发送数据是指主设备将数据发送给从设备。
在SCL为低电平期间，主设备可以在SDA上进行数据传输。
接收数据：接收数据是指从设备将数据发送给主设备。
在SCL为高电平期间，从设备可以在SDA上进行数据传输。
在数据传输过程中，还有一个非常重要的环节是应答。
应答用于确认数据的传输是否成功。
主设备应答：在从设备发出数据位后，主设备需要将SDA拉低作为应答信号，通知从设备数据传输成功。
从设备应答：在主设备发出数据位后，从设备需要在SDA上拉低作为应答信号，通知主设备数据已接收。
时钟频率：I2C总线的时钟频率由主设备生成，通常主设备会通过时钟分频器来控制通信速率。
时钟稳定性：I2C总线的稳定性对于数据传输非常重要。
如果时钟信号不稳定，可能导致数据传输错误。
信号的高低电平：I2C总线的信号需要保持在有效电平范围内，通常在0V到Vcc之间。
总线释放：当I2C总线上的设备不发送或接收数据时，需要释放总线，即将SDA和SCL置于高电平状态。
总结起来，I2C总线信号的时序包括起始和停止条件、数据传输和应答、速率控制等方面。
它在通信过程中使用SCL和SDA两根信号线，通过起始和停止条件来指示通信的开始和结束，通过数据传输和应答来实现发送和接收数据，通过速率控制来控制通信速率。
这些时序要求保持稳定、准确和可靠，以确保正常的数据传输和通信。
I2C总线时序与数据传输.
16．1．2 I2C总线时序与数据传输当I2C总线处在空闲状态时，因为各设备都是开漏输出，所以在上拉电阻的作用下，SDA和SCL均为高电平。
I2C总线上启动一次数据传输过程的标志为主机发送的起始信号，起始信号的作用是通知从机准备接收数据。
当数据传输结束时，主机需要发送停止信号，通知从机停止接收。
因此，一次数据传输的整个过程由从起始信号开始，到停止信号结束。
同时这两个信号也是启动和关闭I“C设备的信号。
图16—2是I2C总线时序示意图，图中最左边和最右边给出了起始信号和停止信号的时序条件。
＞起始信号时序：当SCL为高电平时，SDA由高电平跳变到低电平。
＞停止信号时序：当SCL为高电平时，SDA由低电平跳变到高电平。
I2C总线规定，当SCL为高电平时，SDA的电平必须保持稳定不变的状态，只有当SCL处在低电平时，才可以改变SDA的电平值，但起始信号和停止信号是特例。
因此，当SCL处于高电平时，SDA的任何跳变都会被识别成为一个起始信号或停止信号。
因此在I2C总线上的数据传输过程中，数据信号线5DA的变化只能发生在SCL 为低电平的期间内。
从图16—2中间部分的时序中．可以清楚地看到这一点。
在I2C总线的数据传输过程中，发送到SDA信号线上的数据以字节为单位，每个字节必须为8位，而且是高位在前，低位在后，每次发送数据的字节数量不受限制。
但在这个数据传输过程中需要着重强调的是，当发送方发送完每一字节后，都必须等待接收方返回一个应答响应信号ACK，如图16—3所示。
响应信号ACK宽度为1位，紧跟在8个数据位后面，所以发送1字节的数据需要9个SCL时钟脉冲。
响应时钟脉冲也是由主机产生的，主机在响应时钟脉冲期间释放SDA线，使其处在高电平(见图16—3上面的信号)。
而在响应时钟脉冲期间，接收方需要将SDA拉低，使SDA在响应时钟脉冲高电平期间保持稳定的低电平(见图16—3中间的信号)。
实际上，图16—3中上面和中间的两个信号应该“线与”后呈现在SDA上的。
I2C总线协议及工作原理之欧阳治创编
I2C总线协议及工作原理I2C 总线协议及工作原理一、概述1、I2C总线只有两根双向信号线。
一根是数据线SDA，另一根是时钟线SCL。
SCL：上升沿将数据输入到每个EEPROM器件中；下降沿驱动EEPROM器件输出数据。
(边沿触发)SDA：双向数据线，为OD门，与其它任意数量的OD与OC门成"线与"关系。
I2C总线通过上拉电阻接正电源。
当总线空闲时，两根线均为高电平（SDL=1;SCL=1）。
连到总线上的任一器件输出的低电平，都将使总线的信号变低，即各器件的SDA及SCL都是线“与”关系。
2、主设备与从设备系统中的所有外围器件都具有一个7位的"从器件专用地址码"，其中高4位为器件类型，由生产厂家制定，低3位为器件引脚定义地址，由使用者定义。
主控器件通过地址码建立多机通信的机制，因此I2C总线省去了外围器件的片选线，这样无论总线上挂接多少个器件，其系统仍然为简约的二线结构。
终端挂载在总线上，有主端和从端之分，主端必须是带有CPU的逻辑模块，在同一总线上同一时刻使能有一个主端，可以有多个从端，从端的数量受地址空间和总线的最大电容 400pF的限制。
主端主要用来驱动SCL line；从设备对主设备产生响应；二者都可以传输数据，但是从设备不能发起传输，且传输是受到主设备控制的。
二、协议1.空闲状态I2C总线总线的SDA和SCL两条信号线同时处于高电平时，规定为总线的空闲状态。
此时各个器件的输出级场效应管均处在截止状态，即释放总线，由两条信号线各自的上拉电阻把电平拉高。
2.起始位与停止位的定义：起始信号：当SCL为高期间，SDA由高到低的跳变；启动信号是一种电平跳变时序信号，而不是一个电平信号。
停止信号：当SCL为高期间，SDA由低到高的跳变；停止信号也是一种电平跳变时序信号，而不是一个电平信号。
起始和终止信号都是由主机发出的，在起始信号产生后，总线就处于被占用的状态；在终止信号产生后，总线就处于空闲状态。
I2C总线入门(很详细,很经典)之欧阳术创编
I2C总线入门1）最近学习51单片机，学到A/D,D/A转换的时候发现我板子上的转换芯片不是书上所讲的ADC0804和DAC0832而是PCF8591T，看了一下它的数据手册，发现它并不是书上所说的并行传输数据，是使用 I2C 总线传输的。
搞了两天才搞懂，写出来给大家分享一下，不足之处请务必不吝指出。
以上是I2C总线的简单介绍。
就比如说AT24C02存储芯片，和PCF8591数模模数转换芯片都支持I2C端口。
（如下图）2）接下来看如何使用I2C总线进行通信以上是I2C总线通信的格式。
由上图可以看出进行通信需要以下几个步骤a.初始化I2C总线就是把SDA和SCL都变成高电平。
void init()//初始化{SDA=1;delay();SCL=1;delay();}delay（）为延时函数void delay()//延时4-5个微秒{;;}b.发送起始信号就是保持SCL为高电平，而SDA从高电平降为低电平（这是I2C总线的规定，别问我为什么）void start()//起始信号{SDA=1;delay();SCL=1;delay();SDA=0;delay();}c.发送地址字（芯片的硬件地址）（8591的数据手册）前四位对同一种芯片来说是固定的，不同的芯片之间不同。
就像pcf8591是1001而at24c02是1010接下来三位A0，A1，A2是可编程的三个地址位，这里说说的编程并不是通过软件编程，而是把A0，A1，A2三个引脚接不同的电压来确定数值。
接VCC表示1，接GND表示0。
为什么要有这三个呢？因为有可能你在I2C总线上“并联”了不止一个相同的元件（比如说接了三个8591），那你如何来分辨你要操作的是哪一个芯片呢，就是通过设置A0，A1，A2的数值，来区别。
可编程的地址一个有三位，也就是说最多可以接8个相同的芯片在同一个I2C总线上。
最后一位是读/写位，1为读，0为写。
@如何写数据写数据只需要按照时序图1.先将SCL置0（只有它为0的时候SDA才允许变化）2.改变SDA是数值（就是你当前要穿的一位是0还是1）3.把SCL置1（此时芯片就会读取总线上的数据）下面是代码#define uchar unsigned char#define uint unsigned intvoid write_byte(uchar date)//写一字节数据{uchar i,temp;temp=date;for(i=0;i<8;i++){temp=temp<<1;//左移一位移出的一位在CY中SCL=0;//只有在scl=0时sda能变化值delay();SDA=CY;delay();SCL=1;delay();}SCL=0;delay();SDA=1;delay();}发送地址的时候只需把地址传给该函数即可。
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I2C总线时序详解
欧阳家百（2021.03.07）
由于连接到I2C 总线的器件有不同种类的工艺（CMOS、NMOS、双极性），逻辑0（低）和逻辑1（高）的电平不是固定的，它由电源VCC的相关电平决定，每传输一个数据位就产生一个时钟脉冲。
数据的有效性
SDA 线上的数据必须在时钟的高电平周期保持稳定。
数据线的高或低电平状态只有在SCL 线的时钟信号是低电平时才能改变。
I2C位传输数据有效性
起始和停止条件
SCL 线是高电平时，SDA 线从高电平向低电平切换，这个情况表示起始条件；
SCL 线是高电平时，SDA 线由低电平向高电平切换，这个情况表示停止条件。
起始和停止条件一般由主机产生，总线在起始条件后被认为处于忙的状态
起始和停止条件
，在停止条件的某段时间后总线被认为再次处于空闲状态。
如果产生重复起始条件而不产生停止条件，总线会一直处于忙的状态，此时的起始条件（S）和重复起始条件（Sr）在功能上是一样的。
字节格式
发送到SDA 线上的每个字节必须为8 位，每次传输可以发送的字节数量不受限制。
每个字节后必须跟一个响应位。
首先传输的是数据的最高位（MSB），如果从机要完成一些其他功能后（例如一个内部中断服务程序）才能接收或发送下一个完整的数据字节，可以使时钟线SCL 保持低电平，迫使主机进入等待状态，当从机准备好接收下一个数据字节并释放时钟线SCL 后数据传输继续。
应答响应
数据传输必须带响应，相关的响应时钟脉冲由主机产生。
在响应的时钟脉冲期间发送器释放SDA 线（高）。
在响应的时钟脉冲期间，接收器必须将SDA 线拉低，使它在这个时钟脉冲的高电平期间保持稳定的低电平。
通常被寻址的接收器在接收到的每个字节后，除了用CBUS 地址开头的数。
I2C总线数据传输和应答
据，必须产生一个响应。
当从机不能响应从机地址时（例如它正在执行一些实时函数不能接收或发送），从机必须使数据线保持高电平，主机然后产生一个停止条件终止传输或者产生重复起始条件开始新的传输。
如果从机接收器响应了从机地址，但是在传输了一段时间后不能接收更多数据字节，主机必须再一次终止传输。
这个情况用从机在第一个字节后没有产生响应来表示。
从机使数据线保持高电平，主机产生一个停止或重复起始条件。
如果传输中有主机接收器，它必须通过在从机不产生时钟的最后一个字节不产生一个响应，向从机发送器通知数据结束。
从机发送器必须释放数据线，允许主机产生一个停止或重复起始条件。
寻址方式
7位寻址
第一个字节的头7 位组成了从机地址，最低位（LSB）是第8 位，它决定了传输的
普通的和带重复开始条件的7位地址格式
方向。
第一个字节的最低位是“0”，表示主机会写信息到被选中的从机；“1”表示主机会向从机读信息，当发送了一个地址后，系统中的每个器件都在起始条件后将头7 位与它自己的地址比较，如果一样，器件会判定它被主机寻址，至于是从机接收器还是从机发送器，都由R/W 位决定。
10位寻址
10位寻址和7 位寻址兼容，而且可以结合使用。
10位寻址采用了保留的1111XXX 作为起始条件（S），或重复起始条件（Sr ）的后第一个字节的头7 位。
10 位寻址不会影响已有的7 位寻址，有7 位和10 位地址的器件可以连接
I2C总线10位地址格式
到相同的I2C 总线。
它们都能用于标准模式（F/S）和高速模式（Hs）系统。
保留地址位1111XXX 有8 个组合，但是只有4 个组合11110XX 用于10 位寻址，剩下的4个组合11111XX 保留给后续增强的I2C 总线。
10 位从机地址是由在起始条件（S）或重复起始条件
（Sr ）后的头两个字节组成。
第一个字节的头7 位是11110XX 的组合，其中最后两位（XX）是10 位地址的两个最高位（MSB）。
第一个字节的第8 位是R/W 位，决定了传输的方向，第一个字节的最低位是“0”表示主机将写信息到选中的从机，“1 ”表示主机将向从机读信息。
如果R/W 位是“0 ”，则第二个字节是10 位从机地址剩下的8 位；如果R/W 位是“1” 则下一个字节是从机发送给主机的数据。
编辑本段快速和高速模式
快速模式
快速模式器件可以在400kbit/s 下接收和发送。
最小要求是：它们可以和400kbit/s 传输同步，可以延长SCL 信号的低电平周期来减慢传输。
快速模式器件都向下兼容，可以和标准模式器件在0~100kbit/s 的I2C 总线系统通讯。
但是，由于标准模式器件不向上兼容，所以不能在快速模式I2C 总线系统中工作。
快速模式I2C 总线规范与标准模式相比有以下额外的特征：
1、最大位速率增加到400kbit/s；
2、调整了串行数据（SDA）和串行时钟（SCL ）信号的时序；
3、快速模式器件的输入有抑制毛刺的功能，SDA 和SCL输入有施密特触发器；
4、快速模式器件的输出缓冲器对SDA 和SCL 信号的下降沿有斜率控制功能；
5、如果快速模式器件的电源电压被关断，SDA 和SCL 的I/O 管脚必须悬空，不能阻塞总线；
6、连接到总线的外部上拉器件必须调整以适应快速模式
I2C 总线更短的最大允许上升时间。
对于负载最大是200pF 的总线，每条总线的上拉器件可以是一个电阻，对于负载在
200pF~400pF 之间的总线，上拉器件可以是一个电流源（最大值3mA ）或者是一个开关电阻电路。
高速模式
高速模式（Hs 模式）器件对I2C 总线的传输速度有具大的突破。
Hs 模式器件可以在高达3.4Mbit/s 的位速率下传输信息，而且保持完全向下兼容快速模式或标准模式（F/S 模式）器件，它们可以在一个速度混合的总线系统中双向通讯。
Hs 模式传输除了不执行仲裁和时钟同步外，与F/S 模式系统有相同的串行总线协议和数据格式。
高速模式下I2C 总线规范如下：
1、Hs 模式主机器件有一个SDAH 信号的开漏输出缓冲器和一个在SCLH 输出的开漏极下拉和电流源上拉电路。
这个电流源电路缩短了SCLH 信号的上升时间，任何时侯在Hs 模式，只有一个主机的电流源有效；
2、在多主机系统的Hs 模式中，不执行仲裁和时钟同步，以加速位处理能力。
仲裁过程一般在前面用F/S 模式传输主机码后结束；
3、Hs 模式主机器件以高电平和低电平是1:2 的比率产生一个串行时钟信号。
解除了建立和保持时间的时序要求；
4、可以选择Hs 模式器件有内建的电桥。
在Hs 模式传输中，Hs 模式器件的高速数据（SDAH）和高速串行时钟
（SCLH ）线通过这个电桥与F/S 模式器件的SDA 和SCL 线分隔开来。
减轻了SDAH 和SCLH 线的电容负载，使上升和下降时间更快；
5、Hs 模式从机器件与F/S 从机器件的唯一差别是它们工作的速度。
Hs 模式从机在SCLH 和SDAH输出有开漏输出的缓冲
器。
SCLH 管脚可选的下拉晶体管可以用于拉长SCLH 信号的低电平，但只允许在Hs 模式传输的响应位后进行；
6、Hs 模式器件的输出可以抑制毛刺，而且SDAH 和SCLH 输出有一个施密特触发器；
7、Hs 模式器件的输出缓冲器对SDAH 和SCLH 信号的下降沿有斜率控制功能。
[1]
1/************************************************* *********
** 函数名：读一个字节数据
** 入口参数: 无
** 注意：
** 说明：
*************************************************** ********/
uchar I2cReadByte( void )
{
uchar rbyte = 0;
uchar i = 0;
for(i = 0; i < 8; i++ )
{
rbyte = rbyte << 1; //非常注意...此语句不放在循环体内
最后.
SDA = 1; //SDA为输入
SCL = 1;
NOP_5;
if( SDA == 1 )
rbyte = rbyte | 0x01;
SCL = 0;
}
return rbyte;
}
2从地址读数据
第249行为什么还要加一个I2Cstart()?
3为什么循环变量定义为uchar类型？
4写字节子程序
void I2c_Write_n( uchar DeviceAddress, uchar ByteAddress, uchar *Wdata, uchar n)
第273行，为什么不和读子程序（第250行）一样，将最后一位变成零呢？
5程序454行——456行，十位之后就加小数点，好像不对！！
6 uchar I2cReadDataFromAddr( uchar DeviceAddress, uint ByteAddress )
程序第。