第8章 并行接口和串行接口PPT课件
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图8.2 8255A的内部结构框图
控制端口 未画出
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(1)三个输入/输出端口
端口A:8位双向I/O口。
输入锁存、输出锁存/缓冲。 工作在方式 :0、1、2;
端口B:8位双向I/O口。 输入锁存、输出锁存/缓冲。 工作在方式 :0、1;
2010 copyright / 12
微型计算机原理及应用
主讲教师:XXX 系部:XXXXXXXX
2010 copyright / 1
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概述
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2010 copyright / 2
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第8章 并行接口与串行接口
§8.1 并行接口 §8.2 串行通信
2010 copyright / 3
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可编程并行接口芯片 例如: 通用可编程并行接口芯片有8155A/8156A、
8255A等。
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用I/O写信号作锁存控制
2010 copyright / 8
图8.1 简单并行接口
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✓ 适用场合:传输速率要求高,而传输距离较近的场合。
并行输入口
✓ 并行接口类型: 并行输出口
并行输入/输出口
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硬件实现
简单并行接口
例如:可用锁存器/驱动器74LS244或74LS373等构 成简单并行输入或输出接口,用74LS245等可构成双 向并行接口。
2010 copyright / 13
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A组控制:控制PA7~PA0和PC7~PC4
(2)两组控制电路:
B组控制:控制(PB7~PB0和PC3~PC0
CPU通过8255A输入的数据 CPU通过8255A输出的数据
(3)数据总线缓冲器:传送的信息
CPU写给8255A的控制字 CPU从8255A读入的状态字
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数据 总线 数据总线
缓冲器
A组 控制
RD
WR A1
A0
读/写 控制逻辑
RESET
CS
B组 控制
端口A
PA7~PA0
端口C 上半部分
端口C 下半部分
端口B
PC7~PC4 PC3~PC0 PB7~PB0
2010 copyright / 11
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§8.1 并行接口
§8.1.1 并行接口技术概述 §8.1.2 可编程并行接口芯片8255A
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§8.1.1 并行接口技术概述
并行接口:实现并行传送的接口就是并行接口。
✓ 并行传送的特点:
在同样的时钟速率下其传送速率高,但远距离传送成本较高。
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可编程并行接口的典型硬件结构
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§8.1.2 可编程并行接口芯片8255A
1. 8255A的内部结构
A端口
B端口 四个端口寄存器:C端口
控制端口
两组控制电路
8255A内部结构:一个数据总线缓冲器
一个读/写控制逻辑电路
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8255A的引脚信号
(2)地址线
A1、A0:输入。 用于寻址8255A内部各端口,A1、A0的不同状态与各
端口的对应关系如下:
8255A
PA4 PA5 PA6 PA7 WR RESET D0 D1 D2 D3 D4 D5 D6 D7 Vcc PB7 PB6 PB5 PB4 PB3
计算机学院图《微8型计.3算机原8理2及5应5用A》引脚图16
8255A的引脚信号
(1)数据线 D7~D0:双向三态。
用于传送:
CPU从8255A各端口读入的数据; CPU向8255A各端口写出的数据; CPU从8255A各端口读入的状态; CPU向8255A写出的控制字。
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2. 8255A的引脚信号
8255A是一个40引 脚双列直插的集成芯片
其引脚分为五类:
1、数据线 2、地址线 3、控制线 4、I/O端口线 5、电源与地线
2010 copyright / 16
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PA3 PA2 PA1 PA0 RD CS GND
A1 A0 PC7 PC6 PC5 PC4 PC3 PC2 PC1 PC0 PB0 PB1 PB2
状态字由C口读入,反映方式1和2的中断允许及联络信号情况
2010 copyright / 14
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(4)读/写控制电路: 接收CPU来的地址和控制信号,控制8255A完成读写操作 。
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(1)三个输入/输出端口(续)
端口C: 8位双向I/O口。 输入不锁存、输出锁存。 工作在方式 :方式0和按位置位/复位方式。
另外:当端口A、B工作在方式1和端口A工作在方 式2时,C口作为联络信号使用。故将端口C分为上 C口(PC7~PC4)和下C口(PC3~PC0),分别Βιβλιοθήκη Baidu由A、B口两组控制电路控制。
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两种基本的数据传送方式:
计算机中:串行数据传送方式和并行数据传送方式。 在通信中:则称为串行通信和并行通信。
串行数据传送方式 不同权值的数据位在单条一位宽的传输线上按时间先
后一位一位地传送。
并行数据传送方式 不同权值的数据位在多条并行传输线上同时传送。
2010 copyright / 4
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