常见硬件工程师笔试题(标准答案)
硬件工程师招聘笔试题与参考答案(某大型央企)2025年
2025年招聘硬件工程师笔试题与参考答案(某大型央企)(答案在后面)一、单项选择题(本大题有10小题,每小题2分,共20分)1、在数字逻辑电路设计中,最基本的逻辑门不包括以下哪一种?A. 与门B. 或门C. 非门D. 同或门2、在计算机系统中,用来存放CPU当前正在执行的指令的寄存器是?A. 程序计数器(PC)B. 指令寄存器(IR)C. 数据寄存器(DR)D. 状态寄存器(SR)3、以下哪个不是硬件工程师在电路设计中需要遵循的原则?A、可靠性原则B、经济性原则C、环保性原则D、美观性原则4、在数字电路中,一个标准的TTL与非门输入端接有3个低电平信号,输出端接有4个高电平信号,该与非门的输入逻辑表达式为:A、Y = AB’ + C’D’B、Y = A + B + C + DC、Y = AB + CDD、Y = A’ + B’ + C’ + D’5、以下哪种类型的存储器在计算机系统中通常用作主存储器?A. 硬盘驱动器(HDD)B. 固态硬盘(SSD)C. 只读存储器(ROM)D. 动态随机存取存储器(DRAM)6、在硬件设计中,以下哪种接口用于连接计算机与外部显示设备?A. USBB. SATAC. PCIeD. HDMI7、题干:以下哪种电子元件在数字电路中主要用作存储信息?A. 电阻B. 电容C. 晶体管D. 寄存器8、题干:在计算机系统中,以下哪个部件负责将用户输入的字符转换成相应的ASCII码?A. 中央处理器(CPU)B. 存储器C. 输入设备D. 输出设备9、在以下哪种情况下,一个数字信号被描述为“过采样”?A. 采样频率低于奈奎斯特频率B. 采样频率等于奈奎斯特频率C. 采样频率高于奈奎斯特频率D. 采样频率低于信号的最高频率 10、在数字信号处理中,以下哪个概念与“零阶保持器”相对应?A. 滤波器B. 离散傅里叶变换(DFT)C. 滑动平均滤波器D. 零阶保持器二、多项选择题(本大题有10小题,每小题4分,共40分)1、题干:以下哪些技术属于硬件工程师在嵌入式系统设计中常用的技术?()A、C语言编程B、Verilog或VHDL硬件描述语言C、PCB设计D、Linux操作系统E、数字信号处理2、题干:以下哪些硬件接口属于USB接口标准的一部分?()A、USB 1.1B、USB 2.0C、USB 3.0D、USB Type-CE、串行接口(RS-232)3、以下哪些技术或设备属于硬件工程师在嵌入式系统开发中常用的?()A. ARM处理器B. FPGA(现场可编程门阵列)C. 磁盘阵列D. USB接口4、在硬件设计过程中,以下哪些测试方法可以帮助硬件工程师验证电路设计的正确性?()A. 功能仿真B. 实验室测试C. 现场调试D. 用户反馈5、以下哪些是硬件工程师在设计和验证电路时需要考虑的电气特性?()A. 电压波动B. 电流稳定性C. 信号完整性D. 热设计E. 电磁兼容性6、以下关于SMT(表面贴装技术)的说法,正确的是?()A. SMT可以提高电路的组装密度B. SMT可以提高电路的可靠性C. SMT对电路板的设计要求较高D. SMT的制造成本较高E. SMT适用于大规模生产7、以下哪些属于硬件工程师在产品设计阶段需要考虑的因素?()A. 成本控制B. 可靠性设计C. 易用性设计D. 环境适应性设计E. 法律法规要求8、以下关于硬件测试的描述,正确的是?()A. 硬件测试分为功能测试、性能测试、兼容性测试等B. 功能测试主要检查硬件的功能是否满足设计要求C. 性能测试主要检查硬件的性能指标是否达到设计目标D. 兼容性测试主要检查硬件在不同操作系统、软件环境下的运行情况E. 以上都是9、以下哪些组件属于硬件工程师在设计和制造嵌入式系统时可能需要使用的?()A、微控制器(MCU)B、场效应晶体管(MOSFET)C、可编程逻辑器件(PLD)D、光耦合器E、RF模块 10、下列哪些技术或方法在硬件设计过程中有助于提高系统的可靠性?()A、冗余设计B、热设计分析C、电磁兼容性(EMC)测试D、故障检测和自恢复机制E、材料老化测试三、判断题(本大题有10小题,每小题2分,共20分)1、硬件工程师在进行电路板设计时,只需要考虑电路的电气性能,无需考虑机械结构设计。
硬件工程师笔试题目
硬件工程师笔试题1、电磁干扰的三要素是什么答:电磁干扰源、干扰传播路径和干扰敏感设备2、LCL滤波器的优点答:LCL型滤波器属于三阶滤波器,与前他滤波器相比其具有突出的优越性,在相同的谐波要求下,比其他型电感值、电容值更小,从而显著地节省材料、减少系统成本并降低损耗。
LCL型滤波器对高频谐波的抑制能力极强,并且网侧电感对冲击电流有较强的抑制能力。
3、差分线走线有两个原则:等长和等距。
但在实际布线中可能无法两者都完全满足,那么请问是等长优先还是等距优先?并说明原因。
答:应该等长优先,差分信号是以信号的上升沿和下降沿的交点作为信号变化点的,走线不等长的话会使这个交点偏移,对信号的时序影响较大,另外还给差分信号中引入了共模的成分,降低信号的质量,增加了EMI。
4、压敏电阻的工作原理答:当压敏电阻上的电压超过一定幅度时,电阻的阻值降低,从而将浪涌能量泄放掉,并将浪涌电压限制在一定的幅度。
5、寄生电容和寄生电感产生的影响答:寄生电容会延长信号的上升时间,降低电路的速度。
寄生电感会削弱旁路电容的贡献,减弱整个电源系统的滤波效果。
6、如何消除寄生电容答:(1)增加导体间隙,(2)适当使用地平面,(3)减小过孔7、逆变器常用的拓扑结构答:Boost电路8、常用MPPT算法有哪些答:恒压法、扰动观察法、电导增量法、模糊法、神经元网络法等9、IGBT和MOSFET的区别答:MOSFET可以做到电流很大,可以到上KA,但耐压能力没有IGBT强。
IGBT可以做很大功率,电流和电压都可以,就是一点频率不是太高,目前IGBT 硬开关速度可以到100KHZ,那已经是不错了。
不过相对于MOSFE的工作频率还是九牛一毛,MOSFET可以工作到几百KHZ、MHZ,以至几十MHZ。
10、高频逆变器和工频逆变器的原理区别答:高频逆变器是采用高频变压器升压的逆变电路。
先通过高频变换技术,将低压直流电逆变为低压交流电,经过高频变压器升压后,再经过高频整流滤波电路整流成高压直流电,最后通过逆变电路得到交流电供负载使用。
硬件工程师笔试试题集锦(均有参考答案)
(2)
注意适当加入旁路电容与时测试用; 注意适当加入 0 欧电阻、电感和磁珠以实现抗干扰和阻抗匹配; PCB 设计阶段 自己设计的元器件封装要特别注意以防止板打出来后元器件无法焊接; FM 部分走线要尽量短而粗,电源和地线也要尽可能粗; 旁路电容、晶振要尽量靠近芯片对应管脚; 注意美观与使用方便; 说明自己需要的工艺以及对制板的要求; 防止出现芯片焊错位置,管脚不对应; 防止出现虚焊、漏焊、搭焊等; 先调试电源模块,然后调试控制模块,然后再调试其它模块; 上电时动作要迅速,发现不会出现短路时在彻底接通电源; 调试一个模块时适当隔离其它模块; 各模块的技术指标一定要大于客户的要求; 由于整机调试时仍然会出现很多问题,而且这些问题往往更难解决,如
1、下面是一些基本的数字电路知识问题,请简要回答之。 (1) 什么是 Setup 和 Hold 时间? 答:Setup/Hold Time 用于测试芯片对输入信号和时钟信号之间的时间要求。 建立时间(Setup Time)是指触发器的时钟信号上升沿到来以前,数据能够保持稳 定不变的时间。 输入数据信号应提前时钟上升沿(如上升沿有效)T 时间到达芯片, 这个 T 就是建立时间通常所说的 Setup Time。如不满足 Setup Time,这个数据就 不能被这一时钟打入触发器,只有在下一个时钟上升沿到来时,数据才能被打入 触发器。 保持时间(Hold Time)是指触发器的时钟信号上升沿到来以后,数据保 持稳定不变的时间。如果 Hold Time 不够,数据同样不能被打入触发器。 (2) 什么是竞争与冒险现象?怎样判断?如何消除? 答:在组合逻辑电路中,由于门电路的输入信号经过的通路不尽相同,所产 生的延时也就会不同,从而导致到达该门的时间不一致,我们把这种现象叫做竞 争。由于竞争而在电路输出端可能产生尖峰脉冲或毛刺的现象叫冒险。如果布尔 式中有相反的信号则可能产生竞争和冒险现象。解决方法:一是添加布尔式的消 去项,二是在芯片外部加电容。 (3) 请画出用 D 触发器实现 2 倍分频的逻辑电路? 答:把 D 触发器的输出端加非门接到 D 端即可,如下图所示:
常见硬件工程师笔试题(标准答案)
硬件工程师笔试题一、电路分析:1、竞争与冒险在组合逻辑中,在输入端的不同通道数字信号中经过了不同的延时,导致到达该门的时间不一致叫竞争。
因此在输出端可能产生短时脉冲(尖峰脉冲)的现象叫冒险。
常用的消除竞争冒险的方法有:输入端加滤波电容、选通脉冲、修改逻辑设计等。
2、同步与异步同步逻辑是时钟之间有固定的因果关系。
异步逻辑是各时钟之间没有固定的因果关系。
同步电路:存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源,因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。
异步电路:电路没有统一的时钟,有些触发器的时钟输入端与时钟脉冲源相连,只有这些触发器的状态变化与时钟脉冲同步,而其它的触发器的状态变化不与时钟脉冲同步。
异步电路不使用时钟脉冲做同步,其子系统是使用特殊的“开始”和“完成”信号使之同步同步就是双方有一个共同的时钟,当发送时,接收方同时准备接收。
异步双方不需要共同的时钟,也就是接收方不知道发送方什么时候发送,所以在发送的信息中就要有提示接收方开始接收的信息,如开始位,结束时有停止位3、仿真软件:Proteus4、Setup 和Hold timeSetup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。
建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。
输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。
保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。
如果hold time不够,数据同样不能被打入触发器。
5、IC设计中同步复位与异步复位的区别同步复位在时钟沿采集复位信号,完成复位动作。
异步复位不管时钟,只要复位信号满足条件,就完成复位动作。
异步复位对复位信号要求比较高,不能有毛刺,如果其与时钟关系不确定,也可能出现亚稳态。
硬件工程师招聘笔试题及解答(某大型国企)
招聘硬件工程师笔试题及解答(某大型国企)(答案在后面)一、单项选择题(本大题有10小题,每小题2分,共20分)1、以下哪个不是硬件工程师常用的电子设计自动化(EDA)工具?A、Altium DesignerB、CadenceC、Microsoft OfficeD、Eagle2、在数字电路设计中,以下哪种电路具有非破坏性读出特性?A、SR锁存器B、D触发器C、JK触发器D、T触发器3、以下哪种电子元件在电路中主要起到整流作用?()A. 电阻B. 电容C. 二极管D. 电感4、以下哪个参数是衡量晶体管放大能力的指标?()A. 饱和电压B. 开关电压C. 共基极电流增益D. 共射极电流增益5、某硬件工程师在进行电路设计时,需要选择一种适合高速信号传输的传输线。
以下选项中,哪一种传输线最适合高速信号传输?A. 同轴电缆B. 双绞线C. 无线传输D. 平行电缆6、在硬件设计中,以下哪个元件通常用于将模拟信号转换为数字信号?A. 运算放大器B. 电压比较器C. 模数转换器(ADC)D. 集成运算放大器7、在硬件设计中,以下哪种接口通常用于高速数据传输?A、USB接口B、I2C接口C、SPI接口D、PCI接口8、在硬件电路设计中,以下哪种元件通常用于产生稳定的直流电压?A、电阻B、电容C、二极管D、稳压二极管9、在数字电路中,用于表示逻辑状态的高电平通常指的是:A. 5VB. 3.3VC. 2.5VD. 1.8V 10、以下哪种类型的存储器在断电后会丢失存储的数据?A. 只读存储器(ROM)B. 随机存取存储器(RAM)C. 闪存(Flash Memory)D. 静态随机存取存储器(SRAM)二、多项选择题(本大题有10小题,每小题4分,共40分)1、以下哪些技术属于嵌入式系统硬件设计常用的技术?()A. 数字电路设计B. 模拟电路设计C. PCB(印刷电路板)设计D. 微控制器编程E. FPGA(现场可编程门阵列)设计2、在硬件工程师面试中,以下哪些指标可以用来评估候选人的硬件设计能力?()A. 熟悉的硬件设计工具B. 具有实际硬件项目经验C. 硬件故障诊断能力D. 对硬件设计规范的掌握程度E. 团队协作和沟通能力3、以下哪些组件属于硬件工程师在设计中需要考虑的关键硬件组件?()A. 微处理器B. 电源管理芯片C. 传感器D. 显示屏E. 集成电路(IC)4、在以下关于硬件设计规范的描述中,哪些是硬件工程师在编写硬件设计规范时应该包含的内容?()A. 设计目标和功能需求B. 硬件选型标准和规范C. 设计原理和算法描述D. PCB布局和布线原则E. 测试方法和验收标准5、以下哪些元件属于被动元件?()A. 电容B. 电感C. 变压器D. 晶体管6、在以下选项中,哪些是常见的数字信号处理算法?()A. 快速傅里叶变换(FFT)B. 滤波算法C. 神经网络算法D. 傅里叶级数7、以下哪些是硬件工程师在电路设计中需要考虑的关键因素?()A. 电源稳定性B. 热设计C. 电磁兼容性D. 成本控制E. 电路可靠性8、以下哪些是硬件工程师在项目实施过程中需要遵循的基本原则?()A. 遵循设计规范B. 优先考虑用户体验C. 保证设计可维护性D. 重视项目进度管理E. 注重团队合作9、以下哪些属于硬件工程师在电路设计时需要考虑的电磁兼容性(EMC)问题?A. 电路中的辐射干扰B. 电路对外的干扰C. 电路对电源的干扰D. 电路对同轴电缆的干扰 10、以下哪些是硬件工程师在PCB(印刷电路板)设计时需要遵守的原则?A. 高速信号走线采用差分信号传输B. 电源和地线设计应尽量短且宽C. 同一电源和地线应尽量走直线D. 避免信号走线在PCB边缘附近三、判断题(本大题有10小题,每小题2分,共20分)1、硬件工程师在设计和开发过程中,无需考虑电磁兼容性(EMC)的问题。
硬件工程师考试题
硬件工程师考试题1.集成运放的输入级采用差分放大电路是因为可以。
[单选题] *A.增大放大倍数B.减小温漂(正确答案)C.提高输入电阻D.提高输出电阻2.用万用表测二极管的正、反向电阻来判断二极管的好坏,好的管子应为。
[单选题] *A.正、反向电阻相等B.正向电阻大,反向电阻小C.反向电阻比正向电阻大很多倍(正确答案)D.正、反向电阻都等于无穷大3.某放大电路中三极管的三个管脚的电位分别为U1=6V、U2=5.4V、U3=12V,则对应该管的管脚排列依次是。
[单选题] *e,b,cb,e,c(正确答案)b,c,ec,b,e4.在单管固定偏置共射极放大电路中,若测得三极管的静态管压降UCE近似等于电源电压UCC时(无电流),则该管工作状态为。
[单选题] *A.饱和B.截止(正确答案)C.放大D.不能确定5.场效应管起放大作用时应工作在漏极特性的。
[单选题] *A.非饱和区B.饱和区(正确答案)C.截止区D.击穿区6.下列选项中,不属三极管的参数是。
[单选题] *A.电流放大系数B.最大整流电流(正确答案)C.集电极最大允许电流D.集电极最大允许耗散功率7. 测试放大电路输出电压幅值与相位的变化,可得到它的频率响应,条件是。
[单选题] *A.输入电压幅值不变,改变频率。
(正确答案)B. 输入电压频率不变,改变幅值C.输入电压的幅值与频率同时变化。
8.两个电阻并联时电阻值为2.5Ω,串联时电阻值为10Ω,则两个电阻值。
[单选题] *A.一定都是5Ω(正确答案)B.可能都是5ΩC.可能一个是10ΩD.其值不定9.功率因数定义为。
[单选题] *A.无功功率与有功功率的比值B.有功功率与无功功率的比值C.视在功率与有功功率的比值D.有功功率与视在功率的比值(正确答案)10.当电路发生串联谐振时。
[单选题] *A.电路中电流最大(正确答案)B.电路中电阻两端电压最小C.电路吸收的功率最小11.将标有额定值为“220V、100W”和“220V、25W”白炽灯两盏,将其串联后接入220V工频交流电源上,其亮度情况是。
硬件工程师招聘笔试题及解答
招聘硬件工程师笔试题及解答(答案在后面)一、单项选择题(本大题有10小题,每小题2分,共20分)1、以下哪种元件不属于半导体器件?A、二极管B、晶体管C、电阻D、电容2、在数字电路中,以下哪种逻辑门可以实现“非”功能?A、与门(AND Gate)B、或门(OR Gate)C、异或门(XOR Gate)D、非门(NOT Gate)3、在数字电路设计中,以下哪种逻辑门可以实现与或非(NAND)功能?A. 与门(AND)B. 或门(OR)C. 非门(NOT)D. 或非门(NOR)4、在微处理器中,以下哪个寄存器通常用于存储指令的地址?A. 数据寄存器(Data Register)B. 累加器(Accumulator)C. 程序计数器(Program Counter,PC)D. 指令寄存器(Instruction Register,IR)5、在数字电路中,以下哪种电路能够实现逻辑或(OR)功能?A. 与门(AND Gate)B. 非门(NOT Gate)C. 异或门(XOR Gate)D. 或门(OR Gate)6、在下列存储器中,哪一种存储器的数据在断电后会丢失?A. 只读存储器(ROM)B. 随机存取存储器(RAM)C. 闪存(Flash Memory)D. 硬盘驱动器(HDD)7、以下哪个不属于硬件工程师在PCB(印刷电路板)设计中需要考虑的关键因素?A. 元器件的布局和布线B. 信号完整性C. 元件的温度特性D. 软件编程8、在硬件电路设计中,以下哪种测试方法主要用于验证电路的电气性能?A. 功率测试B. 耐压测试C. 功能测试D. 耐久性测试9、在硬件设计中,以下哪个是用于描述电路元件在电路中相互连接的方式?A. 逻辑门B. 电路图C. 电路板布局D. 元件规格书二、多项选择题(本大题有10小题,每小题4分,共40分)1、以下哪些元件属于数字电路中的基本逻辑门?()A、电阻B、二极管C、三极管D、与门(AND gate)E、或门(OR gate)2、以下关于电路板设计的描述,哪些是正确的?()A、电路板设计应遵循最小化走线长度原则B、电源和地线应设计为粗线以减少电阻C、高电流路径应避免与其他信号线并行D、电路板设计应考虑电磁兼容性(EMC)E、元件布局应尽量紧凑,以提高电路板的密度3、以下哪些技术或工具通常用于硬件工程师的日常工作中?()A. PCB设计软件(如Altium Designer、Eagle)B. 仿真软件(如SPICE、LTspice)C. C语言编程D. 2D/3D机械设计软件(如SolidWorks、AutoCAD)E. 固件编程(如嵌入式C/C++)4、以下关于电子元器件的说法正确的是哪些?()A. 电容器的电容值与其极板面积成正比,与其极板间距成反比。
应届生硬件工程师笔试题
应届生硬件工程师笔试题1. 问题:什么是硬件工程?答案:硬件工程是指设计和实施物理系统的过程,包括电子设备、电路板、嵌入式系统、集成电路和完整系统的设计和制造。
2. 问题:硬件工程师需要具备哪些基本技能?答案:硬件工程师需要具备电路设计、数字和模拟电子技术、微处理器编程、嵌入式系统设计、硬件描述语言(如Verilog或VHDL)和可编程逻辑设计等基本技能。
3. 问题:硬件工程师如何选择和应用不同的电子测量技术?答案:硬件工程师应具备电子测量技术方面的知识,并能够根据不同的设计需求选择和应用不同的测量技术,例如使用示波器、频谱分析仪、信号发生器和逻辑分析仪等工具进行测试和调试。
4. 问题:硬件工程中常用的接口标准有哪些?答案:硬件工程中常用的接口标准包括USB、HDMI、SATA、PCIe、SPI、I2C等,这些标准用于不同设备之间的数据传输和通信。
5. 问题:什么是可编程逻辑控制器(PLC)?它在工业自动化中的应用是什么?答案:可编程逻辑控制器(PLC)是一种专门为工业环境设计的数字电子设备,它可以编程以执行顺序控制、计时、计数和算术运算等任务。
在工业自动化中,PLC用于控制机器和过程的运行,例如自动化生产线和石油化工厂等。
6. 问题:什么是集成电路?硬件工程师如何设计和制造集成电路?答案:集成电路是将多个电子元件集成在一块衬底上,实现一定的电路或系统功能。
硬件工程师可以使用专业软件工具进行集成电路设计,并采用半导体制造工艺进行制造。
设计和制造集成电路需要高度的专业知识和技术。
7. 问题:什么是电磁干扰(EMI)?硬件工程师如何解决电磁干扰问题?答案:电磁干扰是指电气电子设备在运行过程中产生并传播的电磁噪声,可能会对其他设备造成干扰。
硬件工程师可以通过合理布线、滤波和屏蔽等措施来降低电磁干扰的影响。
8. 问题:什么是可靠性工程?硬件工程师如何考虑可靠性设计?答案:可靠性工程是指在产品设计阶段就考虑到产品寿命周期内的各种可靠性问题,并通过设计优化和控制生产过程来提高产品可靠性的过程。
(完整版)硬件工程师笔试题附答案
一、填空题(每题5分,8题,共40分)1.二极管的导通电压一般是0.7V 。
2.MOS管根据掺杂类型可以分为NMOS 、PMOS 。
3.晶体三极管在工作时,发射结和集电结均处于正向偏置,该晶体管工作在饱和状态。
4.二进制数(11010010)2转换成十六进制数是D2 。
5.贴片电阻上的103代表10k 。
6.输出使用OC门或OD门实现线与功能。
7.假设A传输线的特征阻抗是70欧姆,B传输线的特征阻抗是30欧姆,A传输线与B传输线相连,那么它们之间的反射系数是0.4。
(-0.4也可以是正确答案)8.假设模拟信号的输入带宽是10Hz~1MHz,对信号进行无失真采样的最低频率是 2MHz 。
二、问答题(每题10分,6题,共60分)1.单片机上电后没有运转,首先要检查什么?(10分)答案:第一步,测量电源电压是否正常;第二步,测量复位引脚是否正常;第三步,测量外部晶振是否起振。
2.请分别画出BUCK和BOOST电路的原理框图。
(10分)BUCK电路:BOOST电路:3.请画出SAR型(逐次逼近型)ADC的原理框图,或者描述SAR型ADC的工作原理。
(10分)SAR型ADC包括采样保持电路(S/H)、比较器(COMP ARE)、数/模转换器(DAC)、逐次逼近寄存器(SAR REGISTER)和逻辑控制单元(SAR L OGIC)。
模拟输入电压VIN由采样保持电路采样并保持,为实现二进制搜索算法,首先由SAR L OGIC 控制N位寄存器设置在中间刻度,即令最高有效位MSB为“1”电平而其余位均为“0”电平,此时数字模拟转换器DAC输出电压VDAC为0.5VREF,其中VREF为提供给ADC的基准电压。
由比较器对VIN和VDAC进行比较,若VIN>VDAC,则比较器输出“1”电平,N位寄存器的MSB保持“1”电平;反之,若VN<VDAC,则比较器输出“0”电平,N位寄存器的MSB被置为“0”电平。
硬件工程师经典笔试题
硬件工程师经典笔试题模拟电路1、基尔霍夫定理的内容是什么?(仕兰微电子)基尔霍夫定理包括电流定律和电压定律。
电流定律(KCL):在集总电路中,任何时刻,对任一结点,所有流出结点的支路电流的代数和恒等于零。
电压定律(KVL):在集总电路中,任何时刻,沿任一回路,所有支路电压的代数和恒等于零。
2、平板电容公式(C=εS/4πkd)。
(未知)3、最基本的如三极管曲线特性。
(未知)4、描述反馈电路的概念,列举他们的应用。
(仕兰微电子)5、负反馈种类(电压并联反馈,电流串联反馈,电压串联反馈和电流并联反馈);负反馈的优点:(未知)稳定放大倍数;改变输入电阻——串联负反馈,增大输入电阻;并联负反馈,减少输入电阻;改变输出电阻——电压负反馈,减少输出电阻;电流负反馈,增大输出电阻;有效地扩展放大器的通频带;改善放大器的线性和非线性失真。
6、放大电路的频率补偿的目的是什么,有哪些方法?(仕兰微电子)频率补偿目的就是减小时钟和相位差,使输入输出频率同步很多放大电路里都会用到锁相环频率补偿电路7、频率响应,如:怎么才算是稳定的,如何改变频响曲线的几个方法。
(未知)8、给出一个查分运放,如何相位补偿,并画补偿后的波特图。
(凹凸)9、基本放大电路种类(电压放大器,电流放大器,互导放大器和互阻放大器),优缺点,特别是广泛采用差分结构的原因。
(未知)10、给出一差分电路,告诉其输出电压Y+和Y-,求共模分量和差模分量。
(未知)11、画差放的两个输入管。
(凹凸)12、画出由运放构成加法、减法、微分、积分运算的电路原理图。
并画出一个晶体管级的运放电路。
(仕兰微电子)13、用运算放大器组成一个10倍的放大器。
(未知)14、给出一个简单电路,让你分析输出电压的特性(就是个积分电路),并求输出端某点的 rise/fall时间。
(Infineon笔试试题)15、电阻R和电容C串联,输入电压为R和C之间的电压,输出电压分别为C上电压和R上电压,要求制这两种电路输入电压的频谱,判断这两种电路何为高通滤波器,何为低通滤波器。
硬件工程师笔试面试题及答案(fpga相关)
硬件工程师笔试面试题及答案(fpga相关)硬件工程师笔试面试题及答案(FPGA相关)1. 请解释什么是FPGA,并简述其工作原理。
答案:FPGA(Field-Programmable Gate Array,现场可编程门阵列)是一种可以通过编程来配置的集成电路。
它由可编程逻辑块、可编程互连和I/O块组成,用户可以通过编程来定义这些逻辑块和互连的连接方式,从而实现特定的硬件逻辑功能。
2. FPGA与ASIC的主要区别是什么?答案:FPGA与ASIC的主要区别在于:- FPGA是可编程的,用户可以根据自己的需求来配置其逻辑功能,而ASIC(Application-Specific Integrated Circuit,专用集成电路)是为特定应用定制的,一旦制造完成就无法更改。
- FPGA的开发周期较短,适合快速原型开发和产品迭代,ASIC的开发周期较长,但一旦量产,成本较低。
- FPGA的功耗通常高于ASIC,因为ASIC可以针对特定应用进行优化。
3. 描述FPGA设计流程的基本步骤。
答案:FPGA设计流程的基本步骤包括:- 需求分析:确定设计目标和性能要求。
- 逻辑设计:使用硬件描述语言(如VHDL或Verilog)编写设计代码。
- 综合:将设计代码转换为FPGA可以理解的逻辑网表。
- 布局布线:将逻辑网表映射到FPGA芯片的物理资源上,并进行布线。
- 仿真:通过软件模拟来验证设计的正确性。
- 编程下载:将设计文件下载到FPGA芯片中进行测试。
- 调试:根据测试结果对设计进行调整和优化。
4. 在FPGA设计中,如何优化时序性能?答案:在FPGA设计中,优化时序性能可以通过以下方法:- 使用流水线技术来减少关键路径的延迟。
- 优化逻辑设计,减少逻辑深度。
- 使用快速的触发器和低延迟的逻辑门。
- 适当地使用时钟树和时钟管理技术。
- 进行时序约束和时序分析,确保时序要求得到满足。
5. 请列举FPGA设计中常见的测试方法。
硬件工程师招聘笔试题及解答(某大型集团公司)2025年
2025年招聘硬件工程师笔试题及解答(某大型集团公司)(答案在后面)一、单项选择题(本大题有10小题,每小题2分,共20分)1、以下哪种接口通常用于高速数据传输,适用于连接硬盘和主板?A、SATA接口B、IDE接口C、USB接口D、PCI接口2、在硬件设计过程中,以下哪个组件通常用于提供稳定的电源?A、电容器B、电阻器C、电感器D、二极管3、硬件工程师在设计电路板时,为了实现信号的水平对齐,应选用哪种类型的传输线?A、双绞线B、同轴电缆C、差分对传输线D、平行线4、在选择微处理器时,除了考虑主频、缓存外,还应关注哪个性能指标来保证硬件的高效运行?A、接口类型B、功耗C、集成IO数量D、制造工艺5、在硬件电路设计中,以下哪种元件通常用于实现信号的开关功能?A. 电阻B. 二极管C. 场效应晶体管D. 继电器6、以下关于微处理器架构描述正确的是:A. RISC(精简指令集计算机)架构通常拥有更长的指令周期,需要更多时钟周期来完成指令。
B. CISC(复杂指令集计算机)架构的指令集复杂,通常指令周期较短,执行速度快。
C. RISC架构和CISC架构的主要区别在于它们的数据存储和缓存策略。
D. 在处理器设计中,RISC和CISC架构的性能主要取决于其核心计数器的频率。
7、以下哪种芯片类型主要用于数字信号处理?A. 微处理器(CPU)B. 数字信号处理器(DSP)C. 应用处理器(AP)D. 微控制器(MCU)8、在电路设计中,以下哪个术语用于描述电路中能够存储电荷的元件?A. 电阻(Resistor)B. 电容(Capacitor)C. 电流(Current)D. 电压(Voltage)9、9伏特直流电源与9伏特交流电源的区别是什么?A、9伏特直流电源提供恒定不变的电压,而9伏特交流电源每隔一定时间电压会反向。
B、9伏特直流电源和9伏特交流电源没有任何区别。
C、9伏特直流电源的电压会随负载变化而变化,而交流电源保持恒定。
硬件工程师入职笔试题集答案
硬件工程师入职笔试题集
相应答案:
1、(1)答:setup time(建立时间)是指在触发器的时钟信号上升沿到来以前,数据稳定不变的时间,如果建立时间不够,数据将不能在这个时钟上升沿被打入触发器;hold time(保持时间)是指在触发器的时钟信号上升沿到来以后,数据稳定不变的时间,如果保持时间不够,数据同样不能被打入触发器。
(2)答:竞争现象指门电路两个输入信号同时向相反的逻辑电平跳变的现象;冒险现象指由于竞争而在电路输出端可能产生尖峰脉冲的现象。
只要输出端的逻辑函数在一定条件下可能化成:Y=A+A′或Y=A A′,则可判定存在竞争-冒险。
可以通过增加冗余项的方法可以消除竞争-冒险现象。
(3)答:。
(完整版)常见硬件工程师笔试题(标准答案)
硬件工程师笔试题一、电路分析:1、竞争与冒险在组合逻辑中,在输入端的不同通道数字信号中经过了不同的延时,导致到达该门的时间不一致叫竞争。
因此在输出端可能产生短时脉冲(尖峰脉冲)的现象叫冒险。
常用的消除竞争冒险的方法有:输入端加滤波电容、选通脉冲、修改逻辑设计等。
2、同步与异步同步逻辑是时钟之间有固定的因果关系。
异步逻辑是各时钟之间没有固定的因果关系。
同步电路:存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源,因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。
异步电路:电路没有统一的时钟,有些触发器的时钟输入端与时钟脉冲源相连,只有这些触发器的状态变化与时钟脉冲同步,而其它的触发器的状态变化不与时钟脉冲同步。
异步电路不使用时钟脉冲做同步,其子系统是使用特殊的“开始”和“完成”信号使之同步同步就是双方有一个共同的时钟,当发送时,接收方同时准备接收。
异步双方不需要共同的时钟,也就是接收方不知道发送方什么时候发送,所以在发送的信息中就要有提示接收方开始接收的信息,如开始位,结束时有停止位3、仿真软件:Proteus4、Setup 和Hold timeSetup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。
建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。
输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。
保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。
如果hold time不够,数据同样不能被打入触发器。
5、IC设计中同步复位与异步复位的区别同步复位在时钟沿采集复位信号,完成复位动作。
异步复位不管时钟,只要复位信号满足条件,就完成复位动作。
异步复位对复位信号要求比较高,不能有毛刺,如果其与时钟关系不确定,也可能出现亚稳态。
常见硬件工程师笔试题(标准答案)
硬件工程师笔试题一、电路分析:1、竞争与冒险在组合逻辑中,在输入端的不同通道数字信号中经过了不同的延时,导致到达该门的时间不一致叫竞争。
因此在输出端可能产生短时脉冲(尖峰脉冲)的现象叫冒险。
常用的消除竞争冒险的方法有:输入端加滤波电容、选通脉冲、修改逻辑设计等。
2、同步与异步同步逻辑就是时钟之间有固定的因果关系。
异步逻辑就是各时钟之间没有固定的因果关系。
同步电路:存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源,因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。
异步电路:电路没有统一的时钟,有些触发器的时钟输入端与时钟脉冲源相连,只有这些触发器的状态变化与时钟脉冲同步,而其它的触发器的状态变化不与时钟脉冲同步。
异步电路不使用时钟脉冲做同步,其子系统就是使用特殊的“开始”与“完成”信号使之同步同步就就是双方有一个共同的时钟,当发送时,接收方同时准备接收。
异步双方不需要共同的时钟,也就就是接收方不知道发送方什么时候发送,所以在发送的信息中就要有提示接收方开始接收的信息,如开始位,结束时有停止位3、仿真软件:Proteus4、Setup 与Hold timeSetup/hold time 就是测试芯片对输入信号与时钟信号之间的时间要求。
建立时间就是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。
输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就就是建立时间-Setup time、如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。
保持时间就是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。
如果hold time不够,数据同样不能被打入触发器。
5、IC设计中同步复位与异步复位的区别同步复位在时钟沿采集复位信号,完成复位动作。
异步复位不管时钟,只要复位信号满足条件,就完成复位动作。
异步复位对复位信号要求比较高,不能有毛刺,如果其与时钟关系不确定,也可能出现亚稳态。
硬件工程师招聘笔试题与参考答案(某世界500强集团)2024年
2024年招聘硬件工程师笔试题与参考答案(某世界500强集团)(答案在后面)一、单项选择题(本大题有10小题,每小题2分,共20分)1、以下哪种接口常用于连接外部存储设备如硬盘、光驱等?A、USB接口B、HDMI接口C、PCI Express接口D、SATA接口2、在计算机硬件中,以下哪项不是构成CPU(中央处理器)的基本组件?A、控制单元B、运算单元C、寄存器D、主板3、在数字逻辑电路设计中,下列哪种触发器通常用于构建同步时序逻辑电路?A. SR锁存器B. JK触发器C. D锁存器D. 单稳态触发器4、如果一个8位二进制数表示的十进制范围是从-128到+127,那么这个数使用了哪种编码方法?A. 原码B. 反码C. 补码D. 无符号数5、在以下哪种情况下,一个硬件工程师可能会使用模拟电路?A. 设计一个微控制器的外围电路B. 实现一个高速数据通信接口C. 构建一个数字信号处理器D. 开发一个嵌入式系统6、在硬件设计中,以下哪个标准通常用于评估电子组件的可靠性?A. IPC-9595B. ISO/IEC 12207C. IEC 60730-1D. IEEE 802.37、在数字逻辑电路设计中,以下哪种门可以直接驱动一个LED灯?A、与门B、非门C、或门D、三态门8、在使用示波器测量一个未知频率的正弦波时,如果屏幕上的波形每两个周期显示完整,则水平刻度设置为10μs/div,总共有5格,请问该正弦波的频率是多少?A、1kHzB、5kHzC、10kHzD、25kHz9、在下列哪种情况下,一个简单的二进制计数器会溢出?A. 当计数器的值达到最大值时B. 当计数器的值达到最小值时C. 当计数器的值等于0时D. 当计数器的值等于1时 10、以下哪种接口通常用于外部设备与计算机之间的数据传输?A. USB(通用串行总线)B. FireWire(IEEE 1394)C. RS-232D. Ethernet二、多项选择题(本大题有10小题,每小题4分,共40分)1、以下哪些技术或组件是硬件工程师在设计和开发嵌入式系统时通常会使用的?A、微控制器(Microcontroller)B、场效应晶体管(MOSFET)C、线性稳压器(Linear Regulator)D、蓝牙模块(Bluetooth Module)E、操作系统(Operating System)2、在硬件设计过程中,以下哪些因素对电路的可靠性有重要影响?A、元件的选择与质量B、电路布局和布线C、散热设计D、电磁兼容性(EMC)E、抗干扰能力3、以下哪些组件属于硬件工程师在设计和测试嵌入式系统时可能会使用?()A. 微处理器(Microprocessor)B. 外部存储器(External Storage)C. 传感器(Sensors)D. 模拟电路(Analog Circuits)E. 通用接口(General Purpose Interface)4、在硬件设计中,以下哪些方法可以提高电路的抗干扰能力?()A. 使用低噪声元件B. 采用屏蔽和接地措施C. 优化电源设计,减少电源噪声D. 使用滤波器E. 提高电路的频率响应5、以下哪些是硬件工程师在电路设计过程中需要考虑的关键因素?()A. 电源稳定性B. 热设计C. 电磁兼容性D. 成本控制E. 信号完整性6、以下关于嵌入式系统硬件设计原则的描述,正确的是哪些?()A. 优先考虑性能,牺牲成本和功耗B. 在满足功能需求的前提下,尽量降低功耗C. 采用模块化设计,提高系统可扩展性D. 优先考虑成本,牺牲性能和功耗E. 保证系统稳定性,提高可靠性7、以下哪些技术或组件是现代嵌入式系统中常见的硬件组成部分?()A. 微控制器(MCU)B. 传感器C. 显示屏D. USB接口E. 无线通信模块8、在以下关于SATA接口的描述中,哪些是正确的?()A. SATA接口主要用于连接硬盘驱动器和主机系统B. SATA接口支持热插拔功能C. SATA接口的最高传输速率可以达到6GbpsD. SATA接口不支持RAID配置E. SATA接口具有较低的功耗9、以下哪些技术或设备属于硬件工程师在设计和测试嵌入式系统时可能需要使用的?()A. ARM处理器B. FPGA(现场可编程门阵列)C. 微控制器D. 液晶显示屏E. 电源管理芯片 10、以下哪些方法可以用于提高硬件设计的可测试性?()A. 设计模块化B. 使用可测试的接口C. 实现硬件设计规范D. 设计冗余功能E. 优化设计文档三、判断题(本大题有10小题,每小题2分,共20分)1、硬件工程师在进行电路设计时,所有元件都必须符合其额定电压和电流规格。
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硬件工程师笔试题一、电路分析:1、竞争与冒险在组合逻辑中,在输入端的不同通道数字信号中经过了不同的延时,导致到达该门的时间不一致叫竞争。
因此在输出端可能产生短时脉冲(尖峰脉冲)的现象叫冒险。
常用的消除竞争冒险的方法有:输入端加滤波电容、选通脉冲、修改逻辑设计等。
2、同步与异步同步逻辑是时钟之间有固定的因果关系。
异步逻辑是各时钟之间没有固定的因果关系。
同步电路:存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源,因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。
异步电路:电路没有统一的时钟,有些触发器的时钟输入端与时钟脉冲源相连,只有这些触发器的状态变化与时钟脉冲同步,而其它的触发器的状态变化不与时钟脉冲同步。
异步电路不使用时钟脉冲做同步,其子系统是使用特殊的“开始”和“完成”信号使之同步同步就是双方有一个共同的时钟,当发送时,接收方同时准备接收。
异步双方不需要共同的时钟,也就是接收方不知道发送方什么时候发送,所以在发送的信息中就要有提示接收方开始接收的信息,如开始位,结束时有停止位3、仿真软件:Proteus4、Setup 和Hold timeSetup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。
建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。
输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。
保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。
如果hold time不够,数据同样不能被打入触发器。
5、IC设计中同步复位与异步复位的区别同步复位在时钟沿采集复位信号,完成复位动作。
异步复位不管时钟,只要复位信号满足条件,就完成复位动作。
异步复位对复位信号要求比较高,不能有毛刺,如果其与时钟关系不确定,也可能出现亚稳态。
6、常用的电平标准TTL:transistor-transistor logic gate晶体管-晶体管逻辑门CMOS:Complementary Metal Oxide Semiconductor互补金属氧化物半导体LVTTL(Low Voltage TTL)、LVCMOS(Low Voltage CMOS):3.3V、2.5VRS232、RS4857、TTL电平与CMOS电平TTL电平和CMOS电平标准TTL电平:5V供电输出L:<0.4V ;H:>2.4V 1输入L:<0.8V ;H:>2.0V 0CMOS电平:(一般是12V供电)输出L:<0.1*Vcc ;H:>0.9*Vcc输入L:<0.3*Vcc ;H:>0.7*Vcc.CMOS电路临界值(电源电压为+5V)VOHmin =4.5V VOLmax =0.5VVIHmin =3.5V VILmax =1.5V特性区别:CMOS是场效应管构成,TTL为双极晶体管构成;CMOS的逻辑电平范围比较大(3~15V),TTL只能在5V下工作;CMOS的高低电平之间相差比较大、抗干扰性强,TTL则相差小,抗干扰能力差;CMOS功耗很小,TTL功耗较大(1~5mA/门);CMOS的工作频率较TTL略低,但是高速CMOS速度与TTL差不多相当。
8、RS232、RS485RS232:采用三线制传输分别为TXD\RXD\GND,其中TXD为发送信号,RXD为接收信号。
全双工,在RS232中任何一条信号线的电压均为负逻辑关系。
即:-15v ~ -3v 代表1+3v ~ +15v 代表0RS485:采用差分传输(平衡传输)的方式,半双工,一般有两个引脚A、B。
AB间的电势差U为UA-UB:不带终端电阻AB电势差:+2 ~+6v 逻辑‘1’;-2 ~-6v 逻辑‘0’;带终端电阻AB电势差:大于+200mv 逻辑‘1’;小于-200mv 逻辑‘0’;注意:AB之间的电压差不小于200mv。
波特率计算:如图,传输9bit(1起始位+8数据位)花费的时间为79us。
1s传输的数据量为1/0.000079*9 = 113924,可以推测波特设置的波特率为115200。
RS485的波特率计算同理。
(二进制系统中,波特率等于比特率)终端电阻其目的就是消耗通信电缆中的信号反射,其原因有两个:阻抗不连续喝阻抗不匹配。
9、CAN BUS要点(显性与隐性电平):显性位即无论总线上各节点想将总线驱动成什么样的电平,只要有一个节点驱动为显性位,则总线表现为显性位的电平;隐性位正好相反,只有各节点都不将总线驱动成显性位的电平,总线才表现为隐性位对应的电平。
显性位电平为Vh-Vl=2V,逻辑上为“0”;隐性位电平为Vh-Vl=0V,逻辑上为“1”。
CAN总线在没有节点传输报文时是一直处于隐性状态。
当有节点传输报文时显性覆盖隐性,由于CAN总线是一种串行总线,也就是说报文是一位一位的传输的,而且是数字信号(0和1),1代表隐性,0代表显性。
在传送报文的过程中是显隐交替的,就像二进制数字0101001等,这样就能把信息发送出去,而总线空闲的时候是一直处于隐性的。
“显性”具有“优先”的意味,总线上执行逻辑上的线“与”时,只要有一个单元输出显性电平,总线上即为显性电平;只有所有的单元都输出隐性电平,总线上才为隐性电平。
(显性电平比隐性电平更强)隐性(逻辑‘1’):H=2.5V,L=2.5V,H-L=0V显示(逻辑‘0’):H=3.5V,L=1.5V,H-L=2V共同点:CAN_BUS空闲状态为隐性状态,相当于串口通信(232/485)的停止位‘1’;当准备发送数据时,CAN_BUS的状态由隐性变成显性,相当于串口通信(232/485)的起始位‘0’。
10、KNX BUS1、概述:KNX是Konnex的缩写。
1999年5月,欧洲三大总线协议EIB、BatiBus和EHSA 合并成立了Konnex协会,提出了KNX协议。
该协议以EIB为基础,兼顾了BatiBus和EHSA 的物理层规范,并吸收了BatiBus和EHSA中配置模式等优点,提供了家庭、楼宇自动化的完整解决方案。
2、总线框架:A、总线—区域总线(15条)—主干道(15条)—总线设备(64个)B、15*15*64=14400个设备C、三种结构:线形、树形、和星形D、 KNX总线协议遵循OSI模型协议规范,并进行了合理的简化。
由物理层、数据链接层、网络层、传输层和应用层组成,会话层和表示层的功能则并入应用层与传输层3、配置模式:A、S-Mode (system系统模式)B、E-Mode (Essential简单模式)4、所有的总线设备连接到KNX 介质上( 这些介质包括双绞线、射频、电力线或IP/Ethernet), 它们可以进行信息交换。
总线设备可以是传感器也可以是执行器,所有这些功能通过一个统一的系统就可以进行控制、监视和发送信号,不需要额外的控制中心。
5、KNX电缆由一对双绞线组成,其中一条双绞线用于数据传输(红色为CE+ 黑色为CE-),另一条双绞线给电子器件提供电源。
6、所有的信号在总线上都是以串行异步传输(广播)的形式进行传播,也就是说在任何时候,所有的总线设备总是同时接收到总线上的信息,只要总线上不再传输信息时,总线设备即可独立决定将报文发送到总线上。
11、SPI是串行外设接口(Serial Peripheral Interface)是一种高速的,全双工,同步的通信总线,至少四根线;SDI(数据输入)、SDO(数据输出)、SCLK(时钟)、CS(使能)。
12、以太网13、推挽电路和开漏输出推挽输出:可以输出高,低电平,连接数字器件;推挽结构一般是指两个三极管的B极和E极接在一起,总是一个三极管导通时另一个三极管截止。
开漏输出:输出端相当于一个NPN三极管,集电极悬空,只能输出低电平或者高阻态,必须加一个上拉电阻输出高电平。
开漏输出可以将多个输出短接,共用一个上拉,此时这些开漏输出的驱动PIN_A、PIN_B、PIN_C“与”的关系。
14、DC-DC电源和LDO电源LDO:low dropout voltage regulator 低压差线性稳压器,故名思意,为线性的稳压器,仅能使用在降压应用中。
也就是输出电压必需小于输入电压。
优点:稳定性好,负载响应快。
输出纹波小,外围元器件少。
缺点:效率低,输入输出的电压差不能太大。
负载不能太大,目前最大的LDO为5A(但要保证5A的输出还有很多的限制条件)DC/DC:直流电压转直流电压。
严格来讲,LDO也是DC/DC的一种,但目前DC/DC多指开关电源。
包括boost(升压)、buck(降压)、Boost/buck(升/降压)和反相结构,具有高效率、高输出电流、低静态电流等特点,随着集成度的提高,许多新型DC-DC转换器的外围电路仅需电感和滤波电容;但该类电源控制器的输出纹波和开关噪声较大、成本相对较高。
优点:效率高,输入电压范围较宽。
缺点:负载响应比LDO差,输出纹波比LDO大。
15、基尔霍夫定律电压定律(回路定律):电路中沿任何一个回路的所有电压的代数和为0;电流定律(节点定律):流入一个节点的所有电流之和等于流出该节点的所有电流之和。
16、数字电路和模拟电路区别数字电路只关心高低电平,模拟电路是连续变化的模拟量,表现形式为电压和电流的连续波动二、常用的元器件:1、电阻resistance:固定电阻(色环电阻/贴片电阻)、热敏电阻、光敏电阻、数字可调电阻基本作用:限制电流和调节电压;2、电容capacitance:陶瓷电容、铝电解电容、薄膜电容、纸介电容、云母电容基本作用:存储能量(以电场方式)和隔直通交(滤波/旁路);容抗和电容成反比,和频率也成反比。
如果容抗用Xc表示,电容用C表示,频率用f 表示,那么Xc=1/(2πfC)3、电感inductance:磁芯电感、空心电感、可调电感、阻流电感基本作用:存储能量(以磁场方式)和阻交通直(抑制流过它的电流突然变化)电磁感应只有在外施电压或者电流随时间增大或减小的变化过程中才会产生。
重点:电感的能量存储特性可以被用在开关电源电路中,如图升压电路。
当mos管打开,电感存储能量,由二极管隔断的负载由电容存储能量供给。
当MOS管关断时,存储在mos管的能量叠加到5V电源(达到升压的效果)。
此时,电感给电容充电,同时供给负载电流。
4、磁珠:用于抑制信号线、电源线上的高频噪声和尖峰干扰,还具有吸收静电脉冲的能力。
磁珠是用来吸收超高频信号,像一些RF电路,PLL,振荡电路,含超高频存储器电路(DDRSDRAM,RAMBUS等)都需要在电源输入部分加磁珠,而电感是一种蓄能元件,用在LC振荡电路,中低频的滤波电路等,其应用频率范围很少超过50MHZ。