第五章 触发器典型例题
第五章 触发器习题
第五章 触发器5.1习题类型1.给定触发器输入信号的波形,求对应的输出波形2. 触发器的应用。
包括触发器存储功能的应用,触发器分频/计数功能的应用。
5.2 习题1.逻辑电路如图题1所示,已知CP 和A 的波形,画出触发器Q 0、Q 1端的波形,设触发器的初始状态为0。
图题12.逻辑电路如图题2所示,已知CP 和A 的波形,画出触发器Q 0、Q 1端的波形,设触发器的初始状态为0。
图题23.设主从JK 触发器的初始状态为0,CP 、J 、K 信号如图题3所示,试画出触发器Q 端的波形。
4.维持—阻塞D 触发器的初始状态为0,CP 、D 信号如图题4所示,试画出触发器Q 端的波形。
CP J K5.一个触发器的特性方程为nn Q Y X Q ⊕⊕=+1,试用下列两种触发器实现这种触发器的功能。
(1)JK 触发器; (2)D 触发器。
1Q Q CPAAQ CP A图题3CPD图题45.3 习题答案1. Q 0、Q 1端的波形见图解1。
CP A Q Q 1A CP Q1Q 0图解1 图解22. Q 0、Q 1端的波形见图解2。
3. Q 端的波形见图解3。
J K CP Q图解3 图解4 4. Q 端的波形见图解4。
5. 解:(1)JK 触发器:将JK 触发器的J 、K 端相并,再由输入端T 加以控制,则可以构成T 触发器,其特性方程为:nn Q T Q ⊕=+1。
若要实现特性方程为n n Q Y X Q⊕⊕=+1的功能,只要使:Y X T ⊕=,对应的逻辑电路见图解5(a )。
XYQQ(a ) (b )图解5(2)D 触发器:先将D 触发器转变成T 触发器,其特性方程为:n n Q T Q⊕=+1。
若要实现特性方程n n Q Y X Q ⊕⊕=+1的功能,只要使:Y X T ⊕=,对应的逻辑电路见图解5(b )。
CP D Q。
第5章触发器题(含答案)
第五章触发器5.1 画出如题图5.1所示的基本RS触发器输出端、Q Q的电压波形图。
S和R的电压波形如图5.1(b)所示。
题图5.1解:波形如图:5.2 或门组成的基本RS触发器电路如题图5.2(a)所示,已知S和R的波形如题图5.2(b)所示。
试画出、Q Q的波形图。
设触发器的初态Q=0。
题图5.2解:波形如图:5.3 题图5.3所示为一个防抖动输出开关电路。
当拨动开关K时,由于开关接通瞬间发生振颤,R和S的波形如图中所示,请画出和Q Q端的对应波形。
题图5.3解:波形如图:5.4有一时钟RS触发器如题图5.4所示,试画出它的输出端的波形。
初态Q Q=0。
题图5.4解:波形如图:5.5 设具有异步端的主从JK 触发器的初始状态Q = 0,输入波形如题图5.5所示,试画出输出端Q 的波形。
题图5.5解:波形如图:5.6 设题图5.6的初始状态为2Q 1Q 0Q = 000,在脉冲CLK 作用下,画出、、的波形(所用器件都是CD4013)。
S 0Q 1Q 2Q D 、R D 分别是CD4013高电平有效的异步置1端,置0端。
题图5.6解:波形如图:5.7 设题图5.7电路两触发器初态均为0,试画出、波形图。
1Q 2Q题图5.7解:波形如图:5.8 已知CMOS 边沿触发结构JK 触发器CD4207各输入端的波形如题图5.8所示,试画出、Q Q 端的对应波形,设初态Q = 0。
S D 为高电平置1端,R D 为高电平置0端,电路为CLK 上升沿触发。
题图5.8解:波形如图:5.9 如题图5.9所示,利用CMOS 边沿触发器和同或门组成的脉冲分频器。
试分析它在一系列CLK脉冲作用下的、和Y 的波形(初始状态1Q 2Q 120Q Q ==)。
题图5.9解:波形如图:5.10 设题图5.10中各个触发器的初始状态皆为Q = 0,试画出每个触发器Q 端波形。
题图5.10解:波形如图:5.11 题图5.11示出了一个单稳态电路和它的工作波形,试分析其工作原理(初态Q=0)。
第五章触发器
第五章 触发器题5.1画出下图由与非门组成的锁存器输出端SR 的电压波形,输入端、的电压波形如图Q Q '、DS 'D R '中所示。
解:输出波形如下图。
题5.2画出下图由或非门组成的SR 锁存器器输出端的电压波形,输入端、的电压波形如Q Q '、D S D R 图中所示。
解:输出波形如下图。
题5.5在下图电路中,若CLK 、S 、R 的电压波形如图中所示,试画出端与之对应的电压波形。
Q Q '和假定触发器的初始状态为。
0Q =解:输出波形如下图。
题5.7若主从SR 触发器各输入端的电压波形如下图,试画出端对应的电压波形。
设触发器的初Q Q '、始状态为Q =0。
解:输出波形如下:题5.9若主从结构SR触发器的各输DCLK S R R'、、、入端的电压波形如下图,,试画出端对1DS'=Q Q'、应的电压波形。
解:输出波形如下:题5.12若主从结构JK触发器的端的电压波形如下图所示,画出D DCLK R S J K''、、、、端对应的电压波形。
Q Q'、解:输出波形如下:在第三个CLK=1期间,输入信号J发生了跳变,此时,只接受置0信号,1Q=出现了,因此置0。
1K=第四个CLK=1期间,,只接受置1信号,Q=出现过J=1的尖峰,故有置1信号,那么次态置1。
题5.18设图中各触发器的初始状态皆为,试Q=画出在CLK信号连续作用下各触发器输出端的电压波形。
解:(1)JK 触发器的状态方程为:*Q JQ K Q''=+由题意知:1J K ==故有:;状态翻转*11Q Q '=(2)JK 触发器的状态方程为:*Q JQ K Q''=+由题意知:0J K ==故有:;状态保持*22Q Q =(3)JK 触发器的状态方程为:*Q JQ K Q''=+由题意知:,J Q K Q'==故有:;状态翻转*33Q Q '=(4)T 触发器的状态方程为:*Q TQ T Q''=+由题意知:1T =故有:;状态翻转*44Q Q '=(5)JK 触发器的状态方程为:*Q JQ K Q''=+由题意知:;J Q K Q '==故有:;状态保持*55Q Q =(6)JK 触发器的状态方程为:*Q JQ K Q''=+由题意知:;1J Q K ==故有:;保持0状态*60Q =(7)JK 触发器的状态方程为:*Q JQ K Q''=+由题意知:;1J Q K '==故有:;状态翻转*77Q Q '=(8)SR 触发器的状态方程为:*;0()Q S R Q SR '=+=约束条件由题意知:;S Q R Q'==故有:;状态翻转*88Q Q '=(9)D 触发器的状态方程为:*Q D=由题意知:1D =故有:;保持1状态*91Q =(10)D 触发器的状态方程为:*Q D=由题意知:D Q '=故有:;状态翻转*1010Q Q '=(11)D 触发器的状态方程为:*Q D=由题意知:D Q=故有:;状态保持*1111Q Q =(12)T 触发器的状态方程为:*Q TQ T Q''=+由题意知:T Q '=故有:;保持1状态*121Q =因此,输出电压波形图为:题5.24试画出下图电路输出端Y 、Z 的电压波形。
数字电子技术习题课
输出波形
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第5章、触发器
例5:画出与或非门的输出端T以及在时钟CP作用下触发器输出波形。 设触发器初态为零。
CP
A
B
C
T
(a)
Q
Q
电路及输入波形 第10页/共36页
(b)
第5章、触发器
解:该触发器是下降沿触发的JK触发器,触发器的两个输入端J和K连 在一起,构成T触发器。与或非门的输出构成T触发器的输入信号,若 T=1,Q翻转;若T=0,Q保持。输出波形见下图。
都没有发生变化,所以由CP下降沿的R、S值决定输出状态。
第一个CP下降沿:S=1,R=0,触 发器输出置1,Q由初态0变1;
第二个CP下降沿:S=0,R=1,触 发器输出复位,Q由1变0;
第三个CP下降沿:S=0,R=0,触 发器输出保持原来值,Q仍为0;
第四个CP下降沿:S=1,R=1,触 发器输出不确定,Q为不定;
题5.19 试写出图P5.19(a)中各电路的次态函数(即Q1 、 n1Q 2、n1Q 3、n1Q 4 n1 与现态和输入变量之间的函数式),并画出在图P5.19(b)所给定信 号的作用下Q1、Q2、Q3、Q4的电压波形。假定各触发器的初始状态 均为Q=0。
图P5.19
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第5章、触发器
图P5.15
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第5章、触发器
解:此图为带异步置位、复位的上升沿触发的JK触发器,由图可知:
异步置位、复位端均为高电平 有效,SD始终接“0”无效,所以输 出不会出现异步置位的情况;RD初 始为1,所以触发器输出初始状态为 复位状态0。
由边沿触发器的特点可知:边 沿触发器的输出状态仅取决于边沿 时刻瞬间的输入数据。图中注意RD 值的变化情况。
第五章 触发器典型例题
第五章触发器典型例题分析例1:选择题1.为了使时钟控制的RS触发器的次态为1,RS的取值应为()。
A. RS=00B. RS=01C. RS=10D. RS=112.为了使触发器克服空翻与振荡,应采用()。
A.CP高电平触发B.CP低电平触发C.CP低电位触发D.CP边沿触发3.逻辑电路如图所示,当A=“0”,B=“1”时,脉冲来到后触发器( )。
A.具有计数功能B.保持原状态C.置“0”D. 置“1”答案 1.B 2. D 3.A例2:设主从J-K触发器的原状态为1,按照下图所给出的J、K、CP输入波形,画出触发器Q端的工作波形。
解:此题信号K的某些跳变与CP脉冲的跳变发生在同一时刻,这是初学者容易感到疑惑的地方,所以要注意到,画Q次态波形时应看CP脉冲下降沿前一刻的J、K值。
画波形时,从第1个CP脉冲开始分析,看它的下降沿前的J、K为何值,再依据J-K触发器真值表所述的功能,确定Q的次态,也就是CP脉冲下降沿触发以后Q的新状态。
例如图(a)中第1个CP 脉冲下降沿前一刻,J、K同为1,经CP脉冲触发后Q必然翻转,所以在第1个CP脉冲下降沿后Q由1变为0。
这样分析下去,直到最后一个CP脉冲为止。
故该题正确的Q端工作波形如图(b)所示。
例2 J-K触发器工作波形例3:设主从J-K 触发器的原状态为0,输入波形如下图所示,试画出Q 端的工作波形。
解:该例题增加了难度。
要求读者不但熟悉J-K 触发器的真值表,还应熟悉D R 、D R 的异步置0、置1的作用。
画波形时,应首先考虑D R 、D S 的值。
它们对触发器是属于一种电平触发,即不像CP 脉冲那样有上升沿与下降沿的区分。
只要D R (或D S )为0,无论是由0→1,还是由1→0,附近的CP 脉冲都不能起作用,视为无效,同样J 、K 也视为无效。
一旦D R =0(D =1),触发器Q 就为0;而只要D =0(D R =1),触发器Q 就为1。
只有当D R =D S =1时,才分析CP 、J 、K 对触发器Q 的作用。
(完整word版)数字逻辑第五章
第五章触发器-------—---—--——----————-—-————-—--———----—-——--—-——-—-—--————--—————-—-——-—1 : 具有:置0、置1、保持和翻转功能的触发器是()。
A:JK触发器B:SR触发器C:D触发器D:T触发器您选择的答案: 正确答案: A知识点:JK触发器的特性为:J=0, K=0时,Q状态为保持;J=0, K=1时,Q状态为置0;J=1,K=0时,Q状态为置1;J=1, K=1时,Q状态为翻转-—---—-—---———--——-——-—--—--—-——-———-—-—-——-————-——-————-—-—---—————-———-—--2 : 对于JK触发器,输入J=0,K=1,CLK脉冲作用后,触发器的次态应为().A:0B:1C:Q’D:不确定您选择的答案:正确答案: A知识点:JK触发器的特性为:J=1, K=1时,Q状态为翻转,即Q= Q’——--——-—————————---—-——-—-——--—---—-—-——-—---————-——--——--——-—-—-—-—-—---——-3 :有一个或非门构成的SR锁存器,欲使该锁存器保持原态即Q*=Q,则输入信号应为().A:S=R=0B:S=R=1C:S=1,R=0D:S=0,R=1您选择的答案: 正确答案: A知识点:或非门构成的SR锁存器的特性为:R=1, S=0 Q*=0, Q*’=1,即锁存器被置 0(0状态);R=0, S=1 Q*=1, Q*’=0,即锁存器被置 1(1状态);R=S=0, Q*=Q,即锁存器保持原态;R= S=1 Q*=Q*’=0,此为不允许输入。
-——————-—--——----————----—---——--——-—-——--—-—-————--——————---—-—--———--—-—-—4 :JK触发器要实现Q*=1时,J、K端的取值为( ).A:J=0,K=1B:J=0,K=0C:J=1,K=1D:J=1,K=0您选择的答案:正确答案: D知识点:JK触发器的特性为:J=0, K=0时,Q状态为保持;J=0, K=1时,Q状态为置0;J=1, K=0时,Q状态为置1;J=1, K=1时,Q状态为翻转————---—-—---——-—--—-—---—-———--———------—--—---——-—-—————---—--—----—————-—5 :将D触发器的D端与它的Q’端连接,假设初始状态Q=0,则经过1个脉冲作用后,它的状态Q为( )。
第05章触发器习题解N
图P5.5
图A5.5
[题5.6] 若将电平触发SR触发器的Q与R、Q' 与S相连,如图P5.6所示,试画出在CLK信号 作用下Q和Q'端的电压波形。已知CLK信号的 宽度tW=4tpd。tpd为门电路的平均传输延迟 时间,假定tpd tPHL tPLH。设触发器的初始 状态为Q=0。
图A5.15
[题5.16] 在脉冲触发了触发器中,已知了、CLK端的电压波 形如图P5.16所示,试画出Q、Q'端对应的电压波形。设触发 器的起始状态为Q=0。
解:根据厂触发器逻辑功能的定义以及脉冲触发方式的动作特点,画出 的Q、Q'端电压波形如图A5.16。
图A5.16
[题5.17] 在图P5.17所示的主从结构JK触发器电路中,已知 CLK和输入信号T的电压波形如图所示,试画出触发器输出 端Q和Q'的电压波形。设触发器的起始状态为Q=0。
Q1*=A'Q1'+BQ1 触发器FF2的驱动方程为 S2=AB;R2=(A+B)' 将它们代人SR触发器的特性方程Q*=S+R'Q,得到
Q2*=AB+(A+B)Q2 触发器FF3的驱动方程为T3=A⊙B,将它代人了触发器的特性方程Q*=TQ'+T'Q=TQ, 于是得到 Q3*=(A⊙B)Q3 触发器FF4的驱动方程为D4=AB,将它代人D触发器的特性方程Q*=D,得到
入,将Q和Q'置成相应的状态,如表A5.3的真值表所示。
表A5.3 题5.3中图P5.3电路的真值表
①S、R的1状态同时消失后状态不定。
由真值表得 化简后得到
Q*=S'R'Q+SR' SR=0(约束条件)
大连理工大学 5章 触发器 作业
第五章 触发器 作业5.9 如题图5.9所示,利用CMOS 边沿触发器和同或门组成的脉冲分频器。
试分析它在一系列CLK 脉冲作用下的1Q 、2Q 和Y 的波形(初始状态120Q Q ==)。
题图5.9解:波形如图:5.14 电路如题图5.14所示,初态1Q =2Q = 0,试根据CLK 、J 1的波形画出1Q 、2Q 的波形。
题图5.14解:波形如图:5.10 设题图5.10中各个触发器的初始状态皆为Q=0,试画出每个触发器Q端波形。
题图5.10解:波形如图:5.17 电路图如题图5.17所示,试根据CLK 、D R 、A 端的波形画出Q 端的波形。
题图5.17解:波形如图:5.18 电路图如题图5.18所示,触发器的初态1Q =2Q = 0,试画出CLK 信号下1Q ,2Q ,V O的对应波形。
题图5.18解:波形如图:5.21 试画出JK 触发器转换成AB 触发器的逻辑图。
AB 触发器的特性表如题表5.21所示。
要求写出设计过程。
题表5.21解:将AB 触发器的特性表转换成卡诺图,如图(a)。
由卡诺图求出AB 触发器的状态方程。
考察并化简卡诺图,得AB 触发器的特性方程为Q n+1=A n Q +A BQ n +A B Q n = A nQ +(A B+A B )Q n 将AB 触发器的特性方程同JK 触发器的特性方程相比较: Q n+1= J nQ +K Q n得JK 触发器的驱动方程为 J=A K=A ⊙B所以转换电路如图(b)所示(a) (b)BQ nA 00 01 11 10 0 1 0 1 1 1 0 1 0 0 AB Q n +11 0 Q n0 1 1 1 1 0 0 0 Qn。
锁存器与触发器习题与参考答案
第5章 锁存器与触发器 习题与参考答案[题5-1] 画出图题5-1所示的SR 锁存器输出端Q 、Q 端的波形,输入端S 与R 的波形如图所示。
(设Q 初始状态为0)S RSRSRQQ....图题5-1解:SR.QQ....[题5-2] 画出图题5-2所示的SR 锁存器输出端Q 、Q 端的波形,输入端S 与R 的波形如图所示。
(设Q 初始状态为0)S RS RQQ...SR....图题5-2解:SR.Q Q......[题5-3] 画出图题5-3所示的电平触发SR 触发器输出端Q 、Q 端的波形,输入端S 、R 与CLK 的波形如图所示。
(设Q 初始状态为0)C1S RSRQQ....CLKS RCLK...图题5-3解:S RCLK..Q Q..[题5-4] 画出图题5-4所示的电平触发D 触发器输出Q 端的波形,输入端D 与CLK 的波形如图所示。
(设Q 初始状态为0)C1D DQQ....CLKDCLK..图题5-4解:DCLK..QQ....[题5-5] 画出图题5-5所示的边沿触发D 触发器输出端Q 端的波形,输入端D 与CLK 的波形如图所示。
(设Q 初始状态为0)C11DD QQ....CLKDCLK ...DQQ....CLKDCLK...C11D (1)(2)图题5-5解:DCLK ...DCLK...(1)(2)QQ....[题5-6] 画出图题5-6所示的边沿D 触发器输出Q 端的波形,CLK 的波形如图所示。
(设Q 初始状态为0)C11D Q 1CLK....CLK.1C11D Q 2CLK .CLK .图题5-6解:CLK....Q1Q2Q3...[题5-7] 试画出图题5-7所示电路输出端Q 1、Q 0端的波形,CLK 的波形如图所示。
(设Q 初始状态为0)CLK.....图题5-7解:..CLK...Q0Q1[题5-8] 画出图题5-8所示的JK 触发器输出Q 端的波形,输入端J 、K 与CLK 的波形如图所示。
《数字电子技术基础》第5章触发器
5.3 电平触发的触发器
例5.3.1 对于同步SR触发器,电路、时钟及输入端波形
如图5.3.3所示,若Q =0 ,试画出Q和 Q 的波形 。
解:输出波形如图5.3.3所示
图5.3.3
5.3 电平触发的触发器
例5.3.2电路如图5.3.4所示,已知S、R、RD和CLK的 波形,且SD=1,试画出Q和Q 的波形。
b.根据不同的输入信号可以置1或0.
3. 分类:
按触发方式:电平触发器、脉冲触发器和边沿触发器
按逻辑功能方式:SR锁存器、JK触发器、D触发器、 T触发器、T触发器
按结构:基本SR锁存器、同步SR触发器、主从触发器、 维持阻塞触发器、边沿触发器等
5.1 概述
根据存储数据的原理:静态触发器和动态触发器,晶 态触发器是靠电路的自锁来存储数据的,动态触发器 是靠电容存储电荷来存储数据的。
只有在CLK=1时, SR才能起作用
图5.3.1
5.3 电平触发的触发器
二、工作原理
1
1. CLK=0
此时门G3和G4被封锁,输
0
出为高电平。
对于由G1和G2构成的SR
1
锁存器,触发器保持原态,
即Q * = Q
0
1
2. CLK=1
1
此时门G3和G4开启,
触发器输出由S 和R决定。
0
1
a. S=0 , R=0
工作原理:
0
① J=K=0
主触发器保持原态, 0 则触发器(从触发 器)也保持原态。 即
Q*=Q
J
1S
Q主 1S
Q
CLK
C1
C1
K
1R
1R
Q主
第5章_课后习题答案word版本
第5章习题解答5-1由与非门组成的基本RS触发器的R d,S d之间为什么要有约束?当违反约束条件时,输出端Q、Q 会出现什么情况?试举例说明。
解:由与非门组成的基本RS触发器的R d和S d之间的约束条件是:不允许R d和S d同时为0。
当违反约束条件即当R d = S d =0时,Q、Q端将同时为1,作为基本存储单元来说,这既不是0状态,又不是1状态,没有意义。
5-2 试列出或非门组成的基本RS触发器的真值表,它的输入端R d和S d之间是否也要有约束?为什么?解:真值表如右表所示、Rd、Sd之同也要有约束条件,即不允许Rd=Sd=1,否则Q、Q端会同时出现低电平。
5-3画出图5-33由与非门组成的基本RS触发器输出端Q、Q的电压波形,输入端R D、S D的电压波形如图中所示。
解:见下图:5-4画出图5-34由或非门组成的基本RS触发器输出端Q、Q的电压波形,输入端S D、R D的电压波形如图中所示。
廟人1 ■0 0—-r--■ '■ »■'0 10 1\ 001 )」不定图5-335-5图5-35所示为一个防抖动输出的开关电路。
当拨动开关S时,由于开关触点接通瞬间发生振颤,R D、S D的电压波形如图中所示。
试画出Q、Q端对应的电压波形。
图5-35解:见下图:图5-34解:见下图:5-6 在图5-36电路中、若CP、S、R的电压波形如图中所示,试画出Q、Q端与之对应的电压波形。
假定触发器的初始状态为Q = 0。
图解:见下图:5-7在图5-37(a)所示的主从RS触发器中,CP、R、S的波形如图5-37(b)所示,试画出相应的Q m、Q m、Q和Q的波形图。
图5-37解:主从RS触发器的工作过程是:在CP= I期间主触发器接收输入信号,但输出端并不改变状态,只有当CP下降沿到来时从触发器甚才翻转,称为下降沿触发。
根据主从RS 触发器状态转换图可画出波形图如下图所示。
数字电子技术第5章习题解答
第5个CLK的下降沿产生后,触发器的状态随主触发器的状态而改变,即1状态。据此,可画出波形图如图5-12所示。
5-10带异步输入的脉冲触发的SR触发器中,各输入端的信号波形如图5-13所示,试画出Q、Q'端对应的波形。异步输入信号SD=0。
(3)第3个高电平期间,S=1,R=0,Q=1,Q’=0。
(4)第4个高电平期间,S=1,R=1,输出为11态,随后,S=0,R=1,Q=0,Q’=1。
(5)第5个高电平期间,S=0,R=0,输出保持;随后,S=1,R=0,Q=1,Q’=0;接着,S=0,R=0,输出保持;最后,S=0,R=1,Q=0,Q’=1。
图5-6
5-7已知电平触发的D触发器,若CLK、D的电压波形如图5-7所示,试画出Q和Q’端对应的电压波形。设触发器的初始状态为Q=0。
解:触发器为下降沿触发,标出每个时钟信号的下降沿。触发器初始状态为0。
(1)第1个下降沿,D=1,Q=1,Q’=0。
(2)第2个下降沿,D=0,Q=0,Q’=1。
(3)第3个下降沿,D=1,Q=1,Q’=0。
5-3.试问电平触发方式的触发器能构成具有翻转功能的触发器吗?为什么?
解:不能。电平触发方式的触发器,在整个电平有效期间内,均可以接收信号建立状态,因此,若构成具有翻转功能的触发器,将会在整个电平有效期间内不断地接收信号实现翻转,会出现空翻现象。
5-4.已知基本RS触发器电路中,输入信号端RD’和SD’的电压波形如图5-1所示,试画出图示电路的输出端Q和Q’端的电压波形。
第五章习题解答
解:
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练习: 练习: 触发器如图所示,画出输出Q的波形。 触发器如图所示,画出输出Q的波形。
SD J CP K RD S 1J C1 1K R Q1 Q1
SD
D
CP
RD
S 1D C1 R
Q2
Q2
RD
SD
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解:从题图可以看出: 从题图可以看出:
φ1 = Q2 φ2 = Q1Q2 + Q1Q2
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画出波形图如下: 画出波形图如下:
相位上, 超前于Φ 一个CP脉冲周期 脉冲周期。 相位上,Φ1超前于Φ2一个CP脉冲周期。
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Q
A CP
J CI K
Q
R
解:J=A,K=0
R = CP ⋅ Q
画出波形如上所示。 画出波形如上所示。
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5-16 逻辑电路如图所示,已知CP和RD的波形,画 逻辑电路如图所示,已知CP和 的波形, 的波形. 出触发器Q 出触发器Q1和Q2的波形.
D D CI Q Q1 1 J CI K Q Q2
CP
解:从题图看出: 从题图看出: J = Q1 K = Q1 画出波形图如右 所示: 所示:
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5-15 逻辑电路如图所示,已知CP和X的波形,画出触 逻辑电路如图所示,已知CP和 的波形, 发器Q 的波形,设触发器初始状态为0. 发器Q1和Q2的波形,设触发器初始状态为0.
(李晶皎)逻辑与数字系统设计第五章触发器习题解答
第五章触发器5-1由或非门构成的基本RS触发器的特性表:S R Q Q* 功能0 0 Q Q 保持0 1 X 0 复位1 0 X 1 置位1 1 X 0* 约束Q端波形:5-2这是一个门控RS触发器,CP=1期间R、S控制触发器的状态;CP=0期间,触发器的状态保持不变门控RS触发器的特性表:CP R S Q* 功能0 X X Q 保持1 1 0 0 复位1 0 1 1 置位1 1 1 1* 约束5-3(a) RS触发器的输入S=AQ,R=BQ,代入RS触发器的特性方程Q*=S+R Q 中,得:Q*=S+R Q=AQ+(BQ) Q=AQ+(B+Q)Q=AQ+B Q(b) RS触发器的输入S=CQ,R=DQ,代入RS触发器的特性方程Q*=S+R Q 中,得:Q*=S+R Q=CQ+(DQ) Q=CQ+(B+Q)Q=CQ+Q=C+Q5-4与非门构成的基本RS触发器的特性表:R S Q* 功能0 0 1* 约束0 1 0 复位1 0 1 置位1 1 Q 保持5-5根据主从结构同步RS触发器的特性表,可画出波形如下(设正脉冲有效)5-6将S=A,R=A代入RS触发器的特性方程Q*=S+R Q中,得:Q*=A+AQ=A——该电路实现的是D触发器5-7RS触发器的输入S=(AQ),R=(BQ),代入RS触发器的特性方程,图中的RS触发器的R、S为低有效,故特性方程为:Q*=S+RQ中,代入后得:Q*=S+RQ=((AQ))+(BQ)Q=AQ+(B+Q)Q=AQ+B Q5-8由图中可知,当R D=0时,Q1*=Q2*=0;当R D=1时,在时钟脉冲的下降沿,Q1*=D,Q2*=JQ2+K Q2= Q1Q2,画出波形图:5-9主从结构和边沿触发的触发器都是无空翻现象的触发器,这里选用边沿触发的RS触发器。
T触发器的特性方程为Q*= TQ+ T Q,与RS触发器的特性方程Q*=S+R Q,并考虑RS触发器的约束条件RS=0,将T触发器的特性方程化为:Q*= TQ+ (T+Q)Q,故S= TQ,R=(T+Q)=TQ,逻辑电路图如下:5-10触发器上升沿触发,特性方程:Q1*=D1=A,Q2*=D2= Q1,B=( Q2Q1),C=( Q2Q1),波形如下:5-11R D=0时,两个触发器的异步复位端都有效,即:Q1=Q2=0;R D=1时,Q1*=J1Q1+K1Q1= Q1+ Q1Q1=1,下降沿触发Q2*=J2Q2+K2Q2= Q2+ Q2Q2=1,CP上升沿时,触发器的时钟输入端有下降沿出现,即:CP上升沿时触发器有动作波形如下:5-12两个触发器的J=K=1,且都是下降沿触发;故:触发器(1)在CP下降沿翻转;触发器(2)在Q1的下降沿时翻转;输出F=Q1Q2,波形如下(设初态为0):5-13R D=0时,两个触发器的异步复位端都有效,即:Q1=Q2=0;R D=1时:Q1*=D1=Q2,A的上升沿触发Q2*=D2=Q1,B的上升沿触发波形如下:5-14JK触发器的特性方程Q*= JQ+K Q,与T触发器的特性方程Q*= TQ+T Q 进行比较,得:J=K=T,即可构成T触发器。
第五章 触发器 习题参考答案
第五章触发器习题解答【题5.4】画出图 P5.4(a) 中电平触发SR触发器Q和Q’ 端的电压波形。
时钟脉冲CLK和输入S、R的电压波形如图P5.4(b) 所示。
设触发器的初始状态为Q=0。
解:由电平触发器的特性表,可得如上图所示的电压波形。
注意:有不符合SR触发器约束条件的情况,故Q和Q’有一处并不相反!【题5.7】画出图P5.7(a) 中脉冲触发JK触发器输出端Q和Q’的电压波形。
时钟脉冲CLK和输入J、K的电压波形如图P5.7(b) 所示。
设触发器的初始状态为Q=0。
解:由脉冲触发JK触发器的特性表,可得如上图所示的电压波形。
【题5.8】画出图P5.8(a) 中脉冲触发JK触发器输出端Q和Q’的电压波形。
时钟脉冲CLK和输入J、K的电压波如图P5.8(b) 所示。
设触发器的初始状态为Q=0。
解:同脉冲触发JK触发器特性表,可得如上图所示的电压波形。
【题5.11】图P5.11(a) 是带有异步清零端的上升沿触发D触发器,CLK和D 端的电压波形如图P5.11(b) 中所给出。
试画出触发器输出端Q对应的电压波形。
解:Rd=1时,触发器被置0,即Q=0时,由边沿触发D触发器的特性表,可得如上图所示的电压波形。
【题5.13】画出图P5.13(a) 中两个D触发器FF1和FF2的输出端Q1’和Q2’的电压波形。
时钟脉冲CLK和输入端D的电压波形如图P5.13(b)所示。
设触发器的初始状态均为Q=0。
解:FF1触发器发生在CLK下降沿触发;FF2触发器发生在CLK上升沿触发,则电压波形如上图所示。
【题5.14】画出图P5.14(a) 中两个JK触发器FF1和FF2的输出端Q1和Q2的电压波形。
时钟脉冲CLK和输入端J、K的电压波形如图P5.14(a) 所示。
设触发器的的初始状态均为Q=0。
解:FF1触发器发生在CLK下降沿触发;FF2触发器发生在CLK上升沿触发,则Q1、Q2的电压波形如上图所示。
数字电子技术第5章触发器自测练习与习题
数字电子技术第5章触发器自测练习与习题第5章触发器5.1RS触发器自测练习1.或非门构成的基本RS触发器的输入S=1、R=0,当输入S变为0时,触发器的输出将会()。
(a)置位(b)复位(c)不变2.与非门构成的基本RS触发器的输入S=1,R=1,当输入S变为0时,触发器输出将会()。
(a)保持(b)复位(c)置位3.或非门构成的基本RS触发器的输入S=1,R=1时,其输出状态为()。
(a)Q=0,Q=1(b)Q=1,Q=0(c)Q=1,Q=1(d)Q=0,Q=0(e)状态不确定4.与非门构成的基本RS触发器的输入S=0,R=0时,其输出状态为()。
(a)Q=0,Q=1(b)Q=1,Q=0(c)Q=1,Q=1(d)Q=0,Q=0(e)状态不确定5.基本RS触发器74LS279的输入信号是()有效。
(a)低电平(b)高电平6.触发器引入时钟脉冲的目的是()。
(a)改变输出状态(b)改变输出状态的时刻受时钟脉冲的控制。
7.与非门构成的基本RS触发器的约束条件是()。
(a)S+R=0(b)S+R=1(c)SR=0(d)SR=18.钟控RS触发器的约束条件是()。
(a)S+R=0(b)S+R=1(c)SR=0(d)SR=19.RS触发器74LS279中有两个触发器具有两个S输入端,它们的逻辑关系是()。
(a)或(b)与(c)与非(d)异或10.触发器的输出状态是指()。
(a)Q(b)Q答案:1.c2.c3.d4.c5.A6.b7.b8.c9.b10.a5.2D触发器自测练习1.要使电平触发D触发器置1,必须使D=()、CP=()。
2.要使边沿触发D触发器直接置1,只要使SD=()、RD=()即可。
3.对于电平触发的D触发器或D锁存器,()情况下Q输出总是等于D输入。
4.对于边沿触发的D触发器,下面()是正确的。
(a)输出状态的改变发生在时钟脉冲的边沿(b)要进入的状态取决于D输入(c)输出跟随每一个时钟脉冲的输入(d)(a)(b)和(c)5.“空翻”是指()。
详细版第5章-锁存器和触发器.doc
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5 锁存器和触发器
5.2 锁存器
5.2.1 分析图题5.2.1所⽰电路的功能,列出功能表。
解:由逻辑电路图,可以得到Q
端和Q 端得逻辑表达式
Q S Q
Q R Q =⋅=⋅
根据上⾯两式,可以得到该锁存器的功能表,如表题解5.2.1所⽰。
5.2.2 ⽤CMOS 电路74HCT02或⾮门构成消除机械开关抖动影响的电路如图题5.2.2所⽰,试画出在开关S 由位置A 到B 时Q 和Q 端的波形。
如改⽤TTL 电路
74LS02实现,R 1、R 2取值的⼤致范围为多少?整个电路的功耗发⽣什么变化?
解:如图题5.2.2所⽰,开关接通A 点时,Q=0,Q =1。
当开关触点拨离A 点瞬间,由于Q =1的作⽤,其抖动不会影响Q=0的状态。
在开关悬空期间,锁存器保持状态不变。
开关触点第
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第五章触发器练习题
第五章触发器一、填空题1、触发器具有个稳定状态,它可存储位二进制信息。
若要存储8位二进制信息时,需要个触发器。
2、触发器有两个互补输出端Q 和Q ,当0,1Q Q ==时,触发器处于状态;当1,0Q Q ==时,触发器处于状态;可见,触发器的状态是指端的状态。
3、同步RS 触发器的特性方程中,约束条件为RS=0,说明这两个输入信号不能同时为。
4、D 触发器的次态由时钟脉冲CP 上升沿到达时刻D 的状态决定,所以它是。
5、边沿JK 触发器的次态由时钟脉冲CP 下降沿到达时刻输入信号决定。
6、在基本RS 触发器暗中,输入端D R 或D R 能使触发器处于状态,输入端D S 或D S 能使触发器处于状态。
7、同步RS 触发器状态的改变是与信号同步的。
8、同步D 触发器的特性方程为。
9、在CP 脉冲和输入信号作用下,JK 触发器能够具有、、和的逻辑功能。
10、在CP 脉冲有效期间,D 触发器的次态方程1n Q+=,JK 触发器的次态方程1n Q +=。
11、对于JK 触发器,当CP 脉冲有效期间,若0J K ==时,触发器状态;若J K =时,触发器或;若1J K ==时,触发器状态。
12、对于JK 触发器,若J K =,则可完成触发器的逻辑功能。
13、对于JK 触发器,若J K =,则可完成触发器的逻辑功能。
14、将D 触发器的D 端与Q 端直接相连时,D 触发器可转换成触发器。
15、触发器具有稳定状态,其输出状态由触发器的和状态决定。
16、基本RS 触发器有、、三种可使用的功能,对于由与非门组成的基本RS 触发器,在1,0==D D R S 时,触发器;在1,1==D D R S 时,触发器;在0,1==D D R S 时,触发器;不允许时0,0==D D R S 存在,排除这种情况出现的约束条件是。
17、触发器的特性方程是用以表示与、之间关系的方程式。
18、边沿JK 触发器具有、、、功能,其特性方程为。
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第五章触发器
典型例题分析
例1:选择题
1.为了使时钟控制的RS触发器的次态为1,RS的取值应为()。
A. RS=00
B. RS=01
C. RS=10
D. RS=11
2.为了使触发器克服空翻与振荡,应采用()。
A.CP高电平触发
B.CP低电平触发
C.CP低电位触发
D.CP边沿触发
3.逻辑电路如图所示,当A=“0”,B=“1”时,脉冲来到后触发器( )。
A.具有计数功能
B.保持原状态
C.置“0”
D. 置“1”
答案 1.B 2. D 3.A
例2:设主从J-K触发器的原状态为1,按照下图所给出的J、K、CP输入波形,画出触发器Q端的工作波形。
解:此题信号K的某些跳变与CP脉冲的跳变发生在同一时刻,这是初学者容易感到疑惑的地方,所以要注意到,画Q次态波形时应看CP脉冲下降沿前一刻的J、K值。
画波形时,从第1个CP脉冲开始分析,看它的下降沿前的J、K为何值,再依据J-K触发器真值表所述的功能,确定Q的次态,也就是CP脉冲下降沿触发以后Q的新状态。
例如图(a)中第1个CP 脉冲下降沿前一刻,J、K同为1,经CP脉冲触发后Q必然翻转,所以在第1个CP脉冲下降沿后Q由1变为0。
这样分析下去,直到最后一个CP脉冲为止。
故该题正确的Q端工作波形如图(b)所示。
例2 J-K触发器工作波形
例3:设主从J-K 触发器的原状态为0,输入波形如下图所示,试画出Q 端的工作波形。
解:该例题增加了难度。
要求读者不但熟悉J-K 触发器的真值表,还应熟悉D R 、D R 的异步置0、置1的作用。
画波形时,应首先考虑D R 、D S 的值。
它们对触发器是属于一种电平触发,即不像CP 脉冲那样有上升沿与下降沿的区分。
只要D R (或D S )为0,无论是由0→1,还是由1→0,附近的CP 脉冲都不能起作用,视为无效,同
样J 、K 也视为无效。
一旦D R =0(D =1)
,触发器Q 就为0;而只要D =0(D R =1),触发器Q 就为1。
只有当D R =D S =1时,才分析CP 、J 、K 对触发器Q 的作用。
现在从图(a )中t =0时刻开始分析。
由题已知Q 起始状态为0,当第1
个CP 脉冲到来时,正对应着D R =0(D S =1)
,Q 不变,仍为0。
第2个CP 脉冲又对应着D S =0(D R =1),该CP 脉冲无效,但因D R 为0,使Q 由0变为1。
第3个CP 脉冲到来时,D S =D R =1,该CP 脉冲有效,因在它的下降沿前一时刻,J =K =1,所以在第3个CP 脉冲下降沿以后,Q 由1变为0。
接着D S 变为0(D R =1)
,Q 立即响应由0变为1。
第4、5、6个CP 脉冲都因为D =0或D R =0而不起作用,Q 由原来的1保持到D R 为0时才变为0。
最后,Q 的工作波形如下图(b )所示。
例3 工作波形
例4:电路图如下图(a)所示,输入信号CP 、R D 和D 如下图(b)所示,试画出Q 1,Q 2的波形。
例 4 电路与工作波形
解:这是有两个触发器的电路。
首先要分辨两者之间的输入、输出的依赖关系。
这里有J 2=Q 1,而D 1的状态与后者无关。
所以要先画Q 1波形,后画Q 2波形。
如果Q 1波形画错,Q 2波形也不可能正确。
其次要注意到两个不同类型的触发器对CP 脉冲的响应是不一样的,Q 1的翻转对应CP 脉冲的上升沿,Q 2的翻转对应CP 脉冲的下降沿。
另外图中J-K
触发器的K 2端悬空,一般输入端悬空就表示接“1”。
在图(b)中,一开始D R 就为0,所以Q 1、Q 2起始状态都为0。
此后,D R 一直保持为1,那么后面的6个CP 脉冲都是有效触发。
画Q 1波形时,应遵循D 触发器的次态方程Q n +1=D 。
如第1个CP 脉冲上升沿前一刻D 1为1,该上升沿过后,Q 1由0→1。
值得特别注意的是第2个CP 脉冲上升沿正对应着D 1由1→0,Q 1是否也立即由1→0呢?以往常有初学者认为Q 1也立即由1→0。
其实Q 1继续为1,保持到第3个CP 脉冲上升沿以后才由1→0。
对第4个CP 脉冲上升沿处的分析也是这样,此处,D 1由0→1,而Q 1并不立即变化,而是在第5个CP 脉冲上升沿以后,Q 1才由1→0。
这种滞后的响应正是D 触发器的特征。
画Q 2时,注意到Q 1就是J 2的值,而K 2=1,根据CP 脉冲下降沿触发的特点,由真值表确定次态,分析如前面例题所述。
最后,Q 1、Q 2的工作波形如上图(c)所示。
例5:电路和输入波形CP 、A 如下图(a)、(b)所示,设起始状态Q1Q2=00,试画出Q 1、Q 2、B 、C 的输出波形。
例 5
电路与输入波形
解:该电路在两个触发器的基础上增加了组合电路。
因为组合电路的特点是即刻的输出仅取决于即刻的输入。
所以组合电路的输出波形仅依据输出函数的逻辑方法来画。
根据上图(a),B 、C 的逻辑方程为
212121,Q Q C Q Q B +===
由上式可知,只有先画出时序电路的输出Q 1、Q 2的波形以后,才能画出B 、C 的波形。
注意到D 2=Q 1,所以在画Q 1、Q 2波形时又要求先画Q 1波形、后画Q 2波形。
画Q 1、Q2波形时对D 触发器的分析如前面所述,从第1个CP 脉冲开始分析,针对每个CP 脉冲的上升沿,辨认D 输入,再按Q n +1=D 确定次态。
最后得到输出波形如上图(c)所示。
例6:电路如下图(a)所示,设起始状态Q 2Q 1=00,问经过系统时钟信号3个CP 脉冲作用后,Q 2Q 1处于什么状态?
例 6 电路图与波形图
解:要回答这个问题,仍然要求画工作波形。
图中两个T 触发器由于信号T =,都是T ′触发器。
只要受到时钟脉冲信号的触发,触发器就翻转。
但是第二个触发器的时钟脉冲信号应为CP 2=1Q +CP ,只有当1Q 1=0时,第二个触发器才会随着CP 脉冲由0→1,得到上升沿触发而改变状态。
画出的Q 1Q 2波形如上图(b)所示。
从工作波形图可知,经过系统时钟脉冲信号3个CP 脉冲作用后,Q 2Q 1处于11状态。
例7:电路和输入信号CP 、X 如下图(a)、(b)所示,设起始状态Q =0,问经过3个CP 脉冲以后,Q 、Z 分别为什么值?
例7 电路与波形图
解:要解答这个问题。
应正确地画出工作波形。
在电路中有组合逻辑门,就应该首先写出它们的输出逻辑式。
其中,X J XQ Z ==,⊕Q 。
由于J -K 触
发器的次态方程比较复杂,一般画波形时不利用其次态方程。
而是根据每个CP 脉冲下降沿前J 、K 值,结合真值表,确定CP 脉冲下降沿后的Q 的新状态。
例如,Q 的起始状态0,在第1个CP 脉冲下降沿前一时刻,J =Q ⊕X =0⊕1=1。
因为此时J 、K 都为1,在CP 脉冲触发后,触发器必翻转。
所以第1个CP 脉冲下降沿以后,Q 由0变为1。
照着这样分析下去,直到第4个CP 脉冲为止(因题中给出了4个CP 脉冲)。
画出Q 的波形后,再根据XQ Z =,画Z 的对应波形。
最后得到的工作波形如上图(c)所示。
从从图(c)中可知,经过3个CP 脉冲作用后,Q =1,Z =0。
例8:电路和输入波形如下图(a)、(b)所示,试画出Q 1、Q z 、Z 的输出波形。
例8 电路与波形
解:在这个电路中,两个触发器的激励输入都不是直接来自外来信号。
对于这种比较复杂的情况,一般先列出所有激励输入端的方程。
因为Z 是组合逻辑输出,所以也应列出Z 的方程。
这些驱动方程为:
2112111,,,1Q Q Z Q D Q K J ====
从上述逻辑式中,可知应先画出Q 1波形,然后画Q 2波形,最后才能画Z 的波形。
画Q1波形时,由于K1与触发器自身状态有关,如果按真值表画比
较繁琐,所以不妨将J1、K1代入次态方程Q K Q J Q n +=+1,若得到简单的表
达式,则利用它来画Q1波形。
这里将J 1=1,K 1=Q 1代入,得;
1111111111Q Q Q Q Q K Q J Q n =+=+=+
这个方程简单,并意味着,只要1==D D R S ,每个CP 脉冲的下降沿处都会出现Q 1的翻转。
画Q 2波形时,注意D 触发器是在CP 脉冲上升沿触发,且。
画Z 波形时,因为它与1212Q D Q n ==+2Q 有关,所以最好也画出2Q 波形,便于判断Z的状态。
最后所要求的输出波形如上图(c)所示。