微机原理与接口技术第二章 8086系统结构

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微机原理(杭州电子科技大学【4】8086系统结构[2-3]

微机原理(杭州电子科技大学【4】8086系统结构[2-3]

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二、系统的复位与启动
【8086CPU时序】
① 复位信号:通过RESET引脚上的触发信号来引起8086系统复位和启
动,RESET至少维持4个时钟周期的高电平。
② 复位操作:当RESET信号变成高电平时,8086/8088CPU结束现行
操作,各个内部寄存器复位成初值。
标志寄存器
清零
指令寄存器 CS寄存器 DS寄存器 SS寄存器 ES寄存器
的比例倍频后得到CPU的主频,即: CPU主频 = 外频 × 倍频系数
⑥ PC机各子系统时钟(存储系统,显示系统,总线等)是由系统频率按 照一定的比例分频得到。
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内频 550MHz Pentium III
倍频系数5.5
L1 Cache
L2 550MHz Cache
处理机总线 100MHz
微机原理与接口技术
第四讲
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第二章 8086系统结构
内容提要
z微型计算机的发展概况 z8086CPU内部结构 z8086CPU引脚及功能 z8086CPU存储器组织 z8086CPU系统配置 z8086CPU时序
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※有关概念介绍
z 主频,外频,倍频系数 z T状态 z 总线周期 z 指令周期 z 时序 z 时序图
总线操作
读存储器操作 (取操作数)
写存储器操作 (将结果存放到内存)
读 I/O 端口操作 (取 I/O 端口中的数)
写 I/O 端口操作 (往 I/O 端口写数)
中断响应操作
总线周期
存储器读周期 存储器写周期 I/O 端口读周期 I/O 端口写周期 中断响应周期
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微机原理课件第二章 8086系统结构

微机原理课件第二章 8086系统结构

但指令周期不一定都大于总线周期,如MOV AX,BX
操作都在CPU内部的寄存器,只要内部总线即可完成,不 需要通过系统总线访问存储器和I/O接口。
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• 8086CPU的典型总线时序,充分体现了总 线是严格地按分时复用的原则进行工作的。 即:在一个总线周期内,首先利用总线传 送地址信息,然后再利用同一总线传送数 据信息。这样减少了CPU芯片的引脚和外 部总线的数目。
• 执行部件(EU)
• 功能:负责译码和执行指令。
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• 联系BIU和EU的纽带为流水指令队列
• 队列是一种数据结构,工作方式为先进先出。写入的指令 只能存放在队列尾,读出的指令是队列头存放的指令。
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•BIU和EU的动作协调原则 BIU和EU按以下流水线技术原则协调工作,共同完成所 要求的任务: ①每当8086的指令队列中有空字节,BIU就会自动把下 一条指令取到指令队列中。 ②每当EU准备执行一条指令时,它会从BIU部件的指令 队列前部取出指令的代码,然后译码、执行指令。在执 行指令的过程中,如果必须访问存储器或者I/O端口, 那么EU就会请求BIU,完成访问内存或者I/O端口的操 作; ③当指令队列已满,且EU又没有总线访问请求时,BIU 便进入空闲状态。(BIU等待,总线空操作) ④开机或重启时,指令队列被清空;或在执行转移指令、 调用指令和返回指令时,由于待执行指令的顺序发生了 变化,则指令队列中已经装入的字节被自动消除,BIU会 接着往指令队列装入转向的另一程序段中的指令代码。 (EU等待)
•CF(Carry Flag)—进位标志位,做加法时最高位出现进位或 做减法时最高位出现借位,该位置1,反之为0。

微机原理与接口技术第2章8086微处理器

微机原理与接口技术第2章8086微处理器

EU 控 制系统
执行单元 EU
指令队列 队列总线 (8位) 1 2 3 4 5 6
8088
总线接口 单元BIU
8086
8086 CPU 工作特点
8位微处理器的程序执行方式
8086程序的执行过程
BIU中的指令队列为FIFO. 6个中有2个以上为空闲时,BIU会自动把指令 放到指令队列中
2.1.2 8086 CPU 的寄存器配置
AD15~AD8 AD7~AD0
传输的字节
高低字节同时传送(从偶地址传 送一个字) 从奇数地址传送高字节
从偶数地址传送低字节 无操作 从奇地址传送一个字 第一次传送低8位(于奇地址) 第二次传送高8位(于偶地址)
2.存储器的分段结构
8086CPU的内部寄存器是16位的,寄存器直接寻址的 内存空间只能是64KB。8086是采用地址分段的方法 把1MB的存储空间分为若干段来使用,每段最多 64KB,在段内寻址仍可采用传统的16位地址寻址方 法。每个段不一定都是64KB,可以小于它,段与段 之间可以是连续的、分开的、部分重叠的,也可以是 完全重叠的。
① 状态(条件)标志:OF、SF、ZF、CF、AF、PF② 控 制标志位:DF、IF、TF。
① 条件码标志
条件码标志用来记录程序中运行结果的状态信息,它们是根据有关指令 的运行结果由CPU自动设置的。由于这些状态信息往往作为后续条件转 移指令的转移控制条件,所以称为条件码。
进位标志:CF,记录运算时最高有效位产生的进位 值。 符号标志:SF,记录运算结果的符号。结果为负时 置1,否则置0。 零标志: ZF,运算结果为0时ZF位置1,否则置0。
最大模式:多CPU模式,指系统中有两个或者两个以上的微处理器,其中 一个是主处理器8086,而其它的都是协处理器,控制信号是通过8288总线 控制器提供的。

微机原理课件 第2章 8086系统结构

微机原理课件  第2章 8086系统结构

通 用 寄 存 器
AH AL BH BL CH CL DH DL SP BP DI SI
AX BX CX DX

地址总线 20位 数据总线 8088:8位 8086:16位
段寄存器
指令指针
ALU数据总线(16位)
CS DS SS ES IP 内部暂存器
总线 控 制逻辑
运算寄存器
EU 控 制系统
指令队列 Q总线 (8位) 1 2 3 4 5 6 8088 8086
8086/8088CPU提供的指令,能够直接处理的最大无符号数就是一个字(16 位),如果超出这个范围,就必须使用多字节来表示要计算的数据。 这个原理不光只在8086/8088芯片中有,任何芯片,无论它处理的数据范围多 么大,它总是一个有限的单位,如果超出这个单位,就必须使用标志位作为运算 的中介。 b. 在执行移位指令时, CF标志用于存放移出位的值。 例如对01010011实行逻辑右移,即把这个字节中的每一位向右移动一位,左 边空出的那一位置为0,以前最右边那一位就被移出字节范围外了,那么这一位 就是移出位,移出位都是保存在 CF中的。这个例子中,移位完成后, CF应该 等于1。 c. CF标志位还能够为一些条件转移指令提供判别依据。 例如JC指令,它就是先判别CF标志位的值,如果CF=1,就跳转到指令中给出 地址继续执行程序,如果 CF=0,就不作跳转,CPU会顺序执行下一条指令。也 就是说,在程序中,可以根据CF标志取值的不同来实现程序的分支或循环结构。
OF—溢出标志位,OF溢出的判断方法如下: 加法运算: 若两个加数的最高位为0,而和的最高位为1,则产生溢出; 若两个加数的最高位为1,而和的最高位为0,则产生溢出; 两个加数的最高位不相同时,不可能产生溢出。 减法运算: 若被减数的最高位为0,减数的最高位为1,而差的最高位为1, 则产生溢出; 若被减数的最高位为1,减数的最高位为0,而差的最高位为0, 则产生溢出; 被减数及减数的最高位相同时,按两数的大小判断溢出。 如果所进行的运算是带符号数的运算,则溢出标志恰好能够 反映运算结果是否超出了8位或16位带符号数所能表达的范围, 即字节运算大于十127或小于-128时,字运算大于十32767或小 于-32768时,该位置1,反之为0。

微机原理和接口技术[第三版]课本习题答案解析

微机原理和接口技术[第三版]课本习题答案解析

第二章 8086体系结构与80x86CPU1.8086CPU由哪两部分构成?它们的主要功能是什么?答:8086CPU由两部分组成:指令执行部件(EU,Execution Unit)和总线接口部件(BIU,Bus Interface Unit)。

指令执行部件(EU)主要由算术逻辑运算单元(ALU)、标志寄存器FR、通用寄存器组和EU控制器等4个部件组成,其主要功能是执行指令。

总线接口部件(BIU)主要由地址加法器、专用寄存器组、指令队列和总线控制电路等4个部件组成,其主要功能是形成访问存储器的物理地址、访问存储器并取指令暂存到指令队列中等待执行,访问存储器或I/O端口读取操作数参加EU运算或存放运算结果等。

2.8086CPU预取指令队列有什么好处?8086CPU内部的并行操作体现在哪里?答:8086CPU的预取指令队列由6个字节组成,按照8086CPU的设计要求,指令执行部件(EU)在执行指令时,不是直接通过访问存储器取指令,而是从指令队列中取得指令代码,并分析执行它。

从速度上看,该指令队列是在CPU内部,EU从指令队列中获得指令的速度会远远超过直接从内存中读取指令。

8086CPU内部的并行操作体现在指令执行的同时,待执行的指令也同时从内存中读取,并送到指令队列。

5.简述8086系统中物理地址的形成过程。

8086系统中的物理地址最多有多少个?逻辑地址呢?答:8086系统中的物理地址是由20根地址总线形成的。

8086系统采用分段并附以地址偏移量办法形成20位的物理地址。

采用分段结构的存储器中,任何一个逻辑地址都由段基址和偏移地址两部分构成,都是16位二进制数。

通过一个20位的地址加法器将这两个地址相加形成物理地址。

具体做法是16位的段基址左移4位(相当于在段基址最低位后添4个“0”),然后与偏移地址相加获得物理地址。

由于8086CPU的地址线是20根,所以可寻址的存储空间为1M字节,即8086系统的物理地址空间是1MB。

微机原理课件第二章8086系统结构

微机原理课件第二章8086系统结构
程序转移指令
介绍8086处理器的程序转移指令,包括无条 件跳转和条件跳转等操作。
8086中断处理
硬件中断
解释硬件中断的工作原理和处 理过程,以及8086处理器与外 部设备之间的中断信号传递。
软件中断
了解软件中断的使用方法和处 理过程,以及如何在程序中触 发软件中断。
异常中断
探索异常中断的发生原因和处 理机制,以及在运行过程中如 何处理异常中断。
3
总线周期和总线控制信号
介绍8086系统的总线周期和各种总线控制信号的含义和作用。
8086寄存器结构
1 通用寄存器
2 段寄存器
了解8086处理器的通用寄存器,包括数据 寄存器、指令寄存器和堆栈指针寄存器。
探索8086处理器的段寄存器,包括代码段 寄存器、数据段寄存器和堆栈段寄存器。
3 指令指针寄存器
4 标志寄存器
了解8086处理器的指令处理器的标志寄存器,包括各个 标志位的含义和影响。
8086系统工作模式
实模式
保护模式
虚拟8086模式
详细介绍8086处理器的实模式, 了解8086处理器的保护模式, 包括内存寻址方式和运行特点。 包括内存管理机制和特权级别。
8086系统结构
本课件介绍了8086微处理器的系统结构,包括处理器的基本特点、逻辑结构、 功能模块、与外部设备的接口与控制,以及与存储器的接口与控制。
8086系统总线结构
1
物理地址与逻辑地址转换
解释如何将物理地址转换为逻辑地址,并且了解逻辑地址和物理地址之间的关系。
2
地址线和数据线
探索8086系统的地址线和数据线的数量、作用和连接方式。
2 寄存器观察
探索如何使用单步执行技术来逐条执行和 调试程序。

微机原理与接口技术(第三版)课本习题答案

微机原理与接口技术(第三版)课本习题答案

第二章 8086体系结构与80x86CPU1.8086CPU由哪两部分构成它们的主要功能是什么答:8086CPU由两部分组成:指令执行部件(EU,Execution Unit)和总线接口部件(BIU,Bus Interface Unit)。

指令执行部件(EU)主要由算术逻辑运算单元(ALU)、标志寄存器FR、通用寄存器组和EU控制器等4个部件组成,其主要功能是执行指令。

总线接口部件(BIU)主要由地址加法器、专用寄存器组、指令队列和总线控制电路等4个部件组成,其主要功能是形成访问存储器的物理地址、访问存储器并取指令暂存到指令队列中等待执行,访问存储器或I/O端口读取操作数参加EU运算或存放运算结果等。

2.8086CPU预取指令队列有什么好处8086CPU内部的并行操作体现在哪里答:8086CPU的预取指令队列由6个字节组成,按照8086CPU的设计要求,指令执行部件(EU)在执行指令时,不是直接通过访问存储器取指令,而是从指令队列中取得指令代码,并分析执行它。

从速度上看,该指令队列是在CPU内部,EU从指令队列中获得指令的速度会远远超过直接从内存中读取指令。

8086CPU内部的并行操作体现在指令执行的同时,待执行的指令也同时从内存中读取,并送到指令队列。

5.简述8086系统中物理地址的形成过程。

8086系统中的物理地址最多有多少个逻辑地址呢答:8086系统中的物理地址是由20根地址总线形成的。

8086系统采用分段并附以地址偏移量办法形成20位的物理地址。

采用分段结构的存储器中,任何一个逻辑地址都由段基址和偏移地址两部分构成,都是16位二进制数。

通过一个20位的地址加法器将这两个地址相加形成物理地址。

具体做法是16位的段基址左移4位(相当于在段基址最低位后添4个“0”),然后与偏移地址相加获得物理地址。

由于8086CPU的地址线是20根,所以可寻址的存储空间为1M字节,即8086系统的物理地址空间是1MB。

微机原理ch2

微机原理ch2

第二章第二章 8086 8086系统结构系统结构主要内容:§2-1 8086CPU 系统结构§2-2 8086CPU 的引脚功能和系统配置 §2-3 8086存储器组织 §2-4 8086CPU 时序 §2-1 1 8086CPU 8086CPU 系统结构系统结构 一、引言1、8086:Intel 系列的16位微处理器,16条数据线、20条地址线,可寻址地址范围220=1MB,8086工作时,只要一个5V 电源和一个时钟,时钟频率分别有5MHz,8MHz 和10MHz。

2、8088:内部与8086兼容,也是一个16位微处理器,只是外部数据总线为8位,所以称为准16位微处理器。

8088有20条地址线,所以可寻址的地址空间达220即1M 字节。

图2-1 8086CPU 内部结构框图(★)二、8086CPU 的内部结构1、总线接口部件BIU(Bus Interface Unit)它是8086CPU 与外部(存储器和I/O 端口)数据交换的接口。

它提供了16位双向数据总线和20位地址总线,通过它们完成所有外部总线操作。

图2-2 总线接口部件(★)(1)总线接口部件的功能地址形成、取指令、指令排队、读/写操作数和总线控制。

(2)组成部分① 四个段地址寄存器(主要用于存放各段的首地址) CS:16位代码段寄存器; DS:16位数据段寄存器; ES:16位附加段寄存器; SS:16位堆栈段寄存器。

② 16位指令指针寄存器IP(PC)。

存放下一条要执行指令的偏移地址。

③ 20位的地址加法器。

将16位的逻辑地址转换成访问存储器的20位的物理地址。

④ 六字节的指令队列缓冲器。

功能:可存储6字节指令代码,在执行指令的同时,将取下一条指令,当指令队列有2个或2个以上的字节空余时,BIU自动将指令取到指令队列中。

CPU执行完一条指令后,可以指向下一条指令(流水线技术)。

微机系统与接口技术_ 8086系统结构_

微机系统与接口技术_ 8086系统结构_

第2章8086系统结构2.1 8086 CPU内部结构2.2 8086 内部寄存器结构2.3 8086 系统存储器组织2.4 8086 CPU外部特性2.5 8086 CPU操作时序2.1 8086 CPU内部结构8086 CPU概况8086CPU 主频最大为8MHz,具有16位数据总线,20位地址总线,内存寻址能力为1MB采用双列直插封装的8086 CPU有40根管脚在中断管理方面,8086 CPU 可处理内部软件中断和外部中断,中断源可达256个8086 CPU 内部有14个16位寄存器,包括4个段地址寄存器,8个通用寄存器,1个标志寄存器,1个指令指针寄存器支持x86指令集的汇编程序运行模式2.1 8086 CPU 内部结构✓算术逻辑运算单元(ALU)、✓标志寄存器FR 、✓通用寄存器组✓EU 控制器指令执行部件(EU)组成指令执行部件(EU) 总线接口部件(BIU)8086CPU 由两部分组成✓指令译码✓执行指令-在ALU 中完成✓暂存中间运算结果-通用R✓保存运算结果特征-FLAG指令执行部件(EU)功能CPU 部件-总线接口单元总线接口单元(BIU)组成:✓地址加法器✓专用寄存器组✓指令队列✓总线控制电路总线接口单元(BIU)功能:✓形成访问存储器的物理地址,取出指令,暂存到指令队列中等待执行✓访问存储器或I/O端口-读取操作数✓执行转移指令,并取新指令CPU内指令执行过程取指令:CPU的控制器从内存读取一条指令并放入指令寄存器指令译码:指令寄存器中的指令经过译码,决定该指令应进行何种操作(就是指令里的操作码)、操作数在哪里(操作数的地址)。

执行指令,分两个阶段:取操作数和运算。

修改指令计数器,决定下一条指令的地址。

程序指令执行过程 1 控制单元将指令计数器里的指令地址送到地址总线2 在内存中读取指令,CPU将读到的指令进行译码-指令寄存器3 对于执行指令过程中所需要用到的数据,CPU将数据地址也送到地址总线4 CPU把数据读到CPU的内部寄存器暂存,命令运算单元对数据进行加工处理1+修改指令计数器地址,执行下一条指令。

微型计算机原理与接口技术 第2章 8086系统结构讲解

微型计算机原理与接口技术 第2章 8086系统结构讲解

段寄存器
寄存 器名
英文名
中文名
CS
Code segment
代码段寄存器
DS
Data segment
数据段寄存器
ES
Extra segment
附加锻寄存器
SS
Stack segment
堆栈段寄存器
用途
存放代码段段基地址
存放数据段段基地址,存放程 序中经常使用的数据 存放附加段段基地址,存放程 序中不经常使用的数据
? 微处理器的主要功能 ? 微处理器结构受到的限制 ? 16位微处理器的结构特点 ? 8086CPU概况
微处理器的主要功能
? 进行算术运算和逻辑运算 ? 同存储器和I/O接口交流信息 ? 少量暂存数据 ? 寄存指令、指令译码、执行指令 ? 提供整个系统所需的定时和控制信号 ? 可响应I/O设备的中断请求
数,则EU将操作数的偏移地址通过内部的 16 位数据总线送给 BIU,与段基地址一起,在 BIU的地址加法器中形成 20位物理地址,申请 访问存储器或 I/O端口,取得操作数送给 EU 4. EU根据指令要求向 EU内部各部件发出控制命 令,完成执行指令的功能。
8086 CPU寄存器结构(重点)
? 通用寄存器 ? 指针和变址寄存器 ? 段寄存器 ? 指令指针寄存器 ? 标志寄存器PSW
存放堆栈段段基地址
指令指针寄存器
寄存器 名
英文名
中文名 用途
IP
Instruction 指令指
pointer

在程序运行时,保存下一条将要执 行的指令的偏移地址,与CS联用确 定下一条指令的物理地址
在内存中,指令和数据没有任何区别,都是二进制信息,CPU在工作的 时候把有的信息看作指令,有的信息看作数据。那么,CPU根据什么将 内存中的信息看作指令?CPU将CS:IP指向的内存单元中的内容看作指令, 因为,在任何时候,CPU将CS、IP中的内容当作指令的段地址和偏移地 址,用它们合成指令的物理地址,到内存中读取指令码,执行。如果说, 内存中的一段信息曾被CPU执行过的话,那么,它所在的内存单元必然 被CS:IP指向过。

微机原理与接口技术(第三版)&电子工业出版社&课本习题答案

微机原理与接口技术(第三版)&电子工业出版社&课本习题答案

&电子工业出版社&第二章 8086体系结构与80x86CPU1.8086CPU由哪两部分构成?它们的主要功能是什么?答:8086CPU由两部分组成:指令执行部件(EU,Execution Unit)和总线接口部件(BIU,Bus Interface Unit)。

指令执行部件(EU)主要由算术逻辑运算单元(ALU)、标志寄存器FR、通用寄存器组和EU控制器等4个部件组成,其主要功能是执行指令。

总线接口部件(BIU)主要由地址加法器、专用寄存器组、指令队列和总线控制电路等4个部件组成,其主要功能是形成访问存储器的物理地址、访问存储器并取指令暂存到指令队列中等待执行,访问存储器或I/O端口读取操作数参加EU运算或存放运算结果等。

2.8086CPU预取指令队列有什么好处?8086CPU内部的并行操作体现在哪里?答:8086CPU的预取指令队列由6个字节组成,按照8086CPU的设计要求,指令执行部件(EU)在执行指令时,不是直接通过访问存储器取指令,而是从指令队列中取得指令代码,并分析执行它。

从速度上看,该指令队列是在CPU内部,EU从指令队列中获得指令的速度会远远超过直接从内存中读取指令。

8086CPU内部的并行操作体现在指令执行的同时,待执行的指令也同时从内存中读取,并送到指令队列。

5.简述8086系统中物理地址的形成过程。

8086系统中的物理地址最多有多少个?逻辑地址呢?答:8086系统中的物理地址是由20根地址总线形成的。

8086系统采用分段并附以地址偏移量办法形成20位的物理地址。

采用分段结构的存储器中,任何一个逻辑地址都由段基址和偏移地址两部分构成,都是16位二进制数。

通过一个20位的地址加法器将这两个地址相加形成物理地址。

具体做法是16位的段基址左移4位(相当于在段基址最低位后添4个“0”),然后与偏移地址相加获得物理地址。

由于8086CPU的地址线是20根,所以可寻址的存储空间为1M字节,即8086系统的物理地址空间是1MB。

微机原理与接口技术第2章8086系统结构

微机原理与接口技术第2章8086系统结构

第二章8086体系结构与80x86CPU1.8086CPU由哪两部分构成?它们的主要功能是什么?答:8086CPU由两部分组成:指令执行部件(EU,Execution Unit)和总线接口部件(BIU,Bus Interface Unit)。

指令执行部件(EU)主要由算术逻辑运算单元(ALU)、标志寄存器FR、通用寄存器组和EU控制器等4个部件组成,其主要功能是执行指令。

总线接口部件(BIU)主要由地址加法器、专用寄存器组、指令队列和总线控制电路等4个部件组成,其主要功能是形成访问存储器的物理地址、访问存储器并取指令暂存到指令队列中等待执行,访问存储器或I/O端口读取操作数参加EU运算或存放运算结果等。

2.8086CPU预取指令队列有什么好处?8086CPU内部的并行操作体现在哪里?答:8086CPU的预取指令队列由6个字节组成,按照8086CPU的设计要求,指令执行部件(EU)在执行指令时,不是直接通过访问存储器取指令,而是从指令队列中取得指令代码,并分析执行它。

从速度上看,该指令队列是在CPU 内部,EU从指令队列中获得指令的速度会远远超过直接从内存中读取指令。

8086CPU内部的并行操作体现在指令执行的同时,待执行的指令也同时从内存中读取,并送到指令队列。

3.8086CPU中有哪些寄存器?各有什么用途?答:指令执行部件(EU)设有8个16位通用寄存器AX、BX、CX、DX、SP、BP、SI、DI,主要用途是保存数据和地址(包括内存地址和I/O端口地址)。

其中AX、BX、CX、DX主要用于保存数据,BX可用于保存地址,DX还用于保存I/O端口地址;BP、SI、DI主要用于保存地址;SP用于保存堆栈指针。

标志寄存器FR用于存放运算结果特征和控制CPU操作。

BIU中的段寄存器包括CS、DS、ES、SS,主要用途是保存段地址,其中CS代码段寄存器中存放程序代码段起始地址的高16位,DS数据段寄存器中存放数据段起始地址的高16位,SS堆栈段寄存器中存放堆栈段起始地址的高16位,ES扩展段寄存器中存放扩展数据段起始地址的高16位。

微机原理和接口技术-2-3 8086系统结构zq

微机原理和接口技术-2-3 8086系统结构zq
1. 系统复位与启动
Chapter2 8086系统结构
▪ 复位后地址总线浮空 ▪ 复位后,第一条指令的地址:
物理地址为 FFFF0+0H(IP中) =FFFF0H
一般在FFFF0中,存放一条段交叉直接JMP指令, 转移到系统程序实际开始处。这个程序往往实现 系统初始化、引导监控程序或者引导操作系统等 功能,这样的程序叫做引导和装配程序。
2.4.3 8086 CPU时序
▪ 时序(Timing) – 信号高低电平(有效或无效)变化及相互间的时 间顺序关系。
– 总线时序描述CPU引脚如何实现总线操作
– CPU时序决定系统各部件间的同步和定时
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2015.9 Zuo
华中科技大学计算机学院
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8086 CPU时序
▪ 微处理器时序有三级: 指令周期 总线周期 时钟周期
华中科技大学计算机学院
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8086引脚分类图
(S2) M/IO

RD
统 控
(LOCK) WR

(S0) DEN
(S1) DT/R
总线 (RQ0) HOLD 控制 (RQ1) HLDA
READY
CPU TEST 控制 RESET
MN/MX
CLK
8086
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VCC GND
▪ 8086最大模式系统的其他组件,例如,协处理器8087 或8089,总线仲裁器8289,中断控制器8259,存储器, I/O接口等根据实际系统的需要选配,目的是支持多总 线结构,形成一个多处理器系统。
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2015.9 Zuo
华中科技大学计算机学院
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8288引脚图
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控制逻辑发送读有效信号 送指令队列
8086总总 16位
1 2 3 4 5 6
堆指 队队
总总 接接接接
*当指令队列有2个或2个以上的字节空余时, BIU自动将指令取到指令队列中。若遇到转移指令 等,则将指令队列清空,BIU重新取新地址中的指 令代码,送入指令队列。
*指令指针IP由BIU自动修改,IP总是指向下一条将要执行指令的地址。
*各寄存器隐含用法
操作 字 乘 /除 指 令 中 作 为 累 加 器 , 字 I/O 指 令 中 作 为 数 据 寄 存 器 字 节 乘 /除 指 令 ,字 节 I/O ,转 移 , 十进制运算 字 节 乘 / 除 指 令 ( 高 八 位 /余 数 ) , X L AT 指 令 中 作 为 目 的 寄 存 器 作 为 地 址 /基 址 寄 存 器 串操作时,循环计数器 变量位移或循环操作时用作计 数器 字 乘 / 除 指 令 ( 高 十 六 位 /余 数 ) , I/O 间 接 寻 址
8088/8086的寄存器结构 二、 8088/8086的寄存器结构 (续)
4. 段寄存器
*DS(数据段寄存器)指向当前的数据段,该段中存放程 序的操作数; *ES (附加段寄存器)指向当前的附加段,主要用于字符 串数据的存放,也可以用于一般数据 的存放。
第二章 8086系统结构 系统结构
2.1 2.2 2.3 2.4 2.5 8086CPU结构 8086CPU结构 8088/8086的引脚及功能 8088/8086的引脚及功能 8086存储器的组织 8086存储器的组织 8086的系统配置 8086的系统配置 8086CPU时序 8086CPU时序
8086最小模式下的引脚定义 一、8086最小模式下的引脚定义 (续)
TEST# (In): 测试信号,低电平有效。处理器执行 测试信号,低电平有效。 WAIT指令的控制信号。 指令的控制信号。 指令的控制信号
MN/MX# (In):最大 最小工作模式选择信号。硬件设 最大/最小工作模式选择信号 最大 最小工作模式选择信号。 计者用来决定8086工作模式, 工作模式, 计者用来决定 工作模式 MN/MX# =1 8086为最小模式, 为最小模式, 为最小模式 MN/MX# =0 8086为最大模式。 为最大模式。 为最大模式 Vcc GND(In): 处理器的电源引脚
AL BL CL DL
20位
16位
8086总总 16位
ALU
1 2 3 4 5 6
堆指 队队
属第三代微处 理器 运算能力: 数据总线:DB -16bit(8086) / 8bit(8088) 地址总线: AB-20bit 内存寻址能力 220=1MB
状状标存发
执执 接接
总总 接接接接
8086CPU的内部结构 一、 8086CPU的内部结构 (续)
BUS




t
EU
执执 1
执执 2
执执 3
执执 4
执执 5
执执 6
BIU
取堆 1
取堆 2
取堆 3
取堆 4
取堆 5
取堆 6
BUS






t
8088/8086的寄存器结构 二、 8088/8086的寄存器结构
AX BX CX DX AH BH CH DH AL BL CL DL
8088/8086有14个16位寄存器 1. 通用寄存器组 2. 指针/变址寄存器 3. 2个控制寄存器 4. 4个段寄存器
8088/8086的寄存器结构 二、 8088/8086的寄存器结构 (续)
(2) 状态(标志)寄存器PSW ) 状态(标志)
D15 D11
OF DF IF
D8
TF SF
D6
ZF
D4
AF
D2
PF
D0
CF
CF(进位标志): 当运算结果的最高位(D7/D15)出现进位(借位)时, CF=1; PF(奇偶校验标志):当运算结果中“1”的个数为偶数时,PF=1; AF(辅助进位标志):当结果的D3向D4(低位字节)出现进位(借位)时, AF=1; ZF (零标志): 当运算结果为零时,ZF=1; SF (符号标志): 当运算结果的最高位D7/D15为1时,SF=1; OF (溢出标志):当运算结果超过机器所能表示的范围时,OF=1;
8086CPU结构 2.1 8086CPU结构
一、 8086CPU的内部结构 二、 8088/8086的寄存器结构
8086CPU的内部结构 一、 8086CPU的内部结构
AH BH CH DH SP BP SI DI CS DS SS ES
内内内存发 EU 控 制 系 系 输输 / 输输 控制 电电
微机原理及接口技术
第二章 8086系统结构 8086系统结构
国脉信息学院
第二章 8086系统结构 系统结构
工艺 集成度 片内含 29000 晶体管 数据处 理位 16 数据线 内16 外16 内16 HMOS 16 外8 20 1MB 20 1MB 地址线 寻址 空间
Intel 8086 Intel 8088
8088/8086的寄存器结构 二、 8088/8086的寄存器结构 (续)
3. 指令指针和状态寄存器
(1) 指令指针 I P 是一个16位的专用寄存器。当BIU 从内存中取出一条指令,自动修改IP,始终指向下一条将 要执行的指令在现行代码段中的偏移量。 8086/8088中的某 些指令执行后会改变IP的内容,但用户不能编写指令直接 改变IP 的内容。 * I P是指令地址在代码段内的偏移量(又称偏移地址), IP要与CS配合构成共同物理地址。 (2) 状态(标志)寄存器PSW PSW 是一个16位的专用寄存器(6位状态位,3位控制位)存 放运算结果的特征。
8088/8086的寄存器结构 二、 8088/8086的寄存器结构 (续)
4. 段寄存器
8086/8088按信息存储的不同性质分为四类,分别由四个 段寄存器存放该段的首地址,或称为段地址。 * CS(代码段寄存器)指向当前的代码段,指令由此段 取出; *SS (堆栈段寄存器)指向当前的堆栈段,栈操作的对象 是该段存储单元的内容;
8086CPU的内部结构 一、 8086CPU的内部结构 (续)
2.指令执行部件 (Exection Unit) 指令执行部件EU( 指令执行部件
AH BH CH DH SP BP SI DI AL BL CL DL
组成: 组成:通用寄存器,标志寄存器,ALU, EU控制系统等。 作用:负责指令的执行,完成指令的操作。 作用: 工作过程:从队列中取得指令,进行译码, 根据指令要求向EU内部各部件发出控制 命令,完成执行指令的功能。若执行指令 需要访问存储器或I/O端口,则EU将操作 数的偏移地址送给BIU,由BIU取得操作 数送给EU。
8086最小模式下的引脚定义 一、8086最小模式下的引脚定义 (续)
INTR (In) :可屏蔽中断请求线,高电平有效 可屏蔽中断请求线, RD# (O,三态 :读选通信号,低电平有效 三态) 读选通信号, 三态 CLK (In) : 时钟信号,处理器基本定时脉冲 时钟信号,处理器基本定时脉冲. RESET (In) :复位信号,高电平有效。 复位信号, 复位信号 高电平有效。 READY (In):准备好信号,高电平有效。处理器 :准备好信号,高电平有效。 与存储器及 I/O接口速度同步的控制信号 接口速度同步的控制信号 WR# (O,三态 :写选通信号,低电平有效 三态): 三态 写选通信号,
8088/8086的寄存器结构 二、 8088/8086的寄存器结构 (续)
(2) 状态(标志)寄存器PSW (续) ) 状态(标志)
D15 D11
OF DF IF
D8
TF SF
D6
ZF
D4
AF
D2
PF
D0
CF
DF(方向标志):在字符串操作时,决定操作数地址调整的方向,DF=1, 为递减; IF (中断允许标志): IF=1,允许CPU响应外部的可屏蔽中断; TF (陷阱标志):当TF=1,CPU每执行一条指令便自动产生一个内部中断, 在中断服务程序中可检查指令执行情况。
HMOS
Intel8088:准16位微处理器。IBM PC/XT的CPU。
第二章 8086系统结构 系统结构
2.1 2.2 2.3 2.4 2.5 8086CPU结构 8086CPU结构 8088/8086的引脚及功能 8088/8086的引脚及功能 8086存储器的组织 8086存储器的组织 8086的系统配置 8086的系统配置 8086CPU时序 8086CPU时序
1.总线接口部件 总线接口部件BIU 总线接口部件
20位
组成:16位段寄存器,指令指针,20 位地址加法器,总线控制逻辑,6字节 指令队列。 20 20位物理地址送往地址总线 取指令
16位
工作过程: CS 16+IP CS×16+IP
CS DS SS ES IP
内内标存发 输输 / 输输 控制 电电
ALU
EU 控 制 系 系
状状标存发
8086CPU的内部结构 一、 8086CPU的内部结构 (续)
3. 8086CPU结构的特点: 结构的特点: 结构的特点
减少了CPU为取指令而等待的时间,提高了CPU的运行速度。
CPU 取堆 1 执执 1 取堆 2 执执 2 取堆 3 执执 3 取堆 4 执执 4
8086最小模式下的引脚定义 一、8086最小模式下的引脚定义 (续)
1. 基本(共用)引脚信号 基本(共用)
AD7~AD0(I/O,三态):地址 数据分时复用引脚。 ~ 三态):地址/数据分时复用引脚 ( 三态):地址 数据分时复用引脚。 A8 ~A15 (O,三态):地址引脚。 三态):地址引脚。 三态):地址引脚 A19/S6 ~ A16/S3(O,三态):地址 状态分时复用引脚。 三态):地址/状态分时复用引脚 ( 三态):地址 状态分时复用引脚。 BHE# /S7 (O,三态):高字节允许 状态复用引脚 三态) 高字节允许/状态复用引脚 三态 高字节允许 NMI(In):非屏蔽中断请求线,上升边触发。 ( ) 非屏蔽中断请求线,上升边触发。
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