GM8283C_数据手册,RGB转LVDS,TTL转LVDS
GM8387C,GM8388C双像素LDI发送器与接收器
A5
G2 5 -1
DCBAL -1
G2 0
G2 1
G2 2
G2 3
G2 4
G2 5
DCBAL
A6
B2 5 -1
DCBAL -1
B2 0
B2 1
B2 2
B2 3
B2 4
B2 5
DCBAL
� � � � � � � � � �
A7
B2 7 -1
DCBAL -1
R2 6
R2 7
G2 6
G2 7
B2 6
B2 7
G2 3
G2 2
G2 1
A6 A7
B2 3 -1
B2 2 -1
DE *
B2 6 *
B2 7 *
B2 5
B2 4
B2 3
B2 2
R2 7 -1
R2 6 -1
B2 7 *
B2 7
B2 6
G2 7
G2 6
R2 7
R2 6
无直流平衡编码时输入串行数据与参考时钟关系图
C L K 1/2
前一周期 当前周期
DCBAL -1 R1 0 R1 1 R1 2 R1 3 R1 4 R1 5 DCBAL
R2 1
R2 2
R2 3
R2 4
R2 5
DCBAL
适合 VGA、SVGA、XGA、SXGA、QXGA 等格 式的数据从控制器到显示设备的传输 输入信号：TTL/CMOS、LVTTL/LVCMOS 信号 输出信号：满足 TIA/EIA-644 的 LVDS 信号 参考时钟频率：32.5MHz～112MHz 输入时钟采样模式为上升/下降沿可选 最大数据率 5376Mbps 48：8 的数据压缩率 可选预加重，支持长线驱动 可选直流平衡编码，减小码间干扰 封装形式：TQFP100 工作温度范围：－40℃~85℃
rk3288-chapter-33-lvds
When LVDS works at double channel mode, both the lvdsformat modules are necessary. One is for odd cycle RGB data format convert, and the other is for even cycle RGB data format convert. The frequency of LVDS output clock is half of the dclk.
data lanes and 1 clock lane Support MSB mode and LSB mode data transfer Support APB slave bus interface Support low power mode
33.2 Block Diagram
PLL is responsible for multiplying the pin_pixel_clk by 7, which generates a 7X clock used to deserialize the parallel data.
FuZhou Rockchip Electronics Co.,Ltd.
VOP0 VOP1
GRF
lvds dual channel control
lvds_top
LVDS编码方式
目 录
VESA编码 (2)
A．8BIT VESA编码 (2)
B．10BIT (4)
JEIDA编码 (4)
8BIT JEIDA编码， (4)
10BIT JEIDA编码 (5)
通过屏线功能脚改变其编码方式 (5)
单LVDS (5)
通过屏第9脚改变 (5)
通过屏第21脚改变 (6)
双LVDS： (7)
LG的屏第7脚改变编码方式 (7)
三星的屏一般可以45脚改其编码方式， (7)
LVDS缺少任意一组会缺少色彩 (8)
缺少0‐+（图片效果）缺(R0‐5及B0) (9)
缺少1‐+(图片效果)缺(B1‐B5,G0‐G1) (10)
缺少2‐+（图片效果） (10)
缺少3‐+（图片效果） (10)
LVDS缺少任意一组会缺少色彩JEIDA编码， (11)
缺少0‐+（图片效果） (11)
缺少1‐+(图片效果) (12)
缺少2‐+（图片效果） (13)
缺少3‐+（图片效果） (13)
正常画面 10BIT程序，屏也是10BIT编码 (14)
10BIT程序，但屏的编码是8BIT (14)
10 BIT VESA编码 屏是10BIT JEIDA编码 (15)
8BIT程序8BIT的编码，正常画面 (15)
8BIT程序10BIT VESA的编码 (16)
8BIT程序10BIT的JEIDA编码 (17)
奇偶问题 (18)
LVDS编码方式
VESA编码
A．8BIT VESA编码
定义一般式为0‐+，1‐+，2‐+，CLK‐+,3‐+共5组其中数据为4组时钟1组
编码图示：一般奇美AU，编码标识图A
一般三星屏LVDS VESA编码标识图
GM8804c3说明书
输入 阻抗：10MΩ
零点调整范围：0.2～20mV
输入灵敏度：0.5uV/d
输入 范围:0.2～25mV
转 换 方式:Sigma-Delta
A/D转换速度：120次/秒
非 线性：0.01% F.S
增 益 漂 移：10PPM/℃
最高显示精度：1/100000
模拟量输入通道：24bit
HOLD:加料延时，当仪表处于加料延时阶段，该指示灯亮。
GROSS:主显示指示，当主显示显示重量值时，该指示灯亮。
NET:主显示指示，当主显示显示流量值时，该指示灯亮。
TARE:主显示指示，当主显示显示累计值时，该指示灯亮。
HI:当重量高于停止加料点，该指示灯亮。
GO:当重量在加料点和停止加料点之间，该指示灯亮。
：确认键，用于确认仪表当前功能。
：用户参数设定键，用于进入给定流量、定量等设定。
：退出键，用于退出仪表当前功能状态。
：数字1及系统参数设定键，用于数据输入和进入系统参数设置。
：数字2及调校键，用于数据输入和进入调校状态。
：数字3用于数据输入。
：数字4用于数据输入。
：数字5用于数据输入。
：数字6键，用于数据输入，也用于启动运行。
GM8804C
使用说明书
GM8804C-03110101
GM8285C产品资料
GM8285C 1.8V低功耗28位LVDS发送器
——兼容TI的SN75LVDS83B、THine的THC63LVDM83D
产品概述
GM8285C型1.8V低功耗28位LVDS发送器，其功能是将并行数据编码为高速串行数据，实现信号的快速可靠传输。该器件可将28位并行数据转换为4对串行LVDS差分信号，同时并行输出1路LVDS差分时钟信号。
I/O电压支持1.8V/3.3V，core电压为1.8V/3.3V的28位可编程数据选通Channel-Link 发送器，支持1080p（60Hz）视频显示，适合VGA，XGA，SXGA，UXGA格式的数据从控制器到显示设备的传输。质量保证等级为工业级。
特性
◆电源电压：1.8V/3.3V；
◆工作环境温度：-40℃～85℃；
◆工作频率：20MHz～135MHz；
◆输入信号：28位并行LVCMOS数据信号和1路LVCMOS时钟信号；
◆输出信号：4对LVDS数据信号和1对LVDS时钟信号；
◆封装形式：TSSOP56、BGA56；
◆ESD：≥2000V（人体模式）。
应用说明
主要应用于：24bit或18bit视频图像传输系统。下图为GM8285C在24bit图像传输系统中的典型应用图。R U、R D为RS和CLKSEL设置为高、低电平时的上拉和下拉电阻值，R U=1KΩ、R D=0Ω。R U、R D焊接时二者取其一。C0、C1为电源滤波电容，C0=0.1µF、C1=0.01µF。L0为磁珠，L0=60Ω/100MHz。R0为并行数据匹配电阻，R0=33Ω。R1和C2为时钟信号匹配电阻、电容，具体值视前级视频信号源时钟信号的驱动能力。通常R1=50Ω，C2=10pF。
转接口IC大全-RGB互转LVDS-LVDS或RGB转MIPI-MIPI转LVDS或RGB-LVDS或RGB转EDP-HDMI转LVDS或MHL
转接IC详细介绍
EDP输出
NCS8801:LVDS转EDP、RGB转EDP 封装QFN56
2560*1600用于手机、平板、转接板、液晶驱动板、广告机、可视门铃等等控制器到显示设备上
MIPI输出
SDD2828：RGB转MIPI 支持1920*1200分辨率，封装QFN68
用于手机、平板、转接板、
控制器到显示设备上
LVDS输出
GM8283:TTL或RGB转LVDS 支持1366*768，封装TTSOP56
用于手机、平板、转接板、
控制器到显示设备上
GM8285:是GM8283升级版本，在电压和分辨率改动。
ZA7783:MIPI转LVDS,MIPI转RGB, 封装是QFN64 用于手机、平板、转接板、
控制器到显示设备上
ICN6201：MIPI转LVDS 封装QFN48
支持分辨率1920*1200用于手机、车载、转接板、平板等控制器到显示设备上
LT8668：HDMI1.3/VGA/YPBPR转双路LVDS并带音频输出,支持1080P,运用到MONIT OR等显示设备上。
LT8668EX:HDMI1.4/VGA/MHL转4路的LVDS并带音频输出，支持4K*2K,运用到MONI TOR等显示设备上。
HDMI输出
LT8818:RGB转HDMI/MHL BGA64 (4.5*4.5MM)
用到车联网上的车载上。移动电话，数码相机，便携式媒体播放器，掌上游戏机，和数码摄像机。
LT8612：HDMI/MHL转HDMI RGB,YUV 支持到1960*1080 ，封装LQFP-80L。
LT8612EX：HDMI/MHL转HDMI RGB,YUV支持4K*2K, LQFP-80L
GM7123使用说明
GM7123 模拟视频输出方式支持有以下几种：
1、模拟RGB+HSYNC+VHYNC。
2、模拟RGB+CSYNC(CSYNC和HSYNC为同一pin输出)，这种方式的实现需要外部加一个门电路的IC，把分离同步变为复合同步。
3、模拟RGB,同步信号附在G上面，这种方式需要跟BLANK和SY NC脚配合才能够实现，一般这种方式使用的不多。
关于7123的应用电路，有如下疑问：
1、数字RGB888和数字RGB565输出到7123的接法？（包括HSYNC VSYNC）
答：用户接过来的数字RGB888和数字RGB565信号直接到GM7123的数据RGB高位，GM7123没接的低位数字RGB线就通过零欧电阻接地或直接接地。
2、7123引脚Vref 、Psave 有没有固定接法？
答：这个Vref端口是输出参考电压，通常VREF脚外接0.1μF电容。Psave为芯片节能休眠脚，接低电平为芯片休眠，芯片无信号输出，与控制关掉打开电源的区别是，更快让芯片投入工作状态。
3、7123引脚BLANK和SY NC有没有固定接法？
答：引脚BLANK（消隐信号输入）和SYNC（复合同步输入）一般都是不用的，分别BLANK 通过一个0欧电阻接高电平拉高，SY NC通过一个0欧电阻接地拉低，除非要同步到绿色通道，这种用法很少
4、/IOR /IOG /IOB的接法？
答：这是各颜色通道（模拟）的差分信号，它们分别和IOR IOG IOB配对做差分输出（类似于LVDS），不用的话可以接地，一般不用而一般输出接显示器只用到IOR 、IOG 、IOB。
LVDS数据处理
LVDS数据采集
表1版本内容
一、功能简述：
如图1所示，外部以LVDS形式把数据采集传入FPGA，采集的数据经过LVDS_buf串行转并行把数据变成16bit，然后把数据储存到SDRAM_Ctrl模块，再经Gen_frame模块对数据执行“组贞”处理后，最后经USB通信方式把数据传送给PC机。
图1 模块分布连接图
二、模块详细描述：
1、表2 管脚定义
2、关键信号的时序说明
1】usb_ctrl模块
图2USB内部两FIFO结构
型号：CY7C68013A
如图3所示，当操作W_FIFO时usb_data【15:0】为输入，当操作F_FIFO时usb_data【15:0】为输出。
图3三态门
图4写时序
FPGA向USB内部FIFO写时序见图4：
①第一步，先选择w_fifo （EP6）即把addr 赋值为2’b10 。
②第二步，检测w_fifo内部数据是否为空，即检测flag_c 是否为低电平。
③第三步，若flag_c为低，则wr_n拉低，把数据写入w_fifo （EP6）。
④第四步，写入w_fifo数据共有512个。写完后wr_n拉高，等待PC机读取
w_fifo数据。若PC机已经读取完数据，flag_c会拉低（即空），进入
②状态，如此循环。
注：
【1】本实验板所用USB中FIFO字深为1024 byte，位宽为8bit，因数据一次传送16 bit，因此要接收1024 / 2 = 512 （次）
【2】pkg_end为知识拓展，若pkg_end保持一个时钟周期低脉冲，则w_fifo认为已满，手动将wr_n置高，不再写数据。
GM8283C
4 功能描述
GM8283C 型 28 位可编程数据选通发送器由串行器、锁相环、LVDS 驱动器和使能模块四 部分组成。芯片完成的功能如下：串行器载入 28 bits 并行数据后，在同步时钟的触发下将 数据移出，同时将时钟信号与数据信号同步后输出，高速同步时钟是由锁相环产生。LVDS 驱动器模块将串行器同步输出的 4 路串行数据流信号和 1 路同步时钟信号转化为 LVDS 格式 的信号后输出。使能模块在待机状态下，可将内部模块电流关断，使器件进入低功耗状态。 GM8283C 具有可编程数据选通控制功能，通过 RFC 控制可实现时钟对数据的上升沿采样或 下降沿采样，RFC 为高电平时为上升沿采样，RFC 为低电平时为下降沿采样。
5 参数指标
5.1 极限工作条件
a）电源电压（VCC）……………………………… -0.5V～4V b) 输入电压 (VI) ……………………………… -0.5V～VCC +0.5V c) 输出电压 (VO) ………………………………-0.5V～VCC +0.5V d) 贮存温度（Th）（10s）………………………………260℃ e) 工作温度（Tstg）………………………………-65℃～150℃
THC63LVD827参考设计TTL转LVDS
Application Note THAN0135_Rev.1.00_E
THC63LVD827
Application Note
System Diagram and PCB Design Guide Line
Date Revision
20120420THAN0135_Rev.1.00_E
Contents
1.Mode Settings P.3
2.Signal Flow for Each Setting P.3
S/TTL DATA Timing Diagram P.4
4.LVDS DATA Timing Diagram P.6
5.LVDS DATA Mapping P.8
6.Example of System Diagram
1)Single In–Single Out/8bit COMS/TTL Input/IO VCC=1.8V P.10
2)Single In–Dual Out/8bit COMS/TTL Input/IO VCC=1.8V P.11
3)Single In–Dual Out/6bit COMS/TTL Input/IO VCC=3.3V P.12
7.NOTE P.13
8.Trace Example for BGA P.14
9PCB Design Guide Line for LVDS P.15
R[7:0]G[7:0]B[7:0]HSYNC VSYNC
DE CLKIN
CLK Frequency
f
DATA Rate
f
DATA CLK Frequency
f Rate
f
TA1+/-TB1+/-TC1+/-TD1+/-TCLK1+/-
LVDS转RGB原理设计及PCB设计注意事项
LVDS转RGB原理设计与PCB注意事项
当今，配备数字RGB接口的TFF液晶显示屏以其图像清晰、接口简单和亮度高等特点而在电脑笔记本、GPS、机顶盒、WebPad等设备中得到了广泛应用。但是由于驱动显示屏的视频信号频率较高而无法直接进行较远距离传输。为此，可以在图形控制器到LCD之间的FPD(Flat Panel Display)链路中采用LVDS(Low Voltage Differential Signaling)技术来克服这一问题，实际使用证明：经它引接后的传输距离可扩大至10米左右，从而充分满足了液晶屏的一般应用场合。
数字RGB视频信号中除了包括图像信号之外，还包括行同步、场同步、像素时钟等信号，其中像素时钟信号的最高频率可超过28MHz。低电压差分信号技术(LVDS)的采用可以充分避免长距离传输带来的衰减和信号间的相互串扰，LVDS是一种低摆幅的差分信号技术，它使得信号能在差分PCB线对或平衡电缆上以几百Mbps 的速率传输，其低压幅和低电流驱动输出可保证低噪声和低功耗，其优点包括可支持高速数据传输、省电、噪声小、电磁干扰微弱，成本低廉、集成度高等。
最基本的LVDS器件就是LVDS驱动器和接收器。
LVDS的驱动器由驱动差分线对的电流源组成，电流通常为3.5 mA。
LVDS接收器具有很高的输入阻抗，因此驱动器输出的大部分电流都流过100Ω的匹配电阻，并在接收器的输入端产生大约350 mV的电压。因此设计LVDS信号转RGB输出时，电路一般这样设计：
LVDS是串行接口，RGB信号传输时，是将每个基色信号的数据排成一纵队，采用差分数据线按顺序进行输出。在一个时钟脉冲周期内，一对差分数据线可以传输7bit数据。
GM7123C VGA模拟信号输出
DATA SHEET
2010.7 成都国腾电子技术股份有限公司
GM7123
版本记录：1.0 当前版本时间：2010年7月 新旧版本改动比较： 旧版 文档页数
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编制时间：2010年7月
由成都国腾电子技术股份有限公司发布 发布地点：成都
成都国腾电子技术股份有限公司版权所有x -P
D F
W
a t e
r m
a r k
1 概述
GM7123是一款频率330MHz 的3通道10位高速视频DAC 芯片，兼容RS-343A/RS-170标准差分输出，输出电流范围是2mA ～26mA 。输入兼容TTL 电平，内部基准1.23V ，单电源3.3V 供电，采用LQFP48封装。
该芯片可应用于：数字视频系统（1600×1200@100Hz ）；高分辨率彩色图像；数字射频调制；图像处理；仪器和视频信号重建等。
2 特征
GM7123自带3个分离的10位数据输入端口，有视频控制信号SYNC 和BLANK 分别控制同步和消隐。芯片带有省电模式，采用CMOS 工艺制造。
a ） 最高330MSPS 转换速率
b ） 3个10位DAC
c ） 输入兼容TTL 电平
d ） DAC 输出电流范围2mA ～26mA
e ） 集成带隙基准电压源
f ） LQFP48封装
3 封装及引脚功能说明
产品采用48引线的四边引线扁平外壳封装，实体尺寸7mm ×7mm 。
图1 GM7123引脚排布图
GM8285C数据手册
a） 工作温度范围：-40℃～85℃； b） I/O 电源电压：3.3V 或 1.8V； c） Core 电源电压：3.3V 或 1.8V d） 输入信号：28 位并行 LVCMOS 数据信号和 1 路 LVCMOS 时钟信号； e） 输出信号：4 对 LVDS 数据信号和 1 对 LVDS 时钟信号； f） 输入时钟频率：25MHz～135MHz； g） 封装形式：TSSOP56 和 BGA56；
地端
4 功能描述
GM8285C 为 1.8V 低功耗 28 位 LVDS 发送器，可支持 1.8V/3.3V 应用，可应用于 24 位 数和 18 位数视频图像发送领域。
芯片具有输入时钟采样沿可选、LVDS 差分输出摆幅可调功能和低功耗特性。
1) 输入数据和时钟采样时序关系 输入的 28 bits 数据与参考时钟为同步关系，可选择用上升沿采样或下降沿采样，如下 图所示：
VIOVCC=1.98V或 3.6V，VPLLVCC=VLVDSVCC=VCC=3.3V，
IIN
VIN=VIOVCC或GND
-25
25
μA
输入钳位电压
VCL ICL=-18mA，VIOVCC=3.6V，VPLLVCC=VLVDSVCC=VCC=3.3V
－
-1.5
V
差分输出电压 VOD
共模输出电压 VOS
4) 18bit 和 24bit 应用时数据位对应关系如下图所示：
lvds电平转换为hcsl电平
LVDS电平转换为HCSL电平
1. 介绍
本文将介绍如何将LVDS（Low Voltage Differential Signaling）电平转换为HCSL（High-Speed Current Steering Logic）电平。LVDS和HCSL都是常见的高
速差分信号传输标准，但在某些特定应用中需要将LVDS信号转换为HCSL信号。2. LVDS电平
LVDS是一种低压差分信号传输标准，它使用两个相反极性的信号来传输数据。LVDS通常用于高速数据传输，具有较低的功耗和噪音抑制能力。
LVDS信号由两个不同电压表示，通常为Vcm（共模电压）和Vdiff（差分电压）。Vcm是一个固定的偏置电压，用于确定逻辑高和逻辑低的阈值。Vdiff表示逻辑高
和逻辑低之间的差异电压。
3. HCSL电平
HCSL是一种高速差分信号传输标准，它使用一个共模电压和一个差分输出来表示
数据。HCSL通常用于驱动时钟、存储器和其他高速接口。
HCSL信号由一个共模偏置电压和一个差分输出电流表示。共模偏置电压用于确定
逻辑高和逻辑低的阈值，而差分输出电流表示逻辑高和逻辑低之间的差异。
4. LVDS到HCSL转换器
为了将LVDS信号转换为HCSL信号，我们可以使用专门的转换器芯片。以下是一个常见的LVDS到HCSL转换器的电路示意图：
+-----+ +-----+
| | | |
| LVDS|-----|Converter
| | | |
+-----+ +-----+
该转换器芯片接收LVDS信号作为输入，并输出HCSL信号。转换过程包括以下几个步骤：
GM8283C_数据手册,RGB转LVDS,TTL转LVDS
TXIN9 －1
TXIN8 －1
TXIN 18
TXIN 15
TXIN 14
TXIN 13
TXIN 12
TXIN 9
TXIN 8
TXOUT0
TXIN1 －1
TXIN0 －1
前一周期
TXIN 7
5 参数指标
5.1 极限工作条件
a）电源电压（VCC）……………………………… -0.5V～4V b) 输入电压 (VI) ……………………………… -0.5V～VCC +0.5V c) 输出电压 (VO) ………………………………-0.5V～VCC +0.5V d) 贮存温度（Th）（10s）………………………………260℃ e) 工作温度（Tstg）………………………………-65℃～150℃
TXCLKOUT+/TXCLKOUT－ 正/反相输出 LVDS 时钟信号，满足 EIA/TIA-644 标准。
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2
28 位可编程数据选通发送器
数据手册
GM8283C
引脚符号
PWR DWN VCC GND
PLLVCC PLLGND LVDSVCC LVDSGND
在每一时钟周期内，24 bits 的 RGB 数据和 3 bits 的控制数据分别在 4 个 LVDS 串行通 道中传输，单通道数据率最高可达 630Mbps。
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0.35tCIP
0.50tCIP
0.65tCIP
tXIT
输入数据转换时间
1.0
3.0
6.0
tSTC
建立时间
2.5
－
－
tHTC
保持时间
0
－
－
TA
工作温度
-40
25
85
单位 V mV ns ns ns ns ns ns ns ℃
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3
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28 位可编程数据选通发送器
2 特征
a） 电源电压：3.0V～3.6V； b） 工作温度范围：−40～85℃； c） 锁相环内部全集成，无需外部元件； d） 输入时钟频率：10MHz～90MHz； e） 总数据率：2520Mbps； f） 通道压缩比：28：4； g） 输入信号：28 bits LVTTL/LVCMOS 数据和 1 路 LVTTL/LVCMOS 时钟信号； h） 输出信号：满足 EIA/TIA-644 标准的 4 路 LVDS 数据流和 1 路 LVDS 时钟信号； i） 封装形式：TSSOP56； j） 器件等级：工业级； k） 适合 VGA、SVGA、XGA、SXGA（dual pixel）、UXGA（dual pixel）等格式的数据从
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香港众鑫微电子有限公司 金Ｒ １５０１３５０５７５８ Ｑ１０８６２８９４
28 位可编程数据选通发送器
数据手册
GM8283C
1 概述
GM8283C 型 28 位可编程数据选通发送器主要用于视频/图像传输中的发送部分，它可将 并行输入的 28 bits LVTTL/LVCMOS 数据转换为 4 路串行 LVDS 数据流。输入时钟经内部锁相 后，同频率输出，同时转换为 LVDS 差分形式，并保持与输出串行数据流的同步关系；时钟 频率为 10MHz～90MHz。
TXOUT1+
数据输出端
18
TXIN17
数据输入端
46
TXOUT1-
数据输出端
19
TXIN18
数据输入端
47
TXOUT0+
数据输出端
20
TXIN19
数据输入端
48
TXOUT0-
数据输出端
21
GND
TX 数字地端
49
LVDSGND
LVDS 地端
22
TXIN20
数据输入端
50
TXIN27
数据输入端
23
TXIN21
在每一时钟周期内，24 bits 的 RGB 数据和 3 bits 的控制数据分别在 4 个 LVDS 串行通 道中传输，单通道数据率最高可达 630Mbps。
本器件与 DS90CR285、DS90CR287、DS90CF383、DS90C383、DS90C385、SN65LVDS93、 SN75LVDS81、SN75LVDS83 兼容，并可与 GM8284、DS90CR286、DS90CR288、DS90CF384、 DS90CF386、SN65LVDS94、SN75LVDS82 配对使用。
控制器到显示设备的传输。
3 封装及引脚功能说明
1）引出端排列：如图 1 所示：
图 1 GM8283C 引脚排布图
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1
28 位可编程数据选通发送器
数据手册
GM8283C
2）引脚功能说明如表 1 所示。 表 1 芯片引脚功能说明
引出端号
TXOUT3
TXIN5 －1
TXIN27 －1
TXIN 23
TXIN 17
TXIN 16
TXIN 11
TXIN 10
TXIN 5
TXIN 27
TXOUT2
TXIN20 －1
TXIN19 －1
TXIN 26
TXIN 25
TXIN 24
TXIN 22
TXIN 21
TXIN 20
TXIN 19
TXOUT1
TXIN13
数据输入端
40
TXCLKOUT-
时钟输出端
13
GND
TX 数字地端
41
TXOUT2+
数据输出端
14
TXIN14
数据输入端
42
TXOUT2-
数据输出端
15
TXIN15
数据输入端
43
LVDSGND
LVDS 地端
16
TXIN16
数据输入端
44
LVDSVCC
LVDS 电源端
17
RFC
边沿选择端
45
数据手册
GM8283C
图 3 GM8283C 与“4：28 接收器”联用典型应用图 7.2 应用说明
1）输入的 28 bits 数据与参考时钟为同步关系，可选择用上升沿采样或下降沿采样， 如下图 4 所示：
a）上升沿采样（RFC 为高电平电压）
b）下降沿采样（RFC 为低电平电压） 图 4 输入并行数据与输入参考时钟关系图
TXIN9 －1
TXIN8 －1
TXIN 18
TXIN 15
TXIN 14
TXIN 13
TXIN 12
TXIN 9
TXIN 8
TXOUT0
TXIN1 －1
TXIN0 －1
前一周期
TXIN 7
VOD △VOD VOS △VOS IOS IOZ ICCZ
ICCW
表 4 静态特性参数
条件 -40℃≤TA≤85℃，VCC=3.3V
ICL=-18mA VIN=0.4V，2.5V或VCC
VIN=GND
RL=100Ω
VO=0V, RL=100Ω
PWR DWN =0V,VO=0V或VCC
PWR DWN =0V, 输出为三态
TXCLKOUT+/TXCLKOUT－ 正/反相输出 LVDS 时钟信号，满足 EIA/TIA-644 标准。
香港众鑫微电子有限公司
金Ｒ １５０１３５０５７５８ Ｑ１０８６２８９４
2
28 位可编程数据选通发送器
数据手册
GM8283C
引脚符号
PWR DWN VCC GND
PLLVCC PLLGND LVDSVCC LVDSGND
tr tf td0 td1 td2 td3 td4 td5
表 5 动态特性参数
条件 -40℃≤TA≤85℃，
VCC=3.3V
最小
－ RL=100Ω，CL≤10pF
－
f＝85MHz，RL=100Ω， CL≤10pF
-0.2 1.48
3.16
4.48
6.52
8.20
极限值 最大
单位
1.5 ns
1.5
0.2
引脚符号
引脚详细功能描述
TXINn
LVTTL/LVCMOS 输入数据，包含 24 bits RGB 信号和 3 bits 控制信号。
TXOUTn+/TXOUTn-
正/反相输出 LVDS 串行数据流，满足 EIA/TIA-644 标准。
TXCLKIN
LVTTL/LVCMOS 输入参考时钟信号。
RFC
输入时钟采样沿选择信号，控制在时钟上升沿或下降沿载入数据。
ns
1.88 3.56
5.24 6.92 8.60
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金Ｒ １５０１３５０５７５８ Ｑ１０８６２８９４
4
28 位可编程数据选通发送器
数据 BIT6 输出与时钟输 出的相对时间 时钟延迟时间
锁相环建立时间 关断延迟时间 输入时钟抖动
6 机械尺寸
td6
9.88
tCDD
TA=25℃，VCC=3.3V
数据手册
GM8283C
5.3 静态参数
静态参数如表 4 所示。
特性
符号
输入高电平电压
VIH
输入低电平电压
VIL
输入钳位电压
VCL
输入电流
IIN
差分输出电压幅度 互补态差分输出电压变化
共模输出电压幅度 互补态共模输出电压变化
输出短路电流 输出高阻态电流 关断模式电源电流 最坏情况模式
电源电流
5.4 动态参数
5 参数指标
5.1 极限工作条件
a）电源电压（VCC）……………………………… -0.5V～4V b) 输入电压 (VI) ……………………………… -0.5V～VCC +0.5V c) 输出电压 (VO) ………………………………-0.5V～VCC +0.5V d) 贮存温度（Th）（10s）………………………………260℃ e) 工作温度（Tstg）………………………………-65℃～150℃
LVDS 差分输出下降时间 （80%~20%）
数据 BIT0 输出相对时钟 输出延迟时间
数据 BIT1 输出与时钟输 出的相对时间
数据 BIT2 输出与时钟输 出的相对时间
数据 BIT3 输出与时钟输 出的相对时间
数据 BIT4 输出与时钟输 出的相对时间
数据 BIT5 输出与时钟输 出的相对时间
符号
3.8
tPLLS
RL=100Ω，CL≤10pF
－
tPDD
RL=100Ω，CL≤10pF
－
tJIT
RL=100Ω，CL≤10pF
－
数据手册
GM8283C
10.28
6.3
ns
1
ms
100
ns
2
ns
尺寸符号
最小
数值 公称
A1
0.05
―
A
―
―
b
0.17
―
c
0.09
―
D
13.90
―
e
―
0.50
E1
6.00
―
E
符号
功能说明
引出端号
符号
功能说明
1
VCC
PAD 电源端
29
GND
TX 数字地端
2
TXIN5
数据输入端
30
TXIN26
数据输入端
3
TXIN6
数据输入端
百度文库
31
TXCLKIN
时钟输入端
4
TXIN7
数据输入端
32
PWR DWN
关断输入端
5
GND
PAD 地端
33
PLLGND
PLL 地端
6
TXIN8
数据输入端
34
5.2 推荐工作条件
表 3 推荐工作条件
符号
参数
最小
典型
最大
VCC
电源电压
3.0
3.3
3.6
VCCPP
电源电压噪声幅值
－
－
100
tCIP
输入时钟周期
11.1
－
100.0
tCIT
输入时钟转换时间
1.0
3.0
6.0
tCIH
输入时钟高电平时间
0.35tCIP
0.50tCIP
0.65tCIP
tCIL
输入时钟低电平时间
RL=100Ω，
f=10MHz
CL≤10pF
f=90MHz
极限值
最小
最大
2.0
VCC
GND
0.8
－
-1.5
－
15
-10
－
250
450
－
35
1.125
1.375
－
35
－
-5
－
±10
－
90
－
30
－
90
单位
V V V μA μA mV mV V mV mA μA μA
mA
动态参数如表 5 所示。
特性
LVDS 差分输出上升时间 （20%~80%）
6.ÿÿÿÿQFN64ÿÿÿ
DATA SHEET
GM8283C
28 位可编程数据选通发送器
2012.2
香港众鑫微电子有限公司 金Ｒ １５０１３５０５７５８ Ｑ１０８６２８９４
28 位可编程数据选通发送器
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GM8283C
对于输入时钟与数据的关系，要求如下： 建立时间：tSU≥2.5ns，保持时间：tH≥0ns。 2）输出的 4 路串行数据流与同步时钟对应时序关系如下图 5 所示：
TXCLKOUT
8.00
8.10
图 2 外壳外形
7 产品应用信息
香港众鑫微电子有限公司 金Ｒ １５０１３５０５７５８ Ｑ１０８６２８９４
最大 0.15 1.20 0.27 0.20 14.10 ― 6.20 8.20
角度 (°)
－
5
28 位可编程数据选通发送器
7.1 典型应用图 下图 3 为 GM8283C 与“4：28 接收器”联用时的典型应用图。
数据输入端
51
TXIN0
数据输入端
24
TXIN22
数据输入端
52
TXIN1
数据输入端
25
TXIN23
数据输入端
53
GND
TX 数字地端
26
VCC
TX 数字电源端
54
TXIN2
数据输入端
27
TXIN24
数据输入端
55
TXIN3
数据输入端
28
TXIN25
数据输入端
56
TXIN4
数据输入端
3）引脚功能详细描述如表 2 所示。 表 2 芯片引脚功能详细描述
PLLVCC
PLL 电源端
7
TXIN9
数据输入端
35
PLLGND
PLL 地端
8
TXIN10
数据输入端
36
LVDSGND
LVDS 地端
9
VCC
TX 数字电源端
37
TXOUT3+
数据输出端
10
TXIN11
数据输入端
38
TXOUT3-
数据输出端
11
TXIN12
数据输入端
39
TXCLKOUT+
时钟输出端
12
表 2 （续）
引脚详细功能描述 电源关断（低功耗）控制信号，同时也是输出三态控制信号。 数字模块电源。 数字模块地。 锁相环模块电源。 锁相环模块地。 LVDS 模块电源。 LVDS 模块地。
4 功能描述
GM8283C 型 28 位可编程数据选通发送器由串行器、锁相环、LVDS 驱动器和使能模块四 部分组成。芯片完成的功能如下：串行器载入 28 bits 并行数据后，在同步时钟的触发下将 数据移出，同时将时钟信号与数据信号同步后输出，高速同步时钟是由锁相环产生。LVDS 驱动器模块将串行器同步输出的 4 路串行数据流信号和 1 路同步时钟信号转化为 LVDS 格式 的信号后输出。使能模块在待机状态下，可将内部模块电流关断，使器件进入低功耗状态。 GM8283C 具有可编程数据选通控制功能，通过 RFC 控制可实现时钟对数据的上升沿采样或 下降沿采样，RFC 为高电平时为上升沿采样，RFC 为低电平时为下降沿采样。