dxp设计技巧实例笔记(包含蛇形走线)
dxp设计技巧实例笔记(包含蛇形走线)
1)如何使PCB图的背景和边框一致?按住shift选中所有边框，Design->Board shape->Define from selected objects2)线条形成回路就自动删除原来的线解决办法：place line就不会改变原来的。
Place route会改变。
3)同一个项目几个原理图的同一个网络，用不同的网络标号，结果生成网络表时用第一个标注的网络标号。
4)检查PowerPCB印制板图的网络表的方法：把印制板图生成的网络表转换成protel格式，在protel99里先随便导入一个PCB图，然后import两个网络表，用protel99的网络表－》高级－》菜单－》比较网络表在DXP里用reports－》report single pin nets检查没有连线的空管脚是否有遗漏。
5)Pb-free Package 无铅6) 元器件自动编号：Tools >> annotate7) 材料表：Reports >>bill of materials，或Reports >>simple BOM8) 测量尺寸：Ctrl+M9) PROTEL走线时改线宽：按TAB键。
10) QFP封装元器件管脚间距≥0.5mm11) 反面一般只能放2PIN器件，多PIN器件重量不能超过2克12) QFP、BGA器件周围3mm不放其他器件13) 表贴元器件最小0603封装14) DCP010505BP输入电容用2.2uF/0805封装陶瓷电容，输出电容用一个1uF/0805封装陶瓷电容和一个10V/10uF电解电容15) 多上下拉电阻用0603封装电阻，用表贴排阻的话供货厂家少16) 如何让相同的器件依次编号？先RESET ALL（先打开所有项目文档，在不LOCK状态下RESET ALL），然后全部LOCK（鼠标右键FIND SIMILATE OBJECT，选勾select matching，选择OPEN DOCUMENT，在INSPECTOR中选择LOCK DESIGNATOR），然后过滤某种器件，解除LOCK，然后用Tools >> annotate对该种器件编号，然后不用（清除过滤和LOCK编好号的器件），直接过滤另外一种器件，解除LOCK，其后步骤同上。
AD6蛇形等长线布线方法
蛇行等长线布线方法古 风Altium Designer 6.x软件更新速度很快，现在都有AD7了，以前一直用99SE，没想到AD6的功能越来越强大了，在操作方面做了很大改进，特别是在布等长线时，蛇行线的布线那是太容易了。
一． 设置需要等长的网络组点击主菜单DesignàClasses，在弹出的窗口中单击Net Classes，并右键，点Add Class会增加一个New Class，在该网络组上右键，修改一个你想要的名字，如：SDRAM 等。
单击打开它，将需要等长的网络，从左边选取并添加到右边的窗口中。
然后再点击1.选中也就是说，以后的自动等长中，将会以些为基准，所有需等长的线将会跟它一样长。
2．蛇行设置这里为蛇行线的样式，可以根据自己的需要选择.2. 布蛇行线的快捷键控制：在布蛇行线时，按快捷键“1” “2” “3” “4” “，” “。
” 可以在走线时随时控制蛇行线的形状。
快捷键: 1 与2，改变蛇行线的拐角与弧度。
快捷键: 3 与4 改变蛇行线的宽度。
快捷键： ， 与 。
改变蛇行线的幅度。
了解了这些，就可以开始布蛇行线了，单击OK 退出设置，在刚才那条线上，按装走线的方向，拉动鼠标，一串漂亮的蛇行线就出来了。
步长幅度递增量步长递增量规定了蛇线的长度，在拉蛇线时，就不用在乎到底走了多长，总之，拉到蛇线不再出现为止，在有些空隙大的地方，就可以按“逗号”与“句号”键来控制幅度的大小。
四.检查网络长度布完线后，按R ，L 输出报告，查看网络是否是等长的。
OK，蛇行等长线搞定。
注，另外还可以自动等长，但那样出来的线条很难看，所以还是用手动的好。
五．PCB设计学习论坛推荐（众多好的PCB学习资料尽在其中）中国联盟设计论坛/2008年6月29古风。
蛇形走线参数设置
1．简介蛇形走线是布线中经常使用的一种走线方式。
其主要目的就是为了调节延时，满足系统时序设计要求。
但是设计者首先要有这样的认识：蛇形走线会破坏信号质量，改变传输时延，布线时要尽量避免使用。
但实际设计中，为了保证信号有走过足够的保持时间，或者减小同组信号之间的时间偏移，往往不得不故意进行绕线。
当在长度规则设置下开始走线时，有时需要通过使用蛇形走线以达到所需的走线长度。
蛇形走线的示例如图10-60 所示，其中最关键的两个参数就是耦合幅度(Ap) 和耦合距离(Gap)。
很明显，信号在蛇形走线上传输时，相互平行的线段之间会发生耦合，呈差模形式，Gap 越小，Ap 越大，则耦合程度也越大。
图10-60 蛇形走线的示例尽管蛇形走线会引起引起耦合，从而降低信号质量，但是在布线时，蛇形走线对于调节时延和时序是重要的方法。
因此在高速信号布线时，可以使用蛇形走线，但是蛇形走线的Ap 和Gap 的设置必须符合信号的要求。
在PADS Router 中，可以设置蛇形走线的Ap 和Gap,并且在布线过程中添加蛇形布线。
2．设置蛇形走线的Ap 和Gap 参数●执行Tools/Options 菜单命令，或者单击标准工具栏中的Options 图标，系统会弹出选项对话框，然后选择Routing(布线)选型卡。
●然后在Routing to length constaints 区域设置蛇形走线参数，如图10-61 所示。
㊣在Minimum amplitude （幅度）编辑框中将最小值设为20 ，则蛇形走线的幅度最小值被设置为走线宽度的20 倍。
㊣在minimum gap（间距）编辑框中将最小值设为2，则蛇形走线的间隔最小值被设置为走线到拐角间距的2 倍。
●最后单击OK 按钮完成设置。
注意：在使用蛇形走线时，应该注意以下几个技术要点：1.尽量增加平行线段的距离S，至少大于3H，H 指信号走线到参考平面的距离。
通俗的说就是绕大弯走线，只要S 足够大，就几乎能完全避免相互之间的耦合效应。
PCBLayout中的直角走线、差分走线和蛇形线
布线（Layout）是PCB设计工程师最基本的工作技能之一。
走线的好坏将直接影响到整个系统的性能，大多数高速的设计理论也要最终经过Layout 得以实现并验证，由此可见，布线在高速PCB 设计中是至关重要的。
下面将针对实际布线中可能遇到的一些情况，分析其合理性，并给出一些比较优化的走线策略。
主要从直角走线，差分走线，蛇形线等三个方面来阐述。
1．直角走线直角走线一般是PCB布线中要求尽量避免的情况，也几乎成为衡量布线好坏的标准之一，那么直角走线究竟会对信号传输产生多大的影响呢？从原理上说，直角走线会使传输线的线宽发生变化，造成阻抗的不连续。
其实不光是直角走线，顿角，锐角走线都可能会造成阻抗变化的情况。
直角走线的对信号的影响就是主要体现在三个方面：一是拐角可以等效为传输线上的容性负载，减缓上升时间；二是阻抗不连续会造成信号的反射；三是直角尖端产生的EMI。
传输线的直角带来的寄生电容可以由下面这个经验公式来计算：C=61W(Er)[size=1]1/2[/size]/Z0在上式中，C 就是指拐角的等效电容（单位：pF），W指走线的宽度（单位：inch），εr 指介质的介电常数，Z0就是传输线的特征阻抗。
举个例子，对于一个4Mils的50欧姆传输线（εr为4.3）来说，一个直角带来的电容量大概为0.0101pF，进而可以估算由此引起的上升时间变化量：T10-90%=2.2*C*Z0/2 = 2.2*0.0101*50/2 = 0.556ps通过计算可以看出，直角走线带来的电容效应是极其微小的。
由于直角走线的线宽增加，该处的阻抗将减小，于是会产生一定的信号反射现象，我们可以根据传输线章节中提到的阻抗计算公式来算出线宽增加后的等效阻抗，然后根据经验公式计算反射系数：ρ=(Zs-Z0)/(Zs+Z0)一般直角走线导致的阻抗变化在7%-20%之间，因而反射系数最大为0.1左右。
而且，从下图可以看到，在W/2线长的时间内传输线阻抗变化到最小，再经过W/2时间又恢复到正常的阻抗，整个发生阻抗变化的时间极短，往往在10ps 之内，这样快而且微小的变化对一般的信号传输来说几乎是可以忽略的。
处理蛇形线时的几点建议
layout中蛇形线和差分线的使用1．差分走线差分信号（Differential Signal）在高速电路设计中的应用越来越广泛，电路中最关键的信号往往都要采用差分结构设计，什么另它这么倍受青睐呢？在PCB设计中又如何能保证其良好的性能呢？带着这两个问题，我们进行下一部分的讨论。
何为差分信号？通俗地说，就是驱动端发送两个等值、反相的信号，接收端通过比较这两个电压的差值来判断逻辑状态“0”还是“1”。
而承载差分信号的那一对走线就称为差分走线。
差分线怎么布才是严格的等长？我怎么样测试两相的长度是等长度呢？还是我大致让他们平行走线，只是尽量可能的等长，而不是很精确的等长？既然延迟差允许1/4的时钟误差是不是其长度也可以满足两相的长度差存在1/4的误差或者是更少的误差（1/4的误差太大了，平行着走线，怎么走也差不了那么多哦呵呵：））差分信号和普通的单端信号走线相比，最明显的优势体现在以下三个方面：a.抗干扰能力强，因为两根差分走线之间的耦合很好，当外界存在噪声干扰时，几乎是同时被耦合到两条线上，而接收端关心的只是两信号的差值，所以外界的共模噪声可以被完全抵消。
b.能有效抑制EMI，同样的道理，由于两根信号的极性相反，他们对外辐射的电磁场可以相互抵消，耦合的越紧密，泄放到外界的电磁能量越少。
c.时序定位精确，由于差分信号的开关变化是位于两个信号的交点，而不像普通单端信号依靠高低两个阈值电压判断，因而受工艺，温度的影响小，能降低时序上的误差，同时也更适合于低幅度信号的电路。
目前流行的L VDS（low voltage differential signaling）就是指这种小振幅差分信号技术。
对于PCB工程师来说，最关注的还是如何确保在实际走线中能完全发挥差分走线的这些优势。
也许只要是接触过Layout的人都会了解差分走线的一般要求，那就是“等长、等距”。
等长是为了保证两个差分信号时刻保持相反极性，减少共模分量；等距则主要是为了保证两者差分阻抗一致，减少反射。
蛇形线的走线方式
挖掘蛇形线的走线方式蛇形线是Layout中经常使用的一类走线方式。
其主要目的就是为了调节延时，满足系统时序设计要求。
设计者首先要有这样的认识：蛇形线会破坏信号质量，改变传输延时，布线时要尽量避免使用。
但实际设计中，为了保证信号有足够的保持时间，或者减小同组信号之间的时间偏移，往往不得不故意进行绕线。
那么，蛇形线对信号传输有什么影响呢？走线时要注意些什么呢？其中最关键的两个参数就是平行耦合长度（Lp）和耦合距离（S），如图1-8-21所示。
很明显，信号在蛇形走线上传输时，相互平行的线段之间会发生耦合，呈差模形式，S越小，Lp越大，则耦合程度也越大。
可能会导致传输延时减小，以及由于串扰而大大降低信号的质量，其机理可以参考第三章对共模和差模串扰的分析。
下面是给Layout工程师处理蛇形线时的几点建议：1．尽量增加平行线段的距离（S），至少大于3H，H指信号走线到参考平面的距离。
通俗的说就是绕大弯走线，只要S 足够大，就几乎能完全避免相互的耦合效应。
2．减小耦合长度Lp，当两倍的Lp延时接近或超过信号上升时间时，产生的串扰将达到饱和。
3．带状线（Strip-Line）或者埋式微带线（Embedded Micro-strip）的蛇形线引起的信号传输延时小于微带走线（Micro-strip）。
理论上，带状线不会因为差模串扰影响传输速率。
4．高速以及对时序要求较为严格的信号线，尽量不要走蛇形线，尤其不能在小范围内蜿蜒走线。
5．可以经常采用任意角度的蛇形走线，如图1-8-20中的C结构，能有效的减少相互间的耦合。
6．高速PCB 设计中，蛇形线没有所谓滤波或抗干扰的能力，只可能降低信号质量，所以只作时序匹配之用而无其它目的。
7．有时可以考虑螺旋走线的方式进行绕线，仿真表明，其效果要优于正常的蛇形走线。
PCB设计中蛇形线要点
PCB设计中蛇形线要点一、直角走线直角走线一般是PCB布线中要求尽量避免的情况，也几乎成为衡量布线好坏的标准之一，那么直角走线究竟会对信号传输产生多大的影响呢？从原理上说，直角走线会使传输线的线宽发生变化，造成阻抗的不连续。
其实不光是直角走线，顿角，锐角走线都可能会造成阻抗变化的情况。
直角走线的对信号的影响就是主要体现在三个方面：1.拐角可以等效为传输线上的容性负载，减缓上升时间；2.阻抗不连续会造成信号的反射；3.直角尖端产生的EMI。
传输线的直角带来的寄生电容可以由下面这个经验公式来计算：在上式中，C就是指拐角的等效电容（单位：pF），W指走线的宽度（单位：就是传输线的特征阻抗。
举个例子，对于一inch），εr指介质的介电常数，Z个4Mils的50欧姆传输线（εr为4.3）来说，一个直角带来的电容量大概为0.0101pF，进而可以估算由此引起的上升时间变化量：/2 = 2.2*0.0101*50/2 = 0.556ps=2.2*C*Z通过计算可以看出，直角走线带来的电容效应是极其微小的。
由于直角走线的线宽增加，该处的阻抗将减小，于是会产生一定的信号反射现象，我们可以根据传输线章节中提到的阻抗计算公式来算出线宽增加后的等效阻抗，然后根据经验公式计算反射系数：ρ=(Zs-Z0)/(Zs+Z0)，一般直角走线导致的阻抗变化在7%-20%之间，因而反射系数最大为0.1左右。
而且，从下图可以看到，在W/2线长的时间内传输线阻抗变化到最小，再经过W/2时间又恢复到正常的阻抗，整个发生阻抗变化的时间极短，往往在10ps之内，这样快而且微小的变化对一般的信号传输来说几乎是可以忽略的。
很多人对直角走线都有这样的理解，认为尖端容易发射或接收电磁波，产生EMI，这也成为许多人认为不能直角走线的理由之一。
然而很多实际测试的结果显示，直角走线并不会比直线产生很明显的EMI。
也许目前的仪器性能，测试水平制约了测试的精确性，但至少说明了一个问题，直角走线的辐射已经小于仪器本身的测量误差。
altiumdesigner蛇形走线默认规则
altiumdesigner蛇形走线默认规则摘要：一、Altium Designer 简介二、蛇形走线的作用三、蛇形走线默认规则1.蛇形走线规则设置2.蛇形走线规则应用四、蛇形走线规则的优化与调整五、总结正文：Altium Designer 是一款专业的PCB 设计软件，广泛应用于电子设计领域。
在设计过程中，蛇形走线是一种常见的布线方式，能够有效地减少电磁干扰，提高电路的稳定性和可靠性。
为了实现蛇形走线的自动化设计，Altium Designer 提供了蛇形走线默认规则。
蛇形走线默认规则是Altium Designer 内置的一种自动布线策略，能够根据设计需求自动生成蛇形走线。
通过设置蛇形走线的规则，例如线宽、间距、角度等参数，可以实现蛇形走线的自动化设计，提高设计效率。
在Altium Designer 中，设置蛇形走线规则非常简单。
首先，打开PCB 编辑器，选择需要设置蛇形走线的线路。
然后，在菜单栏中选择“线路”>“自动布线”>“蛇形走线”，打开蛇形走线设置对话框。
在此对话框中，可以设置蛇形走线的线宽、间距、角度等参数，以满足设计需求。
在设置好蛇形走线规则后，可以应用这些规则进行自动布线。
在Altium Designer 中，应用蛇形走线规则的方法与普通布线方法相同。
选择需要进行蛇形走线的线路，然后点击工具栏中的“自动布线”按钮，即可实现蛇形走线的自动化设计。
当然，Altium Designer 中的蛇形走线默认规则并非一成不变，而是可以根据实际设计需求进行优化和调整。
例如，可以通过修改蛇形走线的线宽、间距、角度等参数，以实现更优的电磁兼容性能。
此外，还可以通过调整蛇形走线的起点和终点，使其更好地适应电路板的布局。
总之，Altium Designer 中的蛇形走线默认规则为设计师提供了一种高效、可靠的布线方式。
通过合理设置蛇形走线规则，可以实现蛇形走线的自动化设计，提高设计效率。
PADS布蛇形走线的教程[1]
![PADS布蛇形走线的教程[1]](https://img.taocdn.com/s3/m/9d1031da7f1922791688e80a.png)
Blazeroute怎么布蛇形线
Powerpcb本身布不了蛇形线,要用pads带的Blazeroutel来布.Blazeroute是PADS专用的布线工具.用Blazeroute打开pcb,如图
选择欲布蛇形线的pin,然后单击鼠标右键
选择Interactive Route,画一小段线然后在单击鼠标右键
选择Add Accordion,移动鼠标右键就可以画出蛇形线了,连续双击左键就可结束蛇形走线,改为普通走线方式
蛇形线的幅度可以通过在蛇形线的峰值处移动鼠标左键来实现
也可在option中设置其幅度跟宽度,方法是
点击图标,在弹出的对话框中Routing项中的Routing tolength constraints 中设置,
对于等长设计是通过view->spreadsheet调出如下图的列表,显示已布线的长度的文字的颜色来说明的,黄色表示小于min,绿色表示在min跟max之间,红色表示大于max。
蛇形走线（转载）经典
蛇形⾛线（转载）经典会画蛇形线就是⾼⼿了。
⽹上关于蛇形线的⽂章也有很多，总感觉有些帖⼦的内容会误导新⼿，给⼈们带来困扰，⼈为制造⼀些障碍。
那么我们来看看实际应⽤当中蛇形线到底有什么作⽤。
的地平⾯，⾛线的另⼀⾯是暴露在空⽓中的，这样就造成了⾛线四周的介电常数并不⼀致，⽐如我们常⽤的FR4基板介电常数是4.2左右，空⽓…………如果就这个问题深挖下去的话，讲上⼗天半个⽉也讲不完。
长话短说，⽆论是微带线还是带状线，他们的作⽤⽆⾮就是⽤来承载信号，⽆论数字信号或者模拟信号。
这些信号在⾛线⾥以电磁波的形式从⼀端传输到另⼀端。
既然是波，那就要有速度。
信号在PCB⾛线上的速度是多少呢?根据介电常数的区别，速度也不⼀样。
电磁波在空⽓中的传播速度是⼤家都熟知的光速。
在其他介质中的传播速度就要通过下⾯的公式来计算：V=C/Er0.5其中，V是在介质中的传播速度，C是光速，Er是介质的介电常数。
通过这个公式我们就能轻松的计算出信号在PCB⾛线上的传输速度。
⽐如我们把FR4基材的介电常数简单以4来带⼊公式计算，也就是信号在FR4基材中的传输速度是光速的⼀半。
但是表层⾛线的微带线，由于⼀半在空⽓中，⼀半在基材中，介电常数会略有降低，这样传输速度会⽐带状线略快⼀些。
常⽤的经验数据就是微带线的⾛线延时⼤约为140ps/inch,带状线的⾛线延时⼤约为166ps/inch。
前⾯说了这么多只有⼀个⽬的，那就是信号在PCB上的传输是有延时的!也就是说信号并不是在⼀个管脚发送出去以后，瞬间就通过⾛线传输到另⼀个管脚。
虽然信号传输的速度很快，但是只要⾛线长度⾜够长，还是会对信号传输带来影响。
⽐如说⼀个1GHz的信号，周期是1ns，上升沿或者下降沿的时间⼤约为周期的⼗分之⼀，那么就是100ps。
如果我们的⾛线长度超过1inch(⼤约2.54厘⽶)，那么传输的延迟就差出了⼀个上升沿还要多的时间，如果⾛线超过8inch(⼤约20厘⽶)，那么延迟就能整整差出⼀个周期!原来PCB的影响这么⼤，我们板⼦上超过1inch 的⾛线是很常见的。
altiumdesigner蛇形走线默认规则
altiumdesigner蛇形走线默认规则【原创实用版】目录1.Altium Designer 简介2.蛇形走线的概念与作用3.Altium Designer 中设置蛇形走线的方法4.默认规则的含义及其在蛇形走线中的应用5.蛇形走线的优势与局限性正文【Altium Designer 简介】Altium Designer 是一款专业的电子设计自动化（EDA）软件，广泛应用于电路板设计、FPGA 设计、嵌入式系统开发等领域。
该软件提供了丰富的功能和工具，协助工程师高效地完成各种设计任务。
【蛇形走线的概念与作用】蛇形走线是一种在电路板设计中常见的走线方式，其主要特点是走线路径呈蛇形弯曲。
蛇形走线的主要作用是降低信号干扰，提高电路的可靠性和稳定性。
通过增加走线长度，可以减小信号传输过程中的噪声和串扰，从而保证信号质量。
【Altium Designer 中设置蛇形走线的方法】在 Altium Designer 中，设置蛇形走线的方法较为简便。
首先，需要选中需要设置蛇形走线的线路，然后在属性栏中找到“Route Style”选项，将其设置为“Snake”。
接着，在“Snake”选项中，可以调整各种蛇形走线参数，如弯曲角度、弯曲长度等，以满足设计需求。
【默认规则的含义及其在蛇形走线中的应用】默认规则是指在 Altium Designer 中预设的一些参数和约束，用于指导软件自动完成一些设计任务。
在蛇形走线中，默认规则可以应用于设置走线宽度、最小弯曲半径等参数，以保证走线的合规性和可靠性。
通过应用默认规则，可以提高设计效率，减少人工干预的次数。
【蛇形走线的优势与局限性】蛇形走线的优势主要体现在降低信号干扰、提高电路可靠性和稳定性等方面。
通过增加走线长度，可以有效地减小信号传输过程中的噪声和串扰，从而保证信号质量。
然而，蛇形走线也存在一定的局限性，如走线长度较长、设计复杂度较高等，可能会增加设计时间和成本。
因此，在实际设计中，需要权衡各种因素，选择合适的走线方式。
pcb蛇形布线
主板上采用的“蛇形布线”很有讲究，但是并不能认为蛇形布线越多越好。
采用蛇形布线的原因有两个：一个是为了保证布线线路的等长，比如CPU到北桥芯片的时钟线，它不同于普通电器上的线路，在这些线路上以200MHz左右的频率高速运行的信号对线路的长度十分敏感，不等长的时钟布线会引起信号不同步，进而造成系统不稳定。
另一个使用蛇形布线的常见原因是为了尽可能减少电磁辐射（EMI）对主板其余部件和人体的影响。
采用蛇形布线有很多优点，但并不是说在主板布线设计的时候使用蛇形布线越多越好，因为过多过密的主板布线会造成主板布局的疏密不均，会对主板的质量有一定的影响。
好的布线应使主板上各部分线路密度差别不大，并且要尽可能均匀地分布。
而其它与核心部件关系不大的地方一般不宜采用蛇形布线。
蛇形线是Layout中经常使用的一类走线方式。
其主要目的就是为了调节延时，满足系统时序设计要求。
设计者首先要有这样的认识：蛇形线会破坏信号质量，改变传输延时，布线时要尽量避免使用。
但实际设计中，为了保证信号有足够的保持时间，或者减小同组信号之间的时间偏移，往往不得不故意进行绕线。
那么，蛇形线对信号传输有什么影响呢？走线时要注意些什么呢？其中最关键的两个参数就是平行耦合长度（Lp）和耦合距离（S），如图1-8-21所示。
很明显，信号在蛇形走线上传输时，相互平行的线段之间会发生耦合，呈差模形式，S越小，Lp越大，则耦合程度也越大。
可能会导致传输延时减小，以及由于串扰而大大降低信号的质量，其机理可以参考第三章对共模和差模串扰的分析。
下面是给Layout工程师处理蛇形线时的几点建议：1．尽量增加平行线段的距离（S），至少大于3H，H指信号走线到参考平面的距离。
通俗的说就是绕大弯走线，只要S足够大，就几乎能完全避免相互的耦合效应。
2．减小耦合长度Lp，当两倍的Lp延时接近或超过信号上升时间时，产生的串扰将达到饱和。
3．带状线（Strip-Line）或者埋式微带线（Embedded Micro-strip）的蛇形线引起的信号传输延时小于微带走线（Micro-strip）。
altiumdesigner蛇形走线默认规则
altiumdesigner蛇形走线默认规则随着电子技术的不断发展，PCB设计软件Altium Designer成为了越来越多工程师的首选工具。
在Altium Designer中，蛇形走线是一种常见的布线方式，它可以有效提高电路板的利用率，降低信号干扰。
本文将详细介绍Altium Designer中蛇形走线的默认规则设置及实战应用。
1.Altium Designer简介Altium Designer是一款功能强大的PCB设计软件，它集成了一系列的工具，可以帮助工程师轻松完成电路设计、PCB布局和制板等工作。
在Altium Designer中，用户可以自定义布线规则，以满足不同场景的需求。
2.蛇形走线的意义蛇形走线，又称之字形走线，是一种在PCB设计中常用的布线方式。
它可以使信号传输线尽量远离敏感元件，降低电磁干扰；同时，还能提高电路板的利用率，减少面积浪费。
3.默认规则概述在Altium Designer中，蛇形走线的默认规则包括以下几点：- 走线宽度：根据信号频率和传输距离自动调整，以保证信号质量；- 走线间距：最小间距为20mil，以降低信号干扰；- 转折角度：大于等于45度，以减小信号反射；- 过孔样式：使用圆形过孔，以降低信号损耗。
4.蛇形走线规则设置步骤（1）打开Altium Designer，新建或打开一个现有项目；（2）在菜单栏中选择“设计”>“规则”>“布线规则”；（3）在弹出的“布线规则”对话框中，切换到“跟踪”选项卡；（4）在“跟踪”选项卡中，设置蛇形走线的相关规则，如走线宽度、间距、转折角度等；（5）点击“应用”按钮，使设置生效。
5.实战应用与案例分享在实际PCB设计中，我们可以根据具体需求调整蛇形走线的规则，以实现更好的电磁兼容性和信号质量。
以下是一个实战案例：（1）设计一张高速数字电路板的电源部分；（2）根据电源模块的电流、电压等参数，设置合适的蛇形走线规则；（3）在电源线附近添加去耦电容，以减小高频噪声干扰；（4）在关键信号线上采用蛇形走线，以降低相互干扰；（5）检查布线结果，确保信号质量、电磁兼容性及散热等方面的需求。
计技巧PCB设计中蛇形走线有什么作用
计技巧：PCB设计中蛇形走线有什么作用?星期二, 09/13/2011 - 11:21 —samqiu顶384踩-340蛇形走线有什么作用?为什么要蛇形走线?哪些类信号线需要蛇形走线,如果要进行蛇形布线,需要满足什么规则和注意什么问题?下面就为大家来讲解一下PCB设计中蛇形走线的作用。
一、电感作用视情况而定，比如PCI板上的蛇行线就是为了适应PCI 33MHzClock的线长要求。
关于蛇形走线，因为应用场合不同具不同的作用,如果蛇形走线在电脑板中出现，其主要起到一个滤波电感的作用，提高电路的抗干扰能力，若在一般普通PCB板中，除了具有滤波电感的作用外，还可作为收音机天线的电感线圈等等.电脑主机板中的蛇形走线，主要用在一些时钟信号中，如PCIClk,AGPClk，它的作用有两点：1、阻抗匹配2、滤波电感。
对一些重要信号，如INTEL HUB架构中的HUBLink,一共13根，跑233MHz，要求必须严格等长，以消除时滞造成的隐患，绕线是唯一的解决办法。
一般来讲，蛇形走线的线距>=2倍的线宽。
等长布线，尤其是在高频电路中的数据线。
二、有没有计算蛇形线电感量的公式或经验值？specctra可以编程设定网络走线的阻抗匹配规则和差分线走线规则, 帮助里面讲了一些一般的设计原则,有时也兼作电阻作用。
实际是一个分布参数的LC 滤波器。
滤波等长线。
三、平横分布参数高速数字PCB板的等线长是为了使各信号的延迟差保持在一个范围内,保证系统在同一周期内读取的数据的有效性(延迟差超过一个时钟周期时会错读下一周期的数据),一般要求延迟差不超过1/4时钟周期,单位长度的线延迟差也是固定的,延迟跟线宽,线长,铜厚,板层结构有关,但线过长会增大分布电容和分布电感,使信号质量,所以时钟IC引脚一般都接RC端接,但蛇形走线并非起电感的作用,相反的,电感会使信号中的上升元中的高次谐波相移,造成信号质量恶化,所以要求蛇形线间距最少是线宽的两倍,信号的上升时间越小就越易受分布电容和分布电感的影响.蛇行走线应该注意什么问题？如果，走得不好，对pcb板的抗干扰能力是不是不能好转，反而会有恶化作用？简单地说，PCB上的任何一条走线在通过高频信号的情况下都会对该信号造成时延时，蛇形走线的主要作用是补偿“同一组相关”信号线中延时较小的部分，这些部分通常是没有或比其它信号少通过另外的逻辑处理；最典型的就是时钟线，通常它不需经过任何其它逻辑处理，因而其延时会小于其它相关信号。
差分走线,蛇形线的走线注意
差分⾛线,蛇形线的⾛线注意电⼦博客⽹作者：不详布线（Layout）是PCB设计⼯程师最基本的⼯作技能之⼀。
⾛线的好坏将直接影响到整个系统的性能，⼤多数⾼速的设计理论也要最终经过Layout得以实现并验证，由此可见，布线在⾼速PCB设计中是⾄关重要的。
下⾯将针对实际布线中可能遇到的⼀些情况，分析其合理性，并给出⼀些⽐较优化的⾛线策略。
主要从直⾓⾛线，差分⾛线，蛇形线等三个⽅⾯来阐述。
1．直⾓⾛线直⾓⾛线⼀般是PCB布线中要求尽量避免的情况，也⼏乎成为衡量布线好坏的标准之⼀，那么直⾓⾛线究竟会对信号传输产⽣多⼤的影响呢？从原理上说，直⾓⾛线会使传输线的线宽发⽣变化，造成阻抗的不连续。
其实不光是直⾓⾛线，顿⾓，锐⾓⾛线都可能会造成阻抗变化的情况。
直⾓⾛线的对信号的影响就是主要体现在三个⽅⾯：⼀是拐⾓可以等效为传输线上的容性负载，减缓上升时间；⼆是阻抗不连续会造成信号的反射；三是直⾓尖端产⽣的EMI。
传输线的直⾓带来的寄⽣电容可以由下⾯这个经验公式来计算：C="61W"(Er)1/2/Z0在上式中，C就是指拐⾓的等效电容（单位：pF），W指⾛线的宽度（单位：inch），εr指介质的介电常数，Z0就是传输线的特征阻抗。
举个例⼦，对于⼀个4Mils的50欧姆传输线（εr为4.3）来说，⼀个直⾓带来的电容量⼤概为0.0101pF，进⽽可以估算由此引起的上升时间变化量：T10-90%=2.2*C*Z0/2 = 2.2*0.0101*50/2 = 0.556ps通过计算可以看出，直⾓⾛线带来的电容效应是极其微⼩的。
由于直⾓⾛线的线宽增加，该处的阻抗将减⼩，于是会产⽣⼀定的信号反射现象，我们可以根据传输线章节中提到的阻抗计算公式来算出线宽增加后的等效阻抗，然后根据经验公式计算反射系数：ρ=(Zs-Z0)/(Zs+Z0)，⼀般直⾓⾛线导致的阻抗变化在7%-20%之间，因⽽反射系数最⼤为0.1左右。
Altium Designer直接布线时走蛇形
先P->T 布线, 再Shift + A 切换成蛇形走线(ad 里叫Accordions ... 这是P->T 后按` 快捷键时显示的当前可用操作)
(原文件名:2011-07-25 10 25 03.png)
然后按Tab 设置属性,
类型了选用圆弧,
Max Amplitude 设置最大的振幅
Gap 就是间隔(不知这么翻译对不)
下面左边是振幅增量, 右边是间隔增量, 后面有用
(原文件名:2011-07-25 10 18 53.png)然后开始布线
(原文件名:2011-07-25 10 19 34.png)
让边缘变"圆" - 按快捷键"2", 就会增大弧的半径, 增到最大就是两个1/4 的弧直连就是一个180度的半圆了
(原文件名:2011-07-25 10 20 32.png)快捷键"," "." 可以调节振幅
(原文件名:2011-07-25 10 20 54.png)
然后组合起来就可以了
不过AD 的蛇形走线看上去是以"入口点" 为中点两边等量的"振动/振幅" 而你图中的效果(入口点的线, 以及不同振幅的线一边对其)可能不怎么好实现, 估计不是AD画的, 要么是手动调整的
要是不记得快捷键, 没关系, 随时按"`" 可以显示当前支持的操作,。
Altium等长蛇形布线
Altium Designer蛇行等长布线一．设置需要等长的网络组点击主菜单Design-->Classes，在弹出的窗口中单击Net Classes，并右键，点Add Class会增加一个New Class，在该网络组上右键，修改一个你想要的名字，如：SDRAM等。
单击打开它，将需要等长的网络，从左边选取并添加到右边的窗口中。
然后再点击关闭设置。
二.布线在布蛇行线时，只能在已经布好的线上修改，不能直接拉蛇线，所以得先布线，把所有SDRAM Class的网络用手工(不推荐用自动)的方式布完线，走线尽量的短，尽量的宽松，也就是说间距留大一点。
应该把最长的那一根做为基准，把它尽量的布短一点。
三.走蛇行线等长按T，R键，单击一根走线，再按TAB键，设置一下先1.选中在右边的网络中，选中一根你想要长度的网络，一般选最长的那根也就是说，以后的自动等长中，将会以些为基准，所有需等长的线将会跟它一样长。
2．蛇行设置蛇行线幅度步长步长递增量幅度递增量这里为蛇行线的样式，可以根据自己的需要选择.2.布蛇行线的快捷键控制：在布蛇行线时，按快捷键“1”“2”“3”“4”“，”“。
”可以在走线时随时控制蛇行线的形状。
快捷键:1与2，改变蛇行线的拐角与弧度。
快捷键:3与4改变蛇行线的宽度。
快捷键：，与。
改变蛇行线的幅度。
了解了这些，就可以开始布蛇行线了，单击OK退出设置，在刚才那条线上，按装走线的方向，拉动鼠标，一串漂亮的蛇行线就出来了。
规定了蛇线的长度，在拉蛇线时，就不用在乎到底走了多长，总之，拉到蛇线不再出现为止，在有些空隙大的地方，就可以按“逗号”与“句号”键来控制幅度的大小。
四.检查网络长度布完线后，按R，L输出报告，查看网络是否是等长的。
OK，蛇行等长线搞定。
注，另外还可以自动等长，但那样出来的线条很难看，所以还是用手动的好。
altiumdesigner蛇形走线默认规则
altiumdesigner蛇形走线默认规则
蛇形走线是电路板设计中的一种常见走线方式，在Altium Designer中也提供了相应的默认规则来帮助设计师实现蛇形走线。
在进行蛇形走线时，设计师需要遵守这些默认规则以保证电路板的性能和可靠性。
首先，Altium Designer的蛇形走线默认规则包括两个主要方面：走线宽度与间距，以及走线层次。
在进行蛇形走线时，设计师可以根据需要调整这些规则以满足特定的设计需求。
对于走线宽度与间距，Altium Designer默认规定了最小宽度和最小间距，以确保电路板上的线路之间有足够的隔离和绝缘。
这些数值可以在设计规则设置中进行调整，以适应特定的电路板需求。
另外，Altium Designer还提供了走线层次的默认规则。
蛇形走线通常在不同的层次上进行，以提高布局的紧凑性和电路板的性能。
设计师可以按照默认规则进行走线层次的设置，或者根据实际需求进行调整。
在进行蛇形走线时，设计师需要注意以下几点。
首先，确保走线的路径是连续的，不要出现交叉或交错的情况。
其次，要注意走线的方向，避免出现不必要的转弯或倾斜。
最后，注意走线与其他元件的间距，确保足够的隔离和绝缘。
总之，在Altium Designer中进行蛇形走线时，设计师可以按照默认规则进行设置，并根据实际需求进行调整。
通过合理的蛇形走线，可以提高电路板的性能和可靠性，并满足特定的设计需求。
PCB技巧蛇形布线
PCB技巧蛇形布线蛇形布线是一种在PCB设计中常用的技巧，它能够减少布线的交叉和干扰，提高设计的性能和可靠性。
下面是关于蛇形布线的一些技巧和注意事项。
1.确定布线的方向：在进行蛇形布线之前，需要确定布线的方向。
一般来说，信号传输的方向和布线距离较远的元件的位置相对应。
确保信号传输的方向是一致的，可以减少信号干扰和交叉。
2.进行合理的布线规划：在进行蛇形布线之前，需要进行合理的布线规划。
将电路板的不同功能模块分组，并分配给不同的布线区域。
这样可以减少布线之间的交叉和干扰，提高信号完整性。
3.使用连续的布线路径：蛇形布线应该使用连续的布线路径。
这样可以减少信号路径的突变，减小信号的散射和串扰。
如果布线中断，可以通过使用通孔来连接信号路径。
4.注意信号地平面：在蛇形布线中，应该注意信号地平面的规划。
要保持信号地平面连续，避免出现散射和串扰。
可以使用地引线连接不同层的地面。
5.采用四层布线：为了更好地实现蛇形布线，可以考虑使用四层布线。
这样可以将信号层和地平面层分开，减少信号干扰和交叉。
6.控制布线的尺寸：在进行蛇形布线时，应控制布线的尺寸。
布线的尺寸应符合设计规范和制造能力，避免布线过宽或过窄。
布线过宽会导致布线密度较低，布线过窄则容易出现导线打断等问题。
7.控制布线的长度：在进行蛇形布线时，应控制布线的长度。
布线的长度会影响信号传输的速度和信号完整性。
尽量保持布线的长度较短，避免信号传输的延迟和损失。
8.注意信号的引出和引入：在进行蛇形布线时，应注意信号的引出和引入。
要确保信号的引出和引入位置相对于布线路径是理想的。
可以使用不同的引出和引入方式，如引线、晶振等。
9.使用合适的布线密度：在进行蛇形布线时，应使用合适的布线密度。
布线密度过高会导致布线之间的交叉和干扰，布线密度过低则会浪费板子的空间资源。
要根据具体的设计要求和制造能力选择合适的布线密度。
10.进行布线优化：在进行蛇形布线后，还可以进行布线优化。
PCB Layout 中的直角走线、差分走线和蛇形线
PCB Layout 中的直角走线、差分走线和蛇形线布线（Layout）是PCB设计工程师最基本的工作技能之一。
走线的好坏将直接影响到整个系统的性能，大多数高速的设计理论也要最终经过Layout 得以实现并验证，由此可见，布线在高速 PCB 设计中是至关重要的。
下面将针对实际布线中可能遇到的一些情况，分析其合理性，并给出一些比较优化的走线策略。
主要从直角走线，差分走线，蛇形线等三个方面来阐述。
1．直角走线直角走线一般是PCB布线中要求尽量避免的情况，也几乎成为衡量布线好坏的标准之一，那么直角走线究竟会对信号传输产生多大的影响呢？从原理上说，直角走线会使传输线的线宽发生变化，造成阻抗的不连续。
其实不光是直角走线，顿角，锐角走线都可能会造成阻抗变化的情况。
直角走线的对信号的影响就是主要体现在三个方面：一是拐角可以等效为传输线上的容性负载，减缓上升时间；二是阻抗不连续会造成信号的反射；三是直角尖端产生的EMI。
传输线的直角带来的寄生电容可以由下面这个经验公式来计算：C=61W(Er)[size=1]1/2[/size]/Z0在上式中，C 就是指拐角的等效电容（单位：pF），W指走线的宽度（单位：inch），εr指介质的介电常数，Z0就是传输线的特征阻抗。
举个例子，对于一个4Mils的50欧姆传输线（εr为4.3）来说，一个直角带来的电容量大概为0.0101pF，进而可以估算由此引起的上升时间变化量：T10-90%=2.2*C*Z0/2 = 2.2*0.0101*50/2 = 0.556ps通过计算可以看出，直角走线带来的电容效应是极其微小的。
由于直角走线的线宽增加，该处的阻抗将减小，于是会产生一定的信号反射现象，我们可以根据传输线章节中提到的阻抗计算公式来算出线宽增加后的等效阻抗，然后根据经验公式计算反射系数：ρ=(Zs-Z0)/(Zs+Z0)一般直角走线导致的阻抗变化在7%-20%之间，因而反射系数最大为0.1左右。
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1)如何使PCB图的背景和边框一致?按住shift选中所有边框，Design->Board shape->Define from selected objects2)线条形成回路就自动删除原来的线解决办法：place line就不会改变原来的。
Place route会改变。
3)同一个项目几个原理图的同一个网络，用不同的网络标号，结果生成网络表时用第一个标注的网络标号。
4)检查PowerPCB印制板图的网络表的方法：把印制板图生成的网络表转换成protel格式，在protel99里先随便导入一个PCB图，然后import两个网络表，用protel99的网络表－》高级－》菜单－》比较网络表在DXP里用reports－》report single pin nets检查没有连线的空管脚是否有遗漏。
5)Pb-free Package 无铅6) 元器件自动编号：Tools >> annotate7) 材料表：Reports >>bill of materials，或Reports >>simple BOM8) 测量尺寸：Ctrl+M9) PROTEL走线时改线宽：按TAB键。
10) QFP封装元器件管脚间距≥0.5mm11) 反面一般只能放2PIN器件，多PIN器件重量不能超过2克12) QFP、BGA器件周围3mm不放其他器件13) 表贴元器件最小0603封装14) DCP010505BP输入电容用2.2uF/0805封装陶瓷电容，输出电容用一个1uF/0805封装陶瓷电容和一个10V/10uF电解电容15) 多上下拉电阻用0603封装电阻，用表贴排阻的话供货厂家少16) 如何让相同的器件依次编号？先RESET ALL（先打开所有项目文档，在不LOCK状态下RESET ALL），然后全部LOCK（鼠标右键FIND SIMILATE OBJECT，选勾select matching，选择OPEN DOCUMENT，在INSPECTOR中选择LOCK DESIGNATOR），然后过滤某种器件，解除LOCK，然后用Tools >> annotate对该种器件编号，然后不用（清除过滤和LOCK编好号的器件），直接过滤另外一种器件，解除LOCK，其后步骤同上。
17) 在PowerPCB里导出网络表：File >>Report >>PowerPCB V3.0 Format Netlist18) Dxp2004点亮网络：编辑（E），选择（S），物理连接（C）快捷键：Ctrl+H19) 如何将修改应用到多个图纸？在Find Similar Objects对话框，下面的复选框除了“Create Expression”不选，其他全选,下拉列表选“Open Documents”。
在Inspector对话框Include xxx from open documents。
20) Tools >> annotate 里也可以把元器件编号全部复位。
21) PCB图改变连线为任意角度或弧线的快捷方式：shift+空格。
每按一次，改变一种连线方式。
22) 过孔是默认不加阻焊层（绿油）的，可在过孔的属性：Force complete tenting on top和Force complete tenting on bottom两项中进行选择，打勾即加阻焊层。
23) TOP PASTE：表面意思是指顶层焊膏层，就是说可以用它来制作印刷锡膏的钢网，这一层只需要露出所有需要贴片焊接的焊盘，并且开孔可能会比实际焊盘小。
这一层资料不需要提供给PCB厂。
TOP SOLDER：表面意思是指顶层阻焊层，就是用它来涂敷绿油等阻焊材料，从而防止不需要焊接的地方沾染焊锡的，这一层会露出所有需要焊接的焊盘，并且开孔会比实际焊盘要大。
这一层资料需要提供给PCB厂。
24) PowerPCB中如何看焊盘和过孔的孔径？－Select Anything > 点击焊盘或过孔使高亮> 右键菜单Query/Modify… > Pad Stack按钮> Pin:选择管脚，Drill:内径。
25) 如下图所示，D2的2脚和3脚不能这样连接，焊的时候锡会连到一起。
应该从两边绕。
26) 威赛（EDP02-CPU）BGA下过孔外径30mil，内径12mil；只有TOP层外径改为23mil，其他层外径30mil，整板过孔尺寸一样。
（EDP03-CPU）电源处过孔外径40mil，内径20mil；其他过孔外径30mil，内径16mil。
27) 在层间切换：小键盘的“+”28) 将PCB图的某元件封装导入*.PcbLib：1.先画PCB图的外框，Import Changes From*.PrjPCB，根据已安装的库文件调入元器件，Validate Changes，在最右边的Message窗口可看到哪些元器件的封装没找到“Footprint Not Found CR2032”。
2.生成本PCB图的PcbLib，保存。
3.找到以前有的元件封装的PCB文件，找到该元件，复制。
4.打开本PCB 图的PcbLib，Edit->Paste Component，保存，只有保存后才能在安装的库里找到该元件。
29)如何去掉PCB文件板子周围的MXX字符？右键点击一个MXX字符过滤，把MXX改为M*，选择SAME，过滤出来后选择HIDE。
30)PADS layout 2005中打开状态窗口：Window菜单->Status31)打印装焊图问题，把PCB图转90度字符会出现错位的解决办法：原因是元件标号的autoposition属性全为left-above，将left-above属性的字符全选中，将该属性改为manual。
然后Ctrl+A选中全图，鼠标左键点在某个元器件上，按空格键，然后松开鼠标，在弹出的消息框“Rebuild x polygons”选择“No”。
32)一般自动布线后都连接好了，那么又怎么实现一点共地?An：自动布线后，如果希望实现一点接地，可以用下面2种方法来实现，1)在自动布线前先手动布线完成地线的走线工作并锁定，再自动布线完成其他工作；2)在绘制原理图的时候将两个地采用不同的网络来绘制，比如“SGND”和“PGND”，通过一个跳线来连接，即可用自动布线，不过建议还是纯手动为妙。
33)跳线布局图：在DXP中打开PCB文件，UNROUTE，删除跳线外的其他东西，转换为AUTOCAD文件，然后在AUTOCAD文件中更改格式-》文字样式，关掉不需要的层，最后COPY到WORD文档。
34)复制相同部分（元器件和走线）：Netlist->Clean All Nets，然后复制，然后改元器件号，然后再与原理图同步。
35)定位孔尺寸及定位：重新设置原点，然后随便放一个焊盘，双击，在属性里编辑位置和36)一组有序网络标号可用矩阵粘贴：先做一个，然后复制，然后点击EDIT菜单中的SmartPaste，如下图所示设置：37)如何设置覆铜与焊盘的间距：设置Clearance为15mil。
38)汉字字体：先全设为TRUE TYPE，然后字体改为仿宋体。
39)英文字体：设为Stroke，字体为Sans Serif，字高36mil，字宽8mil。
40)PCB用放大镜看：菜单view->board insight，快捷键shift+M。
41)铺铜层的设计：一般建议用网格方式铺铜，网格的设置推荐正交90度/网格线宽10mil，网格尺寸25mil。
覆铜要注意爬电距离。
覆铜时Clearance设为15mil。
42)小板子尺寸在90mmX90mm以下必须做拼板。
43)QFN封装作法：中间大焊盘要焊接到器件中间的散热焊盘，四周加4个过孔连接到GND，过孔也有散热作用，过孔周围加防焊，防止漏锡。
44)材料表的制作：从DXP导出.XLS格式材料表，用BOM Simple.XLT模板。
45)BGA下过孔的设置：1）1.27mm间距焊盘：过孔内径>=12mil，外径>=24 mil，电源层间隙直径（2X电源层间隙+孔内径）>=32mil，即电源层间隙（Plane Clearance）>=10mil；2）1mm间距焊盘：过孔内径>=10mil，外径>=22 mil，电源层间隙直径（2X电源层间隙+孔内径）>=30mil，即电源层间隙（Plane Clearance）>=10mil；3）0.8mm间距焊盘：过孔内径>=8mil，外径>=18 mil，电源层间隙直径（2X电源层间隙+孔内径）>=28mil，即电源层间隙（Plane Clearance）>=10mil。
46)高喜的过孔设置：BGA下面内径8mil，外径16mil；BGA以外内径12mil，外径24mil。
47)高速PCB线宽最小6mil，苏杭、高喜都能做。
4mil会增加成本，成品率降低。
48)BGA下线与过孔的间距最小可做到4mil，我们要求在5.5mil以上。
49)PADS2007导出的网络表不对，不能用来和PROTEL的网络表比较，只能用PADS200550)字符：字高最好要有35mil。
如果太小的话，印出的字符就不容易看清楚了；字符线宽最好大于等于8mil。
51)COPY别人原理图时，电源和地的符号要重新放置。
例如，有的GND符号，网络竟然是VCC。
52)导线需要裸铜的，只需在相同位置的TOP SOLDER层和BOTTOM SOLDER层画线即可。
在需要散热或降低电源阻抗的情况下可能需要缚裸铜。
53)DXP中项目、库等信息栏看不到：把窗口右边界往左拖。
54)更改PCB中元器件的封装：1）将该封装添加到lib中；2）选择器件，右击，如下图所示。
55)原理图自动节点设置，如下图所示：56)原理图手动节点设置，如下图所示：Default Primitives中的手动节点设置优先级高。
57)原理图编译出错：pin is visible in one sub-part and hidden in another sub-part。
在projectoptions里，将“mismatched pin visibility”设为“no report”即可。
58)原理图编译出错：duplicate net name wire xxx。
解决：将该网络连线重画。
59)原理图编译出错：floating net nabels。
解决：重画该网络标号及连线。
60)快速复制网络标号，并使尾数递增：如BA0，按住SHIFT键，鼠标左键拖动BA0，就复制了1个BA1，以此类推。