dsp时钟日历课程设计
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课程设计说明书(本科)
题目: 时钟日历
姓名:
专业: 电子信息工程
班级: 09级一班
2012年 6 月
目录
摘要 (1)
一、硬件设计 (1)
1、硬件方案设计 (1)
2、单元电路设计 (2)
3、电路原理图 (5)
4、硬件调试 (6)
二、软件设计 (6)
1、系统分析 (6)
2、软件系统设计 (7)
3、软件代码实现 (9)
4、软件调试 (24)
四、课程设计体会总结 (24)
五、参考文献 (24)
时钟日历
摘要:课程设计的主要目的是用tms320f2812芯片为核心控制部件,设计一个能用LCD液
晶显示屏显示当前年,月,日,时,分,秒以及星期的具有电子时钟功能的万年历。
⑴学习并了解ICETEK-F2812-A板及教学实验箱的使用;
⑵学习DSP芯片的I/O端口的控制方法;
⑶熟悉字模的简单构建和使用;
⑷熟悉Emulator方式下的程序调试规程,并最终能够熟练掌握在DSP软硬件环境下
的程序开发流程;能够对现有器件进行简单地编程,实现各种简单地显示控制。
关键词:dsp 时钟日历
一、硬件设计
1、硬件方案设计
本系统以TMS2812为核心控制部件,利用软件编程,通过DS1302进行时钟控制,使用12864 LCD液晶显示器进行时钟显示,能实现题目的基本要求,尽量做到硬件电路简单稳定,减小电磁干扰和其他环境干扰,充分发挥软件编程的优点,减小因元器件精度不够引起的误差。由于时间有限和本身知识水平的发挥,我们认为本系统还有需要改进和提高的地方,例如选用更高精度的元器件,硬件电路更加精确稳定,软件测量算法进一步的改进与完善等。总体框图如图1所示。
GND +5V
ADD PWM4
PWM3
VSS PWM2
V0
IOPA7
IOPA6
IOPA5 REST
IOPA4
IOPA3 OSCBYP
TXAL1
TXAL2
IOPB0- IOPB7
E
CS1
CS2
R/W
RS DB0-DB7
RST
I/O
SCLK
VCC1/VCC2
X1/X2
GND
复位电路
OSCBYP为高电平。采
用内部振荡
双电源
32768hz 10K
DS1302
图1 电路总体框图
2、 单元电路设计
1)、 控制部件 TMS320F2812结构及性能
本次课设所使用的TMS320F2812是ICETEK-F2812-A 型DSP 用户板中集成试验箱,所以下面主要对该板各个板块及其功能的描述。
图2-1 F2812-A 板的实物图
下面说明该些接口及其功能如表2-1:
在本次设计中主要用到P1口中的pwm 引脚作为I/O 口来传送数据。P1 接口主要是扩展评估板上空闲的DSP 外设引脚,以便于定制用户的硬件环境。由于这组引脚是直接来自于F2812 DSP 芯片,因此,这些引脚为TTL 3.3V 标准,其输出最高电压为3.3V 。所以在ds1302中要用四个二极管来降压,关于其接口的设置可以用软件对每个引脚功能设计。 手动复位开关 参考电压选择
用户使用的开关 5V 电源开关 用户使用的指示灯
5V 电源接口 CAN 总线接口 DSP 仿真器接口 模式选择跳线
九针D 型串口
表2-1接口和功能分类 功能分类
接口名称 接口定义 电源接口
POWER 5V 电源输入 外设接口
DB9 九针D 型串口
总线接口
P1 34芯外扩总线 P2 34芯外扩总线 P3 34芯外扩总线 P4 34芯外扩总线 指示灯
POW_LED 电源指示灯 USER_LED 用户使用的发光管 辅助接口
DSP_JTAG :DSP 仿真器接口 开关
USER_SW 用户使用的开关 RESET 手动复位开关
JP3 SCI 选择 AD 参考电压选
择
ADREFLO1 AD 参考低电压输入 ADREFIN1 测试端,必须悬空 模式选择跳线 MP/MC1 MP/MC 方式选择 MDXA1 SCITXDA1
SPICLKA1
SPISTEA1
2)、 时钟芯片 DS1302结构及其功能
⑴ DS1302的引脚 图2-2 DS1302的引脚图
图2-2DS1302的引脚排列,其中Vcc1为后备电源,VCC2为主电源。在主电源关闭的情况下,也能保持时钟的连续运行。DS1302由Vcc1或Vcc2两者中的较大者供电。当Vcc2大于Vcc1+0.2V 时,Vcc2给DS1302供电。当Vcc2小于Vcc1时,DS1302由Vcc1供电。X1和X2是振荡源,外接32.768kHz 晶振。RST 是复位/片选线,通过把RST 输入驱动置高电平来启动所有的数据传送。RST 输入有两种功能:首先,RST 接通控制逻辑,允许地址/命令序列送入移位寄存器;其次,RST 提供终止单字节或多字节数据的传送手段。当RST 为高电平时,所有的数据传送被初始化,允许对DS1302进行操作。如果在传送过程中RST 置为低电平,则会终止此次数据传送,I/O 引脚变为高阻态。上电运行时,在Vcc ≥2.5V 之前,RST 必须保持低电平。只有在SCLK 为低电平时,才能1 8 2 7 3 6 4 5
I/O RST SCLK GND VCC2 X2
X1
VCC1