数字电路-2进制优先编码器
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数字电路实验报告
姓名:陈小龙学号:14051113 班级:
专业:网络工程课程名称:数字电路设计
任课老师:张怀相实验名称:2进制优先编码器1.实验程序源代码
module cxl_4(IN,Y,EN,DONE);
input[7:0] IN;
input EN;
output DONE;
output[2:0] Y;
reg DONE;
reg[2:0] Y;
always @(*)
begin
if(!EN)
begin
if(IN[0]==1)
begin
Y=3'b000;
DONE=1;
end
else if(IN[0]==0&&IN[1]==1)
begin
Y=3'b001;
DONE=1;
end
else if(IN[0]==0&&IN[1]==0&&IN[2]==1)
begin
Y=3'b010;
DONE=1;
end
else
if(IN[0]==0&&IN[1]==0&&IN[2]==0&&IN[3]==1)
begin
Y=3'b011;
DONE=1;
end
else
if(IN[0]==0&&IN[1]==0&&IN[2]==0&&IN[3]==0&&IN[4]== 1)
begin
Y=3'b100;
DONE=1;
end
else
if(IN[0]==0&&IN[1]==0&&IN[2]==0&&IN[3]==0&&IN[4]== 0&&IN[5]==1)
begin
Y=3'b101;
DONE=1;
end
else
if(IN[0]==0&&IN[1]==0&&IN[2]==0&&IN[3]==0&&IN[4]== 0&&IN[5]==0&&IN[6]==1)
begin
Y=3'b110;
DONE=1;
end
else
if(IN[7]==1&&IN[6]==0&&IN[5]==0&&IN[4]==0&&IN[3]== 0&&IN[2]==0&&IN[1]==0&&IN[0]==0)
begin
Y=3'b111;
DONE=1;
end
else
if(IN[7]==0&&IN[6]==0&&IN[5]==0&&IN[4]==0&&IN[3]== 0&&IN[2]==0&&IN[1]==0&&IN[0]==0)
begin
Y=3'b000;
DONE=0;
end
end
else
begin
Y=3'b000;
DONE=0;
end
end
endmodule
2.仿真波形
3.电路图
4.约束文件
NET "IN[0]" LOC = T5; NET "IN[1]" LOC = V8; NET "IN[2]" LOC = U8; NET "IN[3]" LOC = N8; NET "IN[4]" LOC = M8; NET "IN[5]" LOC="V";
NET "IN[6]" LOC = T9; NET "IN[7]" LOC = T10; NET "EN" LOC = A8; NET "Y[0]" LOC = T11; NET "Y[1]" LOC = R11; NET "Y[2]" LOC = N11; NET "DONE" LOC = M11; NET "IN[5]" LOC = V9;
5.思考与探索