信号完整性分析基础
信号完整性分析基础系列之一——眼图测量
信号完整性分析基础系列之一——关于眼图测量（上）汪进进美国力科公司深圳代表处内容提要：本文将从作者习惯的无厘头漫话风格起篇，从四个方面介绍了眼图测量的相关知识：一、串行数据的背景知识; 二、眼图的基本概念; 三、眼图测量方法; 四、力科示波器在眼图测量方面的特点和优势。
全分为上、下两篇。
上篇包括一、二部分。
下篇包括三、四部分。
您知道吗？眼图的历史可以追溯到大约47年前。
在力科于2002年发明基于连续比特位的方法来测量眼图之前，1962年-2002的40年间，眼图的测量是基于采样示波器的传统方法。
您相信吗？在长期的培训和技术支持工作中，我们发现很少有工程师能完整地准确地理解眼图的测量原理。
很多工程师们往往满足于各种标准权威机构提供的测量向导，Step by Step，满足于用“万能”的Sigtest软件测量出来的眼图给出的Pass or Fail结论。
这种对于Sigtest的迷恋甚至使有些工程师忘记了眼图是可以作为一项重要的调试工具的。
在我2004年来力科面试前，我也从来没有听说过眼图。
那天面试时，老板反复强调力科在眼图测量方面的优势，但我不知所云。
之后我Google“眼图”，看到网络上有限的几篇文章，但仍不知所云。
刚刚我再次Google“眼图”，仍然没有找到哪怕一篇文章讲透了眼图测量。
网络上搜到的关于眼图的文字，出现频率最多的如下，表达得似乎非常地专业，但却在拒绝我们的阅读兴趣。
“在实际数字互连系统中，完全消除码间串扰是十分困难的，而码间串扰对误码率的影响目前尚无法找到数学上便于处理的统计规律，还不能进行准确计算。
为了衡量基带传输系统的性能优劣，在实验室中，通常用示波器观察接收信号波形的方法来分析码间串扰和噪声对系统性能的影响，这就是眼图分析法。
如果将输入波形输入示波器的Y轴，并且当示波器的水平扫描周期和码元定时同步时，适当调整相位，使波形的中心对准取样时刻，在示波器上显示的图形很象人的眼睛，因此被称为眼图（Eye Map）。
于博士信号完整性分析入门(修改)
于博士信号完整性分析入门于争 博士for more information,please refer to 电设计网欢迎您什么是信号完整性?如果你发现，以前低速时代积累的设计经验现在似乎都不灵了，同样的设计，以前没问题，可是现在却无法工作，那么恭喜你，你碰到了硬件设计中最核心的问题：信号完整性。
早一天遇到，对你来说是好事。
在过去的低速时代，电平跳变时信号上升时间较长，通常几个ns。
器件间的互连线不至于影响电路的功能，没必要关心信号完整性问题。
但在今天的高速时代，随着IC输出开关速度的提高，很多都在皮秒级，不管信号周期如何，几乎所有设计都遇到了信号完整性问题。
另外，对低功耗追求使得内核电压越来越低，1.2v内核电压已经很常见了。
因此系统能容忍的噪声余量越来越小，这也使得信号完整性问题更加突出。
广义上讲，信号完整性是指在电路设计中互连线引起的所有问题，它主要研究互连线的电气特性参数与数字信号的电压电流波形相互作用后，如何影响到产品性能的问题。
主要表现在对时序的影响、信号振铃、信号反射、近端串扰、远端串扰、开关噪声、非单调性、地弹、电源反弹、衰减、容性负载、电磁辐射、电磁干扰等。
信号完整性问题的根源在于信号上升时间的减小。
即使布线拓扑结构没有变化，如果采用了信号上升时间很小的IC芯片，现有设计也将处于临界状态或者停止工作。
下面谈谈几种常见的信号完整性问题。
反射：图1显示了信号反射引起的波形畸变。
看起来就像振铃，拿出你制作的电路板，测一测各种信号，比如时钟输出或是高速数据线输出，看看是不是存在这种波形。
如果有，那么你该对信号完整性问题有个感性的认识了，对，这就是一种信号完整性问题。
很多硬件工程师都会在时钟输出信号上串接一个小电阻，至于为什么，他们中很多人都说不清楚，他们会说，很多成熟设计上都有，照着做的。
或许你知道，可是确实很多人说不清这个小小电阻的作用，包括很多有了三四年经验的硬件工程师，很惊讶么?可这确实是事实，我碰到过很多。
信号完整性分析基础系列之二十四
信号完整性分析基础系列之二十四——关于抖动（上）美国力科公司深圳代表处汪进进写在前面的话抖动话题是示波器测量的最高境界，也是最风云变换的一个话题，这是因为抖动是示波器测量的诸多功能中最和“数学”相关的。
玩数学似乎是需要一定境界的。
“力科示波器是怎么测量抖动的?”，“这台示波器抖动测量准不准?”，“时钟抖动和数据抖动测量方法为什么不一样？”，“总体抖动和峰峰值抖动有什么区别? ”，“余辉方法测量抖动不是最方便吗？”，“抖动和眼图，浴盆曲线之间是什么?”，…… 关于抖动的问题层出不穷。
这么多年来，在完成了“关于触发（上）、（下）”和“关于眼图（上）、（下）”，“关于S参数（上）（下）”等三篇拙作后，我一直希望有一篇“关于抖动”的文章问世，但每每下笔又忐忑而止，怕有谬误遗毒。
今天，当我鼓起勇气来写关于抖动的时候，我需要特别说明，这是未定稿，恳请斧正。
抖动和波形余辉的关系有一种比较传统的测量抖动的方法，就是利用余辉来查看信号边沿的变化，然后再用光标测量变化的大小（如图1所示），后来更进了一步，可以利用示波器的“余辉直方图”和相关参数自动测量出余辉的变化范围，这样测量的结果就被称为“抖动”。
这个方法是在示波器还没有“测量统计”功能之前的方法，但在90年代初力科发明了测量统计功能之后，这个方法就逐渐被淘汰了。
图1 传统的抖动测量方法这种传统的方法有下面这些缺点：（1）总会引入触发抖动，因此测量的结果很不准确。
（2）只能测量某种参数的抖动，譬如触发上升沿，测量下降沿的余辉变化，反应了宽度的抖动，触发上升沿，测量相邻的上升沿的余辉变化，反应了周期的抖动。
显然还有很多类型的抖动特别是最重要的TIE抖动无法测量出来。
（3）抖动产生的因果关系的信息也无从得知。
定义抖动的四个维度和抖动相关的名词非常多：时钟抖动，数据抖动; 周期抖动，TIE抖动，相位抖动，cycle-cycle抖动; 峰峰值抖动(pk-pk jitter)，有效值抖动(rms jitter);总体抖动(Tj)，随机抖动(Rj)，固有抖动(Dj);周期性抖动，DCD抖动，ISI抖动，数据相关性抖动; 定时抖动，基于误码率的抖动; 水平线以上的抖动和水平线以下的抖动…… 这些名词反应了定义抖动的不同维度。
讲座四信号完整性分析
讲座四 信号完整性分析
4．降低串扰的设计技术
串绕是不可能完全消除的，只能在PCB设计中尽量减小串扰。 通常减小串绕的设计技术如下： 1)根据功能分类逻辑器件系列，保持总线结构被严格控制； 2)避免互相平行的走线布线，走线间要有足够的间隔以最小化 电感耦合； 3)使用相对介电常数较低的叠层； 4)最小化元件间的距离； 5)最小化并行走线的长度；
讲座四 信号完整性分析
4．4．1 信号反射的形成 当传输线上的阻抗不连续时会导致信号 反射。这种不连续可以是走线宽度的变化、 网络终端的不匹配、缺少终端、T型连接器 或二分支走线、布线层间的导孔、变化的 负载和逻辑器件、大电源平面不连续、转 换连接器、走线阻抗的变化等。
讲座四 信号完整性分析
4．4．2 阻抗匹配与端接技术
讲座四 信号完整性分析
2．串扰的特性 1)串扰是线间的信号耦合，在串扰存在的信 号线中，干扰源常常也是被干扰对象，而 被干扰对象同时也是干扰源。 2)串扰分为后向串扰和前向串扰两种，传输 线上任意一点的串扰为二者之和。 3)对于传输周期信号的信号线，串扰也是周 期性的。
讲座四 信号完整性分析
针对以上这些串扰的特性，可以归纳出几种减小串扰的主要 方法： 1)加大线间距，减小走线平行长度，必要时可以以jog方式 走线； 2)串扰大小与线间距成反比，与线平行长度成正比； 3)串扰随电路中负载的变化而变化，对于相同的拓扑结构 和布线情况，负载越大，串扰越大； 4)高速信号线在满足条件的情况下，加入端接匹配可以减 小或消除反射，从而减小串扰； 5)对于微带传输线和带状传输线，将走线高度限制在高于 地线平面lOmil以内，可以显著减小串扰；
讲座四 信号完整性分析
４．３信号完整性分析模型
印制电路板设计的S1分析模型
信号完整性分析
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信号完整性分析在高速数字系统中 的应用
信号完整性分析在数字信号处理系 统中的应用
高速数字接口设计
应用场景：高速数字接口设计是信号完整性分析的重要应用场景之一
设计目标：保证信号传输的稳定性和可靠性
设计挑战：高速数字接口设计面临着信号传输速度、信号完整性、信号干扰等问题
建立信号完整 性分析的数学 模型
验证模型的准 确性和可靠性
优化模型，提 高分析结果的 准确性和可靠 性
仿真分析
仿真模型搭建：根 据实际电路搭建仿 真模型
仿真参数设置：设 置仿真参数，如频 率、阻抗等
仿真结果分析：分 析仿真结果，如信 号质量、时延等
仿真优化：根据仿 真结果进行优化， 如调整电路参数、 增加滤波器等
结果解读与优化建议
结果解读：根据分析结果，判断信号的完整性 优化建议：针对分析结果，提出针对性的优化方案 实施方案：根据优化建议，制定实施计划并执行 效果评估：对优化后的信号进行再次分析，评估优化效果
信号完整性分析的 应用场景
高速数字系统设计
信号完整性分析在数字电路设计中 的应用
信号完整性分析在数字通信系统中 的应用
信号完整性分析的 流程
确定分析目标
确定信号完整性分析的目标， 如提高信号传输质量、降低信 号干扰等
确定分析的范围，如系统级、 模块级、芯片级等
确定分析的指标，如信号传输 延迟、信号抖动、信号失真等
确定分析的方法，如仿真分析、 实验验证等
建立模型
确定信号完整 性分析的目标 和需求
收集和分析信 号完整性相关 的数据
添加副标题
信号完整性分析
汇报人：
信号完整性分析基础之八——抖动的频域分析
在上两篇文章中，我们分别介绍了直方图（统计域分析）和抖动追踪（时域分析）在抖动分析中的应用。
从抖动的直方图和抖动追踪波形上我们可以得到抖动的主要构成成分以及抖动参数的变化趋势。
如需对抖动的构成做进一步的分析，还需要从频域角度去进一步分析抖动的跟踪波形。
抖动的频谱即是对抖动追踪（jitter track）波形做FFT运算。
如下图1所示为一个时钟周期测量参数的追踪、频谱分析步骤及效果，在抖动频谱图上可以清楚的看出某两个频率值点抖动比较大：图1 抖动频谱黄色为实际采集到的时钟波形（C1通道）P1测量C1通道时钟信号的时钟周期F7函数对P1测量参数进行跟踪F6对F7进行FFT分析下图2所示为一典型的串行信号抖动追踪频谱图，从图中可看出各种抖动成分；DDj和Pj为窄带频谱（三角形谱或者谱线）但是DDj和Pj的区别是由于DDj是和码型相关的，其频率fDDJ一般会是数据位率的整数倍，如果Pj的频率fPJ正好等于fDDJ，那么从抖动的频谱图里面是很难将DDj和Pj精确的分开的，所以通常在抖动分解的过程中一般通过时域平均的方法来分解DDj；BUj主要由于串扰等因素引起的，一般分为两种，一种是窄带，但幅度较高，很显然这类BUJ也是很难和PJ区分开的，除非我们知道引起BUJ的源头，知道其频率，所以说我们在抖动测试时得到的PJ一般会包含这类BUJ(所以通常情况下对这类BUJ不加区分，直接算做PJ，而将BUJ分类为PJ和OBUJ，在之前的抖动分类文章中有提及)；另外一类是宽带的BUJ（很多时候也叫OBUJ，other bounded uncorrelated jitter），幅度很小，基本会埋没到RJ中去，这类抖动很容易被误算作RJ，目前使用在示波器上的抖动分解软件只有Lecroy最近推出的SDAII（基于NQ-SCALE抖动分解理论）能够较好的将这类抖动从Rj中剥离出来；RJ是宽带频谱，幅度很小。
图2 典型的数据抖动频谱图构成在Lecroy示波器的SDAII抖动分析软件中，是先通过时域平均的方法分离出DDJ.然后在对抖动追踪波形做FFT分析。
信号完整性分析
一所要面临的问题二一些有用的常识三电感电容及电阻的基础以及要注意的问题四传输线的问题以及反射等问题五有损线的损耗六差分信号和查分对的问题一所要面临的问题一单一网络的信号完整性二两个或多个网络间的串扰三电源和地分配中的轨道塌陷四来自整个系统中的电磁干扰和辐射一个重要的概念1：带宽的问题（注释2）对任意一个非理想的方波信号而言（电子系统这种波形非常常见，比如系统的时钟），该信号均可认为是由同频率的基波信号和高次谐波叠加而成。
假设一个1GHz 的时钟它是有1G 的基波加3次谐波再加5次谐波再加7次谐波组成的。
那个这个时钟信号的带宽就是7G.如果加到31次谐波了，那么这个信号的带宽就是31G。
随着叠加的谐波数越多叠加后的信号就越接近完美的方波。
换句话说那就是10%到90%上升时间越小。
可见信号的上升时间决定了信号的带宽。
这样确定系统时钟的上升时间就非常重要了。
为什么上升时间会这么重要呢？下面举例说明：大多数电路板而言会采用FR4板材，FR4板并非理想的无耗板材。
损耗的机理有两种第一导体损耗，第二介质损耗。
比损耗更为严重的是损耗对不同频率信号的损耗是不同，因为在物理上这涉及到介质充放电过程的快慢以及带来的损耗。
对一个4英寸（4000mil）的FR4传输线而言，这样的导线对8GHz的信号损耗达到能量的50%或幅值的70%.试想如果用这样的线去传导一个带宽为9G的1GHz的方波会怎样？结果就是组成这个方波的信号中九次谐波分量被严重损耗，而其他谐波分量也将不同成度的损耗。
这就导致方波的上升沿退化，比如原来上升边是50ps变成了1.5ns。
如果传输的信号频率是10MHz影响不大。
如果传输信号是500M，（2ns的周期）这下麻烦就大了去了。
下面引入带宽和上升时间的关系这是一个近似的经验上的估计：对于10%到90%上升时间来讲关系为：BW=0.35/RT(RT为10%到90%上升时间)也有一些资料给的上升时间是20%-80%上升时间。
第13章 信号完整性分析[31页]
![第13章 信号完整性分析[31页]](https://img.taocdn.com/s3/m/5273941f5acfa1c7aa00cc9b.png)
13.6.4.设置信号完整性分析的规则
1.在PCB编辑环境中，执行【Design】/【Rule】命令，则系统弹出PCB 规则和约束编辑器。 2.选择其中的“Signal Integrity”选项，新建一个信号下降沿过冲（Overshoo t-Falling Edge）的分析规则，具体参数设置对话框如图13-35所示。
13.4.6进行信号完整性分析
1执行【Tools】/【Singnal Integrity…】命令，则系统开始进行初步分析， 打开了信器左下角的
按钮，在弹出的菜单中执行 相关的详细信息，如图所示。
命令，以查看NetR1全部
3.在图13-37中双击“NetR1”行或选中“NetR1”行，再单击>，NetR1添加 到右边的网络栏中，与该网络线连接的元器件的名称添加到右边元件符 栏中。如图所示。
13.4.2信号完成性分析项目的建立
。 1. 完成环形振荡电路项目的建立，如图所示
2. 完成环形振荡电路图原理图绘制，如图所示。
3. 完成环形振荡电路的PCB布线，如图所示。
13.6.3 设定元件的SI模型，加入规则
13.6.3.1电源规则设置的操作
（1）执行菜单命令【Place】/【Directives】/【PCB layoit】，分别在原理 图中相关的电源符号与接地符号上放置两个PCB布局标签，如图所示。
（5） 双击选中的Supply Nets选项，打开电源网络参数值设置对话框， 输入所设定的电压值为5V，如图所示。
（6） 单击
按钮，依次返回，即完成了直流电源网络规则的设置。
按照同样的操作，可以完成接地网络规则的设置，其电压参数值输入为0V。
13.4.3.2激励信号设置的操作
（1）激励信号规则设置与电源规则设置类似，相同的操作步骤有（1）、 （2）和（3），不同的是在第（4）步，在弹出的选择设计规则类型对话 框Signal Integrity类型中，激励信号选择代表电源网络的Signal Stiulus等 选项，如图所示。
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• SI的重要性
随着高频数字电路的不断发展，SI问题变得越 来越引人注目，数字电路的频率越高，出现SI 问题的可能性就越大，对设计工程师来说，他 的挑战也就越大。
SI简介 • SI的内容
信号完整性它包含两方面的内容，一是独立信 号的质量，另一个是时序。我们在电子设计的 过程中不得不考虑两个问题：信号有没有按时 到达目的地？信号达到目的地后它的质量如何？ 所以我们做信号完整性分析的目的就是确认高 频数字传输的可靠性。
负占空比的定义及测试方法
负占空比是指信号的低电平保持时间占真个周期时间的比例
高电平保持时间的定义及测试方法
高电平保持时间是指信号从低到高跳变完成后信号持续的时间
低电平保持时间的定义及测试方法
低电平保持时间是指信号从高到低跳变完成后信号持续的时间
周期的定义及测试方法
周期是指有固定周期信号连续完成逻辑0和逻辑1跳变所需时间
SI简介 • 理想逻辑电压波形
在数字系统中，信号以逻辑‘0’或者‘1’的方 式从一个器件传输到另外一个器件，信号到底是 ‘0’还是‘1’一般来说它们都是有一个参考电 平的。在接收端的输入门里面，如果信号的电压 超过高电平参考电压Vih，则该信号被识别为高逻 辑；如果信号的电压低于低电平的参考电压Vil， 则该信号就被识别为低逻辑。我们下面这个图就 是一个理想的信号。
信号产生基本原理
晶振符号和等效电路
信号产生基本原理
谐振频率
从石英晶体谐振器的等效电路可知，它有两个谐振频率， 即（1）当L、C、R支路发生串联谐振时，它的等效阻抗 最小（等于R）。串联揩振频率用fs表示，石英晶体对于 串联揩振频率fs呈纯阻性，（2）当频率高于fs时L、C、R 支路呈感性，可与电容C。发生并联谐振，其并联频用fd 表示。根据石英晶体的等效电路，可定性画出它的抗— 频率特性曲线如上图所示。可见当频率低于串联谐振频 率fs或者频率高于并联揩振频率fd时，石英晶体呈容性。 仅在fs＜f＜fd极窄的范围内，石英晶体呈感性。
正过冲的定义及测试方法
正过冲是指高电平处的过冲值，单位为V或mV或者用百分 比表
负过冲的定义及测试方法
负过冲是指低电平处的过冲值，单位为V或mV或者用百分比表
正欠冲的定义及测试方法
正欠冲是指高电平处的欠冲值，单位为V或mV或者用百分比表
负欠冲的定义及测试方法
负欠冲是指低电平处的欠冲值，单位为V或mV或者用百分比表
信号产生基本原理
时钟芯片的架构
信号产生基本原理
PLL基本原理
信号产生基本原理
PLL频率合成器
PLL频率合成器是由程序分频器、鉴相器及压 控振荡器三大部分组成, 从晶振束的100KHz 标准信号经100 分频后得1KHz的基准频率fR, 压控振荡频率f1通过程序分频得到频率fM,fM 和fR同时加到鉴相器进行比较。只有当fR和fM 完全同频同相时,环路平衡被锁定,即fR=fM。可 见, 当环路锁定时,压控振荡器的输出频率完全 决定于程序分频器的分频比,即f1= M·fR ,只要 改变分频比M,便可使f1改变,从而得到所需的各 个频率点
SI简介 • 理想逻辑电压波形
SI简介
•
接收端的实际波形
SI简介
• 数据采样及时序例子 数据越是复杂，里面就包含很多的二进制码，这些 二进制码将组成一连串的波形，而不是简单的一个 方波。接收端的器件就需要采样这些波形以便获取 相关的二进制信息。数字采样的过程通常是通过时 钟信号的上升沿或者下降沿来触发的，我们下面这 个图就是个简单的例子。
频率的定义及测试方法
频率是指周期信号在一秒内完成周期跳变的次数；
延迟的定义及测试方法
延迟是指两个相关信号之间的相位差；
眼图参数的定义及测试方法
• 时间参数包括：眼图高电平值，眼图低
电平值，眼图最大值，眼图最小值，眼 图交叉点位置等。
眼图高电平值的定义及测试方法
眼图高电平值是指眼图高电平累积部分最低点的值；
振幅的定义及测试方法
振幅是指被测波形的振动幅度，即高电平与低电平的差值， 其单位为V或者mV；
高电平的定义及测试方法
• 高电平是指信号逻辑“1”所在位置的幅度，其单位通常为V和 mV。
低电平的定义及测试方法
低电平是指信号逻辑“0”所在位置的幅度，其单位通常为V和 mV。
均方根值的定义及测试方法
最小值是指所捕获波形里面振幅最小点所处位置的电压值， 单位为V或者mV；
峰峰值的定义及测试方法
峰峰值是指最大值和最小值相减的绝对值，单位为V或mV；
平均值的定义及测试方法
平均值是指所捕获波形里面所有点幅度的平均值
周期平均值的定义及测试方法
周期平均值是指所捕获波形里面所指定一个周期里所有点幅度 的平均值
时间参数的定义及测试方法
• 时间参数包括：上升时间，下降时间，正 占空比，负占空比，高电平宽度，低电平宽 度，周期，频率，延迟
上升时间的定义及测试方法
上升时间是指信号从逻辑‘0’跳变到逻辑‘1’时所花费的时间； • 低频信号的上升时间测量
上升时间的定义及测试方法
上升时间是指信号从逻辑‘0’跳变到逻辑‘1’时所花费的时间； 高频信号的上升时间测量
衡量信号品质的参数
信号质量的参数:振幅参数，时间参数，眼图参数 等。振幅参数包括：振幅，高电平，低电平，均 方根值，单个周期的均方根值，最大值，最小值， 峰峰值，平均值，单个周期平均值，正过冲，负 过冲，正欠冲，负欠冲等； 时间参数包括：上升时间，下降时间，正占空比， 负占空比，高电平宽度，低电平宽度，周期，频 率，延迟等； 眼图参数包括：眼高，眼宽，眼图最高点，眼最 低点，交叉点等；
衡量时序的参数
• 衡量时序的参数主要有四个：建立时间，保持 时间，传输延迟，相位偏移。数据是否按时到达 逻辑器件就跟时序里面的相位偏移和传输延迟有 关系，当数据波形的质量有问题时通常会直接影 响到信号的建立时间或者保持时间。因此任何模 块的通信信号都必须在保证信号质量的基础上再 保证时序的恰倒好处。
下降时间的定义及测试方法
下降时间是指信号从逻辑‘1’跳变到逻辑‘0’时所花费的时间； 低频信号的下降时间测量
下降时间的定义及测试方法
下降时间是指信号从逻辑‘1’跳变到逻辑‘0’时所花费的时间； 高频信号的下降时间测量
正占空比的定义及测试方法
正占空比是指信号的高电平保持时间占真个周期时间的比例；
均方根值是指整个捕获波形上所有点幅度的均方根 值，其单位为V或者mv；
周期均方根值的定义及测试方法
周期均方根值是指整个捕获波形上指定一个周期内所有点幅度 的均方根值，其单位为V或者mV；
最大值的定义及测试方法
最大值是指所捕获波形里面振幅最大点所处位置的电压值， 单位为V或者mV；
最小值的定义及测试方法
眼图低电平值的定义及测试方法
• 眼图低电平值是指眼图低电平累积部分最高点的值；
眼图最大值的定义及测试方法
眼图最大值是指眼图高电平处最高电平所在位置的值
眼图最小值的定义及测试方法
眼图最小值是指眼图低电平处最低电平所在电压值；
眼图交叉点的定义及测试方法
眼图交叉点是指眼图中的差分信号的上升沿和下降沿的交叉点
信号产生基本原理
信号波形
信号产生基本原理
方波的组成
信号产生基本原理 石英振荡器结构
晶振原理
信号产生基本原理
压电效应
若在石英晶体的两个电极上加一电场，晶片就会产生机 械变形。反之，若在晶片的两侧施加机械压力，则 在晶片相应的方向上将产生电场，这种物理现象称为 压电效应。如果在晶片的两极上加交变电压，晶片就 会产生机械振动，同时晶片的机械振动又会产生交变 电场。在一般情况下，晶片机械振动的振幅和交变电 场的振幅非常微小，但当外加交变电压的频率为某一 特定值时，振幅明显加大，比其他频率下的振幅大得 多，这种现象称为压电谐振，它与LC回路的谐振现象 十分相似。它的谐振频率与晶片的切割方式、几何形 状、尺寸等有关。
建立时间的定义和测量方法
建立时间是指数据在被采样时钟采样前已经建立起来的时间。
保持时间的Leabharlann 义和测量方法保持时间是指数据在被采样时钟采样后还要继续保持的时间
传输延迟的定义和测量方法
传输延迟是指信号从源端出来传输到接收端的过程中在传输线上 所花费的时间；
相位偏移的定义和测量方法
相位偏移是指同步信号之间的实际相位差异
SI 简介 • 数据采样及时序例子
SI简介 • 数据采样及时序例子
从这个图里面我们可以清楚地看到数据必须准 时到达逻辑门而且在接收端期间开始锁存前必 须确定它们的逻辑状态。任何数据的延迟或者 失真都会导致数据传输的失败。失败有两种可 能：一个是因为接收端根本就无法识别数据； 另一个是接收端虽然识别了数据，但数据因 为失真而导致错误。
信号完整性基础知识
测试部教育训练材料
目录 ： SI简介 信号产生基本原理 ������������ 信号质量测试方法 ������������ 信号时序测试方法
SI简介
SI 的基本概念：
SI（signal integrity )即信号完整性，就是指电 路系统中信号的质量，如果在要求的时间内， 信号能不失真地从源端传送到接收端，我们就 称该信号是完整的。